DE4138057A1 - Halbleitereinrichtung und verfahren zu deren herstellung - Google Patents

Halbleitereinrichtung und verfahren zu deren herstellung

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Description

Die vorliegende Erfindung bezieht sich auf Halbleitereinrich­ tungen und im besonderen auf eine Halbleitereinrichtung mit einem durch Ionenimplantation unter Nutzung einer Gateelektrode als Maske gebildeten Störstellengebiet sowie ein Verfahren zur Herstellung derselben.
Der MOS-Transistor ist als Typ einer Halbleitereinrichtung bekannt. Fig. 7 ist eine Querschnittsdarstellung eines her­ kömmlichen p-Kanal-MOS-Transistors, der eine Gateelektrode aufweist. Wie Fig. 7 zeigt, weist ein p-Kanal-MOS-Transistor ein n-Siliziumsubstrat 11, mit einem vorbestimmten Abstand voneinander auf dem n-Siliziumsubstrat 11 gebildete Elementiso­ lations-Oxidschichten 12, mit einem vorbestimmten Abstand von­ einander zwischen den Elementisolations-Oxidschichten 12 gebildete p⁺-Störstellengebiete 15 und eine zwischen den p⁺-Störstellengebieten 15 angeordnete, eine Gateelektrode bil­ dende polykristalline Siliziumschicht 14 mit einer Gateoxid­ schicht 13 darunter auf. Bei einem herkömmlichen p-Kanal-MOS- Transistor ist die Gateelektrode durch eine polykristalline Siliziumschicht 14 gebildet.
Fig. 8 ist eine vergrößerte Querschnittsdarstellung der Gate­ elektrode nach Fig. 7 zur Erklärung der Kristallstruktur. Wie Fig. 8 zeigt, weisen die Kristallorientierungen der Kristall­ körner einer eine herkömmliche Gateelektrode bildenden poly­ kristallinen Siliziumschicht 14 eine Mehrzahl von Ebenenorien­ tierungen auf. Das heißt, die polykristalline Siliziumschicht 14 enthält Kristallkörner der (110) -Ebenen-Orientierung und Kristallkörner der (111)-Ebenen-Orientierung beim Beispiel der Fig. 8. Die polykristalline Siliziumschicht 14 ist mit Phosphor dotiert.
Die Fig. 9A bis 9D sind Querschnittsdarstellungen eines her­ kömmlichen p-Kanal-MOS-Transistors zur Erklärung des Verfahrens zu dessen Herstellung. Wie Fig. 9A zeigt, werden Elementisola­ tions-Oxidschichten 12 auf einem n-Siliziumsubstrat 11 mit einem vorbestimmten Abstand voneinander zur Elementisolation gebildet. Eine Gateoxidschicht 13 wird auf dem n-Silizium­ substrat 11 und den Elementisolations-Oxidschichten 12 gebildet. Wie Fig. 9B zeigt, wird auf der Gateoxidschicht 13 eine polykristalline Siliziumschicht 14 mit Phospor-Dotierung gebildet. Die polykristalline Siliziumschicht 14 dient als Gateelektrode. Diese polykristalline Siliziumschicht 14 ist - wie oben beschrieben - aus Kristallkörnern mit unterschied­ lichen Ebenen-Orientierungen gebildet. Wie Fig. 9C zeigt, werden die Gateoxidschichten 13 und die polykristalline Siliziumschicht 14 durch Ätzen unter Nutzung eines (nicht gezeigten) Resistmusters gemustert (strukturiert). Auf diese Weise wird eine Gateelektrode entsprechend dem Beispiel erhalten. Wie Fig. 9D zeigt, werden unter Nutzung der poly­ kristallinen Siliziumschicht 14 als Maske B⁺-Ionen 16 implan­ tiert, um p⁺-Störstellengebiete 16 zu bilden. Mittels dieses Herstellungsverfahrens wird ein herkömmlicher p-Kanal-MOS- Transistor gebildet. Die polykristalline Siliziumschicht 14 ist möglicherweise aus Kristallkörnern mit den beiden Kristall­ orientierungen (110) und (111) gebildet, wie oben beschrieben.
Bei einem herkömmlichen p-Kanal-MOS-Transistor werden die p⁺- Störstellengebiete 15 auf selbstausrichtende Weise durch Implantation von B⁺-Ionen unter Nutzung der polykristallinen Siliziumschicht 14, die eine Gateelektrode wird, als Maske ge­ bildet.
Da die oben beschriebene polykristalline Siliziumschicht 14 aus Kristallkörnern mit unterschiedlicher Kristallorientierung ge­ bildet ist, gibt es das Problem, daß B⁺-Ionen durch die poly­ kristalline Siliziumschicht 14 hindurchgehen, wenn die Kristallorientierung identisch mit der Implantationsrichtung der Ionen ist. Dieses Problem wird als das Kanalbildungs- Phänomen bezeichnet. Die Implantation von B⁺-Ionen in den Bereich direkt unterhalb der Gateelektrode infolge des Kanalbildungs-Phänomens führt zu Problemen, die im folgenden erklärt werden. Das Kanalgebiet zwischen den p⁺-Störstellen­ gebieten 15, die als Source beziehungsweise Drain dienen, wird leicht leitend (es entsteht ein "Kanalleck"), was einem ordnungsgemäßen Betrieb hinderlich ist. Die Entstehung eines "Kanallecks" führt zu dem Problem, daß der Leckstrom und die Wahrscheinlichkeit eines fehlerbehafteten Betriebes der gesamten Halbleitereinrichtung erhöht werden. Weiterhin gibt es bezüglich der Transistorkennlinien (-charakteristiken) des p- Kanal-MOS-Transistors das Problem, daß die Schwellspannung ansteigt.
Bei einem herkömmlichen p-Kanal-MOS-Transistor gibt es also in dem Falle, daß ein Störstellengebiet auf selbstausrichtende Weise durch Ionenimplantation unter Nutzung der Gateelektrode als Maske gebildet wird, Probleme bezüglich der effektiven Verhinderung von Betriebsfehlern und einer Verschlechterung der Transistorcharakteristiken.
Es ist Aufgabe der vorliegenden Erfindung, eine Einrichtung bereitzustellen, bei der ein Störstellengebiet auf selbstaus­ richtende Weise durch Ionenimplantation unter Nutzung einer Gateelektrode als Maske gebildet und eine Verschlechterung der Transistorcharakteristiken verhindert ist. Insbesondere ist dabei zu verhindern, daß "Kanallecks" (leitende Zustände) ent­ stehen.
Um dies zu erreichen, ist die Erfindung darauf gerichtet, effektiv das Kanalbildungs-Phänomen, demzufolge bei der Bildung eines Störstellengebietes auf selbstausrichtende Weise durch Ionenimplantation unter Nutzung einer Gateelektrode als Maske beim Verfahren zur Herstellung einer Halbleitereinrichtung Ionen in das Kanalgebiet direkt unterhalb der Gateelektrode eindringen, zu verhindern, ohne daß dadurch der Herstellungs­ prozeß verkompliziert wird.
Entsprechend einem Aspekt der Erfindung weist eine Halbleiter­ einrichtung ein Substrat eines ersten Leitungstyps, ein Paar von Störstellengebieten eines zweiten Leitungstyps und eine Gateelektrode aus einer polykristallinen Schicht, bei der Kri­ stallorientierungen der Kristallkörner in einer vorbestimmten Richtung ausgerichtet sind, auf. Das Paar von Störstellengebie­ ten ist im Halbleitersubstrat des ersten Leitungstyps mit einem vorbestimmten Abstand voneinander gebildet. Die Gateelektrode ist mit einer Isolatorschicht darunter zwischen dem Paar von Störstellengebieten auf dem Halbleitersubstrat gebildet.
Die Gateelektrode ist auf dem Halbleitersubstrat zwischen dem Paar von Störstellengebieten mit einer Isolierschicht darunter gebildet. Die Gateelektrode ist aus einer polykristallinen Schicht gebildet, bei der die Kristallorientierungen der Kristallkörner in einer vorbestimmten Richtung ausgerichtet sind. Durch Implantation von Ionen unter einem vorbestimmten Winkel bezüglich der Kristallorientierung der polykristallinen Schicht wird das Kanalbildungs-Phänomen, bei dem Ionen stellenweise durch die Gateelektrode hindurchgehen und in den Bereich direkt unterhalb der Gateelektrode implantiert werden, wirksam abgestellt.
Nach einem weiteren Aspekt der Erfindung weist ein Verfahren zur Herstellung einer Halbleitereinrichtung den Schritt des Bildens einer polykristallinen Schicht auf einem Halbleiter­ substrat derart, daß die Kristallorientierungen der Kristall­ körner in einer vorbestimmten Richtung ausgerichtet sind, auf. Dann wird die polykristalline Schicht gemustert (strukturiert). Unter Nutzung der gemusterten polykristallinen Schicht als Maske wird im Halbleitersubstrat durch Implantation von Ionen unter einem vorbestimmten Winkel bezüglich der Kristall­ orientierung der polykristallinen Schicht ein Störstellengebiet gebildet.
Die polykristalline Schicht wird auf dem Halbleitersubstrat so gebildet, daß die Kristallorientierungen der Kristallkörner in eine vorbestimmte Richtung ausgerichtet sind. Unter Nutzung der gemusterten polykristallinen Schicht als Maske wird durch Implantation von Ionen unter einem vorbestimmten Winkel bezüglich der Kristallorientierung der polykristallinen Schicht im Halbleitersubstrat ein Störstellengebiet gebildet. Dies verhindert effektiv das Auftreten des Kanalbildungs-Phänomens, bei dem während der Ionenimplantation Ionen stellenweise durch die Gateelektrode hindurchtreten und in den Bereich direkt unterhalb der Gateelektrode implantiert werden. Eine polykristalline Siliziumschicht mit in einer vorbestimmten Richtung angeordneten Kristallorientierungen kann mit der üblichen Anzahl von Prozeßschritten gebildet werden.
Entsprechend einem weiteren Aspekt der Erfindung weist ein Verfahren zur Herstellung einer polykristallinen Silizium­ schicht die Schritte des Bildens einer polykristallinen Siliziumschicht auf einem darunterliegendem Substrat mit einer einer definierten Orientierung folgenden Ausrichtung der Kristallkörner durch chemische Gasphasenabscheidung (CVD) unter Nutzung eines Gases vom Silantyp als Reaktionsgas unter den weiteren Bedingungen eines Drucks von 0,1-1,0 Torr und einer Temperatur von 550°-620°C auf.
Eine polykristalline Siliziumschicht wird auf dem darunter­ liegenden Substrat derart gebildet, daß die Kristallorien­ tierungen der Kristallkörner in einer definierten Richtung ausgerichtet sind, durch chemische Gasphasenabscheidung unter Nutzung eines Gases vom Silantyp als Reaktionsgas unter den weiteren Bedingungen eines Drucks von 0,1-1,0 Torr und einer Temperatur von 550-620°C. Damit wird leicht eine polykri­ stalline Siliziumschicht mit einer definierten Richtung folgenden Kristallorientierungen ohne komplizierte Herstel­ lungsschritte gebildet.
Weitere Merkmale und Zweckmäßigkeiten der Erfindung ergeben sich aus der Erläuterung von Ausführungsbeispielen anhand der Figuren.
Von den Figuren zeigen:
Fig. 1 eine Querschnittsdarstellung eines p-Kanal-MOS- Transistors mit einer Gateelektrode entsprechend einer Ausführungsform,
Fig. 2 eine vergrößerte Querschnittsdarstellung der Gateelektrode nach Fig. 1 zur Erklärung der Kristallstruktur,
Fig. 3A-3D Querschnittsdarstellungen des p-Kanal-MOS- Transistors nach Fig. 1 zur Erklärung des Verfahrens zu seiner Herstellung,
Fig. 4A-4D graphische Darstellungen, die das Röntgen- Beugungsspektrum in Abhängigkeit von der Kristallorientierung einer polykristallinen Siliziumschicht bei unterschiedlicher Temperatur während des Schritts des Bildens der polykristallinen Siliziumschicht durch Niederdruck- CVD zeigen,
Fig. 5 eine graphische Darstellung, die die Beziehung zwischen dem Ionenimplantationswinkel und der Ionenimplantationstiefe mit Bezug auf die Orientierung der kristallographischen Achse der Kristallkörner, wobei die Ebenen-Orientierung (110) ist, zeigt,
Fig. 6 eine Querschnittsdarstellung eines p-Kanal-MOS- Transistors mit einer Gateelektrode entsprechend einer anderen Ausführungsform,
Fig. 7 eine Querschnittsdarstellung eines herkömmlichen p- Kanal-MOS-Transistors mit einer Gateelektrode,
Fig. 8 eine vergrößerte Querschnittsdarstellung der Gateelektrode nach Fig. 7 zur Erklärung der Kristallstruktur und
Fig. 9A-9D Querschnittsdarstellungen eines herkömmlichen p- Kanal-MOS-Transistors zur Erklärung des Verfahrens zu seiner Herstellung.
Wie Fig. 1 zeigt, weist ein p-Kanal-MOS-Transistor nach der ersten Ausführungsform ein n-Siliziumsubstrat 1, Element­ isolationsoxidschichten 2 auf dem n-Siliziumsubstrat 1 mit einem vorbestimmten Abstand voneinander zur Elementisolation, ein Paar von p⁺-Störstellengebieten 5 mit einem vorbestimmten Abstand voneinander zwischen den Elementisolations-Oxidschich­ ten 2 und eine polykristalline Siliziumschicht 4 mit einer Gateoxidschicht 3 darunter zwischen dem Paar von p⁺-Störstel­ lengebieten 5 auf. Die polykristalline Siliziumschicht 4 unter­ scheidet sich von einer herkömmlichen darin, daß die Kristall­ orientierungen in eine definierte Richtung ausgerichtet sind.
Wie Fig. 2 zeigt, weist die eine Gateelektrode bildende polykristalline Siliziumschicht 4 Kristallkörner auf, deren Kristallorientierungen in die (110)-Ebenenrichtung ausgerichtet sind. Die Ausführungsform, bei der die polykristalline Siliziumschicht 4 mit den in eine bestimmte Richtung ausgerichteten Kristallorientierungen als Gateelektrode dient, kann dem beim Stand der Technik üblichen Problem des Kanalbildungs-Phänomens effektiv entgegen wirken. Die Kristallorientierungen bei der polykristallinen Siliziumschicht 4 nach der Ausführungsform sind in der (110)-Ebenenrichtung angeordnet. Durch Einstellen der Richtung der Ionenimplantation mit einer Neigung gegenüber der kristallographischen Achsenrichtung der polykristallinen Siliziumschicht 4 unter einem bestimmten Winkel wird die Neigung der Ionenimplanta­ tionsrichtung bezüglich der kristallographischen Achse bei der Bildung des p⁺-Störstellengebietes 5, wie im weiteren beschrieben, für die gesamte polykristalline Siliziumschicht 4 gleich. Wenn die Orientierung der Kristallkörner in eine definierte Richtung ausgerichtet ist und die Ionen unter einem Winkel bezüglich der Kristallorientierung implantiert werden, bei dem es schwer ist, daß Ionen in das Kanalgebiet implantiert werden, kann das Kanalbildungs-Phänomen leicht unterdrückt werden. Dementsprechend kann auch eine Kanalbildung zwischen den p⁺-Störstellengebieten (ein leitender Zustand) effektiv verhindert werden. Damit kann auch die Verschlechterung von Transistoreigenschaften, wie etwa das Ansteigen der Schwell­ spannung, effektiv verhindert werden.
Im folgenden wird unter Bezugnahme auf die Fig. 3A-3D das Herstellungsverfahren erklärt. Elementisolations-Oxidschichten 2 werden auf einem n-Siliziumsubstrat 1 mit einem vorbestimmten Abstand voneinander zur Elementisolation gebildet. Eine Gateoxidschicht 3 wird auf dem n-Siliziumsubstrat 1 und der Elementisolations-Oxidschicht 2 gebildet. Wie Fig. 3B zeigt, wird über der Gateoxidschicht 3 durch ein Niederdruck-CVD- Verfahren eine mit Phosphor dotierte polykristalline Silizium­ schicht 4 mit in eine bestimmte Richtung ausgerichtete Kristallorientierungen gebildet. Die Art der Ausrichtung der Kristallorientierungen in der polykristallinen Siliziumschicht 4 wird weiter unten erklärt. Wie Fig. 3C zeigt, werden die polykristalline Siliziumschicht 4 und die Gateoxidschicht 3 durch Plasmaätzen unter Nutzung eines (nicht gezeigten) Resistmusters strukturiert. Damit wird eine Gateelektrode mit einer Struktur entsprechend der Ausführungsform erhalten. Wie Fig. 3D zeigt, werden p⁺-Störstellengebiete 5 auf selbstaus­ richtende Weise durch Implantation von B⁺-Ionen unter Nutzung der polykristallinen Siliziumschicht 4, die eine Gateelektrode werden soll, als Maske gebildet. Die Richtung der Implantation der B⁺-Ionen bildet mit der kristallographischen Orientierung der polykristallinen Siliziumschicht 4 einen vorbestimmten Winkel, bei dem das Kanalbildungs-Phänomen im wesentlichen unterdrückt wird.
Es ist erforderlich, die Bildung der Schicht durch ein Nieder­ druck-CVD-Verfahren unter Einhaltung der nachfolgenden Bedingungen auszuführen, damit die Kristallorientierungen der polykristallinen Siliziumschicht 4 in der (110)-Ebenenrichtung ausgerichtet werden. Vorzugsweise werden 100%-iges Silan oder 20-30% Silan in Stickstoff als Reaktionsgas unter einem Druck von 0,1-1,0 Torr und einer Temperatur von 550-620°C verwendet. Noch günstiger ist es, wenn der Druck 0,17 Torr und die Temperatur 620°C beträgt und 100%-iges Silan als Reaktionsgas verwendet wird. Die Temperaturbedingung ergibt sich aus den folgenden experimentellen Ergebnissen. In den graphischen Darstellungen der Fig. 4A-4D gibt die Abszisse den Beugungswinkel und die Ordinate die Röntgenbeugungs­ intensität an. Aus Fig. 4A ist zu ersehen, daß die Kristall­ orientierung der polykristallinen Siliziumschicht zwei Typen von Kristallkörnern einschließt, deren Ebenenrichtungen (110) und (111) sind, wenn die polykristalline Siliziumschicht bei einer CVD-Temperatur von 660°C gebildet wird. In der graphischen Darstellung repräsentiert das Peak der Ebenen- Orientierung (100) die Kristallorientierung des n-Silizium­ substrates. Wenn die CVD-Temperatur 660°C beträgt, ist es schwierig, die Kristallorientierungen in eine bestimmte Richtung auszurichten, da die Kristallkörner der gebildeten polykristallinen Siliziumschicht die beiden Ebenenorien­ tierungen (110) und (111) aufweisen.
Fig. 4B zeigt den Fall, daß die polykristalline Silizium­ schicht 4 bei einer CVD-Temperatur von 640°C gebildet wird. Aus der graphischen Darstellung ist zu ersehen, daß das Peak der (111)-Ebenen-Orientierung - obgleich niedriger - noch vorhanden ist. Es ist damit schwierig die Kristallorientierungen der Körner innerhalb der polykristallinen Siliziumschicht 4 bei dieser Temperatur in eine bestimmte Richtung auszurichten.
Fig. 4C zeigt den Fall, daß die polykristalline Silizium­ schicht 4 bei einer CVD-Temperatur von 620°C gebildet wird. Aus der graphischen Darstellung ist zu ersehen, daß das peak der (111)-Ebenen-Orientierung im wesentlichen verschwunden und nur noch das peak der (110)-Orientierung signifikant ist. Dies bedeutet, daß die Kristallorientierungen der Kristallkörner der polykristallinen Siliziumschicht 4 durch Bildung der poly­ kristallinen Siliziumschicht bei einer Temperatur von 620°C in die (110)-Orientierung ausgerichtet werden können. Die anderen Verfahrensbedingungen sind Einsatz von 100%-igem Silan oder 20-30% Silan in Stickstoff als Reaktionsgas und ein Druck von 0,1-1,0 Torr, wie oben bereits erwähnt.
Aus dem Experiment, bei dem die CVD-Temperatur (Atmosphären­ temperatur) schrittweise abgesenkt wurde, ist zu entnehmen, daß die Kristallorientierungen der polykristallinen Siliziumschicht 4 entlang der (110)-Richtung angeordnet werden, wenn die Temperatur auf 620°C verringert wird. Es ist anzunehmen, daß ein ähnlicher Effekt erreicht werden kann, wenn die Temperatur niedriger als 620°C ist.
Fig. 4D zeigt den Fall, daß die polykristalline Silizium­ schicht 4 bei einer CVD-Temperatur von 540°C gebildet wird. Die Körner der polykristallinen Siliziumschicht 4 sind amorph, und das Peak der Kristallorientierung ist nicht mehr zu sehen. Das heißt, es gibt kein Peak für die Kristallorientierung der polykristallinen Siliziumschicht 4 mehr, denn die Ebenen- Orientierung (100) ist die Kristallorientierung des n- Siliziumsubstrates 1. Es ist damit schwierig, die Kristall­ orientierung der polykristallinen Siliziumschicht in eine definierte Richtung einzustellen, wenn die CVD-Temperatur niedriger als 540°C ist. Es ist daher wünschenswert, die Bildung bei einer CVD-Temperatur von über 550°C vorzunehmen.
Aus dem Ergebnis des Experiments ist zu erkennen, daß die Bildung innerhalb des Temperaturbereiches von 550°C-620°C durch ein Niederdruck-CVD-Verfahren erfolgen muß, um die Kristallorientierung der polykristallinen Siliziumschicht 4 in eine definierte Richtung einzustellen. Der Implantationswinkel (die Implantationsrichtung) der B⁺-Ionen wird im folgenden anhand des Schrittes der Bildung der p⁺-Störstellengebiete 5 unter Bezug auf Fig. 3D erklärt. Die Darstellung der Fig. 5 wird in Kapitel 5, 5.3, Fig. 5.8 in MOS LSI Manufacturing Technology, Nikkei Mc Graw-Hill gezeigt. Die Abszisse der graphischen Darstellung stellt die Tiefe von der Oberfläche und die Ordinate die Ionenzahl dar. Diese Darstellung zeigt das Er­ gebnis eines Experiments der Durchführung einer Ionenimplanta­ tion unter einem Implantationswinkel im Bereich von 0-8° be­ züglich der Orientierung der kristallographischen Achse. Aus Fig. 5 ist zu entnehmen, daß die Ionenimplantationstiefe den kleinsten Wert annimmt, wenn unter einem Winkel von 8° bezüg­ lich der Orientierung der kristallographischen Achse von <110< implantiert wird. Dies bedeutet, daß eine Kanalbildung am wenigsten wahrscheinlich ist, wenn die Ionen unter einem Winkel von 8° bezüglich der Orientierung der kristallographischen Achse <110< implantiert werden. Es ist daher wünschenswert, die Ionen unter einem Winkel von 8° bezüglich der Orientierung der kristallographischen Achse der polykristallinen Siliziumschicht im Implantationsschritt der Fig. 3D zu implantieren.
Fig. 6 ist eine Querschnittsdarstellung eines p-Kanal-MOS- Transistors mit einer Gateelektrode nach einer weiteren Ausfüh­ rungsform.
Wie Fig. 6 zeigt, ist bei dieser Ausführungsform die Gateelek­ trode als Zweischicht-Struktur aus einer polykristallinen Sili­ ziumschicht 4a und einer polykristallinen Siliziumschicht 4b gebildet. Die polykristalline Siliziumschicht 4a ist aus poly­ kristallinen Körnern mit einer Mehrzahl von Orientierungen ge­ bildet, ähnlich wie die herkömmliche polykristalline Silizium­ schicht 14 nach Fig. 7. Bei der polykristallinen Silizium­ schicht 4b sind die Kristallorientierungen der Kristallkörner in einer definierten Richtung ausgerichtet. Ein Effekt ähnlich zu dem der Ausführungsform nach Fig. 1 kann durch Ausbildung der Gateelektrode als Zweischicht-Struktur aus polykristalli­ nen Schichten 4a und 4b, wobei die Kristallorientierungen in einer der polykristallinen Siliziumschichten in eine bestimmte Richtung ausgerichtet sind, erreicht werden.
Obgleich die beschriebene Ausführungsform eine Anwendung auf einen p-Kanal-MOS-Transistor darstellt, ist die Erfindung da­ rauf nicht begrenzt, und ähnliche Effekte können bei einem n-Kanal-MOS-Transistor erzielt werden. Desweiteren ist die Er­ findung nicht auf die Ausführungsform, bei der die Ebenen- Orientierung der Kristallkörner der polykristallinen Silizium­ schicht 4 die (110)-Richtung ist, begrenzt, sondern die Kri­ stallkörner können auch in einer (111)-Ebenen-Richtung ausge­ richtet sein. Genauer gesagt, ist es möglich, eine polykristal­ line Siliziumschicht mit (111) -Ebenen-Orientierung durch ge­ eignete Steuerung der CVD-Temperatur zu bilden.
Entsprechend einem Aspekt der Erfindung wird eine Halbleiter­ einrichtung mit einer Gateelektrode vorgesehen, die eine poly­ kristalline Schicht, bei der die Kristallorientierungen der Kristallkörner in einer definierten Richtung ausgerichtet sind, aufweist. Dies hindert Ionen effektiv daran, stellenweise durch die Gateelektrode durchzutreten und in den Bereich direkt unterhalb implantiert zu werden, wenn die Ionen unter einem vorbestimmten Winkel bezüglich der Orientierung der polykri­ stallinen Siliziumschicht implantiert werden. Im Ergebnis dessen kann die Erzeugung von Betriebsfehlern und eine Verschlechterung der Transistorkennlinien (-charakteristiken) bei der Bildung eines Störstellengebietes auf selbstausrich­ tende Weise durch Ionenimplantation unter Nutzung einer Gate­ elektrode als Maske effektiv verhindert werden.
Nach einem weiteren Aspekt der Erfindung wird ein Verfahren zur Herstellung einer Halbleitereinrichtung vorgeschlagen, das einen Schritt der Bildung einer polykristallinen Schicht auf einem Halbleitersubstrat derart aufweist, daß die Kristall­ orientierungen der Kristallkörner in eine bestimmte Richtung ausgerichtet werden. Dann wird die polykristalline Schicht gemustert. Unter Nutzung der gemusterten polykristallinen Schicht als Maske wird durch Implantation von Ionen unter einem vorbestimmten Winkel bezüglich der Kristallorientierung der polykristallinen Schicht im Halbleitersubstrat ein Störstellen­ gebiet gebildet. Dies unterdrückt effektiv das Kanalbildungs- Phänomen, bei dem Ionen stellenweise durch die Gateelektrode hindurchtreten und in den Bereich direkt unterhalb der Gate­ elektrode implantiert werden, wenn eine Ionenimplantation aus­ geführt wird. Im Ergebnis dessen kann effektiv die Erzeugung von Betriebsfehlern und eine Verschlechterung der Transistor­ charakteristiken verhindert werden, wenn Störstellengebiete auf selbstausrichtende Weise durch Ionenimplantation unter Nutzung einer Gateelektrode als Maske gebildet werden. Der Herstellungs­ prozeß wird nicht verkompliziert, da eine polykristalline Si­ liziumschicht mit in eine bestimmte Richtung ausgerichteten Kristallorientierungen mit der gleichen Anzahl von Herstel­ lungsschritten gebildet wird, wie im herkömmlichen Falle.
Nach einem weiteren Aspekt der Erfindung wird ein Verfahren zur Herstellung einer polykristallinen Siliziumschicht vorgeschla­ gen, das einen Schritt des Bildens einer polykristallinen Siliziumschicht auf einem darunterliegenden Substrat durch chemische Gasphasenabscheidung unter Nutzung eines Gases vom Silantyp als Reaktionsgas unter den weiteren Bedingungen eines Druckes von 0,1-1,0 Torr und einer Temperatur von 550°-620°C aufweist, so daß die Kristallorientierungen der Kristallkörner in eine bestimmte Richtung ausgerichtet werden.

Claims (14)

1. Halbleitereinrichtung mit
einem Halbleitersubstrat (1) eines ersten Leitungstyps,
einem Paar von Störstellengebieten (5) eines zweiten Lei­ tungstyps, die mit einem vorbestimmten Abstand voneinan­ der im Halbleitersubstrat (1) des ersten Leitungstyps ge­ bildet sind, und
einer Gateelektrode mit einer polykristallinen Schicht (4), die auf dem Halbleitersubstrat (1) zwischen dem Paar von Störstellengebieten (5) mit einer Isolatorschicht (3) da­ runter gebildet ist, und bei der die Kristallorientierungen der Kristallkörner in eine bestimmte Richtung ausgerichtet sind.
2. Halbleitereinrichtung nach Anspruch 1, dadurch gekennzeich­ net, daß die polykristalline Schicht eine polykristalline Siliziumschicht (4) aufweist.
3. Halbleitereinrichtung nach Anspruch 2, dadurch gekennzeich­ net, daß die Kristallorientierung der polykristallinen Siliziumschicht eine (110)-Ebenen-Orientierung ist.
4. Halbleitereinrichtung nach Anspruch 2, dadurch gekennzeich­ net, daß die Kristallorientierung der polykristallinen Siliziumschicht eine (111)-Ebenen-Orientierung ist.
5. Halbleitereinrichtung nach einem der Ansprüche 1-4, da­ durch gekennzeichnet, daß die Gateelektrode (4) und das Paar von Störstellengebieten (5) einen MOS-Transistor bilden.
6. Halbleitereinrichtung nach einem der Ansprüche 1-5, da­ durch gekennzeichnet, daß die Gateelektrode eine aus nur einer polykristallinen Schicht (4) gebildete Gateelektrode ist.
7. Halbleitereinrichtung nach einem der Ansprüche 1-5, da­ durch gekennzeichnet, daß die Gateelektrode (4) eine Mehr­ zahl polykristalliner Schichten (4a, 4b) aufweist, wobei die Kristallorientierungen in mindestens einer der poly­ kristallinen Schichten (4b) in eine bestimmte Richtung aus­ gerichtet sind.
8. Halbleitereinrichtung nach einem der Ansprüche 2-7, da­ durch gekennzeichnet, daß die polykristalline Silizium­ schicht eine polykristalline CVD-Siliziumschicht (4) auf­ weist.
9. Verfahren zur Herstellung einer Halbleitereinrichtung mit den Schritten:
Bilden einer polykristallinen Schicht (4) auf einem Halb­ leitersubstrat (1) derart, daß die Kristallorientierungen der Kristallkörner in eine bestimmte Richtung ausgerichtet sind,
Mustern der polykristallinen Schicht (4) und
Bilden eines Störstellengebietes (5) im Halbleitersubstrat (1) durch Ionenimplantation unter einem vorbestimmten Winkel bezüglich der Kristallorientierung der polykristal­ linen Schicht unter Nutzung der gemusterten polykristalli­ nen Schicht (4) als Maske.
10. Verfahren nach Anspruch 9, dadurch gekennzeichnet, daß der Schritt des Bildens der polykristallinen Schicht den Schritt des Bildens einer polykristallinen Siliziumschicht (4) aufweist.
11. Verfahren nach Anspruch 10, dadurch gekennzeichnet, daß der Schritt des Bildens der polykristallinen Siliziumschicht den Schritt des Bildens einer polykristallinen Silizium­ schicht (4) durch ein CVD-Verfahren aufweist.
12. Verfahren nach Anspruch 11, dadurch gekennzeichnet, daß der Schritt des Bildens der polykristallinen Siliziumschicht den Schritt des Bildens einer polykristallinen Silizium­ schicht (4) unter Nutzung eines Gases vom Silantyp als Re­ aktionsgas unter einem Druck von 0,1-1,0 Torr und einer Temperatur von 550-620°C aufweist.
13. Verfahren nach einem der Ansprüche 10-12, dadurch gekenn­ zeichnet, daß der Schritt des Bildens des Störstellengebie­ tes den Schritt des Bildens eines Störstellengebietes (5) im Halbleitersubstrat (1) durch Ionenimplantation unter einem Winkel von 7°-14° bezüglich der kristallographi­ schen Achse der polykristallinen Siliziumschicht, wenn die Ebenen-Orientierung der Kristallkörner der polykristallinen Siliziumschicht (110) ist, aufweist.
14. Verfahren zur Herstellung einer polykristallinen Silizium­ schicht, gekennzeichnet durch einen Schritt des Bildens einer polykristallinen Siliziumschicht (4) auf einem darun­ terliegenden Substrat (1) durch ein chemisches Gasphasen­ abscheidungsverfahren unter Nutzung eines Gases vom Silan­ typ als Reaktionsgas unter einem Druck von 0,1-1,0 Torr und einer Temperatur von 550-620°C.
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