DE19845294B4 - Halbleitervorrichtung und Herstellungsverfahren einer Halbleitervorrichtung - Google Patents
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- H01L2924/12—Passive devices, e.g. 2 terminal devices
- H01L2924/1203—Rectifying Diode
- H01L2924/12036—PN diode
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- H01L2924/11—Device type
- H01L2924/13—Discrete devices, e.g. 3 terminal devices
- H01L2924/1304—Transistor
- H01L2924/1306—Field-effect transistor [FET]
- H01L2924/13091—Metal-Oxide-Semiconductor Field-Effect Transistor [MOSFET]
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Abstract
Halbleitervorrichtung
mit
einem Halbleitersubstrat (13),
einer auf dem Halbleitersubstrat (13) vorgesehenen elektronischen Schaltung (11a),
einem mit der elektronischen Schaltung (11a) verbundenen Anschluß (121) und
einem Metallverbindungsteil (3), das gemeinsam mit sowohl dem Anschluß (121) als auch einem Bereich einer Oberfläche des Halbleitersubstrates (13), der benachbart zu dem Anschluß (121) freigelegt ist, kontaktiert ist, und
einer zwischen dem Verbindungsteil (3) und dem Halbleitersubstrat (13) gebildeten Diode mit der Oberfläche des Halbleitersubstrates (13) als eine der Elektroden.
einem Halbleitersubstrat (13),
einer auf dem Halbleitersubstrat (13) vorgesehenen elektronischen Schaltung (11a),
einem mit der elektronischen Schaltung (11a) verbundenen Anschluß (121) und
einem Metallverbindungsteil (3), das gemeinsam mit sowohl dem Anschluß (121) als auch einem Bereich einer Oberfläche des Halbleitersubstrates (13), der benachbart zu dem Anschluß (121) freigelegt ist, kontaktiert ist, und
einer zwischen dem Verbindungsteil (3) und dem Halbleitersubstrat (13) gebildeten Diode mit der Oberfläche des Halbleitersubstrates (13) als eine der Elektroden.
Description
- Die vorliegende Erfindung betrifft eine Halbleitervorrichtung mit einer elektronischen Schaltung und ein Herstellungsverfahren einer Halbleitervorrichtung.
- Speziell betrifft sie einen elektrischen Schutz für die elektronische Schaltung.
- Bei einer der Anmelderin bekannten Halbleitervorrichtung schreitet manchmal ein Strom- bzw. Spannungsstoß, der durch statische Elektrizität verursacht ist, mit hoher Spannung oder großem Strom zu einer darin vorgesehenen elektronischen Schaltung fort.
- Folglich gibt es eine Schwierigkeit, daß die in der Halbleitervorrichtung vorgesehene elektronische Schaltung durch den Stoß durchbrochen wird. Speziell bei einer Halbleitervorrichtung mit einer SOI-Struktur (Silizium-auf-Isolator-Struktur) wird eine darin vorgesehene elektronische Schaltung leicht durch den Stoß durchbrochen.
33 zeigt ein Beispiel eines Querschnitts der Halbleitervorrichtung mit der SOI-Struktur. In33 bezeichnet13 einen p-Halbleiterbereich in einem SOI-Substrat (im folgenden als Halbleitersubstrat bezeichnet), bezeichnet111 eine SOI-Schicht (Halbleiterschicht), bezeichnet14 einen vergrabenen Oxidfilm und bezeichnet112 einen MOS-Transistor, der auf der SOI-Schicht111 vorgesehen ist und eine elektronische Schaltung mit einem Gate G, einem Source S und einem Drain D, die gezeigt sind, bildet. Der vergrabene Oxidfilm14 weist eine sehr schlechte thermische Leitfähigkeit auf. Beispielsweise weist SiO2 eine thermische Leitfähigkeit von ungefähr 1/100 verglichen mit einem Einkristall Si auf. Wenn der Stoß zwischen dem Source S und dem Drain D fortschreitet, werden folglich die Temperaturen des Source S und des Drain D derart erhöht, dass der Source S und der Drain S leicht durchbrochen werden. - Die
EP 0 622 850 A1 zeigt eine Schutzdiode zum Schutz gegen elektrostatische Entladung bei der SOI-Technik. Die Diode ist in einem Grabenbereich ausgebildet, der sich in das SOI-Substrat erstreckt. - Die nach dem Prioritätsdatum der vorliegenden Anmeldung veröffentliche
EP 0 838 857 A2 mit älterem Zeitrang zeigt eine Vorrichtung zum Schutz gegen elektrostatische Entladung. Der Schutz wird durch einen Metallkontakt zu einem n-Substrat bzw. einer n-Wanne erzielt. - Es ist Aufgabe der vorliegenden Erfindung, eine Halbleitervorrichtung vorzusehen, die eine darin gebildete elektronische Schaltung vor einem Stoß schützen kann, und ein Herstellungsverfahren der Halbleitervorrichtung vorzusehen.
- Die Aufgabe wird durch Halbleitervorrichtung des Anspruches 1 oder 6 oder durch das Herstellungsverfahren einer Halbleitervorrichtung des Anspruches 7 gelöst.
- Weiterbildungen der Erfindung sind in den Unteransprüchen angegeben.
- Ein erster Aspekt der vorliegenden Erfindung ist auf eine Halbleitervorrichtung gerichtet, die ein Halbleitersubstrat, eine elektronische Schaltung, die auf dem Halbleitersubstrat vorgesehen ist, einen Anschluss, der mit der elektronischen Schaltung leitend verbunden ist, und ein Metallverbindungsteil, das gemeinsam mit sowohl dem Anschluss als auch einem Bereich einer Oberfläche des Halbleitersubstrates, der benachbart zu dem Anschluss freigelegt ist, kontaktiert ist, und eine Diode mit der Oberfläche des Halbleitersubstrates als eine der Elektroden, die zwischen dem Verbindungsteil und dem Halbleitersubstrat gebildet ist, aufweist.
- Ein zweiter Aspekt der vorliegenden Erfindung ist auf eine Halbleitervorrichtung gerichtet, bei der das Metall einen Schottky-Übergang mit dem Bereich bildet.
- Ein dritter Aspekt der vorliegenden Erfindung ist auf die Halbleitervorrichtung gerichtet, bei der der Bereich einen Leitungstyp aufweist, der zu dem Leitungstyp des Halbleitersubstrates umgekehrt ist.
- Ein vierter Aspekt der vorliegenden Erfindung ist auf eine Halbleitervorrichtung gerichtet, die weiter einen Isolierfilm, der zwischen dem Halbleitersubstrat und dem Anschluß gebildet ist, der die elektronische Schaltung umgibt und der benachbart zu dem Anschluß zusammen mit dem Bereich freigelegt ist, und ein leitendes Teil, das auf dem Isolierfilm und dem Bereich gebildet ist, aufweist.
- Ein fünfter Aspekt der vorliegenden Erfindung ist auf eine Halbleitervorrichtung gerichtet, bei der der Bereich in der Mitte des Anschlusses vorgesehen ist.
- Ein sechster Aspekt der vorliegenden Erfindung ist auf eine Halbleitervorrichtung gerichtet, die einen Halbleiterchip, der ein Halbleitersubstrat, einen Isolierfilm, der auf dem Halbleitersubstrat gebildet ist, und eine Halbleiterschicht, die auf dem Isolierfilm gebildet ist und eine elektronische Schaltung, die darauf gebildet ist, aufweist, ein Schutzsubstrat zum elektrischen Schützen der Halbleiterschicht, einen externen Anschluß, ein erstes Verbindungsteil zum elektrischen Verbinden des Halbleiterchips und des Schutzsubstrates und ein zweites Verbindungsteil zum elektrischen Verbinden des Schutzsubstrates und des externen Anschlusses aufweist.
- Ein siebter Aspekt der vorliegenden Erfindung ist auf ein Herstellungsverfahren einer Halbleitervorrichtung mit den Schritten von (a) Vorbereiten eines Halbleitersubstrates, eines Iso lierfilmes, der auf dem Halbleitersubstrat gebildet ist, eine Halbleiterschicht, die auf dem Isolierfilm gebildet ist und eine elektrische Schaltung darauf gebildet aufweist, eines Anschlusses, der mit der elektronischen Schaltung verbunden ist, und eines externen Anschlusses, (b) Bilden einer Öffnung auf dem Isolierfilm derart, daß das Halbleitersubstrat freigelegt wird, (c) Verbinden von einem Ende eines Metallverbindungsteiles mit dem externen Anschluß und (d) Kontaktieren des anderen Endes des Verbindungsteiles mit dem freigelegten Halbleitersubstrat und dem Anschluß gerichtet.
- Ein achter Aspekt der vorliegenden Erfindung ist auf ein Verfahren zum Herstellen einer Halbleitervorrichtung gerichtet, das weiterhin zwischen den Schritten (b) und (c) einen Schritt (e) des Umwandelns eines Leitungstyps einer Oberfläche des freigelegten Halbleitersubstrates in einen anderen als den des Halbleitersubstrates aufweist.
- Ein neunter Aspekt der vorliegenden Erfindung ist auf ein Herstellungsverfahren einer Halbleitervorrichtung gerichtet, das weiterhin zwischen den Schritten (e) und (c) einen Schritt (f) des Bildens eines leitenden Teiles von der Oberfläche des freigelegten Halbleitersubstrates zu einer Seitenwand der Öffnung aufweist.
- Ein zehnter Aspekt der vorliegenden Erfindung ist auf eine Halbleitervorrichtung gerichtet, bei der die elektronische Schaltung auf einer SOI-Struktur vorgesehen ist.
- Ein elfter Aspekt der vorliegenden Erfindung ist auf ein Herstellungsverfahren einer Halbleitervorrichtung gerichtet, bei der die elektronische Schaltung auf einer SOI-Struktur gebildet wird.
- Ein zwölfter Aspekt der vorliegenden Erfindung ist auf eine Halbleitervorrichtung gerichtet, bei der die elektronische Schaltung auf einer SOI-Struktur vorgesehen ist.
- Entsprechend dem ersten Aspekt der vorliegenden Erfindung wird in einem Fall, bei dem ein Stoß von dem Verbindungsteil zu dem Kontaktierungsfleck übertragen wird, der Stoß zu dem Halbleitersusbtrat über die Diode gesendet. Folglich kann die elektronische Schaltung vor dem Stoß geschützt werden.
- Entsprechend dem zweiten Aspekt der vorliegenden Erfindung ist eine Schottky-Diode zwischen dem Verbindungsteil und der Oberfläche des Halbleitersubstrates gebildet. Daher können die Effekte entsprechend dem ersten Aspekt der vorliegenden Erfindung leicht erzielt werden.
- Entsprechend dem dritten Aspekt der vorliegenden Erfindung ist eine Diode des PN-Übergangstyps auf der Oberfläche des Halbleitersubstrates gebildet. Daher ist ein Widerstand während dem Durchbruch verglichen mit der Schottky-Diode kleiner. Folglich kann der Stoß leicht zu dem Halbleitersubstrat fließen.
- Entsprechend dem vierten Aspekt der vorliegenden Erfindung wird es für Verbindungsteil, wenn es in Kontakt mit dem Kontaktierungsfleck kommt, schwieriger in Kontakt mit dem Bereich zu kommen, an dem das Halbleitersubstrat freigelegt ist, wenn eine Dicke des Isolierfilms erhöht wird. Wenn jedoch das leitende Teil vorgesehen ist, kann das Verbindungsteil mit dem Halbleitersubstrat elektrisch verbunden werden.
- Entsprechend dem fünften Aspekt der vorliegenden Erfindung ist der Bereich in der Mitte des Anschlusses vorgesehen. Sogar wenn das Verbindungsteil zu der Peripherie des Anschlusses kontaktiert ist, kann folglich das Verbindungsteil leicht in Kontakt mit dem Bereich kommen.
- Entsprechend dem sechsten Aspekt der vorliegenden Erfindung weist die Halbleitervorrichtung, bei der die Halbleiterschicht mit der elektronischen Schaltung, die darauf gebildet ist, von dem Halbleitersubstrat durch den Isolierfilm isoliert ist, sehr wenig Pfade auf, über die ein Stoß zu der Halbleiterschicht fließt, wenn der Stoß von dem externen Anschluß zu der Halbleiterschicht übertragen wird. Aus diesem Grund kann die elektrische Schaltung durch den Stoß leicht durchbrochen werden. Daher ist das Schutzsubstrat elektrisch zwischen dem externen Anschluß und dem Halbleiterchip derart vorgesehen, daß verhindert wird, daß der Stoß von dem externen Anschluß zu dem Halbleiterchip übertragen wird. Folglich kann die Halbleiterschaltung vor dem Stoß geschützt werden.
- Entsprechend dem siebten Aspekt der vorliegenden Erfindung leitet im allgemeinen die elektronische Schaltung, die auf dem Isolierfilm gebildet ist, den Stoß mit Schwierigkeiten ab. Das Verbindungsteil wird jedoch mit dem externen Anschluß in dem Schritt (c) verbunden. Daher fließt der Stoß zu dem externen Anschluß, sogar wenn er während dem Kontaktieren in dem Schritt (d) erzeugt wird. Daher kann die elektronische Schaltung vor dem Stoß geschützt werden.
- Entsprechend dem achten Aspekt der vorliegenden Erfindung fließt der Stoß über die Diode des PN-Übergangstyps, die auf dem Halbleitersubstrat gebildet ist, heraus, sogar wenn es wahrscheinlich ist, daß er von dem Verbindungsteil zu der elektronischen Schaltung fließt. Folglich kann die elektronische Schaltung vor dem Stoß geschützt werden.
- Entsprechend dem neunten Aspekt der vorliegenden Erfindung können die Effekte entsprechend dem achten Aspekt der vorliegenden Erfindung erzielt werden, sogar wenn das andere Ende des Verbindungsteiles in einer solchen Art kontaktiert ist, daß es nur die Seitenwand der Öffnung erreicht und nicht das Halbleitersubstrat an einem Boden der Öffnung erreicht.
- Entsprechend dem zehnten Aspekt der vorliegenden Erfindung kann die elektronische Schaltung, die auf der SOI-Struktur gebildet ist, effektiv vor dem Stoß geschützt werden.
- Entsprechend dem elften Aspekt der vorliegenden Erfindung kann die elektronische Schaltung, die auf der SOI-Struktur gebildet ist, effektiv vor dem Stoß geschützt werden.
- Entsprechend dem zwölften Aspekt der vorliegenden Erfindung kann die elektronische Schaltung, die auf der SOI-Struktur gebildet ist, effektiv vor dem Stoß geschützt werden.
- Weitere Merkmale und Zweckmäßigkeiten der Erfindung ergeben sich aus der folgenden Beschreibung von Ausführungsbeispielen der Erfindung anhand der Figuren. Von den Figuren zeigen:
-
1 eine konzeptionelle Ansicht, die eine Halbleitervorrichtung entsprechend einem ersten Ausführungsbeispiel zeigt, -
2 eine Querschnittsansicht, die die Halbleitervorrichtung entsprechend dem ersten Ausführungsbeispiel zeigt, -
3 ein Ersatzschaltbild, das die Halbleitervorrichtung entsprechend dem ersten Ausführungsbeispiel zeigt, -
4 ein Ersatzschaltbild, das die Halbleitervorrichtung entsprechend dem ersten Ausführungsbeispiel zeigt, -
5 eine Querschnittsansicht, die eine Halbleitervorrichtung entsprechend einem zweiten Ausführungsbeispiel zeigt, -
6 eine Querschnittsansicht, die eine Halbleitervorrichtung entsprechend einem dritten Ausführungsbeispiel zeigt, -
7 eine Querschnittsansicht, die die Halbleitervorrichtung entsprechend dem dritten Ausführungsbeispiel zeigt, -
8 eine Querschnittsansicht, die die Halbleitervorrichtung entsprechend dem dritten Ausführungsbeispiel zeigt, -
9 eine Querschnittsansicht, die die Halbleitervorrichtung entsprechend dem dritten Ausführungsbeispiel zeigt, -
10 eine Querschnittsansicht, die die Halbleitervorrichtung entsprechend dem dritten Ausführungsbeispiel zeigt, -
11 eine Querschnittsansicht, die eine Halbleitervorrichtung entsprechend einem vierten Ausführungsbeispiel zeigt, -
12A und12B Querschnittsansichten, die ein Herstellungsverfahren einer Halbleitervorrichtung entsprechend einem fünften Ausführungsbeispiel zeigen, -
13A und13B Querschnittsansichten, die das Herstellungsverfahren einer Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigen, -
14A und14B Querschnittsansichten, die das Herstellungsverfahren einer Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigen, -
15A und15B Querschnittsansichten, die das Herstellungsverfahren einer Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigen, -
16A und16B Querschnittsansichten, die das Herstellungsverfahren einer Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigen, -
17A und17B Querschnittsansichten, die das Herstellungsverfahren einer Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigen, -
18A und18B Querschnittsansichten, die das Herstellungsverfahren einer Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigen, -
19 eine Querschnittsansicht, die das Herstellungsverfahren der Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigt, -
20 eine Querschnittsansicht, die das Herstellungsverfahren der Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigt, -
21A und21B Querschnittsansichten, die das Herstellungsverfahren der Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigen, -
22 eine Querschnittsansicht, die die Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigt, -
23 eine Querschnittsansicht, die das Herstellungsverfahren der Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigt, -
24A und24B Querschnittsansichten, die das Herstellungsverfahren der Halbleitervorrichtung entsprechend dem fünften Ausführungsbeispiel zeigen, -
25 eine konzeptionelle Ansicht, die eine Halbleitervorrichtung entsprechend einem sechsten Ausführungsbeispiel zeigt, -
26 eine konzeptionelle Ansicht, die die Halbleitervorrichtung entsprechend dem sechsten Ausführungsbeispiel zeigt, -
27 eine konzeptionelle Ansicht, die die Halbleitervorrichtung entsprechend dem sechsten Ausführungsbeispiel zeigt, -
28 eine Querschnittsansicht, die die Halbleitervorrichtung entsprechend dem sechsten Ausführungsbeispiel zeigt, -
29 eine Querschnittsansicht, die ein Herstellungsverfahren einer Halbleitervorrichtung entsprechend einem siebten Ausführungsbei spiel zeigt, -
30 eine Querschnittsansicht, die das Herstellungsverfahren der Halbleitervorrichtung entsprechend dem siebten Ausführungsbeispiel zeigt, -
31 eine Querschnittsansicht, die das Herstellungsverfahren der Halbleitervorrichtung entsprechend dem siebten Ausführungsbeispiel zeigt, -
32 eine Querschnittsansicht, die die Halbleitervorrichtung entsprechend dem siebten Ausführungsbeispiel zeigt, -
33 eine Querschnittsansicht, die eine SOI-Struktur zeigt, und -
34 eine Querschnittsansicht, die einen Fall zeigt, bei dem die vorliegende Erfindung bei einem Halbleitersubstrat angewendet wird, das eine andere Struktur als die SOI-Struktur aufweist. - Erstes Ausführungsbeispiel
-
1 ist eine konzeptionelle Ansicht, die eine Struktur einer Halbleitervorrichtung entsprechend dem ersten Ausführungsbeispiel zeigt. In1 bezeichnen1 einen Halbleiterchip mit einer SOI-Struktur und11 einen Bereich mit einer SOI-Schicht, der auf dem Halbleiterchip1 vorgesehen ist (im folgenden als SOI-Bereich bezeichnet). Eine elektronische Schaltung ist in dem SOI-Bereich11 gebildet. Das Bezugszeichen12 bezeichnet einen auf dem Halbleiterchip1 vorgesehenen Bereich, zu dem ein Kontaktierungsdraht3 (Metallverbindungsteil) verbunden ist (im folgenden als Kontaktierungsbereich bezeichnet). Das Bezugszeichen2 bezeichnet einen externen Anschluß, der über den Kontaktierungsdraht3 mit dem Kontaktierungsbereich12 verbunden ist, und das Bezugszeichen4 bezeichnet eine Kunststofform. - Als nächstes wird der Kontaktierungsbereich
12 mit Bezug zu2 beschrieben.2 ist eine Querschnittsansicht, die eine Halbleitervorrichtung entsprechend dem ersten Ausführungsbeispiel zeigt und einen Abschnitt darstellt, der den Kontaktierungsbereich12 in1 betrifft. In2 bezeichnen13 ein Halbleitersubstrat,14 einen Isolator, der einen vergrabenen Oxidfilm, einen dielektrischen Zwischenschichtfilm und ähnliches enthält,15 einen Glasbeschichtungsfilm,16 einen Polyimidfilm,112 einen MOS-Transistor als Vertreter einer elektronischen Schaltung. Das Bezugszeichen121 bezeichnet einen Kontaktierungsfleck (Anschluß), der mit der elektronischen Schaltung verbunden ist bzw. zu ihr leitet, das Bezugszeichen122 bezeichnet eine Öffnung, die das Halbleitersubstrat13 erreicht und die benachbart bzw. angrenzend zu dem Kontaktierungsbereich12 vorgesehen ist, und das Bezugszeichen113 bezeichnet eine Verdrahtung der elektronischen Schaltung. Der Isolator14 ist zwischen dem Halbleitersubstrat13 und dem Kontaktierungsfleck121 gebildet, umschließt die elektronische Schaltung und ist benachbart zu dem Kontaktierungsfleck121 zusammen mit einem Bereich einer Oberfläche des Halbleitersubstrates13 freigelegt. - Der Kontaktierungsdraht
3 ist gemeinsam mit dem Kontaktierungsfleck121 und dem Halbleitersubstrat13 in Kontakt. Tatsächlich weist die Öffnung122 eine kleine Tiefe auf. Daher kann verursacht werden, daß der Kontaktierungsdraht3 mit dem Kontaktierungsfleck121 und dem Halbleitersubstrat13 unter Verwendung von beispielsweise einem Wärme-Ultraschall-Kontaktierungsverfahren gemeinsam in Kontakt kommt. -
3 zeigt eine Ersatzschaltung eines relevanten Abschnittes. Das Bezugszeichen11a bezeichnet eine in dem SOI-Bereich11 gebildete elektronische Schaltung. Der Kontaktierungsdraht3 und das Halbleitersubstrat13 bilden dazwischen einen Schottky-Übergang. Daher ist eine Diode1220 mit dem Halbleitersubstrat13 als Anode und dem Kontaktierungsdraht3 als Kathode gebildet. Es ist bevorzugt, daß ein Material des Verbindungsdrahtes3 , der den Schottky-Übergang bildet, ein Metall ist, wie zum Beispiel Gold, Aluminium oder ähnliches. Ein über den Kontaktierungsdraht3 übertragenes Signal wird nicht zu dem Halbleitersubstrat13 gesendet. Wenn jedoch ein Stoß durch den Kontaktierungsdraht3 übertragen wird, bricht die Diode1220 zusammen, so daß der Kontaktierungsdraht3 mit dem Halbleitersubstrat13 elektrisch verbunden wird. Wie in4 gezeigt ist, kann eine Schutzschaltung6 zum Schützen der elektronischen Schaltung11a vor dem Stoß auf einem SOI-Substrat vorgesehen sein, das ein anderes als der SOI-Bereich11 ist und das zwischen der elektronischen Schaltung11a und dem Kontaktierungsfleck bzw. -fläche121 gebildet ist. - Entsprechend dem ersten Ausführungsbeispiel wird ein über den Kontaktierungsdraht
3 übertragener Stoß effektiv in das Halbleitersubstrat13 entladen. Folglich kann die elektronische Schaltung vor einem Stoß geschützt werden. - Zweites Ausführungsbeispiel
- Als nächstes wird ein zweites Ausführungsbeispiel beschrieben.
5 ist eine Querschnittsansicht, die eine Halbleitervorrichtung entsprechend dem zweiten Ausführungsbeispiel zeigt, und die einen Abschnitt darstellt, der den Kontaktierungsbereich12 in1 betrifft. In5 bezeichnet123 ein Dotierungsbereich, in dem eine n-Dotierung in einen Boden einer Öffnung122 implantiert ist. Die anderen Bezugszeichen sind die gleichen wie in dem ersten Ausführungsbeispiel. - In dem zweiten Ausführungsbeispiel ist eine Diode des PNÜbergangstyps mit dem Dotierungsbereich
123 als Kathode und dem p-Halbleitersubstrat13 als Anode gebildet. - Entsprechend dem zweiten Ausführungsbeispiel weist die Diode mit dem Dotierungsbereich
123 und dem Halbleitersubstrat13 einen kleineren Widerstand als in der Diode, die in dem ersten Ausführungsbeispiel beschrieben ist, auf. Daher wird ein Stoß leichter in das Halbleitersubstrat13 entladen. - Dritte Ausführungsbeispiel
- Wenn beispielsweise eine Tiefe der Öffnung
122 in5 erhöht wird, kommt ein Kontaktierungsdraht3 schwieriger in Kontakt mit dem Dotierungsbereich123 . In dem dritten Ausführungsbeispiel ist ein leitendes Teil124 , wie zum Beispiel Al, Cu, TiN oder W, über bzw. auf einem Isolator14 und dem Dotierungsbereich123 gebildet, wie in6 gezeigt ist. - Es ist ausreichend, daß das leitende Teil
124 zumindest auf dem Boden der Öffnung122 und einer Seitenwand des Isolators14 gebildet ist. Beispielsweise kann das leitende Teil124 , wie in7 -10 gezeigt ist, gebildet sein. -
9 und10 zeigen das leitende Teil124 , das durch Sputtern von Metall, Bilden eines Resists und Ätzen eines nicht notwendigen Abschnittes des Metalls erhalten wird.6 -8 zeigen das leitende Teil124 , das unter Verwendung eines Reparatursystems mit einem fokussierten Innenstrahl (im folgenden als ein FIB bezeichnet) erhalten wird. In einem Fall, bei dem das FIB verwendet wird, wird der Durchsatz mehr erhöht, wenn die Anzahl der Kontaktierungsbereiche12 verringert wird, und das leitende Teil124 kann verglichen mit einem Fall, bei dem das Sputtern oder ähnliches durchgeführt wird, wie oben beschrieben wurde, lokal gebildet werden. - Entsprechend dem dritten Ausführungsbeispiel kommt der Kontaktierungsdraht
3 in Kontakt mit dem leitenden Teil124 , sogar wenn die Öffnung122 eine große Tiefe aufweist. Daher kann die elektrische Verbindung zu einer Diode sichergestellt werden. - Viertes Ausführungsbeispiel
- In einem vierten Ausführungsbeispiel ist eine Öffnung
122 in einer Mitte eines Kontaktierungsflecks bzw. -fläche121 gebildet, wie in11 gezeigt ist. Von oberhalb des Kontaktierungsfleckes121 gesehen, ist die Öffnung122 durch den Kontaktierungsfleck121 umschlossen. - Entsprechend dem vierten Ausführungsbeispiel ist die Öffnung
122 in der Mitte des Kontaktierungsflecks121 gebildet. Folglich kommt ein Kontaktierungsdraht3 leicht in Kontakt mit einem Boden der Öffnung122 , sogar wenn er zu der Peripherie des Kontaktierungsflecks121 kontaktiert ist. Weiterhin ist die Öffnung112 einfach mit dem Kontaktierungsdraht3 bedeckt und ein Isolator14 ist nicht freigelegt. Daher ist es möglich zu verhindern, daß der Isolator14 Feuchtigkeit absorbiert. - Fünftes Ausführungsbeispiel
- In einem fünften Ausführungsbeispiel wird im folgenden ein Herstellungsverfahren einer Halbleitervorrichtung beschrieben. Zuerst wird ein Wafer
10 mit einer Struktur, die in12A und12B gezeigt ist, unter Verwendung einer bekannten Technik erhalten. In dem Wafer10 ist ein SOI-Substrat mit einem Glasbeschichtungsfilm15 und einem Polyimidfilm16 bedeckt, und eine elektronische Schaltung ist in einem SOI-Bereich11 gebildet. Andere Bezugszeichen entsprechen den oben erwähnten Bezugszeichen. -
12A ,13A ,14A ,15A ,16A ,17A ,18A ,21A und24A zeigen einen Abschnitt, der den Kontaktierungsbereich12 für eine Span nungsversorgung Vdd oder den Kontaktierungsbereich12 für ein Signal betrifft.12B ,13B ,14B ,15B ,16B ,17B ,18B ,21B und24B zeigen einen Abschnitt, der den Kontaktierungsbereich12 für eine Masse Vss betrifft. - Mit Bezug zu einer Struktur, die in
12A und12B gezeigt ist, wird der Polyimidfilm16 einem Bemustern derart ausgesetzt, daß der Kontaktierungsbereich12 oberhalb eines Kontaktierungsflecks121 vorgesehen wird (13A und13B ). - Mit Bezug zu der Struktur, die in
13A und13B gezeigt ist, wird der Glasbeschichtungsfilm15 unter Verwendung des Polyimidfilmes16 als Maske geätzt. Folglich wird der Glasbeschichtungsfilm15 , der in dem Kontaktierungsbereich12 vorgesehen ist, entfernt und der Kontaktierungsfleck121 und ein Isolator14 werden freigelegt (14A und14B ). - Mit Bezug zu der Struktur, die in
14A und14B gezeigt ist, wird der Isolator14 unter Verwendung des Polyimidfilmes16 und des Kontaktierungsflecks121 als Masken geätzt. Folglich wird eine Öffnung122 , die ein Halbleitersubstrat13 erreicht, auf bzw. in dem Isolator14 derart gebildet, daß das Halbleitersubstrat13 freigelegt wird (15A und15B ). - Als nächstes wird ein Resist
51 , das einen anderen Abschnitt als den Kontaktierungsbereich12 für Vdd oder das Signal bedeckt, gebildet und eine n-Dotierung wird implantiert. Folglich wird ein n-Dotierungsbereich123 an einem Boden der Öffnung122 für Vdd oder das Signal vorgesehen (16A und16B ). - Dann wird der Resist
51 entfernt. Danach wird ein Resist52 , der einen anderen Abschnitt als den Kontaktierungsbereich12 für Vss bedeckt, gebildet und eine p-Dotierung wird implantiert. Folglich wird ein p-Dotierungsbereich123 an dem Boden der Öffnung122 für Vss vorgesehen (17A und178 ). - Danach wird der Resist
52 derart entfernt, daß die in18A und18B gezeigte Struktur erhalten wird. Die Struktur wird in Chips geschnitten. Somit wird ein Halbleiterchip1 gebildet. Der Halbleiterchip1 und ein externer Anschluß2 werden vorbereitet (19 ) . - Als nächstes werden der Kontaktierungsbereich
12 und der externe Anschluß bzw. die externe Verbindung2 durch einen Kontaktierungsdraht3 kontaktiert (20 ,21A und21B ). Der Kontaktierungsdraht3 wird mit dem externen Anschluß2 kontaktiert und wird dann mit dem Kontaktierungsbereich12 des Halbleiterchips1 kontaktiert. - Wie oben beschrieben wurde, werden der externe Anschluß
2 und der Halbleiterchip1 in dieser Reihenfolge elektrisch verbunden. Daher wird der Kontaktierungsdraht3 mit dem Kontaktierungsbereich12 in einem Zustand kontaktiert, in dem ein Stoß, der während dem Kontaktieren erzeugt wird, dazu gebracht wird, zu dem externen Anschluß2 zu fließen. Folglich kann eine elektronische Schaltung vor dem Stoß geschützt werden. Weiterhin wird der Kontaktierungsdraht3 mit dem Kontaktierungsbereich12 kontaktiert und wird mit einer Diode verbunden, die ein p-Halbleitersubstrat13 als Anode und einen n-Dotierungsbereich123 als Kathode aufweist. Sogar wenn es wahrscheinlich ist, daß ein während dem Kontaktieren erzeugter Stoß von dem Kontaktierungsdraht3 zu der elektronischen Schaltung fließt, fließt er folglich über die Diode zu dem Halbleitersubstrat13 . Daher kann die elektrische Schaltung vor dem Stoß geschützt werden. Ein solcher Schutz für die elektronische Schaltung ist effektiv in einem Fall, bei dem der Halbleiterchip1 keine Schutzschaltung aufweist. - Als nächstes werden der externe Anschluß
2 , der Verbindungsdraht3 und der Halbleiterchip1 mit einem Formkunststoff4 bedeckt, und der externe Anschluß2 wird einem Rahmen bzw. Umrah men ausgesetzt. Somit wird eine Halbleitervorrichtung fertiggestellt (22 ). - Wenn das Bilden und Entfernen des Resists
51 und52 und die Ionenimplantation zum Bilden des Dotierungsbereiches123 ausgelassen werden, kann die Halbleitervorrichtung entsprechend dem ersten Ausführungsbeispiel erhalten werden. - Der Schritt des Bildens des leitenden Teiles
124 , das in dem vierten Ausführungsbeispiel beschrieben wurde, kann hinzugefügt werden, bevor der Halbleiterchip1 und der externe Anschluß2 , die in19 gezeigt sind, vorbereitet werden. Es ist beispielsweise bevorzugt, daß das leitende Teil124 unter Verwendung eines FIB direkt nachdem die Struktur, die in18A und18B gezeigt ist, erhalten wird, gebildet wird (24A und24B ). - Weiterhin wird die Öffnung
122 in dem Kontaktierungsbereich12 für Vss vorgesehen, so daß der Kontaktierungsdraht3 in Kontakt mit dem Halbleitersubstrat13 kommt. Daher wird ein elektrisches Potential von Masse dem Halbleitersubstrat13 gegeben. Die p-Dotierung wird in das Halbleitersubstrat13 an dem Boden der Öffnung122 für Vss implantiert. Folglich wird ein Widerstand zwischen dem Kontaktierungsdraht3 und dem Halbleitersubstrat13 reduziert. - Bei einer Halbleitervorrichtung, zu der ein Signal mit einer Größe, die kleiner als Masse Vss ist, gesendet wird, ist die Öffnung
122 in einer solchen Art nicht in dem Kontaktierungsbereich12 vorgesehen, daß das Signal nicht von dem Halbleitersubstrat13 gesendet wird, wie in23 gezeigt ist. - Entsprechend dem fünften Ausführungsbeispiel wird der während dem Kontaktieren erzeugte Stoß in das Halbleitersubstrat
13 entladen, sogar wenn es wahrscheinlich ist, daß er von dem Kontaktierungsdraht3 zu der elektronischen Schaltung fließt. Da her kann die elektronische Schaltung vor dem Stoß geschützt werden. Weiterhin werden der externe Anschluß2 und der Halbleiterchip1 elektrisch in dieser Reihenfolge verbunden. Folglich wird der Kontaktierungsdraht3 mit dem Kontaktierungsbereich12 in einem Zustand kontaktiert, indem der Stoß dazu gebracht werden kann, zu dem externen Anschluß2 zu fließen. Somit kann die elektronische Schaltung vor dem Stoß geschützt werden. - Sechstes Ausführungsbeispiel
- In der gleichen Art wie die obige elektronische Schaltung wird die Schutzschaltung
6 leicht durch einen Stoß durchbrochen, wenn sie auf einer SOI-Struktur vorgesehen ist. In einem sechsten Ausführungsbeispiel ist die Schutzschaltung6 auf einem anderen Substrat vorgesehen. -
25 ist eine Draufsicht, die eine Halbleitervorrichtung entsprechend dem sechsten Ausführungsbeispiel zeigt. In25 bezeichnet das Bezugszeichen23 einen Kontaktierungsbereich, der auf einem Halbleiterchip1 vorgesehen ist, bezeichnet das Bezugszeichen7 ein Halbleitersubstrat (Schutzsubstrat) zum elektrischen Schützen der SOI-Schicht111 , bezeichnen die Bezugszeichen21 und22 Kontaktierungsbereiche, die auf dem Halbleitersubstrat7 gebildet sind, bezeichnet das Bezugszeichen31 einen Kontaktierungsdraht (erstes Verbindungsteil), der mit dem Kontaktierungsbereich22 und23 kontaktiert ist, bezeichnet das Bezugszeichen32 einen Kontaktierungsdraht (zweites Verbindungsteil), der mit einem externen Anschluß2 und dem Kontaktierungsbereich21 kontaktiert ist, und die anderen Bezugszeichen entsprechen den oben erwähnten Bezugszeichen. Die Schutzschaltung6 ist auf dem Halbleitersubstrat7 gebildet und ist mit den Kontaktierungsbereichen21 und22 verbunden. - Die Spannungsversorgung Vdd und Masse Vss werden von den externen Anschlüssen
2 für die Spannungsversorgung Vdd und die Masse Vss zu der Schutzschaltung6 über Verdrahtungen (nicht gezeigt) geliefert. - Alle Kontaktierungsbereiche
21 ,22 und23 können wie der in23 gezeigte Kontaktierungsbereich12 gebildet sein. Alternativ kann zumindest einer der Kontaktierungsbereiche21 ,22 und23 der Kontaktierungsbereich12 entsprechend einem von dem ersten bis vierten Ausführungsbeispiel sein. - Wenn der Kontaktierungsbereich entsprechend einem von dem ersten bis vierten Ausführungsbeispiel bei zumindest einem der Kontaktierungsbereiche
21 ,22 und23 angewendet wird, kann die auf dem Halbleitersubstrat7 vorzusehende Schutzschaltung ausgelassen werden, da eine Diode, die durch das Kontaktieren gebildet ist, eine elektronische Schaltung vor einem Stoß schützt. - Zusätzlich zu der in
25 gezeigten Struktur können Strukturen, die in26 bis28 gezeigt sind, gebildet sein. Obwohl vier Halbleitersubstrate7 in25 vorgesehen sind, ist ein Halbleitersubstrat7 in26 vorgesehen und ein Halbleiterchip1 ist auf dem Halbleitersubstrat7 montiert. In27 ist ein Flip-Chip-Verfahren angewendet.28 zeigt einen Querschnitt von27 . In28 bezeichnet das Bezugszeichen311 einen Anschluß bzw. einen erhöhten Kontaktflecken (erstes Verbindungsteil), wie zum Beispiel Gold, Aluminium, Lot, Weichlot oder ähnliches, der die Kontaktierungsbereiche23 und22 elektrisch verbindet. Durch das Flip-Chip-Verfahren können eine große Anzahl von Kontaktbereichen23 und22 elektrisch zu einer Zeit verbunden werden. Daher kann der Durchsatz erhöht werden. - Entsprechend dem sechsten Ausführungsbeispiel fließt der Stoß in das Halbleitersubstrat
7 . Daher kann die elektronische Schaltung, die auf dem Halbleiterchip1 vorgesehen ist, vor dem Stoß geschützt werden. - Siebtes Ausführungsbeispiel
- In dem siebten Ausführungsbeispiel wird im folgenden ein Herstellungsverfahren der Halbleitervorrichtung entsprechend dem sechsten Ausführungsbeispiel im folgenden beschrieben. Zuerst werden ein Halbleiterchip
1 , ein Halbleitersubstrat7 und ein externer Anschluß2 vorbereitet (29 ). - Als nächstes wird ein Kontaktierungsdraht
32 mit dem externen Anschluß2 kontaktiert und wird dann mit einem Kontaktierungsbereich21 kontaktiert (30 ). Danach wird ein Kontaktierungsdraht31 mit einem Kontaktierungsbereich22 kontaktiert und wird dann mit einem Kontaktierungsbereich23 kontaktiert (31 ). Somit werden der elektrische Anschluß2 , das Halbleitersubstrat7 und der Halbleiterchip1 elektrisch in dieser Reihenfolge verbunden. Daher wird der Kontaktierungsdraht31 elektrisch mit dem Halbleitersubstrat7 und dem externen Anschluß2 verbunden, wenn er mit dem Kontaktierungsbereich23 kontaktiert wird. Folglich kann eine elektronische Schaltung vor einem Stoß, der während dem Kontaktieren erzeugt wird, geschützt werden. - Dann werden der externe Anschluß
2 , der Kontaktierungsdraht31 , der Kontaktierungsdraht32 , der Halbleiterchip1 und das Halbleitersubstrat7 mit einem Formkunststoff4 bedeckt, und der externe Anschluß2 wird einem Rahmen ausgesetzt. Somit wird eine Halbleitervorrichtung fertiggestellt (32 ). - Entsprechend dem siebten Ausführungsbeispiel werden der elektrische Anschluß
2 , das Halbleitersubstrat7 und der Halbleiterchip1 elektrisch in dieser Reihenfolge verbunden. Daher kann die elektronische Schaltung vor dem Stoß, der während dem Kontaktieren erzeugt wird, geschützt werden. - Variante
- Obwohl ein Fall oben beschrieben wurde, bei dem die elektronische Schaltung auf der SOI-Struktur vorgesehen ist, kann die elektronische Schaltung auf einem Halbleitersubstrat vorgesehen sein, das keine SOI-Struktur sein muß. Beispielsweise können die obigen Ausführungsbeispiele bei einer Struktur angewendet werden, bei der ein MOS-Transistor
112 , der eine elektronische Schaltung bildet, auf einem Halbleitersubstrat13 gebildet ist, wie in34 gezeigt ist.
Claims (11)
- Halbleitervorrichtung mit einem Halbleitersubstrat (
13 ), einer auf dem Halbleitersubstrat (13 ) vorgesehenen elektronischen Schaltung (11a ), einem mit der elektronischen Schaltung (11a ) verbundenen Anschluß (121 ) und einem Metallverbindungsteil (3 ), das gemeinsam mit sowohl dem Anschluß (121 ) als auch einem Bereich einer Oberfläche des Halbleitersubstrates (13 ), der benachbart zu dem Anschluß (121 ) freigelegt ist, kontaktiert ist, und einer zwischen dem Verbindungsteil (3 ) und dem Halbleitersubstrat (13 ) gebildeten Diode mit der Oberfläche des Halbleitersubstrates (13 ) als eine der Elektroden. - Halbleitervorrichtung nach Anspruch 1, bei der das Metall mit dem Bereich einen Schottky-Übergang bildet.
- Halbleitervorrichtung nach Anspruch 1, bei der der Bereich einen Leitungstyp aufweist, der umgekehrt zu einem Leitungstyp des Halbleitersubstrates (
13 ) ist. - Halbleitervorrichtung nach Anspruch 3, weiter mit einem Isolierfilm (
14 ), der zwischen dem Halbleitersubstrat (13 ) und dem Anschluß (121 ) gebildet ist, der die elektronische Schaltung (11a ) umschließt und der benachbart zu dem Anschluß (121 ) zusammen mit dem Bereich freigelegt ist, und einem leitenden Teil (124 ), das über den Isolierfilm (14 ) und den Bereich gebildet ist. - Halbleitervorrichtung nach einem der Ansprüche 1 bis 4, bei der der Bereich in einer Mitte des Anschlusses (
121 ) vorgesehen ist. - Halbleitervorrichtung mit einem Halbleiterchip (
1 ), der ein Halbleitersubstrat (13 ), einen auf dem Halbleitersubstrat (13 ) gebildeten Isolierfilm (14 ) und eine auf dem Isolierfilm (14 ) gebildete Halbleiterschicht (111 ), die eine darauf gebildete elektronische Schaltung aufweist, aufweist, einem Schutzsubstrat (7 ) zum elektrischen Schützen der Halbleiterschicht (111 ), einem externen Anschluß (2 ), einem ersten Verbindungsteil (31 ) zum elektrischen Verbinden des Halbleiterchips (1 ) und des Schutzsubstrates (7 ) und einem zweiten Verbindungsteil (32 ) zum elektrischen Verbinden des Schutzsubstrates (7 ) und des externen Anschlusses (2 ). - Herstellungsverfahren einer Halbleitervorrichtung mit den Schritten: (a) Vorbereiten eines Halbleitersubstrates (
13 ), eines auf dem Halbleitersubstrat (13 ) gebildeten Isolierfilmes (14 ), einer Halbleiterschicht (111 ), die auf dem Isolierfilm (14 ) gebildet ist und eine darauf gebildete elektronische Schaltung (11a ) aufweist, eines Anschlusses (121 ), der mit der elektronischen Schaltung (11a ) verbunden ist, und eines externen Anschlusses (2 ), (b) Bilden einer Öffnung (122 ) auf dem Isolierfilm (14 ) derart, daß das Halbleitersubstrat (13 ) freigelegt wird, (c) Verbinden von einem der Enden eines Metallverbindungsteiles (3 ) mit dem externen Anschluß (2 ) und (d) Kontaktieren des anderen Endes des Verbindungsteiles (3 ) mit dem freigelegten Halbleitersubstrat (13 ) und dem Anschluß (121 ) . - Verfahren nach Anspruch 7, weiter mit einem Schritt (e) zwischen den Schritten (b) und (c) des Machens eines Leitungstyps einer Oberfläche des freigelegten Halbleitersubstrates (
13 ) verschieden von dem des Halbleitersubstrates (13 ). - Verfahren nach Anspruch 8, weiter mit einem Schritt (f) zwischen den Schritten (e) und (c) des Bildens eines leitenden Teiles (
124 ) von der Oberfläche des freigelegten Halbleitersubstrates (13 ) zu einer Seitenwand der Öffnung (122 ). - Halbleitervorrichtung nach einem der Ansprüche 1 bis 6, bei der die elektronische Schaltung (
11a ) auf einer SOI-Struktur vorgesehen ist. - Verfahren nach einem der Ansprüche 7 bis 9, bei der die elektronische Schaltung (
11a ) auf einer SOI-Struktur vorgesehen wird.
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---|---|---|---|---|
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EP1868423A1 (de) * | 1998-09-17 | 2007-12-19 | Ibiden Co., Ltd. | Mehrschichtige Leiterplatte |
JP2974022B1 (ja) * | 1998-10-01 | 1999-11-08 | ヤマハ株式会社 | 半導体装置のボンディングパッド構造 |
JP3217336B2 (ja) * | 1999-11-18 | 2001-10-09 | 株式会社 沖マイクロデザイン | 半導体装置 |
JP2002016065A (ja) * | 2000-06-29 | 2002-01-18 | Toshiba Corp | 半導体装置 |
US6887786B2 (en) * | 2002-05-14 | 2005-05-03 | Applied Materials, Inc. | Method and apparatus for forming a barrier layer on a substrate |
CN1601735B (zh) * | 2003-09-26 | 2010-06-23 | 松下电器产业株式会社 | 半导体器件及其制造方法 |
US7808115B2 (en) * | 2004-05-03 | 2010-10-05 | Broadcom Corporation | Test circuit under pad |
US7691127B2 (en) * | 2005-12-13 | 2010-04-06 | Cardiva Medical, Inc. | Drug eluting vascular closure devices and methods |
DE102007016257A1 (de) * | 2007-04-04 | 2008-10-09 | X-Fab Semiconductor Foundries Ag | Verfahren zur Herstellung eines elektrischen Trägerscheibenkontaktes mit vorderseitigem Anschluss |
JP2008199045A (ja) * | 2008-03-19 | 2008-08-28 | Seiko Epson Corp | 半導体装置およびその製造方法 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0622850A1 (de) * | 1993-04-30 | 1994-11-02 | International Business Machines Corporation | Schutzdiode gegen elektrostatische Entladungen in der Silizium-auf-Insulator-Technologie |
EP0838857A2 (de) * | 1996-10-22 | 1998-04-29 | International Business Machines Corporation | Elektrostatische Entladungsschutzvorrichtung |
Family Cites Families (22)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60247940A (ja) * | 1984-05-23 | 1985-12-07 | Hitachi Ltd | 半導体装置およびその製造方法 |
JPS6144454A (ja) * | 1984-08-09 | 1986-03-04 | Fujitsu Ltd | 半導体装置 |
JPH077783B2 (ja) * | 1988-03-18 | 1995-01-30 | 株式会社東芝 | 電気的接続部に銅もしくは銅合金製金属細線を配置する半導体装置 |
US5719448A (en) * | 1989-03-07 | 1998-02-17 | Seiko Epson Corporation | Bonding pad structures for semiconductor integrated circuits |
JP2617798B2 (ja) * | 1989-09-22 | 1997-06-04 | 三菱電機株式会社 | 積層型半導体装置およびその製造方法 |
US5113236A (en) * | 1990-12-14 | 1992-05-12 | North American Philips Corporation | Integrated circuit device particularly adapted for high voltage applications |
JP2550248B2 (ja) * | 1991-10-14 | 1996-11-06 | 株式会社東芝 | 半導体集積回路装置およびその製造方法 |
JP3211351B2 (ja) * | 1992-04-08 | 2001-09-25 | 関西日本電気株式会社 | 半導体装置 |
US5854085A (en) * | 1992-06-04 | 1998-12-29 | Lsi Logic Corporation | Multi-layer tab tape having distinct signal, power and ground planes, semiconductor device assembly employing same, apparatus for and method of assembling same |
JP3124144B2 (ja) * | 1993-01-27 | 2001-01-15 | 株式会社東芝 | 半導体装置 |
JP2944840B2 (ja) * | 1993-03-12 | 1999-09-06 | 株式会社日立製作所 | 電力用半導体装置 |
JPH077820A (ja) * | 1993-06-18 | 1995-01-10 | Takaoka Electric Mfg Co Ltd | 配電盤 |
EP0646959B1 (de) * | 1993-09-30 | 2001-08-16 | Consorzio per la Ricerca sulla Microelettronica nel Mezzogiorno | Verfahren zur Metallisierung und Verbindung bei der Herstellung von Leistungshalbleiterbauelementen |
US5382818A (en) * | 1993-12-08 | 1995-01-17 | Philips Electronics North America Corporation | Lateral semiconductor-on-insulator (SOI) semiconductor device having a buried diode |
JP2755148B2 (ja) * | 1993-12-28 | 1998-05-20 | ヤマハ株式会社 | 半導体装置 |
JPH07312424A (ja) * | 1994-05-18 | 1995-11-28 | Nippondenso Co Ltd | 半導体装置及びその製造方法 |
JPH0888323A (ja) * | 1994-09-19 | 1996-04-02 | Nippondenso Co Ltd | 半導体集積回路装置 |
EP0740853B1 (de) * | 1994-11-22 | 1999-01-13 | Koninklijke Philips Electronics N.V. | Halbleiter mit einem träger auf dem ein substrat mit einem halbleiter-element mittels einer klebeschicht und ein leiterbahn-muster befestigt sind |
US5661082A (en) * | 1995-01-20 | 1997-08-26 | Motorola, Inc. | Process for forming a semiconductor device having a bond pad |
JPH0923017A (ja) * | 1995-07-06 | 1997-01-21 | Mitsubishi Electric Corp | Soi入力保護回路 |
US5700735A (en) * | 1996-08-22 | 1997-12-23 | Taiwan Semiconductor Manufacturing Company, Ltd. | Method of forming bond pad structure for the via plug process |
JP3305211B2 (ja) * | 1996-09-10 | 2002-07-22 | 松下電器産業株式会社 | 半導体装置及びその製造方法 |
-
1998
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Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0622850A1 (de) * | 1993-04-30 | 1994-11-02 | International Business Machines Corporation | Schutzdiode gegen elektrostatische Entladungen in der Silizium-auf-Insulator-Technologie |
EP0838857A2 (de) * | 1996-10-22 | 1998-04-29 | International Business Machines Corporation | Elektrostatische Entladungsschutzvorrichtung |
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KR19990076526A (ko) | 1999-10-15 |
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