DE112013005829T5 - Kobaltbasierte Verbindungen und Verfahren zu ihrer Herstellung - Google Patents
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- 238000000034 method Methods 0.000 title claims abstract description 161
- GUTLYIVDDKVIGB-UHFFFAOYSA-N cobalt atom Chemical compound [Co] GUTLYIVDDKVIGB-UHFFFAOYSA-N 0.000 title claims abstract description 143
- 239000010941 cobalt Substances 0.000 title claims abstract description 142
- 229910017052 cobalt Inorganic materials 0.000 title claims abstract description 142
- 230000008569 process Effects 0.000 title description 89
- 150000001875 compounds Chemical class 0.000 title description 6
- 239000000945 filler Substances 0.000 claims abstract description 108
- 239000000758 substrate Substances 0.000 claims abstract description 42
- 239000000463 material Substances 0.000 claims description 97
- 210000001654 germ layer Anatomy 0.000 claims description 27
- 239000000203 mixture Substances 0.000 claims description 21
- 238000005240 physical vapour deposition Methods 0.000 claims description 19
- 238000000231 atomic layer deposition Methods 0.000 claims description 16
- 238000005229 chemical vapour deposition Methods 0.000 claims description 16
- 230000004888 barrier function Effects 0.000 claims description 14
- 229910052751 metal Inorganic materials 0.000 claims description 13
- 239000002184 metal Substances 0.000 claims description 13
- 238000001465 metallisation Methods 0.000 claims description 13
- 229910052710 silicon Inorganic materials 0.000 claims description 12
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 claims description 10
- 229910052732 germanium Inorganic materials 0.000 claims description 10
- 229910052757 nitrogen Inorganic materials 0.000 claims description 9
- 239000010703 silicon Substances 0.000 claims description 8
- 229910052719 titanium Inorganic materials 0.000 claims description 8
- 239000010936 titanium Substances 0.000 claims description 8
- 229910052715 tantalum Inorganic materials 0.000 claims description 7
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 claims description 7
- GNPVGFCGXDBREM-UHFFFAOYSA-N germanium atom Chemical compound [Ge] GNPVGFCGXDBREM-UHFFFAOYSA-N 0.000 claims description 6
- 229910052796 boron Inorganic materials 0.000 claims description 5
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 claims description 4
- 239000000126 substance Substances 0.000 claims description 3
- 238000005498 polishing Methods 0.000 claims description 2
- 238000007747 plating Methods 0.000 claims 2
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 claims 1
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 claims 1
- 229910052698 phosphorus Inorganic materials 0.000 claims 1
- 239000011574 phosphorus Substances 0.000 claims 1
- 229910000765 intermetallic Inorganic materials 0.000 abstract description 7
- 239000010410 layer Substances 0.000 description 171
- 238000000137 annealing Methods 0.000 description 27
- 150000001869 cobalt compounds Chemical class 0.000 description 22
- 238000004891 communication Methods 0.000 description 15
- 239000010949 copper Substances 0.000 description 12
- 239000000956 alloy Substances 0.000 description 11
- 229910052802 copper Inorganic materials 0.000 description 11
- 238000013508 migration Methods 0.000 description 11
- 230000005012 migration Effects 0.000 description 11
- 239000004065 semiconductor Substances 0.000 description 11
- 229910052721 tungsten Inorganic materials 0.000 description 10
- 229910052799 carbon Inorganic materials 0.000 description 9
- 229910045601 alloy Inorganic materials 0.000 description 8
- 238000000151 deposition Methods 0.000 description 8
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 7
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 7
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 6
- 238000013459 approach Methods 0.000 description 6
- 239000007789 gas Substances 0.000 description 6
- 238000004519 manufacturing process Methods 0.000 description 6
- 229910021332 silicide Inorganic materials 0.000 description 6
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 description 6
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 6
- 239000010937 tungsten Substances 0.000 description 6
- -1 but not limited to Substances 0.000 description 5
- 230000008021 deposition Effects 0.000 description 5
- 238000012545 processing Methods 0.000 description 5
- 239000010409 thin film Substances 0.000 description 5
- 229910000531 Co alloy Inorganic materials 0.000 description 4
- 229910052782 aluminium Inorganic materials 0.000 description 4
- 229910052786 argon Inorganic materials 0.000 description 4
- 229910052790 beryllium Inorganic materials 0.000 description 4
- 229910052793 cadmium Inorganic materials 0.000 description 4
- 229910052791 calcium Inorganic materials 0.000 description 4
- 229910052804 chromium Inorganic materials 0.000 description 4
- DDHRUTNUHBNAHW-UHFFFAOYSA-N cobalt germanium Chemical compound [Co].[Ge] DDHRUTNUHBNAHW-UHFFFAOYSA-N 0.000 description 4
- 239000004020 conductor Substances 0.000 description 4
- 238000009792 diffusion process Methods 0.000 description 4
- 238000005530 etching Methods 0.000 description 4
- 229910052735 hafnium Inorganic materials 0.000 description 4
- 229910052738 indium Inorganic materials 0.000 description 4
- 229910052741 iridium Inorganic materials 0.000 description 4
- 229910052749 magnesium Inorganic materials 0.000 description 4
- 229910052750 molybdenum Inorganic materials 0.000 description 4
- 229910052759 nickel Inorganic materials 0.000 description 4
- 229910052758 niobium Inorganic materials 0.000 description 4
- 229910052760 oxygen Inorganic materials 0.000 description 4
- 229910052763 palladium Inorganic materials 0.000 description 4
- 229910052697 platinum Inorganic materials 0.000 description 4
- 229910052702 rhenium Inorganic materials 0.000 description 4
- 229910052703 rhodium Inorganic materials 0.000 description 4
- 229910052709 silver Inorganic materials 0.000 description 4
- 229910052718 tin Inorganic materials 0.000 description 4
- 229910052720 vanadium Inorganic materials 0.000 description 4
- 229910052725 zinc Inorganic materials 0.000 description 4
- 229910052726 zirconium Inorganic materials 0.000 description 4
- 239000002131 composite material Substances 0.000 description 3
- 238000005137 deposition process Methods 0.000 description 3
- 238000009713 electroplating Methods 0.000 description 3
- 230000006870 function Effects 0.000 description 3
- 239000001257 hydrogen Substances 0.000 description 3
- 229910052739 hydrogen Inorganic materials 0.000 description 3
- 125000004435 hydrogen atom Chemical class [H]* 0.000 description 3
- 230000008018 melting Effects 0.000 description 3
- 238000002844 melting Methods 0.000 description 3
- 229910044991 metal oxide Inorganic materials 0.000 description 3
- 150000004706 metal oxides Chemical class 0.000 description 3
- 239000007787 solid Substances 0.000 description 3
- MZLGASXMSKOWSE-UHFFFAOYSA-N tantalum nitride Chemical compound [Ta]#N MZLGASXMSKOWSE-UHFFFAOYSA-N 0.000 description 3
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 2
- 229910000577 Silicon-germanium Inorganic materials 0.000 description 2
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 description 2
- LEVVHYCKPQWKOP-UHFFFAOYSA-N [Si].[Ge] Chemical compound [Si].[Ge] LEVVHYCKPQWKOP-UHFFFAOYSA-N 0.000 description 2
- 239000000853 adhesive Substances 0.000 description 2
- 230000001070 adhesive effect Effects 0.000 description 2
- 230000008901 benefit Effects 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 2
- 230000001351 cycling effect Effects 0.000 description 2
- 239000003989 dielectric material Substances 0.000 description 2
- 230000009977 dual effect Effects 0.000 description 2
- 230000005669 field effect Effects 0.000 description 2
- SCCCLDWUZODEKG-UHFFFAOYSA-N germanide Chemical compound [GeH3-] SCCCLDWUZODEKG-UHFFFAOYSA-N 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- 239000011229 interlayer Substances 0.000 description 2
- 230000006911 nucleation Effects 0.000 description 2
- 238000010899 nucleation Methods 0.000 description 2
- 125000006850 spacer group Chemical group 0.000 description 2
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- 239000005749 Copper compound Substances 0.000 description 1
- 229910052581 Si3N4 Inorganic materials 0.000 description 1
- 229910004298 SiO 2 Inorganic materials 0.000 description 1
- 125000004429 atom Chemical group 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
- 239000000356 contaminant Substances 0.000 description 1
- 150000001880 copper compounds Chemical class 0.000 description 1
- 230000002939 deleterious effect Effects 0.000 description 1
- 239000002019 doping agent Substances 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000005670 electromagnetic radiation Effects 0.000 description 1
- 230000002349 favourable effect Effects 0.000 description 1
- 238000005429 filling process Methods 0.000 description 1
- 239000010408 film Substances 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 238000011065 in-situ storage Methods 0.000 description 1
- 230000001939 inductive effect Effects 0.000 description 1
- 239000011810 insulating material Substances 0.000 description 1
- 238000010849 ion bombardment Methods 0.000 description 1
- 230000007774 longterm Effects 0.000 description 1
- 238000004377 microelectronic Methods 0.000 description 1
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 1
- 150000004767 nitrides Chemical class 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 238000002203 pretreatment Methods 0.000 description 1
- 239000000377 silicon dioxide Substances 0.000 description 1
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 1
- 238000005477 sputtering target Methods 0.000 description 1
- 238000003860 storage Methods 0.000 description 1
- 238000000427 thin-film deposition Methods 0.000 description 1
- 238000012546 transfer Methods 0.000 description 1
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Abstract
Beschrieben werden eine Kobalt umfassende metallische Verbindung und ein Verfahren zum Ausbilden einer kobaltbasierten metallischen Verbindung. In einer Ausführungsform weist eine Kobalt umfassende metallische Verbindung eine dielektrische Schicht, die auf einem Substrat angeordnet ist, und eine Öffnung auf, die so in der dielektrischen Schicht ausgebildet ist, dass das Substrat freiliegt. Weiterhin weist die Ausführungsform eine Keimschicht, die über dem Substrat angeordnet ist, und ein Kobalt umfassendes Füllmaterial auf, das innerhalb der Öffnung und auf einer Oberfläche der Keimschicht ausgebildet ist.
Description
- GEBIET DER ERFINDUNG
- Ausführungsformen der vorliegenden Erfindung beziehen sich allgemein auf metallische Verbindungsstrukturen und entsprechende Verfahren zu ihrer Herstellung. Insbesondere beziehen sich Ausführungsformen der vorliegenden Erfindung auf kobaltbasierte Verbindungsstrukturen und entsprechende Verfahren zu ihrer Herstellung.
- HINTERGRUND DER ERFINDUNG
- Typischerweise weisen integrierte Schaltungsvorrichtungen (IC) Schaltungselemente wie Transistoren, Kondensatoren und Widerstände auf, die innerhalb eines oder auf einem Halbleitersubstrat(s) ausgebildet sind. Verbindungsstrukturen dienen dazu, die diskreten Schaltungselemente zu funktionalen Schaltungen zusammenzuschalten oder zu verbinden. Typische metallische Verbindungen können einen Leiterbahnanteil und einen Kontaktdurchgangsanteil umfassen.
- Derzeit werden Verbindungsstrukturen aus Kupfer hergestellt und können eine Sperrschicht wie Titan oder Tantal oder Nitridmaterialien wie Tantalnitrid oder Titannitrid oder eine Kombination aus diesen (z. B. Tantalnitrid/Tantal (TNT)) aufweisen. Ein Problem bei der Verwendung von Verbindungsstrukturen aus Kupfer besteht darin, dass sie sehr anfällig für Elektronenwanderung sind, was zu Hohlraumbildung und Ausfall führen kann.
- Wolframmetallisierung wurde erfolgreich benutzt, um Vorderseitenkontakte herzustellen, und wurde daher für die Rückseitenmetallisierung für die Verbindungsherstellung vorgeschlagen. Ein wünschenswerter Vorteil bei der Verwendung von Wolframmetallisierung besteht darin, dass sie äußerst widerstandsfähig gegen schädliche Elektronenwanderungseffekte ist. Ein Nachteil bei der Verwendung von Wolframmetallisierung besteht jedoch darin, dass der elektrische Widerstand höher als der von Kupfer ist. Insbesondere sind die Widerstände von Wolframleitungen 4 bis 6 Mal höher als die von Kupferverbindungen, und die Widerstände von Kontaktdurchgängen können um bis zu 20% höher sein. Diese hohen Widerstände verschlechtern in erheblicher Weise die Leistung integrierter Schaltungen und sind daher nicht wünschenswert.
- KURZE BESCHREIBUNG DER ZEICHNUNGEN
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- AUSFÜHRLICHE BESCHREIBUNG DER ERFINDUNG
- Ausführungsformen der vorliegenden Erfindung beziehen sich auf Kobaltverbindungen und Verfahren zur Herstellung von Kobaltverbindungen. Zu beachten ist, dass verschiedene Ausführungsformen unter Hinweis auf die Abbildungen beschrieben werden. Bestimmte Ausführungsformen lassen sich jedoch ohne eine oder mehrere dieser speziellen Einzelheiten oder in Kombination mit anderen bekannten Verfahren und Konfigurationen realisieren. In der folgenden Beschreibung werden zahlreiche spezielle Einzelheiten dargelegt, etwa spezielle Konfigurationen, Abmessungen, Prozesse usw., um ein gründliches Verständnis der vorliegenden Erfindung zu vermitteln. In anderen Fällen wurden bekannte Halbleiterprozesse und Fertigungstechnik nicht mit besonderer Ausführlichkeit beschrieben, um das Verständnis der vorliegenden Erfindung nicht unnötigerweise zu erschweren. Der Hinweis in dieser Beschreibung auf „eine einzige Ausführungsform”, „eine Ausführungsform” oder dergleichen bedeutet, dass ein(e) besondere(s) Merkmal, Struktur, Konfiguration oder Eigenschaft, das/die im Zusammenhang mit der Ausführungsform beschrieben wird, in wenigstens einer Ausführungsform der Erfindung vorkommt. Der Ausdruck „bei einer Ausführungsform” oder „in einer Ausführungsform” an diversen Stellen in der Beschreibung bezieht sich somit nicht notwendigerweise immer auf dieselbe Ausführungsform. Ferner können die Merkmale, Strukturen, Konfigurationen oder Kennzeichen auf jede geeignete Weise in einer oder mehreren Ausführungsform(en) kombiniert werden.
- Die Begriffe „über”, „zu”, „zwischen” und „auf”, wie sie in diesem Dokument verwendet werden, beziehen sich auf eine relative Position einer Schicht in Bezug auf andere Schichten. Eine Schicht, die „über” oder „auf” einer anderen Schicht ist oder an eine andere Schicht „gebondet” ist, kann in direktem Kontakt mit der anderen Schicht sein oder eine oder mehrere dazwischenliegende Schichten haben. Eine Schicht „zwischen” Schichten kann direkt in Kontakt mit den Schichten sein oder eine oder mehrere dazwischenliegende Schichten haben.
- Eine Ausführungsform der Erfindung ist eine Kobaltverbindung, die eine Kobaltkeimschicht und ein Kobaltfüllmaterial aufweist. Die Keimschicht ist mit einer anderen Zusammensetzung und/oder durch einen anderen Prozess ausgebildet als die, welche zur Ausbildung des Kobaltfüllmaterials benutzt wird/werden. Eine andere Ausführungsform ist eine Kobaltverbindung, die eine Kobaltsteckerschicht und ein Kobaltfüllmaterial aufweist. Die Steckerschicht ist mit einer anderen Zusammensetzung und/oder durch einen anderen Prozess ausgebildet als die, welche zur Ausbildung des Kobaltfüllmaterials benutzt wird/werden. Derartige Kobaltverbindungen sind vorteilhaft, da sie einen niedrigen Widerstand haben (z. B. weniger als Wolfram) und sehr widerstandsfähig gegen Elektronenwanderung sind (z. B. widerstandsfähiger gegen Elektronenwanderung als Kupfer), was die Herstellung von Hochleistungsverbindungsstrukturen ermöglicht.
- Ein weiterer Vorteil ist, dass Kobaltverbindungen keine Sperrschichten benötigen, die ansonsten benutzt werden, um Kupfermigration zu verhindern. Da die Abmessungen bei der Herstellung herkömmlicher Verbindungen skaliert werden, kann der hohe Widerstand derartiger Sperrschichten die Leistung herkömmlicher Kupferverbindungen in größerem Maße beeinträchtigen.
- Gemäß einem ersten Aspekt wird eine konforme kobaltbasierte Keimschicht in einer Öffnung in einer dielektrischen Schicht ausgebildet. Ein kobaltbasiertes Füllmaterial wird dann auf die kobaltbasierte Keimschicht aufgebracht oder auf ihr gezüchtet, um eine Kobaltverbindung auszubilden.
- Beispielsweise veranschaulichen
106 mit einer Oberseite118 , die als Substrat benutzt werden kann, auf dem eine Kobaltverbindung ausgebildet werden kann. Substrat106 kann einen beliebigen Anteil einer teilgefertigten integrierten Schaltung (IC) aufweisen, auf der letztlich eine Kobaltverbindung hergestellt wird. Typischerweise weist beispielsweise Substrat106 aktive und passive Vorrichtungen auf, oder diese sind auf Substrat106 ausgebildet. Wie in150 in Substrat106 vorhanden, auf der letztlich eine Kobaltverbindung ausgebildet wird. In einer derartigen Ausführungsform wurde das Substrat106 im Front-End-Of-Line (FEOL) verarbeitet, und die leitfähige Region150 ist eine Diffusionsregion, die in einem kristallinen Halbleitersubstrat oder einer kristallinen Halbleiterschicht ausgebildet ist; beispielsweise ist die leitfähige Region eine Source- oder Drainregion eines Transistors. In einer anderen derartigen Ausführungsform ist die leitfähige Region150 eine zugrunde liegende Metallleiterbahn in einer Back-End-Of-Line-Metallisierungsstruktur (BEOL), wie ausführlicher weiter unten im Zusammenhang mit - Erneut Bezug nehmend auf
102 über dem Substrat106 ausgebildet. Die dielektrische Schicht102 kann aus jedem geeigneten dielektrischen oder isolierenden Material wie u. a. Siliziumdioxid, SiOF, kohlenstoffdotiertem Oxid, einem Glas- oder einem Polymermaterial bestehen. In der dielektrischen Schicht wird eine Öffnung ausgebildet. Die Öffnung legt die leitfähige Region150 frei, mit der durch eine Kobaltverbindung letztlich Kontakt hergestellt wird. In einer Ausführungsform, wie sie in114 (z. B. eine Kontaktdurchgangsbohrung oder einen Kontaktdurchgangsschlitz) mit Seitenwänden116 und eine obere Öffnung110 (z. B. einen metallischen Leiterbahngraben) mit Seitenwänden112 auf, wie dies bei einem Dual-Damascene-Prozess üblich ist. Obwohl zwei Öffnungen dargestellt sind, ist dies so zu verstehen, dass stattdessen auch eine einzige Öffnung in der dielektrischen Schicht102 ausgebildet werden kann, wie sie z. B. bei einem Single-Damascene-Ansatz Anwendung findet, bei dem nur eine Leiterbahn oder ein Kontaktdurchgang, jedoch nicht beide, in einem einzigen Vorgang gefertigt wird. Die Öffnung oder Öffnungen können in der dielektrischen Schicht102 mittels bekannten lithographischen und Ätzungstechniken hergestellt werden, die typischerweise bei der Fertigung mittels Damascene- und Dual-Damascene-Prozess benutzt werden. Obwohl nur eine dielektrische Schicht102 dargestellt ist, können stattdessen auch mehrere Schichten der gleichen oder anderer dielektrischer Materialien benutzt werden, z. B. eine erste dielektrische Schicht mit einer Öffnung114 darin und eine zweite dielektrische Schicht mit einer Öffnung112 darin. Zudem ist in einer Ausführungsform und wie in102 auf einer Ätzstoppschicht104 ausgebildet, die auf Substrat106 angeordnet ist. Die Ätzstoppschicht104 kann aus einem Material wie Siliziumnitrid oder Siliziumoxynitrid gebildet sein. - Bezug nehmend auf
120 aufgebracht. Es lässt sich verstehen, dass vor dem Aufbringen der Keimschicht120 eine Haft-/Sperrschicht ausgebildet werden kann, z. B. eine Tantalnitrid-/Tantalschicht (TNT) oder eine Titannitrid/Titanschicht. In einer anderen Ausführungsform wird jedoch keine Haft- und/oder Sperrschicht benutzt, und die Keimschicht120 wird direkt auf der dielektrischen Schicht102 und direkt auf der leitfähigen Region150 ausgebildet. Die Keimschicht120 kann auf einer Oberseite108 der dielektrischen102 sowie auf der freiliegenden Oberseite118 des Substrats106 (z. B. auf der leitfähigen Region150 ) ausgebildet sein. Die Kobaltkeimschicht120 wird auch an den Seitenwänden116 der oberen Öffnung114 und den Seitenwänden112 der unteren Öffnung110 ausgebildet. Die Keimschicht120 kann eine konforme Schicht sein, die sich aus einem Material einschließlich Kobalt zusammensetzt. In einer Ausführungsform ist die Kobaltkeimschicht120 in einer Dicke von weniger als 3 nm und typischerweise 1 nm bis 3 nm ausgebildet. Die Keimschicht120 kann als Keimbildungsschicht für das Wachstum der nachfolgenden Füllmaterialien dienen. In einer Ausführungsform setzt sich die Keimschicht120 im Wesentlichen, wenn nicht sogar vollständig, aus Kobalt zusammen. Beispielsweise setzt sich die Keimschicht in einer speziellen derartigen Ausführungsform aus mindestens 50% Kobalt zusammen. „%” der Zusammensetzung bezieht sich hier auf Atom-%. In einer besonderen Ausführungsform setzt sich die Keimschicht aus mindestens 90% Kobalt zusammen. In jedem dieser Fälle kann der nicht aus Kobalt bestehende Rest der Keimschichtzusammensetzung, falls zutreffend, eines oder mehrere der Elemente Al, Ni, Cu, Ag, Au, Mn, Ti, V, Cr, Fe, Ta, W, Ru, P, B, C, N, Si, Ge, Mg, Zn, Rh, Pt, Cd, Hf, In, Sn, C, O, Be, Ca, Zr, Nb, Mo, Ir, Re oder Pd aufweisen. In einer anderen Ausführungsform setzt sich die Keimschicht120 aus einem kobaltbasierten Verbund- oder Legierungsmaterial zusammen. Beispielsweise setzt sich in einer Ausbildungsform die Keimschicht120 aus einer schwachen Legierung zusammen, die sich aus circa 0,25–5% eines anderen Elements als Kobalt, wie etwa den oben aufgeführten, zusammensetzt, wobei für die restlichen circa 95+% Kobalt verwendet wird. Eine derartige schwache Legierung kann entweder während des Aufbringens oder der Verarbeitung nach dem Aufbringen Migration der nicht aus Kobalt bestehenden Spezies auf Kobaltflächen oder -grenzflächen implizieren. Die Migration kann eine Diffusionsbarriere für das Kobalt bieten und/oder benutzt werden, um die Haftung des Kobalts an den anderen Schichten zu verbessern. Korngrenzen innerhalb des Kobalts können ebenfalls mit den nicht aus Kobalt bestehenden Spezies gefüllt werden. In anderen Ausführungsformen kann die Keimschicht120 jedoch auch weniger als 50% Kobalt aufweisen, wird jedoch immer noch als kobaltbasiertes Material bezeichnet. Zu beispielhaften Ausführungsformen von Keimschichten auf kobaltbasierten Verbindungen zählen Kobaltsilizid- oder Kobaltgermanid-Keimschichten. In einer speziellen derartigen Ausführungsform weist die leitfähige Region150 mindestens ein wenig Germanium (z. B. eine freiliegende dotierte Silizium-Germanium- oder dotierte Germaniumregion oder Metallgermanidregion) auf, und die Keimschicht120 ist eine kompatible Kobaltgermanid-Schicht. In einer weiteren speziellen derartigen Ausführungsform weist die leitfähige Region150 mindestens ein wenig Silizium (z. B. eine freiliegende dotierte Siliziumregion oder eine Metallsilizidregion) auf, und die Keimschicht120 ist eine kompatible Kobaltsilizid-Schicht. Zu den beispielhaften Ausführungsformen von Keimschichten aus kobaltbasierten Legierungen zählt Kobalt legiert mit einem oder mehreren der folgenden Elemente: Al, Ni, Cu, Ag, Au, Mn, Ti, V, Cr, Fe, Ta, W, Ru, P, B, C, N, Si, Ge, Mg, Zn, Rh, Pt, Cd, Hf, In, Sn, C, O, Be, Ca, Zr, Nb, Mo, Ir, Re oder Pd. In den oben beschriebenen Ausführungsformen kann die Kobaltkeimschicht120 eine kleinkörnige Struktur haben. - Die Keimschicht
120 kann aufgebracht oder gezüchtet werden durch chemisches Aufdampfen (Chemical Vapor Deposition – CVD), Atomlagenabscheidung (Atomic Layer Deposition – ALD), physikalische Gasphasenabscheidung (Physical Vapor Deposition – PVD), Galvanisieren, nichtgalvanische Metallisierung oder einen sonstigen geeigneten Prozess, der konforme Dünnschichten aufbringt. In einer Ausführungsform wird die Kobaltkeimschicht120 so aufgebracht, dass sie eine hochqualitative konforme Schicht ausbildet, die ausreichend und gleichmäßig alle freiliegenden Flächen innerhalb der Öffnungen und Oberseiten bedeckt. Die hochqualitative Keimschicht kann in einer Ausführungsform ausgebildet werden, indem das Kobaltkeimmaterial mit einer langsamen Aufbringungsrate aufgebracht wird, um die konforme Keimschicht gleichmäßig und konsistent aufzubringen. Durch Ausbilden der Keimschicht120 in konformer Weise kann die Kompatibilität eines anschließend ausgebildeten Füllmaterials mit der zugrunde liegenden Struktur verbessert werden. Insbesondere kann die Keimschicht120 einen Aufbringungsprozess unterstützen, indem sie eine geeignete Oberflächenenergetik für die Abscheidung darauf schafft. - Die Aufbringungsrezepte für Dünnschichten, die Prozesse wie CVD, ALD und PVD benutzen, können je nach gewünschter Prozesszeit, Dicke und Konformitätsqualität variieren. Wenn beispielsweise CVD für die Abscheidung benutzt wird, kann die Keimschicht
120 eine konforme Dünnschicht schneller schaffen, als ein ALD-Prozess benötigen würde, um die gleiche Schicht aufzubringen; doch die Qualität der durch den CVD-Prozess aufgebrachten Dünnschicht kann geringer sein als die Qualität der durch den ALD-Prozess aufgebrachten Dünnschicht. In einer anderen Ausführungsform wird die Keimschicht120 durch einen PVD-Prozess aufgebracht. Der PVD-Prozess kann mit einem erhöhten Abstand zwischen dem aufnehmenden Substrat und dem entsprechenden Sputterziel durchgeführt werden, um eine hochkonforme Dünnschicht auszubilden. - Bezug nehmend auf
122 auf den freiliegenden Oberflächen der Keimschicht120 ausgebildet werden, so dass das Füllmaterial122 vollständig die Öffnungen110 und114 ausfüllt und auf der Oberseite der Kobaltkeimschicht120 auf der Oberseite108 des Dielektrikums102 ausgebildet wird. Eine Naht124 kann innerhalb der Öffnungen110 ,114 während des Aufbringens des Füllmaterials122 ausgebildet werden. In einer Ausführungsform kann Füllmaterial122 mit einem der vorgenannten Elemente dotiert oder legiert werden, die mit der Keimschicht120 legierbar sind. Beispielsweise setzt sich in einer Ausbildungsform das Füllmaterial122 aus einer schwachen Legierung zusammen, die sich aus circa 0,25–5% eines anderen Elements als Kobalt, wie etwa den oben aufgeführten, zusammensetzt, wobei für die restlichen circa 95+% Kobalt verwendet wird. Eine derartige schwache Legierung kann entweder während des Aufbringens oder der Verarbeitung nach dem Aufbringen Migration der nicht aus Kobalt bestehenden Spezies auf Kobaltflächen oder -grenzflächen implizieren. Die Migration kann eine Diffusionsbarriere für das Kobalt bieten und/oder benutzt werden, um die Haftung des Kobalts an den anderen Schichten zu verbessern. Korngrenzen innerhalb des Kobalts können ebenfalls mit den nicht aus Kobalt bestehenden Spezies gefüllt werden. In einer Ausführungsform setzt sich das Füllmaterial122 im Wesentlichen nur aus Kobalt zusammen. In einer anderen Ausführungsform ist das Füllmaterial122 zu mindestens 90% Kobalt. In noch einer anderen Ausführungsform setzt sich das Füllmaterial122 zu mindestens 50% aus Kobalt zusammen. - Das Füllmaterial
122 kann anders zusammengesetzt sein als die Keimschicht120 . Beispielsweise kann die Keimschicht120 sowohl aus Silizium als auch Kobalt zusammengesetzt sein, während sich das Füllmaterial122 nur aus Kobalt zusammensetzt. In einem anderen Beispiel kann die Keimschicht120 aus einer ersten kobaltbasierten Legierung (wie die oben beschriebenen) zusammengesetzt sein, während das Füllmaterial122 aus einer anderen, zweiten Legierung wie etwa einer kobaltbasierten Legierung zusammengesetzt sein kann. In einer Ausführungsform kann das Füllmaterial122 eine andere Kornstruktur als die Keimschicht120 haben. Beispielsweise kann die Keimschicht120 eine kleinere Kornstruktur als die Kornstruktur des Füllmaterials122 haben. - In einer Ausführungsform der Erfindung kann das Kobaltfüllmaterial
122 durch einen Prozess wie u. a. CVD, ALD, PVD, Galvanisieren oder nichtgalvanische Metallisierung ausgebildet werden. In einer Ausführungsform kann sich das zum Ausbilden des Füllmaterials122 benutzte Prozessverfahren vom Prozess unterscheiden, der zum Ausbilden der Keimschicht120 benutzt wird. Weiterhin kann die Keimschicht120 konform ausgebildet werden, während das Füllmaterial122 gemäß einem nichtkonformen oder Bottom-up-Ansatz ausgebildet wird. Beispielsweise kann die Keimschicht120 durch einen ALD-Aufbringungsprozess ausgebildet werden, der eine konforme Schicht auf freiliegenden Flächen des aufnehmenden Substrats ausbildet, während das Füllmaterial122 durch einen PVD-Prozess ausgebildet wird, der das Füllmaterial gerichtet auf die Oberflächen der Keimschicht120 sputtert, mit höheren Aufbringungsraten auf den ebenen Flächen als auf Seitenflächen. In einem anderen Beispiel kann die Keimschicht120 durch einen ALD-Aufbringungsprozess ausgebildet werden, der eine konforme Schicht auf freiliegenden Oberflächen des aufnehmenden Substrats ausbildet, während das Füllmaterial122 durch einen Galvanisierprozess ausgebildet werden kann, der das Füllmaterial aus Flächen der Keimschicht120 züchtet. In noch einem anderen Beispiel kann die Keimschicht120 durch einen CVD-Aufbringungsprozess und das Füllmaterial durch einen PVD-Prozess ausgebildet werden. - In einer anderen Ausführungsform können die Keimschicht
120 und das Füllmaterial122 durch denselben Prozess (z. B. ALD, CVD oder PVD), jedoch mit unterschiedlichen Aufbringungsparametern wie Druck, Aufbringungsrate, Temperatur usw., aufgebracht werden. Beispielsweise können die Keimschicht120 und das Füllmaterial122 durch einen CVD-Prozess aufgebracht werden; wobei sich jedoch die bei der CVD-Verarbeitung für die Keimschicht benutzte Parametergruppe, wie Aufbringungsdruck und -temperatur, von der bei der CVD-Verarbeitung für das Füllmaterial122 benutzten Parametergruppe unterscheiden kann. In einem anderen Beispiel werden die Keimschicht und das Füllmaterial durch einen PVD-Prozess ausgebildet, doch kann die Keimschicht durch einen PVD-Prozess mit einem größeren Abstand zwischen dem Ziel und dem aufnehmenden Substrat als beim PVD-Prozess ausgebildet werden, der zum Ausbilden des Füllmaterials benutzt wird. In einer anderen Ausführungsform wird das metallische Füllmaterial durch einen in Kolonnen erfolgenden PVD-Prozess ausgebildet, während die Keimschicht durch einen nicht in Kolonnen erfolgenden PVD-Prozess ausgebildet wird. Oder alternativ wird die Keimschicht durch einen ALD-Prozess mit einer geringeren Aufbringungsrate ausgebildet als der Aufbringungsrate des ALD-Prozesses, die zum Ausbilden des Füllmaterials122 benutzt wird, so dass die Keimschicht120 konformer als das Füllmaterial122 ausgebildet wird. - Bezug nehmend auf
124 in110 und114 in der dielektrischen Schicht102 ausgebildet wird. Der Glühprozess kann dazu beitragen, größere Kornstrukturen innerhalb des Füllmaterials122 zu züchten, was den Widerstand reduziert und Verunreinigungen aus schlechten Kornstrukturen austreibt. In einer Ausführungsform benutzt der Glühprozess Formiergase, etwa u. a. Gase wie Stickstoff, Wasserstoff und Argon. Weiterhin kann der Glühprozess bei einer Temperatur durchgeführt werden, die niedriger als der Wärmehaushalt der Backend-Strukturen ist. Beispielsweise wird der Glühprozess in einer Ausführungsform bei 300°C bis 400°C durchgeführt. In einer anderen Ausführungsform wird der Glühprozess bei einer Temperatur ausgeführt, die höher als der Schmelzpunkt des Füllmaterials122 , jedoch niedriger als der Wärmehaushalt der Backend-Strukturen ist. - In noch einer anderen Ausführungsform kann optional ein Zyklusverfahren benutzt werden, um die Verbindungsschicht
122 innerhalb der Öffnungen114 und110 ohne die Naht124 aufzubringen. Ein Zyklus kann eine Aufbringung des Füllmaterials122 und einen Glühprozess implizieren. Der Glühvorgang eines Zyklus kann auf eine Temperatur und Zeitdauer eingestellt werden, um kurz das Füllmaterial aufzuschmelzen, um die Kantenabdeckung zu optimieren. Der Aufbringungsvorgang eines Zyklus kann ein kurzes Aufbringen sein, um weniger Füllmaterial aufzubringen, so dass mehrere Vorgänge erforderlich sind, um die Kontaktdurchgangs- und Leiterbahnöffnungen114 und110 vollständig zu füllen. In einer Ausführungsform sind weniger als 5 Zyklen notwendig, um das Füllmaterial122 ohne eine Naht124 aufzubringen. - Bezug nehmend auf
122 und die Keimschicht120 zu entfernen, die oberhalb der Oberseite108 der dielektrischen Schicht102 angeordnet sind. In einer Ausführungsform kann der CMP-Prozess ein zeitgesteuerter CMP-Prozess sein, der zeitlich so gesteuert wird, dass er an der Oberseite108 der dielektrischen Schicht der Leiterbahn stoppt. In einer anderen Ausführungsform kann der CMP-Prozess die Oberseite108 der dielektrischen Schicht der Leiterbahn als Stoppschicht benutzen. Da die Dicke des oberhalb der Oberseite der dielektrischen Schicht der Leiterbahn aufgebrachten Füllmaterials variieren kann, kann die Benutzung der Oberseite108 als Stoppschicht ein zuverlässigeres Verfahren sein. In einer alternativen Ausführungsform wird ein Ätzprozess benutzt, um das Füllmaterial122 und die Keimschicht120 zu entfernen, die oberhalb der Oberseite108 der dielektrischen Schicht102 angeordnet sind. -
200 eines Anteils einer IC-Struktur mit kobaltbasierten metallischen Verbindungen gemäß einer Ausführungsform der vorliegenden Erfindung. Ein Stapel dielektrischer Schichten102 weist metallische Verbindungen124 auf, die Keimschichten120 und metallische Füllschichten124 haben. Der Anteil der in -
300 , das ein Verfahren zur Ausbildung einer kobaltbasierten metallischen Verbindung gemäß einer Ausführungsform der vorliegenden Erfindung veranschaulicht. Bei302 wird eine Öffnung in einer dielektrischen Schicht ausgebildet, um eine leitfähige Region in einem Substrat freizulegen. Bei304 wird eine Kobaltkeimschicht über dem Substrat in Kontakt mit der leitfähigen Region sowie über der dielektrischen Schicht und an Seitenwänden der Öffnung ausgebildet. Bei306 wird ein Füllmaterial auf der Keimschicht ausgebildet und füllt die Öffnung. Das Füllmaterial setzt sich aus einem kobaltbasierten Material zusammen. Bei308 wird in einer optionalen Ausführungsform Wärme beaufschlagt, um das Füllmaterial aufzuschmelzen. Bei310 werden das Füllmaterial und das Keimschichtmaterial, die oberhalb einer Oberseite der dielektrischen Schicht angeordnet sind, entfernt. In einer derartigen Ausführungsform weisen das Füllmaterial und die Keimschicht beide Kobalt auf, haben jedoch unterschiedliche Zusammensetzungen. In einer anderen derartigen Ausführungsform weisen das Füllmaterial und die Keimschicht beide Kobalt auf, werden jedoch durch unterschiedliche Aufbringungs- oder Zuchtverfahren ausgebildet. In noch einer anderen derartigen Ausführungsform weisen das Füllmaterial und die Keimschicht beide Kobalt auf, haben jedoch unterschiedliche Materialzusammensetzungen und werden durch unterschiedliche Aufbringungs- oder Zuchtverfahren ausgebildet. - In einem zweiten Aspekt wird ein kobaltbasierter Stecker in einem unteren Anteil (z. B. einer Kontaktdurchgangsbohrung oder einem Kontaktdurchgangsschlitz) einer Öffnung in einer dielektrischen Schicht ausgebildet. Eine kobaltbasierte leitfähige Leiterbahn wird dann auf dem kobaltbasierten Stecker in einem oberen Anteil (z. B. einem metallischen Leiterbahngraben) der Öffnung ausgebildet, um eine Kobaltverbindung auszubilden.
- Beispielsweise veranschaulichen
- Bezug nehmend auf
420 in der leitfähigen Region150 des Substrats106 ausgebildet. In einer Ausführungsform wird der Stecker420 wie dargestellt innerhalb der unteren Öffnung114 der dielektrischen Schicht102 so ausgebildet, dass die untere Öffnung114 vollständig mit dem Steckermaterial420 gefüllt wird. In einer anderen Ausführungsform kann die Oberseite des Steckers420 jedoch nicht planar mit der Oberseite der unteren Öffnung114 sein. Beispielsweise kann die Oberseite des Steckers420 höher oder niedriger als die Oberseite der unteren Öffnung sein. In einer anderen Ausführungsform kann die Oberseite des Steckers420 eine pilzförmige Wölbung infolge des Wachstumsprofils während der Ausbildung des Steckers420 ausbilden. - In einer Ausführungsform ist der Stecker
420 gemäß einem Bottom-up-Ansatz ausgebildet. Dies bedeutet, dass der Stecker420 nicht durch konformes Aufbringen über der Struktur in420 durch selektives Aufbringen auf die oder Züchten aus der Fläche der leitfähigen Region150 . In einer speziellen Ausführungsform wird der Stecker420 durch nichtgalvanische Metallisierung des Steckermaterials auf eine freiliegende und kompatible Fläche der leitfähigen Region150 ausgebildet. Beispielsweise hat die leitfähige Region150 eine obere metallisierte Fläche oder eine Fläche, die Metall wie Kobalt (Co), Kupfer (Cu) oder Wolfram (W) enthält, und ein kobaltbasierter Stecker420 wird durch nichtgalvanisches Aufbringen ausgebildet, das Bottom-up-Züchten aus der metallisierten oder Metall enthaltenden Fläche der leitfähigen Region150 impliziert. Bei einem derartigen Prozess wird die metallisierte oder Metall enthaltende Fläche der leitfähigen Region150 als Keimbildungsort für das Material des Steckers420 benutzt. In anderen Ausführungsformen können andere Bottom-up-Füll- und -Wachstumsaufbringungsansätze wie u. a. Galvanisieren benutzt werden. Ein Bottom-up-Füllansatz ist ein Ansatz, bei dem eine Aufbringungsrate schneller auf planaren oder flachen Flächen als an senkrechten Seitenwänden ist. - Der Stecker
420 kann ein kobaltbasierter Stecker sein, der sich aus mindestens 50% Kobalt zusammensetzt. „%” der Zusammensetzung bezieht sich hier auf Atom-%. In einer besonderen Ausführungsform setzt sich der Stecker420 aus mindestens 90% Kobalt zusammen. In jedem dieser Fälle kann der nicht aus Kobalt bestehende Rest der Zusammensetzung des Steckers420 , falls zutreffend, eines oder mehrere der Elemente Al, Ni, Cu, Ag, Au, Mn, Ti, V, Cr, Fe, Ta, W, Ru, P, B, C, N, Si, Ge, Mg, Zn, Rh, Pt, Cd, Hf, In, Sn, C, O, Be, Ca, Zr, Nb, Mo, Ir, Re oder Pd aufweisen. In einer anderen Ausführungsform setzt sich der Stecker420 aus einem kobaltbasierten Verbund- oder Legierungsmaterial zusammen. Beispielsweise setzt sich in einer Ausbildungsform der Stecker420 aus einer schwachen Legierung zusammen, die sich aus circa 0,25–5% eines anderen Elements als Kobalt, wie etwa den oben aufgeführten, zusammensetzt, wobei für die restlichen circa 95+% Kobalt verwendet wird. Eine derartige schwache Legierung kann entweder während des Aufbringens oder der Verarbeitung nach dem Aufbringen Migration der nicht aus Kobalt bestehenden Spezies auf Kobaltflächen oder -grenzflächen implizieren. Die Migration kann eine Diffusionsbarriere für das Kobalt bieten und/oder benutzt werden, um die Haftung des Kobalts an den anderen Schichten zu verbessern. Korngrenzen innerhalb des Kobalts können ebenfalls mit den nicht aus Kobalt bestehenden Spezies gefüllt werden. In anderen Ausführungsformen kann der Stecker420 jedoch auch weniger als 50% Kobalt aufweisen, wird jedoch immer noch als kobaltbasiertes Material bezeichnet. Zu beispielhaften Ausführungsformen von kobaltbasierten Verbundmaterialien für den Stecker420 zählen Kobaltsilizid- oder Kobaltgermanid-Steckermaterialien. In einer speziellen derartigen Ausführungsform weist die leitfähige Region150 mindestens ein wenig Germanium (z. B. eine freiliegende dotierte Silizium-Germanium- oder dotierte Germaniumregion oder Metallgermanidregion) auf, und das Material des Steckers420 ist eine kompatible Kobaltgermanid-Schicht. In einer weiteren speziellen derartigen Ausführungsform weist die leitfähige Region150 mindestens ein wenig Silizium (z. B. eine freiliegende dotierte Siliziumregion oder eine Metallsilizidregion) auf, und das Material des Steckers420 ist eine kompatible Kobaltsilizid-Schicht. Zu den beispielhaften Ausführungsformen kobaltbasierter Legierungsmaterialien für den Stecker420 zählt Kobalt legiert mit einem oder mehreren der folgenden Elemente: Al, Ni, Cu, Ag, Au, Mn, Ti, V, Cr, Fe, Ta, W, Ru, P, B, C, N, Si, Ge, Mg, Zn, Rh, Pt, Cd, Hf, In, Sn, C, O, Be, Ca, Zr, Nb, Mo, Ir, Re oder Pd. In den oben beschriebenen Ausführungsformen kann der Kobaltstecker420 eine kleinkörnige Struktur haben. - Bezug nehmend auf
422 optional auf der freiliegenden Fläche des Steckers420 und der Oberseite108 der dielektrischen Schicht102 durchgeführt werden. Die Vorbehandlung erfolgt durch einen Plasmaprozess oder Ionenbeschussprozess, um die Haftung einer später ausgebildeten Verbindung an der behandelten Fläche zu verbessern. In einer Ausführungsform kann die Vorbehandlung in einer Plasmakammer bei einer Temperatur, die sich in einem Bereich von Zimmertemperatur bis ca. 300°C bewegt, für ca. 20 bis 60 Sekunden mit Hilfe von beispielsweise H2/He-Plasma oder Ar-Plasma erfolgen. In einer anderen Ausführungsform kann die Vorbehandlung den Beschuss mit Argonionen aufweisen. Es ist einzusehen, dass eine derartige Vorbehandlung in anderen Phasen des Prozessflusses, z. B. vor dem Ausbilden von Keimschichten und/oder Steckermaterialien erfolgen kann. - Bezug nehmend auf
424 auf dem Stecker420 innerhalb der oberen Öffnung110 und auf der Oberseite108 der dielektrischen Schicht102 ausgebildet. Eine Naht426 kann innerhalb der oberen Öffnung110 während des Aufbringens des Füllmaterials424 ausgebildet werden. In einer Ausführungsform setzt sich das Füllmaterial424 aus einem Material zusammen, das Kobalt enthält. Beispielsweise kann das Füllmaterial aus Materialien zusammengesetzt und durch Prozesse aufgebracht werden, die oben für das Füllmaterial122 beschrieben werden. Weiterhin kann das Füllmaterial424 vom Material für den Stecker420 in seiner Zusammensetzung und/oder Aufbringungstechnik in einer Art und Weise abweichen, die ähnlich der oben für optionale Unterschiede zwischen Keimschicht120 und Füllmaterial122 beschriebenen Art ist. - Bezug nehmend auf
424 aufzuschmelzen. Die Naht426 in110 und114 innerhalb der dielektrischen Schicht102 ausgebildet wird. Der Glühprozess kann das Züchten größerer Kornstrukturen innerhalb des Füllmaterials424 ermöglichen, was den Widerstand reduziert und Verunreinigungen aus andernfalls schlechten Kornstrukturen austreibt. In einer Ausführungsform impliziert der Glühprozess die Benutzung von Formiergasen, etwa u. a. Gase wie Stickstoff, Wasserstoff und Argon. Weiterhin kann der Glühprozess bei einer Temperatur durchgeführt werden, die niedriger als der Wärmehaushalt der Backend-Strukturen ist. Beispielsweise wird der Glühprozess in einer Ausführungsform bei 300°C bis 400°C durchgeführt. In einer anderen Ausführungsform wird der Glühprozess bei einer Temperatur ausgeführt, die höher als der Schmelzpunkt des Füllmaterials424 , jedoch niedriger als der Wärmehaushalt der Backend-Strukturen ist. - In noch einer anderen Ausführungsform kann optional ein Zyklusverfahren benutzt werden, um das Füllmaterial
424 innerhalb der Öffnung110 ohne die Naht426 aufzubringen. Ein Zyklus kann eine einzelne Aufbringung des Füllmaterials424 und einen einzelnen Glühprozess implizieren. Der Glühvorgang eines Zyklus kann auf eine Temperatur und Zeitdauer eingestellt werden, um kurz das Füllmaterial424 aufzuschmelzen, um die Kantenabdeckung zu optimieren. Der Aufbringungsvorgang eines Zyklus kann ein kurzes Aufbringen sein, um weniger Füllmaterial424 aufzubringen, so dass mehrere Vorgänge erforderlich sind, um die obere Öffnung110 vollständig zu füllen. In einer Ausführungsform sind weniger als 5 Zyklen notwendig, um das Füllmaterial424 ohne eine Naht426 aufzubringen. - Bezug nehmend auf
424 oberhalb der Oberseite108 der dielektrischen Schicht102 zu entfernen, um die kobaltbasierte Struktur428 bereitzustellen. In einer Ausführungsform kann der CMP-Prozess ein zeitgesteuerter CMP-Prozess sein, der zeitlich so gesteuert wird, dass er an der Oberseite108 der dielektrischen Schicht der Leiterbahn stoppt. In einer anderen Ausführungsform kann der CMP-Prozess die Oberseite108 der dielektrischen Schicht102 als Stoppschicht benutzen. Da die Dicke des oberhalb der Oberseite108 der dielektrischen Schicht102 aufgebrachten Füllmaterials variieren kann, kann die Benutzung der Oberseite108 als Stoppschicht ein zuverlässigeres Verfahren sein. In einer alternativen Ausführungsform wird ein Ätzprozess benutzt, um das Füllmaterial424 oberhalb der Oberseite108 der dielektrischen Schicht102 zu entfernen. - In einem dritten Aspekt wird ein kobaltbasierter Stecker in einem unteren Anteil (z. B. einer Kontaktdurchgangsbohrung oder einem Kontaktdurchgangsschlitz) einer Öffnung in einer dielektrischen Schicht ausgebildet. Als nächstes wird eine kobaltbasierte Keimschicht in einem oberen Anteil (z. B. einem metallischen Leiterbahngraben) der Öffnung über dem kobaltbasierten Stecker ausgebildet. Eine kobaltbasierte leitfähige Leiterbahn wird dann auf der kobaltbasierten Keimschicht ausgebildet, um den oberen Anteil der Öffnung zu füllen, um eine Kobaltverbindung auszubilden.
- Beispielsweise veranschaulichen
420 in der unteren Öffnung114 der dielektrischen Schicht102 auf der leitfähigen Region150 des Substrats106 ausgebildet. Auf diese Weise kann die daraus resultierende Struktur der - Bezug nehmend auf
524 konform mit der Struktur der524 in einer Ausführungsform in der oberen Öffnung114 der dielektrischen Schicht102 und auf dem freiliegenden Stecker420 ausgebildet. Die Zusammensetzung und das Verfahren zum Ausbilden der Keimschicht524 können wie für die Keimschicht120 der524 eine Sperrschicht ausgebildet werden. - Bezug nehmend auf
526 auf der Keimschicht524 innerhalb der oberen Öffnung110 und auf der Oberseite108 der dielektrischen Schicht102 ausgebildet. Eine Naht528 kann innerhalb der Öffnung110 nach dem Aufbringen des Füllmaterials526 ausgebildet werden. Die Zusammensetzung und das Verfahren zum Ausbilden der Füllmaterialschicht526 kann wie für das Füllmaterial122 der526 von dem Material der Keimschicht524 in seiner Zusammensetzung und/oder Aufbringungstechnik in einer Art und Weise abweichen, die ähnlich der oben für optionale Unterschiede zwischen Füllmaterial122 und Keimschicht120 beschriebenen Art ist. Obwohl der Stecker420 , die Keimschicht524 und das Füllmaterial526 zudem alle kobaltbasiert sind, können sie alle voneinander in Zusammensetzung und/oder Aufbringungstechnik abweichen, wie dies oben für optionale Unterschiede zwischen Füllmaterial122 und Keimschicht120 sowie zwischen Füllmaterial424 und Stecker420 beschrieben wird. - Bezug nehmend auf
526 aufzuschmelzen. Die Naht528 in110 der dielektrischen Schicht102 ausgebildet wird. Der Glühprozess kann das Züchten größerer Kornstrukturen innerhalb des Füllmaterials526 ermöglichen, was den Widerstand reduziert und Verunreinigungen aus schlechten Kornstrukturen austreibt. In einer Ausführungsform impliziert der Glühprozess die Benutzung von Formiergasen, etwa u. a. Gase wie Stickstoff, Wasserstoff und Argon. Weiterhin kann der Glühprozess bei einer Temperatur durchgeführt werden, die niedriger als der Wärmehaushalt der Backend-Strukturen ist. Beispielsweise wird der Glühprozess in einer Ausführungsform bei 300°C bis 400°C durchgeführt. In einer anderen Ausführungsform wird der Glühprozess bei einer Temperatur ausgeführt, die höher als der Schmelzpunkt des Füllmaterials526 , jedoch niedriger als der Wärmehaushalt der Backend-Strukturen ist. - In noch einer anderen Ausführungsform kann optional ein Zyklusverfahren benutzt werden, um das Füllmaterial
526 innerhalb der Öffnung110 ohne die Naht528 aufzubringen. Ein Zyklus kann eine Aufbringung des Füllmaterials526 und einen Glühprozess implizieren. Der Glühvorgang eines Zyklus kann auf eine Temperatur und Zeitdauer eingestellt werden, um kurz das Füllmaterial aufzuschmelzen, um die Kantenabdeckung zu optimieren. Der Aufbringungsvorgang eines Zyklus kann ein kurzes Aufbringen sein, um weniger Füllmaterial aufzubringen, so dass mehrere Vorgänge erforderlich sind, um die Öffnung510 vollständig zu füllen. In einer Ausführungsform sind weniger als 5 Zyklen notwendig, um das Füllmaterial526 ohne eine Naht528 aufzubringen. - Bezug nehmend auf
526 und die Keimschicht524 , die oberhalb der Oberseite108 der dielektrischen Schicht102 angebracht sind, zu entfernen, um die kobaltbasierte Struktur530 bereitzustellen. In einer Ausführungsform kann der CMP-Prozess ein zeitgesteuerter CMP-Prozess sein, der zeitlich so gesteuert wird, dass er an der Oberseite108 der dielektrischen Schicht102 stoppt. In einer anderen Ausführungsform kann der CMP-Prozess die Oberseite108 der dielektrischen Schicht102 als Stoppschicht benutzen. Da die Dicke des oberhalb der Oberseite108 der dielektrischen Schicht102 aufgebrachten Füllmaterials variieren kann, kann die Benutzung der Oberseite108 als Stoppschicht ein zuverlässigeres Verfahren sein. In einer anderen Ausführungsform wird ein Ätzprozess benutzt, um das Füllmaterial526 und die Keimschicht524 zu entfernen, die oberhalb der Oberseite108 der dielektrischen Schicht102 angeordnet sind. -
600 , das ein Verfahren zur Ausbildung einer kobaltbasierten metallischen Verbindung gemäß einer Ausführungsform der vorliegenden Erfindung veranschaulicht. Bei602 wird eine Öffnung in einer dielektrischen Schicht ausgebildet, um eine leitfähige Region in einem Substrat freizulegen. Bei604 wird ein Kobaltstecker in einem unteren Anteil der Öffnung in Kontakt mit der leitfähigen Region ausgebildet. Bei606 wird ein Füllmaterial auf dem Stecker ausgebildet und füllt die Öffnung. Das Füllmaterial setzt sich aus einem kobaltbasierten Material zusammen. Bei608 wird in einer optionalen Ausführungsform Wärme beaufschlagt, um das Füllmaterial aufzuschmelzen. Bei610 wird das oberhalb einer Oberseite der dielektrischen Schicht angeordnete Füllmaterial entfernt. In einer derartigen Ausführungsform weisen das Füllmaterial und der Stecker beide Kobalt auf, haben jedoch unterschiedliche Zusammensetzungen. In einer anderen derartigen Ausführungsform weisen das Füllmaterial und der Stecker beide Kobalt auf, werden jedoch durch unterschiedliche Aufbringungs- oder Zuchtverfahren ausgebildet. In noch einer anderen derartigen Ausführungsform weisen das Füllmaterial und der Stecker beide Kobalt auf, haben jedoch unterschiedliche Materialzusammensetzungen und werden durch unterschiedliche Aufbringungs- oder Zuchtverfahren ausgebildet. In einer anderen Ausführungsform wird eine Keimschicht zwischen dem Stecker und dem Füllmaterial ausgebildet. Die Keimschicht kann eine kobaltbasierte Schicht sein. - In einem vierten Aspekt ist eine metallische Gateelektrode einer Halbleitervorrichtung zumindest teilweise aus Kobalt zusammengesetzt. Das bedeutet, dass Ausführungsformen der vorliegenden Erfindung nicht darauf beschränkt sein müssen, kobaltbasierte Verbindungen auszubilden.
- In einem Bespiel stellt
702 angefertigten Metalloxid-Halbleiter-Feldeffekttransistor (Metal Oxide Semiconductor Field Effect Transistor, MOSFET)700 gemäß einer Ausführungsform der vorliegenden Erfindung dar. Eine Gatedielektrikumschicht704 ist oberhalb einer Kanalregion706 angeordnet, und eine Gateelektrode708 ist oberhalb der Gatedielektrikumschicht704 angeordnet. Die Gatedielektrikumschicht704 und die Gateelektrode708 können durch die Gate-Isolierabstandshalter710 isoliert sein. Spitzenverlängerungen712 können durch Implantieren von Dotierungsstoffatomen in das Substrat702 ausgebildet werden. Source- und Drainregionen, z. B. spannungsinduzierende Source-/Drainregionen720 , können ausgebildet werden, indem selektiv eine Epitaxiefolie in ausgeätzten Anteilen des Substrats702 gezüchtet wird, und werden entweder in Situ oder nach der Epitaxiefolienzüchtung oder beidem dotiert. In einer Ausführungsform können Spitzenverlängerungen712 gleichzeitig mit den Source- und Drainregionen ausgebildet werden, um „Epi”-Spitzenverlängerungen zu schaffen. In typischen MOS-FETs setzt sich die Kanalregion706 aus einem Halbleitermaterial wie etwa monokristallinem Silizium zusammen. In einer Ausführungsform ist die Gateelektrode708 eine metallische Gateelektrode, z. B. basiert die Austrittsarbeit der Gateelektrode700 auf einer metallischen oder metallhaltigen Schicht. In einer derartigen Ausführungsform setzt sich die metallische Gateelektrode zumindest in gewissem Umfang aus Kobalt zusammen. Beispielsweise weist die metallische Gateelektrode708 in einer speziellen Ausführungsform eine kobaltbasierte Austrittsarbeit-Einstellschicht700A und ein darauf angeordnetes zusätzliches Füllmetall700B auf wie in708 aus einem einzigen kobaltbasierten Material zusammen. In noch einer anderen speziellen Ausführungsform ist nur das Füllmaterial770B der Gateelektrode708 kobaltbasiert, während die Austrittsarbeit-Einstellschicht700A kein Kobalt aufweist. In jedem dieser Fälle wird das kobaltbasierte Material oder die kobaltbasierte Schicht durch ein oben beschriebenes Verfahren ausgebildet. Beispielsweise setzt sich das kobaltbasierte Material oder die kobaltbasierte Schicht aus mindestens 90% Kobalt zusammen. In einer speziellen derartigen Ausführungsform setzt sich das kobaltbasierte Material oder die kobaltbasierte Schicht aus einer schwachen Legierung zusammen, die rund 0,25–5% eines anderen Elements als Kobalt hat, wobei der Rest rund 95+% Kobalt ist. - Zudem ist zu beachten, dass der MOS-FET
700 eine planare Vorrichtung sein oder einen dreidimensionalen Körper aufweisen kann, wie z. B. in einem Doppel-Gate-, Fin-FET-, Tri-Gate- oder Gate-all-around-Transistor. Als solches kann das Substrat702 ein planares Substrat sein oder eine Querschnittansicht eines dreidimensionalen Körpers darstellen. Weiterhin können in einer Ausführungsform die Gateelektrode708 und speziell eine metallische Gateelektrode mit Hilfe eines Ersatz-Gateprozesses gefertigt werden, bei dem ein Blind-Gate (wie ein polykristallines Silizium- oder Dielektrikum-Blind-Gate) durch einen Planarisierungsprozess freigelegt und dann entfernt wird, um eine Öffnung auszubilden. Die Öffnung wird dann mit einem metallischen Gate (z. B. einer metallischen Gateelektrode, einschließlich Kobalt) gefüllt. Alles Material, das während eines derartigen Füllvorgangs oberhalb der Dielektrikum-Zwischenschicht740 ausgebildet wurde, kann danach durch chemischmechanisches Polieren (CMP) entfernt werden. Bei einem derartigen Ersatz-Gateprozessablauf ist zu beachten, dass die Gatedielektrikumschicht auch ersetzt werden kann, was dann eine Gatedielektrikumschicht ergibt, die Seitenwandanteile hat, die zwischen der Gateelektrode708 und den Abstandshaltern710 ausgebildet werden wie in700 dargestellt werden. Zu beachten ist, dass Isolierschichten, z. B. Dielektrikum-Zwischenschicht740 , und Metallisierungszuleitungsschichten, die benutzt werden, um den MOS-FET700 zu integrieren, z. B. in eine integrierte Schaltung, ebenfalls mit einbezogen werden können wie in der Technik ausreichend bekannt. -
800 gemäß einer Ausführungsform der vorliegenden Erfindung. Die Rechenvorrichtung800 beherbergt eine Leiterplatte802 . Die Leiterplatte802 kann eine Reihe von Komponenten aufweisen, u. a. einschließlich eines Prozessors804 und mindestens eines Kommunikationschips806 . Der Prozessor804 ist physisch und elektrisch an die Leiterplatte802 angeschlossen. In einigen Implementierungen ist der mindestens eine Kommunikationschip806 auch physisch und elektrisch an die Leiterplatte802 angeschlossen. In weiteren Implementierungen ist der Kommunikationschip806 Teil des Prozessors804 . - Je nach ihren Anwendungen kann die Rechenvorrichtung
800 andere Komponenten aufweisen, die physisch und elektrisch an die Leiterplatte802 angeschlossen sein können oder nicht. Zu diesen anderen Komponenten können unter anderem ein flüchtiger Speicher (z. B. DRAM), ein nichtflüchtiger Speicher (z. B. ROM), ein Flash-Speicher, ein Grafikprozessor, ein digitaler Signalprozessor, ein Kryptoprozessor, ein Chipsatz, eine Antenne, ein Display, ein Touchscreen-Display, ein Touchscreen-Controller, eine Batterie, ein Audio-Codec, ein Video-Codec, ein Leistungsverstärker, eine Global-Positioning-System-Vorrichtung (GPS), ein Kompass, ein Beschleunigungsmessgerät, ein Gyroskop, ein Lautsprecher, eine Kamera und ein Massenspeichergerät (z. B. ein Festplattenlaufwerk, eine Kompakt-Disk (CD), eine Digital Versatile Disk (DVD) usw.) zählen. - Der Kommunikationschip
806 ermöglicht die drahtlose Kommunikation für die Datenübertragung von und zu der Rechenvorrichtung800 . Der Begriff „drahtlos” und davon abgeleitete Begriffe können verwendet werden, um Schaltungen, Vorrichtungen, Systeme, Verfahren, Techniken, Kommunikationskanäle usw. zu beschreiben, die Daten durch Benutzung modulierter elektromagnetischer Strahlung über ein nicht festes Medium kommunizieren können. Der Begriff impliziert nicht, dass die damit verbundenen Vorrichtungen keine Drähte enthalten, obwohl dies in einigen Ausführungsformen der Fall sein könnte. Der Kommunikationschip806 kann jede(s) einer Anzahl drahtloser Normen oder Protokolle implementieren, u. a. einschließlich Wi-Fi (IEEE 802.11-Familie), WiMAX (IEEE 802.16-Familie), IEEE 802.20, Long Term Evolution (LTE), Ev-DO, HSPA+, HSDPA+, HSUPA+, EDGE, GSM, GPRS, CDMA, TDMA, DECT, Bluetooth, Ableitungen von diesen sowie alle sonstigen Protokolle für drahtlose Übertragung, die als 3G, 4G, 5G und darüber hinaus bezeichnet werden. Die Rechenvorrichtung800 kann eine Mehrzahl von Kommunikationschips806 aufweisen. Beispielsweise kann ein erster Kommunikationschip806 drahtloser Kommunikation kürzerer Reichweite wie Wi-Fi und Bluetooth gewidmet sein, und ein zweiter Kommunikationschip806 kann drahtloser Kommunikation größerer Reichweite wie GPS, EDGE, GPRS, CDMA, WiMAX, LTE, Ev-DO und anderen gewidmet sein. - Der Prozessor
804 der Rechenvorrichtung800 weist einen IC-Die auf, der innerhalb des Prozessors804 gepackt ist. In einigen Implementierungen der Erfindung weist der IC-Die des Prozessors eine oder mehrere Kobaltverbindungen auf, die gemäß Implementierungen der Erfindung aufgebaut sind. Der Begriff „Prozessor” kann sich auf jede Vorrichtung oder jeden Anteil einer Vorrichtung beziehen, die/der elektronische Daten aus Registern und/oder einem Speicher verarbeitet, um diese elektronischen Daten in andere elektronische Daten umzuwandeln, die in Registern und/oder einem Speicher gespeichert werden können. - Der Kommunikationschip
806 weist außerdem einen IC-Die auf, der innerhalb des Kommunikationschips806 gepackt ist. Gemäß einer anderen Implementierung der Erfindung weist der IC-Die des Kommunikationschips eine oder mehrere Kobaltverbindungen auf, die gemäß Implementierungen der Erfindung aufgebaut sind. - In weiteren Implementierungen kann eine andere Komponente, die von der Rechenvorrichtung
800 beherbergt wird, einen IC-Die aufweisen, der eine oder mehrere Kobaltverbindungen enthält, die gemäß Implementierungen der Erfindung aufgebaut sind. - In verschiedenen Ausführungsformen kann die Rechenvorrichtung
800 ein Laptop, ein Netbook, ein Notebook, ein Ultrabook, ein Smartphone, ein Tablet, ein Personal Digital Assistant (PDA), ein ultramobiler PC, ein Mobiltelefon, ein Desktop-Computer, ein Server, ein Drucker, ein Scanner, ein Monitor, eine Set-Top-Box, ein Entertainment-Control-Center, eine digitale Kamera, ein tragbares Musikabspielgerät oder ein digitaler Videorekorder sein. In weiteren Ausführungsformen kann die Rechenvorrichtung800 jede andere elektronische Vorrichtung sein, die Daten verarbeitet. - Wenn die verschiedenen Aspekte dieser Erfindung verwendet werden, wird für Fachleute auf diesem Gebiet der Technik deutlich, dass Kombinationen oder Variationen der oben genannten Ausführungsformen möglich sind, um eine metallische Verbindung auszubilden, die Kobalt umfasst, sowie ein Verfahren zum Ausbilden einer metallischen Verbindung, die Kobalt umfasst. Obwohl die vorliegende Erfindung in einer Sprache beschrieben wurde, die spezifisch für die strukturellen Merkmale und/oder verfahrenstechnischen Handlungen ist, ist zu beachten, dass die in den beigefügten Patentansprüchen definierte Erfindung nicht notwendigerweise auf die beschriebenen spezifischen Merkmale oder Handlungen beschränkt ist. Die offenbarten spezifischen Merkmale und Handlungen sind vielmehr so zu verstehen, dass sie besonders günstige Implementierungen der beanspruchten Erfindung sind, die nützlich für die Veranschaulichung der vorliegenden Erfindung sind.
Claims (30)
- Metallische Verbindungsstruktur, umfassend: eine dielektrische Schicht, die auf einem Substrat angeordnet ist; eine Öffnung in der dielektrischen Schicht, wobei die Öffnung Seitenwände hat und eine leitfähige Region des Substrats freilegt; eine Keimschicht, die über der leitfähigen Region des Substrats und an den Seitenwänden der Öffnung angeordnet ist, wobei die Keimschicht Kobalt umfasst; und ein Füllmaterial innerhalb der Öffnung und auf einer Fläche der Keimschicht, wobei das Füllmaterial Kobalt umfasst und eine Kornstruktur oder Zusammensetzung hat, die anders als die der Keimschicht ist.
- Metallische Verbindungsstruktur nach Anspruch 1, wobei sich das Füllmaterial zu mindestens 50 Atom-% aus Kobalt zusammensetzt.
- Metallische Verbindungsstruktur nach Anspruch 1, die weiterhin eine Sperrschicht umfasst, die mindestens ein Element umfasst, das aus einer Gruppe ausgewählt wurde, die aus Titan, Tantal und Stickstoff besteht, wobei diese Sperrschicht zwischen der Keimschicht und der leitfähigen Region des Substrats und den Seitenwänden der Öffnung ausgebildet wird.
- Metallische Verbindungsstruktur nach Anspruch 3, wobei die Keimschicht weiterhin mindestens ein Element umfasst, das aus einer Gruppe ausgewählt wurde, die aus Silizium und Germanium besteht.
- Metallische Verbindungsstruktur nach Anspruch 3, wobei die Keimschicht und das Füllmaterial verschiedene Kornstrukturen haben.
- Metallische Verbindungsstruktur nach Anspruch 3, wobei die Keimschicht und das Füllmaterial verschiedene Materialien sind.
- Metallische Verbindungsstruktur nach Anspruch 2, wobei die Keimschicht eine Keimschicht oben auf der Sperrschicht umfasst und wobei die Keimschicht, die Sperrschicht und das Füllmaterial unterschiedliche Materialien sind.
- Metallische Verbindungsstruktur nach Anspruch 4, wobei das Füllmaterial im Wesentlichen aus Kobalt besteht.
- Verfahren zum Ausbilden einer metallischen Verbindungsstruktur, umfassend: Ausbilden einer Öffnung in einer auf einem Substrat angeordneten dielektrischen Schicht, wobei die Öffnung eine leitfähige Region des Substrats freilegt; Ausbilden einer Kobalt umfassenden Keimschicht in der Öffnung über der leitfähigen Region des Substrats durch ein erstes Verfahren, das eine erste Reihe von Parametern umfasst; Ausbilden eines Kobalt umfassenden Füllmaterials auf einer Fläche der Keimschicht durch ein zweites Verfahren, das eine zweite Reihe von Parametern umfasst, wobei die erste Reihe von Parametern anders als die zweite Reihe von Parametern ist, und wobei das Füllmaterial eine Kornstruktur oder Zusammensetzung hat, die anders als die der Keimschicht ist; und Entfernen von Anteilen des Füllmaterials und der Keimschicht, die oberhalb einer Oberseite der dielektrischen Schicht angeordnet sind.
- Verfahren nach Anspruch 9, wobei das erste und das zweite Verfahren identische Verfahren sind.
- Verfahren nach Anspruch 9, wobei das erste und das zweite Verfahren unterschiedliche Verfahren sind.
- Verfahren nach Anspruch 9, wobei das erste Verfahren ein Verfahren umfasst, das aus einer Gruppe ausgewählt wurde, die aus chemischem Aufdampfen (Chemical Vapor Deposition – CVD), Atomlagenabscheidung (Atomic Layer Deposition – ALD) und physikalischer Gasphasenabscheidung (Physical Vapor Deposition – PVD) besteht.
- Verfahren nach Anspruch 9, wobei das zweite Verfahren ein Verfahren umfasst, das aus einer Gruppe ausgewählt wurde, die aus CVD, ALD, PVD, Galvanisieren und nichtgalvanischer Metallisierung besteht.
- Verfahren nach Anspruch 9, wobei das Entfernen chemischmechanisches Polieren (CMP) umfasst.
- Verfahren nach Anspruch 9, das weiterhin das Ausbilden einer Sperrschicht, die mindestens ein Element umfasst, das aus einer Gruppe ausgewählt wurde, die aus Titan, Tantal und Stickstoff besteht, zwischen der Keimschicht und der leitfähigen Region des Substrats und den Seitenwänden der Öffnung umfasst.
- Verfahren nach Anspruch 9, wobei die Keimschicht weiterhin mindestens ein Element umfasst, das aus einer Gruppe ausgewählt wurde, die aus Silizium und Germanium besteht.
- Verfahren nach Anspruch 9, wobei das erste Verfahren ein konformes und das zweite Verfahren ein nichtkonformes Verfahren ist.
- Verfahren nach Anspruch 9, wobei das erste Verfahren ein langsames Aufbringen und das zweite Verfahren ein schnelles Aufbringen ist.
- Verfahren nach Anspruch 9, das weiterhin das Wiederholen eines Aufschmelzens des Füllmaterials und das Ausbilden des Füllmaterials umfasst, bis die Öffnung vollständig gefüllt ist.
- Verfahren nach Anspruch 19, wobei die Wiederholung mindestens drei Mal erfolgt.
- Metallische Verbindungsstruktur, umfassend: eine dielektrische Schicht, die auf einem Substrat angeordnet ist; eine Öffnung, die in der dielektrischen Schicht angeordnet ist und eine leitfähige Region im Substrat freilegt, wobei die Öffnung einen unteren und einen oberen Anteil hat; einen Kobalt umfassenden Stecker, der im unteren Anteil der Öffnung angeordnet ist; und ein Kobalt umfassendes Füllmaterial, das auf dem Stecker und im oberen Anteil der Öffnung angeordnet ist, wobei das Füllmaterial eine Kornstruktur oder Zusammensetzung hat, die anders als die der Keimschicht ist.
- Metallische Verbindungsstruktur nach Anspruch 21, wobei der Stecker weiterhin mindestens ein Element umfasst, das aus einer Gruppe ausgewählt wurde, die aus Phosphor und Bor besteht.
- Metallische Verbindungsstruktur nach Anspruch 21, wobei der Stecker und das Füllmaterial verschiedene Kornstrukturen haben.
- Metallische Verbindungsstruktur nach Anspruch 21, wobei der Stecker und das Füllmaterial verschiedene Zusammensetzungen haben.
- Metallische Verbindungsstruktur nach Anspruch 21, die weiterhin eine Kobalt umfassende Keimschicht umfasst, die über dem Stecker und auf einer Fläche von mindestens dem oberen Anteil der Öffnung angeordnet ist.
- Metallische Verbindungsstruktur nach Anspruch 25, wobei die Keimschicht und das Füllmaterial verschiedene Kornstrukturen oder Zusammensetzungen haben.
- Verfahren zum Ausbilden einer metallischen Verbindungsstruktur, umfassend: Ausbilden einer Öffnung in einer dielektrischen Schicht, die auf einem Substrat angeordnet ist, wobei die Öffnung eine leitfähige Region im Substrat freilegt, wobei die Öffnung einen oberen Anteil und einen unteren Anteil hat; Ausbilden eines Kobalt umfassenden Steckers über der leitfähigen Region des Substrat und innerhalb von mindestens dem unteren Anteil der Öffnung durch ein erstes Verfahren, das eine erste Reihe von Parametern umfasst; Ausbilden eines Kobalt umfassenden Füllmaterials über dem Stecker, der dielektrischen Schicht und innerhalb mindestens des unteren Anteils der Öffnung durch ein zweites Verfahren, das eine zweite Reihe von Parametern umfasst, wobei die erste Reihe von Parametern anders als die zweite Reihe von Parametern ist und wobei das Füllmaterial eine Kornstruktur oder Zusammensetzung hat, die anders als der Stecker ist; und Entfernen von Anteilen des Füllmaterials, das oberhalb einer Oberseite der dielektrischen Schicht angeordnet ist.
- Verfahren nach Anspruch 27, wobei das erste Verfahren ein Verfahren umfasst, das aus einer Gruppe ausgewählt wurde, die aus chemischem Aufdampfen (Chemical Vapor Deposition – CVD), Atomlagenabscheidung (Atomic Layer Deposition – ALD) und physikalischer Gasphasenabscheidung (Physical Vapor Deposition – PVD) besteht, und das zweite Verfahren ein Verfahren umfasst, das aus einer Gruppe ausgewählt wurde, die aus Galvanisieren und nichtgalvanischer Metallisierung besteht.
- Verfahren nach Anspruch 27, wobei das erste und das zweite Verfahren identische Verfahren sind.
- Verfahren nach Anspruch 27, wobei das erste und das zweite Verfahren unterschiedliche Verfahren sind.
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
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US13/730,184 | 2012-12-28 | ||
US13/730,184 US9514983B2 (en) | 2012-12-28 | 2012-12-28 | Cobalt based interconnects and methods of fabrication thereof |
PCT/US2013/075336 WO2014105477A1 (en) | 2012-12-28 | 2013-12-16 | Cobalt based interconnects and methods of fabrication thereof |
Publications (1)
Publication Number | Publication Date |
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DE112013005829T5 true DE112013005829T5 (de) | 2015-09-24 |
Family
ID=51016246
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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DE112013005829.4T Pending DE112013005829T5 (de) | 2012-12-28 | 2013-12-16 | Kobaltbasierte Verbindungen und Verfahren zu ihrer Herstellung |
Country Status (7)
Country | Link |
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US (1) | US9514983B2 (de) |
KR (1) | KR101670620B1 (de) |
CN (2) | CN104813446B (de) |
DE (1) | DE112013005829T5 (de) |
GB (2) | GB2522825B (de) |
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2012
- 2012-12-28 US US13/730,184 patent/US9514983B2/en active Active
-
2013
- 2013-12-16 GB GB1509998.9A patent/GB2522825B/en active Active
- 2013-12-16 WO PCT/US2013/075336 patent/WO2014105477A1/en active Application Filing
- 2013-12-16 GB GB1808072.1A patent/GB2562626B/en active Active
- 2013-12-16 CN CN201380062154.7A patent/CN104813446B/zh active Active
- 2013-12-16 CN CN201710556412.7A patent/CN107452711B/zh active Active
- 2013-12-16 DE DE112013005829.4T patent/DE112013005829T5/de active Pending
- 2013-12-16 KR KR1020157012770A patent/KR101670620B1/ko active IP Right Grant
- 2013-12-20 TW TW102147529A patent/TWI538144B/zh active
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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DE102018206436A1 (de) * | 2018-01-02 | 2019-07-04 | Globalfoundries Inc. | Integrationsschema für eine mit Kobalt plattierte Via |
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Also Published As
Publication number | Publication date |
---|---|
KR20150070339A (ko) | 2015-06-24 |
CN107452711A (zh) | 2017-12-08 |
GB2562626B (en) | 2019-02-20 |
TW201442184A (zh) | 2014-11-01 |
TWI538144B (zh) | 2016-06-11 |
US20140183738A1 (en) | 2014-07-03 |
CN107452711B (zh) | 2022-08-30 |
GB2522825A (en) | 2015-08-05 |
GB201808072D0 (en) | 2018-07-04 |
WO2014105477A1 (en) | 2014-07-03 |
GB201509998D0 (en) | 2015-07-22 |
CN104813446B (zh) | 2017-08-08 |
GB2522825B (en) | 2018-12-12 |
KR101670620B1 (ko) | 2016-10-28 |
CN104813446A (zh) | 2015-07-29 |
US9514983B2 (en) | 2016-12-06 |
GB2562626A (en) | 2018-11-21 |
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