DE112004002156T5 - Verfahren zum Verhindern der Vergrößerung einer Kontaktlochbreite während der Kontaktherstellung - Google Patents
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- 238000000034 method Methods 0.000 title claims abstract description 51
- 230000004888 barrier function Effects 0.000 claims abstract description 52
- 229910021332 silicide Inorganic materials 0.000 claims abstract description 40
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 claims abstract description 40
- 238000000151 deposition Methods 0.000 claims abstract description 20
- 239000004065 semiconductor Substances 0.000 claims abstract description 16
- 238000000992 sputter etching Methods 0.000 claims description 12
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 claims description 9
- 239000001257 hydrogen Substances 0.000 claims description 9
- 229910052739 hydrogen Inorganic materials 0.000 claims description 9
- 239000010936 titanium Substances 0.000 claims description 9
- 238000005137 deposition process Methods 0.000 claims description 8
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 claims description 4
- 238000004544 sputter deposition Methods 0.000 claims description 4
- 229910052719 titanium Inorganic materials 0.000 claims description 4
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 claims description 3
- 238000005530 etching Methods 0.000 claims description 2
- 238000000746 purification Methods 0.000 claims description 2
- 238000004519 manufacturing process Methods 0.000 abstract description 18
- 229910052751 metal Inorganic materials 0.000 description 10
- 239000002184 metal Substances 0.000 description 10
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 8
- 238000000623 plasma-assisted chemical vapour deposition Methods 0.000 description 7
- 239000000758 substrate Substances 0.000 description 7
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 6
- 230000008021 deposition Effects 0.000 description 6
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 5
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 5
- 229910052721 tungsten Inorganic materials 0.000 description 5
- 239000010937 tungsten Substances 0.000 description 5
- 229910052786 argon Inorganic materials 0.000 description 4
- 239000000463 material Substances 0.000 description 3
- 239000000377 silicon dioxide Substances 0.000 description 3
- 150000002739 metals Chemical class 0.000 description 2
- 235000012239 silicon dioxide Nutrition 0.000 description 2
- 238000007792 addition Methods 0.000 description 1
- 238000004140 cleaning Methods 0.000 description 1
- 238000001459 lithography Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000005389 semiconductor device fabrication Methods 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76843—Barrier, adhesion or liner layers formed in openings in a dielectric
- H01L21/76844—Bottomless liners
-
- H—ELECTRICITY
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76802—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76802—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
- H01L21/76814—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics post-treatment or after-treatment, e.g. cleaning or removal of oxides on underlying conductors
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76853—Barrier, adhesion or liner layers characterized by particular after-treatment steps
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- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
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- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
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- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Electrodes Of Semiconductors (AREA)
Abstract
Verfahren
zur Herstellung eines Kontakts über
einer Silizidschicht (214), die in einem Halbleiterchip angeordnet
ist, wobei das Verfahren die Schritte umfasst:
Abscheiden (150) einer Barrierenschicht (202) auf Seitenwänden (206, 207) eines Kontaktlochs (208) und auf einer natürlichen Oxidschicht (210), die an einer Unterseite des Kontaktlochs (208) angeordnet ist, wobei die Seitenwände (206, 207) durch das Kontaktloch (208) in einer dielektrischen Schicht (204) definiert sind;
Entfernen (152) eines Bereichs (219) der Barrierenschicht (202) und der natürlichen Oxidschicht (210), die an der Unterseite des Kontaktlochs (208) angeordnet sind, um die Silizidschicht (214) freizulegen.
Abscheiden (150) einer Barrierenschicht (202) auf Seitenwänden (206, 207) eines Kontaktlochs (208) und auf einer natürlichen Oxidschicht (210), die an einer Unterseite des Kontaktlochs (208) angeordnet ist, wobei die Seitenwände (206, 207) durch das Kontaktloch (208) in einer dielektrischen Schicht (204) definiert sind;
Entfernen (152) eines Bereichs (219) der Barrierenschicht (202) und der natürlichen Oxidschicht (210), die an der Unterseite des Kontaktlochs (208) angeordnet sind, um die Silizidschicht (214) freizulegen.
Description
- Technisches Gebiet
- Die vorliegende Erfindung betrifft im Allgemeinen das Gebiet der Halbleiterbauteilherstellung. Insbesondere betrifft die vorliegende Erfindung das Gebiet der Kontaktherstellung für Halbleiterbauelemente in einem Halbleiterchip.
- Hintergrund der Erfindung
- Kontakte bzw. Kontaktgebiete werden u. a. dazu verwendet, Verbindungen zwischen einem Transistorgebiet in einem Halbleiterchip und einer Metallverbindungsschicht herzustellen, die über dem Transistorgebiet angeordnet ist. Um eine hohe Schaltungsdichte zu erreichen, müssen diese Kontakte, die im Allgemeinen ein großes Aspektverhältnis aufweisen, innerhalb einer kleinen Fläche des Halbleiterchips angeordnet werden können, ohne dass diese einander berühren oder anderweitig stören. Somit ist es wichtig, die Kontaktlochbreite während der Herstellung der Kontakte zu steuern, um damit einen Kontakt mit einer ausreichend geringen Breite zu ermöglichen.
- Während eines konventionellen Kontaktfertigungsprozesses wird ein Kontaktloch typischerweise durch Lithographie definiert und in einer Oxidschicht geätzt, die beispielsweise über einem Transistorgebiet eines Halbleiterchips angeordnet ist. Das sich ergebende Kontaktloch kann über einer Silizidschicht gebildet werden, die beispielsweise mit einem Source- oder Drain-Bereich in dem Transistorgebiet des Halbleiterchips verbunden sein kann. Das Kontaktloch wird dann mit einer Barrierenschicht beschichtet, das ein Metall, etwa Titan, aufweist und wird mit einem Metall gefüllt, etwa Wolfram, um einen Kontakt herzustellen. Bevor jedoch die Barrierenschicht an den Seitenwänden des Kontaktlochs und auf der Silizidschicht, die an der Unterseite des Kontaktlochs angeordnet ist, abgeschieden werden kann, muss zunächst eine natürliche Oxidschicht entfernt werden, die sich über der Silizidschicht bildet. In dem konventionellen Kontaktherstellungsprozess wird die natürliche Oxidschicht typischerweise durch Anwenden eines Sputter-Ätzprozesses mit Argon entfernt.
- Während des Sputter-Ätzprozesses werden auch die oberen Eckenbereiche der Oxidschicht, die das Kontaktloch definieren, zusammen mit der natürlichen Oxidschicht geätzt, so dass dadurch eine Vergrößerung der Breite der Oberseite des Kontaktloches hervorgerufen wird. Als Folge davon weist der Kontakt, der nach dem Füllen des Kontaktloches mit Wolfram gebildet wird, eine ungewollte große Breite im Vergleich zu der anfänglichen Breite des strukturierten Kontaktloches auf.
- Es besteht daher ein Bedarf im Stand der Technik für ein Verfahren zur Herstellung eines Kontakts über einem Transistorgebiet eines Halbleiterchips, wobei eine unerwünschte Vergrößerung einer Kontaktlochbreite während der Herstellung des Kontakts vermieden wird.
- Überblick Die vorliegende Erfindung richtet sich an ein Verfahren zur Verhinderung eines Anstiegs der Kontaktlochbreite während der Kontaktherstellung. Die vorliegende Erfindung löst das Problem im Stand der Technik und stellt ein Verfahren zur Herstellung eines Kontaktes über einem Transistorgebiet eines Halbleiterchips bereit, das eine unerwünschte Vergrößerung der Kontaktlochbreite während der Kontaktherstellung verhindert.
- Gemäß einer beispielhaften Ausführungsform umfasst ein Verfahren zur Herstellung eines Kontaktes über einer Silizidschicht, die in einem Halbleiterchip angeordnet ist, den Schritt des Abscheidens einer Barrierenschicht an Seitenwänden eines Kontaktloches und auf einer natürlichen Oxidschicht, die an einer Unterseite des Kontaktlochs angeordnet ist, wobei die Seitenwände durch das Kontaktloch in einer dielektrischen Schicht definiert sind. Beispielsweise kann die Barrierenschicht Titan/Titannitrid und die dielektrische Schicht kann ein PECVD-Oxid sein. Der Schritt des Abscheidens der Barrierenschicht auf den Seitenwänden des Kontaktlochs und auf der natürlichen Oxidschicht kann so optimiert werden, dass die Barrierenschicht eine größere Dicke an der Oberseite des Kontaktloches als an der Unterseite des Kontaktloches aufweist.
- Gemäß dieser anschaulichen Ausführungsform umfasst das Verfahren ferner das Entfernen eines Bereichs der Barrierenschicht und der natürlichen Oxidschicht, die an der Unterseite des Kontaktlochs angeordnet ist, um die Silizidschicht freizulegen. Beispielsweise können der Bereich der Barrierenschicht und der natürlichen Oxidschicht, die an der Unterseite des Kontaktlochs angeordnet sind, durch Anwenden eines Sputter-Ätzsprozesses entfernt werden. Das Kontaktloch weist eine elektrische Kontaktbreite auf, wobei die elektrische Kontaktbreite durch den Sputter-Ätzprozess nicht vergrößert wird. Die dielektrische Schicht umfasst obere Eckengebiete, die benachbart zu dem Kontaktloch angeordnet sind, wobei die oberen Eckengebiete der dielektrischen Schicht während des Schritts zum Entfernen des Bereichs der Barrierenschicht und der natürlichen Oxidschicht, der an der Unterseite des Kontaktlochs angeordnet ist, nicht geätzt werden. Weitere Merkmale und Vorteile der vorliegenden Erfindung werden für den Fachmann beim Studium der folgenden detaillierten Beschreibung und der begleitenden Zeichnungen offenkundig.
- Kurze Beschreibung der Zeichnungen
-
1 ist ein Flussdiagramm, das den beispielhaften Verfahrensschritten gemäß einer Ausführungsform der vorliegenden Erfindung entspricht. -
2a zeigt eine Querschnittsansicht eines Teils einer Scheibe, die gemäß einer Ausführungsform der vorliegenden Erfindung entsprechend gewisser Schritte des Flussdiagramms in1 bearbeitet wird. -
2b zeigt eine Querschnittsansicht eines Teils einer Scheibe, die gemäß einer Ausführungsform der Erfindung entsprechend gewissen Schritten des Flussdiagramms in1 bearbeitet wird. -
3 ist ein Flussdiagramm, das beispielhaften Verfahrensschritten gemäß einer Ausführungsform der vorliegenden Erfindung entspricht. -
4a zeigt eine Querschnittsansicht eines Teils einer Scheibe, die gemäß einer Ausführungsform der Erfindung entsprechend gewissen Schritten des Flussdiagramms in3 bearbeitet wird. -
4b zeigt eine Querschnittsansicht eines Teils einer Scheibe, die gemäß einer Ausführungsform der vorliegenden Erfindung entsprechend gewissen Schritten des Flussdiagramms in3 bearbeitet wird. -
5 ist ein Flussdiagramm, das beispielhaften Verfahrensschritten gemäß einer Ausführungsform der vorliegenden Erfindung entspricht. -
6a zeigt eine Querschnittsansicht eines Teils einer Scheibe, die gemäß einer Ausführungsform der Erfindung entsprechend gewissen Schritten des Flussdiagramms in5 bearbeitet wird. -
6b zeigt eine Querschnittsansicht eines Teils einer Scheibe, die gemäß einer Ausführungsform der Erfindung entsprechend gewissen Schritten des Flussdiagramms in5 bearbeitet wird. - Detaillierte Beschreibung der Erfindung
- Die vorliegende Erfindung richtet sich an ein Verfahren zum Verhindern einer vergrößerten Kontaktlochbreite während der Herstellung eines Kontakts in einem Halbleiterchip. Die folgende Beschreibung enthält spezielle Informationen, die sich auf die Implementierung der vorliegenden Erfindung beziehen. Der Fachmann erkennt, dass die vorliegende Erfindung in einer anderen Weise eingerichtet werden kann, als dies in der vorliegenden Anmeldung speziell erläutert ist. Ferner sind einige spezielle Details der Erfindung nicht erläutert, um die Erfindung nicht unnötig zu verdunkeln.
- Die Zeichnungen in der vorliegenden Erfindung und die dazugehörige detaillierte Beschreibung richten sich lediglich an beispielhafte Ausführungsformen der Erfindung. Der Kürze halber sind andere Ausführungsformen der vorliegenden Erfindung nicht speziell in der vorliegenden Anmeldung beschrieben und sind auch nicht im speziellen in den vorliegenden Zeichnungen dargestellt.
-
1 zeigt ein Flussdiagramm, das ein beispielhaftes Verfahren zur Herstellung eines Kontakts über einem Transistorgebiet in einem Halbleiterchip gemäß einer Ausführungsform der vorliegenden Erfindung darstellt. Gewisse Details und Merkmale, die dem Fachmann auf dem Gebiet vertraut sind, sind in dem Flussdiagramm100 weggelassen. Beispielsweise kann ein Schritt aus einem oder mehreren Teilschritten bestehen oder es können eine spezielle Anlage oder spezielle Materialien erforderlich sein, wie dies im Stand der Technik bekannt ist. Die Schritte150 und152 , die in dem Flussdiagramm100 angezeigt sind, sind ausreichend, um eine Ausführungsform der vorliegenden Erfindung zu beschreiben, wobei andere Ausführungsformen der Erfindung andere Schritte anwenden können, als in dem Flussdiagramm100 gezeigt sind. Zu beachten ist, dass die in dem Flussdiagramm100 gezeigten Prozessschritte an einer Scheibe ausgeführt werden, die vor dem Schritt150 ein Kontaktloch, das in einer dielektrischen Schicht gebildet ist, und eine natürliche Oxidschicht aufweist, die über einer Silizidschicht an der Unterseite des Kontaktlochs angeordnet ist, wobei die dielektrische Schicht und die Silizidschicht über einem Transistorgebiet eines Substrats (in der Figur nicht gezeigt) angeordnet sein können. Strukturen250 und252 in den2a und2b zeigen das Ergebnis des Ausführens der Schritte150 und152 des Flussdiagramms100 an einer Struktur, die ein in einer dielektrischen Schicht gebildetes Kontaktloch, die über einem Transistorgebiet eines Substrats angeordnet ist (in den Figuren nicht gezeigt), aufweist, wie dies zuvor erläutert ist. - Es sei nun auf den Schritt
150 in1 und die Struktur250 in2a verwiesen; im Schritt150 des Flussdiagramms100 wird eine Barrierenschicht202 über einer dielektrischen Schicht204 an Seitenwänden206 und207 eines Kontaktlochs208 und über einer natürlichen Oxidschicht210 , die an der Unterseite212 des Kontaktlochs208 und ferner über einer Silizidschicht214 angeordnet ist, abgeschieden. Wie in2a gezeigt ist, liegt die dielektrische Schicht204 über der dielektrischen Schicht216 , die über einem Transistorgebiet eines Substrats (in2a nicht gezeigt) angeordnet ist. Die dielektrische Schicht204 kann Siliziumdioxid aufweisen, das beispielsweise in einem plasmaunterstützten chemischen Dapfabscheide- („PECVD") Prozess abgeschieden werden kann. Siliziumdioxid, das in einem PECVD-Prozess abgeschieden wird, wird auch als „PECVD"-Oxid in der vorliegenden Anmeldung bezeichnet. Die natürliche Oxidschicht210 liegt über der Silizidschicht214 an der Unterseite212 des Kontaktlochs208 und kann thermisch gewachsenes Oxid aufweisen. Beispielsweise kann die natürliche Oxidschicht210 eine Dicke von 10,0 Angstrom bis 50,0 Angstrom aufweisen. Die Barrierenschicht202 kann an den Seitenwänden206 und207 des Kontaktlochs208 über der natürlichen Oxidschicht210 und über der dielektrischen Schicht204 in einer bekannten Weise abgeschieden werden und kann Titan/Titannitrid („Ti/TiN") aufweisen. In anderen Ausführungsformen weist die Barrierenschicht202 eine andere Kombination aus Metallen oder ein geeignetes einzelnes Metall auf. In der vorliegenden Ausführungsform wird das Abscheiden der Barrierenschicht202 so optimiert, das Bereiche218 der Barrierenschicht202 , die benachbart zu oberen Eckengebieten222 an der Oberseite des Kontaktlochs208 angeordnet sind, eine größere Dicke als ein Bereich219 der Barrierenschicht202 besitzen, der an der Unterseite212 des Kontaktlochs208 angeordnet ist. Als Folge liefern die Bereiche218 der Barrierenschicht202 einen ausreichenden Schutz für die oberen Eckengebiete222 der dielektrischen Schicht204 während eines nachfolgenden Sputter-Ätzprozesses. Die Kontaktlochbreite220 , die die Strecke zwischen den Seitenwänden206 und207 des Kontaktloches208 ist, wird auch als „elektrische Kontaktbreite" in der vorliegenden Anmeldung bezeichnet. Gemäß2a wird das Ergebnis des Schritts150 des Flussdiagramms100 durch die Struktur250 dargestellt. Es sei nun auf den Schritt152 in1 und die Struktur252 in2b verwiesen; im Schritt152 des Flussdiagramms100 werden der Bereich219 der Barrierenschicht202 und die natürliche Oxidschicht210 , die an der Unterseite212 des Kontaktlochs208 angeordnet sind, entfernt, um die Silizidschicht214 freizulegen. Der Bereich219 der Barrierenschicht202 , der an der Unterseite212 des Kontaktlochs208 angeordnet ist, und die natürliche Oxidschicht210 können durch Anwendung eines Sputter-Ätzprozesses entfernt werden, der Argon („Ar") aufweisen kann. Der Sputter-Ätzprozess entfernt auch Bereiche der Barrierenschicht202 , die an der Oberseite der Seitenwände206 und207 aufgebracht sind. Da jedoch die Bereiche218 der Barrierenschicht202 (in2a gezeigt) eine ausreichende Dicke aufweisen, um obere Eckengebiete222 der dielektrischen Schicht204 zu schützen, werden die oberen Eckengebiete222 während des Sputter-Ätzprozesses nicht geätzt. Als Folge davon wird die Kontaktlochbreite220 während des Sputter-Ätzprozesses nicht vergrößert. Das Kontaktloch208 kann mit einem Metall, etwa Wolfram, in einem nachfolgenden Schritt gefüllt werden, um die Kontaktherstellung abzuschließen. Gemäß2b wird das Ergebnis des Schritts152 des Flussdiagramms100 durch die Struktur252 dargestellt. - Somit wird in der Ausführungsform der vorliegenden Erfindung in
1 durch Bilden der Barrierenschicht202 vor dem Durchführen eines Sputter-Ätzprozesses zum Entfernen der natürlichen Oxidschicht210 und durch Optimieren der Herstellung der Barrierenschicht202 erfindungsgemäß ein Ätzen der oberen Eckengebiete222 der dielektrischen Schicht204 verhindert. Als Folge davon kann erfindungsgemäß vorteilhafterweise ein Kontakt erreicht werden, der eine Kontaktlochbreite aufweist, die während des Herstellungsprozesses für den Kontakt nicht vergrößert wird. -
3 zeigt ein Flussdiagramm zur Darstellung eines beispielhaften Verfahrens zur Herstellung eines Kontakts über einem Transistorgebiet einer Scheibe gemäß einer Ausführungsform der vorliegenden Erfindung. Gewisse Details und Merkmale, die dem Fachmann auf dem Gebiet vertraut sind, sind in dem Flussdiagramm300 weggelassen. Beispielsweise kann ein Schritt aus einem oder mehreren Teilschritten bestehen oder kann spezielle Anlagen oder Materialien erfordern, wie dies im Stand der Technik bekannt ist. Die Schritt350 und352 , die in dem Flussdiagramm300 gekennzeichnet sind, sind ausreichend, um eine Ausführungsform der vorliegenden Erfindung zu beschreiben, wobei in anderen Ausführungsformen der Erfindung andere Schritte im Vergleich zu den in dem Flussdiagramm300 gezeigten Schritten eingesetzt werden können. Zu beachten ist, dass die in dem Flussdiagramm300 gezeigten Bearbeitungsschritte an einer Schreibe ausgeführt werden, die vor dem Schritt350 ein Kontaktloch aufweist, das in einer dielektrischen Schritt ausgebildet ist, und eine natürliche Oxidschicht aufweist, die über einer Silizidschicht an der Unterseite des Kontaktlochs angeordnet ist, wobei die dielektrische Schicht und die Silizidschicht über einem Transistorgebiet eines Substrats (in der Figur nicht gezeigt) angeordnet sein können. Die Strukturen350 und352 in den4a und4b zeigen das Ergebnis des Ausführens der Schritte350 und252 des Flussdiagramms300 an einer Struktur mit einem in einer dielektrischen Schicht gebildeten Kontaktloch, die über einem Transistorgebiet eines Substrats angeordnet ist (in den Figuren nicht gezeigt), wie dies zuvor erläutert ist. - Es sei nun auf den Schritt
350 in3 und die Struktur450 in4a verwiesen; im Schritt350 des Flussdiagramms300 wird eine natürliche Oxidschicht410 , die über einer Silizidschicht414 angeordnet ist, an einer Unterseite412 eines Kontaktlochs408 durch Anwenden eines reaktiven Wasserstoffvorreinigungsprozesses430 entfernt. Zu beachten ist, dass, obwohl die natürliche Oxidschicht410 im Schritt350 entfernt wird, die natürliche Oxidschicht410 in4a gezeigt ist, um die vorliegende Ausführungsform der Erfindung besser darzustellen. In4a entsprechen die dielektrische Schichten404 und416 , Seitenwände406 und407 , das Kontaktloch408 , die natürliche Oxidschicht410 und die Silizidschicht414 in der Struktur450 den dielektrischen Schichten204 und216 , den Seitenwänden206 und207 , dem Kontaktloch208 , der natürlichen Oxidschicht210 und der Silizidschicht214 in der Struktur250 in2a . In der vorliegenden Ausführungsform weist die dielektrische Schicht404 ein PECVD-Oxid auf, das in einem Ausheizprozess nach dem Abscheiden davon (d. h. des PECVD-Oxids) ausgehärtet werden kann. Somit ist die dielektrische Schicht404 wesentlich härter als die natürliche Oxidschicht410 , die Siliziumoxid aufweist, das thermisch bei Raumtemperatur gewachsen ist. Wenn folglich die natürliche Oxidschicht410 weggeätzt wird (d. h. entfernt wird) durch den reaktiven Wasserstoffvorreinigungsprozess, d. h. durch den reaktiven Wasserstoffvorreinigungsprozess430 , werden obere Eckengebiete422 der dielektrischen Schicht404 , die an den Oberseiten der Seitenwände406 angeordnet sind, nicht geätzt. Somit wird die Kontaktlochbreite420 , die dem Abstand zwischen den Seitenwänden406 und407 des Kontaktlochs408 entspricht, für das Ausführen des reaktiven Wasserstoffvorreinigungsprozesses430 nicht vergrößert. Die Kontaktlochbreite420 ist ähnlich zu der Kontaktlochbreite220 in2a und wird auch als "elektrische Kontaktbreite" in der vorliegenden Anmeldung bezeichnet. Gemäß4a ist das Ergebnis des Schritts350 des Flussdiagramms300 durch die Struktur450 repräsentiert. - Es sei weiter auf den Schritt
352 in3 und die Struktur452 in4b verwiesen; im Schritt352 des Flussdiagramms300 wird eine Barrierenschicht432 an den Seitenwänden406 und407 des Kontaktlochs408 über der Silizidschicht414 , die an der Unterseite412 des Kontaktlochs408 angeordnet ist, und über der dielektrischen Schicht404 abgeschieden. Die Barrierenschicht432 kann in bekannter Weise abgeschieden werden und kann Ti/TiN aufweisen. In anderen Ausführungsformen weist die Barrierenschicht432 eine andere Kombination aus Metallen oder ein geeignetes einzelnes Metall auf. Das Kontaktloch408 wird in einen nachfolgenden Schritt mit einem Metall, etwa Wolfram, gefüllt, um die Herstellung des Kontakts abzuschließen. Gemäß4b ist das Ergebnis des Schritts352 des Flussdiagramms300 durch die Struktur452 dargestellt. - Somit liefert in der Ausführungsform der vorliegenden Erfindung in
3 durch Anwenden eines reaktiven Wasserstoffvorreinigungsprozesses zum Entfernen einer natürlichen Oxidschicht an der Unterseite eines Kontaktlochs vor dem Abscheiden einer Barrierenschicht in den Kontaktloch die vorliegende Erfindung vorteilhafterweise einen Kontakt, der eine Kontaktlochbreite aufweist, die sich während des Herstellens des Kontakts nicht vergrößert. -
5 zeigt ein Flussdiagramm, in welchem ein beispielhaftes Verfahren zur Herstellung eines Kontakts über einem Transistorgebiet einer Scheibe gemäß einer Ausführungsform der vorliegenden Erfindung dargestellt ist. Gewisse Details und Merkmale, die dem Fachmann auf diesem Gebiet vertraut sind, sind in dem Flussdiagramm500 weggelassen. Beispielsweise kann ein Schritt aus einem oder mehreren Teilschritten bestehen oder kann spezielle Anlagen oder Materialien, wie dies im Stand der Technik bekannt ist, erfordern. Die Schritte550 und552 , die in dem Flussdiagramm550 angezeigt sind, sind ausreichend, um eine Ausführungsform der vorliegenden Erfindung zu beschreiben, wobei in anderen Ausführungsformen der Erfindung andere Schritte angewendet werden können, als sie in dem Flussdiagramm500 gezeigt sind. Zu beachten ist, dass die in dem Flussdiagramm500 gezeigten Bearbeitungsschritte an einer Scheibe ausgeführt werden, die vor dem Schritt550 ein in einer dielektrischen Schicht gebildetes Kontaktloch und eine natürliche Oxidschicht aufweist, die über einer Silizidschicht an der Unterseite des Kontaktlochs angeordnet ist, wobei die dielektrische Schicht und die Silizidschicht über einem Transistorgebiet eines Substrats (in den Figuren nicht gezeigt) angeordnet sein können. Die Strukturen550 und552 in den6a und6b zeigen das Ergebnis des Ausführens der Schritte550 und552 des Flussdiagramms550 an einer Struktur mit einem Kontaktloch, das in einer dielektrischen Schicht gebildet ist, die über einem Transistorgebiet eines Substrats (in den Figuren nicht gezeigt) angeordnet ist, wie dies zuvor erläutert ist. - Es sei nun auf den Schritt
550 in5 und die Struktur450 in4a verwiesen; im Schritt550 des Flussdiagramms500 wird eine Barrierenschicht602 an Seitenwänden606 und607 eines Kontaktlochs608 über einer natürlichen Oxidschicht610 , die an einer Unterseite612 des Kontaktlochs608 angeordnet ist, und über einer dielektrischen Schicht604 abgeschieden, die über einer dielektrischen Schicht616 angeordnet ist. Der Schritt550 in4 entspricht dem Schritt350 in3 . Insbesondere entsprechen die Barrierenschicht602 , die dielektrischen Schichten604 und616 , die Seitenwände606 und607 , das Kontaktloch608 , die natürliche Oxidschicht610 , die Unterseite612 , die Silizidschicht614 , Bereiche618 , ein Bereich619 , eine Kontaktlochbreite620 und obere Eckengebiete622 in der Struktur650 in6a der Barrierenschicht202 , den dielektrischen Schichten204 und216 , den Seitenwänden206 und207 , dem Kontaktloch208 , der natürlichen Oxidschicht210 , der Unterseite212 , der Silizidschicht214 , den Bereichen218 , dem Bereich219 , der Kontaktlochbreite220 und den oberen Eckengebieten222 in der Struktur250 in2a . Somit wird ähnlich zu der Kontaktlochbreite220 in2a auch die Kontaktlochbreite420 als eine „elektrische Kontaktbreite" in der vorliegenden Anmeldung bezeichnet. Ähnlich zu der Barrierenschicht202 in2a kann die Abscheidung der Barrierenschicht602 in der vorliegenden Ausführungsform so optimiert werden, dass die Bereiche618 der Barrierenschicht602 , die benachbart zu oberen Eckenbereichen222 an der Oberseite des Kontaktlochs608 angeordnet sind, eine größere Dicke aufweisen als der Bereich619 der Barrierenschicht602 , der an der Unterseite612 des Kontaktlochs608 angeordnet ist. Gemäß6a wird das Ergebnis des Schritts550 des Flussdiagramms550 durch die Struktur650 repräsentiert. - Es sei weiter auf die Schritte
552 in5 und die Struktur652 in6b verwiesen; im Schritt552 des Flussdiagramms550 wird ein simultaner Sputter-Ätz/Abscheide-Prozess ausgeführt, um die natürliche Oxidschicht, die über der Silizidschicht614 angeordnet ist, an der Unterseite612 des Kontaktlochs608 zu entfernen. In dem simultanen Sputter-Ätz/Abscheide-Prozess kann Argon zum Sputter-Ätzen verwendet werden und anschließend kann Ti/TiN an den Seitenwänden606 und an der Unterseite612 des Kontaktlochs608 abgeschieden werden, indem beispielsweise eine Sputter-Abscheidetechnik eingesetzt wird. Der simultane Sputter-Ätz/Abscheide-Prozess kann ein geeignetes Sputter-Ätz/Abscheide-Verhältnis anwenden, so dass die natürliche Oxidschicht610 geätzt wird (d. h. entfernt wird). Beispielsweise kann das Verhältnis von Argon und Ti/TiN-Molekülen eingestellt werden, um ein Sputter-Ätz/Abscheide-Verhältnis von 1,0 bis 2,0 zu erreichen. Somit kann durch Anwenden eines Sputter-Ätz/Abscheide-Verhältnisses von größer 1,0 in der vorliegenden Ausführungsform eine Entfernung der natürlichen Oxidschicht610 erreicht werden, während die oberen Eckenbereiche622 der dielektrischen Schicht604 geschützt werden, indem Ti/TiN an den Seitenwänden606 und607 des Kontaktlochs608 wieder abgeschieden wird. Das Kontaktloch608 kann dann mit einem Metall, etwa Wolfram, in einem nachfolgenden Schritt zur Vervollständigung der Herstellung des Kontakts gefüllt werden. Gemäß6b ist das Ergebnis des Schritts552 des Flussdiagramms550 durch die Struktur652 repräsentiert. - Somit wird in der Ausführungsform der vorliegenden Erfindung in
5 durch Anwenden eines simultanen Sputter-Ätz/Abscheide-Prozesses erfindungsgemäß des Entfernen einer natürlichen Oxidschicht an der Unterseite eines Kontaktloches, das über einer Silizidschicht angeordnet ist, erreicht, während eine unerwünschte Vergrößerung der Kontaktlochbreite während des Herstellens des Kontakts vermieden wird. - Wie somit zuvor erläutert ist, wird in Ausführungsformen der Erfindung in den
1 ,3 und5 durch geeignetes Auswählen der Reihenfolge und der Techniken für Sputter-Ätz- und Barrierenschicht-Abscheide-Prozesse erfindungsgemäß das Entfernen einer natürlichen Oxidschicht an der Unterseite eines Kontaktloches erreicht, während ein ungewolltes Vergrößern der Kontaktlochbreite während des Herstellens des Kontakts vermieden wird. Im Gegensatz dazu wird in einem konventionellen Kontaktherstellungsprozess, in welchem ein Ar-Sputterätzprozess zum Entfernen einer natürlichen Oxidschicht vor dem Abscheiden einer Barrierenschicht angewendet wird, zu einer unerwünschten Vergrößerung der Kontaktlochbreite. - Aus der obigen Beschreibung beispielhafter Ausführungsformen der Erfindung geht hervor, dass diverse Techniken zum Verwirklichen der Konzepte der vorliegenden Erfindung angewendet werden können, ohne von deren Schutzbereich abzuweichen. Obwohl die Erfindung mit spezieller Bezugnahme auf gewisse Ausführungsformen beschrieben ist, erkennt der Fachmann, dass Änderungen in Form und Detail vorgenommen werden können, ohne von dem Grundgedanken und dem Schutzbereich der Erfindung abzuweichen. Die beschriebenen beispielhaften Ausführungsformen sind in jeder Hinsicht als lediglich anschaulich und nicht einschränkend zu betrachten. Es sollte beachtet werden, dass die Erfindung nicht auf die speziellen beispielhaften beschriebenen Ausführungsformen eingeschränkt ist, sondern dass viele Änderungen, Modifizierungen und Ergänzungen möglich sind, ohne dass vom Schutzbereich der Erfindung abgewichen wird.
- Somit ist ein Verfahren zum Vermeiden des Vergrößerns einer Kontaktlochbreite während der Herstellung eines Kontakts beschrieben.
- Figurenbeschreibung
-
1 -
-
150 Abscheiden einer Barrierenschicht an Seitenwänden des Kontaktlochs über der natürlichen Oxidschicht, die über einer Silizidschicht an der Unterseite des Kontaktlochs angeordnet ist, und über einer dielektrischen Schicht -
152 Entfernen eines Bereichs der Barrierenschicht und der natürlichen Oxidschicht, die and der Unterseite des Kontaktlochs angeordnet sind, um die Silizidschicht freizulegen -
3 -
-
350 Entfernen der natürlichen Oxidschicht, die über der Silizidschicht an der Unterseite des Kontaktlochs angeordnet ist, durch Anwenden eines reaktiven Wasserstoffvorreinigungsprozesses -
352 Abscheiden einer Barrierenschicht an Seitenwänden des Kontaktlochs über der Silizidschicht, die an der Unterseite des Kontaktlochs angeordnet ist, und über einer dielektrischen Schicht -
5 -
-
550 Abscheiden einer Barrierenschicht an Seitenwänden des Kontaktlochs über einer natürlichen Oxidschicht, die an einer Unterseite des Kontaktlochs angeordnet ist, und über einer dielektrischen Schicht. -
552 Ausführen eines gleichzeitigen Sputter-Ätz/Abscheide-Prozesses, um eine natürliche Oxidschicht, die über einer Silizidschicht an der Unterseite des Kontaktslochs angeordnet ist, zu entfernen. - Zusammenfassung
- Gemäß einer beispielhaften Ausführungsform umfasst ein Verfahren zur Herstellung eines Kontakts über einer Silizidschicht (
214 ), die in einem Halbleiterchip angeordnet ist, den Schritt des Abscheidens einer Barrierenschicht (202 ) auf Seitenwänden (206 ,207 ) des Kontaktlochs (208 ) und auf einer natürlichen Oxidschicht (210 ), die an einer Unterseite des Kontaktlochs (208 ) angeordnet ist, wobei die Seitenwände (206 ,207 ) durch das Kontaktloch (208 ) in einer dielektrischen Schicht (204 ) definiert sind. Der Schritt des Abscheidens (150 ) der Barrierenschicht (202 ) auf den Seitenwänden (206 ,207 ) des Kontaktlochs (208 ) und auf der natürlichen Oxidschicht (210 ) kann so optimiert werden, dass die Barrierenschicht (202 ) an einer Oberseite des Kontaktlochs (208 ) eine größere Dicke aufweist als an der Unterseite des Kontaktlochs (208 ). Gemäß dieser beispielhaften Ausführungsform umfasst das Verfahren ferner das Entfernen (152 ) eines Bereichs (219 ) der Barrierenschicht (202 ) und der natürlichen Oxidschicht (210 ), die an der Unterseite des Kontaktlochs (208 ) angeordnet sind, um die Silizidschicht (214 ) freizulegen.
Claims (10)
- Verfahren zur Herstellung eines Kontakts über einer Silizidschicht (
214 ), die in einem Halbleiterchip angeordnet ist, wobei das Verfahren die Schritte umfasst: Abscheiden (150 ) einer Barrierenschicht (202 ) auf Seitenwänden (206 ,207 ) eines Kontaktlochs (208 ) und auf einer natürlichen Oxidschicht (210 ), die an einer Unterseite des Kontaktlochs (208 ) angeordnet ist, wobei die Seitenwände (206 ,207 ) durch das Kontaktloch (208 ) in einer dielektrischen Schicht (204 ) definiert sind; Entfernen (152 ) eines Bereichs (219 ) der Barrierenschicht (202 ) und der natürlichen Oxidschicht (210 ), die an der Unterseite des Kontaktlochs (208 ) angeordnet sind, um die Silizidschicht (214 ) freizulegen. - Verfahren nach Anspruch 1, wobei das Entfernen (
152 ) des Bereichs (219 ) der Barrierenschicht (202 ) und der natürlichen Oxidschicht (210 ), die an der Unterseite des Kontaktlochs (208 ) angeordnet sind, Anwenden eines Sputter-Ätzprozesses umfasst. - Verfahren nach Anspruch 1, wobei die dielektrische Schicht (
204 ) obere Eckengebiete (222 ) aufweist, die benachbart zu dem Kontaktloch (208 ) angeordnet sind, wobei die oberen Eckengebiete (222 ) der dielektrischen Schicht (204 ) während des Entfernens (152 ) des Bereichs (219 ) der Barrierenschicht (202 ) und der natürlichen Oxidschicht (210 ), der an der Unterseite des Kontaktlochs (208 ) angeordnet sind, nicht geätzt wird. - Verfahren nach Anspruch 2, wobei das Kontaktloch (
208 ) eine elektrische Kontaktbreite (220 ) aufweist, und wobei die elektrische Kontaktbreite (220 ) durch den Sputter-Ätzprozess nicht vergrößert wird. - Verfahren zur Herstellung eines Kontakts über einer Silizidschicht (
414 ), die in einem Halbleiterchip angeordnet ist, wobei das Verfahren die Schritte umfasst: Entfernen (350 ) einer natürlichen Oxidschicht (410 ), die über der Silizidschicht (414 ) an einer Unterseite eines Kontaktlochs (408 ) angeordnet ist, durch Anwenden eines reaktiven Wasserstoffvorreinigungsprozesses (430 ), wobei Seitenwände (406 ,407 ) durch das Kon taktloch (408 ) in einer dielektrischen Schicht (404 ) definiert sind, und wobei die dielektrische Schicht (404 ) obere Eckengebiete (422 ) aufweist, die benachbart zu dem Kontaktloch (408 ) angeordnet sind; Abscheiden (352 ) einer Barrierenschicht (432 ) auf den Seitenwänden (406 ,407 ) des Kontaktlochs (408 ) und über der Silizidschicht (414 ). - Verfahren nach Anspruch 5, wobei der reaktive Wasserstoffvorreinigungsprozess (
430 ) die oberen Ecken (422 ) der dielektrischen Schicht (404 ) nicht ätzt. - Verfahren nach Anspruch 5, wobei das Kontaktloch (
408 ) eine elektrische Kontaktbreite (420 ) aufweist, und wobei die elektrische Kontaktbreite (420 ) durch den reaktiven Wasserstoffvorreinigungsprozess (430 ) nicht vergrößert wird. - Verfahren zur Herstellung eines Kontakts über einer Silizidschicht (
514 ), die in einem Halbleiterchip angeordnet ist, wobei das Verfahren die Schritte umfasst: Abscheiden (555 ) einer Barrierenschicht (602 ) auf Seitenwänden (606 ,607 ) eines Kontaktlochs (608 ) und auf einer natürlichen Oxidschicht (610 ), die an einer Unterseite des Kontaktlochs (608 ) angeordnet ist, wobei die Seitenwände (606 ,607 ) durch das Kontaktloch (608 ) in einer dielektrischen Schicht (604 ) definiert sind, und wobei die natürliche Oxidschicht (610 ) über der Silizidschicht (614 ) angeordnet ist; Entfernen (552 ) der natürlichen Oxidschicht (610 ), die über der Silizidschicht (614 ) an der Unterseite des Kontaktlochs (608 ) angeordnet ist, durch Anwenden eines Sputter-/Ätz-Abscheide-Prozesses. - Verfahren nach Anspruch 8, wobei Entfernen (
552 ) der natürlichen Oxidschicht (610 ), die über der Silizidschicht (614 ) angeordnet ist, an der Unterseite des Kontaktlochs (608 ) umfasst: simultanes Sputter-Ätzen der Barrierenschicht (602 ) und der natürlichen Oxidschicht (610 ) und Abscheiden von Titan/Titannitrid auf der Barrierenschicht (602 ). - Verfahren nach Anspruch 8, wobei das Kontaktloch (
608 ) eine elektrische Kontaktbreite (620 ) aufweist, und wobei die elektrische Kontaktbreite (620 ) durch den Sputter-Ätz-Abscheide-Prozess nicht vergrößert wird.
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US10/705,631 | 2003-11-08 | ||
US10/705,631 US7005387B2 (en) | 2003-11-08 | 2003-11-08 | Method for preventing an increase in contact hole width during contact formation |
PCT/US2004/033417 WO2005048342A1 (en) | 2003-11-08 | 2004-10-08 | Method for preventing an increase in contact hole width during contact formation |
Publications (1)
Publication Number | Publication Date |
---|---|
DE112004002156T5 true DE112004002156T5 (de) | 2006-09-14 |
Family
ID=34552414
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE112004002156T Ceased DE112004002156T5 (de) | 2003-11-08 | 2004-10-08 | Verfahren zum Verhindern der Vergrößerung einer Kontaktlochbreite während der Kontaktherstellung |
Country Status (8)
Country | Link |
---|---|
US (1) | US7005387B2 (de) |
JP (1) | JP4662943B2 (de) |
KR (1) | KR101180977B1 (de) |
CN (1) | CN1883045A (de) |
DE (1) | DE112004002156T5 (de) |
GB (1) | GB2423635B (de) |
TW (1) | TWI359475B (de) |
WO (1) | WO2005048342A1 (de) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20080038910A1 (en) * | 2006-08-10 | 2008-02-14 | Advanced Micro Devices, Inc. | Multiple lithography for reduced negative feature corner rounding |
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JP6494940B2 (ja) * | 2013-07-25 | 2019-04-03 | ラム リサーチ コーポレーションLam Research Corporation | 異なるサイズのフィーチャへのボイドフリータングステン充填 |
US9972504B2 (en) | 2015-08-07 | 2018-05-15 | Lam Research Corporation | Atomic layer etching of tungsten for enhanced tungsten deposition fill |
KR102607331B1 (ko) * | 2018-07-13 | 2023-11-29 | 에스케이하이닉스 주식회사 | 고종횡비 구조를 위한 갭필 방법 및 그를 이용한 반도체장치 제조 방법 |
Family Cites Families (21)
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---|---|---|---|---|
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JPH0661181A (ja) | 1992-08-11 | 1994-03-04 | Sony Corp | バリアメタルの形成方法 |
JP3237917B2 (ja) * | 1992-09-22 | 2001-12-10 | 沖電気工業株式会社 | 半導体素子の製造方法 |
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-
2003
- 2003-11-08 US US10/705,631 patent/US7005387B2/en not_active Expired - Fee Related
-
2004
- 2004-10-08 GB GB0608285A patent/GB2423635B/en not_active Expired - Fee Related
- 2004-10-08 KR KR1020067008659A patent/KR101180977B1/ko not_active IP Right Cessation
- 2004-10-08 JP JP2006539499A patent/JP4662943B2/ja not_active Expired - Fee Related
- 2004-10-08 DE DE112004002156T patent/DE112004002156T5/de not_active Ceased
- 2004-10-08 CN CNA2004800337772A patent/CN1883045A/zh active Pending
- 2004-10-08 WO PCT/US2004/033417 patent/WO2005048342A1/en active Application Filing
- 2004-10-18 TW TW093131505A patent/TWI359475B/zh not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
TWI359475B (en) | 2012-03-01 |
GB0608285D0 (en) | 2006-06-07 |
TW200524077A (en) | 2005-07-16 |
US20050101148A1 (en) | 2005-05-12 |
GB2423635B (en) | 2007-05-30 |
US7005387B2 (en) | 2006-02-28 |
CN1883045A (zh) | 2006-12-20 |
KR101180977B1 (ko) | 2012-09-07 |
JP2007511087A (ja) | 2007-04-26 |
WO2005048342A1 (en) | 2005-05-26 |
JP4662943B2 (ja) | 2011-03-30 |
KR20060107763A (ko) | 2006-10-16 |
GB2423635A (en) | 2006-08-30 |
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8127 | New person/name/address of the applicant |
Owner name: GLOBALFOUNDRIES INC., GRAND CAYMAN, KY |
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8128 | New person/name/address of the agent |
Representative=s name: GRUENECKER, KINKELDEY, STOCKMAIR & SCHWANHAEUSSER, |
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R002 | Refusal decision in examination/registration proceedings | ||
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