DE102014221633B4 - Verfahren zur Herstellung einer Halbleitervorrichtung - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 61
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 23
- 229910052751 metal Inorganic materials 0.000 claims abstract description 84
- 239000002184 metal Substances 0.000 claims abstract description 84
- 230000008018 melting Effects 0.000 claims abstract description 64
- 238000002844 melting Methods 0.000 claims abstract description 64
- 238000000137 annealing Methods 0.000 claims abstract description 23
- 230000005496 eutectics Effects 0.000 claims abstract description 5
- -1 nitride compound Chemical class 0.000 claims description 3
- 239000000463 material Substances 0.000 claims description 2
- 235000012431 wafers Nutrition 0.000 description 40
- 238000010438 heat treatment Methods 0.000 description 14
- 238000000034 method Methods 0.000 description 14
- 238000009792 diffusion process Methods 0.000 description 6
- 229910052782 aluminium Inorganic materials 0.000 description 5
- 238000005275 alloying Methods 0.000 description 4
- 238000001816 cooling Methods 0.000 description 4
- 229910002601 GaN Inorganic materials 0.000 description 3
- 230000004048 modification Effects 0.000 description 3
- 238000012986 modification Methods 0.000 description 3
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 2
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 2
- 230000004888 barrier function Effects 0.000 description 2
- 239000007772 electrode material Substances 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- 229910052760 oxygen Inorganic materials 0.000 description 2
- 239000001301 oxygen Substances 0.000 description 2
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 2
- 229910002704 AlGaN Inorganic materials 0.000 description 1
- 229910017401 Au—Ge Inorganic materials 0.000 description 1
- 229910000846 In alloy Inorganic materials 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 239000002131 composite material Substances 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 230000018109 developmental process Effects 0.000 description 1
- 238000002347 injection Methods 0.000 description 1
- 239000007924 injection Substances 0.000 description 1
- 230000007246 mechanism Effects 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 229910052758 niobium Inorganic materials 0.000 description 1
- 229910052702 rhenium Inorganic materials 0.000 description 1
- 239000007787 solid Substances 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
- 229910052715 tantalum Inorganic materials 0.000 description 1
- 238000004627 transmission electron microscopy Methods 0.000 description 1
- 229910052721 tungsten Inorganic materials 0.000 description 1
- 238000001771 vacuum deposition Methods 0.000 description 1
- 229910052726 zirconium Inorganic materials 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/283—Deposition of conductive or insulating materials for electrodes conducting electric current
- H01L21/285—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation
- H01L21/28506—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers
- H01L21/28575—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising AIIIBV compounds
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/283—Deposition of conductive or insulating materials for electrodes conducting electric current
- H01L21/285—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation
- H01L21/28506—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers
- H01L21/28512—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic Table
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/20—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
- H01L29/2003—Nitride compounds
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/45—Ohmic electrodes
- H01L29/452—Ohmic electrodes on AIII-BV compounds
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- Engineering & Computer Science (AREA)
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- Condensed Matter Physics & Semiconductors (AREA)
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Abstract
Verfahren zur Herstellung einer Halbleitervorrichtung (10), das Folgendes umfasst:einen Schritt zum Ausbilden einer Mehrfachmetallschicht (14) für jedes von mehreren Halbleiterelementen (12), die auf einem Wafer ausgebildet sind;einen Schritt zum Legen des Wafers in einen Temperofen;einen ersten Temperaturerhöhungsschritt zum Erhöhen einer Temperatur im Temperofen auf eine Temperatur innerhalb eines ersten Temperaturbereichs zwischen einer Temperatur, die um 100 °C niedriger ist als ein minimaler Schmelzpunkt, und dem minimalen Schmelzpunkt, wobei der minimale Schmelzpunkt ein niedrigster Schmelzpunkt unter Schmelzpunkten der jeweiligen Schichten (16, 18, 20, 22) der Mehrfachmetallschicht (14) ist;einen Temperaturhalteschritt zum Halten der Temperatur innerhalb des ersten Temperaturbereichs für 30 s bis 150 s nach dem ersten Temperaturerhöhungsschritt;einen zweiten Temperaturerhöhungsschritt zum Erhöhen der Temperatur im Ofen auf eine Temperatur innerhalb eines zweiten Temperaturbereichs, die niedriger als ein maximaler Schmelzpunkt, der ein höchster Schmelzpunkt ist, und höher als der minimale Schmelzpunkt unter Schmelzpunkten der jeweiligen Schichten (16, 18, 20, 22) der Mehrfachmetallschicht (14) ist, nach dem Temperaturhalteschritt mit einer Temperaturerhöhungsgeschwindigkeit von 5 °C/s bis 20 °C/s; undeinen Temperschritt zum Halten der Temperatur innerhalb des zweiten Temperaturbereichs für 30 s bis 150 s nach dem zweiten Temperaturerhöhungsschritt und Ausbilden einer ohmschen Elektrode der Mehrfachmetallschicht (14),wobei die Mehrfachmetallschicht (14) bei einer Temperatur, die niedriger ist als der maximale Schmelzpunkt, keinen eutektischen Punkt aufweist.
Description
- Die vorliegende Erfindung bezieht sich auf ein Verfahren zur Herstellung einer Halbleitervorrichtung mit einer ohmschen Elektrode, die dazu vorgesehen ist, beispielsweise einem Halbleiterelement Leistung zuzuführen.
-
JP 2001 - 196 574 A -
US 7 615 868 B2 offenbart einen Anschluss mit einer Halbleiterschicht, einer ersten Metallschicht aus Al, und einer zweiten Halbleiterschicht aus zumindest einer Metall innerhalb von Nb, W, Fe, Hf, Re, Ta und Zr. -
US 5 387 549 A offenbart ein Herstellungsverfahren eines ohmischen Kontaktes, in dem eine erste Metallschicht mit In oder einer In-Legierung auf einer Kompositum-Halbleiterschicht ausgebildet, einer zweiten Metallschicht mit einer Au-Ge-Legierung auf der ersten Metallschicht ausgebildet wird, und Legierungsbehandlung mit einer Temperatur von 350°C oder weniger durchgeführt wird. Außerdem wird auf dieCN 102 931 054 A und dieWO 2011 / 078 252 A1 - Das Dokument Bright et. al.: Correlation of contact resistance with microstructure for Au/Ni/Al/Ti/AlGaN/GaN ohmic contacts using transmission electron microscopy. In: Journal of Applied Physics, 89, 2001, 6, 3143 - 3150 offenbart eine Technik zum Ausbilden einer ohmschen Elektrode, die dazu vorgesehen ist, einem Halbleiterelement Leistung zuzuführen, durch Wärmebehandlung anstelle von Ioneninjektion.
- Auf einem Wafer werden viele ohmsche Elektroden ausgebildet, um ein auf dem Wafer ausgebildetes Halbleiterelement zu kontaktieren. Der Widerstandswert eines Kontakts zwischen dem Halbleiterelement und den ohmschen Elektroden ist vorzugsweise innerhalb der Oberfläche des Wafers gleichmäßig. Das Verfahren zum Ausbilden einer ohmschen Elektrode durch Wärmebehandlung, das im Journal of Applied Physics Band 89, S. 3143 bis S. 3150, offenbart ist, weist jedoch das Problem auf, dass die Gleichmäßigkeit des Kontaktwiderstandswerts innerhalb der Oberfläche der Wafers unzureichend ist.
- Die vorliegende Erfindung wurde implementiert, um das vorstehend beschriebene Problem zu lösen, und es ist eine Aufgabe der vorliegenden Erfindung, ein Verfahren zur Herstellung einer Halbleitervorrichtung zu schaffen, das in der Lage ist, die Gleichmäßigkeit des Kontaktwiderstandswerts innerhalb der Oberfläche des Wafers zu verbessern.
- Erfindungsgemäß wird diese Aufgabe durch ein Verfahren nach Anspruch 1 gelöst.
- Die Merkmale und Vorteile der vorliegenden Erfindung können wie folgt zusammengefasst werden.
- Vorteilhafte Weiterbildungen der Erfindung ergeben sich aus den abhängigen Ansprüchen
- Weitere Merkmale und Zweckmäßigkeiten der Erfindung ergeben sich aus der Beschreibung von Ausführungsformen der Erfindung anhand der Figuren. Von den Figuren zeigen:
-
1 eine Querschnittsansicht einer Halbleitervorrichtung; -
2 eine Wärmebehandlungsprozedur; -
3 einen Graphen, der Ergebnisse der Messung von Kontaktwiderstandswerten an sieben Punkten innerhalb der Oberfläche des Wafers der vorliegenden Erfindung darstellt; -
4 einen Graphen, der Ergebnisse der Messung von Kontaktwiderstandswerten an sieben Punkten innerhalb der Oberfläche des ohne Temperaturhalteschritt hergestellten Wafers darstellt; -
5 eine Querschnittsansicht einer Halbleitervorrichtung gemäß der zweiten Ausführungsform; und -
6 eine Wärmebehandlungsprozedur. - Ein Verfahren zur Herstellung einer Halbleitervorrichtung gemäß Ausführungsformen der vorliegenden Erfindung wird mit Bezug auf die begleitenden Zeichnungen beschrieben. Denselben oder entsprechenden Komponenten werden dieselben Bezugszeichen zugewiesen und auf eine doppelte Beschreibung kann verzichtet werden.
- Erste Ausführungsform
-
1 ist eine Querschnittsansicht einer Halbleitervorrichtung 10. Die Halbleitervorrichtung 10 ist mit einem Halbleiterelement 12 versehen. Eine Mehrfachmetallschicht 14 ist auf dem Halbleiterelement 12 ausgebildet. Die Mehrfachmetallschicht 14 ist auf einem spezifischen Abschnitt des Halbleiterelements 12 ausgebildet, beispielsweise um Leistung zum Halbleiterelement 12 zuzuführen. Die Mehrfachmetallschicht 14 ist mit einer ersten Metallschicht 16, einer zweiten Metallschicht 18, einer dritten Metallschicht 20 und einer vierten Metallschicht 22 versehen. Die Mehrfachmetallschicht 14 bildet als Ganzes eine ohmsche Elektrode. - Ein Verfahren zur Herstellung einer Halbleitervorrichtung gemäß der ersten Ausführungsform der vorliegenden Erfindung wird beschrieben. Im Verfahren zur Herstellung einer Halbleitervorrichtung gemäß der ersten Ausführungsform der vorliegenden Erfindung wird die Mehrfachmetallschicht 14 für jedes von mehreren Halbleiterelementen, die auf einem Wafer ausgebildet sind, ausgebildet. Das heißt, mehrere Mehrfachmetallschichten 14 werden auf dem Wafer ausgebildet. Die Mehrfachmetallschicht 14 wird beispielsweise unter Verwendung eines Vakuumabscheidungsverfahrens oder Sputterverfahrens ausgebildet.
- Ein Schmelzpunkt der ersten Metallschicht 16 ist t1, ein Schmelzpunkt der zweiten Metallschicht 18 ist t2, der niedriger ist als t1, ein Schmelzpunkt der dritten Metallschicht 20 ist t3, der niedriger ist als t2, und ein Schmelzpunkt der vierten Metallschicht 22 ist t4, der niedriger ist als t3. Der niedrigste Schmelzpunkt unter den Schmelzpunkten der jeweiligen Schichten der Mehrfachmetallschicht 14 wird „minimaler Schmelzpunkt“ genannt. Der minimale Schmelzpunkt ist t4. Der höchste Schmelzpunkt unter den Schmelzpunkten der jeweiligen Schichten der Mehrfachmetallschicht 14 wird „maximaler Schmelzpunkt“ genannt. Der maximale Schmelzpunkt ist t1. Es ist zu beachten, dass die Mehrfachmetallschicht 14 keinen eutektischen Punkt bei einer Temperatur aufweist, die niedriger ist als der maximale Schmelzpunkt.
- Als nächstes wird der Wafer in einen Temperofen gelegt. Als nächstes wird die Mehrfachmetallschicht 14 einer Wärmebehandlung im Temperofen unterzogen. Die Wärmebehandlung wird mit Bezug auf
2 beschrieben. Zuerst wird eine anfängliche Periode P1 beschrieben. Die Temperatur der Mehrfachmetallschicht 14 an einem Startpunkt der Periode P1 ist normalerweise Raumtemperatur. Die Temperatur im Temperofen wird auf eine Temperatur innerhalb eines ersten Temperaturbereichs von einer Temperatur, die um 100 °C niedriger ist als der minimale Schmelzpunkt (t4), auf den minimalen Schmelzpunkt erhöht. Dieser Schritt wird „erster Temperaturerhöhungsschritt“ genannt. - Die Temperaturerhöhungsgeschwindigkeit im ersten Temperaturerhöhungsschritt ist nicht besonders begrenzt und liegt beispielsweise im Bereich von 5 °C/s bis 50 °C/s. Das Verfahren zum Erhöhen der Temperatur im Ofen ist nicht besonders begrenzt und ist beispielsweise Widerstandserwärmung oder Lampenbestrahlung.
- Als nächstes wird eine Periode P2 beschrieben. In der Periode P2 wird nach dem ersten Temperaturerhöhungsschritt die Temperatur innerhalb des ersten Temperaturbereichs für 30 s bis 150 s gehalten. Dieser Schritt wird „Temperaturhalteschritt“ genannt. Im Temperaturhalteschritt kann die Temperatur innerhalb des ersten Temperaturbereichs zeitlich geändert werden oder eine spezifische Temperatur innerhalb des ersten Temperaturbereichs kann aufrechterhalten werden.
- Als nächstes wird eine Periode P3 beschrieben. In der Periode P3 wird nach dem Temperaturhalteschritt die Temperatur im Ofen auf eine Temperatur innerhalb eines zweiten Temperaturbereichs, die niedriger als der maximale Schmelzpunkt und höher als der minimale Schmelzpunkt ist, erhöht. Dieser Schritt wird „zweiter Temperaturerhöhungsschritt“ genannt. Die Temperaturerhöhungsgeschwindigkeit im zweiten Temperaturerhöhungsschritt wird als 5 °C/s bis 20 °C/s angenommen.
- Als nächstes wird eine Periode P4 beschrieben. In der Periode P4 wird nach dem zweiten Temperaturerhöhungsschritt eine Temperatur innerhalb des zweiten Temperaturbereichs für 30 s bis 150 s gehalten und ohmsche Elektroden werden unter Verwendung der Mehrfachmetallschicht 14 ausgebildet. Dieser Schritt wird „Temperschritt“ genannt. Der Temperschritt bewirkt, dass eine Legierungsreaktion zwischen dem Halbleiterelement 12 und der Mehrfachmetallschicht 14 stattfindet, die eine Elektronenbarriere oder eine Barriere von positiven Löchern zwischen dem Halbleiterelement und der Mehrfachmetallschicht verringert.
- Als nächstes wird eine Periode P5 beschrieben. In der Periode P5 wird der Temperofen abgekühlt und auf die Raumtemperatur zurückgeführt. Dieser Schritt wird „Abkühlungsschritt“ genannt. Das Abkühlverfahren ist nicht besonders begrenzt und beispielsweise kann eine natürliche Abkühlung übernommen werden. Das Verfahren zur Herstellung einer Halbleitervorrichtung gemäß der ersten Ausführungsform der vorliegenden Erfindung bildet mehrere Mehrfachmetallschichten 14 auf einem Wafer gemäß den vorstehend beschriebenen Schritten aus.
- Im Temperaturhalteschritt findet eine gegenseitige Diffusion (Diffusion einer festen Schicht) zwischen der ersten Metallschicht 16, der zweiten Metallschicht 18, der dritten Metallschicht 20 und der vierten Metallschicht 22 statt und die Differenzen der Schmelzpunkte zwischen diesen Schichten werden verringert. Eine Zeit von 30 s bis 150 s ist erforderlich, um zu ermöglichen, dass die gegenseitige Diffusion ausreichend stattfindet. Das Vorsehen des Temperaturhalteschritts ermöglicht, dass die Temperaturgleichmäßigkeit innerhalb der Oberfläche des Wafers sich im Vergleich zu einem Fall ohne Temperaturhalteschritt verbessert.
- Im zweiten Temperaturerhöhungsschritt ist es durch Begrenzen der Temperaturerhöhungsgeschwindigkeit auf 5 °C/s bis 20 °C/s möglich, die Temperatur innerhalb des zweiten Temperaturbereichs zu erhöhen, während eine zufriedenstellende Temperaturgleichmäßigkeit innerhalb der Oberfläche des Wafers aufrechterhalten wird. Wenn die Temperaturerhöhungsgeschwindigkeit geringer ist als 5 C/s, wird eine Störstelle (restlicher Sauerstoff- oder Wassergehalt oder dergleichen) in das Elektrodenmaterial aufgenommen. Wenn andererseits die Temperaturerhöhungsgeschwindigkeit größer als 20 °C/s ist, verschlechtert sich die Temperaturgleichmäßigkeit innerhalb der Oberfläche des Wafers während des Temperaturanstiegs. Im zweiten Temperaturerhöhungsschritt wird daher die Temperaturerhöhungsgeschwindigkeit auf 5 °C/s bis 20 °C/s begrenzt. Dies macht es möglich, den Temperschritt auszuführen, während die Temperaturgleichmä-ßigkeit innerhalb der Oberfläche des Wafers aufrechterhalten wird, und dadurch die Gleichmäßigkeit des Kontaktwiderstandswerts innerhalb der Oberfläche des Wafers zwischen dem Halbleiterelement 12 und der ohmschen Elektrode (Mehrfachmetallschicht 14) zu verbessern.
- Da die Mehrfachmetallschicht 14 keinen eutektischen Punkt bei einer Temperatur aufweist, die niedriger ist als der maximale Schmelzpunkt, ist es möglich zu verhindern, dass die ganze Mehrfachmetallschicht 14 im Temperschritt schmilzt.
-
3 ist ein Graph, der Ergebnisse der Messung von Kontaktwiderstandswerten an sieben Punkten innerhalb der Oberfläche des Wafers der Halbleitervorrichtung, die unter Verwendung des Verfahrens zur Herstellung einer Halbleitervorrichtung gemäß der ersten Ausführungsform der vorliegenden Erfindung hergestellt wurde, darstellt. Kontaktwiderstandswerte mit im Wesentlichen keiner Veränderung werden in den jeweiligen Punkten innerhalb der Oberfläche des Wafers erhalten.4 ist ein Graph, der Ergebnisse der Messung von Kontaktwiderstandswerten an sieben Punkten innerhalb der Oberfläche des Wafers der Halbleitervorrichtung darstellt, die unter Verwendung des Herstellungsverfahrens hergestellt wurde, wobei der Temperaturhalteschritt aus dem Verfahren zur Herstellung einer Halbleitervorrichtung gemäß der ersten Ausführungsform der vorliegenden Erfindung ausgeschlossen ist. Veränderungen von Kontaktwiderstandswerten werden an den jeweiligen Punkten innerhalb der Oberfläche des Wafers beobachtet. - Die Reihenfolge der Anordnung der jeweiligen Schichten, die die Mehrfachmetallschicht 14 bilden, ist nicht besonders begrenzt. Die Anzahl von Schichten, die die Mehrfachmetallschicht 14 bilden, ist nicht besonders begrenzt. Das Halbleiterelement 12 besteht im Allgemeinen aus Si. Wenn jedoch veranlasst wird, dass das Halbleiterelement 12 als Hochfrequenzelement fungiert, kann das Halbleiterelement 12 aus einem Nitridverbundhalbleiter wie z. B. GaN ausgebildet sein. Es ist zu beachten, dass die vorstehend beschriebene Modifikation auf das Verfahren zur Herstellung einer Halbleitervorrichtung gemäß der folgenden Ausführungsform anwendbar ist.
- Zweite Ausführungsform
- Ein Verfahren zur Herstellung einer Halbleitervorrichtung gemäß einer zweiten Ausführungsform der vorliegenden Erfindung bezieht sich auf das Verfahren zur Herstellung einer Halbleitervorrichtung gemäß der ersten Ausführungsform, in der Ti und Al als Mehrfachmetallschicht übernommen werden.
5 ist eine Querschnittsansicht einer Halbleitervorrichtung 50 gemäß der zweiten Ausführungsform der vorliegenden Erfindung. Eine Mehrfachmetallschicht 52 ist mit einer Ti-Schicht 54, die auf dem Halbleiterelement 12 ausgebildet ist, als erste Metallschicht, einer Al-Schicht 56, die auf der Ti-Schicht 54 ausgebildet ist, als zweite Metallschicht und einer Ti-Schicht 58, die auf der Al-Schicht 56 ausgebildet ist, als dritte Metallschicht versehen. - Die Ti-Schicht 54, die die erste Metallschicht ist, und die Ti-Schicht 58, die die dritte Metallschicht ist, bestehen aus demselben Material. Schmelzpunkte der Ti-Schichten 54 und 58 sind 1668 °C und ein Schmelzpunkt der Al-Schicht 56 ist 660 °C. Die Ti-Schichten 54 und 58 und die Al-Schicht 56 weisen keinen eutektischen Punkt auf. Das Verfahren zur Herstellung der Halbleitervorrichtung 50 wird nachstehend beschrieben.
- Zuerst wird die Mehrfachmetallschicht 52 für jedes von mehreren Halbleiterelementen, die auf einem Wafer ausgebildet sind, ausgebildet. Als nächstes wird der Wafer in einen Temperofen gelegt. Als nächstes wird der Wafer einer Wärmebehandlung unterzogen. Die Wärmebehandlung wird mit Bezug auf
6 beschrieben. Ein erster Temperaturerhöhungsschritt (Periode P1) wird beschrieben. Ein minimaler Schmelzpunkt, der der niedrigste Schmelzpunkt unter Schmelzpunkten der jeweiligen Schichten der Mehrfachmetallschicht 52 ist, ist 660 °C. Ein erster Temperaturbereich ist ein Bereich von einer Temperatur (560 °C), die um 100 °C niedriger ist als der minimale Schmelzpunkt, zum minimalen Schmelzpunkt (660 °C). Im ersten Temperaturerhöhungsschritt wird die Temperatur im Ofen auf eine Temperatur innerhalb des ersten Temperaturbereichs (560 °C bis 660 °C) erhöht. - Als nächstes wird im Temperaturhalteschritt (Periode P2) die Temperatur innerhalb des ersten Temperaturbereichs (560 °C bis 660 °C) für 30 s bis 150 s gehalten. Als nächstes wird im zweiten Temperaturerhöhungsschritt (Periode P3) die Temperatur im Ofen auf eine Temperatur innerhalb des zweiten Temperaturbereichs erhöht, die niedriger als der maximale Schmelzpunkt (1668 C), der der höchste Schmelzpunkt ist, und höher als der minimale Schmelzpunkt (660 °C) unter den Schmelzpunkten der jeweiligen Schichten der Mehrfachmetallschicht 52 ist. Die Temperaturerhöhungsgeschwindigkeit im zweiten Temperaturerhöhungsschritt liegt im Bereich von 5 °C/s bis 20 °C/s. In der zweiten Ausführungsform der vorliegenden Erfindung wird die Temperatur im Ofen auf 750 °C bis 950 °C erhöht, die eine Temperatur innerhalb des zweiten Temperaturbereichs ist.
- Als nächstes wird im Temperschritt (Periode P4) 750 °C bis 950 °C, die eine Temperatur innerhalb des zweiten Temperaturbereichs ist, für 30 s bis 150 s gehalten und ohmsche Elektroden werden aus der Mehrfachmetallschicht 52 ausgebildet. Schließlich wird im Abkühlungsschritt (Periode P5) die Temperatur im Ofen auf die Größenordnung der Raumtemperatur gesenkt.
- Die Differenz des Schmelzpunkts zwischen Ti und Al ist sehr groß, wobei sie 1000 °C überschreitet. Aus diesem Grund tritt wahrscheinlich, wenn die Mehrfachmetallschicht 52 aus Ti und Al besteht, eine Temperaturdifferenz zwischen dem mittleren Bereich und dem Umfang des Wafers auf. Wenn beispielsweise die Mehrfachmetallschicht, die Ti und Al enthält, von Raumtemperatur auf eine Temperatur im Temperschritt (z. B. 900 °C) erhitzt wird und ein Dehnen und Tempern durchgeführt werden, kann eine Gleitlinie auftreten oder die Zusammensetzung des Verbundhalbleiters kann ungleichmäßig werden oder eine Verzerrung des Wafers kann auftreten. Alle diese Ereignisse können verursachen, dass sich die Gleichmäßigkeit des Kontaktwiderstandswerts innerhalb der Oberfläche des Wafers verschlechtert.
- Gemäß dem Verfahren zur Herstellung einer Halbleitervorrichtung gemäß der zweiten Ausführungsform der vorliegenden Erfindung wird angenommen, dass im Temperaturhalteschritt zum Halten einer Temperatur von 560 °C bis 660 °C eine gegenseitige Diffusion aufgetreten ist, bei der Al der Al-Schicht 56 in die Ti-Schichten 54 und 58 diffundiert wird und Ti der Ti-Schichten 54 und 58 in die Al-Schicht 56 diffundiert wird. Diese gegenseitige Diffusion verursacht, dass die Schmelzpunkte der Ti-Schichten 54 und 58 niedriger sind als 1668 °C, und verursacht, dass der Schmelzpunkt der Al-Schicht 56 höher ist als 660 °C. Das heißt, die Differenz der Schmelzpunkte nimmt ab. Daher können Temperaturveränderungen innerhalb der Oberfläche des Wafers verringert werden.
- Hinsichtlich der Zeit im Temperaturhalteschritt wird, wenn diese Zeit kürzer als 30 s oder länger als 150 s ist, die Gleichmäßigkeit des Kontaktwiderstandswerts innerhalb der Oberfläche des Wafers nicht verbessert und eher verschlechtert und somit wird diese Zeit auf 30 s bis 150 s gesetzt. Durch Vorsehen von 30 s oder mehr für den Temperaturhalteschritt wird angenommen, dass Ti und Al gegenseitig ausreichend diffundiert werden. Ein Mechanismus, wenn der Temperaturhalteschritt länger als 150 s festgelegt wird, ist unbekannt.
- Im zweiten Temperaturerhöhungsschritt wird die Temperaturerhöhungsgeschwindigkeit auf 5 °C/s bis 20 °C/s festgelegt und daher kann die Temperatur erhöht werden, während die Temperaturgleichmäßigkeit innerhalb der Oberfläche des Wafers aufrechterhalten wird. Daher ist es möglich zu bewirken, dass eine Legierungsreaktion zwischen dem Halbleiterelement und der Mehrfachmetallschicht im Temperschritt fortschreitet, während die Temperaturgleichmäßigkeit innerhalb der Oberfläche des Wafers aufrechterhalten wird.
- Wenn im zweiten Temperaturerhöhungsschritt die Temperaturerhöhungsgeschwindigkeit auf weniger als 5 °C/s festgelegt wird, kann ein Problem auftreten, bei dem eine Störstelle (restlicher Sauerstoff- oder Wassergehalt oder dergleichen) im Temperofen in das Elektrodenmaterial während des Temperaturanstiegs aufgenommen werden kann. Wenn andererseits die Temperaturerhöhungsgeschwindigkeit größer als 20 °C/s festgelegt wird, kann die Temperaturgleichmäßigkeit innerhalb der Oberfläche des Wafers während des Temperaturanstiegs nicht aufrechterhalten werden.
- Im Temperschritt ist die Bearbeitungszeit vorzugsweise auf 30 s bis 150 s festgelegt. Innerhalb einer Bearbeitungszeit, die kürzer ist als 30 s, schreitet die Legierungsreaktion zwischen dem Halbleiterelement und der Mehrfachmetallschicht nicht ausreichend fort. Innerhalb einer Bearbeitungszeit, die länger ist als 150 s, wird alternativ geschätzt, dass die Temperatur innerhalb der Oberfläche des Wafers ungleichmäßig ist, aber Details sind noch festzustellen.
- Ein wichtiger Punkt der vorliegenden Erfindung besteht darin, den Temperaturhalteschritt vor dem Temperschritt auszuführen. In dem Temperaturhalteschritt werden Komponenten der jeweiligen Schichten der Mehrfachmetallschicht zum Diffundieren gebracht, dann werden Differenzen der Schmelzpunkte dazwischen verringert und die Temperaturgleichmäßigkeit innerhalb der Oberfläche des Wafers wird verbessert. Um die Differenz der Schmelzpunkte ausreichend zu verringern, wird die Zeit im Temperaturhalteschritt auf 30 s oder mehr und 150 s oder weniger festgelegt. Der zweite Temperaturerhöhungsschritt wird so ausgeführt, dass die Temperaturgleichmäßigkeit innerhalb der Oberfläche des so erhaltenen Wafers nicht verloren geht, und der Temperschritt wird ausgeführt. Verschiedene Modifikationen sind möglich, solange dieses Merkmal nicht verloren geht.
- In der zweiten Ausführungsform sind die Ti-Schicht und die Al-Schicht als Schichten übernommen, die die Mehrfachmetallschicht bilden, aber die vorliegende Erfindung ist nicht darauf begrenzt. Wenn Differenzen der Schmelzpunkte zwischen den jeweiligen Schichten, die die Mehrfachmetallschicht bilden, bestehen, ist es möglich, die Temperaturgleichmäßigkeit innerhalb der Oberfläche des Wafers zu verbessern und die Gleichmäßigkeit der Kontaktwiderstandswerte innerhalb der Oberfläche des Wafers unter Verwendung des Verfahrens zur Herstellung einer Halbleitervorrichtung der vorliegenden Erfindung zu verbessern.
- Die vorliegende Erfindung fördert die Diffusion jeder Schicht der Mehrfachmetallschicht, verbessert die Temperaturgleichmä-ßigkeit innerhalb der Oberfläche des Wafers und tempert dann die Mehrfachmetallschicht und kann dadurch die Gleichmäßigkeit des Kontaktwiderstandswerts innerhalb der Oberfläche des Wafers verbessern.
- Offensichtlich sind viele Modifikationen und Veränderungen der vorliegenden Erfindung angesichts der obigen Lehren möglich. Daher kann die Erfindung innerhalb des Schutzbereichs der beigefügten Ansprüche selbstverständlich anders als spezifisch beschrieben ausgeführt werden.
Claims (5)
- Verfahren zur Herstellung einer Halbleitervorrichtung (10), das Folgendes umfasst: einen Schritt zum Ausbilden einer Mehrfachmetallschicht (14) für jedes von mehreren Halbleiterelementen (12), die auf einem Wafer ausgebildet sind; einen Schritt zum Legen des Wafers in einen Temperofen; einen ersten Temperaturerhöhungsschritt zum Erhöhen einer Temperatur im Temperofen auf eine Temperatur innerhalb eines ersten Temperaturbereichs zwischen einer Temperatur, die um 100 °C niedriger ist als ein minimaler Schmelzpunkt, und dem minimalen Schmelzpunkt, wobei der minimale Schmelzpunkt ein niedrigster Schmelzpunkt unter Schmelzpunkten der jeweiligen Schichten (16, 18, 20, 22) der Mehrfachmetallschicht (14) ist; einen Temperaturhalteschritt zum Halten der Temperatur innerhalb des ersten Temperaturbereichs für 30 s bis 150 s nach dem ersten Temperaturerhöhungsschritt; einen zweiten Temperaturerhöhungsschritt zum Erhöhen der Temperatur im Ofen auf eine Temperatur innerhalb eines zweiten Temperaturbereichs, die niedriger als ein maximaler Schmelzpunkt, der ein höchster Schmelzpunkt ist, und höher als der minimale Schmelzpunkt unter Schmelzpunkten der jeweiligen Schichten (16, 18, 20, 22) der Mehrfachmetallschicht (14) ist, nach dem Temperaturhalteschritt mit einer Temperaturerhöhungsgeschwindigkeit von 5 °C/s bis 20 °C/s; und einen Temperschritt zum Halten der Temperatur innerhalb des zweiten Temperaturbereichs für 30 s bis 150 s nach dem zweiten Temperaturerhöhungsschritt und Ausbilden einer ohmschen Elektrode der Mehrfachmetallschicht (14), wobei die Mehrfachmetallschicht (14) bei einer Temperatur, die niedriger ist als der maximale Schmelzpunkt, keinen eutektischen Punkt aufweist.
- Verfahren zur Herstellung einer Halbleitervorrichtung nach
Anspruch 1 , wobei die Mehrfachmetallschicht (52) eine erste Metallschicht (54), die auf dem Halbleiterelement (12) ausgebildet ist, eine zweite Metallschicht (56), die auf der ersten Metallschicht (54) ausgebildet ist, und eine dritte Metallschicht (58), die aus demselben Material wie die erste Metallschicht (54) besteht, auf der zweiten Metallschicht (56) umfasst. - Verfahren zur Herstellung einer Halbleitervorrichtung nach
Anspruch 2 , wobei die erste Metallschicht (54) und die dritte Metallschicht (58) aus Ti bestehen und die zweite Metallschicht (56) aus Al besteht. - Verfahren zur Herstellung einer Halbleitervorrichtung nach einem der
Ansprüche 1 bis3 , wobei das Halbleiterelement (12) aus einem Nitridverbundhalbleiter besteht. - Verfahren zur Herstellung einer Halbleitervorrichtung nach
Anspruch 1 , wobei die Halbleiterelemente auf einem Wafer ausgebildet sind, die Mehrfachmetallschicht eine erste Metallschicht (16) auf dem Halbleiterelement, eine zweite Metallschicht (18) auf der ersten Metallschicht (16), eine dritte Metallschicht (20) auf der zweiten Metallschicht (18) und eine vierte Metallschicht (22) auf der dritten Metallschicht (20) aufweist, ein Schmelzpunkt der vierten Metallschicht (22) niedriger als ein Schmelzpunkt der dritten Metallschicht (20) ist, ein Schmelzpunkt der dritten Metallschicht (20) niedriger als ein Schmelzpunkt der zweiten Metallschicht (18) ist, und der Schmelzpunkt der zweiten Metallschicht (18) niedriger als ein Schmelzpunkt der ersten Metallschicht (16) ist.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013-260582 | 2013-12-17 | ||
JP2013260582A JP6206159B2 (ja) | 2013-12-17 | 2013-12-17 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE102014221633A1 DE102014221633A1 (de) | 2015-06-18 |
DE102014221633B4 true DE102014221633B4 (de) | 2022-07-07 |
Family
ID=53192886
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102014221633.8A Active DE102014221633B4 (de) | 2013-12-17 | 2014-10-24 | Verfahren zur Herstellung einer Halbleitervorrichtung |
Country Status (5)
Country | Link |
---|---|
US (2) | US20150170921A1 (de) |
JP (1) | JP6206159B2 (de) |
KR (1) | KR101600325B1 (de) |
CN (1) | CN104716037B (de) |
DE (1) | DE102014221633B4 (de) |
Families Citing this family (1)
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KR20150070946A (ko) | 2015-06-25 |
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JP6206159B2 (ja) | 2017-10-04 |
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Legal Events
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R012 | Request for examination validly filed | ||
R084 | Declaration of willingness to licence | ||
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
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