DE102004004880A1 - Verbindungsverfahren für direkt verbundene gestapelte integrierte Schaltungen - Google Patents

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Abstract

Ein Verfahren und eine verwandte Konfiguration zum Stapeln und Verbinden mehrerer identischer integrierter Schaltungshalbleiterchips. Ein Chip, der gemäß der vorliegenden Erfindung entworfen ist, kann direkt mit einem anderen identischen Chip verbunden werden durch Plazieren eines zweiten Chips auf einem ersten Chip. Der zweite Chip ist im wesentlichen identisch zu dem ersten Chip und weist eine Drehung bezüglich des ersten Chips auf. Eine Mehrzahl von elektrischen Verbindungen auf dem ersten Chip ist mit einer Mehrzahl von elektrischen Verbindungen auf dem zweiten Chip in Kontakt und bildet elektrische Verbindungen zwischen benachbarten gestapelten Chips.

Description

  • Moderne Halbleiterbauelemente, die üblicherweise als integrierte Schaltungen oder „Chips" bezeichnet werden, werden auf Wafern hergestellt, und die Wafer werden dann in Gitter gesägt, wodurch die einzelnen Chips vor dem Zusammenbau in einem Gehäuse getrennt werden. Integrierte Schaltungen werden in einer Vielzahl von Größen hergestellt, aber reichen typischerweise von nur wenigen Millimetern zu einigen Zentimetern oder mehr in der Breite. Jeder Chip kann zahlreiche elektrische Signale für Eingabe oder Ausgabe aufweisen. Prozessoren können beispielsweise mehrere hundert Signale aufweisen.
  • Es müssen Maßnahmen getroffen werden, um einen Chip elektrisch mit der gedruckten Schaltungsplatine zu verbinden, mit der derselbe verwendet wird, und auch um den Chip vor Schäden oder anderen externen Bedingungen zu schützen, die den Betrieb desselben behindern könnten. Häusungstechnik oder Häusen ist das Gebiet in der Halbleitertechnik, das diese Bedürfnisse adressiert. Integrierte Schaltungen sind typischerweise in „Gehäusen" auf gedruckten Schaltungsplatinen befestigt, d. h. Strukturen, die eine elektrische Schnittstelle mit einer gedruckten Schaltungsplatine (oder einfach „Platine") liefern und auch einen bloßen Chip und dessen elektrische Verbindungen vor Schäden zu schützen, einschließlich Schäden aufgrund von Feuchtigkeit, Erschütterung und Stößen. Ein gehäuster Chip ist im allgemeinen an einem Metalleiterrahmen oder einem Substrat befestigt, elektrisch mit dem Leiterrahmen oder Substrat befestigt und zum Schutz mit einer keramischen Umhüllung oder einer Kunststoff-„Gußzusammensetzung" umhüllt.
  • Gelegentlich bieten herkömmliche Häusungslösungen keine angemessenen Platzeinsparungen auf einer gedruckten Schaltungsplatine. Insbesondere im Fall von Speichervorrichtungen kann die Funktionalität von mehreren Chips erforderlich sein, während nur für einen gehäusten Chip Platz auf einer Platine verfügbar ist. In solchen Fällen wird häufig die Verwendung eines „Multichipmoduls" (MCM) oder eines einzelnen Gehäuses, das mehrere Chips enthält, in Betracht gezogen. In einigen MCMs werden Chips Seite an Seite auf einem einzigen Substrat angeordnet. Abhängig von der Anwendung liefert dieser Lösungsansatz jedoch im Vergleich zum einfachen getrennten Häusen mehrerer Chips, einem weiter verbreiteten Zusammenbauprozeß, eventuell keine wesentlichen Platzeinsparungen. Folglich kann es wünschenswert sein, mehrere Chips in einem einzigen Gehäuse zu stapeln.
  • Es gibt mehrere Vorteile von gestapelten Chipgehäusen. Es kann mehr Funktionalität in einem bestimmten Bereich von Platinenplatz kann erreicht werden, da mehr Siliziumfunktionen pro Fläche an Platinenplatz (und pro Einheitsvolumen von Anwendungsplatz) möglich sind. Das Eliminieren einzelner Gehäuse für jeden Chip kann zu wesentlichen Größen- und Gewichtsreduzierungen der gedruckten Schaltungsplatinen und der elektronischen Geräte führen, in denen dieselben installiert sind. Das Aufnehmen von zwei oder mehr Chips in einem Gehäuse verringert die Anzahl von Komponenten, die auf einer Anwendungsplatine befestigt sind, wodurch potentiell die Gesamtsystemkosten reduziert werden. Außerdem kann das Bereitstellen eines einzigen Gehäuses für Gehäuseanordnung, elektrisches Testen und Handhaben die Herstellungskosten reduzieren.
  • In einigen Fällen ist es wünschenswert, mehrere identische Chips in ein einziges Gehäuse zu häusen, wie z. B. im Fall von bestimmten Speichervorrichtungen. Als ein Beispiel könnten vier identische 8-Megabyte (Mb-) Chips miteinander verbunden werden, um als eine einzige 32-Mb-Vorrichtung zu wirken. Außerdem könnte eine 16- oder 24-Mb-Vorrichtung auf dem gleichen Gehäusesubstrat oder der gleichen Gehäuseplatine zusammengebaut werden, durch Verbinden von zwei oder drei dieser Chips, ohne die Notwendigkeit des Entwerfens und Herstellens eines zusätzlichen Chipentwurfs.
  • Das Stapeln und elektrische Verbinden mehrerer elektrischer Chips hat sich als problematisch erwiesen, da jeder identische Chip die genau gleichen internen Strukturen, Schaltungsanordnungen und Strukturen von Bondanschlußflächen aufweist. Folglich ist es schwierig, mehrere identische Chips durch die Chips unter denselben zu einem Substrat oder zu einer Hauptplatine zu leiten, da ein aktives Merkmal auf einem Chip auf dem Chip unterhalb desselben einen Bereich erfordern würde, der keine aktive Schaltungsanordnung aufweist, um durch denselben zu verlaufen und eine Verbindung mit dem Substrat oder der Platine herzustellen. Es besteht ein Bedarf, eine Lösung zum Verbinden mehrerer identisch gestapelter Chips mit flachem Profil zu liefern.
  • Es ist die Aufgabe der vorliegenden Erfindung, ein Verfahren zum elektrischen Verbinden einer Mehrzahl identischer gestapelter integrierter Schaltungschips, einen integrierten Schaltungschip, ein integriertes Schaltungsgehäuse, eine Verbindungseinrichtung zum elektrischen Verbinden einer Mehrzahl von identischen gestapelten integrierten Schaltungschips und ein elektronisches System mit verbesserten Charakteristika zu schaffen.
  • Diese Aufgabe wird durch ein Verfahren gemäß Anspruch 1, einen Chip gemäß Anspruch 8 und 18, ein Gehäuse gemäß Anspruch 23, eine Einrichtung gemäß Anspruch 26 sowie ein System gemäß Anspruch 27 und 28 gelöst.
  • Es ist ein Verfahren und System zum Verbinden eines integrierten Schaltungschips offenbart, der eine Oberfläche aufweist, der eine integrierte Schaltung und eine Mehrzahl von Verbindungsanschlußflächensätzen umfaßt, wobei jeder Bondanschlußflächensatz im wesentlichen identische An schlußflächenlayouts auf der Chipoberfläche aufweist. Ein Chip, der gemäß der vorliegenden Erfindung entworfen ist, kann direkt mit einem anderen identischen Chip verbunden werden, durch Plazieren eines zweiten Chips auf einen ersten Chip. Der zweite Chip ist im wesentlichen identisch mit dem ersten Chip und weist eine Rotation bezüglich des ersten Chips auf. Eine Mehrzahl von elektrischen Verbindungen auf dem ersten Chip ist mit einer Mehrzahl von elektrischen Verbindungen auf dem zweiten Chip in Kontakt, wodurch elektrische Verbindungen zwischen benachbarten gestapelten Chips gebildet werden.
    •
  • Bevorzugte Ausführungsbeispiele der vorliegenden Erfindung werden nachfolgend Bezug nehmend auf beiliegende Zeichnungen näher erläutert. Es zeigen:
  • 1 ein Systemebenenschema einer elektronischen Vorrichtung;
  • 2A eine Querschnittsansicht eines ersten Ausführungsbeispiels der vorliegenden Erfindung mit einem Gehäuse, das vier identische gestapelte Chips enthält;
  • 2B eine Draufsicht eines Chipentwurfs gemäß einem darstellenden Ausführungsbeispiel;
  • 2C eine perspektivische Ansicht von vier gestapelten Chips gemäß einem darstellenden Ausführungsbeispiel;
  • 2D eine Querschnittsansicht von vier gestapelten Chips gemäß einem darstellenden Ausführungsbeispiel;
  • 3A eine Draufsicht eines alternativen Ausführungsbeispiels eines Chipentwurfs zum Stapeln von mehr als vier Chips;
  • 3B eine Querschnittsansicht eines alternativen Ausführungsbeispiels eines Chipentwurfs zum Stapeln von mehr als vier Chips; und
  • 4 eine Draufsicht eines Chipentwurfs mit einer alternativen Bondanschlußflächenkonfiguration.
  • In der folgenden Beschreibung und den Ansprüchen werden bestimmte Begriffe verwendet, um spezielle Systemkomponenten zu bezeichnen. Wie es für einen Fachmann auf diesem Gebiet offensichtlich ist, können Halbleiterfirmen Prozesse, Komponenten und Unterkomponenten mit unterschiedlichen Namen bezeichnen. Dieses Dokument möchte nicht zwischen Komponenten unterscheiden, die sich dem Namen aber nicht der Funktion nach unterscheiden. Bei der folgenden Erörterung und in den Ansprüchen werden die Begriffe „umfassen" und „enthalten" auf offene Weise verwendet, und sollten somit interpretiert werden, um „umfassen, aber nicht beschränkt auf ..." zu bedeuten.
  • Der Begriff „integrierte Schaltung" bezieht sich auf einen Satz von elektronischen Komponenten und deren Verbindungen (zusammen interne elektrische Schaltungselemente), die auf der Oberfläche eines Mikrochips strukturiert sind. Der Begriff „Halbleiterbauelement" bezieht sich allgemein auf eine integrierte Schaltung (IC), die in einen Halbleiterwafer integriert sein kann, von einem Wafer vereinzelt bzw. singuliert sein kann oder für die Verwendung auf einer Schaltungsplatine gehäust sein kann. Der Begriff „Chip" („Chips" für mehrere) bezieht sich allgemein auf einen Halbleitermikrochip in verschiedenen Stufen der Fertigstellung, unabhängig davon, ob derselbe integriert in einen Wafer oder vereinzelt von einem Halbleiterwafer ist, und der eine integrierte Schaltung umfaßt, die auf der Oberfläche desselben hergestellt ist. Der Begriff „Wafer" bezieht sich auf ein im allgemeinen rundes Einkristallhalbleiter substrat, auf dem integrierte Schaltungen in der Form von Chips hergestellt werden.
  • Der Begriff „Verbindung" bezieht sich auf eine physikalische Verbindung, die eine mögliche elektrische Kommunikation zwischen den verbundenen Elementen liefert. Der Begriff „Bond-Anschlußfläche" bezieht sich allgemein auf eine leitfähige Stelle, die zum Leiten von Signalen oder anderen elektrischen Verbindungen zu oder von einem Chip verwendet wird, und kann sich auf Stellen für die Verwendung mit einer Drahtverbindung, einer C4-Kugelbefestigung oder anderen Verbindungsmethoden beziehen. Es ist klar, wenn der Begriff „Seite" im Zusammenhang mit Bond-Anschlußflächen verwendet wird, eine „Seite" sich auf einen Peripheriebereich auf einer oberen oder unteren Oberfläche eines Chips am nächstliegendsten zu einer speziellen Chipkantenfläche bezieht. Der Begriff „Stift" bezieht sich auf den Abschlußpunkt auf einer Chipoberfläche einer elektrischen Verbindung (wie z. B. eine Signaladresse, Leistung, Masse oder keine Verbindung) und entspricht im allgemeinen einer spezifischen Bond-Anschlußfläche. Der Begriff „Kontaktstelle" bezieht sich auf eine leitfähige Verbindungsstelle auf einem Gehäusesubstrat oder einer gedruckten Schaltungsplatine. Wenn nicht jeder Begriff in dieser Beschreibung speziell definiert ist, ist die Absicht, daß dem Begriff seine einfache und übliche Bedeutung zugewiesen ist.
  • Die folgende Erörterung bezieht sich auf verschiedene Ausführungsbeispiele der Erfindung. Obwohl eines oder mehrere dieser Ausführungsbeispiele bevorzugt werden können, sollten die offenbarten Ausführungsbeispiele nicht als den Schutzbereich der Offenbarung, einschließlich den Ansprüchen, begrenzend interpretiert oder anderweitig verwendet werden. Außerdem versteht ein Fachmann auf diesem Gebiet, daß die folgende Beschreibung breite Anwendung findet, und die Erörterung jedes Ausführungsbeispiels nur beispielhaft für dieses Ausführungsbeispiel gemeint ist, und den Schutzbereich der Offenbarung, einschließlich der Ansprüche, nicht auf dieses Ausführungsbeispiel beschränken soll.
  • Gemäß der vorliegenden Erfindung sind ein Verfahren und System zum Verbinden mehrerer identischer gestapelter Halbleiterchips offenbart. Mit Bezugnahme auf 1 ist ein Systemebenenschema eines elektronischen Geräts 10 gezeigt, das Chips 60 umfaßt, die gemäß den bevorzugten Ausführungsbeispielen gestapelt sind. Ein elektronisches Gerät 10 umfaßt typischerweise ein oder mehrere gedruckte Schaltungsplatinen 20, mit denen eine Mehrzahl von Gehäusen 30 verbunden sind. Das elektronische Gerät 10 kann ein Computer, ein Mobiltelephon oder jedes typische elektronische Gerät sein, das eine gedruckte Schaltungsplatine 20 umfaßt. In einem Gehäuse 30 werden eine Mehrzahl identischer Chips 60 gestapelt und mit dem Gehäuse verbunden. Alternativ kann das Gehäuse 30 fehlen, und der unterste der gestapelten Chips 60 kann direkt mit der Platine 20 verbunden sein. Chips 60 verarbeiten typischerweise Eingangssignale und/oder liefern Informationen für den Betrieb des elektronischen Geräts 10.
  • Ein erstes Ausführungsbeispiel der vorliegenden Erfindung ist in 2A gezeigt, wobei vier identische gestapelte Chips 60 auf einem Substrat 34 gehäust sind und mit einem Kapselungsmaterial 32 bedeckt sind. Für die Zwecke dieser Offenbarung wird davon ausgegangen, daß die gestapelten Chips 60 identisch sind und durch die Position von unten nach oben mit den Bezugszeichen 61, 62, 63 bzw. 64 unterschieden werden. Bei dem gezeigten Ausführungsbeispiel sind die identischen Chips 61, 62, 63 und 64 alle 90° voneinander gedreht, um eine Achse 65 senkrecht zu den Chipoberflächen, die vertikal durch die geometrische Mitte der Chips verläuft.
  • Ein Chip umfaßt typischerweise integrierte Schaltungen mit Ausgangsanschlußflächen oder „Bond"-Anschlußflächen (nicht gezeigt) auf zumindest einer Oberfläche des Chips. Für einen Chip, der gemäß der vorliegenden Erfindung entworfen ist, haben sowohl die obere als auch die untere Fläche eines Chips übereinstimmende Strukturen von Bondanschlußflächen, wobei jedes Paar von passenden Bondanschlußflächen durch Verbindungen verbunden ist, die von der oberen Fläche zu der unteren Fläche verlaufen. Der Chip ist entworfen, um in verschiedenen Rotationspositionen bezüglich des Substrats 34 verwendbar zu sein. Bei der folgenden Beschreibung wird davon ausgegangen, daß die Anzahl von Rotationspositionen gleich vier ist.
  • Obwohl vier Chips 60 gezeigt sind, ist es klar, daß mehr oder weniger Chips auf diese Weise zusammengesetzt werden könnten, ohne von der Wesensart der Erfindung abzuweichen. Es ist auch klar, daß die Chips so beschrieben werden, daß dieselben mit Kontakthügeln bzw. Bumps versehene Verbindungen 40 zueinander aufweisen, aber jedes geeignete Verfahren für eine direkte Verbindung gemäß den darstellenden Ausführungsbeispielen aufweisen können. Es ist auch klar, daß die Chips mit einer gedruckten Schaltungsplatine oder einer anderen Häusungslösung als einem Substrat verbunden sein können.
  • Ein Chip, der gemäß verschiedenen Ausführungsbeispielen entworfen ist, kann Anschlußflächen entlang allen vier Seiten der Chipoberfläche aufweisen, wobei jede Seite einen unterschiedlichen Satz von Stiften aufweist, die den Bondanschlußflächen (siehe 2B) zugewiesen sind. Wenn derselbe im Zusammenhang der Ausrichtung verwendet wird, bezieht sich der Begriff „Seite" im allgemeinen auf einen Peripheriebereich eines Chips, entweder eine Endfläche oder ein Oberflächenbereich in der Nähe einer solchen Endfläche. In einer Konfiguration mit vier identischen gestapelten Chips hat jede der vier Seiten auf jedem Chip eine andere Anschlußflächenzuweisungsreihenfolge. Es ist jedoch klar, daß jeder Chip das gleiche Anschlußflächenlayout aufweist, so daß die Abstände zwischen den und die Positionen der Bondanschlußflächen an jeder Seite an allen vier Seiten identisch sind. Wenn die Chips gemäß bestimmten Ausführungsbeispielen zusammengebaut werden, wird nur eine Seite pro Chip zum Leiten aller Signale verwendet.
  • Jeder Chip ist für die elektrische Verbindung mit anderen identischen gestapelten Chips entworfen. Das Anschlußflächenlayout kann so gewählt werden, daß in jedem Satz bestimmte Anschlußflächen existieren, und andere Anschlußflächen wirksam sind, um jeden Satz zu unterscheiden. Unterschiedliche Anschlußflächen müssen keine „Auswahl"-Leitungen sein, sondern können alternativ „Adreß"-Leitungen mit vier unterschiedlichen Logikmasken sein. Elektrische Verbindungen zwischen zwei Chips sind gebildet, so daß ein Satz Anschlußflächen von jedem Chip in elektrischer Kommunikation mit den anderen Chips ist. Falls, als ein Beispiel, vier Chips miteinander verbunden werden sollen, und jeder Chip ein Megabyte (Mb) Speicher darstellt, können Anschlußflächenpositionen für Datensignale und Adreßsignale in jedem Satz sein. Im wesentlichen hat eine spezielle Adreßsignalanschlußfläche auf jeder Seite des Chips die gleiche Position auf jeder Seite des Chips, unabhängig davon, wie der Chip gedreht ist.
  • Die Ausführungsbeispiele der vorliegenden Erfindung erfordern nicht das Verbinden mehrerer einzelner Chips, sondern ermöglichen eine direkte Verbindung von mehr als einem der gleichen Chips, die von dem Chip gedreht sind, der mit denselben geschichtet ist. Die Drehung bzw. Rotation zwischen benachbarten Chips wird durch die Symmetrie bestimmt, und für eine Vierfachsymmetrie kann die Drehung ein Mehrfaches von 90° sein. Zusätzlich zu einer Vierfachrotationssymmetrie umfassen andere möglicherweise nützliche Symmetrien Zweifach-, Dreifach- und Sechsfachsymmetrien. Folglich können Drehungen ganzzahligen Mehrfachen als 90° entsprechen, einschließlich 45°, 60°, 120° und 180°.
  • Viele Halbleiterbauelemente sind „anschlußflächenbegrenzt", was bedeutet, daß der gesamte verfügbare Platz auf dem Umfang einer Chipoberfläche für Bondanschlußflächen verwendet wird. Auf Speichervorrichtungen könnten jedoch alle Bondanschlußflächen häufig an einer Seite des Umfangs plaziert sein, wodurch die anderen drei Seiten frei bleiben zum Wiederholen der Anschlußfläche in einer übereinstimmenden Struktur. Diese Konfiguration ermöglicht es, daß mehr als einer der gleichen Chips gestapelt werden können, wenn dieselben gemäß den beschriebenen Ausführungsbeispielen gedreht werden.
  • Chips, die gemäß dem Verbindungsverfahren verschiedener Ausführungsbeispiele entworfen sind, sind spezifisch entworfen, um leitfähige Durchgänge oder Durchgangslöcher (nicht gezeigt) aufzuweisen, die zwischen elektrischen Verbindungen auf der oberen und der unteren Oberfläche des Chips durch einen Chip verlaufen. Diese elektrischen Verbindungen können leitfähige „Bond"-Anschlußflächen sein, auf denen eine leitfähige Kugel oder ein „Bump" zum Verbinden der Oberfläche eines Chips mit der Oberfläche eines anderen Chips aufgebracht ist. Jede Bondanschlußfläche ist typischerweise einem bestimmten Signal oder einem anderen Stift (wie z. B. Leistung, Masse oder keine Verbindung) in dem Chip zugeordnet.
  • Ein darstellendes Ausführungsbeispiel ist in 2B gezeigt, in der eine Draufsicht eines Chips 60 gezeigt ist, mit Bondanschlußflächen 70, die in Sätzen 78 angeordnet sind, wobei jeder Satz 78 eine wirksame Beziehung mit der integrierten Schaltung des Chips aufweist, die für den speziellen Satz eindeutig ist. Jeder Satz 78 umfaßt eine oder mehrere Bondanschlußflächen 70, wobei jede Bondanschlußfläche eine wirksame Beziehung mit der integrierten Schaltung aufweist, die betriebsmäßig nicht von einer entsprechenden Bondanschlußfläche in einem anderen Bondanschlußflächensatz unterschieden werden kann. Jeder Satz 78 ist durch einen Adreßbereich, der für den Satz eindeutig ist, mit der integrierten Schaltung gekoppelt.
  • Jede Bondanschlußfläche 70 ist typischerweise einem Stift zugeordnet, wobei ein Abschnitt der Stifte als „B" für Leerstellen 72, „S" für Auswahlleitungen 74, und „Ax" (wobei Ax aufeinanderfolgende Adreßstifte von A1 bis An darstellt) für Adreßleitungen 76 gekennzeichnet ist. Die Adreßstifte auf jeder Chipseite werden gemeinsam als „Adreß-/Datenbus" bezeichnet, in dem die Adreß- und Datenstifte multiplext werden können. Leere Anschlußflächen 72 sind einfach Platzhalter in einer Anschlußflächenkonfiguration, die als nicht genutzte Plätze dienen, durch die Durchgangslöcher und andere Leitungen vertikal zu benachbarten Chips verlaufen können, und die eventuell keine elektrische Verbindung zu der internen Schaltungsanordnung in dem Chip benötigen. Auswahlleitungen 74 bestimmen, welcher der mehreren Chips derzeit adressiert wird und folglich, welcher der mehreren Chips die Steuerung des Adreß-/Datenbus hat. Zusammen werden die leeren Anschlußflächen 72 und die Auswahlleitungen 74 in einem Satz 78 als „Auswahlbondanschlußflächen" bezeichnet. Typischerweise ist nur ein Auswahlsignal zu einem Zeitpunkt aktiv. Auf jeder Chipseite wird die Zuweisung von Auswahlanschlußflächen und leeren Anschlußflächen variiert, um es zu ermöglichen, daß der gedrehte identische Chip gemäß der vorliegenden Erfindung verwendet wird.
  • Bei einer beispielhaften Implementierung würden Adreß/Datenleitungen A(N+1) und A( N+2) von dem Hostcomputer/Mikroprozessor (nicht gezeigt) decodiert, um einzelne Adreßleitungen zu liefern, die mit den Auswahlleitungen auf den Anschlußflächen 61 – 64 verbunden würden. Dies würde es den vier Chips ermöglichen, jeweils einen anderen Adreßraum abzudecken und nur zu dem geeigneten Zeitpunkt ausgewählt (aktiviert) zu werden. Beispielsweise kann es 16 Adreß/Datenleitungen A1 bis A16 geben. Das bedeutet, daß jeder Chip 64K adressierbare Bytes hätte. Zwei zusätzliche Adreßleitungen, beispielsweise A17 und A18 würden zu den Auswahlleitungen geleitet, so daß der Chip 61 für Zugriffe in dem Bereich 0 – 64 KB, der Chip 62 in dem Bereich 64 – 128 KB, der Chip 63 in dem Bereich 128K – 192 KB und der Chip 64 in dem Bereich 192 – 256 KB aktiviert wäre.
  • Bei diesem ersten Ausführungsbeispiel der vorliegenden Erfindung hat jeder der vier Chips 60 eine interne Schaltungsanordnung, die mit einer der Auswahlleitungen verbunden ist. Wenn die geeignete Auswahlleitung aktiviert ist, spricht der Chip auf die Adreßsignale an und kann Daten auf Datensignalleitungen (nicht gezeigt) liefern oder speichern. Adreßleitungen 76 antworten und senden Daten zurück. Es ist klar, daß zusätzlich zu den Stifttypen, die hierin dargestellt sind, Leistungs-, Masse- und andere Steuerleitungen auf dem Chip vorliegen können. Als ein Beispiel sind zwischen den geschichteten Adreßleitungen 76 von vier gestapelten Chips alle vier zugewiesenen Adreßpositionen zur gleichen Zeit verbunden und aktiv. Auswahlstifte variieren die Position auf jeder Seite eines Chips, so daß, wenn dieselben gemäß der vorliegenden Erfindung mit benachbarten gestapelten Chips ausgerichtet sind, die Stifte über oder unter der bestimmten Auswahlposition leere Stifte sind.
  • Adreßstifte haben auf jeder Seite eines Chips die gleiche Position, so daß A1 auf einem Chip mit A1 auf einem benachbarten Chip ausgerichtet ist, unabhängig von der Drehausrichtung des benachbarten Chips.
  • Das erste Ausführungsbeispiel der vorliegenden Erfindung ist in der perspektivischen Ansicht in 2C deutlicher dargestellt, wo vier identische Chips 60 gestapelt sind und elektrisch miteinander verbunden sind. Bei diesem Ausführungsbeispiel weist der Chip 60 eine spezielle Struktur und Beabstandung von Bondanschlußflächen 70 auf, die einem herkömmlichen „Bondring"-Entwurf folgen kann, wobei die Anschlußflächen auf der Chipoberfläche in der Nähe des Umfangs des Chips 60 angeordnet sind. Jede Seite (81, 82, 83 bzw. 84) des Chips 60 weist eine eindeutige Reihenfolge von Stiftzuweisungen auf, so daß, wenn jeder nachfolgende Chip um 90 Grad gedreht wird und auf dem vorhergehenden Chip gestapelt wird, physikalische Bondanschlußflächen in der gleichen Struktur wiederholt werden, aber die Stifte, die jeder Anschlußfläche zugewiesen sind, werden häufig variiert, abhängig von dem Stifttyp, um eine elektrische Verbindung durch alle gestapelten Chips zu ermöglichen. Erneut ist klar, obwohl vier Chips als ein Beispiel gezeigt sind, mehr oder weniger Chips gemäß den darstellenden Ausführungsbeispielen zusammengebaut sein können, ohne von der Wesensart der Erfindung abzuweichen.
  • Wie bei 2A sind die identischen gestapelten Chips 60, die in 2C gezeigt sind, zu Unterscheidungszwecken von unten nach oben als 61, 62, 63 und 64 bezeichnet. Jeder Chip 60 weist im allgemeinen vier Seiten 81, 82, 83 und 84 auf, und das Drehen eines Chips um 90 Grad präsentiert in einer Seitenansicht eine andere Seite. Wenn vier identische Chips 60 miteinander verbunden sind, sind vier eindeutige Endflächen vorzugsweise mit denjenigen über und unter derselben ausgerichtet. Falls mehr als vier Chips verbunden werden, kann eine Chipendfläche auf einer Fläche des Stapels wiederholt werden, wie es notwendig ist, um das erforderliche Leiten zu erreichen.
  • Bei einer Querschnittsansicht eines ersten Ausführungsbeispiels der Erfindung, wie es in 2D gezeigt ist, sind identische Chips 61, 62, 63 und 64 gestapelt, mit den Endflächen 81, 82, 83 bzw. 84 jeweils in einer Reihe. Wenn eine Chipauswahl 74 auf einem Chip 64 aktiviert werden soll, kann dieses Signal von einem Gerät (nicht gezeigt) auf dem Substrat 34 kommuniziert werden und durch die Leerstellen 72 auf den drei Chips 60 unter dem Chip 64 nach oben geleitet werden. Wenn eine Chipauswahl 74 auf dem Chip 63 aktiviert werden soll, kann dieses Signal von dem Substrat 34 kommuniziert werden und durch die Leerstellen 72 auf den beiden Chips 60 unter dem Chip 64 verlaufen. Wenn eine Chipauswahl 74 auf dem Chip 62 aktiviert werden soll, kann dieses Signal von einem Gerät (nicht gezeigt) auf dem Substrat 34 kommuniziert werden, und durch die Leerstellen 72 auf dem einzelnen Chip 60 unter dem Chip 64 verlaufen. Wenn eine Chipauswahl 74 auf dem Chip 61 aktiviert werden soll, kann das Signal direkt von dem Substrat 34 weitergeleitet werden. Wenn eine der Adressen 76 (von den Adressen A1 bis Adresse AN) aktiv ist, sind alle vier geschichteten Adreßpositionen zum gleichen Zeitpunkt aktiv, so daß, wenn A1 auf dem Chip 64 aktiv ist, A1 auch auf den Chips 61, 62 und 63 aktiv ist.
  • Im allgemeinen entspricht die Anzahl von gestapelten Chips der Anzahl von Seiten pro Chip, die für die Verbindung verwendet werden. Mehr als ein Bondanschlußflächenring kann jedoch auf jeder Seite eines Chips vorhanden sein, wodurch es ermöglicht wird, daß mehr als vier Chips gestapelt und verbunden werden. Wie es in einer Draufsicht in 3A gezeigt ist, weist ein alternatives Ausführungsbeispiel der vorliegenden Erfindung mehr als einen Satz 100 von Bondanschlußflächen 70 pro Chipseite auf, wobei es im allgemeinen einen Satz 90 von Bondanschlußflächen auf einer Chipoberfläche pro Chip 90 gibt, der gestapelt werden soll. Obwohl solche Sätze in 3A als linear angeordnete Ringe von Bondanschlußflächen 70 in der Nähe des Chipumfangs gezeigt wurden, ist es klar, daß die Bondanschlußflächen jeder anderen Struktur auf der Chipoberfläche entsprechen können, linear oder anders, solange diese Struktur wiederholt wird, während der Chip 90 in 90 Grad-Inkrementen gedreht wird.
  • 3B zeigt eine Seitenansicht einer möglichen Stiftanordnung für einen Chip mit mehr als vier Sätzen von Bondanschlußflächen pro Seite um das Stapeln von mehr als vier Chips zu ermöglichen. Sechs Chips 90 sind gezeigt, die durch die Position von unten nach oben mit den Bezugszeichen 91, 92, 93, 94, 95 bzw. 96 unterschieden werden. Um eine solche Konfiguration zu ermöglichen, wird ein anderer Satz 100 von Anschlußflächen 70 als Ziel genommen, durch Variieren der Verbindungsstruktur zwischen dem vierten und fünften Chip, wie sie von der Unterseite des Stapels her bezeichnet sind, für Chipkonfigurationen mit vier eindeutigen Anschlußflächensätzen. Beispielsweise ist in 3B ersichtlich, daß die Struktur von Verbindungen 40, die für die Chips 91 – 94 verwendet wird, nicht mehr für die Chips 95 und darüber benötigt wird, da alle vier Konfigurationen des äußeren Satzes 102 bei der Drehung verwendet wurden.
  • Es ist klar, daß in den Chips 95 und 96 der äußere Satz 102 nach wie vor existiert, aber aus Deutlichkeitsgründen in der Seitenansicht von 3B nicht gezeigt ist. Diese erste Struktur der Verbindungen 40 zwischen den Anschlußflächen der Sätze 102 kann an dem vierten Chip oder dem Chip 94 beendet werden und zwischen den Anschlußflächen des Satzes 104 kann eine neue Struktur verwendet werden, die den vierten Chip 94 und jeden nachfolgenden Chip (95 und 96) verbindet. Es ist klar, obwohl dies nicht gezeigt ist, daß der Satz 104 ausreichend leere Anschlußflächen 72 umfaßt, um das Leiten von Chips über dem vierten Chip (z. B. Chips 95 und 96) durch die ersten vier Chips (z. B. Chips 91 – 94) zu dem Substrat 34 zu ermöglichen. Jeder Chip ist entworfen und in dem Stapel gedreht, so daß nur ein Chip aktivierten Adreßleitungen Aufmerksamkeit schenkt.
  • Es ist auch klar, daß die Bondanschlußflächen keinem herkömmlichen „Ring"-Entwurf entsprechen müssen, der die Plazierung auf dem Umfang einer Chipoberfläche erfordert. Da mit Bumps versehene Chips häufig Verbindungen auf der Fläche einer Chipoberfläche aufweisen, kann jede leitbare Konfiguration von Bondanschlußflächen verwendet werden, ohne Beschränkung auf eine bestimmte geographische Position auf der Chipoberfläche, solange dieselben wiederholt werden, während der Chip in 90°-Inkrementen gedreht wird. Dies ist in 4 dargestellt, wo eine Draufsicht eines Chips 110 eine wiederholende Struktur von Bondanschlußflächen 120 aufweist, die nicht in einer typischen Umfangsringkonfiguration angeordnet sind, aber sich trotzdem wiederholen, wenn dieselben um 90°-Inkremente gedreht werden.
  • Chips sind durch ein bekanntes elektrisches Verbindungsverfahren aneinander befestigt, einschließlich C4-Kugelbefestigung, oder jedes andere geeignete Verfahren, das in der Technik bekannt ist. Im wesentlichen funktionieren alle verbundenen Chips als einer. Für Speichervorrichtungen kann diese Anordnung die kundenspezifische Einstellung von Speicherbedürfnissen ermöglichen, da jeder zusätzliche gestapelte Chip mehr Speicher beitragen kann, wodurch ein Grad an kundenspezifischer Einstellung in dem Platz ermöglicht wird, der für ein Gehäuse verwendet wird. Zusätzlich zu den bereits erwähnten Vorteilen muß für die Verwendung mit einem darstellenden Ausführungsbeispiel nur eine Vorrichtung entworfen, hergestellt, getestet und zusammengesetzt werden, was potentiell zu Zuführkettenvorteilen, einfacherer Fehlerbehebung und Ertragsverwaltung führen kann.

Claims (28)

  1. Verfahren zum elektrischen Verbinden einer Mehrzahl von identischen gestapelten integrierten Schaltungschips (60), das folgende Schritte umfaßt: Plazieren eines zweiten Chips (62) auf einem ersten Chip (61), wobei der zweite Chip (62) identisch zu dem ersten Chip (61) ist, wobei der zweite Chip (62) eine Drehung bezüglich des ersten Chips (61) aufweist; Kontaktieren einer Mehrzahl elektrischer Verbindungen (70) auf dem ersten Chip (61) mit einer Mehrzahl von elektrischen Verbindungen (70) auf dem zweiten Chip (62); und Bilden elektrischer Verbindungen (40) zwischen benachbarten gestapelten Chips (60).
  2. Verfahren gemäß Anspruch 1, bei dem die Mehrzahl von identischen Chips (60) drei oder mehr identische Chips (60) umfaßt.
  3. Verfahren gemäß Anspruch 1 oder 2, bei dem die elektrischen Verbindungen (40) C4-Bumps sind.
  4. Verfahren gemäß einem der Ansprüche 1 bis 3, bei dem die elektrischen Verbindungen (40) Lötmittelsäulen sind.
  5. Verfahren gemäß einem der Ansprüche 1 bis 4, bei dem die Chips direkt an einer gedruckten Schaltungsplatine befestigt sind.
  6. Verfahren gemäß einem der Ansprüche 1 bis 5, bei dem die Chips auf einem Halbleitergehäusesubstrat gehäust sind.
  7. Verfahren gemäß Anspruch 6, bei dem das Gehäuse (30) an einer gedruckten Schaltungsplatine (20) befestigt ist.
  8. Integrierter Schaltungschip (60), der folgende Merkmale umfaßt: eine Oberfläche mit einer integrierten Schaltung; und eine Mehrzahl von Bondanschlußflächensätzen (78), die jeweils im wesentlichen identische Anschlußflächenlayouts auf der Oberfläche aufweisen, wobei die im wesentlichen identischen Anschlußflächenlayouts durch Drehungen um eine Achse senkrecht zu der Oberfläche aufeinander bezogen sind, wobei jeder Bondanschlußflächensatz (78) ein oder mehrere entsprechende Auswahlbondanschlußflächen (74) umfaßt, die als eine Gruppe eine wirksame Beziehung zu der integrierten Schaltung haben, die für den Bondanschlußflächensatz (48) eindeutig ist.
  9. Chip gemäß Anspruch 8, bei dem die Bondanschlußflächensätze (78) durch leitfähige Wege mit passenden Bondanschlußflächensätzen (78) auf einer gegenüberliegenden Oberfläche des Chips (60) gekoppelt sind.
  10. Chip (60) gemäß Anspruch 8 oder 9, bei dem jeder Bondanschlußflächensatz (78) ferner ein oder mehrere Bondanschlußflächen (70) umfaßt, die jeweils eine wirksame Beziehung zu der integrierten Schaltung haben, die wirkungsmäßig nicht von einer entsprechenden Bondanschlußfläche (70) in jedem anderen Bondanschlußflächensatz (78) unterschieden werden kann.
  11. Chip (60) gemäß einem der Ansprüche 8 bis 10, bei dem jede der Auswahlbondanschlußflächen (74) in der Gruppe ein Auswahlsignal befördert, und wobei jeder der Bond anschlußflächensätze nur eine der Auswahlbondanschlußflächen (74) von dem Satz (78) mit der integrierten Schaltung koppelt.
  12. Chip (60) gemäß einem der Ansprüche 8 bis 11, bei denen die Drehungen ganzzahligen Mehrfachen von 45° entsprechen.
  13. Chip (60) gemäß einem der Ansprüche 8 bis 11, bei dem die Drehungen ganzzahligen Mehrfachen von 60° entsprechen.
  14. Chip (60) gemäß einem der Ansprüche 8 bis 11, bei dem die Drehungen ganzzahligen Mehrfachen von 90° entsprechen.
  15. Chip (60) gemäß einem der Ansprüche 8 bis 11, bei dem die Drehungen ganzzahligen Mehrfachen von 120° entsprechen.
  16. Chip (60) gemäß einem der Ansprüche 8 bis 11, bei dem die Drehungen ganzzahligen Mehrfachen von 180° entsprechen.
  17. Chip (60) gemäß einem der Ansprüche 8 bis 16, bei dem die Sätze (78) von einer oder mehreren entsprechenden Bondanschlußflächen (76) Adreßsignale befördern und wobei jeder der Sätze (78) durch einen eindeutigen Adreßbereich mit der integrierten Schaltung gekoppelt ist.
  18. Integrierter Schaltungschip, der folgende Merkmale umfaßt: eine integrierte Schaltung; und Bondanschlußflächen, die ein rotationssymmetrisches Layout aufweisen, wobei jede Bondanschlußfläche elek trisch mit einer entsprechenden ausgerichteten Bondanschlußfläche auf einer gegenüberliegenden Oberfläche des Chips verbunden ist.
  19. Chip gemäß Anspruch 18, bei dem die integrierte Schaltung für einen korrekten Betrieb in jeder Drehausrichtung von Bondanschlußflächen mit einem Satz von gelieferten Betriebssignalen entworfen ist.
  20. Chip gemäß Anspruch 19, bei dem der Betrieb der integrierten Schaltung auf eine drehungsabhängige Weise aktiviert ist.
  21. Chip gemäß einem der Ansprüche 18 bis 20, bei dem die Rotationssymmetrie zweifach oder vierfach ist.
  22. Chip gemäß einem der Ansprüche 18 bis 20, bei dem die Rotationssymmetrie dreifach, sechsfach oder achtfach ist.
  23. Integriertes Schaltungsgehäuse, das folgende Merkmale umfaßt: eine Mehrzahl identischer Chips (60), die gestapelt sind und elektrisch mit benachbarten Chips verbunden sind, wobei jeder Chip bezüglich benachbarter Chips gedreht ist; ein Kapselungsmaterial, das die Mehrzahl von identischen Chips umgibt; und ein Gehäusesubstrat (34), auf dem die gestapelten Chips verbunden sind.
  24. Integriertes Schaltungsgehäuse (34) gemäß Anspruch 23, bei dem die Mehrzahl identischer Chips (60) drei oder mehr identische Chips umfaßt.
  25. Integriertes Schaltungsgehäuse gemäß Anspruch 23 oder 24, bei dem die identischen Chips (60) entlang einer Rotationssymmetrieachse ausgerichtet sind.
  26. Verbindungsverfahren zum elektrischen Verbinden einer Mehrzahl von identischen gestapelten integrierten Schaltungschips, das folgende Schritte umfaßt: Plazieren eines zweiten Chips (62) auf einem ersten Chip (61), wobei der zweite Chip (62) identisch zu dem ersten Chip (61) ist, wobei der zweite Chip (62) eine Drehung bezüglich des ersten Chips (61) aufweist; Kontaktieren einer Mehrzahl elektrischer Verbindungen (70) auf dem ersten Chip (61) mit einer Mehrzahl von elektrischen Verbindungen (70) auf dem zweiten Chip (62); und Bilden elektrischer Verbindungen (40) zwischen benachbarten gestapelten Chips (60).
  27. Elektronisches System, das folgende Merkmale umfaßt: ein elektronisches Gerät, wobei das elektronische Gerät eine gedruckte Schaltungsplatine umfaßt; eine Mehrzahl von identischen Chips (60), die gestapelt und mit benachbarten Chips elektrisch verbunden sind, wobei jeder Chip bezüglich benachbarten Chips gedreht ist; ein Kapselungsmaterial, das die Mehrzahl identischer Chips umgibt; und ein Gehäusesubstrat (34), auf dem die gestapelten Chips verbunden sind, wobei das Gehäusesubstrat (34) mit der gedruckten Schaltungsplatine verbunden ist.
  28. Elektronisches System, das folgende Merkmale umfaßt: ein elektronisches Gerät, wobei das elektronische Gerät eine gedruckte Schaltungsplatine umfaßt; und eine Mehrzahl identischer Chips (60), die gestapelt und mit benachbarten Chips elektrisch verbunden sind, wobei jeder Chip bezüglich benachbarten Chips gedreht ist, und wobei die gestapelten Chips (60) mit der gedruckten Schaltungsplatine verbunden sind.
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