DE10110453A1 - Verfahren zum Montieren eines Halbleiterchips auf einem Substrat und auf einem Substrat montierbarer Halbleiterbaustein - Google Patents
Verfahren zum Montieren eines Halbleiterchips auf einem Substrat und auf einem Substrat montierbarer HalbleiterbausteinInfo
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Abstract
Durch die vorliegende Erfindung wird ein Verfahren zum Herstellen eines Halbleiterbausteins bereitgestellt, wobei das Verfahren die Schritte aufweist: Bereitstellen eines Halbleiterchips mit einer Pad-Montagefläche mit einem Bondpad, Ausbilden eines ersten Bumps auf dem Bondpad, Ausbilden einer Photoresistschicht auf der Pad-Montagefläche, Ausbilden eines zweiten Bumps, der über eine obere Fläche der Photoresistschicht vom ersten Bump hervorsteht, und Ausbilden eines leitfähigen Körpers auf dem zweiten Bump. Der leitfähige Körper weist einen Ankerabschnitt auf, der mit einem oberen Abschnitt des zweiten Bump elektrisch verbunden ist und ihn einkapselt, und einen Kontaktabschnitt, der vom Ankerabschnitt versetzt angeordnet und dazu geeignet ist, mit einem Substrat verbunden zu werden (Fig. 6).
Description
Die vorliegende Erfindung betrifft ein Verfahren zum
Montieren eines Halbleiterchips auf einem Substrat und einen
auf einem Substrat montierbaren Halbleiterbaustein.
Im Zuge der raschen Fortschritte und Weiterentwicklun
gen in der Halbleiterfertigungstechnologie werden die An
schluß- bzw. Kontaktflecken oder Bondpads auf der Oberfläche
eines Halbleiterchips sowie die Abstände zwischen benachbar
ten Bondpads immer kleiner. Dadurch können Probleme auftre
ten, wenn der Halbleiterchip mit einer externen Schaltung
verbunden wird, und die Produktion kann beeinträchtigt wer
den.
In der mitanhängigen US-Patentanmeldung Nr. 09/725432
beschreibt der Anmelder ein Verfahren zum Montieren eines
Halbleiterchips auf einem Substrat, um einen Halbleiterbau
stein herzustellen. Das Substrat weist einen Chip-Montage
bereich mit mehreren Lotstellen auf. Der Halbleiterchip
weist eine Pad-Montagefläche mit mehreren Bondpads (An
schlußfelder bzw. Verbindungsfläche bzw. Kontaktfleck) auf,
die dazu vorgesehen sind, mit entsprechenden der Lotstellen
verbunden zu werden und auf der Pad-Montagefläche an Posi
tionen angeordnet sind, die von den Positionen der entspre
chenden Lotstellen des Chip-Montagebereichs versetzt sind.
Das Verfahren weist die Schritte auf: Ausbilden mehrerer
leitfähiger Bumps (Erhebung bzw. Kontakthöcker), die jeweils
mit einem entsprechenden Bondpad elektrisch verbunden und so
ausgebildet sind, daß sie von den entsprechenden Bondpads
hervorstehen; Ausbilden einer Photoresistschicht auf der
Pad-Montagefläche und Ausbilden mehrerer Zugangslöcher in
der Photoresistschicht, wobei jedes der Zugangslöcher mit
mindestens einem Abschnitt eines entsprechenden Bumps ausge
richtet ist und ihn freilegt; und Ausbilden mehrerer leitfä
higer Körper, die jeweils einen Ankerabschnitt aufweisen,
der eines der Zugangslöcher füllt und mit dem freigelegten
Abschnitt des entsprechenden Bumps verbunden ist und ihn
einkapselt, einen Ansatzabschnitt, der sich vom Ankerab
schnitt aus erstreckt und auf der Oberfläche der Photore
sistschicht ausgebildet ist, und einen Kontaktabschnitt, der
von einem Ende des Ansatzabschnitts hervorsteht und auf der
Oberfläche der Photoresistschicht gegenüberliegend dem An
kerabschnitt ausgebildet ist. Der Kontaktabschnitt ist an
einer Position angeordnet, die einer zugeordneten Lotstelle
auf dem Chip-Montagebereich des Substrats entspricht.
Es ist eine Aufgabe der vorliegenden Erfindung, ein
Verfahren des in der vorstehend erwähnten mitanhängigen US-
Patentanmeldung Nr. 09/725431 beschriebenen Typs zum Montie
ren eines Halbleiterchips auf einem Substrat bereitzustel
len, durch das ein Halbleiterchip so auf einem Substrat an
geordnet wird, daß der vorstehend erwähnte Nachteil elimi
niert wird.
Es ist eine andere Aufgabe der vorliegenden Erfindung,
einen Halbleiterbaustein des in der vorstehend erwähnten
mitanhängigen US-Patentanmeldung Nr. 09/725431 beschriebenen
Typs bereitzustellen, durch den der vorstehend erwähnte
Nachteil eliminiert werden kann.
Diese Aufgaben werden durch die Merkmale der Patentan
sprüche gelöst.
Gemäß einem Aspekt der vorliegenden Erfindung wird ein
Verfahren zum Montieren eines Halbleiterchips auf einem Sub
strat bereitgestellt, das einen Chip-Montagebereich mit meh
reren Lotstellen aufweist. Der Halbleiterchip weist eine
Pad-Montagefläche mit mehreren Bondpads auf, die dazu vorge
sehen sind, mit entsprechenden der Lotstellen verbunden zu
werden. Das Verfahren weist die Schritte auf: Ausbilden meh
rerer leitfähiger erster Bumps, die jeweils mit einem ent
sprechenden Bondpad elektrisch verbunden und so ausgebildet
sind, daß sie von den entsprechenden Bondpads hervorstehen;
Ausbilden einer Photoresistschicht auf der Pad-Montage
fläche, wobei die ersten Bumps in die Photoresistschicht
eingebettet sind; Ausbilden von Zugangslöchern in der Photo
resistschicht, wobei jedes der Zugangslöcher mit mindestens
einem Abschnitt eines entsprechenden ersten Bumps ausgerich
tet ist und diesen Abschnitt freilegt; und Ausbilden mehre
rer leitfähiger zweiter Bumps, die jeweils einen unteren Ab
schnitt aufweisen, der ein entsprechendes der Zugangslöcher
füllt, um eine elektrische Verbindung mit dem Abschnitt des
entsprechenden ersten Bumps herzustellen und ihn einzukap
seln, und einen oberen Abschnitt, der sich vom unteren Ab
schnitt aus erstreckt und von einer oberen Fläche der Photo
resistschicht gegenüberliegend der Pad-Montagefläche hervor
steht, um eine elektrische Verbindung mit einer entsprechen
den Lotstelle auf dem Substrat zu ermöglichen.
Gemäß einem anderen Aspekt der vorliegenden Erfindung
wird ein Halbleiterbaustein bereitgestellt, der dazu geeig
net ist, auf einem Substrat montiert zu werden, das einen
Chip-Montagebereich mit mehreren Lotstellen aufweist. Der
Halbleiterbaustein weist auf: einen Halbleiterchip mit einer
Pad-Montagefläche, die mehrere auf der Pad-Montagefläche an
geordnete Bondpads aufweist; mehrere leitfähige erste Bumps,
die mit entsprechenden Bondpads elektrisch verbunden sind
und von den Bondpads hervorstehen; eine auf der Pad-Montage
fläche des Halbleiterchips ausgebildete Photoresistschicht,
wobei die Photoresistschicht mehrere Zugangslöcher aufweist,
die jeweils mit mindestens einem Abschnitt eines entspre
chenden ersten Bumps auf den Bondpads ausgerichtet sind und
diesen freilegen; und mehrere leitfähige zweite Bumps, die
jeweils einen unteren Abschnitt aufweisen, der ein entspre
chendes der Zugangslöcher füllt, um eine elektrische Verbin
dung mit dem Abschnitt eines entsprechenden der ersten Bumps
herzustellen und ihn einzukapseln, und einen oberen Ab
schnitt, der sich vom unteren Abschnitt aus erstreckt und
von einer oberen Fläche der Photoresistschicht gegenüberlie
gend der Pad-Montagefläche hervorsteht.
Gemäß einem noch anderen Aspekt der vorliegenden Erfin
dung wird ein Verfahren zum Montieren eines Halbleiterchips
auf einem Substrat bereitgestellt, das einen Chip-Montage
bereich mit mehreren Lotstellen aufweist. Der Halbleiterchip
weist eine Pad-Montagefläche mit mehreren Bondpads auf, die
dazu vorgesehen sind, mit entsprechenden der Lotstellen ver
bunden zu werden. Das Verfahren weist die Schritte auf: Aus
bilden einer Photoresistschicht auf der Pad-Montagefläche;
Ausbilden von Zugangslöchern in der Photoresistschicht, die
jeweils mit mindestens einem Abschnitt eines entsprechenden
Bondpads ausgerichtet sind und ihn freilegen und die jeweils
durch eine Umfangswand begrenzt sind; Ausbilden mehrerer
leitfähiger Überzugsschichten, die jeweils einen rohrförmi
gen unteren Abschnitt aufweisen, der die Umfangswand eines
entsprechenden Zugangslachs bedeckt und mit einem entspre
chenden Bondpad elektrisch verbunden ist, und einen oberen
Abschnitt, der auf einer oberen Fläche der Photore
sistschicht um das entsprechende Zugangsloch herum ausgebil
det ist; und Ausbilden mehrerer leitfähiger Körper, die je
weils einen Ansatzabschnitt aufweisen sowie einen Ankerab
schnitt und einen Kontaktabschnitt an gegenüberliegenden En
den des Ansatzabschnitts, wobei der Ankerabschnitt einen In
nenraum des unteren Abschnitts einer entsprechenden der
Überzugsschichten füllt und mit dem oberen Abschnitt der
entsprechenden Überzugsschicht elektrisch verbunden ist und
ihn einkapselt, wobei der Kontaktabschnitt auf der oberen
Fläche der Photoresistschicht ausgebildet ist und an einer
Position angeordnet ist, die einer zugeordneten Lotstelle
auf dem Chip-Montagebereich des Substrats entspricht, wobei
der Ansatzabschnitt auf der oberen Fläche der Photore
sistschicht ausgebildet ist und die Anker- und Kontaktab
schnitte miteinander verbindet.
Gemäß einem weiteren Aspekt der vorliegenden Erfindung
wird ein Halbleiterbaustein bereitgestellt, der auf einem
Substrat montierbar ist, das einen Chip-Montagebereich mit
mehreren Lotstellen aufweist. Der Halbleiterbaustein weist
auf: einen Halbleiterchip mit einer Pad-Montagefläche, die
mehrere Bondpads aufweist; eine auf der Pad-Montagefläche
des Halbleiterchips ausgebildete Photoresistschicht, wobei
die Photoresistschicht mehrere Zugangslöcher aufweist, die
mit mindestens einem Abschnitt eines entsprechenden der
Bondpads ausgerichtet sind und ihn freilegen, wobei jedes
der Zugangslöcher durch eine Umfangswand begrenzt ist; meh
rere Überzugsschichten, die jeweils einen rohrförmigen unte
ren Abschnitt aufweisen, der die Umfangswand eines entspre
chenden Zugangslochs bedeckt und mit einem entsprechenden
der Bondpads elektrisch verbunden ist, und einen oberen Ab
schnitt, der auf einer oberen Fläche der Photoresistschicht
um das entsprechende Zugangsloch herum ausgebildet ist; und
mehrere leitfähige Körper, die jeweils einen Ansatzabschnitt
aufweisen sowie einen Ankerabschnitt und einen Kontaktab
schnitt an gegenüberliegenden Enden des Ansatzabschnitts,
wobei der Ankerabschnitt einen Innenraum des unteren Ab
schnitts einer entsprechenden Überzugsschicht füllt und den
oberen Abschnitt der entsprechenden Überzugsschicht einkap
selt, so daß er mit dem entsprechenden Bondpad elektrisch
verbunden ist, wobei der Kontaktabschnitt auf der oberen
Fläche der Photoresistschicht ausgebildet und an einer Posi
tion angeordnet ist, die einer zugeordneten Lotstelle auf
dem Chip-Montagebereich des Substrats entspricht, wobei der
Ansatzabschnitt auf der oberen Fläche der Photoresistschicht
ausgebildet ist und die Anker- und Kontaktabschnitte mitein
ander verbindet.
Die Zeichnungen stellen Ausführungsformen der Erfindung
dar; es zeigen:
Fig. 1 eine schematische Ansicht zum Darstellen eines
leitfähigen ersten Bumps, der auf einem Halbleiterchip aus
gebildet ist, der dazu geeignet ist, gemäß einem erfindungs
gemäßen Verfahren auf einem Substrat montiert zu werden;
Fig. 2 eine schematische Ansicht zum Darstellen einer
Photoresistschicht, die gemäß dem erfindungsgemäßen Verfah
ren auf einer Pad-Montagefläche des Halbleiterchips von Fig.
1 ausgebildet wird;
Fig. 3 eine schematische Ansicht zum Darstellen einer
Maske, die gemäß dem erfindungsgemäßen Verfahren in einem
Photolithografieprozeß für die Photoresistschicht von Fig. 2
verwendet wird;
Fig. 4 eine schematische Ansicht zum Darstellen eines
Zugangslochs, das gemäß dem erfindungsgemäßen Verfahren in
der Photoresistschicht von Fig. 3 ausgebildet wird;
Fig. 5 und 6 schematische Ansichten zum Darstellen
der Ausbildung eines zweiten Bumps auf der Oberseite des er
sten Bumps im Zugangsloch von Fig. 4 gemäß dem erfindungsge
mäßen Verfahren;
Fig. 7 eine schematische Ansicht zum Darstellen einer
Verbindung des zweiten Bumps von Fig. 6 mit dem Substrat;
Fig. 8 und 9 schematische Ansichten zum Darstellen,
wie gemäß dem erfindungsgemäßen Verfahren ein modifiziertes
Zugangsloch in der Photoresistschicht von Fig. 4 ausgebildet
wird;
Fig. 10 und 11 schematische Ansichten zum Darstellen
der Ausbildung eines modifizierten zweiten Bumps von Fig. 6
im modifizierten Zugangsloch von Fig. 9;
Fig. 12 bis 14 schematische Ansichten zum Darstellen
der Ausbildung eines Zugangslochs in einer Photore
sistschicht auf einer Pad-Montagefläche eines Halbleiter
chips und der Ausbildung einer Überzugsschicht im Zugangs
loch gemäß einer anderen Ausführungsform der vorliegenden
Erfindung;
Fig. 15 eine schematische Ansicht zum Darstellen der
Ausbildung eines leitfähigen Körpers auf der Photore
sistschicht von Fig. 6;
Fig. 16 eine schematische Ansicht zum Darstellen der
Ausbildung eines leitfähigen Körpers auf der Photore
sistschicht von Fig. 11;
Fig. 17 eine schematische Ansicht zum Darstellen der
Ausbildung eines leitfähigen Körpers auf der Photore
sistschicht von Fig. 14;
Fig. 18 eine schematische Ansicht zum Darstellen der
Ausbildung eines modifizierten leitfähigen Körpers auf der
Photoresistschicht von Fig. 15;
Fig. 19 eine schematische Ansicht zum Darstellen der
Ausbildung eines modifizierten leitfähigen Körpers auf der
Photoresistschicht von Fig. 16; und
Fig. 20 eine schematische Ansicht zum Darstellen der
Ausbildung eines modifizierten leitfähigen Körpers auf der
Photoresistschicht von Fig. 17.
Fig. 1 zeigt einen gemäß dem erfindungsgemäßen Verfah
ren auf einem Substrat 6 (vergl. Fig. 7), z. B. auf einer ge
druckten Schaltung oder einem anderen Halbleiterbaustein, zu
montierenden Halbleiterchip 1. Das Substrat 6 weist einen
Chip-Montagebereich mit mehreren Lotstellen 61 auf (von de
nen nur eine Lotstelle 61 dargestellt ist). Der Halbleiter
chip 1 weist eine Pad-Montagefläche 10 mit mehreren Bondpads
11 auf (es ist nur ein Bondpad 11 dargestellt), die dazu
vorgesehen sind, mit entsprechenden der Lotstellen 61 ver
bunden zu werden und auf der Pad-Montagefläche 10 an Posi
tionen angeordnet sind, die mit den Positionen der entspre
chenden Lotstellen 61 auf dem Chip-Montagebereich des Sub
strats 6 ausgerichtet oder bezüglich diesen versetzt sein
können.
Die Fig. 1 bis 6 zeigen aufeinanderfolgende Schritte
zum Verarbeiten des Halbleiterchips 1 zum Herstellen eines
Halbleiterbausteins, der dazu vorgesehen ist, auf dem Sub
strat 6 montiert zu werden, gemäß dem erfindungsgemäßen Ver
fahren.
In Fig. 1 werden mehrere leitfähige erste Bumps 2 (es
ist nur ein erster Bump 2 dargestellt) gemäß einem bekannten
Verfahren jeweils auf den Bondpads 11 auf der Pad-
Montagefläche 10 des Halbleiterchips 1 so ausgebildet, daß
sie von den Bondpads hervorstehen.
In Fig. 2 wird eine in Licht aushärtende Schicht, z. B.
eine Photoresistschicht 3, auf der Pad-Montagefläche 10 so
ausgebildet, daß die ersten Bumps 2 in der Photoresist
schicht 3 eingebettet sind.
In Fig. 3 wird eine Maske 4 auf der Photoresistschicht
3 angeordnet, und die Photoresistschicht 3 wird an Positio
nen belichtet, die von den ersten Bumps 2 und den Bondpads
11 versetzt sind. Die belichteten Abschnitte der Photore
sistschicht 3 härten aus und bilden eine die Pad-
Montagefläche 10 bedeckende Isolierschicht.
In Fig. 4 werden mehrere Zugangslöcher 30 (es ist nur
eine dargestellt) in der Photoresistschicht 3 ausgebildet,
indem unbelichtete Abschnitte der Photoresistschicht 3 durch
Lösungswaschen von der Isolierschicht entfernt werden. Jedes
der Zugangslöcher 30 legt einen Abschnitt eines entsprechen
den ersten Bumps 2 frei. In dieser Ausführungsform erstreckt
sich jedes Zugangsloch 30 von der oberen Fläche der Photore
sistschicht 3 bis zu einer Ebene bzw. einem Niveau, das sich
über der Pad-Montagefläche 10 und unter einem oberen Ab
schnitt des entsprechenden ersten Bumps 2 befindet. Die Tie
fe jedes Zugangslochs 30 kann durch Steuern der Waschzeit
während des Lösungswaschens manipuliert werden.
Die Fig. 5 und 6 zeigen die Schritte zum Ausbilden
eines leitfähigen zweiten Bumps 5 auf der Oberseite des er
sten Bumps 2 in jedem Zugangsloch von Fig. 4. In Fig. 5 wird
eine Masse einer leitfähigen Metallpaste 5' in jedes der Zu
gangslöcher 30 eingefüllt, wobei ein oberer Abschnitt der
Masse der Metallpaste 5' von einer oberen Fläche der Photo
resistschicht 3 hervorsteht. Die Masse der Metallpaste 5'
wird durch Infrarotstrahlen erwärmt, so daß sie im wesentli
chen schmilzt, und anschließend gekühlt, um den zweiten Bump
5 auszubilden, der einen unteren Abschnitt aufweist, der das
entsprechende Zugangsloch 30 füllt und den freigelegten Ab
schnitt des entsprechenden ersten Bumps 2 einkapselt, und
einen oberen Abschnitt, der von der oberen Fläche der Photo
resistschicht 3 hervorsteht. Der übrige Teil jedes ersten
Bumps 2 ist in der Photoresistschicht 3 eingebettet.
Wie in Fig. 7 dargestellt, kann durch Ausbilden der
zweiten Bumps 5 die Herstellung einer Verbindung der Bond
pads 11 mit den entsprechenden Lotstellen 61 auf dem Sub
strat 6 erleichtert werden, und die im herkömmlichen Verfah
ren auftretenden Schwierigkeiten können eliminiert werden.
Fig. 15 entspricht Fig. 7, jeder der Bondpads 11 ist
jedoch nicht mit einer entsprechenden Lotstelle 61 ausge
richtet, sondern stattdessen an einer Position angeordnet,
die von der Position der entsprechenden Lotstelle (nicht
dargestellt) versetzt ist. Daher weist der Halbleiterbau
stein ferner mehrere leitfähige Körper 8 (es ist nur einer
dargestellt) auf, die hergestellt werden, nachdem die zwei
ten Bumps 5 ausgebildet wurden. Jeder der leitfähigen Körper
8 weist einen Ansatzabschnitt 801 sowie einen Ankerabschnitt
800 und einen Kontaktabschnitt 802 an gegenüberliegenden En
den des Ansatzabschnitts 801 auf. Der Ankerabschnitt 800 ist
mit dem oberen Abschnitt eines entsprechenden zweiten Bumps
5 elektrisch verbunden und kapselt ihn ein. Der Kontaktab
schnitt 802 ist auf der oberen Fläche der Photoresistschicht
3 ausgebildet und an einer Position angeordnet, die der zu
geordneten Lotstelle auf dem Chip-Montagebereich des Sub
strats entspricht. Der Ansatzabschnitt 801 ist auf der obe
ren Fläche der Photoresistschicht 3 ausgebildet und verbin
det die Anker- und Kontaktabschnitte 800, 802 miteinander.
Anschließend wird, nachdem die leitfähigen Körper 8 ausge
bildet wurden, ein dritter Bump 9 durch bekannte Löttechni
ken auf dem Kontaktabschnitt 802 jedes leitfähigen Körpers 8
bezüglich des entsprechenden Ansatzabschnitts 801 in Quer
richtung so ausgebildet, daß er vom Kontaktabschnitt hervor
steht und mit der entsprechenden Lotstelle auf dem Chip-
Montagebereich des Substrats ausgerichtet ist.
Alternativ kann, wie in Fig. 18 dargestellt, der dritte
Bump 9 mit dem Anker- und dem Ansatzabschnitt 800, 801 ein
stückig ausgebildet sein.
Die Fig. 8 bis 11 entsprechen den Fig. 3 bis 6
und zeigen aufeinanderfolgende Schritte zum Ausbilden mehre
rer modifizierter Zugangslöcher 30 (es ist nur eines darge
stellt) in der Photoresistschicht 3 von Fig. 4 und zum Aus
bilden mehrerer modifizierter zweiter Bumps 5 (es ist nur
einer dargestellt) in den modifizierten Zugangslöchern 30
gemäß dem erfindungsgemäßen Verfahren. Jedes der modifizier
ten Zugangslöcher 30 hat eine derartige Tiefe von der oberen
Fläche der Photoresistschicht 3 zur Pad-Montagefläche 10 des
Hallbleiterchips 1, daß jeder modifizierte zweite Bump 5 die
gesamte obere Fläche des entsprechenden ersten Bumps 2 be
deckt.
Fig. 16 entspricht Fig. 15 und zeigt die Ausbildung der
leitfähigen Körper 8 auf der Photoresistschicht 3, nachdem
die zweiten Bumps 5 von Fig. 11 ausgebildet wurden, wobei
die dritten Bumps 9 durch bekannte Löttechniken auf den
leitfähigen Körpern 8 ausgebildet werden, nachdem die leit
fähigen Körper ausgebildet wurden.
Fig. 19 entspricht Fig. 18 und zeigt ein alternatives
Verfahren zum Ausbilden des dritten Bumps 9, der mit dem An
ker- und dem Ansatzabschnitt 800, 801 des leitfähigen Kör
pers 8 von Fig. 16 einstückig ausgebildet wird.
Die Fig. 12 bis 14 zeigen aufeinanderfolgende
Schritte eines modifizierten erfindungsgemäßen Verfahrens
zum Verarbeiten des Halbleiterchips 1, um basierend auf dem
vorangehend beschriebenen erfindungsgemäßen Verfahren einen
modifizierten Halbleiterbaustein herzustellen. Die Ausbil
dung jedes Zugangslochs 30 erfolgt in diesem Verfahren ähn
lich wie im vorangehenden Verfahren. An Stelle der Ausbil
dung der ersten und zweiten Bumps 2, 5 wird jedoch durch be
kannte Metallisierungs- oder Galvanisierungstechniken eine
Überzugsschicht 7 in den entsprechenden Zugangslöchern 30
ausgebildet. Jede Überzugsschicht 7 weist einen rohrförmigen
unteren Abschnitt 71 auf, der eine Umfangswand eines ent
sprechenden Zugangslochs 30 bedeckt und mit einem entspre
chenden Bondpad 11 elektrisch verbunden ist, und einen obe
ren Abschnitt 72, der sich vom unteren Abschnitt 71 aus er
streckt und auf der oberen Fläche der Photoresistschicht 3
um das entsprechende Zugangsloch 30 herum angeordnet ist.
Fig. 17 entspricht Fig. 15 oder Fig. 16 und zeigt die
Ausbildung der leitfähigen Körper 8 auf der Photore
sistschicht 3 von Fig. 14, nachdem die Überzugsschichten 7
ausgebildet wurden, wobei die dritten Bumps 9 durch bekannte
Löttechniken auf den leitfähigen Körpern 8 ausgebildet wer
den, nachdem die leitfähigen Körper 8 ausgebildet wurden.
Der Ankerabschnitt 800 jedes leitfähigen Körpers 8 füllt ei
nen Innenraum des unteren Abschnitts 71 der entsprechenden
Überzugsschicht 7 und kapselt den oberen Abschnitt 72 der
entsprechenden Überzugsschicht 7 ein, um einen elektrischen
Kontakt mit dem entsprechenden Bondpad 11 herzustellen.
Fig. 20 entspricht Fig. 18 oder Fig. 19 und zeigt ein
alternatives Verfahren zum Ausbilden des dritten Bump 9, der
mit den Anker- und Ansatzabschnitten 800, 801 des leitfähi
gen Körpers 8 von Fig. 17 einstückig ausgebildet ist.
Die ersten Bumps 2 werden vorzugsweise aus Zinn-
Lotmittel hergestellt, während die zweiten Bumps 5 und die
leitfähigen Körper 8 aus leitfähiger Paste hergestellt wer
den, die ein aus Gold, Silber, Kupfer, Eisen, Zinn und Alu
minium ausgewähltes Metall enthält.
Durch die zweiten Bumps 5 oder die Überzugsschichten 7
können die leitfähigen Körper 8 mit den Bondpads 11 fest und
stabil in Kontakt gehalten werden, ohne daß sie während
nachfolgender Verarbeitungsschritte, z. B. während eines Wär
metests, abgezogen oder abgelöst werden.
Claims (23)
1. Verfahren zum Montieren eines Halbleiterchips auf einem
Substrat, wobei das Substrat einen Chip-Montagebereich
mit mehreren Lotstellen aufweist und der Halbleiterchip
eine Pad-Montagefläche mit mehreren Bondpads aufweist,
die dazu vorgesehen sind, mit entsprechenden der Lot
stellen verbunden zu werden, wobei das Verfahren die
Schritte aufweist:
Ausbilden mehrerer leitfähiger erster Bumps, die jeweils mit einem entsprechenden Bondpad elektrisch verbunden und so ausgebildet sind, daß sie von den ent sprechenden Bondpads hervorstehen;
Ausbilden einer Photoresistschicht auf der Pad- Montagefläche, wobei die ersten Bumps in der Photore sistschicht eingebettet sind;
Ausbilden von Zugangslöchern in der Photore sistschicht, wobei jedes der Zugangslöcher mit minde stens einem Abschnitt eines entsprechenden ersten Bumps ausgerichtet ist und diesen Abschnitt freilegt; und
Ausbilden mehrerer leitfähiger zweiter Bumps, die jeweils einen unteren Abschnitt aufweisen, der ein ent sprechendes der Zugangslöcher füllt, um eine elektri sche Verbindung mit dem Abschnitt des entsprechenden ersten Bumps herzustellen und ihn einzukapseln, und ei nen oberen Abschnitt, der sich vom unteren Abschnitt aus erstreckt und von einer oberen Fläche der Photore sistschicht gegenüberliegend der Pad-Montagefläche her vorsteht, um eine elektrische Verbindung mit einer ent sprechenden Lotstelle auf dem Substrat zu ermöglichen.
Ausbilden mehrerer leitfähiger erster Bumps, die jeweils mit einem entsprechenden Bondpad elektrisch verbunden und so ausgebildet sind, daß sie von den ent sprechenden Bondpads hervorstehen;
Ausbilden einer Photoresistschicht auf der Pad- Montagefläche, wobei die ersten Bumps in der Photore sistschicht eingebettet sind;
Ausbilden von Zugangslöchern in der Photore sistschicht, wobei jedes der Zugangslöcher mit minde stens einem Abschnitt eines entsprechenden ersten Bumps ausgerichtet ist und diesen Abschnitt freilegt; und
Ausbilden mehrerer leitfähiger zweiter Bumps, die jeweils einen unteren Abschnitt aufweisen, der ein ent sprechendes der Zugangslöcher füllt, um eine elektri sche Verbindung mit dem Abschnitt des entsprechenden ersten Bumps herzustellen und ihn einzukapseln, und ei nen oberen Abschnitt, der sich vom unteren Abschnitt aus erstreckt und von einer oberen Fläche der Photore sistschicht gegenüberliegend der Pad-Montagefläche her vorsteht, um eine elektrische Verbindung mit einer ent sprechenden Lotstelle auf dem Substrat zu ermöglichen.
2. Verfahren nach Anspruch 1, wobei der Schritt zum Aus
bilden der zweiten Bumps das Einfüllen einer Masse ei
ner leitfähigen Metallpaste in jedes der Zugangslöcher
aufweist, wobei ein oberer Abschnitt der Masse der Me
tallpaste von der oberen Fläche der Photoresistschicht
hervorsteht, Erwärmen des oberen Abschnitts der Masse
der Metallpaste durch Infrarotstrahlen, um die Masse
der Metallpaste im wesentlichen zu schmelzen, und an
schließende Abkühlen der geschmolzenen Masse der Me
tallpaste aufweist, um den zweiten Bump herzustellen.
3. Verfahren nach Anspruch 1 oder 2, ferner mit dem
Schritt zum Ausbilden mehrerer leitfähiger Körper, die
jeweils einen Ansatzabschnitt aufweisen sowie einen An
kerabschnitt und einen Kontaktabschnitt an gegenüber
liegenden Enden des Ansatzabschnitts, wobei der An
kerabschnitt mit dem oberen Abschnitt eines entspre
chenden zweiten Bumps elektrisch verbunden ist und ihn
einkapselt, wobei der Kontaktabschnitt auf der oberen
Fläche der Photoresistschicht ausgebildet und an einer
Position angeordnet ist, die einer zugeordneten Lot
stelle auf dem Chip-Montagebereich des Substrats ent
spricht, wobei der Ansatzabschnitt auf der oberen Flä
che der Photoresistschicht ausgebildet ist und die An
ker- und Kontaktabschnitte miteinander verbindet.
4. Verfahren nach Anspruch 1, 2 oder 3, wobei jedes der
Zugangslöcher eine Tiefe von der oberen Fläche der Pho
toresistschicht zur Pad-Montagefläche des Halbleiter
chips aufweist.
5. Verfahren nach Anspruch 1, 2 oder 3, wobei jedes der
Zugangslöcher eine Tiefe von der oberen Fläche der Pho
toresistschicht zu einem Niveau über dem entsprechenden
Bondpad und unter einem oberen Abschnitt des entspre
chenden ersten Bumps aufweist.
6. Verfahren nach einem Anspruch 3, wobei der Kontaktab
schnitt jedes der leitfähigen Körper einen leitfähigen
dritten Bump aufweist, der bezüglich des Ansatzab
schnitts in Querrichtung vom Kontaktabschnitt hervor
steht und mit dem Anker- und dem Ansatzabschnitt ein
stückig ausgebildet ist.
7. Verfahren nach Anspruch 3, ferner mit dem Schritt zum
Ausbilden eines leitfähigen dritten Bumps auf dem Kon
taktabschnitt jedes leitfähigen Körpers, nachdem die
leitfähigen Körper ausgebildet wurden, so daß der drit
te Bump bezüglich des Ansatzabschnitts in Querrichtung
vom Kontaktabschnitt hervorsteht.
8. Verfahren nach Anspruch 3, wobei die ersten Bumps aus
Zinn-Lotmittel hergestellt sind, und wobei die zweiten
Bumps und die leitfähigen Körper aus einer leitfähigen
Metallpaste hergestellt sind, die ein Metall enthält
das aus Gold, Silber, Kupfer, Eisen, Zinn und Aluminium
ausgewählt wird.
9. Halbleiterbaustein, der dazu geeignet ist, auf einem
Substrat montiert zu werden, wobei das Substrat einen
Chip-Montagebereich mit mehreren Lotstellen aufweist,
wobei der Halbleiterbaustein aufweist:
einen Halbleiterchip mit einer Pad-Montagefläche, die mehrere auf der Pad-Montagefläche angeordnete Bond pads aufweist;
mehrere leitfähige erste Bumps, die mit entspre chenden Bondpads elektrisch verbunden sind und von den Bondpads hervorstehen;
eine auf der Pad-Montagefläche des Halbleiterchips ausgebildete Photoresistschicht, wobei die Photore sistschicht mehrere Zugangslöcher aufweist, die jeweils mit mindestens einem Abschnitt eines entsprechenden er sten Bumps auf den Bondpads ausgerichtet sind und die sen freilegen; und
mehrere leitfähige zweite Bumps, die jeweils einen unteren Abschnitt aufweisen, der ein entsprechendes der Zugangslöcher füllt, um eine elektrische Verbindung mit dem Abschnitt eines entsprechenden ersten Bumps herzu stellen und ihn einzukapseln, und einen oberen Ab schnitt, der sich vom unteren Abschnitt aus erstreckt und von einer oberen Fläche der Photoresistschicht ge genüberliegend der Pad-Montagefläche hervorsteht.
einen Halbleiterchip mit einer Pad-Montagefläche, die mehrere auf der Pad-Montagefläche angeordnete Bond pads aufweist;
mehrere leitfähige erste Bumps, die mit entspre chenden Bondpads elektrisch verbunden sind und von den Bondpads hervorstehen;
eine auf der Pad-Montagefläche des Halbleiterchips ausgebildete Photoresistschicht, wobei die Photore sistschicht mehrere Zugangslöcher aufweist, die jeweils mit mindestens einem Abschnitt eines entsprechenden er sten Bumps auf den Bondpads ausgerichtet sind und die sen freilegen; und
mehrere leitfähige zweite Bumps, die jeweils einen unteren Abschnitt aufweisen, der ein entsprechendes der Zugangslöcher füllt, um eine elektrische Verbindung mit dem Abschnitt eines entsprechenden ersten Bumps herzu stellen und ihn einzukapseln, und einen oberen Ab schnitt, der sich vom unteren Abschnitt aus erstreckt und von einer oberen Fläche der Photoresistschicht ge genüberliegend der Pad-Montagefläche hervorsteht.
10. Halbleiterbaustein nach Anspruch 9, ferner mit mehreren
leitfähigen Körpern, die jeweils einen Ansatzabschnitt
aufweisen sowie einen Ankerabschnitt und einen Kontakt
abschnitt an gegenüberliegenden Enden des Ansatzab
schnitts, wobei der Ankerabschnitt ein entsprechendes
der Zugangslöcher füllt und mit dem oberen Abschnitt
eines entsprechenden zweiten Bumps elektrisch verbunden
ist und ihn einkapselt, wobei der Kontaktabschnitt auf
der oberen Fläche der Photoresistschicht ausgebildet
und an einer Position angeordnet ist, die einer zuge
ordneten Lotstelle auf dem Chip-Montagebereich des Sub
strats entspricht, wobei der Ansatzabschnitt auf der
oberen Fläche der Photoresistschicht ausgebildet ist
und die Anker- und Kontaktabschnitte miteinander ver
bindet.
11. Halbleiterbaustein nach Anspruch 9 oder 10, wobei jedes
der Zugangslöcher eine Tiefe von der oberen Fläche der
Photoresistschicht zur Pad-Montagefläche des Halblei
terchips aufweist.
12. Halbleiterbaustein nach Anspruch 9 oder 10, wobei jedes
der Zugangslöcher eine Tiefe von der oberen Fläche der
Photoresistschicht zu einem Niveau über dem entspre
chenden Bondpad und unter einem oberen Abschnitt des
entsprechenden ersten Bumps aufweist.
13. Halbleiterbaustein nach Anspruch 10, 11 oder 12, wobei
der Kontaktabschnitt jedes der leitfähigen Körper einen
leitfähigen dritten Bump aufweist, der bezüglich des
Ansatzabschnitts in Querrichtung vom Kontaktabschnitt
hervorsteht und mit dem Anker- und dem Ansatzabschnitt
einstückig ausgebildet ist.
14. Halbleiterbaustein nach Anspruch 10, ferner mit einem
leitfähigen dritten Bump, der auf dem Kontaktabschnitt
jedes der leitfähigen Körper so ausgebildet ist, daß
der dritte Bump bezüglich des Ansatzabschnittes in
Querrichtung vom Kontaktabschnitt hervorsteht.
15. Halbleiterbaustein nach einem der Ansprüche 10 bis 14,
wobei die ersten Bumps aus Zinn-Lotmittel hergestellt
sind, und wobei die zweiten Bumps und die leitfähigen
Körper aus einer leitfähigen Metallpaste hergestellt
sind, die ein Metall enthält, das aus Gold, Silber,
Kupfer, Eisen, Zinn und Aluminium ausgewählt wird.
16. Verfahren zum Montieren eines Halbleiterchips auf einem
Substrat, wobei das Substrat einen Chip-Montagebereich
mit mehreren Lotstellen aufweist und der Halbleiterchip
eine Pad-Montagefläche mit mehreren Bondpads aufweist,
die dazu vorgesehen sind, mit entsprechenden der Lot
stellen verbunden zu werden, wobei das Verfahren die
Schritte aufweist:
Ausbilden einer Photoresistschicht auf der Pad- Montagefläche;
Ausbilden von Zugangslöchern in der Photore sistschicht, wobei jedes Zugangsloch mit mindestens ei nem Abschnitt eines entsprechenden Bondpads ausgerich tet ist und ihn freilegt, und wobei jedes Zugangsloch durch eine Umfangswand begrenzt ist;
Ausbilden mehrerer leitfähiger Überzugsschichten durch eine Metallisierungs- oder Galvanisierungstech nik, wobei jede Überzugsschicht einen rohrförmigen un teren Abschnitt aufweist, der die Umfangswand eines entsprechenden Zugangslochs bedeckt und mit einem ent sprechenden Bondpad elektrisch verbunden ist, und einen oberen Abschnitt, der auf einer oberen Fläche der Pho toresistschicht um das entsprechende Zugangsloch herum angeordnet ist; und
Ausbilden mehrerer leitfähiger Körper, die jeweils einen Ansatzabschnitt aufweisen sowie einen Ankerab schnitt und einen Kontaktabschnitt an gegenüberliegen den Enden des Ansatzabschnitts, wobei der Ankerab schnitt einen Innenraum des unteren Abschnitts einer entsprechenden Überzugsschicht füllt und den oberen Ab schnitt der entsprechenden Überzugsschicht einkapselt, so daß er mit dem entsprechenden Bondpad elektrisch verbunden ist, wobei der Kontaktabschnitt auf der obe ren Fläche der Photoresistschicht ausgebildet und an einer Position angeordnet ist, die einer zugeordneten Lotstelle auf dem Chip-Montagebereich des Substrats entspricht, wobei der Ansatzabschnitt auf der oberen Fläche der Photoresistschicht ausgebildet ist und die Anker- und Kontaktabschnitte miteinander verbindet.
Ausbilden einer Photoresistschicht auf der Pad- Montagefläche;
Ausbilden von Zugangslöchern in der Photore sistschicht, wobei jedes Zugangsloch mit mindestens ei nem Abschnitt eines entsprechenden Bondpads ausgerich tet ist und ihn freilegt, und wobei jedes Zugangsloch durch eine Umfangswand begrenzt ist;
Ausbilden mehrerer leitfähiger Überzugsschichten durch eine Metallisierungs- oder Galvanisierungstech nik, wobei jede Überzugsschicht einen rohrförmigen un teren Abschnitt aufweist, der die Umfangswand eines entsprechenden Zugangslochs bedeckt und mit einem ent sprechenden Bondpad elektrisch verbunden ist, und einen oberen Abschnitt, der auf einer oberen Fläche der Pho toresistschicht um das entsprechende Zugangsloch herum angeordnet ist; und
Ausbilden mehrerer leitfähiger Körper, die jeweils einen Ansatzabschnitt aufweisen sowie einen Ankerab schnitt und einen Kontaktabschnitt an gegenüberliegen den Enden des Ansatzabschnitts, wobei der Ankerab schnitt einen Innenraum des unteren Abschnitts einer entsprechenden Überzugsschicht füllt und den oberen Ab schnitt der entsprechenden Überzugsschicht einkapselt, so daß er mit dem entsprechenden Bondpad elektrisch verbunden ist, wobei der Kontaktabschnitt auf der obe ren Fläche der Photoresistschicht ausgebildet und an einer Position angeordnet ist, die einer zugeordneten Lotstelle auf dem Chip-Montagebereich des Substrats entspricht, wobei der Ansatzabschnitt auf der oberen Fläche der Photoresistschicht ausgebildet ist und die Anker- und Kontaktabschnitte miteinander verbindet.
17. Verfahren nach Anspruch 16, wobei der Kontaktabschnitt
jedes der leitfähigen Körper einen leitfähigen Bump
aufweist, der bezüglich des Ansatzabschnitts in Quer
richtung vom Kontaktabschnitt hervorsteht und mit dem
Anker- und dem Ansatzabschnitt einstückig ausgebildet
ist.
18. Verfahren nach Anspruch 16 oder 17, ferner mit dem
Schritt zum Ausbilden eines leitfähigen Bumps auf dem
Kontaktabschnitt jedes der leitfähigen Körper, nachdem
die leitfähigen Körper ausgebildet wurden, so daß der
Bump bezüglich des Ansatzabschnitts in Querrichtung vom
Kontaktabschnitt hervorsteht.
19. Verfahren nach Anspruch 18, wobei die Bumps aus Zinn-
Lotmittel hergestellt ist und die leitfähigen Körper
aus einer leitfähigen Metallpaste hergestellt sind, die
ein Metall enthält, das aus Gold, Silber, Kupfer, Ei
sen, Zinn und Aluminium ausgewählt wird.
20. Halbleiterbaustein, der dazu geeignet ist, auf einem
Substrat montiert zu werden, wobei das Substrat einen
Chip-Montagebereich mit mehreren Lotstellen aufweist,
wobei der Halbleiterbaustein aufweist:
einen Halbleiterchip mit einer Pad-Montagefläche mit mehreren Bondpads;
eine auf der Pad-Montagefläche des Halbleiterchips ausgebildete Photoresistschicht, wobei die Photore sistschicht mehrere Zugangslöcher aufweist, die mit mindestens einem Abschnitt eines entsprechenden Bond pads ausgerichtet sind und diesen freilegen, wobei je des der Zugangslöcher durch eine Umfangswand begrenzt ist;
mehrere Überzugsschichten, die jeweils einen rohr förmigen unteren Abschnitt aufweisen, der die Umfangs wand eines entsprechenden Zugangslochs bedeckt und mit einem entsprechenden der Bondpads elektrisch verbunden ist, und einen oberen Abschnitt, der auf einer oberen Fläche der Photoresistschicht um das entsprechende Zu gangsloch herum angeordnet ist; und
mehrere leitfähige Körper, die jeweils einen An satzabschnitt aufweisen sowie einen Ankerabschnitt und einen Kontaktabschnitt an gegenüberliegenden Enden des Ansatzabschnitts, wobei der Ankerabschnitt einen Innen raum des unteren Abschnitts einer entsprechenden Über zugsschicht füllt und den oberen Abschnitt der entspre chenden Überzugsschicht einkapselt, so daß er mit dem entsprechenden Bondpad elektrisch verbunden ist, wobei der Kontaktabschnitt auf der oberen Fläche der Photore sistschicht ausgebildet und an einer Position angeord net ist, die einer zugeordneten Lotstelle auf dem Chip- Montagebereich des Substrats entspricht, wobei der An satzabschnitt auf der oberen Fläche der Photore sistschicht ausgebildet ist und die Anker- und Kontakt abschnitte miteinander verbindet.
einen Halbleiterchip mit einer Pad-Montagefläche mit mehreren Bondpads;
eine auf der Pad-Montagefläche des Halbleiterchips ausgebildete Photoresistschicht, wobei die Photore sistschicht mehrere Zugangslöcher aufweist, die mit mindestens einem Abschnitt eines entsprechenden Bond pads ausgerichtet sind und diesen freilegen, wobei je des der Zugangslöcher durch eine Umfangswand begrenzt ist;
mehrere Überzugsschichten, die jeweils einen rohr förmigen unteren Abschnitt aufweisen, der die Umfangs wand eines entsprechenden Zugangslochs bedeckt und mit einem entsprechenden der Bondpads elektrisch verbunden ist, und einen oberen Abschnitt, der auf einer oberen Fläche der Photoresistschicht um das entsprechende Zu gangsloch herum angeordnet ist; und
mehrere leitfähige Körper, die jeweils einen An satzabschnitt aufweisen sowie einen Ankerabschnitt und einen Kontaktabschnitt an gegenüberliegenden Enden des Ansatzabschnitts, wobei der Ankerabschnitt einen Innen raum des unteren Abschnitts einer entsprechenden Über zugsschicht füllt und den oberen Abschnitt der entspre chenden Überzugsschicht einkapselt, so daß er mit dem entsprechenden Bondpad elektrisch verbunden ist, wobei der Kontaktabschnitt auf der oberen Fläche der Photore sistschicht ausgebildet und an einer Position angeord net ist, die einer zugeordneten Lotstelle auf dem Chip- Montagebereich des Substrats entspricht, wobei der An satzabschnitt auf der oberen Fläche der Photore sistschicht ausgebildet ist und die Anker- und Kontakt abschnitte miteinander verbindet.
21. Halbleiterbaustein nach Anspruch 20, wobei der Kontakt
abschnitt jedes der leitfähigen Körper einen leitfähi
gen Bump aufweist, der bezüglich des Ansatzabschnitts
in Querrichtung vom Kontaktabschnitt hervorsteht und
mit dem Anker- und dem Ansatzabschnitt einstückig aus
gebildet ist.
22. Halbleiterbaustein nach Anspruch 20 oder 21, ferner mit
einem leitfähigen Bump, die auf dem Kontaktabschnitt
jedes der leitfähigen Körper so ausgebildet ist, daß
der Bump bezüglich des Ansatzabschnitts in Querrichtung
vom Kontaktabschnitt hervorsteht.
23. Halbleiterbaustein nach Anspruch 22, wobei der Bump aus
Zinn-Lotmittel hergestellt ist und die leitfähigen Kör
per aus einer leitfähigen Metallpaste hergestellt sind,
die ein Metall enthält, das aus Gold, Silber, Kupfer,
Eisen, Zinn und Aluminium ausgewählt wird.
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
OP8 | Request for examination as to paragraph 44 patent law | ||
8127 | New person/name/address of the applicant |
Owner name: COMPUTECH INTERNATIONAL VENTURES LTD., TORTOLA, VG |
|
8181 | Inventor (new situation) |
Inventor name: CHEN, I-MING, TAIPEH/T AI-PEI, TW |
|
8127 | New person/name/address of the applicant |
Owner name: EVERGRAND HOLDINGS LTD., TORTOLA, VG |
|
R082 | Change of representative |
Representative=s name: PATRONUS IP PATENT- & RECHTSANWAELTE BERNHARD , DE |
|
R119 | Application deemed withdrawn, or ip right lapsed, due to non-payment of renewal fee |
Effective date: 20131001 |