CN106098003B - Goa电路 - Google Patents

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Abstract

本发明提供一种GOA电路，所述GOA电路通过第九薄膜晶体管、第十薄膜晶体管、及电阻来控制第三节点的电位，其中，所述第九薄膜晶体管的栅极电性连接于第m条时钟信号，源极电性连接于第一恒压电位，漏极电性连接于电阻的一端；所述第十薄膜晶体管的栅极电性连接于第m+2条时钟信号，源极电性连接于第二恒压电位，漏极电性连接于电阻的另一端，通过第m条时钟信号和第m+2条时钟信号控制所述第九薄膜晶体管和第十薄膜晶体管交替导通，能够实现对第三节点进行定时充放电，防止由于第三节点长时间维持高电位而引起的关键薄膜晶体管阈值电压漂移，保证GOA电路的稳定性。

Description

GOA电路
技术领域
本发明涉及显示技术领域，尤其涉及一种GOA电路。
背景技术
液晶显示器(Liquid Crystal Display，LCD)具有机身薄、省电、无辐射等众多优点，得到了广泛的应用。如：液晶电视、移动电话、个人数字助理(PDA)、数字相机、计算机屏幕或笔记本电脑屏幕等，在平板显示领域中占主导地位。
GOA技术(Gate Driver on Array)即阵列基板行驱动技术，是运用液晶显示面板的原有阵列制程将水平扫描线的驱动电路制作在显示区周围的基板上，使之能替代外接集成电路板((Integrated Circuit，IC)来完成水平扫描线的驱动。GOA技术能减少外接IC的焊接(bonding)工序，有机会提升产能并降低产品成本，而且可以使液晶显示面板更适合制作窄边框或无边框的显示产品。
请参阅图1，图1为现有的一种GOA电路的电路图，图1所示的GOA电路包括：级联的多级GOA单元，每一级GOA单元均包括：扫描控制模块100、输出模块200、及节点控制模块300；设n和m均为正整数，在第n级GOA模块中：所述扫描控制模块100包括：第一薄膜晶体管T1，所述第一薄膜晶体管T1的栅极接入上两级第n-2级GOA单元的栅极扫描信号G(n-2)，源极接入正向扫描控制信号U2D，漏极电性连接第一节点H(n)；以及第三薄膜晶体管T3，所述第三薄膜晶体管T3的栅极接入下两级第n+2级GOA单元的栅极扫描信号G(n+2)，源极接入反向扫描控制信号D2U，漏极电性连接于第一节点H(n)；所述输出模块200包括：第二薄膜晶体管T2、以及第一电容C1；所述第二薄膜晶体管T2的栅极电性连接于第二节点Q(n)，源极电性连接于第m+1条时钟信号CK(m+1)，漏极接入第n级GOA单元的栅极扫描信号G(n)；所述第一电容C1的一端电性连接于第二节点Q(n)，另一端接入第n级GOA单元的栅极扫描信号G(n)；所述节点控制模块300包括：第四薄膜晶体管T4、第五薄膜晶体管T5、第六薄膜晶体管T6、第七薄膜晶体管T7、第八薄膜晶体管T8、第九薄膜晶体管T9、以及第二电容C2；所述第四薄膜晶体管T4的栅极电性连接于第三节点P(n)，源极接入第n级GOA单元的栅极扫描信号G(n)，漏极电性连接于恒压低电位VGL；所述第五薄膜晶体管T5的栅极电性连接于恒压高电位VGH，源极电性连接于第一节点H(n)，漏极电性连接于第二节点Q(n)；所述第六薄膜晶体管T6的栅极电性连接于第一节点H(n)，源极电性连接于第三节点P(n)，漏极电性连接于恒压低电位VGL；所述第七薄膜晶体管T7的栅极电性连接于第三节点P(n)，源极电性连接于第二节点Q(n)，漏极电性连接于恒压低电位VGL；所述第八薄膜晶体管T8的栅极电性连接于第m+3条时钟信号CK(m+3)，源极接入第n级GOA单元的栅极扫描信号G(n)，漏极电性连接于恒压低电位VGL；所述第九薄膜晶体管T9的栅极和源极均电性连接于第m+2条时钟信号CK(m+2)，漏极电性连接于第三节点P(n)；所述第二电容C2的一端电性连接于第三节点P(n)，另一端电性连接于恒压低电位VGL。
在现有的GOA电路中，在非输出阶段，第三节点P(n)会长时间处于高电位，第四薄膜晶体管T4与第七薄膜晶体管T7长时间导通，进而导致第四薄膜晶体管T4与第七薄膜晶体管T7发生阈值电压漂移(Vth Shift)，最终导致GOA电路的稳定性下降和输出异常。
发明内容
本发明的目的在于提供一种GOA电路，能够实现对第三节点进行定时充放电，防止由于第三节点长时间维持高电位而引起的关键薄膜晶体管阈值电压漂移，保证GOA电路的稳定性。
为实现上述目的，本发明提供了一种GOA电路，包括：级联的多级GOA单元，每一级GOA单元均包括：扫描控制模块、与所述扫描控制模块电性连接输出模块、与所述输出模块电性连接的下拉模块、与所述扫描控制模块、输出模块和下拉模块均电性连接的下拉控制模块；
设n和m均为正整数，除第一级、第二级、倒数第二级、以及最后一级GOA单元外，在第n级GOA模块中：
所述扫描控制模块用于利用正向扫描控制信号或反向扫描控制信号控制所述GOA电路进行正向扫描或反向扫描；
所述输出模块接入第m+1条时钟信号，用于在第n级GOA单元作用期间利用第m+1条时钟信号输出第n级GOA单元的栅极扫描信号；
所述下拉模块用于在第n级GOA单元的非作用期间下拉所述第n级GOA单元的栅极扫描信号的电位；
所述下拉控制模块接入第m条时钟信号、第m+2条时钟信号、第一恒压电位、第二恒压电位，用于在第n级GOA单元的作用期间关闭下拉模块并维持输出模块打开，在第n级GOA单元的非作用期间打开下拉模块并关闭输出模块，同时利用第m条时钟信号和第m+2条时钟信号控制第一恒压电位和第二恒压电位对下拉模块的开关节点进行定时充放电；
所述第一恒压电位与第二恒压电位的电位相反，所述正向扫描控制信号与反向扫描控制信号的电位相反。
所述扫描控制模块包括：第一薄膜晶体管、以及第三薄膜晶体管；所述输出模块包括：第二薄膜晶体管、以及第一电容；所述下拉模块包括：第四薄膜晶体管、第八薄膜晶体管、以及第二电容；所述下拉控制模块包括：第六薄膜晶体管、第七薄膜晶体管、第九薄膜晶体管、第十薄膜晶体管、以及电阻；所述GOA电路还包括稳压模块，所述稳压模块包括：第五薄膜晶体管；
所述第一薄膜晶体管的栅极接入上两级第n-2级GOA单元的栅极扫描信号，源极接入正向扫描控制信号，漏极电性连接第一节点；
所述第二薄膜晶体管的栅极电性连接于第二节点，源极电性连接于第m+1条时钟信号，漏极电性连接于栅极扫描信号；所述第三薄膜晶体管T3的栅极接入下两级第n+2级GOA单元的栅极扫描信号，源极接入反向扫描控制信号，漏极电性连接于第一节点；所述第四薄膜晶体管的栅极电性连接于第三节点，源极接入第n级GOA单元的栅极扫描信号，漏极电性连接于第二恒压电位；所述第五薄膜晶体管的栅极电性连接于第一恒压电位，源极电性连接于第一节点，漏极电性连接于第二节点；所述第六薄膜晶体管的栅极电性连接于第一节点，源极电性连接于第三节点，漏极电性连接于第二恒压电位；所述第七薄膜晶体管的栅极电性连接于第三节点，源极电性连接于第二节点，漏极电性连接于第二恒压电位；所述第八薄膜晶体管的栅极电性连接于第m+3条时钟信号，源极接入第n级GOA单元的栅极扫描信号，漏极电性连接于第二恒压电位；所述第九薄膜晶体管的栅极电性连接于第m条时钟信号，源极电性连接于第一恒压电位，漏极电性连接于电阻的一端；所述第十薄膜晶体管的栅极电性连接于第m+2条时钟信号，源极电性连接于第二恒压电位，漏极电性连接于电阻的另一端；所述第二电容的一端电性连接于第三节点，另一端电性连接于第二恒压电位；所述第一电容的一端电性连接于第二节点，另一端电性连接于栅极扫描信号；
所述第三节点为所述下拉模块的开关节点。
在第一级和第二级GOA单元中，所述第一薄膜晶体管的栅极电性连接于电路起始信号；
在倒数第二级和最后一级GOA单元中，所述第三薄膜晶体管的栅极电性连接于电路起始信号。
包括四条时钟信号：第一、第二、第三、及第四条时钟信号；当所述第m条时钟信号为第二条时钟信号时，第m+3条时钟信号为第一条时钟信号；当所述第m条时钟信号为第三条时钟信号时，第m+2条时钟信号为第一条时钟信号，第m+3条时钟信号为第二条时钟信号；当所述第m条时钟信号为第四条时钟信号时，第m+1条时钟信号为第一条时钟信号，第m+2条时钟信号为第二条时钟信号，第m+3条时钟信号为第三条时钟信号。
所述第一、第二、第三、及第四条时钟信号的脉冲周期相同，前一条时钟信号的下降沿与后一条时钟信号的上升沿同时产生。
所述各个薄膜晶体管均为N型薄膜晶体管，所述第一恒压电位为恒压高电位，第二恒压电位为恒压低电位。
所述各个薄膜晶体管均为P型薄膜晶体管，所述第一恒压电位为恒压低电位，第二恒压电位为恒压高电位。
所述各个薄膜晶体管均为低温多晶硅薄膜晶体管。
所述正向扫描控制信号为高电位，反向扫描控制信号为低电位；
反向扫描时，所述正向扫描控制信号为低电位，反向扫描控制信号为高电位。
正向扫描时，所述正向扫描控制信号为低电位，反向扫描控制信号为高电位；
反向扫描时，所述正向扫描控制信号为高电位，反向扫描控制信号为低电位。
本发明的有益效果：本发明提供了一种GOA电路，所述GOA电路通过第九薄膜晶体管、第十薄膜晶体管、及电阻来控制第三节点的电位，其中，所述第九薄膜晶体管的栅极电性连接于第m条时钟信号，源极电性连接于第一恒压电位，漏极电性连接于电阻的一端；所述第十薄膜晶体管的栅极电性连接于第m+2条时钟信号，源极电性连接于第二恒压电位，漏极电性连接于电阻的另一端，通过第m条时钟信号和第m+2条时钟信号控制所述第九薄膜晶体管和第十薄膜晶体管交替导通，能够实现对第三节点进行定时充放电，防止由于第三节点长时间维持高电位而引起的关键薄膜晶体管阈值电压漂移，保证GOA电路的稳定性。
附图说明
为了能更进一步了解本发明的特征以及技术内容，请参阅以下有关本发明的详细说明与附图，然而附图仅提供参考与说明用，并非用来对本发明加以限制。
附图中，
图1为现有的一种GOA电路的电路图；
图2为本发明的GOA电路的电路图；
图3为本发明的GOA电路的第一级GOA单元的电路图；
图4为本发明的GOA电路的第二级GOA单元的电路图；
图5为本发明的GOA电路的最后一级GOA单元的电路图；
图6为本发明的GOA电路的倒数第二级GOA单元的电路图；
图7为本发明的GOA电路的正向扫描时序图；
图8为本发明的GOA电路的反向扫描时序图。
具体实施方式
为更进一步阐述本发明所采取的技术手段及其效果，以下结合本发明的优选实施例及其附图进行详细描述。
请参阅图2，本发明提供一种GOA电路，包括：级联的多级GOA单元，每一级GOA单元均包括：扫描控制模块100、与所述扫描控制模块100电性连接输出模块200、与所述输出模块200电性连接的下拉模块300、与所述扫描控制模块100、输出模块200和下拉模块300均电性连接的下拉控制模块400；
设n和m均为正整数，除第一级、第二级、倒数第二级、以及最后一级GOA单元外，在第n级GOA模块中：
所述扫描控制模块100用于利用正向扫描控制信号U2D或反向扫描控制信号D2U控制所述GOA电路进行正向扫描或反向扫描；
所述输出模块200接入第m+1条时钟信号CK(m+1)，用于在第n级GOA单元作用期间利用第m+1条时钟信号CK(m+1)输出第n级GOA单元的栅极扫描信号G(n)；
所述下拉模块300用于在第n级GOA单元的非作用期间下拉所述第n级GOA单元的栅极扫描信号G(n)的电位；
所述下拉控制模块400接入第m条时钟信号CK(m)、第m+2条时钟信号CK(m+2)、第一恒压电位、第二恒压电位，用于在第n级GOA单元的作用期间关闭下拉模块300并维持输出模块200打开，在第n级GOA单元的非作用期间打开下拉模块300并关闭输出模块200，同时利用第m条时钟信号CK(m)和第m+2条时钟信号CK(m+2)控制第一恒压电位和第二恒压电位对下拉模块400的开关节点进行定时充放电；
所述第一恒压电位与第二恒压电位的电位相反，所述正向扫描控制信号U2D与反向扫描控制信号D2U的电位相反。
具体地，所述输出模块200包括：第二薄膜晶体管T2、以及第一电容C1；所述下拉模块300包括：第四薄膜晶体管T4、第八薄膜晶体管T8、以及第二电容C2；所述下拉控制模块400包括：第六薄膜晶体管T6、第七薄膜晶体管T7、第九薄膜晶体管T9、第十薄膜晶体管T10、以及电阻R1。
此外，所述GOA电路还包括稳压模块500，所述稳压模块500包括：第五薄膜晶体管T5。
进一步地，所述第一薄膜晶体管T1的栅极接入上两级第n-2级GOA单元的栅极扫描信号G(n-2)，源极接入正向扫描控制信号U2D，漏极电性连接第一节点H(n)；所述第二薄膜晶体管T2的栅极电性连接于第二节点Q(n)，源极电性连接于第m+1条时钟信号CK(m+1)，漏极电性连接于栅极扫描信号G(n)；所述第三薄膜晶体管T3的栅极接入下两级第n+2级GOA单元的栅极扫描信号G(n+2)，源极接入反向扫描控制信号D2U，漏极电性连接于第一节点H(n)；所述第四薄膜晶体管T4的栅极电性连接于第三节点P(n)，源极接入第n级GOA单元的栅极扫描信号G(n)，漏极电性连接于第二恒压电位；所述第五薄膜晶体管T5的栅极电性连接于第一恒压电位，源极电性连接于第一节点H(n)，漏极电性连接于第二节点Q(n)；所述第六薄膜晶体管T6的栅极电性连接于第一节点H(n)，源极电性连接于第三节点P(n)，漏极电性连接于第二恒压电位；所述第七薄膜晶体管T7的栅极电性连接于第三节点P(n)，源极电性连接于第二节点Q(n)，漏极电性连接于第二恒压电位；所述第八薄膜晶体管T8的栅极电性连接于第m+3条时钟信号CK(m+3)，源极接入第n级GOA单元的栅极扫描信号G(n)，漏极电性连接于第二恒压电位；所述第九薄膜晶体管T9的栅极电性连接于第m条时钟信号CK(m)，源极电性连接于第一恒压电位，漏极电性连接于电阻R1的一端；所述第十薄膜晶体管T10的栅极电性连接于第m+2条时钟信号CK(m+2)，源极电性连接于第二恒压电位，漏极电性连接于电阻R1的另一端；所述第一电容C1的一端电性连接于第二节点Q(n)，另一端接入第n级GOA单元的栅极扫描信号G(n)；所述第二电容C2的一端电性连接于第三节点P(n)，另一端电性连接于第二恒压电位；
其中，所述第三节点P(n)即为所述下拉模块400的开关节点。
具体地，请参阅图3及图4，在第一级和第二级GOA单元中，所述第一薄膜晶体管T1的栅极电性连接于电路起始信号STV。请参阅图5及图6，在最后一级和倒数第二级GOA单元中，所述第三薄膜晶体管T3的栅极电性连接于电路起始信号STV。
需要说明的是，上述GOA电路包括：四条时钟信号：第一、第二、第三、及第四条时钟信号CK(1)、CK(2)、CK(3)、CK(4)；当所述第m条时钟信号CK(m)为第二条时钟信号CK(2)时，第m+3条时钟信号CK(m+3)为第一条时钟信号CK(1)；当所述第m条时钟信号CK(m)为第三条时钟信号CK(3)时，第m+2条时钟信号CK(m+2)为第一条时钟信号CK(1)，第m+3条时钟信号CK(m+3)为第二条时钟信号CK(2)；当所述第m条时钟信号CK(m)为第四条时钟信号CK(4)时，第m+1条时钟信号CK(m+1)为第一条时钟信号CK(1)，第m+2条时钟信号CK(m+2)为第二条时钟信号CK(2)，第m+3条时钟信号CK(m+3)为第三条时钟信号CK(3)。
进一步地，所述第一、第二、第三、及第四条时钟信号CK(1)、CK(2)、CK(3)、CK(4)的脉冲周期相同，前一条时钟信号的下降沿与后一条时钟信号的上升沿同时产生，即所述第一条时钟信号CK(1)的第一个脉冲信号首先产生，所述第一时钟信号CK(1)的第一个脉冲信号结束的同时所述第二条时钟信号CK(2)的第一个脉冲信号产生，所述第二条时钟信号CK(2)的第一个脉冲信号结束的同时所述第三条时钟信号CK(3)的第一个脉冲信号产生，所述第三条时钟信号CK(3)的第一个脉冲信号结束的同时所述第四条时钟信号CK(4)的第一个脉冲信号产生，所述第四条时钟信号CK(4)的第一个脉冲信号结束的同时所述第一条时钟信号CK(1)的第二个脉冲信号产生。
可选地，所述各个薄膜晶体管均为N型薄膜晶体管，所述第一恒压电位为恒压高电位VGH，第二恒压电位为恒压低电位VGL。其正向扫描时，所述正向扫描控制信号U2D为高电位，反向扫描控制信号D2U为低电位；反向扫描时，所述正向扫描控制信号U2D为低电位，反向扫描控制信号D2U为高电位。
可选地，所述各个薄膜晶体管均为P型薄膜晶体管，所述第一恒压电位为恒压低电位VGL，第二恒压电位为恒压高电位VGH。其正向扫描时，所述正向扫描控制信号U2D为低电位，反向扫描控制信号D2U为高电位；反向扫描时，所述正向扫描控制信号U2D为高电位，反向扫描控制信号D2U为低电位
优选地，所述各个薄膜晶体管均为低温多晶硅薄膜晶体管。
具体地，请参阅图7，本发明的GOA电路(N型薄膜晶体管)正向扫描时的工作过程如下：首先，第n-2级GOA单元的栅极扫描信号G(n-2)以及正向扫描控制信号U2D均提供高电位，第一薄膜晶体管T1导通，将第一节点H(n)充电至高电位，第六薄膜晶体管T6导通，第三节点P(n)被拉低至低电位，同时第五薄膜晶体管T5受恒压高电位VGH的控制始终导通，第二节点Q(n)充电至高电位；接着，第n-2级GOA单元的栅极扫描信号G(n-2)提供低电位，第一薄膜晶体管T1关闭，第二节点Q(n)受第一电容C1电压保持作用维持高电位，第二薄膜晶体管T2打开，第m+1条时钟信号CK(m+1)提供高电位，栅极扫描信号G(n)输出高电位；然后，第m+1条时钟信号CK(m+1)提供低电位，第二节点Q(n)仍受第一电容C1电压保持作用维持高电位，栅极扫描信号G(n)输出低电位；随后，第n+2级GOA单元的栅极扫描信号G(n+2)提供高电位，反向扫描控制信号D2U提供低电位，第三薄膜晶体管T3打开，第一和第二节点H(n)、Q(n)被拉低至低电位，第二薄膜晶体管T2关闭，第六薄膜晶体管T6关闭；接着，第m条时钟信号CK(m)和第m+2条时钟信号CK(m+2)交替提供高电位，定时对第三节点P(n)进行充放电，并维持栅极扫描信号G(n)和第二节点Q(n)的低电位，其中，当第m条时钟信号CK(m)为高电位时，第九薄膜晶体管T9导通，而此时第m+2条时钟信号CK(m+2)为低电位，第十薄膜晶体管T10关闭，由于电阻R1的分压，第三节点P(n)被充电至恒压高电位VGH，第四和第七薄膜晶体管T4、T7均导通，栅极扫描信号G(n)和第二节点Q(n)被维持在恒压低电位VGL；当第m+2条时钟信号CK(m+2)为高电位时，第十薄膜晶体管T10导通，而此时第m条时钟信号CK(m)为低电位，第九薄膜晶体管T9关闭，由于电阻R1的分压，第三节点P(n)被拉低至恒压低电位VGL，从而对第三节点P(n)进行放电，防止由于第三节点P(n)长时间维持高电位而引起的关键薄膜晶体管阈值电压漂移。
相应地，请参阅图8，图8为本发明的GOA电路的反向扫描时的时序图，反向扫描时，扫描方向与正向扫描相反，正向扫描控制信号U2D为低电位，反向扫描控制信号D2U为高电位，其余工作过程均与正向扫描相同，此处不再赘述。
综上所述，本发明提供了一种GOA电路，所述GOA电路通过第九薄膜晶体管、第十薄膜晶体管、及电阻来控制第三节点的电位，其中，所述第九薄膜晶体管的栅极电性连接于第m条时钟信号，源极电性连接于第一恒压电位，漏极电性连接于电阻的一端；所述第十薄膜晶体管的栅极电性连接于第m+2条时钟信号，源极电性连接于第二恒压电位，漏极电性连接于电阻的另一端，通过第m条时钟信号和第m+2条时钟信号控制所述第九薄膜晶体管和第十薄膜晶体管交替导通，能够实现对第三节点进行定时充放电，防止由于第三节点长时间维持高电位而引起的关键薄膜晶体管阈值电压漂移，保证GOA电路的稳定性。
以上所述，对于本领域的普通技术人员来说，可以根据本发明的技术方案和技术构思作出其他各种相应的改变和变形，而所有这些改变和变形都应属于本发明权利要求的保护范围。

Claims (10)

1.一种GOA电路，其特征在于，包括：级联的多级GOA单元，每一级GOA单元均包括：扫描控制模块(100)、与所述扫描控制模块(100)电性连接输出模块(200)、与所述输出模块(200)电性连接的下拉模块(300)、与所述扫描控制模块(100)、输出模块(200)和下拉模块(300)均电性连接的下拉控制模块(400)；
设n和m均为正整数，除第一级、第二级、倒数第二级、以及最后一级GOA单元外，在第n级GOA模块中：
所述扫描控制模块(100)用于利用正向扫描控制信号(U2D)或反向扫描控制信号(D2U)控制所述GOA电路进行正向扫描或反向扫描；
所述输出模块(200)接入第m+1条时钟信号(CK(m+1))，用于在第n级GOA单元作用期间利用第m+1条时钟信号(CK(m+1))输出第n级GOA单元的栅极扫描信号(G(n))；
所述下拉模块(300)用于在第n级GOA单元的非作用期间下拉所述第n级GOA单元的栅极扫描信号(G(n))的电位；
所述下拉控制模块(400)接入第m条时钟信号(CK(m))、第m+2条时钟信号(CK(m+2))、第一恒压电位、第二恒压电位，用于在第n级GOA单元的作用期间关闭下拉模块(300)并维持输出模块(200)打开，在第n级GOA单元的非作用期间打开下拉模块(300)并关闭输出模块(200)，同时利用第m条时钟信号(CK(m))和第m+2条时钟信号(CK(m+2))控制第一恒压电位和第二恒压电位对下拉模块(400)的开关节点进行定时充放电；
所述第一恒压电位与第二恒压电位的电位相反，所述正向扫描控制信号(U2D)与反向扫描控制信号(D2U)的电位相反。
2.如权利要求1所述的GOA电路，其特征在于，所述扫描控制模块(100)包括：第一薄膜晶体管(T1)、以及第三薄膜晶体管(T3)；所述输出模块(200)包括：第二薄膜晶体管(T2)、以及第一电容(C1)；所述下拉模块(300)包括：第四薄膜晶体管(T4)、第八薄膜晶体管(T8)、以及第二电容(C2)；所述下拉控制模块(400)包括：第六薄膜晶体管(T6)、第七薄膜晶体管(T7)、第九薄膜晶体管(T9)、第十薄膜晶体管(T10)、以及电阻(R1)；所述GOA电路还包括稳压模块(500)，所述稳压模块(500)包括：第五薄膜晶体管(T5)；
所述第一薄膜晶体管(T1)的栅极接入上两级第n-2级GOA单元的栅极扫描信号(G(n-2))，源极接入正向扫描控制信号(U2D)，漏极电性连接第一节点(H(n))；所述第二薄膜晶体管(T2)的栅极电性连接于第二节点(Q(n))，源极电性连接于第m+1条时钟信号(CK(m+1))，漏极接入第n级GOA单元的栅极扫描信号(G(n))；所述第三薄膜晶体管(T3)的栅极接入下两级第n+2级GOA单元的栅极扫描信号(G(n+2))，源极接入反向扫描控制信号(D2U)，漏极电性连接于第一节点(H(n))；所述第四薄膜晶体管(T4)的栅极电性连接于第三节点(P(n))，源极接入第n级GOA单元的栅极扫描信号(G(n))，漏极电性连接于第二恒压电位；所述第五薄膜晶体管(T5)的栅极电性连接于第一恒压电位，源极电性连接于第一节点(H(n))，漏极电性连接于第二节点(Q(n))；所述第六薄膜晶体管(T6)的栅极电性连接于第一节点(H(n))，源极电性连接于第三节点(P(n))，漏极电性连接于第二恒压电位；所述第七薄膜晶体管(T7)的栅极电性连接于第三节点(P(n))，源极电性连接于第二节点(Q(n))，漏极电性连接于第二恒压电位；所述第八薄膜晶体管(T8)的栅极电性连接于第m+3条时钟信号(CK(m+3))，源极接入第n级GOA单元的栅极扫描信号(G(n))，漏极电性连接于第二恒压电位；所述第九薄膜晶体管(T9)的栅极电性连接于第m条时钟信号(CK(m))，源极电性连接于第一恒压电位，漏极电性连接于电阻(R1)的一端；所述第十薄膜晶体管(T10)的栅极电性连接于第m+2条时钟信号(CK(m+2))，源极电性连接于第二恒压电位，漏极电性连接于电阻(R1)的另一端；所述第一电容(C1)的一端电性连接于第二节点(Q(n))，另一端接入第n级GOA单元的栅极扫描信号(G(n))；所述第二电容(C2)的一端电性连接于第三节点(P(n))，另一端电性连接于第二恒压电位；
所述第三节点(P(n))为所述下拉模块(400)的开关节点。
3.如权利要求2所述的GOA电路，其特征在于，在第一级和第二级GOA单元中，所述第一薄膜晶体管(T1)的栅极电性连接于电路起始信号(STV)；
在倒数第二级和最后一级GOA单元中，所述第三薄膜晶体管(T3)的栅极电性连接于电路起始信号(STV)。
4.如权利要求1所述的GOA电路，其特征在于，包括四条时钟信号：第一、第二、第三、及第四条时钟信号(CK(1)、CK(2)、CK(3)、CK(4))；当所述第m条时钟信号(CK(m))为第二条时钟信号(CK(2))时，第m+3条时钟信号(CK(m+3))为第一条时钟信号(CK(1))；当所述第m条时钟信号(CK(m))为第三条时钟信号(CK(3))时，第m+2条时钟信号(CK(m+2))为第一条时钟信号(CK(1))，第m+3条时钟信号(CK(m+3))为第二条时钟信号(CK(2))；当所述第m条时钟信号(CK(m))为第四条时钟信号(CK(4))时，第m+1条时钟信号(CK(m+1))为第一条时钟信号(CK(1))，第m+2条时钟信号(CK(m+2))为第二条时钟信号(CK(2))，第m+3条时钟信号(CK(m+3))为第三条时钟信号(CK(3))。
5.如权利要求4所述的GOA电路，其特征在于，所述第一、第二、第三、及第四条时钟信号(CK(1)、CK(2)、CK(3)、CK(4))的脉冲周期相同，前一条时钟信号的下降沿与后一条时钟信号的上升沿同时产生。
6.如权利要求2所述的GOA电路，其特征在于，所述各个薄膜晶体管均为N型薄膜晶体管，所述第一恒压电位为恒压高电位(VGH)，第二恒压电位为恒压低电位(VGL)。
7.如权利要求2所述的GOA电路，其特征在于，所述各个薄膜晶体管均为P型薄膜晶体管，所述第一恒压电位为恒压低电位(VGL)，第二恒压电位为恒压高电位(VGH)。
8.如权利要求2所述的GOA电路，其特征在于，所述各个薄膜晶体管均为低温多晶硅薄膜晶体管。
9.如权利要求6所述的GOA电路，其特征在于，正向扫描时，所述正向扫描控制信号(U2D)为高电位，反向扫描控制信号(D2U)为低电位；
反向扫描时，所述正向扫描控制信号(U2D)为低电位，反向扫描控制信号(D2U)为高电位。
10.如权利要求7所述的GOA电路，其特征在于，正向扫描时，所述正向扫描控制信号(U2D)为低电位，反向扫描控制信号(D2U)为高电位；
反向扫描时，所述正向扫描控制信号(U2D)为高电位，反向扫描控制信号(D2U)为低电位。
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