CN104282279A - 移位寄存器单元、移位寄存器、栅极驱动电路和显示装置 - Google Patents
移位寄存器单元、移位寄存器、栅极驱动电路和显示装置 Download PDFInfo
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Abstract
本发明提供了一种移位寄存器单元及应用其的移位寄存器、栅极驱动电路和显示装置。在移位寄存器单元中在输出节点之前增加了包括两个小沟道宽度MOS管的信号放大模块,从而在相同设计参数状态下,就能实现在大负载条件下,输出能力明显改善的效果。
Description
技术领域
本发明涉及电气电子行业显示驱动电路技术领域,尤其涉及一种移位寄存器单元及应用其的移位寄存器、栅极驱动电路和显示装置。
背景技术
液晶显示器(Liquid Crystal Display,简称LCD)由于具有低功耗、重量轻、厚度薄、无电磁辐射以及无污染等优点,已广泛地应用于包括手机、平板电脑、电视机、显示器、笔记本电脑、照相机、摄像机、数码相框、导航仪等在内的具有显示功能的产品或部件中。
在现有的液晶显示器中,像素阵列可以包括横纵交错的栅极扫描线和数列数据线。其中,为了实现像素阵列的逐行扫描,通常采用栅线驱动电路给像素阵列的栅极扫描线提供扫描信号。
现有技术中,栅极驱动电路常采用GOA(Gate Driver on Array,阵列基板行驱动)设计将TFT(Thin Film Transistor,薄膜场效应晶体管)栅极开关电路集成在显示面板的阵列基板上以形成对显示面板的扫描驱动,这种利用GOA技术集成在阵列基板上的栅极驱动电路也称为GOA电路或移位寄存器电路。
然而,现有技术的移位寄存器单元中,当输出端口Output上负载变大时,其输出能力变差,若在现有结构上进行输出能力的提升,需要将相应的晶体管沟道宽度加大很多,才能提高输出能力,会占用很多设计空间。
发明内容
(一)要解决的技术问题
鉴于上述技术问题,本发明提供了一种在大负载情况下能够保持输出能力大致不变的移位寄存器单元及应用其的移位寄存器、栅极驱动电路和显示装置。
(二)技术方案
本发明提供了一种移位寄存器单元。该移位寄存器单元包括:输入模块,响应于第一时钟信号输入端输入的时钟信号,将输入信号STV提供至第一节点A,其中,该第一节点A为该输入模块的输出节点;上拉模块,响应于输入信号STV,将电源正极电压VGH提供至第三节点C;下拉模块,响应于第三时钟信号输入端输入的时钟信号,将电源负极电压VGL提供至第三节点C,该第三节点C作为上拉模块和下拉模块共同的输出节点;复位模块,响应于第三节点C的输入信号,将电源正极电压VGH提供至第一节点A;第一输出模块,响应于第三节点C的输入信号,将电源正极电压VGH提供至移位寄存器单元的输出节点Output,其中,电源正极电压VGH和第三节点C之间设置第二电容C2;第二输出模块,响应于第一节点A的输入信号,将第二时钟输入端输入的时钟信号提供至第四节点D,其中,第四节点D和第一节点A之间设置第一电容C1;以及信号放大模块,呈反相器结构,设置于第四节点D和移位寄存器单元的输出节点Output之间,用于对第四节点D的信号进行放大后输出。
根据本发明的另一个方面,还提供了一种移位寄存器。该移位寄存器包括:n级的如上所述移位寄存器单元,其中,n≥2;前一级移位寄存器单元的输出端口Output)输出的信号作为后一级移位寄存器单元的输入信号STV)。
根据本发明的又一个方面,再提供了一种栅极驱动电路。该栅极驱动电路包括上述的移位寄存器。
根据本发明的再一个方面,再提供了一种显示装置。该显示装置包括上述的栅极驱动电路。
(三)有益效果
本发明移位寄存器单元及应用其的移位寄存器、栅极驱动电路和显示装置中,仅在原有移位寄存器单元基础上增加两个小沟道宽度的晶体管,在相同设计参数状态下,就能实现在大负载条件下,输出能力明显改善的效果,并且占用的设计空间小,实现成本低。
附图说明
图1为根据本发明第一实施例移位寄存器单元的结构示意图;
图2为图1所示移位寄存器单元中各信号的时序图;
图3为现有移位寄存器单元和图1所示移位寄存器单元输出能力对比的曲线图;
图4为根据本发明实施例移位寄存器中一部分的结构示意图;
图5为图4所示移位寄存器中各信号的时序图。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚明白,以下结合具体实施例,并参照附图,对本发明进一步详细说明。需要说明的是,在附图或说明书描述中,相似或相同的部分都使用相同的图号。附图中未绘示或描述的实现方式,为所属技术领域中普通技术人员所知的形式。另外,虽然本文可提供包含特定值的参数的示范,但应了解,参数无需确切等于相应的值,而是可在可接受的误差容限或设计约束内近似于相应的值。
本发明移位寄存器单元中,仅在原有移位寄存器单元基础上增加两个小沟道宽度的晶体管,在相同设计参数状态下,就能实现在大负载条件下,输出能力明显改善的效果。
一、第一实施例
在本发明的一个示例性实施例中,提供了一种移位寄存器单元。图1为根据本发明实施例移位寄存器单元的结构示意图。如图1所示,本实施例移位寄存器单元包括:
输入模块101,响应于第一时钟信号输入端输入的时钟信号CLK1,将输入信号STV提供至第一节点A,其中,该第一节点A为该输入模块101的输出节点;
上拉模块102,响应于输入信号STV,将电源正极电压VGH提供至第三节点C;
下拉模块103,响应于第三时钟信号输入端输入的时钟信号CLK3,将电源负极电压VGL提供至第三节点C,该第三节点C作为上拉模块102和下拉模块103共同的输出节点;
复位模块104,响应于第三节点C的输入信号,将电源正极电压VGH提供至第一节点A;
第一输出模块105,响应于第三节点C的输入信号,将电源正极电压VGH提供至本实施例移位寄存器单元的输出节点Output,其中,电源正极电压VGH和第三节点C之间设置第二电容C2;
第二输出模块106,响应于第一节点A的输入信号,将第二时钟信号输入端输入的时钟信号CLK2提供至第四节点D,其中,第四节点D和第一节点A之间设置第一电容C1;
信号放大模块107,呈反相器结构,设置于第四节点D和输出节点Output之间,用于对第四节点D的信号进行放大后输出。
以下结合图1对本实施例移位寄存器的各个组成部分分别进行详细说明。
请参照图1,下拉模块101包括:第一P型TFT晶体管M1,其栅极连接至第一时钟信号输入端,其源极连接至输入信号STV的输入端,其漏极连接至第一节点A。
请参照图1,上拉模块102包括:第三P型TFT晶体管M3,其栅极连接至输入信号STV的输入端,其源极连接至电源正极电压VGH,其漏极连接至第三节点C。
请参照图1,下拉节点103包括:第四P型TFT晶体管M4,其栅极连接至第三时钟信号输入端,其漏极连接至电源负极电压VGL的输入端,其源极连接至第三节点C。
请参照图1,复位模块104包括:第二P型TFT晶体管M2,其栅极连接至第三节点C,其源极连接至电源正极电压VGH的输入端,其漏极连接至第一节点A。
请参照图1,第一输出模块105包括:第五P型TFT晶体管M5,其栅极连接至第三节点C,其源极连接至电源正极电压VGH的输入端,其漏极连接至输出节点Output,且该第五P型TFT晶体管M5的栅极和源极之间设置第二电容C2。
请参照图1,第二输出模块106包括:第六P型TFT晶体管M6,其栅极连接至第一节点A,其漏极连接至第二时钟信号CLK2的输入端,其源极连接至第四节点D,且该第六P型TFT晶体管M6的源极和栅极之间设置第一电容C1。
请参照图1,信号放大模块107包括:第七P型TFT晶体管M7,其栅极和漏极均连接至第四节点D;第八P型TFT晶体管M8,其栅极连接至第七P型TFT晶体管M7的源极,其源极连接至第四节点D,其漏极连接至输出节点Output。
由图1可以看出,本实施例移位寄存器在输出端第六P型TFT晶体管M6上增加了一个反相器结构的信号放大模块107,该信号放大模块107在第六P型TFT晶体管M6的输出端增加了一个信号放大功能的第七P型TFT晶体管M7和第八P型TFT晶体管M8,来提高第六P型TFT晶体管M6的输出能力。
尤其需要说明的是,该第七P型TFT晶体管M7和第八P型TFT晶体管M8均为小沟道宽度的晶体管,就能够明显提高第六P型TFT晶体管M6的输出能力。并且,相比于通过增加第五P型晶体管M5和第六P型晶体管M6的沟道宽度来提升第六P型晶体管M6的输出能力,其成本将大大降低。
本领域技术人员应当清楚,上述的小沟道宽度是与移位寄存器连接负载的大小相关联的,因此不能直接就以某个数值作为代表。本发明中采用这种结构可以降低沟道长度,是指在相同负载状态下,相对不采用这种结构的移位寄存器而言,可以降低相应TFT沟道长度,只是个对比结果,其不能是具体数值,特此解释。
本实施例中,所有薄膜晶体管TFT均为P型薄膜晶体管TFT,且所有薄膜晶体管TFT在低电平时导通,高电平时断开。
本实施例信号时序同样参照图2所示,本实施例移位寄存器单元的工作原理如下:
第一阶段(t1):STV和CLK1为低压开启信号,由CLK1控制的第一P型TFT晶体管M1开启,将STV的低压信号传输到第六P型TFT晶体管M6的栅极,并且通过第一电容C1进行保存,同时该信号还将第六P型TFT晶体管M6开启,将此时CLK2的高压信号通过第六P型TFT晶体管M6传输给Output端。由STV控制的第三P型TFT晶体管M3开启,将高压VGH信号输入到第五P型TFT晶体管M5的栅极,并且通过第二电容C2进行保持。
第二阶段(t2):CLK2变成低压开启信号,此时存储在第一电容C1的第六P型TFT晶体管M6栅极电位将第六P型TFT晶体管M6打开,CLK2的低压信号通过第六P型TFT晶体管M6传输给具有信号放大功能的第七P型TFT晶体管M7和第八P型TFT晶体管M8,通过他们来提高CLK2的输出能力,将信号传输到Output。此时第五P型TFT晶体管M5栅极的高压信号通过第二电容C2进行存储,使第五P型TFT晶体管M5保持关闭状态。
第三阶段(t3):CLK3为低压开启信号,使第四P型TFT晶体管M4开启,低压VGL信号通过第四P型TFT晶体管M4传输到第五P型TFT晶体管M5和第二P型TFT晶体管M2的栅极,并且通过第二电容C2进行保持。VGL信号使第二P型TFT晶体管M2开启,将VGH信号通过第二P型TFT晶体管M2传输到第六P型TFT晶体管M6的栅极,使第六P型TFT晶体管M6关断,并且通过第一电容C1进行保存。当第六P型TFT晶体管M6关断后,第七P型TFT晶体管M7和第八P型TFT晶体管M8也关断。VGL信号将第五P型TFT晶体管M5开启,使VGH信号通过第五P型TFT晶体管M5传输到输出节点Output上。
第四阶段(t4):CLK1变成低压信号,而此时STV已为高压信号。STV的高压信号通过第一P型TFT晶体管M1传输到第六P型TFT晶体管M6的栅极,使第六P型TFT晶体管M6关断,并且通过第一电容C1进行保持。此时第五P型TFT晶体管M5的栅极为上阶段保持的VGL信号,因此第五P型TFT晶体管M5依旧开启,将VGH信号传输到输出节点Output上。
第五阶段(t5):CLK2为开启信号,不过此时第六P型TFT晶体管M6栅极上为上桢保持的高压信号,第六P型TFT晶体管M6处于关闭状态。M5栅极还是上桢通过第二电容C2保持的低压信号,VGH信号还是通过第五P型TFT晶体管M5传输到输出节点Output上。
第六阶段(t6)和第三阶段一样。
其余时段的工作就是重复第四阶段到第六阶段的动作,这样输出节点Output就一直输出VGH信号。
图3为本实施例移位寄存器单元与现有移位寄存器单元输出能力对比的曲线图。由图3可知,本实施例移位寄存器单元无论是曲线的下降能力还是上升能力,均比现有移位寄存器单元有大幅提升,并且占用的设计空间小,实现的成本低。
至此,本发明实施例移位寄存器单元介绍完毕。
二、第二实施例
在本发明的第二个示例性实施例中,还提供了另外一种移位寄存器单元。该移位寄存器单元与第一实施例移位寄存器单元的区别在于:该移位寄存器中的晶体管均为N型的TFT晶体管。
本实施例中,只需将如图1所示的移位寄存器单元的各信号高低电位反向,电源正极电压VGH与电源负极电压VGL位置互换即可实现。
三、第三实施例
在本发明的第三个示例性实施例中,还提供了一种级联的移位寄存器。该移位寄存器包括级联的n个如实施例一所述的移位寄存器单元,n≥3。在图4中仅给出该移位寄存器的一部分,即4个移位寄存器单元。
请参照图4,为每一移位寄存器单元提供电源正极电压VGH、电源负极电压VGL,前一级移位寄存器单元的输出端口Output与后一级移位寄存器单元的输入信号STV端连接。
如图5所示,在该移位寄存器中,相邻的三个移位寄存器单元-第i、i+1、i+2级的移位寄存器单元,的时钟信号满足以下关系:
(1)对于第i个移位寄存器单元,其第一时钟信号输入端输入的时钟信号为CLK1,其第二时钟信号输入端输入的时钟信号为CLK2,其第三时钟信号输入端输入的时钟信号为CLK3;
(2)对于第i+1个移位寄存器单元,其第一时钟信号输入端输入的时钟信号为上述CLK2,其第二时钟信号输入端输入的时钟信号为上述CLK3,其第三时钟信号输入端输入的时钟信号为上述CLK1;
(3)对于第i+2个移位寄存器单元,其第一时钟信号输入端输入的时钟信号为上述CLK3,其第二时钟信号输入端输入的时钟信号为上述CLK1,其第三时钟信号输入端输入的时钟信号为CLK2;
本领域技术人员应当清楚,对于第i+3个移位寄存器单元而言,其时钟信号的输入与第i个移位寄存器相同,即第一时钟信号输入端输入的时钟信号为CLK1,其第二时钟信号输入端输入的时钟信号为CLK2,其第三时钟信号输入端输入的时钟信号为CLK3,依次类推。
需要说明的是,上述i为大于等于1的整数,且i+2≤n。
请参照图5,在该移位寄存器中,后一级移位寄存器单元的输出信号时序相比于前一级移位寄存器单元的输出信号时序,高电平信号向后顺延。
本领域技术人员应当清楚,该移位寄存器级联的个数可以根据需要进行设计,其可以为大于等于2的任意级,只要其时钟信号按照上述顺序进行轮换即可。
四、第四实施例
在本发明的第四个示例性实施例中,还提供了一种栅极驱动电路。该栅极驱动电路包括第三实施例所述的移位寄存器。该栅极驱动电路中除该移位寄存器之外的其他部件采用现有技术栅极驱动电路中相应部件即可,此处不再详细描述。
五、第五实施例
在本发明的第五个示例性实施例中,还提供了一种显示装置。该显示装置包括第四实施例的栅极驱动电路。该显示装置除该栅极驱动电路之外的其他部件采用现有技术显示装置中相应部件即可,此处不再详细描述。
至此,已经结合附图对本发明五个实施例进行了详细描述。依据以上描述,本领域技术人员应当对本发明移位寄存器单元及应用其的移位寄存器、栅极驱动电路和显示装置有了清楚的认识。
此外,上述对各元件和方法的定义并不仅限于实施例中提到的各种具体结构、形状或方式,本领域普通技术人员可对其进行简单地更改或替换。
综上所述,本发明的移位寄存器相比于现有移位寄存器增加两个小的晶体管,构成一个反相器结构,就能实现在大负载条件下,输出能力明显改善的效果,其无论是曲线的下降能力还是上升能力,均比现有结构有大幅提升。基于该移位寄存器单元,本发明的移位寄存器、栅极驱动电路和显示装置与现有技术的相应装置在效果上均能得到对应的提升,并且实现成本低,不会增加太大的成本。
以上所述的具体实施例,对本发明的目的、技术方案和有益效果进行了进一步详细说明,所应理解的是,以上所述仅为本发明的具体实施例而已,并不用于限制本发明,凡在本发明的精神和原则之内,所做的任何修改、等同替换、改进等,均应包含在本发明的保护范围之内。
Claims (11)
1.一种移位寄存器单元,其特征在于,包括:
输入模块,响应于第一时钟信号输入端输入的时钟信号,将输入信号(STV)提供至第一节点(A),其中,该第一节点(A)为该输入模块的输出节点;
上拉模块,响应于输入信号(STV),将电源正极电压(VGH)提供至第三节点(C);
下拉模块,响应于第三时钟信号输入端输入的时钟信号,将电源负极电压(VGL)提供至第三节点(C),该第三节点(C)作为所述上拉模块和下拉模块共同的输出节点;
复位模块,响应于所述第三节点(C)的输入信号,将电源正极电压(VGH)提供至第一节点(A);
第一输出模块,响应于所述第三节点(C)的输入信号,将电源正极电压(VGH)提供至所述移位寄存器单元的输出节点(Output),其中,电源正极电压(VGH)和第三节点(C)之间设置第二电容(C2);
第二输出模块,响应于所述第一节点(A)的输入信号,将第二时钟输入端输入的时钟信号提供至第四节点(D),其中,所述第四节点(D)和第一节点(A)之间设置第一电容(C1);以及
信号放大模块,设置于所述第四节点(D)和所述移位寄存器单元的输出节点(Output)之间,用于对所述第四节点(D)的信号进行放大后输出。
2.根据权利要求1所述的移位寄存器单元,其特征在于,所述信号放大模块,呈反相器结构,包括:
第七P型TFT晶体管(M7),其栅极和漏极均连接至所述第四节点(D);
第八P型TFT晶体管(M8),其栅极连接至所述第七P型TFT晶体管(M7)的源极,其源极连接至所述第四节点(D),其漏极连接至所述移位寄存器单元的输出节点(Output)。
3.根据权利要求1所述的移位寄存器单元,其特征在于,所述上拉模块包括:
第三P型TFT晶体管(M3),其栅极连接至输入信号(STV)的输入端,其源极连接至电源正极电压(VGH),其漏极连接至所述第三节点(C)。
4.根据权利要求1所述的移位寄存器单元,其特征在于,所述下拉模块包括:
第四P型TFT晶体管(M4),其栅极连接至第三时钟信号输入端,其漏极连接至电源负极电压(VGL),其源极连接至第三节点(C)。
5.根据权利要求1所述的移位寄存器单元,其特征在于,所述复位模块包括:
第二P型TFT晶体管(M2),其栅极连接至所述第三节点(C),其源极连接至电源正极电压(VGH),其漏极连接至所述第一节点(A)。
6.根据权利要求1所述的移位寄存器单元,其特征在于,所述第一输出模块包括:
第五P型TFT晶体管(M5),其栅极连接至所述第三节点(C),其源极连接至电源正极电压(VGH),其漏极连接至所述移位寄存器单元的输出节点(Output),且该第五P型TFT晶体管(M5)的栅极和源极之间设置第二电容(C2)。
7.根据权利要求1所述的移位寄存器单元,其特征在于,所述第二输出模块包括:
第六P型TFT晶体管(M6),其栅极连接至第一节点(A),其漏极连接至第二时钟信号输入端,其源极连接至所述第四节点(D),且该第六P型TFT晶体管(M6)的源极和栅极之间设置第一电容(C1)。
8.一种移位寄存器,其特征在于,包括n级的如权利要求1至7中任一项所述移位寄存器单元,其中,n≥2;
前一级移位寄存器单元的输出端口(Output)输出的信号作为后一级移位寄存器单元的输入信号(STV)。
9.根据权利要求8所述的移位寄存器,其特征在于,所述n≥3,相邻的第i、i+1、i+2级的移位寄存器单元的时钟信号满足以下关系:
第i级移位寄存器单元的第一时钟信号输入端、第i+1级移位寄存器单元的第三时钟信号输入端、第i+2级移位寄存器单元的第二时钟信号输入端同时输入第一时钟信号(CLK1);
第i级移位寄存器单元的第二时钟信号输入端、第i+1级移位寄存器单元的第一时钟信号输入端、第i+2级移位寄存器单元的第三时钟信号输入端同时输入第二时钟信号(CLK2);
第i级移位寄存器单元的第三时钟信号输入端、第i+1级移位寄存器单元的第二时钟信号输入端、第i+2级移位寄存器单元的第一时钟信号输入端同时输入第三时钟信号(CLK2);
其中,i为大于等于1的整数,且i+2≤n。
10.一种栅极驱动电路,其特征在于,包括权利要求8或9所述的移位寄存器。
11.一种显示装置,其特征在于,包括权利要求10所述的栅极驱动电路。
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