KR980006437A - 박막 트랜지스터 및 그 제조방법 - Google Patents
박막 트랜지스터 및 그 제조방법Info
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Abstract
본 발명은 박막트랜지스터 및 그 제조방법에 관한 것으로, 특히, 엘디디 또는 오프셋 구조의 박막트랜지스터에 있어서, 게이트전극 이외에 별도로 형성된 전극을 이용하여 엘디디영역 또는 오프셋영역을 균일하게 형성하려하는 것이다. 이를 위하여 본 발명은 절연기판 상에 활성층이 형성되고, 상기 활성층내의 양측에 소오스영역과 드레인영역이 형성되고, 상기 활성층의 상기 소오스영역과 상기 드레인영역 사이의 소정의 위치에 채널영역이 형성되고, 상기 활성층에서 상기 채널영역과 상기 소오스영역 사이, 혹은 상기 채널영역과 상기 드레인영역 사이를 임의영역으로 정의하는 박막트랜지스터에 있어서, 상기 임의영역에 형성되되, 상기 소오스영역, 혹은 상기 드레인 영역의 내측에 위치하는 하나이상의 서브채널영역과, 상기 임의영역에 형성되되, 상기 서브채널과 상기 채널영역 사이에 위치하는 하나이상의 제1영역과, 상기 채널영역 상부에 절연막을 개재하여 형성되는 게이트전극과, 상기 서브채널영역 상부에 절연막을 개재하여 형성되는 하나이상의 서브게이트전극을 구비한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 4 도는 본 발명의 박막트랜지스터를 화소 스위치용 소자로 채택한 액정표시장치의 화소의 평면도.
Claims (12)
- 절연기판 상에 활성층이 형성되고, 상기 활성층내의 양측에 소오스영역과 드레인영역이 형성되고, 상기 활성층의 상기 소오스영역과 상기 드레인영역 사이의 소정의 위치에 채널영역이 형성되고, 상기 활성층에서 상기 채널영역과 상기 소오스영역 사이, 혹은 상기 채널영역과 상기 드레인영역 사이를 임의영역으로 정의하는 박막트랜지스터에 있어서, 상기 임의영역에 형성되되, 상기 소오스영역, 혹은 상기 드레인영역의 내측에 위치하는 하나이상의 서브채널영역과, 상기 임의영역에 형성되되, 상기 서브채널과 상기 채널영역 사이에 위치하는 하나이상의 제1영역과, 상기 채널영역 상부에 절연막을 개재하여 형성되는 게이트전극과, 상기 서브채널영역 상부에 절연막을 개재하여 형성되는 하나이상의 서브게이트전극을 구비하는 박막트랜지스터.
- 제1항에 있어서, 상기 게이트전극, 상기 서브게이트전극 및 상기 절연기판의 노출된 표면상에 형성되되, 상기 소오스영역과 상기 드레인영역을 외부와 통하게 하는 콘택홀이 있는 층간절연막과, 상기 층간절연막 상에 상기 층간절연막의 콘택홀을 통하여 상기 소오스영역 및 드레인영역에 연결되어 형성되는 소오스전극 및 드레인전극과, 상기 소오스전극, 상기 드레인전극 및 상기 층간절연막의 노출된 표면상에 형성되되, 상기 드레인전극을 외부에 통하게 하는 콘택홀이 있는 보호막과, 상기 보호막 상에 상기 보호막의 콘택홀을 통하여 상기 드레인전극과 연결되어 형성되는 화소전극을 더 구비하는 것이 특징인 박막트랜지스터.
- 제1항에 있어서, 상기 제1영역은 얼디디영역인 것이 특징인 박막트랜지스터.
- 제1항에 있어서, 상기 제1영역은 오프셋영역인 것이 특징인 박막트랜지스터.
- 제1항에 있어서, 상기 서브게이트전극은 상기 게이트전극과 다른 배선층에 연결된 것이 특징인 박막트랜지스터.
- 제5항에 있어서, 상기 배선층은 화소전극과 스토리지 캐패시터를 이루는 스토리지 캐패시터의 제1전극인 것이 특징인 박막트랜지스터.
- 제1항에 있어서, 상기 서브게이트전극이 상기 게이트전극의 양측에 형성된 것이 특징인 박막트랜지스터.
- 제1항에 있어서, 상기 서브게이트전극이 상기 게이트전극의 일측에만 형성된 것이 특징인 박막트랜지스터.
- 박막트랜지스터의 제조방법에 있어서,1) 절연기판 상에 다결정 실리콘박막을 적층한 후, 패터닝하여 반도체 활성층을 형성하는 단계와,2) 상기 반도체 활성층 및 상기 절연기판의 노출된 표면에 제1절연막과 제1도전층의 순차적으로 증착한후, 패터닝하여 상기 반도체 활성층상에 게이트절연막이 개재된 게이트전극과, 상기 게이트전극 주변의 상기 반도체 활성층상에 게이트 절연막이 개재된 적정수의 서브게이트 전극을 형성하는 단계와,3) 상기 게이트전극과 상기 서브게이트전극의 일부를 덮는 이온주입 마스크를 형성한 후, 상기 이온주입 마스크를 이용하여 상기 반도체 활성층에 고농도의 불순물을 주입함으로써, 상기 반도체 활성층의 양측에 소오스영역 및 드레인영역을 형성하는 단계와,4) 상기 게이트전극 및 상기 서브게이트전극을 마스크로하여 상기 반도체 활성층에 저농도의 불순물을 주입하여 상기 게이트전극과 상기 서브게이트전극 사이의 하부에 위치한 상기 반도체 활성층에 엘디디영역을 형성하는 단계를 포함하여 이루어지는 박막트랜지스터 제조방법.
- 제9항에 있어서, 상기 4)단계의 공정후에,1) 상기 게이트전극, 상기 서브게이트전극 및 상기 반도체 활성층의 노출된 표면에 제2절연막을 적층한 후, 상기 제2절연막을 패터닝하여 상기 반도체 활성층상에 상기 소오스영역 및 드레인영역의 일부만을 노출시키는 콘택홀이 있는 층간절연막을 형성하는 단계와,2) 상기 콘택홀 내부 및 제2절연막의 노출된 표면에 제2도전물질을 적층한 후, 패터닝하여 상기 소오스영역 및 상기 드레인영역과 연결되는 소오스전극 및 드레인전극을 형성하는 단계와,3) 전면에 제3절연막을 형성한 후, 패터닝하여 상기 드레인전극을 일부노출시키는 콘택홀이 있는 보호막을 형성하는 단계와,4) 상기 보호막 상에 투명도전물질을 적층한 후, 패터닝하여 상기 드레인전극에 연결되는 화소전극을 형성하는 단계를 더 포함하여 이루어지는 것을 특징인 박막트랜지스터 제조방법.
- 제9항에 있어서, 상기 3)단계의 공정은 생략하여 엘디디영역을 오프셋영역으로 형성하는 것을 특징으로 하는 박막트랜지스터 제조방법.
- 제9항에 있어서, 상기 3)단계와 상기 4)단계를 역순으로 공정을 진행한 후, 상기 5)단계를 진행하는 것을 특징으로 하는 박막트랜지스터 제조방법.
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