KR970072491A - 박막트랜지스터 및 그 제조방법 - Google Patents

박막트랜지스터 및 그 제조방법 Download PDF

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Abstract

본 발명은 박막트랜지스터 및 그 제조 방법에 관한 것으로, 다결정 실리콘 트랜지스터의 누설전류를 감소시키면서 온 전류 감소의 문제 및 소자의 안정성을 향상시킨다. 또한 박막트랜지스터의 소오스 및 드레인 영역과 채널 사이에 오프셋 영역을 두고 절연막을 두고, 소오스 전극 및 드레인 전극과 같은 물질로 같은 층에 게이트 전극과 콘택하여 오프셋 영역을 덮는 별도의 전극의 형성한 구조를 특징으로 한다.

Description

박막트랜지스터 및 그 제조방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제5도는 본 발명의 일 실시예인 박막트랜지스터의 레이아웃, 제6도는 본 발명의 다른 실시예인 박막트랜지스터의 레이아웃, 제7도는 제5도의 구조를 가지는 본 발명의 박막트랜지스터의 제조방법의 공정단면도.

Claims (13)

  1. 기판 상에 하나 이상의 불순물 영역을 가지며 도상으로 형성된 반도체 층과, 상기 반도체층의 일부영역과 제1절연층을 사이에 두고 중첩되게 형성된 적어도 하나 이상이 제1전극과, 상기 반도체층의 불순물 영역과 연결된 하나 이상의 제2전극을 포함하여 이루어지며, 상기 불순물 영역과 상기 반도체층의 일부영역 사이에 적어도 하나 이상의 불순물이 도핑되지 않은 영역을 가지는 박막트랜지스터에 있어서, 상기 제1전극의 상부에 절연되어 형성되되, 적어도 하나 이상의 콘택홀을 통하여 상기 제1전극과 연결되며, 상기 제2전극과 절연된 제3전극을 부가 형성한 것이 특징인 박막트랜지스터.
  2. 제1항에 있어서, 상기 박막트랜지스터는 기판 상에 채널영역과, 복수개의 불순물 영역과, 상기 채널 영역과 상기 불순물 영역 사이에 불순물이 도핑되지 않은 영역을 가지는 도상의 반도체층과, 상기 반도체층과 상기 기판 위에 형성된 제1절연층과, 상기 반도체층의 채널 영역에 중첩되도록, 상기 제1절연층 위에 형성된 제1전극과, 상기 제1전극과 상기 제1절연층 위에 형성된 제2절연층과, 상기 제1절연층과 상기 제2절연층에 거쳐 형성된 하나 이상의 콘택홀을 통하여 상기 반도체층의 복수개의 불순물 영역에 연결되는 복수개의 제2전극과,상기 제2절연층에 형성된 하나 이상의 콘택홀을 통하여 상기 제1전극과 연결된 제3전극을 포함하여 이루어진 박막트랜지스터.
  3. 제2항에 있어서, 상기 제3전극이 상기 제2전극과 동일물질로 동일층에 형성된 것을 특징으로 하는 박막트랜지스터.
  4. 제2항에 있어서, 상기 제3전극이 상기 불순물이 도핑되지 않은 영역을 덮도록 형성된 것을 특징으로 하는 박막트랜지스터.
  5. 제1항에 있어서, 상기 박막트랜지스터는 기판 상에 형성되어 복수개의 채널영역과, 상기 채널영역의 양쪽에 형성된 복수개의 불순물영역과, 상기 채널영역과 상기 불순물 영역 사이에 적어도 하나 이상의 불순물이 도핑되지 않은 영역을 가지는 도상의 반도체층과, 상기반도체층과 상기 기판 위에 형성된 제1절연층과, 상기 반도체층의 일부영역과 중첩되고, 상기 반도체층과 중첩되지 않는 영역에서 서로 연결되도록 상기 제1절연층 위에 형성된 적어도 하나 이상의 제1전극과, 상기 제1전극과 상기 제1절연층 위에 형성된 제2절연층과, 상기 불순물 영역에 대응하여 연결된 적어도 하나 이상이 제2전극과, 상기 제2절연층에 형성된 하나 이상의 콘택홀을 통하여 상기 제1전극과 연결된 제3전극을 포함하여 이루어진 박막트랜지스터.
  6. 제5항에 있어서, 상기 제3전극이 상기 제2전극과 동일물질로 동일층에 형성된 것을 특징으로 하는 박막트랜지스터.
  7. 제5항에 있어서, 상기 제3전극이 상기 불순물이 도핑되지 않은 영역을 덮도록 형성된 것을 특징으로 하는 박막트랜지스터.
  8. 박막트랜지스터 제조 방법에 있어서, 1) 기판 상에 도상 패턴의 반도체층을 형성하는 단계와, 2) 상기 기판과 상기 반도체층의 노출된 표면에 제1절연막을 적층하는 단계와, 3) 상기 반도체층 일부영역에 중첩되도록 제1절연막 표면에 도전물질로 제1전극을 형성하는 단계와, 4)상기 제1전극의 노출된 표면에 이온 도핑 차폐막을 형성하고, 상기 이온 도핑 차폐막을 마스크로 이온 도핑 또는 이온 주입하여 상기 반도체층에 불순물 영역 및 불순물이 도핑되지 않은 영역을 정의하는 단계와, 5) 상기 이온 도핑 차폐막을 제거하고, 상기 제1전극 및 제1절연막의 노출된 표면에 제2절연막을 형성하는 단계와, 6)상기 불순물 영역 상부의 제2절연막 및 제1절연막에 제1콘택홀을 형성하고, 동시에 상기 제1전극의 상부의 제2절연막에 제2콘택홀을 형성하는 단계와, 7) 상기 제1콘택홀을 통하여 불순물 영역과 연결되는 제2전극을 형성하고, 동시에 상기 제2콘택홀을 통하여 상기 제1전극과 연결되는 제3전극을 형성하는 단계를 포함하는 박막트랜지스터 제조 방법.
  9. 제8항에 있어서, 4)단계에서 상기 이온 도핑 차폐막은 절연막 또는 포토 레지스트를 적층 후, 패터닝하여 형성하는 것을 특징으로 하는 박막트랜지스터 제조방법.
  10. 제8항에 있어서, 7)단계에서, 상기 제3전극을 형성할 때, 상기 반도체층의 불순물이 도핑되지 않은 영역을 전부 덮도록 형성하는 것을 특징으로 하는 박막트랜지스터 제조방법.
  11. 박막트랜지스터 제조 방법에 있어서, 1) 기판 상에 도상 패턴의 반도체층을 형성하는 단계와, 2) 상기 기판과 상기 반도체층의 노출된 표면에 제1절연막을 적층하는 단계와, 3) 상기 반도체층 일부영역에 중첩되고, 상기 반도체층과 중첩되지 않는 영역에서 서로 연결되도록 제1절연막 표면에 도전물질로 적어도 하나 이상의 제1전극을 형성하는 단계와, 4) 상기 이웃하는 두 제1전극 사이의 일부 제1절연막이 노출되도록 이온도핑 차폐막을 형성하고, 상기 이온 도핑 차폐막을 마스크로 이온 도핑 또는 이온 주입하여 상기 반도체층에 불순물 영역 및 불순물이 도핑되지 않은 영역을 정의하는 단계와, 5) 상기 이온 도핑 차폐막을 제거하고, 상기 제1전극 및 제1절연막의 노출된 표면에 제2절연막을 형성하는 단계와, 6) 상기 불순물 영역 상부의 제2절연막 및 제1절연막에 제1콘택홀을 형성하고, 동시에 상기 제1전극 상부의 제2절연막에 제2콘택홀을 형성하는 단계와, 7) 상기 제1콘택홀을 통하여 상기 불순물 영역과 연결되는 적어도 하나 이상의 제2전극을 형성하고, 동시에 상기 제2콘택홀을 통하여 상기 제1전극과 연결되는 제3전극을 형성하는 단계를 포함하는 박막트랜지스터 제조방법.
  12. 제11항에 있어서, 4)단계에서 상기 이온 도핑 차폐막은 절연막 또는 포토 레지스트를 적층후, 패터닝하여 형성하는 것을 특징으로 하는 박막트랜지스터 제조방법.
  13. 제11항에 있어서, 7)단계에서, 상기 제3전극을 형성할 때, 상기반도체층의 불순물이 도핑되지 않은 영역을 전부 덮도록 형성하는 것을 특징으로 하는 박막트랜지스터 제조방법.
    ※참고사항: 최초출원 내용에 의하여 공개하는 것임.
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US8409887B2 (en) 2009-03-03 2013-04-02 Samsung Display Co., Ltd. Organic light emitting diode display device and method of fabricating the same
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