KR900002457A - 출력버퍼회로 - Google Patents

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KR900002457A
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시게루 구마가이
히로시 이와하시
히로토 나카이
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아오이 죠이치
가부시키가이샤 도시바
다케다이 마사다카
도시바 마이크로 일렉트로닉스 가부시키가이샤
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Abstract

내용 없음.

Description

출력버퍼회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 출력버퍼회로의 구성을 나타낸 회로도,
제2도는 MOS트랜지스터에서 게이트전압과 di/dt의 관계를 나타낸 특성도,
제4도는 상기 실시예회로 및 종래회로에서 각 노드의 전압변화를 나타낸 특성도,

Claims (6)

  1. 소오스와 드레인중 한쪽이 전원(VSS)에 접속되고 다른쪽이 신호출력노드(26)에 접속되어 내부데이터를 외부로 출력시키기 위한 제1MOS트랜지스터(25)와, 소오스와 드레인중 한쪽이 저항성소자(28)를 통해 상기 제1MOS트랜지스터(25)의 게이트에 결합된 제2MOS트랜지스터(23) 및, 이 제2MOS트랜지스터(23)를 도통시킴으로써 상기 제1MOS트랜지스터(25)를 도통시켜 내부데이터를 외부로 출력시키는 제어수단 (20)을 구비하여 구성된 것을 특징으로 하는 출력버퍼회로.
  2. 제1항에 있어서, 상기 제1 및 제2MOS트랜지스터(25,23)는 챈널형태가 서로 다른 MOS트랜지스터로 구성된 것을 특징으로 하는 출력버퍼회로.
  3. 소오스와 드레인중 한쪽이 제1전원(VDD)에 접속되고 다른쪽이 출력노드(26)에 접속된 한쪽 챈널의 제1MOS트랜지스터(18)와, 소오스와 드레인중 한쪽이 제2전원(VSS)에 접속되고 다른쪽이 상기 신호출력노드(26)에 접속된 챈널의 제2MOS트랜지스터(25), 소오스와 드레인중 한쪽이 제1전원(VDD)에 접속되고 다른쪽이 상기 제1MOS트랜지스터(18)의 게이트에 접속된 한쪽 챈널의 제3MOS트랜지스터(16), 소오스와 드레인중 한쪽이 제2전원(VSS)에 접속되고 다른쪽이 상기 제1MOS트랜 지스터(18)의 게이트에 접속되며 게이트가 상기 제3MOS트랜지스터(16)와 공통으로 접속된 다른쪽 챈널의 제4MOS트랜지스터(17), 소오스와 드레인중 한쪽이 제1전원(VDD)에 접속된 한쪽 챈널의 제5MOS트랜지스터(23), 일단이 상기 제5MOS트랜지스터(23)의 소오스와 드레인중 다른쪽에 접속되고 타단이 상기 제2MOS트랜지 스터(25)의 게이트에 접속된 저항성소자 및, 소오스와 드레인중 한쪽이 제2전원(VSS)에 접속되고 다른쪽이 상기 제2MOS트랜지스터(25)의 게이트에 접속되며 게이트가 상기 제5MOS트랜지스터(23)와 공통으로 접속된 다른쪽 챈널의 제6MOS트랜지스터(24)를 구비하여 구성된 한 것을 특징으로 하는 출력버퍼회로.
  4. 제3항에 있어서, 상기 저항성소자가 MOS트랜지스터(41)로 구성된 것을 특징으로 하는 출력버퍼회로.
  5. 제3항에 있어서, 상기 저항성소자가 소오스와 드레인이 병렬로 접속되는 2개이상의 MOS트랜지스터(41,42)로 구성된 것을 특징으로 하는 출력버퍼회로.
  6. 제3항에 있어서, 상기 제4MOS트랜지스터(17)의 소오스와 드레인중 다른쪽과 상기 제1MOS트랜지스터(18)의 게이트간에 저항성소자가 접속되어 구성된 것을 특징으로 하는 출력버퍼회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019890009838A 1988-07-11 1989-07-11 출력버퍼회로 KR920010984B1 (ko)

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