KR100722934B1 - 반도체소자의 퓨즈박스 및 퓨즈 커팅 방법 - Google Patents
반도체소자의 퓨즈박스 및 퓨즈 커팅 방법 Download PDFInfo
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Abstract
Description
Claims (21)
- 기판상에 형성된 제1 배선 및 제2 배선;상기 기판상에 형성된 적어도 하나의 연결 패턴; 그리고,상기 제1 배선 및 제2 배선에 연결된 퓨즈 라인을 포함하되,상기 퓨즈 라인은 서로 떨어져 위치하며 상기 적어도 하나의 연결 패턴에 연결되고 서로 전기적으로 연결된 복수의 서브 퓨즈 라인들을 포함하는 퓨즈 박스.
- 청구항 1에 있어서,상기 기판상에 형성된 하부 층간절연막; 그리고상기 하부 층간절연막을 관통하여 상기 배선들과 상기 서브 퓨즈 라인들을 전기적으로 연결하고, 상기 연결 패턴과 상기 서브 퓨즈라인들을 전기적으로 연결하는 복수의 도전체들을 더 포함하는 퓨즈 박스.
- 청구항 2에 있어서,상기 하부 층간절연막 상에 형성된 상부 층간절연막; 그리고,상기 상부 층간절연막 상에 형성되며 상기 상부 층간절연막을 노출하는 적어도 하나의 퓨즈창을 구비하는 패시베이션막을 더 포함하는 퓨즈 박스.
- 청구항 3에 있어서,상기 서브 퓨즈 라인들은 동일한 퓨즈창 내에 위치하는 퓨즈 박스.
- 청구항 3에 있어서,상기 서브 퓨즈 라인들은 서로 다른 퓨즈창 내에 위치하는 퓨즈 박스.
- 청구항 3에 있어서,상기 적어도 하나의 퓨즈창은 제1 퓨즈창을 포함하고, 상기 퓨즈 라인은 제1 퓨즈 라인을 포함하며,상기 제1 퓨즈창의 폭은 상기 제1 퓨즈라인의 길이보다 큰 퓨즈 박스.
- 기판의 제1 층간절연막 상에 형성된 제1 배선, 제2 배선 그리고 적어도 하나의 연결 패턴;상기 제1 층간절연막, 상기 배선들, 그리고 연결 패턴 상에 형성된 제2 층간절연막;상기 제2 층간절연막 상에 형성되며 서로 떨어진 복수의 서브 퓨즈라인들을 구비하는 퓨즈 라인; 그리고,상기 제2 층간절연막을 관통하여 상기 서브 퓨즈 라인들을 상기 배선들 및 연결 패턴에 전기적으로 연결하는 복수의 도전체들을 포함하는 퓨즈 박스.
- 청구항 7에 있어서,상기 제2 층간절연막 및 상기 퓨즈 라인 상에 형성된 제3 층간절연막; 그리고,상기 제3 층간절연막 상에 형성되며 상기 제2 층간절연막을 노출하는 적어도 하나의 퓨즈창을 구비하는 패시베이션막을 더 포함하는 퓨즈 박스.
- 청구항 8에 있어서,상기 서브 퓨즈 라인들은 동일한 퓨즈창 내에 위치하는 퓨즈 박스.
- 청구항 8에 있어서,상기 서브 퓨즈 라인들은 서로 다른 퓨즈창 내에 위치하는 퓨즈 박스.
- 청구항 8에 있어서,상기 적어도 하나의 퓨즈창은 제1 퓨즈창을 포함하고, 상기 퓨즈 라인은 제1 퓨즈 라인을 포함하며,상기 제1 퓨즈창의 폭은 상기 제1 퓨즈라인의 길이보다 큰 퓨즈 박스.
- 청구항 8에 있어서,인접한 퓨즈 라인들은 동일한 퓨즈창 내에 위치하는 퓨즈 박스.
- 청구항 8에 있어서,인접한 퓨즈 라인들은 서로 다른 퓨즈창들 내에 위치하되, 상기 서로 다른 퓨즈창들은 대각선 방향으로 배치된 퓨즈 박스.
- 기판상에 제1 배선 및 제2 배선을 형성하고;기판상에 적어도 하나의 연결 패턴을 형성하고;서로 떨어져 위치하며 상기 적어도 하나의 연결 패턴에 연결되고 서로 전기적으로 연결된 복수의 서브 퓨즈 라인들을 포함하되, 상기 제1 배선 및 제2 배선에 연결된 퓨즈 라인을 형성하고; 그리고,상기 퓨즈 라인의 복수 개의 서브 퓨즈 라인들을 커팅하는 것을 포함하는 퓨즈 커팅 방법.
- 청구항 14에 있어서,상기 서브 퓨즈 라인들을 커팅하는 것은 상기 퓨즈 라인 상에 패시베이션막을 형성하고;상기 패시베이션막을 패터닝하여 상기 서브 퓨즈 라인들을 노출하는 적어도 하나의 퓨즈창을 형성하고; 그리고,상기 퓨즈창을 통해 레이저빔을 조사하는 것을 포함하는 퓨즈 커팅 방법.
- 청구항 14에 있어서,상기 서브 퓨즈 라인들을 커팅하는 것은 하나의 서브 퓨즈 라인을 커팅하는 것을 포함하는 퓨즈 커팅 방법.
- 청구항 14에 있어서,상기 커팅이 진행된 서브 퓨즈 라인이 완전히 커팅되지 않을 경우, 인접한 다른 서브 퓨즈 라인을 커팅하는 것을 포함하는 퓨즈 커팅 방법.
- 청구항 14에 있어서,상기 서브 퓨즈 라인들을 커팅하는 것은 인접한 복수 개의 서브 퓨즈 라인들을 동시에 커팅하는 것을 포함하는 퓨즈 커팅 방법.
- 청구항 14에 있어서,상기 퓨즈 라인은 인접하는 제1 퓨즈 라인과 제2 퓨즈 라인을 포함하는 복수 개로 형성되고,상기 제1 퓨즈 라인 및 상기 제2 퓨즈 라인이 모두 커팅될 경우, 상기 서브 퓨즈 라인들을 커팅하는 것은: 상기 제1 퓨즈 라인의 서브 퓨즈 라인을 커팅하고,상기 제2 퓨즈 라인의 서브 퓨즈 라인을 커팅하되, 상기 커팅되는 제2 퓨즈 라인의 서브 퓨즈 라인은 상기 커팅되는 제1 퓨즈 라인의 서브 퓨즈 라인에 대해서 대각선 방향에 위치하는 퓨즈 커팅 방법.
- 청구항 15에 있어서,상기 퓨즈 라인은 인접하는 제1 퓨즈 라인과 제2 퓨즈 라인을 포함하는 복수 개로 형성되고,상기 적어도 하나의 퓨즈창을 형성하는 것은: 상기 제1 퓨즈 라인의 서브 퓨즈 라인 상에 제1 퓨즈창을 형성하고; 그리고,상기 제2 퓨즈 라인의 서브 퓨즈 라인 상에 제2 퓨즈창을 형성하는 것을 포함하되,상기 커팅되는 제2 퓨즈 라인의 서브 퓨즈 라인은 상기 커팅되는 제1 퓨즈 라인의 서브 퓨즈 라인에 대해서 대각선 방향에 위치하는 퓨즈 커팅 방법.
- 기판상에 서로 인접한 제1 퓨즈 라인 및 제2 퓨즈 라인을 포함하는 다수의 퓨즈 라인들을 형성하고; 그리고,상기 제1 퓨즈 라인 및 제2 퓨즈 라인을 커팅하는 것을 포함하되,상기 제1 퓨즈 라인이 커팅되는 부분과 상기 제2 퓨즈 라인이 커팅되는 부분은 대각선 방향이 되도록 상기 제1 퓨즈 라인 및 제2 퓨즈 라인을 커팅하는 퓨즈 커팅 방법.
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020050110734A KR100722934B1 (ko) | 2005-11-18 | 2005-11-18 | 반도체소자의 퓨즈박스 및 퓨즈 커팅 방법 |
US11/559,759 US7576408B2 (en) | 2005-11-18 | 2006-11-14 | Fuse box, method of forming a fuse box, and fuse cutting method |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020050110734A KR100722934B1 (ko) | 2005-11-18 | 2005-11-18 | 반도체소자의 퓨즈박스 및 퓨즈 커팅 방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20070052927A KR20070052927A (ko) | 2007-05-23 |
KR100722934B1 true KR100722934B1 (ko) | 2007-05-30 |
Family
ID=38053296
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020050110734A KR100722934B1 (ko) | 2005-11-18 | 2005-11-18 | 반도체소자의 퓨즈박스 및 퓨즈 커팅 방법 |
Country Status (2)
Country | Link |
---|---|
US (1) | US7576408B2 (ko) |
KR (1) | KR100722934B1 (ko) |
Families Citing this family (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
TW200905824A (en) * | 2007-07-19 | 2009-02-01 | Advanced Semiconductor Eng | Method of cutting signal wire reserved on circuit board and circuit layout thereof |
KR20100056160A (ko) * | 2008-11-19 | 2010-05-27 | 삼성전자주식회사 | 반도체 장치 및 그 제조 방법 |
US8055958B2 (en) * | 2008-12-11 | 2011-11-08 | Samsung Electronics Co., Ltd. | Replacement data storage circuit storing address of defective memory cell |
KR101119805B1 (ko) * | 2009-06-30 | 2012-03-21 | 주식회사 하이닉스반도체 | 퓨즈 형성 방법 및 그에 따른 퓨즈 구조 |
KR101048794B1 (ko) * | 2009-07-03 | 2011-07-15 | 주식회사 하이닉스반도체 | 반도체 장치의 퓨즈부 |
KR101083640B1 (ko) * | 2009-07-31 | 2011-11-16 | 주식회사 하이닉스반도체 | 반도체 장치의 퓨즈부 및 그 제조방법 |
KR101048821B1 (ko) * | 2009-07-31 | 2011-07-12 | 주식회사 하이닉스반도체 | 반도체 장치의 퓨즈부 |
KR101051178B1 (ko) * | 2009-11-11 | 2011-07-21 | 주식회사 하이닉스반도체 | 반도체 소자의 퓨즈 및 그의 형성 방법 |
US20120286390A1 (en) * | 2011-05-11 | 2012-11-15 | Kuei-Sheng Wu | Electrical fuse structure and method for fabricating the same |
KR20140007191A (ko) * | 2012-07-09 | 2014-01-17 | 에스케이하이닉스 주식회사 | 반도체 소자의 퓨즈 및 그 형성 방법 |
US9240376B2 (en) * | 2013-08-16 | 2016-01-19 | Globalfoundries Inc. | Self-aligned via fuse |
JP2016213293A (ja) * | 2015-05-01 | 2016-12-15 | エスアイアイ・セミコンダクタ株式会社 | 半導体集積回路装置 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20050003034A (ko) * | 2003-06-30 | 2005-01-10 | 주식회사 하이닉스반도체 | 반도체 메모리 장치 및 그 제조방법 |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
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KR100317533B1 (ko) * | 1999-11-10 | 2001-12-24 | 윤종용 | 반도체 집적회로 장치에서의 레이저 퓨즈박스의 구조 및그에 따른 제조 방법 |
KR100605599B1 (ko) | 2001-12-31 | 2006-07-28 | 주식회사 하이닉스반도체 | 반도체 장치 및 그 제조방법 |
KR100513304B1 (ko) | 2002-12-10 | 2005-09-07 | 삼성전자주식회사 | 반도체 기억장치의 퓨즈 박스및 그 제조방법 |
JP2004303991A (ja) | 2003-03-31 | 2004-10-28 | Seiko Epson Corp | 半導体装置及びその製造方法 |
US7662674B2 (en) * | 2005-05-20 | 2010-02-16 | Intel Corporation | Methods of forming electromigration and thermal gradient based fuse structures |
-
2005
- 2005-11-18 KR KR1020050110734A patent/KR100722934B1/ko active IP Right Grant
-
2006
- 2006-11-14 US US11/559,759 patent/US7576408B2/en active Active
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20050003034A (ko) * | 2003-06-30 | 2005-01-10 | 주식회사 하이닉스반도체 | 반도체 메모리 장치 및 그 제조방법 |
Also Published As
Publication number | Publication date |
---|---|
US7576408B2 (en) | 2009-08-18 |
KR20070052927A (ko) | 2007-05-23 |
US20070115745A1 (en) | 2007-05-24 |
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FPAY | Annual fee payment |
Payment date: 20160429 Year of fee payment: 10 |
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FPAY | Annual fee payment |
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FPAY | Annual fee payment |
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