KR100344912B1 - 반도체소자의기판장착구조및그장착방법 - Google Patents
반도체소자의기판장착구조및그장착방법Info
- Publication number
- KR100344912B1 KR100344912B1 KR1019970032615A KR19970032615A KR100344912B1 KR 100344912 B1 KR100344912 B1 KR 100344912B1 KR 1019970032615 A KR1019970032615 A KR 1019970032615A KR 19970032615 A KR19970032615 A KR 19970032615A KR 100344912 B1 KR100344912 B1 KR 100344912B1
- Authority
- KR
- South Korea
- Prior art keywords
- substrate
- mounting
- resin film
- bump
- conductor pattern
- Prior art date
Links
- 239000000758 substrate Substances 0.000 title claims abstract description 76
- 239000004065 semiconductor Substances 0.000 title claims abstract description 59
- 238000000034 method Methods 0.000 title claims description 26
- 239000011347 resin Substances 0.000 claims abstract description 35
- 229920005989 resin Polymers 0.000 claims abstract description 35
- 238000010438 heat treatment Methods 0.000 claims abstract description 15
- 238000003825 pressing Methods 0.000 claims abstract description 8
- 239000011248 coating agent Substances 0.000 claims abstract description 3
- 238000000576 coating method Methods 0.000 claims abstract description 3
- 238000007689 inspection Methods 0.000 claims description 11
- 229910052737 gold Inorganic materials 0.000 claims description 9
- 239000010931 gold Substances 0.000 claims description 9
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 claims description 8
- 239000002313 adhesive film Substances 0.000 claims description 2
- 230000004907 flux Effects 0.000 claims 1
- 239000000956 alloy Substances 0.000 abstract description 26
- 229910045601 alloy Inorganic materials 0.000 abstract description 26
- 239000004020 conductor Substances 0.000 description 29
- 239000010410 layer Substances 0.000 description 20
- 230000002950 deficient Effects 0.000 description 12
- 229910052718 tin Inorganic materials 0.000 description 10
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 9
- 239000000463 material Substances 0.000 description 8
- 239000002245 particle Substances 0.000 description 8
- 238000007747 plating Methods 0.000 description 8
- 239000000047 product Substances 0.000 description 4
- 239000000919 ceramic Substances 0.000 description 3
- 238000004132 cross linking Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 239000002699 waste material Substances 0.000 description 3
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 2
- 239000004593 Epoxy Substances 0.000 description 2
- MCMNRKCIXSYSNV-UHFFFAOYSA-N Zirconium dioxide Chemical compound O=[Zr]=O MCMNRKCIXSYSNV-UHFFFAOYSA-N 0.000 description 2
- 238000005275 alloying Methods 0.000 description 2
- 229910052802 copper Inorganic materials 0.000 description 2
- 239000010949 copper Substances 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 2
- 239000004642 Polyimide Substances 0.000 description 1
- 229910052581 Si3N4 Inorganic materials 0.000 description 1
- 239000012790 adhesive layer Substances 0.000 description 1
- PNEYBMLMFCGWSK-UHFFFAOYSA-N aluminium oxide Inorganic materials [O-2].[O-2].[O-2].[Al+3].[Al+3] PNEYBMLMFCGWSK-UHFFFAOYSA-N 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000003822 epoxy resin Substances 0.000 description 1
- 239000000945 filler Substances 0.000 description 1
- 239000012467 final product Substances 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 239000011810 insulating material Substances 0.000 description 1
- 239000012212 insulator Substances 0.000 description 1
- 239000007788 liquid Substances 0.000 description 1
- 239000011368 organic material Substances 0.000 description 1
- 239000005011 phenolic resin Substances 0.000 description 1
- 229920000647 polyepoxide Polymers 0.000 description 1
- 229920000728 polyester Polymers 0.000 description 1
- 239000004645 polyester resin Substances 0.000 description 1
- 229920001225 polyester resin Polymers 0.000 description 1
- 229920001721 polyimide Polymers 0.000 description 1
- -1 polytetrafluoroethylene Polymers 0.000 description 1
- 239000004810 polytetrafluoroethylene Substances 0.000 description 1
- 229920001343 polytetrafluoroethylene Polymers 0.000 description 1
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 description 1
- 229910010271 silicon carbide Inorganic materials 0.000 description 1
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 1
- 229910000679 solder Inorganic materials 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
- H01L21/56—Encapsulations, e.g. encapsulation layers, coatings
- H01L21/563—Encapsulation of active face of flip-chip device, e.g. underfilling or underencapsulation of flip-chip, encapsulation preform on chip or mounting substrate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L24/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/13144—Gold [Au] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
- H01L2224/29001—Core members of the layer connector
- H01L2224/29099—Material
- H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/29101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
- H01L2224/29111—Tin [Sn] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
- H01L2224/29001—Core members of the layer connector
- H01L2224/29099—Material
- H01L2224/2919—Material with a principal constituent of the material being a polymer, e.g. polyester, phenolic based polymer, epoxy
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
- H01L2224/73203—Bump and layer connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
- H01L2224/73203—Bump and layer connectors
- H01L2224/73204—Bump and layer connectors the bump connector being embedded into the layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
- H01L2224/818—Bonding techniques
- H01L2224/81801—Soldering or alloying
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/831—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector the layer connector being supplied to the parts to be connected in the bonding apparatus
- H01L2224/83101—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector the layer connector being supplied to the parts to be connected in the bonding apparatus as prepeg comprising a layer connector, e.g. provided in an insulating plate member
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/831—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector the layer connector being supplied to the parts to be connected in the bonding apparatus
- H01L2224/83102—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector the layer connector being supplied to the parts to be connected in the bonding apparatus using surface energy, e.g. capillary forces
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/8319—Arrangement of the layer connectors prior to mounting
- H01L2224/83192—Arrangement of the layer connectors prior to mounting wherein the layer connectors are disposed only on another item or body to be connected to the semiconductor or solid-state body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/91—Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
- H01L2224/92—Specific sequence of method steps
- H01L2224/921—Connecting a surface with connectors of different types
- H01L2224/9212—Sequential connecting processes
- H01L2224/92122—Sequential connecting processes the first connecting process involving a bump connector
- H01L2224/92125—Sequential connecting processes the first connecting process involving a bump connector the second connecting process involving a layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01004—Beryllium [Be]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01005—Boron [B]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01006—Carbon [C]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01013—Aluminum [Al]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01029—Copper [Cu]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01033—Arsenic [As]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/0104—Zirconium [Zr]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/0105—Tin [Sn]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01075—Rhenium [Re]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01078—Platinum [Pt]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01079—Gold [Au]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/0132—Binary Alloys
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/014—Solder alloys
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/14—Integrated circuits
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/156—Material
- H01L2924/1579—Material with a principal constituent of the material being a polymer, e.g. polyester, phenolic based polymer, epoxy
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10T—TECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
- Y10T29/00—Metal working
- Y10T29/49—Method of mechanical manufacture
- Y10T29/49002—Electrical device making
- Y10T29/49117—Conductor or circuit manufacturing
- Y10T29/49124—On flat or curved insulated base, e.g., printed circuit, etc.
- Y10T29/4913—Assembling to base an electrical component, e.g., capacitor, etc.
- Y10T29/49144—Assembling to base an electrical component, e.g., capacitor, etc. by metal fusion
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10T—TECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
- Y10T29/00—Metal working
- Y10T29/49—Method of mechanical manufacture
- Y10T29/49002—Electrical device making
- Y10T29/49117—Conductor or circuit manufacturing
- Y10T29/49124—On flat or curved insulated base, e.g., printed circuit, etc.
- Y10T29/4913—Assembling to base an electrical component, e.g., capacitor, etc.
- Y10T29/49146—Assembling to base an electrical component, e.g., capacitor, etc. with encapsulating, e.g., potting, etc.
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Wire Bonding (AREA)
- Electric Connection Of Electric Components To Printed Circuits (AREA)
Abstract
도전부와 함께 기판상에 수지 필름을 피복시키는 제 1 단계; 범프가 상기 수지 필름을 관통하여 상기 도전부와 접촉하도록 가압 및 가역하는 제 2 단계; 및 상기 반도체 소자 및 기판 사이에 상기 범프와 도전부가 합금화되도록 가압 및 가열하는 제 3 단계에 의해 형성되는 반도체 소자/기판의 장착구조가 개시된다.
Description
본 발명은 반도체 소자를 기판상에 장착하는 구조 및 방법에 관한 것으로, 특히 범프를 갖는 반도체 소자(칩)를 플렉시블 기판등의 도전부에 대해 장착하는, 반도체 소자의 기판상의 장착 구조 및 방법에 관한 것이다.
도 1A-1D는 종래 기술을 도시한다. 도 1A-1D는 종래예의 반도체 소자의 장착 방법을 나타낸 공정도이다.
도 1A에 도시된 경우를 참조하면, 도전부로써 도전체 패턴(100)이 형성된 플렉시블 기판(101)에 대해 금으로 된 범프(102)를 갖는 반도체칩(103)이 장착된다. 도전체 패턴(100)의 표면은 주석으로 도금된다. 범프의 수는 반도체칩이 IC인 경우, 그의 단자수에 대응하게 됨으로써, 상기 칩은 일반적으로 수십개 내지 수백개 정도의 범프를 갖는다.
먼저, 도 1B에 도시된 바와같이, 범프(102)가 도전체 패턴(100)에 접촉하도록 배치되어, 서로 가열 및 가압되도록 기판과 칩이 배치된다. 이 과정은 280-600℃의 온도에서 실행되며, 각 범프는 약 100㎛정도의 정방형 크기이고 10-60gf의 부하로 가압된다. 그 결과, 범프(102)와 도전체 패턴의 표면의 주석 도금에 의해 금과 주석으로 된 합금층(104)이 형성되어, 반도체칩(103)이 플렉시블 기판(101)에 고정되어 전기적으로 접속된다.
다음, 도 1C에 도시된 바와같이, 반도체칩(103)과 플렉시블 기판(101) 사이에 액상의 수지(105)를 도포하고 또한 칩 측면에도 충전하여, 결국 도 1D에 도시된 바와같이 반도체칩의 장착된 구조를 얻는다.
도 2는 다른 종래 실시예에 따른 반도체 소자의 장착 구조를 나타낸다. 도 1A-1D와 동일 기능을 갖는 부품들은 동일 참조부호로 나타낸다. 이 실시예에서는, 도전체 패턴(100)이 형성된 플렉시블 기판(101)의 표면에 도전 입자(106)가 분산되어 있는 이방성 도전막(107)이 점착된다. 범프(102)를 가진 반도체칩(103)을 이방성 도전막(107)의 상방에서 가압하며 동시에 가열한다. 범프(102) 및 플렉시블 기판(101)상의 도전체 패턴(100)은 이방성 도전막(107)내의 도전입자(105)에 의해 전기적으로 접속된다. 반도체칩(103)과 플렉시블 기판(101)은 가열에 의해 경화된 이방성 도전막(107)에 의해 고정된다.
이 경우의 가압 압력은 도 1A-1D의 경우와 유사하며 도 1A-1D에서와 같이 합금층의 형성될 정도의 온도는 불필요하고 이방성 도전막(107)을 경화시키는데 필요한 온도; 즉 그 온도는 약 200℃정도로 설정된다.
도 1A-1D에 도시된 종래예에서는, 도 1D에 도시된 바와같이 완성품에 대한 전기적 검사등이 실행된다, 즉, 범프(102)와 플렉시블 기판(101)의 도전 패턴(100) 사이에 합금층(104)을 형성한후 완성품을 검사하며, 충전재로서 수지(105)가 도포되어 있다. 그러나, 이 경우에는, 반도체칩(103)이 이미 합금층(104)에 의해 플렉시블 기판(101)에 확고하게 고정되어 있다.
따라서, 제품 완성후에 전기적 검사등에 의해 반도체칩(103)이 불량으로 판정되면, 그 불량 칩(103)을 제거하기 위해서는 플렉시블 기판(101)의 도전체 패턴(100)을 박리시킬 필요가 있다. 이는 플렉시블 기판(101)이 재사용 될 수 없고, 폐기되어야 함을 의미한다.
또한, 합금층(104)이 형성된 경우의 도 1B에 도시된 가열과정에서, 플렉시블 기판(101)의 도전체 패턴(100)의 표면의 주석이 범프(102)를 향해 모여드는 경향이 있다. 그 결과, 반도체칩(103)의 범프(102)와 도전체 패턴(100) 사이의 접합 영역에서 바깥쪽으로 넓게 확산된 형상의 합금층(104)이 형성된다. 이와같이 형성된 합금층(104)은 인접한 다른 범프 또는 다른 도전 패턴에 직접 접촉되어, 에지 리크의 문제를 야기한다.
도 2에 도시된 장착 구조 및 방법에서는, 이방성 도전막(107)이 사용된다. 그러나, 그 막중의 도전입자(106)가 항상 균일한 밀도로 분산되는 것은 아니며, 일부 장소에서는 도전 입자(106)가 비교적 고밀도로 존재하게 된다. 고 입자 밀도를 갖는 상기 위치가 반도체칩(103)과의 접촉 영역으로 될 회로에 손상을 야기하게 된다.
또한, 도전 입자(105)가 범프(102)와 플렉시블 기판(101) 사이에서 이상적인 전기적 접속을 행하고 있지만, 도전 입자(106)의 불균일에 의해 접속 저항이 커지게 되거나, 또는 불확실한 접속, 최악의 경우, 비접속을 야기할 수 있다.
본 발명의 목적은 제품 완성후에 반도체칩이 불량으로 판명되면, 그 불량칩을 교환할 수 있어서 기판을 재사용할 수 있고, 종래의 에지 리크 문제를 일으키지 않고 확실한 접속을 보장할 수 있는, 반도체 소자의 장착 구조 및 그의 제조 방법에 관한 것이다.
본 발명은 상기 목적을 얻도록 성취되었으며, 본 발명의 요지는 다음과 같다:
본 발명의 제 1 양태에 따르면, 기판상에 장착된 반도체 소자로서, 상기 기판은 그 위에 수지 필름이 위치되는 도전부를 갖고, 상기 반도체 소자는 수지막을 통해 연장되는 합금부를 갖는 범프들을 포함하며, 상기 합금부는 상기 범프 및 도전부로 형성되는, 기판상에 장착된 것을 특징으로 한다.
본 발명의 제 2 양태에 따르면, 상기 기판이 플렉시블 기판인 것을 특징으로하는 반포체 소자/기판 장착 구조가 개시된다.
본 발명의 제 3 양태에 따르면, 상기 수지 필름은 상기 범프 및 상기 기판상의 도전부의 합금화가 행해지는 온도 범위에서 크로스-링크를 야기하는 특성을 갖는 것을 특징으로 하는 반도체 소자/기판 장착 구조가 개시된다.
본 발명의 제 4 양태에 따르면, 범프를 갖는 반도체 소자를 상기 범프가 기판의 도전부에 접속되도록 장착하는 반도제 소자의 장착 방법에 있어서 :
상기 도전부와 감께 기판상에 수지 필름을 피복시키는 제 1 단계;
상기 범프가 상기 수지 필름을 관통하여 상기 도전부와 접촉하도록 가압 및 가열하는 제 2 단계; 및
상기 반도체 소자 및 기판 사이에 상기 범프와 도전부가 합금화되도록 가압 및 가열하는 제 3 단계로 구성됨을 특징으로 한다.
본 발명의 제 5 양태에 따르면, 상기 기판이 플렉시블 기판인 것을 특징으로 하는 반도체 소자의 장착 방법이 개시된다.
본 발명의 제 6 양태에 따르면, 상기 수지 필름은, 상기 제 2 단계중에는 크로스-링크 작용을 발생하지 않고 제 3 과정중에 상기 수지 필름을 경화시키도록 크로스-링크 작용을 발생하는 특성을 가지는 것을 특징으로 하는 반도체 소자의 장착방법이 개시된다.
본 발명의 1 실시예에 의하면, 상기 수지 필름은 단일 요소이다.
본 발명의 1 실시예에 의하면, 상기 수지 필름은 도전부상의 제 1 부분 및 기판과 물리적으로 직접 접하는 제 2 부분을 갖는다.
본 발명의 1 실시예에 의하면, 상기 수지 필름은 비접착성 필름이다.
본 발명의 1 실시예에 의하면, 상기 수지 필름은 함금부가 수지막을 통해 연장되는 영역에서 용융 및 고화 부분을 한정한다.
본 발명의 1 실시예에 의하면, 상기 범프는 금이다.
본 발명의 1 실시예에 의하면, 상기 수지 필름은 플러스가 없다.
본 발명의 1 실시예에 의하면, 상기 합금부는 Au와 Sn의 합금이다.
상기한 구성에 따르면, 반도제 소자의 범프와 기판의 도전부를 합금화하기 전의 공정에서 이미 전기적 검사를 행함으로써, 불량 반도체가 발견되면, 그 불량칩만을 용이하게 교체할 수 있어서 기판 자체를 재사용할 수 있게된다. 따라서, 종래 구조에 비해 폐기물을 줄일 수 있어서, 비용을 절감할 수 있게 된다.
또한, 가압 및 가열에 의해 합금층이 형성될 때 각 범프가 수지 필름에 의해 둘러싸이게 됨으로써, 종래 기술에서 문제점으로 지적된 바와같은, 도전체 패턴의 표면의 주석 도금이 범프를 향해 모여서 반도체칩의 단부면에서 확산되는 합금층이 형성되는 현상이 발생되지 않게된다. 결과, 종래 구조에서 발생되는 에지 리크의 문제를 해결할 수 있게 된다.
상기 효과는 특히 플렉시블 기판등의 가요성 기판에 대해 효과적이다.
도 1A-1D는 종래예에 따라 반도체 소자를 기판상에 장착하는 단계들을 나타낸 기판 장착 공정도;
도 2는 다른 종래예에 따라 반도체 소자를 기판상에 장착하는 방법을 나타낸 단면도;
도 3은 도 1A-1D에 도시된 종래예의 문제점을 나타낸 단면도; 및
도 4A-4D는 본 발명의 일실시예에 따라 반도체 소자를 기판상에 장착하는 단계들을 나타낸 기판 장착 공정도이다.
본 발명의 일 실시예를 도 4A-4D를 참조하여 설명한다. 도 4A-4D는 이 실시예에 따른 반도제 소자의 장착 방법을 나타낸 공정도이다. 동일 기능을 가진 부품들은 도 1A-1D에 도시된 종래예의 참조부호와 동일한 참조부호를 부여한다.
이 실시예에서는, 도 4A에 도시된 바와 같이, 금으로 된 범프(102)를 갖는 반도체칩(103)을 도전체 패턴(100)이 형성된 플렉시블 기판(101)상에 장착한다. 이 플렉시블 기판(101)의 절연체의 재질은 폴리이미드 또는 폴리에스테르로 제조되며 도전체 패턴(100)의 재료는 동이다. 동의 표면은 주석으로 도금된다.
본 명세서에서, 도전체 패턴(100)의 주석 도금 두께는 0.1-5㎛이고, 범프(102)의 높이는 5-50㎛이다.
먼저, 도 4B에 도시된 바와같이, 도전체 패턴(100) 및 플렉시블 기판(101)의 표면에 수지 필름(1)이 점착된다. 수지 필름(1)의 재료는 에폭시 수지, 폴리에스테르 수지, 불소수지, 또는 이들의 임의의 조합물을 이용할 수 있다. 더 구체적으로, 예컨대 도 2의 종래예에서 사용된 이방성 도전막(107)에서 도전 입자(106)를 제거한 막 등이 사용될 수 있다. 두께는 적어도 10㎛이고 범프(102)의 높이보다 두껍도록 설정된다.
다음, 도 4C에 도시된 바와같이, 반도체칩(103)의 범프(102)를 상기 수지 필름(1)을 사이에 두고 플렉시블 기판(101)상의 도전체 패턴(100)에 대해 가열하면서 가압한다. 가열 온도는 수지 필름(1)이 연화되지만 경화되지는 않는 범위로 한다. 본 명세서에서는, 가열 온도는 약 100℃로 설정하였다.
범프(102)의 표면과 도전체 패턴(100)의 주석 도금 표면은 도금중에 결정 성장에 의해 거칠어지기 때문에, 범프(102) 및 도전체 패턴(100)이 상기 가압 및 가열 처리중에 수지 필름(1)을 관통하여 서로 접촉하게 된다.
반도체칩(103)과 플렉시블 기판(101)이 전기 접속될 때, 필요한 전기 검사등이 행해진다. 이 단계에서, 최종 제품으로는 아직 완성되지 않았지만, 일시적으로 전기 접속이 완료된 상태에서 검사가 실행된다. 이 경우에, 범프들(102)이 도전체 패턴(100)과 접촉하게 되며, 반도체칩(103)이 플렉시블 기판(101)을 압압하지 않더라도 접속 상태는 계속된다. 다만, 확실한 전기 접속을 위해, 약간의 압력을 가하는 것이 바람직하다. 상기 검사의 결과, 반도체칩(103)이 불량으로 판명되면, 반도체칩(103)은 플렉시블 기판(101)에서 제거된다.
종래의 구조에서, 불량칩은 불가피하게, 범프(102)와 도전체 패턴(100) 사이에 합금층(104)을 형성한후에 제거되어야 하므로, 불량칩이 강제로 제거될 때 도전체 패틴(100)이 함께 박리되어, 기판의 재사용을 불가능하게 한다. 이와 반대로, 이 실시예에 따르면, 범프(102)는 도전체 패턴(100)에 접속되는 것이 아니라, 접촉만 되므로 플렉시블 기판의 도전체 패턴(100)에 무리한 응력을 가하지 않고 불량 칩만을 용이하게 제거할 수 있다.
전기 검사의 결과, 아무 문제도 발견되지 않으면, 도 4D에 도시된 바와같이 반도체칩(103)과 플렉시블 기판(101)을 함께 가압 및 가열하여 범프(102)와 도전체 패턴(100)에 의한 합금층(104)을 형성함으로써, 안정적인 칩기판 접속을 완료한다. 가열 및 가압 조건은 도 1A-1D의 경우와 동일하다. 특히, 상기 과정은 280-600℃의 온도에서 실행되며, 각 범프는 약 100㎛정도의 정방형으로서 10-60gf의 부하로 가압된다.
상기 합금층(104)이 형성될때, 수지 필름(1)도 형성된다. 이 방식으로, 합금층이 형성될 수 있는 범위내의 고온에서 수지 필름(1)의 크로스-링크 작용으로 인해 경화를 완료할 수 있다. 따라서, 고온에서 경화되는 특성을 갖는 수지 필름이 이 실시예에서 사용된다.
상기한 바와같이, 이 실시예에서는, 도 4C에 도시된 전단계, 즉 반도체칩(103)의 범프(102) 및 플렉시블 기판(101)의 도전체 패턴(100)으로 된 합금층(104) 형성단계 이전에 전기 검사가 실행되므로, 불량 반도체칩(103)이 발견되면 용이하게 대체될 수 있어서, 플렉시블 기판(101)을 재사용할 수 있다. 이로써 종래 구조에 비해 폐기물을 줄일 수 있어서, 비용을 절감할 수 있다.
또한, 도 4C에 도시된 단계에서 범프(102)에 의해 수지 필름(1)이 돌파되므로서, 범프들(102)은 이미 도 4D에 도시된 합금층 형성을 위한 가압 및 가열 과정에서 수지 필름(1)으로 피복된 상태이다. 따라서, 도전체 패턴의 표면(100)상의 주석 도금이 범프(102)를 향해 모여서, 종래 기술의 문제점으로 제시한 바와같이, 반도체칩(103)의 단부면에서 확산되는 합금층이 형성되는 현상이 발생되지 않는다. 그 결과, 종래 구조에서 발생되는 에지 리크의 문제를 해결할 수 있다.
가요성을 갖는 플렉시블 기판이 이 실시예에서 기판으로서 사용될때, 그 기관은 도 3 에 도시된 바와같이 제조공정중 또는 기판의 사용 방법등에 의해 기판이 구부려지는 경우가 있다. 이에 의해 종래 구조에서는 에지 리크가 야기되었다. 그러나, 이 실시예에 따르면, 상기 문제가 해결될 수 있으므로, 상기 구조는 특히 가요성을 갖는 플렉시블 기판용으로 적합하다.
이 실시예에서는, 도 2에 도시된 바와같이 이방성 도전막을 사용하는 대신에, 반도체칩(103)과 플렉시블 기관(101) 사이의 전기 접속이 합금층(104)에 의해이루어짐으로써 확실한 전기적 접속을 보장할 수 있다.
상기 실시예에서 범프(102)의 재료로서 금이 사용되고 도체 패턴(100)의 표면 도금을 위해 주석이 사용되었지만, 다른 실시예에서는 범프(102)의 재료로서 땜납을 사용하고 전체 패턴(100)) 도금용으로 금을 사용할 수도 있다. 이 경우에, 범프(102)의 높이는, 5-100㎛로 설정되고, 도전체 패턴(100)의 금도금의 두께는 0.05㎛ 이상으로 됨이 바람직하다. 도 4D에 대응하는 단계에서의 온도는 200-350℃가 바람직하다. 압력은 상기 실시예에서와 동일하게 설정된다.
도전체 패턴(100)이 직접 형성되어 있는 절연 재료로 된 플렉시블 기판(101)이 상기 실시예에서 기판으로서 사용되었지만, 상기 기판과 패턴 사이에 접착층이 제공된 구조도 사용될 수 있다. 기판용 재료로는 가요성이 있는 기판으로 제한되지 않고, 유기재료료 된 경질 기판, 또는 세라믹 기판이 사용될 수 있다. 경질 기판로서 사용될 수 있는 재료로는 에폭시, 유리 에폭시, 폴리테트라플루오로에틸렌, 페놀 수지 등을 포함한다. 세라믹 기판으로서 사용될 수 있는 재료로는 알루미나, 지르코니아, 질화실리콘 및 탄화실리콘 세라믹을 포함한다.
상기한 바와 같이, 본 발명에 따르면, 전기적 검사 등에 의해 반도체칩의 불량이 발견될 때, 불량 반도체칩만을 용이하게 제거할 수 있어 반도체칩을 장착하는 기판의 재사용이 가하다. 따라서, 종래 구조에 비해 폐기물이 감소될 수 있으므로, 비용을 절감할 수 있다.
또한, 반도체칩의 범프 및 기판의 도전체 패턴에 의해 형성된 합금층이 반도체칩의 단부면에서 확산되지 않으므로 합금층이 상기 패턴의 다른 영역 또는 반도체칩 자체의 단부와 접촉하는 경우에 발생하는 종래의 에지 리크의 문제를 해소할 수 있다.
본 발명에서는 이방성 도전막을 사용하지 않고, 반도체칩과 기판 사이의 전기적 접속을 형성할 수 있는 합금층을 이용함으로써, 확실한 전기적 접속을 보장할 수 있다.
Claims (6)
- 범프를 갖는 반도체 소자를 상기 범프가 기판의 도전부에 접속되도록 장착하는 반도체 소자의 장착 방법에 있어서,상기 도전부를 포함하는 수지 필름을 피복시키는 제 1 단계;상기 범프가 상기 수지필름을 관통하여 상기 도전부와 접촉하도록, 상기 수지필름이 연화되지만 경화되지는 않는 제1 온도 범위에서 가압 및 가열하는 제 2 단계;상기 범프와 도전부가 접촉된 상태에서 반도체 소자의 전기적인 검사를 행하는 검사단계; 및상기 반도체 소자 및 기판 사이에서 상기 범프와 도전부가 합금화되도록, 상기 수지필름이 경화되는 제2 온도 범위에서 가압 및 가열하는 제 3 단계를 구비하는 것을 특징으로 하는 반도체 소자의 장착 방법.
- 제1항에 있어서, 상기 기판이 플렉시블 기판인 반도체 소자의 장착 방법.
- 제1항에 있어서, 상기 수지 필름은, 상기 제 2 단계에서는 가교되지 않고 제 3 단계에서 가교되는 특성을 갖는 소자의 장착 방법.
- 제1항에 있어서, 상기 수지 필름은 비접착성 필름인 것을 특징으로 하는 반도체 소자의 장착방법.
- 제1항에 있어서, 상기 범프는 금인 것을 특징으로 하는 반도체 소자의 장착 방법.
- 제1항에 있어서, 상기 수지 필름은 플럭스가 없는 것을 특징으로 하는 반도체 소자의 장착방법.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP96-196479 | 1996-07-25 | ||
JP8196479A JPH1041694A (ja) | 1996-07-25 | 1996-07-25 | 半導体素子の基板実装構造及びその実装方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
KR100344912B1 true KR100344912B1 (ko) | 2002-11-29 |
Family
ID=16358484
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019970032615A KR100344912B1 (ko) | 1996-07-25 | 1997-07-14 | 반도체소자의기판장착구조및그장착방법 |
Country Status (6)
Country | Link |
---|---|
US (1) | US6058021A (ko) |
EP (1) | EP0821408A3 (ko) |
JP (1) | JPH1041694A (ko) |
KR (1) | KR100344912B1 (ko) |
CN (1) | CN1121062C (ko) |
TW (1) | TW476230B (ko) |
Families Citing this family (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3544990B2 (ja) * | 1995-10-31 | 2004-07-21 | イビデン株式会社 | 電子部品モジュール及びその製造方法 |
EP0824301A3 (en) * | 1996-08-09 | 1999-08-11 | Hitachi, Ltd. | Printed circuit board, IC card, and manufacturing method thereof |
JP2000003977A (ja) * | 1998-06-16 | 2000-01-07 | Shinko Electric Ind Co Ltd | 半導体チップ実装用基板 |
KR100509874B1 (ko) * | 1998-07-01 | 2005-08-25 | 세이코 엡슨 가부시키가이샤 | 반도체 장치 제조 방법 |
ES2154593B1 (es) * | 1999-06-08 | 2001-10-16 | Mecanismos Aux Es Ind S L | Diseño de componentes electronicos sobre una capa de cobre de 400 micras en circuitos impresos. |
JP3215686B2 (ja) | 1999-08-25 | 2001-10-09 | 株式会社日立製作所 | 半導体装置及びその製造方法 |
KR100940764B1 (ko) * | 1999-09-14 | 2010-02-10 | 소니 케미카루 앤드 인포메이션 디바이스 가부시키가이샤 | 이방성 도전접속체 및 제조방법 |
JP3451373B2 (ja) * | 1999-11-24 | 2003-09-29 | オムロン株式会社 | 電磁波読み取り可能なデータキャリアの製造方法 |
JP4082097B2 (ja) * | 2002-06-12 | 2008-04-30 | 日本電気株式会社 | 半導体装置用ソケット及び半導体装置接続方法 |
JP2005019815A (ja) * | 2003-06-27 | 2005-01-20 | Seiko Epson Corp | 半導体装置およびその製造方法、回路基板ならびに電子機器 |
US7294533B2 (en) * | 2003-06-30 | 2007-11-13 | Intel Corporation | Mold compound cap in a flip chip multi-matrix array package and process of making same |
JP4494745B2 (ja) | 2003-09-25 | 2010-06-30 | 浜松ホトニクス株式会社 | 半導体装置 |
JP4351012B2 (ja) | 2003-09-25 | 2009-10-28 | 浜松ホトニクス株式会社 | 半導体装置 |
JP4494746B2 (ja) | 2003-09-25 | 2010-06-30 | 浜松ホトニクス株式会社 | 半導体装置 |
JP5029026B2 (ja) * | 2007-01-18 | 2012-09-19 | 富士通株式会社 | 電子装置の製造方法 |
CN102254837A (zh) * | 2011-04-29 | 2011-11-23 | 永道无线射频标签(扬州)有限公司 | 电子标签倒贴片封装生产线封装工艺 |
JP6143665B2 (ja) * | 2013-12-26 | 2017-06-07 | Towa株式会社 | 半導体封止方法及び半導体封止装置 |
US10249515B2 (en) * | 2016-04-01 | 2019-04-02 | Intel Corporation | Electronic device package |
CN113571430A (zh) * | 2020-04-28 | 2021-10-29 | 西部数据技术公司 | 具有减小的底部填充面积的倒装芯片封装体 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03222339A (ja) * | 1990-01-29 | 1991-10-01 | Casio Comput Co Ltd | 半導体装置の接続方法 |
JPH04255300A (ja) * | 1991-02-07 | 1992-09-10 | Fujitsu Ltd | ガイドブロックの形成方法 |
Family Cites Families (20)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
NL7110944A (ko) * | 1970-08-24 | 1972-02-28 | ||
JPS5357481A (en) * | 1976-11-04 | 1978-05-24 | Canon Inc | Connecting process |
JPS5873126A (ja) * | 1981-10-27 | 1983-05-02 | Seiko Keiyo Kogyo Kk | 半導体装置の実装方法 |
JPH01199440A (ja) * | 1988-02-04 | 1989-08-10 | Matsushita Electric Ind Co Ltd | 半導体装置の製造方法 |
EP0389756B1 (en) * | 1989-02-02 | 1994-06-01 | Matsushita Electric Industrial Co., Ltd. | Method of assembling semiconductor devices |
JP2833111B2 (ja) * | 1989-03-09 | 1998-12-09 | 日立化成工業株式会社 | 回路の接続方法及びそれに用いる接着剤フィルム |
US5071787A (en) * | 1989-03-14 | 1991-12-10 | Kabushiki Kaisha Toshiba | Semiconductor device utilizing a face-down bonding and a method for manufacturing the same |
US5611140A (en) * | 1989-12-18 | 1997-03-18 | Epoxy Technology, Inc. | Method of forming electrically conductive polymer interconnects on electrical substrates |
US5085913A (en) * | 1990-04-27 | 1992-02-04 | At&T Bell Laboratories | Silicone material |
US5128746A (en) * | 1990-09-27 | 1992-07-07 | Motorola, Inc. | Adhesive and encapsulant material with fluxing properties |
JPH05175280A (ja) * | 1991-12-20 | 1993-07-13 | Rohm Co Ltd | 半導体装置の実装構造および実装方法 |
JPH0697228A (ja) * | 1992-09-16 | 1994-04-08 | Sharp Corp | 半導体実装構造 |
US5859470A (en) * | 1992-11-12 | 1999-01-12 | International Business Machines Corporation | Interconnection of a carrier substrate and a semiconductor device |
US5386624A (en) * | 1993-07-06 | 1995-02-07 | Motorola, Inc. | Method for underencapsulating components on circuit supporting substrates |
EP0645805B1 (en) * | 1993-09-29 | 2000-11-29 | Matsushita Electric Industrial Co., Ltd. | Method for mounting a semiconductor device on a circuit board, and a circuit board with a semiconductor device mounted thereon |
US5579573A (en) * | 1994-10-11 | 1996-12-03 | Ford Motor Company | Method for fabricating an undercoated chip electrically interconnected to a substrate |
JP2770821B2 (ja) * | 1995-07-27 | 1998-07-02 | 日本電気株式会社 | 半導体装置の実装方法および実装構造 |
CN1194059A (zh) * | 1995-08-29 | 1998-09-23 | 美国3M公司 | 用于粘合电子器件的可变形基片部件 |
US5783867A (en) * | 1995-11-06 | 1998-07-21 | Ford Motor Company | Repairable flip-chip undercoating assembly and method and material for same |
JP2806348B2 (ja) * | 1996-03-08 | 1998-09-30 | 日本電気株式会社 | 半導体素子の実装構造及びその製造方法 |
-
1996
- 1996-07-25 JP JP8196479A patent/JPH1041694A/ja active Pending
-
1997
- 1997-06-18 TW TW086108486A patent/TW476230B/zh not_active IP Right Cessation
- 1997-06-20 US US08/880,170 patent/US6058021A/en not_active Expired - Fee Related
- 1997-07-14 KR KR1019970032615A patent/KR100344912B1/ko not_active IP Right Cessation
- 1997-07-23 CN CN97115428A patent/CN1121062C/zh not_active Expired - Fee Related
- 1997-07-25 EP EP97305608A patent/EP0821408A3/en not_active Withdrawn
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03222339A (ja) * | 1990-01-29 | 1991-10-01 | Casio Comput Co Ltd | 半導体装置の接続方法 |
JPH04255300A (ja) * | 1991-02-07 | 1992-09-10 | Fujitsu Ltd | ガイドブロックの形成方法 |
Also Published As
Publication number | Publication date |
---|---|
TW476230B (en) | 2002-02-11 |
CN1121062C (zh) | 2003-09-10 |
US6058021A (en) | 2000-05-02 |
JPH1041694A (ja) | 1998-02-13 |
EP0821408A2 (en) | 1998-01-28 |
EP0821408A3 (en) | 1999-12-01 |
CN1175089A (zh) | 1998-03-04 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR100344912B1 (ko) | 반도체소자의기판장착구조및그장착방법 | |
KR101105948B1 (ko) | 전기 부품의 실장 방법 및 실장 장치 | |
US6229209B1 (en) | Chip carrier | |
KR100297313B1 (ko) | 돌출전극을갖는반도체장치 | |
EP1445995B1 (en) | Method of mounting an electronic component on a circuit board and system for carrying out the method | |
KR100288035B1 (ko) | 플립칩 접속방법, 플립칩 접속 구조체 및 그것을 사용한 전자기기 | |
JPH11111896A (ja) | 半導体装置及びその製造方法 | |
KR100563890B1 (ko) | 전기적 접속 장치 및 전기적 접속 방법 | |
EP1448745B1 (en) | Anisotropically electroconductive adhesive film, method for the production thereof, and semiconductor devices | |
JPH05218137A (ja) | 半導体装置の製造方法 | |
KR100244047B1 (ko) | 접착 조성물의 수축으로 인한 파손이 적은 반도체 칩과 기판 사이의 전기적 접속을 갖는 반도체 소자 및 그 실장 방법 | |
US20110057330A1 (en) | Electronic device and method of manufacturing electronic device | |
JP3509642B2 (ja) | 半導体装置の実装方法および実装構造 | |
JP2000068321A (ja) | 半導体装置およびその製造方法 | |
JPH04171970A (ja) | 半導体装置 | |
JP3055193B2 (ja) | 回路の接続方法及び液晶装置の製造方法 | |
JP2004247621A (ja) | 半導体装置およびその製造方法 | |
JP2004253529A (ja) | 半導体装置及びその製造方法 | |
KR20110048119A (ko) | 전도성 범프를 갖는 칩 및 그 제조방법과, 칩을 구비한 전자부품 및 그 제조방법 | |
JPH08102464A (ja) | 突起電極構造とその形成方法及び突起電極を用いた接続構造とその接続方法 | |
JPH09326326A (ja) | 電子部品、配線基板及び電子部品の配線基板への実装構造 | |
JP3232805B2 (ja) | バンプ電極の形成方法 | |
JP2004165659A (ja) | 電極の接続方法および該方法で得た電極の接続構造 | |
JPH08250543A (ja) | 半導体装置 | |
JPS63237427A (ja) | 半導体素子の実装方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
AMND | Amendment | ||
E902 | Notification of reason for refusal | ||
AMND | Amendment | ||
E601 | Decision to refuse application | ||
J201 | Request for trial against refusal decision | ||
AMND | Amendment | ||
E801 | Decision on dismissal of amendment | ||
J301 | Trial decision |
Free format text: TRIAL DECISION FOR APPEAL AGAINST DECISION TO DECLINE AMENDMENT REQUESTED 20001117 Effective date: 20010329 |
|
S901 | Examination by remand of revocation | ||
B601 | Maintenance of original decision after re-examination before a trial | ||
J301 | Trial decision |
Free format text: TRIAL DECISION FOR APPEAL AGAINST DECISION TO DECLINE REFUSAL REQUESTED 20000712 Effective date: 20010831 |
|
S901 | Examination by remand of revocation | ||
E902 | Notification of reason for refusal | ||
GRNO | Decision to grant (after opposition) | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
Payment date: 20070625 Year of fee payment: 6 |
|
LAPS | Lapse due to unpaid annual fee |