KR100235222B1 - 싱글 인라인 메모리 모듈 - Google Patents
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Abstract
본 발명의 싱글 인라인 메모리 모듈은, 제1 및 제2면을 갖는 인쇄회로카드와 상기 인쇄회로카드를 회로소자에 결합하는 접속기 수단을 포함하며, 상기 제1 및 제2면상에 배치된 복수의 메모리 장치를 포함하며, 상기 메모리 장치가 제1, 제2 및 제3구성에 배열되는데, 상기 제1구성은 상기 제1 및 제2면에 대해 등을 맞대어 배치되고 서로간에 전기적으로 결합된 최소한 2개의 메모리 소자를 구비하고, 상기 제2구성은 서로간에 병행하는 배열로 결합된 최소한 2개의 상기 제1구성을 구비하고, 상기 제3구성은 최소한 2개의 상기 제2구성으로 포함한다.
Description
제1a도는 본 발명의 기술에 따른 싱글 인라인 메모리모듈(SIMM)의 제1면에 대한 전기적 개략도.
제1b도는 SIMM의 제2면에 대한 메모리 소자의 좌-우 거울상을 예시한 전기적 개략도.
제2a도는 SIMM 상에 위치된 메모리 소자의 물리적 배치를 예시한 도면.
제2b도는 SIMM 상에 판독 접속기 구조의 확대도.
제3도는 제1도 및 제1b도에 도시된 전기적 개략도에 대한 상호접속을 개선하는데 필요한 유전체를 절연함으로써 분리된 스택 전도층을 예시한 도면.
제4도는 SIMM으로 순환된 번지, 데이터 및 제어신호의 데이터, 번지 및 논리선 전체의 설명도.
제5도는 SIMM과 메모리 시스템을 상호접속하는데 사용된 하이 핀 밀도의 이중판독 접속기 구조상의 핀 배열을 예사한 도면.
제6도는 SIMM을 왕복하는 신호전송에 대한 핀아웃 합계를 나타낸 도면.
* 도면의 주요부분에 대한 부호의 설명
5 : SIMM 10 : DRAM
15 : 구동기 20 : 제어신호
21 : 접근신호 30 : 접속기
[발명의 분야]
본 발명은 컴퓨터 시스템 및 메모리 하드웨어에 관한 것이다.
특히, 본 발명은 컴퓨터 시스템내에서 메모리 구조를 형성하도록 결합될 수 있는 모듈러 회로 기판에 관한 것이다.
[배경 기술]
싱글 인라인 메모리 모듈("SIMM")은 표면 장착 메모리 칩을 수용하도록 설계된 콤팩트 회로기판이다. SIMM은 상기 SIMM을 수납하도록 설계된 컴퓨터 시스템의 사용자 설치에 대하여 콤팩트하고 용이하게 운영되는 모듈러 메모리 소자를 제공하도록 설계되었다. 일반적으로 SIMM은 컴퓨터 시스템내의 접속기에 용이하게 삽입되어, 그로부터 필요한 전원, 접지 및 논리신호를 구동한다.
전형적으로 SIMM은 인쇄회로기판에 장착된 복수의 임의 접근 메모리 ("RAM")을 구비 한다. 사용자의 요구에 따라, RAM 메모리 칩은 동적 RAM(DRAM), 비휘발성 정적 RAM(SRAM) 또는 비디오 RAM(VRAM)이 될 수 있다. DRAM 메모리가 SRAM용 메모리 셀보다 크고 값이 싸기 때문에, DRAM 메모리는 원칙적 빌딩 블록으로서 광범위하게 사용된다.
SRAM 및 DRAM SIMM은 각각 고속 캐시 메모리 및 비디오 프레임 버퍼 같은 특별한 목적에 대하여 보다 제한된 응용을 갖는다. 왜냐하면 컴퓨터 시스템 메모리의 대부분을 DRAM이 형성하기 때문이며, 따라서 메모리 모듈이 사용자의 요구사항을 시간으로 변경하는 것으로서, 사용자의 필요한 계산을 유연성있게 수용하는 것이 바람직하다. 더욱이, 바람직한 것은 사용자가 해결해야 하는 최소한의 문제점, 특히 특별한 메모리 구조내에서 SIMM의 구성면에 있어서 컴퓨터 시스템에 SIMM 모듈을 추가하는 것이다. 과거에는, 하나 이상의 메가 바이트(MB)의 메모리 증분을 제공하도록 SIMM이 일반적으로 설계되었으며, 메모리 부가가 컴퓨터 시스템에 사용된 전체 데이터 폭의 일부만을 포함한 것을 제외하였다. 종래의 편성 및 구조의 선도적 일예는 클레이톤(Clayton)에게 허여된 미국특허 제4,656,605호(1987년 4월 7일)에 개시된 것이다. 클레이톤 특허는 9개의 메모리 칩에 장착된 콤펙트 모듈러 메모리 회로기판을 개시하는데, 상기 메모리 칩은 8비트(1바이트) 데이터 폭과 홀짝 비트에 메모리 증분을 제공하도록 배열된다.
따라서, 대부분의 컴퓨터 시스템이 32비트, 64비트 또는 그이상의 비트의 데이터 경로를 사용하기 때문에, 클레이톤 특허에 따라 구성된 SIMM은 전체 데이터 경로에 대한 메모리 증분을 제공할 수 없다. 대신에 사용자는, 예컨대 SIMM 모듈을 설치하기 위해 베이스 번지를 설정하는 싱글 메모리 유닛으로서 분기된 SIMM 모듈로 하여금 기능하도록 하는데 필요한 어떤 추가적 구성조건과의 조합에 있어서 복수의 SIMM을 구하여 설치하여야 한다.
결과적으로, 사용자는 그의 유용한 주 메모리를 증가시키려고 종래기술에 따라 구성된 SIMM을 가산함으로써, 전형적으로는 그의 컴퓨터의 전체 데이터 경로에 대한 메모리 확장을 달성하도록 복수의 SIMM을 삽입하여야 한다.
다음은 SIMM이 1바이트 폭 메모리 증분을 구비한 DRAM 부분 근방에 배열된 통상의 종래 SIMM 기술의 절차이다. 따라서 32비트의 폭을 갖는, 바이트당 8비트가 존재하는 데이터 경로에서는, 종래기술에 따라 구성된 SIMM을 사용하는 주메모리의 1메가 바이트 확장이 1메가 바이트의 전체 데이터 경로확장을 구하도록 제각기 1메가 바이트 용량의 4개의 SIMM 모듈을 요구하는 것이다.
다음 명세서에서 보다 상세히 기술되는 바와 같이, 본 발명은 다른 속성중에서도 전체 데이터 경로 폭에 메모리 확장을 용이하게 제공함으로써, 소정의 원하는 메모리 증분을 얻도록 복수의 SIMM 모듈을 구성 및 설치하는 사용자의 부담을 경감시킨다.
[발명의 개요]
동적 임의 접근 메모리(DRAM)의 메모리 확장용 전체폭의 싱글인라인 메모리 모듈(SIMM)이 개시된다. 복수의 DRAM 메모리 소자가 장착된 인쇄회로 기판은 44비트의 폭을 갖는 데이터 경로로 배열된다.
본 발명의 SIMM은 메모리 소자에 밀접하게 근접하는 신호를 버퍼 및 구동하는 내장 구동기를 더욱이 포함한다. 추가로, 전기 전도성 트레이스는 분포된 메모리 소자에 대한 신호 스큐를 최소화하기 위해 적재 및 트레이스 커패시턴스를 감소 시키는 방법으로 회로 기판상에서 순환된다. SIMM은 기능성을 향상시키기 위해 전기적 트레이스를 그 회로기판의 양측으로부터 수신하는 하이 핀 밀도의 이중판독 접속기 구조를 추가로 포함한다. SIMM은 메모리 확장을 전체폭 증분으로 제공함과 동시에 한 SIMM을 상보형 소켓에 설치한다. 따라서, 접속기 수조를 순환하는 대칭적 전원 및 접지는 SIMM이 부정확하게 삽입될 수 없도록 보장하므로, SIMM을 접속기 슬롯에 물리적으로 역전시켜 전원을 SIMM으로 역전되지 않도록 한다.
본 발명의 목적, 특징, 이점은 본 발명의 바람직한 실시예의 하기에 기술된 상세한 설명과 첨부도면으로부터 명백히 드러난다.
[발명의 상세한 설명]
집적 데이터 및 비디오 메모리용 버스 기술이 개시된다. 설명을 목적으로 하는 다음 명세서에서, 특정번호, 시간, 신호등은 본 발명의 전체적 이해를 제공하도록 개시된다. 그러나, 본 발명의 분야에 숙련된 기술자에게는 이들을 특정하게 설명하지 않고 실시될 수 있음을 알 수 있다. 다른 경우에, 주지된 회로 및 장치는 본 발명을 불필요하게 명료하게 하지 않도록 블록도로 도시된다.
본 명세서에서 서술된 SIMM의 바람직한 실시예는 계류중인 미국특허 출원 제 07/886,671호(1992년 5월 19일)에서 "집적 데이터 및 비디오 메로리용 버스 기술"(A Bus Architecture for Integrated Data and Video Memory)이라는 제목으로 개시된 집적 데이터 및 비디오 메모리 버스와 함께 사용되도록 설계 및 의도된다.
그러나 당업자라면, 여기서 개시된 명세서의 기술이 본 발명의 범위를 이탈하지 않고 변경할 수 있음을 알 수 있다. 비록 본 발명의 바람직한 실시예가 상기 참조된 미국 특허출원에 개시된 집적 데이터 및 비디오 메모리의 데이터 경로와 정합하는 데이터 경로의 용어로써 개시되어 있을지라도, 버스의 설계 변경은 SIMM이 집적 메모리 버스의 데이터 경로폭에 정합될 수 있는 본 발명의 범위내에 있게됨이 명백하다.
제1도의 구성을 참조하면, SIMM의 첫째 대응면에 장착된 메모리의 전기 블록도가 도시된다. 제1도에서 복수의 동적 RAM(DRAM)(10)은 2개의 다발(10a)로 분류된다. 각 다발에는 9개의 DRAM(10)이 있다.
구동기(15)는 제어신호와, 양측면 접속기(30)를 통해 외부버스 배열(도시안됨)로부터의 번지신호를 수신한다. 복수의 제어선(20)은 RAS-(행접근 스트로브) CAS-(열접근 스트로브), WE-(판독 사용가능) 및 OE-(출력 사용가능)을 순환하고, 구동기(15)로부터 모든 DRAM(10) 까지의 제어신호는 SIMM(5)에 장착된다. 더구나, 구동기(15)는 SIMM(5)에 장착된 모든 DRAM(10)이 접근신호(21)를 버퍼하고 순서적으로 분배시킨다. 본 도면을 명백히 하기 위해, 데이터, 번지 및 제어선을 모든 DRAM(10)으로 특별히 순환하는 것을 생략한다. 그러나, 제1a도에서 알 수 있는 바와 같이 모든 DRAM(10)은 4개의 데이터 선을 갖는데, DRAM(5)이 4개에 의한 ("by-four") 구성으로 배열된 수개의 상용가능한 DRAM 중 어느 하나로 된다.
하기의 제1b도와 관련하여 알 수 있는 바와 같이, DRAM(10) 각각의 DRAM 다발(10d) 및 (10b)은 SIMM(5)의 대향측면에 장착되고 복수의 비아스(vias, 도시안됨)를 통하는 전기적 트레이스에 의한 전기통신으로 위치된 거울상 DRAM(10)으로 정합된다.
전기 트레이스의 특정 순환은 SIMM(5)상에서 SIMM(5)의 특정 구현을 위해 선택된 메모리 칩의 특정 기술에 좌우된다. 그러나, 본 발명의 기술에 따라 구성된 모든 SIMM(5)은 SIMM(5)상에서 동작하는 모든 장치로 접속기(30)로부터 신장하는 전체폭의 데이터 경로를 가지며, 모든 DRAM(10), 구동기(15) 및 SIMM(5)의 원하는 기능을 구현하는데 필요한 기타의 논리소자를 포함한다. 바람직한 것으로서, SIMM(5)는 144비트 데이터 경로를 구체화하며, 128개의 데이터 선(DATA[127:0], 주지된 오차 정정 코드를 구현하는 16개의 오차 정정선(CBW[15:0]), 1의 RAS-, 2의 CAS- 신호, 1의 WF, 신호 및 1의 리셋선을 구비한다. 전도성 트레이스 커패시턴스를 최소화하는 모든 제어선(20), 번지신호(21) 및 데이터 신호(25)에 대한 모든 순환은 제목, "고속전기 신호 상호접속구조"(High Speed Electric Signal Interconnect Structure), 본 발명의 양수인에게 양도됨, 에 따라 게재된 상기 인용된 미국 특허출원을 참고한다.
모든 제어신호(20)에 대해 제어순환하는 트레이스는 각각의 DRAM 다발(10a,10b,10c,10d)에 대하여 구동기(15)로부터 중앙 DRAM(10)으로 취급된다.
중앙 DRAM(10) 근방의 DRAM은 제어신호(20)를 짧은 서브 트레이선(도시안됨)을 경유하여 결합하며, 총 커패시턴스를 최소화하고 신호 상승시간을 증가시킨다.
제3도에 있어서, 제어, 번지, 데이터 및 출력·접지신호 모두를 순환하기 위해 사용된 스택업이 예시된다.
제1b도에는 SIMM(5)의 둘째, 배면이 도시된다.
제1b도에서, 2개의 추가적 DRAM 다발(10c) 및 (10d)는 정면에 대한 DRAM 다발(10a) 및 (10b)로서 배열되는 것을 도시한다.
DRAM 다발(10c) 및 (10d)에서 각각의 DRAM(10)은 비슷하게는 4개의 입력선 뿐만 아니라 SIMM(5)의 거울상 배면에 대하여 전도성 비아스를 통하는 정면에서 구동기(15)로부터 통과된 번지 및 제어선을 수신함으로써, DRAM(10)이 장착될 수 있는 이용가능한 표면 영역을 배가한다. 더욱이, SIMM(5)은 바람직한 것으로서 SIMM(5)의 전체 두께를 감소시키기 위해 얇고 소형의 아웃트라인 패키지(TSOP) DRAM(10)을 사용한다.
그렇게 구성된 경우, 본 발명의 양쪽면 SIMM(5)은 종래기술의 단일면 SIMM(예컨대, 클레이튼(clayton)에 의해 설명)보다 두껍지 않게 된다.
제4도에는 SIMM(5)을 메모리 모듈 소켓(도시안됨)에 접속하도록 사용된 수치 고밀도 접속기(30)가 예시된다. 제4도에서, 접속기(30)는 200핀 단자를 가진 것을 나타냄, 따라서 대다수의 신호가 SIMM(5)을 왕복 순환하도록 한다.
SIMM(5)의 바람직한 실시예에서, SIMM(5)은 집적 데이터 및 비디오 메모리 버스, 예컨대 여기서 참고로 병합되고, 미국, 캘리포니아, 마운틴 뷔우 소재의 선 마이크로 시스템즈사에 양도된 상기 인용된 계류중인 미국 특허 출원에 기술됨, 와 부합되는 특별히 병합된 데이터 경로기술을 의도하는 것이다.
특히, SIMM(5) 상에 구성된 데이터 경로기술은 128개의 데이터선, 16의 오차 정정코드선(제1도 내지 제6도에서 CBW[15:1]로 참조됨), 또한 DRAM 메모리 접근을 달성하는데 필요한 복수의 제어신호를 포함한다.
제1a도 및 제1b도에 제어선(20)으로 집단적으로 참조된 상기 제어신호는 SIMM(5)마다 1개의 RAS-, 2의 CAS- 신호, 1의 WE- 및 1의 리셋선을 포함한다.
따라서, DRAM(10)의 동작을 제어하기 위해 사용된 제어신호(20)를 포함하지 않으며, DRAM(10)을 왕복하는 데이터의 전송을 위해 사용된 데이터 경로는 144비트폭으로 나타난다. 제1도 내지 제6도에서 CBW[15:0]로서 참조된 오차 정정 신호를 경시하는 것은, 메모리를 왕복하는 데이터를 독출 및 판독하는 SIMM(5)의 실제적 데이터 경로폭이 128비트폭 또는 16 바이트이며, 집적 데이터 및 비디오 메모리 버스의 그것들과 일치한다. 따라서, 본 발명의 SIMM(5)은 전체폭 증분으로 메모리 버스에 설치될 수 있다. SIMM(5) 상에 이용될 수 있는 총 메모리 용량은 다음과 같이 계산된다. SIMM(5)에 장착된 각 RAM(10)의 용량에 좌우되어, 각각의 SIMM 모듈(5)의 총 메모리 용량은 4메가 바이트(MB)로부터 총 36 DRAM(10)에 걸쳐 분포된 최대 64MB 까지 변화될 수 있다. 상용될 수 있는 256K×41M 비트 DRAM(10)을 사용하면, 4 메가 바이트의 메모리가 SIMM(5)상에 제공될 수 있다.
선택적으로는, 16메가비트 부분이 사용될 경우, SIMM(5)의 번지지점 가능한 번지 공간이 매우 큰 2기가바이트 이상이기 때문에, SIMM(5)은 보다 큰 16메가 비트를 용이하게 수납할 수 있으며, 36 DRAM들이 장착된 SIMM에 대한 총용량 64메가 바이트를 이용할 수 있게 한다.
SIMM(5)의 동작은 이하에 간단히 기술될 제어신호(20)에 의해 제어된다.
집적 데이터 및 비디오 버스와 관련한 SIMM(5)의 실제적 동작을 완전히 논의하기 위해서, 판독기가 상기 계류중인 미국 특허출원, 제목 "버스기술"(A Bus Architecture)에서 참조된다.
DRAM(10) 및 구동기(15)의 물리적 배열이 SIMM(5)상에 예시된 제2도의 구성을 참조한다. 또한 DRAM 다발(10a) 및 (10b)은 SIMM(5)의 배면에 대해 도시되며, SIMM(5)은 SIMM(5)의 바닥에 지상에 2개의 접점 영역(50a) 및 (50b)을 갖고 있음을 알 수 있다. 접점 영역(50a) 및 (50b)은 접속기 맵 (제4도에 도시)과 핀아웃 합계에 대한 번호에 대응하는, 핀 0 내지 핀 199까지의 SIMM(5)의 바닥에지를 길이방향으로 접근하는 소폭의 전도성 접점 패드로 구성된다.
제2도에서, SIMM(5)의 상세한 바닥에지를 제2a도에 도시되고, 접점영역(50a) 및 (50b)의 접점영역에 대한 확대도는 투시도로 도시된다.
제2a도에서는 접점영역(50a) 및 (50b)이 SIMM(5)의 정면상에 대다수가 밀접하게 간격진 접점패드(35)와 SIMM(5)의 배면상에 거울상이 전기적으로 분명히 설정된 접점패드(36)로 구성됨을 알 수 있다. 종래기술에 따라 구성된 SIMM 과 대비하여, 본 발명의 SIMM(5)은 SIMM(5)의 정면 및 배면 사이의 접속을 중단("breaking")함으로써 SIMM의 핀아웃 용량을 증배시켜, 전기적 기능이 정확할 수 있는 에지영역을 효과적으로 증배시킨다. 명확성을 위해, 0.1 "중심에 배치된 접점핀을 갖는 종래의 SIMM 모듈과 대비할 때, SIMM(5) 상의 접점(35) 및 (36)의 간격은 0.050" 중심상에 배치되고 측면치수에서 0.040"로 되는 접점패드(35) 및 (36)는 따라서 접점패드 사이의 0.010"의 간격으로 산출된다. 그러나, 정밀한 간격 및 치수는 본 발명을 특정하지 않으며, 이 분야에 숙련된 기술자는 다수의 간격 및 패드 배치도가 제2a도에서 접점영역(50a) 및 (50b)으로 예시된 바와 같이 이중판독("dual read out) 구성을 사용할 수 있음을 명백히 알 수 있다.
그러므로, 접점영역(50a) 및 (50b)의 감소된 간격 및 이중판독 구성은 함께 동작하고, 클레이톤에 의해 제안된 것보다 4배 이상으로 SIMM 모둘에 대해 이용될 수 있는 매우 개량된 핀아웃 밀도를 제공한다.
특히, 200핀이 SIMM(5)에 대해 사용되도록 이용될 수 있으므로, 144 비트의 전체 데이터 경로 폭 뿐만 아니라 제어신호 및 출력과 접지접속은 SIMM(5)의 접속기(30)와 접속기 영역(50a) 및 (50b)에 의해 수납된다.
SIMM(5)상에 설치된 DRAM(10)의 형태에 따른 메모리 용량과 관련하여 전술한 바와 같이, 본 발명의 기술에 따라 구성된 SIMM(5)의 주요 이점은 메모리 확장이 전체 데이터 폭 증분으로 수납될 수 있는 것이다.
종래의 SIMM을 사용하는 메모리 확장과 대비할 때 메모리 확장시 SIMM(5)의 사용, 특히 상기 인용된 계류중인 출원의 집적 데이터 및 비디오 메모리와 연관된 메모리는 동시에 하나의 SIMM을 확장할 수 있고, 메모리 확장시 단일 증분을 얻도록 삽입될 복수의 모듈을 필요로 하지 않는다.
상기한 결과는 SIMM(5)상의 신호경로를 경유하는 전체 데이터의 수납으로부터 주로 구동되며, 따라서 추가적 메모리의 용이한 설치를 편리하게 한다.
마지막으로는 DRAM(10) 및 구동기(15)에 접속된 전원 및 접지를 위해 접속기(30)를 추가로 제공한다. 알수 있는 바와 같이, 모든 전원 및 접지 리드는, 제6도에서 보다 명확히 알 수 있는 것으로서, 접속기(30)내에서 대칭적으로 배열된다.
전원(VCC) 및 접지(GND) 리드는 모든 16 핀마다 선택되도록 보여진다.
SIMM이 반전된 위치에서 메모리 모듈 소켓에 부적절하게 삽입될 경우, 대칭적 전원 접지 리드는 SIMM(5)가 역전-전원 공급되어 파괴되는 것으로부터 보호한다.
다음은 집적 데이터 및 비디오 메모리와 호환가능한 싱글 인라인 메모리 모듈에 대한 물리적 기술을 서술한다. 이 분야에 숙련된 기술자에 의해 실시될 수 있는 변경 및 수정은, 본 발명의 정신 및 범위를 벗어나지 않고 본 발명의 요소에 대한 장치성분 및 배열을 예측가능하게 한다.
특히, SIMM(5) 이 상기 인용된 계류중인 출원으로부터 참고로 병합된 집적데이터 및 비디오 메모와는 다음 메모리 배열로 사용될 수 있음이 예기된다.
그러나, SIMM(5)은 집적된 비디오 메모리에 사용되도록 적합하게 설계되고, 사용자는 상기 시스템의 사용으로부터 최적의 이점을 유도할 수 있다.
본 발명이 바람직한 실시예와 관련하여 기술되어 있지만, 수개의 선택적 변경, 변화 및 사용은 다음 명세서에 비추어 이 분야에 숙련된 기술자에게 명백하게 이해될 수 있다.
Claims (11)
- 제1 및 제2면을 가지며, 인쇄회로카드를 회로소자에 결합시키기 위한 접속기 수단을 포함한 상기 인쇄회로카드; 상기 제1 및 제2면상에 배치된 복수의 메모리 장치;로 구성되어 있고, 상기 메모리 장치가 제1, 제2 및 제3구성으로 배열되는데, 상기 제1구성은 상기 제1 및 제2면에 대해 등을 맞대어 배치되고 서로간에 전기적으로 결합된 최소한 2개의 메모리 소자로 구성되고; 상기 제2구성은 서로간에 나란한 배열로 결합된 최소한 2개의 상기 제1구성으로 구성되고; 상기 제3구성은 상호 결합된 최소한 2개의 상기 제2구성으로 구성되는 것을 특징르로하는 싱글 인라인 메모리 모듈.
- 제1항에 있어서, 상기 메모리 소자를 번지지정하는 버퍼수단을 더 포함하고, 상기 버퍼수단이 상기 접속기 수단에 결합된 것을 특징으로 하는 싱글 인라인 메모리 모듈.
- 제2항에 있어서, 상기 접속기 수단은 상기 싱글 인라인 메모리 모듈의 상기 제1 및 제2면에 바닥 에지를 따라 분포된 복수의 전기 전도성 접점면을 갖는 이중 판독 접속기 구조로 구성되고, 상기 제1면 상의 상기 접점면이 상기 제2면상의 상기 제2접점면으로부터 전기적으로 절연되어, 상기 전기 전도성 접점면이 번지지정 정보를 상기 버퍼수단에 제공하는 것을 특징으로 하는 싱글 인라인 메모리 모듈.
- 제1면 및 제2면을 가지며, 인쇄회로 기판의 상기 제1면 및 상기 제2면상에 복수의 전기 접점을 갖는 접속기 에지를 구비하는 상기 인쇄회로기판; 상기 인쇄회로 기판의 상기 제1면에 배열되고, 상기 인쇄회로 기판의 상기 접속기 에지상의 상기 전기접점에 결합된 데이터 선을 가지는 제1세트의 메모리소자; 상기 인쇄회로 기판의 제2면에 배열되고, 상기 인쇄회로기판의 상기 접속기 에지상의 상기 전기 접점에 결합된 데이터 선을 가지고, 상기 제1세트의 메모리 소자의 거울상인 제2세트의 메모리소자; 상기 인쇄회로 기판의 거의 중앙에 장착되고, 상기 전기 접점을 통해 복수의 제어 신호를 수신하고, 상기 제어신호를 사어기 제1세트의 메모리 소자 및 상기 제2세트의 메모리 소자로 전송하는 구동기회로;의 소자들로 구성되어 있는 것을 특징으로 하는 싱글 인라인 메모리 모듈.
- 제4항에 있어서, 상기 인쇄회로기판의 제1면에 배열된 상기 제1세트의 메모리 소자는 상기 구동기 회로의 좌측에 배열된 제1서브세트와 상기 구동기 회로의 우측에 배열된 제2서브세트로 구성되고; 상기 인쇄회로 기판의 제2면에 배열된 상기 제2세트의 메모리 소자는 상기 제1서브세트의 거울상인 제3서브세트와 상기 제2서브세트의 거울상인 제4서브세트로 구성되는 것을 특징으로 하는 싱글 인라인 메모리 모듈.
- 제5항에 있어서, 상기 제1, 제2, 제3 및 제4서브세트의 메모리 소자는 3×3행렬로 배열된 9개의 메모리 소자로 구성되는 것을 특징으로 하는 싱글 인라인 메모리 모듈.
- 제6항에 있어서, 상기 구동기 회로는 상기 제1 및 제2메모리 소자 서브세트의 3×3 행렬의 중심 메모리 소자에 상기 제어신호를 직접 전송하는 것을 특징으로 하는 싱글 인라인 메모리 모듈.
- 제4항에 있어서, 상기 제어신호는 열번지 스트로브(CAS), 행번지 스트로브(RAS), 기록사용가능(WE), 및 출력 사용가능(OE)신호로 구성되는 것을 특징으로 하는 싱글 인라인 메모리 모듈.
- 제8항에 있어서, 상기 구동기 회로는 번지선을 추가로 구동하는 것을 특징으로 하는 싱글 인라인 메모리 모듈.
- 제4항에 있어서, 상기 전기신호는 상기 싱글 인라인 메모리 모듈이 부정확하게 삽입될 때 상기 싱글 인라인 메모리 모듈이 손상받지 않도록 대칭적 전원 및 접지 접점을 구비한 것을 특징으로 하는 싱글 메모리 모듈.
- 제4항에 있어서, 상기 인라인 메모리 모듈은 최소한 연관 중앙처리장치에 사용된 제2데이터 경로의 폭과 같은 제1데이터 경로에 데이터를 제공하는 것을 특징으로 하는 싱글 인라인 메모리 모듈.
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