JPS63296292A - 半導体装置 - Google Patents
半導体装置Info
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- JPS63296292A JPS63296292A JP62130683A JP13068387A JPS63296292A JP S63296292 A JPS63296292 A JP S63296292A JP 62130683 A JP62130683 A JP 62130683A JP 13068387 A JP13068387 A JP 13068387A JP S63296292 A JPS63296292 A JP S63296292A
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- 239000000758 substrate Substances 0.000 claims abstract description 5
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- 238000010586 diagram Methods 0.000 description 6
- 229910000679 solder Inorganic materials 0.000 description 3
- 238000005476 soldering Methods 0.000 description 2
- 238000005452 bending Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、実装基板上に集積回路用パンケージを搭載
した半導体装置に関するものである。
した半導体装置に関するものである。
第2図は従来の集積回路パッケージを搭載した半導体装
置を示す図で、第2図(alは両面実装した場合を、第
2図(b)は片面実装した場合を示している。また第3
図は該バフケージのリード接合部の拡大断面図であり、
ここでは特にスモールアウトラインパッケージ(SOP
)の場合を示している。
置を示す図で、第2図(alは両面実装した場合を、第
2図(b)は片面実装した場合を示している。また第3
図は該バフケージのリード接合部の拡大断面図であり、
ここでは特にスモールアウトラインパッケージ(SOP
)の場合を示している。
図において、1aは実装基板5上に搭載されたパッケー
ジ本体、2はその外部リード端子、3はその半田付部、
4は半田付部3と実装基板5とを接続する半田であり、
この半田4によりパッケージ1aが基板5に固着されて
いる。また各バフケージ1aは、配線9及びスルーホー
ル8により接続されている。
ジ本体、2はその外部リード端子、3はその半田付部、
4は半田付部3と実装基板5とを接続する半田であり、
この半田4によりパッケージ1aが基板5に固着されて
いる。また各バフケージ1aは、配線9及びスルーホー
ル8により接続されている。
次に実装方法について説明する。sop型の集積回路パ
ッケージ1aを実装基板5上に実装する場合、第3図の
ように、実装基板5の表面に形成された各々の電極部の
マウンドバフドロに半田4を予め付けておき、この実装
基板5上にパフヶージ1aを載置してそれらの外部リー
ド端子2の半田付部3とマウンドパッド6とを半田4で
電気的。
ッケージ1aを実装基板5上に実装する場合、第3図の
ように、実装基板5の表面に形成された各々の電極部の
マウンドバフドロに半田4を予め付けておき、この実装
基板5上にパフヶージ1aを載置してそれらの外部リー
ド端子2の半田付部3とマウンドパッド6とを半田4で
電気的。
機械的に接続して半田付けする方法が取られている。ま
た、第4図のように、各外部リード端子2は、■〜[相
]のリード位置が決められている。
た、第4図のように、各外部リード端子2は、■〜[相
]のリード位置が決められている。
第4図に示すようにその外部リード端子2が下方に折り
曲げられたAタイプのパッケージ1aを基板5に実装し
て、同番号の外部リード端子2同士を接続するためには
、実装基板、5に複雑な配線9やスルーホール8を設け
る必要がある。
曲げられたAタイプのパッケージ1aを基板5に実装し
て、同番号の外部リード端子2同士を接続するためには
、実装基板、5に複雑な配線9やスルーホール8を設け
る必要がある。
従来の半導体装置は以上のように構成されているので、
第2図(a)に示すように、両面実装をした場合、同番
号のリード同士をつなぐスルーホールを開けることが難
しく、また第2図(b)に示すように片面実装した場合
2つのパンケージ間で同番号のリード同士をつなぐ際、
配線が交差し、スルーホールが必要であるなどの問題点
があった。
第2図(a)に示すように、両面実装をした場合、同番
号のリード同士をつなぐスルーホールを開けることが難
しく、また第2図(b)に示すように片面実装した場合
2つのパンケージ間で同番号のリード同士をつなぐ際、
配線が交差し、スルーホールが必要であるなどの問題点
があった。
本願の第1の発明は、上記のような問題点を解消するた
めになされたもので、片面実装において同番号のリード
同士を配線の引き回しのみによってつなぐことができる
半導体装置を得ることを目的とする。
めになされたもので、片面実装において同番号のリード
同士を配線の引き回しのみによってつなぐことができる
半導体装置を得ることを目的とする。
また本願の第2の発明は両面実装において各パッケージ
間で同番号のリード同士を簡単なスルーホールにより接
続できる半導体装置を得ることを目的とする。
間で同番号のリード同士を簡単なスルーホールにより接
続できる半導体装置を得ることを目的とする。
本願の第1の発明に係る半導体装置は実装基板の一表面
上に、その外部リードを下方に折り曲げた第1のICパ
ッケージと外部リードを上方に折り曲げた第2のICパ
フケージとを片面実装してなるものである。
上に、その外部リードを下方に折り曲げた第1のICパ
ッケージと外部リードを上方に折り曲げた第2のICパ
フケージとを片面実装してなるものである。
本願の第2の発明に係る半導体装置は実装基板の表面に
、その外部リードを下方に折り曲げた第1のICパッケ
ージを、該実装基板の裏面にその外部リードを上方に折
り曲げた第2のICパ・ノケージをそれぞれ対面するよ
う両面実装してなるものである。
、その外部リードを下方に折り曲げた第1のICパッケ
ージを、該実装基板の裏面にその外部リードを上方に折
り曲げた第2のICパ・ノケージをそれぞれ対面するよ
う両面実装してなるものである。
本願発明においては、集積回路用パフケージとして外部
リード端子を下側に折り曲げたものと上側に折り曲げた
ものの2種類を用いたから、片面実装する場合には配線
の引き回しのみによって同番号の外部リード端子同士を
つなぐことができ、また両面実装する場合にはスルーホ
ールにより簡単に同番号の外部リード端子同士をつなぐ
ことができる。
リード端子を下側に折り曲げたものと上側に折り曲げた
ものの2種類を用いたから、片面実装する場合には配線
の引き回しのみによって同番号の外部リード端子同士を
つなぐことができ、また両面実装する場合にはスルーホ
ールにより簡単に同番号の外部リード端子同士をつなぐ
ことができる。
以下、本願発明の実施例を図について説明する。
第1図は本願の第1.第2の発明の実施例による半導体
装置を示し、図において、第2図、第3図と同一符号は
同一のものを示し、1はICチップ7を樹脂封止してな
るICパッケージ、2は該ICパフケージ1の配列番号
■〜[相]の決まっている外部リード端子、5はICパ
ッケージ1の実装基板である。この実装基板5に搭載さ
れたパッケージ1は、第4図(al〜(d)に示すよう
に外部リード端子2を下側つまりICチップ7と反対側
に折り曲げた第1のICパッケージ(Aタイプ)laと
、第5図(a)〜(d)に示すように外部リード端子2
を上側つまりICチップ7側に折り曲げた第2のICパ
ッケージ(Bタイプ)lbの2種類がある。この2種類
のパッケージは上述のように、外部リード端子2の折り
曲げ方が異なるため、つまりAタイプとBタイプのパッ
ケージla、lbでは同一の配列番号のリード■〜[相
]が対称形に位置しているため、第1図(alに示すよ
うに実装基板5の表面にAタイプのパッケージ1aを、
その裏面の該パッケージ1aと対応する位置にBタイプ
のパッケージ1bを実装した場合、同じ配列番号のリー
ド同士が向き合うことになる。
装置を示し、図において、第2図、第3図と同一符号は
同一のものを示し、1はICチップ7を樹脂封止してな
るICパッケージ、2は該ICパフケージ1の配列番号
■〜[相]の決まっている外部リード端子、5はICパ
ッケージ1の実装基板である。この実装基板5に搭載さ
れたパッケージ1は、第4図(al〜(d)に示すよう
に外部リード端子2を下側つまりICチップ7と反対側
に折り曲げた第1のICパッケージ(Aタイプ)laと
、第5図(a)〜(d)に示すように外部リード端子2
を上側つまりICチップ7側に折り曲げた第2のICパ
ッケージ(Bタイプ)lbの2種類がある。この2種類
のパッケージは上述のように、外部リード端子2の折り
曲げ方が異なるため、つまりAタイプとBタイプのパッ
ケージla、lbでは同一の配列番号のリード■〜[相
]が対称形に位置しているため、第1図(alに示すよ
うに実装基板5の表面にAタイプのパッケージ1aを、
その裏面の該パッケージ1aと対応する位置にBタイプ
のパッケージ1bを実装した場合、同じ配列番号のリー
ド同士が向き合うことになる。
また第1図(b)に示すように実装基板5の一表面にA
タイプ及びBタイプのパッケージla、lbをほぼ平行
に並べて実装した場合、両者の各リードは対称な位置に
くる。
タイプ及びBタイプのパッケージla、lbをほぼ平行
に並べて実装した場合、両者の各リードは対称な位置に
くる。
次に作用効果について説明する。
集積回路パッケージ1を実装基・板5に固着する方法は
従来と同様であるが、本願発明の実施例ではAタイプ及
びBタイプの2種類のパッケージを用いて実装を行なう
点が異なる。
従来と同様であるが、本願発明の実施例ではAタイプ及
びBタイプの2種類のパッケージを用いて実装を行なう
点が異なる。
まず第1図(a)に示すように両面実装する場合は、実
装基板5の表面にAタイプのパッケージ1aを固着する
とともに、その裏面の該パッケージ1aに対面する位置
にBタイプのパッケージ1bを固着する。この場合Aタ
イプのバフケージ1aのリード端子2はこれと同一番号
のBタイプのリード端子2の丁度上に位置しているため
、スルーホール8を設けることにより簡単にこれらの接
続を行なうことができる。
装基板5の表面にAタイプのパッケージ1aを固着する
とともに、その裏面の該パッケージ1aに対面する位置
にBタイプのパッケージ1bを固着する。この場合Aタ
イプのバフケージ1aのリード端子2はこれと同一番号
のBタイプのリード端子2の丁度上に位置しているため
、スルーホール8を設けることにより簡単にこれらの接
続を行なうことができる。
また、第1図(b)に示すように片面実装する場合は、
実装基Vi5の一表面にAタイプ及びBタイプのパッケ
ージla、lbをほぼ平行に並べて実装する。この場合
はAタイプの外部リード端子2はこれと同一番号のBタ
イプのパッケージの外部リード端子2と線対称の位置に
あるため、配線を交差させたり、スルーホールを設けた
りすることなく、配線の引き回しのみでこれらをつなぐ
ことができる。
実装基Vi5の一表面にAタイプ及びBタイプのパッケ
ージla、lbをほぼ平行に並べて実装する。この場合
はAタイプの外部リード端子2はこれと同一番号のBタ
イプのパッケージの外部リード端子2と線対称の位置に
あるため、配線を交差させたり、スルーホールを設けた
りすることなく、配線の引き回しのみでこれらをつなぐ
ことができる。
このように上記A、82つのタイプのパッケージla、
lbを併用することによって、第1図のように簡単にパ
フケージ同士を接続することができる。
lbを併用することによって、第1図のように簡単にパ
フケージ同士を接続することができる。
なお、上記実施例では、スモール・アウトライン・パッ
ケージ(SOP)について述べたが、これは外部リード
端子がJ型に成形加工されているプラスチック・リード
付チップ・キャリア(PLCC)や、Jリード形アウト
ラインパッケージ(SOJ)でもよい。
ケージ(SOP)について述べたが、これは外部リード
端子がJ型に成形加工されているプラスチック・リード
付チップ・キャリア(PLCC)や、Jリード形アウト
ラインパッケージ(SOJ)でもよい。
つまり、本願発明は面実装形のパッケージには全て適用
することができる。
することができる。
以上のように、本願発明に係る半導体装置によれば、外
部リード端子を下側、上側に折り曲げた第1.第2のパ
ッケージを併用したので、ICチップの実装に際して上
記2つのICパッケージ間で同番号の外部リード端子同
士を片面実装では配線の引き回しのみにより、両面実装
ではスルーホールにより簡単に接続することができると
いう効果がある。
部リード端子を下側、上側に折り曲げた第1.第2のパ
ッケージを併用したので、ICチップの実装に際して上
記2つのICパッケージ間で同番号の外部リード端子同
士を片面実装では配線の引き回しのみにより、両面実装
ではスルーホールにより簡単に接続することができると
いう効果がある。
第1図は本願発明の第1.第2の実施例による半導体装
置を説明するための図、第2図は従来の半導体装置を説
明するための図、第3図はICパッケージのリード接合
部を示す拡大図、第4図はAタイプのICパンケージを
示す図、第5図はBタイプのICパッケージを示す図で
ある。 図において、1aは第1のICパッケージ、1bは第2
のICパッケージ、2は外部リード端子、5は実装基板
、6はマウンドパッド、7はICチップ、8はスルーホ
ール、9は配線である。 なお図中同一符号は同−又は相当部分を示す。
置を説明するための図、第2図は従来の半導体装置を説
明するための図、第3図はICパッケージのリード接合
部を示す拡大図、第4図はAタイプのICパンケージを
示す図、第5図はBタイプのICパッケージを示す図で
ある。 図において、1aは第1のICパッケージ、1bは第2
のICパッケージ、2は外部リード端子、5は実装基板
、6はマウンドパッド、7はICチップ、8はスルーホ
ール、9は配線である。 なお図中同一符号は同−又は相当部分を示す。
Claims (3)
- (1)実装基板の一表面上に、その外部リードを下方に
折り曲げた第1のICパッケージと外部リードを上方に
折り曲げた第2のICパッケージとを片面実装してなる
ことを特徴とする半導体装置。 - (2)上記第1、第2のICパッケージはそれぞれ上記
実装基板上にほぼ平行にならべて片面実装したものであ
ることを特徴とする特許請求の範囲第1項記載の半導体
装置。 - (3)実装基板の表面に、その外部リードを下方に折り
曲げた第1のICパッケージを、該実装基板の裏面にそ
の外部リードを上方に折り曲げた第2のICパッケージ
をそれぞれ対面するよう両面実装してなることを特徴と
する半導体装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62130683A JPS63296292A (ja) | 1987-05-27 | 1987-05-27 | 半導体装置 |
US07/194,944 US4994896A (en) | 1987-05-27 | 1988-05-17 | Semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62130683A JPS63296292A (ja) | 1987-05-27 | 1987-05-27 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63296292A true JPS63296292A (ja) | 1988-12-02 |
Family
ID=15040118
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62130683A Pending JPS63296292A (ja) | 1987-05-27 | 1987-05-27 | 半導体装置 |
Country Status (2)
Country | Link |
---|---|
US (1) | US4994896A (ja) |
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