JPS6125392A - カラ−ビデオ信号処理装置 - Google Patents
カラ−ビデオ信号処理装置Info
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- JPS6125392A JPS6125392A JP14709684A JP14709684A JPS6125392A JP S6125392 A JPS6125392 A JP S6125392A JP 14709684 A JP14709684 A JP 14709684A JP 14709684 A JP14709684 A JP 14709684A JP S6125392 A JPS6125392 A JP S6125392A
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- color video
- video signal
- circuit
- signals
- converter
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- Pending
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- 238000005070 sampling Methods 0.000 abstract description 14
- 238000006243 chemical reaction Methods 0.000 abstract description 9
- 238000000034 method Methods 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 6
- 238000000926 separation method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/46—Colour picture communication systems
- H04N1/56—Processing of colour picture signals
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04N9/00—Details of colour television systems
- H04N9/64—Circuits for processing colour signals
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- Engineering & Computer Science (AREA)
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- Signal Processing (AREA)
- Processing Of Color Television Signals (AREA)
- Color Television Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔技術分野〕
本発明は、カラービデオ信号を処理するカラービデオ信
号処理装置に関し、特にカラービデオ信号の各成分をア
ナログ・デジタル変換(以下A/D変換)するカラービ
デオ信号処理装置に関する。
号処理装置に関し、特にカラービデオ信号の各成分をア
ナログ・デジタル変換(以下A/D変換)するカラービ
デオ信号処理装置に関する。
一般にテレビジョン信号をサンプリングする場合、第1
図のテレビ両面1の垂直方向(矢印α)に沿ってa 、
b、c・・・・・とサンプリングしA/D変換してい
た。従来のA/D変準の為の処理回路をlK2図に示す
。
図のテレビ両面1の垂直方向(矢印α)に沿ってa 、
b、c・・・・・とサンプリングしA/D変換してい
た。従来のA/D変準の為の処理回路をlK2図に示す
。
第2図において、S、 4.5は夫々入力のR,()、
B信号で各々A/D変換器6,7.8でい変換され、
デジタルデータ9,10.11が得られる。
B信号で各々A/D変換器6,7.8でい変換され、
デジタルデータ9,10.11が得られる。
12は水平同期信号でサンプリングパルス発生器13に
入力され、サンプリングパルス14を発止し、A/D変
換器6,7.8を制御している。
入力され、サンプリングパルス14を発止し、A/D変
換器6,7.8を制御している。
この場合、ビデオ信号を、サンプリングするため、サン
プリングのアパーチャが小さくなければならず、サンプ
リングの周期が、水平走査と同じ周期であっても高速の
A/D変換器が必要となるー。
プリングのアパーチャが小さくなければならず、サンプ
リングの周期が、水平走査と同じ周期であっても高速の
A/D変換器が必要となるー。
一般に高速A/’D変換器は高価で、これを3個使うこ
とになると、高価をシステムになってしまう。
とになると、高価をシステムになってしまう。
本発明は上記従来技術の欠点に鑑み、ビデオ信号の各成
分に対して単一のA/D変換器でA/D変換が可能なカ
ラービデオ信号処理装置の提供を目的としている。
分に対して単一のA/D変換器でA/D変換が可能なカ
ラービデオ信号処理装置の提供を目的としている。
生513に:入力され、サンプリングパルス発生器13
からは、サンプリングパルス14が発生し、サンプルホ
ールド回路(以下8/F1回路)15〜17、及びタイ
ミング発生器22に入力される。
からは、サンプリングパルス14が発生し、サンプルホ
ールド回路(以下8/F1回路)15〜17、及びタイ
ミング発生器22に入力される。
3〜5けそれぞれ人力R,G、B信号を示し、それぞれ
S/41回路15〜17に入力される。S/H回路15
〜17は、サンプリングパルス14のタイミングで、そ
れぞれR,G、B信号をサンプリングし、ホールドする
。S/E回路15〜17でサンプルホールドされたR、
G、B信号は、選択手段としてのアナグスイッチ回路1
8に入力されている。アナログスイッチ回路18は、タ
イミング発生器22から発生し九アナログスイッチコン
トロール信号25.24の制御によp、sA回路15〜
17の出力を選択する。アナログスイッチ回路18の出
力けA/D変換器1?lC入力され、タイミング発生器
22から発生し九A/D変換クロック25の制御でデジ
タルデータ20に変換される。
S/41回路15〜17に入力される。S/H回路15
〜17は、サンプリングパルス14のタイミングで、そ
れぞれR,G、B信号をサンプリングし、ホールドする
。S/E回路15〜17でサンプルホールドされたR、
G、B信号は、選択手段としてのアナグスイッチ回路1
8に入力されている。アナログスイッチ回路18は、タ
イミング発生器22から発生し九アナログスイッチコン
トロール信号25.24の制御によp、sA回路15〜
17の出力を選択する。アナログスイッチ回路18の出
力けA/D変換器1?lC入力され、タイミング発生器
22から発生し九A/D変換クロック25の制御でデジ
タルデータ20に変換される。
タイミング発生器22には、マスターフミック21及び
、サンプリングパルス14が入力され、アナログスイッ
チ回路1Bを制御するアナログスイッチコントロール信
号25,24、Aβ変換りσツク25、データ判別信号
26.27及びデータ 効信号28を出力している。
、サンプリングパルス14が入力され、アナログスイッ
チ回路1Bを制御するアナログスイッチコントロール信
号25,24、Aβ変換りσツク25、データ判別信号
26.27及びデータ 効信号28を出力している。
このタイミング発生器22の構成例を、第4因に示し、
そのタイミングチャートを第5図に示す。29け、プリ
センタプル・アンプ・カウンタで、サンプリングパルス
14で、置数16ナログスイツチコントロ一ル信号25
.24のタイミング信号を発生している。アナログスイ
ッチ1Bはコントロール信号25.24の状態に応じて
表1の如く制御される。
そのタイミングチャートを第5図に示す。29け、プリ
センタプル・アンプ・カウンタで、サンプリングパルス
14で、置数16ナログスイツチコントロ一ル信号25
.24のタイミング信号を発生している。アナログスイ
ッチ1Bはコントロール信号25.24の状態に応じて
表1の如く制御される。
tlにおいてLけローレベル、Hはノ為イレベルを示し
ている。
ている。
ブリセンタプル・アップカウンタ29、AND回路52
.35、D型フリツプフaンブ(以下DF? )50、
Sl、57、インバータ56はデータ有効信号28を形
成している。データ有効信号28がHの時^A変換器1
9の出力デジタルデータ20け有効である。
.35、D型フリツプフaンブ(以下DF? )50、
Sl、57、インバータ56はデータ有効信号28を形
成している。データ有効信号28がHの時^A変換器1
9の出力デジタルデータ20け有効である。
プリセッタブル・アップカウンタ29 、DFF55.
34はデータ判別信号26.27を形成している。
34はデータ判別信号26.27を形成している。
データ判別信号26 、27とR,G、B各市力データ
との関係を表2に示す。
との関係を表2に示す。
データ有効信号28及びデータ判別信号26゜27によ
り、データの受信側はデジタル出力データ20を正確K
R,G、Bの各デジタルデータを判別することが可能と
なる。
り、データの受信側はデジタル出力データ20を正確K
R,G、Bの各デジタルデータを判別することが可能と
なる。
以上説明したように、本実施例1j、 R,G、Bの
アナログ信号をそれぞれ同一タイミングでサンプルホー
ルド、このサンプルホールドした値を、順次選択し、1
個のA/D変換器で、デジタルデータに変換しでいる。
アナログ信号をそれぞれ同一タイミングでサンプルホー
ルド、このサンプルホールドした値を、順次選択し、1
個のA/D変換器で、デジタルデータに変換しでいる。
この場合、 S/11回路は、小さなマパーチャでサ
ンプリングし、ボルテージ・ドループ(Voltage
Droop)が少くなければならないが、Aρ変換器
は1水平走査期間中に15回A/D変換すれば良い。即
ちR,G、Bの各色信号をテレビ画面の垂直方向に1サ
ンプリングしデジタル信号に変換する場合A/D変換器
は、次のサンプリングまでの時間つまり、1水平走査期
間中に、5回A/D変換すればよいので高速のAρ変換
器を必要とせず、安価ICA/C変換することが可能で
ある。更に同一タイミングで各成分をサンプリングして
いるので色ずれ等が発生しない。
ンプリングし、ボルテージ・ドループ(Voltage
Droop)が少くなければならないが、Aρ変換器
は1水平走査期間中に15回A/D変換すれば良い。即
ちR,G、Bの各色信号をテレビ画面の垂直方向に1サ
ンプリングしデジタル信号に変換する場合A/D変換器
は、次のサンプリングまでの時間つまり、1水平走査期
間中に、5回A/D変換すればよいので高速のAρ変換
器を必要とせず、安価ICA/C変換することが可能で
ある。更に同一タイミングで各成分をサンプリングして
いるので色ずれ等が発生しない。
尚、本実施例においてはカラービデオ信号をR,G、B
の5包成分に分けたが、輝度宿場、■信号、Q信号に分
けることも、その他の分離方法にも適用可能である。
の5包成分に分けたが、輝度宿場、■信号、Q信号に分
けることも、その他の分離方法にも適用可能である。
以上説明した如く、本発明によればカラービデオ信号の
各成分を一つのA/D変換器でA/D変換が可能となり
、システムのコストに影響を与フ えるA/D変換器を削減できるので〜ストダウンに大六
く寄与する。
各成分を一つのA/D変換器でA/D変換が可能となり
、システムのコストに影響を与フ えるA/D変換器を削減できるので〜ストダウンに大六
く寄与する。
第1図はビデオ信号のサンプリングの説明図、第2図れ
従来のサンプリング回路図、 @3図は本実施例のカラービデオ信号の処理回路図、 第4図は第5図のタイミング発生器22の詳細回路図、 第5図は第3図及び第4■の各部の信号波形図である。 図において、 15.16.17はサンプルホールド回路1Bは選択回
路としてのアナログスイッチ19#″jアナログ・デジ
タル変換器 を夫々示す。 出厩人 キャノン株式会社
従来のサンプリング回路図、 @3図は本実施例のカラービデオ信号の処理回路図、 第4図は第5図のタイミング発生器22の詳細回路図、 第5図は第3図及び第4■の各部の信号波形図である。 図において、 15.16.17はサンプルホールド回路1Bは選択回
路としてのアナログスイッチ19#″jアナログ・デジ
タル変換器 を夫々示す。 出厩人 キャノン株式会社
Claims (1)
- カラービデオ信号の各成分のそれぞれをサンプルホール
ドする複数個のサンプルホールド回路、前記複数個のサ
ンプルホールド回路の出力を選択する選択回路、前記選
択回路の出力をアナログデジタル変換する、アナログ・
デジタル変換器からなることを特徴とするカラービデオ
信号処理装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14709684A JPS6125392A (ja) | 1984-07-16 | 1984-07-16 | カラ−ビデオ信号処理装置 |
US07/488,539 US4974058A (en) | 1984-07-16 | 1990-02-28 | Color signal processing apparatus using a plurality of sample-and-hold circuits and a single switched A/D converter |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14709684A JPS6125392A (ja) | 1984-07-16 | 1984-07-16 | カラ−ビデオ信号処理装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6125392A true JPS6125392A (ja) | 1986-02-04 |
Family
ID=15422391
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP14709684A Pending JPS6125392A (ja) | 1984-07-16 | 1984-07-16 | カラ−ビデオ信号処理装置 |
Country Status (2)
Country | Link |
---|---|
US (1) | US4974058A (ja) |
JP (1) | JPS6125392A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63260389A (ja) * | 1987-04-17 | 1988-10-27 | Seiko Epson Corp | A/d変換回路 |
JP2006267016A (ja) * | 2005-03-25 | 2006-10-05 | Honda Elesys Co Ltd | レーダ装置 |
Families Citing this family (8)
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JPH05308599A (ja) * | 1991-12-30 | 1993-11-19 | Samsung Electron Co Ltd | プリンティング方法及びこれに適合したプリンティング装置 |
JP3166494B2 (ja) * | 1994-07-27 | 2001-05-14 | 松下電器産業株式会社 | 遅延検波方法および装置 |
US6925428B1 (en) | 2000-05-19 | 2005-08-02 | The United States Of America As Represented By The Secretary Of The Navy | Multifunctional, multi-input, missile signal measurement apparatus |
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-
1984
- 1984-07-16 JP JP14709684A patent/JPS6125392A/ja active Pending
-
1990
- 1990-02-28 US US07/488,539 patent/US4974058A/en not_active Expired - Lifetime
Cited By (2)
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Also Published As
Publication number | Publication date |
---|---|
US4974058A (en) | 1990-11-27 |
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