JPH06122260A - 画像記録制御回路 - Google Patents
画像記録制御回路Info
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- JPH06122260A JPH06122260A JP4273282A JP27328292A JPH06122260A JP H06122260 A JPH06122260 A JP H06122260A JP 4273282 A JP4273282 A JP 4273282A JP 27328292 A JP27328292 A JP 27328292A JP H06122260 A JPH06122260 A JP H06122260A
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Abstract
(57)【要約】
【目的】 ソフトウェアによる画像処理を用いることな
く、高速に任意の幅の余白を作り出すこと、及び、ソフ
トウェアによる画像処理を用いることなく、印刷位置を
調整することのできる画像記録制御回路を提供するこ
と。 【構成】 画像メモリから画像データを入力し、そのデ
ータを加工してプリンタ等の印刷手段に出力する画像記
録制御回路２６において、前記画像メモリの画像データ
を送出する画像データ送出手段から前記印刷手段に送出
する各スキャンラインの画像データの前端部分をマスク
する印刷前端マスク回路２９と、後端部分をマスクする
印刷後端マスク回路３０と、前記印刷手段のスキャンラ
イン毎の印刷開始タイミングに対して各スキャンライン
の画像データの前記印刷手段への送出開始を遅延させる
印刷位置調整回路２８とを設けた。
く、高速に任意の幅の余白を作り出すこと、及び、ソフ
トウェアによる画像処理を用いることなく、印刷位置を
調整することのできる画像記録制御回路を提供するこ
と。 【構成】 画像メモリから画像データを入力し、そのデ
ータを加工してプリンタ等の印刷手段に出力する画像記
録制御回路２６において、前記画像メモリの画像データ
を送出する画像データ送出手段から前記印刷手段に送出
する各スキャンラインの画像データの前端部分をマスク
する印刷前端マスク回路２９と、後端部分をマスクする
印刷後端マスク回路３０と、前記印刷手段のスキャンラ
イン毎の印刷開始タイミングに対して各スキャンライン
の画像データの前記印刷手段への送出開始を遅延させる
印刷位置調整回路２８とを設けた。
Description
【０００１】
【産業上の利用分野】本発明は、画像メモリから画像デ
ータを入力し、そのデータを加工してプリンタ等の印刷
手段に出力する画像記録制御回路に関する。
ータを入力し、そのデータを加工してプリンタ等の印刷
手段に出力する画像記録制御回路に関する。
【０００２】
【従来の技術】ファクシミリ装置等で一般的に使用され
るＡ４のカット紙は、幅が２１０mmあるが、普通左右両
端数mmを余白として、その部分には印刷をしていない。
しかし、一般的にファクシミリ装置は、ほぼ用紙幅いっ
ぱいに印字可能の印刷ヘッドを持った印刷装置と、それ
に対応した画像メモリとを持っている。また、ファクシ
ミリ装置のスキャナ装置もほぼ用紙幅の読み込みヘッド
を持っている。そのため、伝送されてきて画像メモリに
溜め込まれている画像データをそのまま印刷すると、余
白部分にも画像が載ってしまい、また、元の原稿の余白
部分に画像が無かったとしても、原稿の汚れやノイズ等
の為に余白を汚してしまうことがあり、きれいな余白が
得られなかった。
るＡ４のカット紙は、幅が２１０mmあるが、普通左右両
端数mmを余白として、その部分には印刷をしていない。
しかし、一般的にファクシミリ装置は、ほぼ用紙幅いっ
ぱいに印字可能の印刷ヘッドを持った印刷装置と、それ
に対応した画像メモリとを持っている。また、ファクシ
ミリ装置のスキャナ装置もほぼ用紙幅の読み込みヘッド
を持っている。そのため、伝送されてきて画像メモリに
溜め込まれている画像データをそのまま印刷すると、余
白部分にも画像が載ってしまい、また、元の原稿の余白
部分に画像が無かったとしても、原稿の汚れやノイズ等
の為に余白を汚してしまうことがあり、きれいな余白が
得られなかった。
【０００３】そこで、図８に示すようにソフトウェアで
画像メモリ１の余白に対応する部分Ａに白データをいれ
て、その画像データを印刷する方法があった。
画像メモリ１の余白に対応する部分Ａに白データをいれ
て、その画像データを印刷する方法があった。
【０００４】しかし、周知のように画像データはデータ
量が非常に多く、画像メモリ１の余白に対応する部分Ａ
に白データをいれるだけでも、時間がかかってしまって
いた。
量が非常に多く、画像メモリ１の余白に対応する部分Ａ
に白データをいれるだけでも、時間がかかってしまって
いた。
【０００５】ところで、従来のファクシミリ装置の構成
を図９及び図１０に基づいて説明する。
を図９及び図１０に基づいて説明する。
【０００６】原稿を読み取るスキャナブロック２、用紙
送りモータ３を駆動するモータドライバ４が接続された
Ｉ／Ｏポート５、システム用のＲＡＭ６（Ｒandom Ａcc
essＭemory ）、画像処理時のバッファとなるＲＡＭ
７、ＲＯＭ８(Ｒead Ｏnly Ｍemory )、レーザープリン
タ９と命令及びステータスのやり取りをするＡＳＩＣ１
０（Ａpplication Ｓpecific Ｉntegrated Ｃircui
t）、密度変換縮小回路１１、画像メモリであるページ
メモリ１２、センサブロック１３、キーボードブロック
１４、表示ブロック１５、公衆回線１６に接続されるＮ
ＣＵ１７(Ｎetwork Ｃontrol Ｕnit )が接続されたモデ
ムブロック１８、符号化と復号をするＣＯＤＥＣ１９
（Ｃoder and Ｄecoder）が画像データ送出手段等とし
て動作するＣＰＵ２０（Ｃentral Ｐrocessing Ｕnit）
に接続されている。
送りモータ３を駆動するモータドライバ４が接続された
Ｉ／Ｏポート５、システム用のＲＡＭ６（Ｒandom Ａcc
essＭemory ）、画像処理時のバッファとなるＲＡＭ
７、ＲＯＭ８(Ｒead Ｏnly Ｍemory )、レーザープリン
タ９と命令及びステータスのやり取りをするＡＳＩＣ１
０（Ａpplication Ｓpecific Ｉntegrated Ｃircui
t）、密度変換縮小回路１１、画像メモリであるページ
メモリ１２、センサブロック１３、キーボードブロック
１４、表示ブロック１５、公衆回線１６に接続されるＮ
ＣＵ１７(Ｎetwork Ｃontrol Ｕnit )が接続されたモデ
ムブロック１８、符号化と復号をするＣＯＤＥＣ１９
（Ｃoder and Ｄecoder）が画像データ送出手段等とし
て動作するＣＰＵ２０（Ｃentral Ｐrocessing Ｕnit）
に接続されている。
【０００７】また、前記レーザープリンタ９は画像デー
タを入力するために前記ページメモリ１２に前記密度変
換縮小回路１１を介して接続されている。ここで、この
密度変換縮小回路１１は図１０に示すようにラッチＩＣ
２１を介してデータバスに接続された密度変換回路２２
と縮小回路２３とから形成されている。この密度変換回
路２２は前記ページメモリ１２内の画像データの単位長
さあたりの画素数を前記レーザープリンタ９の単位長さ
あたりの印刷画素数に一致するように変換してから出力
するもので、つまり、例えば、解像度８画素／mmのスキ
ャナで読み込んだ画像データを解像度１６画素／mmのプ
リンタで印刷できるようにしたものである。また、前記
縮小回路２３は縮小印刷をする際に入力される画像デー
タを縮小してから出力するようにしたものである。
タを入力するために前記ページメモリ１２に前記密度変
換縮小回路１１を介して接続されている。ここで、この
密度変換縮小回路１１は図１０に示すようにラッチＩＣ
２１を介してデータバスに接続された密度変換回路２２
と縮小回路２３とから形成されている。この密度変換回
路２２は前記ページメモリ１２内の画像データの単位長
さあたりの画素数を前記レーザープリンタ９の単位長さ
あたりの印刷画素数に一致するように変換してから出力
するもので、つまり、例えば、解像度８画素／mmのスキ
ャナで読み込んだ画像データを解像度１６画素／mmのプ
リンタで印刷できるようにしたものである。また、前記
縮小回路２３は縮小印刷をする際に入力される画像デー
タを縮小してから出力するようにしたものである。
【０００８】そして、ラインコントロール回路２４が前
記ページメモリ１２に接続され、このラインコントロー
ル回路２４には前記レーザープリンタ９から出力される
スキャンライン同期信号ＬＳＹＮＣ（以下ＬＳＹＮＣと
記す）が入力されている。
記ページメモリ１２に接続され、このラインコントロー
ル回路２４には前記レーザープリンタ９から出力される
スキャンライン同期信号ＬＳＹＮＣ（以下ＬＳＹＮＣと
記す）が入力されている。
【０００９】なお、電力を供給する電源ユニット２５が
図示しない各電源端子に接続されている。
図示しない各電源端子に接続されている。
【００１０】このような構成において、レーザープリン
タ９の印刷動作時には、レーザープリンタ９によって一
スキャンライン印刷動作毎にＬＳＹＮＣが出力される
が、このＬＳＹＮＣが出力されるごとにページメモリ１
２内の各スキャンラインの先頭アドレスが順に示され、
さらに、ＬＳＹＮＣが出ている間ページメモリ１２はイ
ネーブルとされる。
タ９の印刷動作時には、レーザープリンタ９によって一
スキャンライン印刷動作毎にＬＳＹＮＣが出力される
が、このＬＳＹＮＣが出力されるごとにページメモリ１
２内の各スキャンラインの先頭アドレスが順に示され、
さらに、ＬＳＹＮＣが出ている間ページメモリ１２はイ
ネーブルとされる。
【００１１】そして、レーザープリンタ９によって出力
される一画素毎の画素同期信号ＶＣＬＫ（以下ＶＣＬＫ
と記す）に従って画素データがＶＤＡＴＡとしてレーザ
ープリンタ９に入力されて印刷が行われる。
される一画素毎の画素同期信号ＶＣＬＫ（以下ＶＣＬＫ
と記す）に従って画素データがＶＤＡＴＡとしてレーザ
ープリンタ９に入力されて印刷が行われる。
【００１２】ところで、このファクシミリ装置の縮小回
路２３は、縮小率に合わせて画像データの画素を間引
き、間引いた分を詰めて出力するもので、そのため、縮
小回路２３を働かせて印刷を行うと図１１に示すように
レーザープリンタ９の印刷範囲Ｂの左上隅に縮小された
画像が印刷されてしまい、見た目のバランスが悪く、好
ましいものではなかった。
路２３は、縮小率に合わせて画像データの画素を間引
き、間引いた分を詰めて出力するもので、そのため、縮
小回路２３を働かせて印刷を行うと図１１に示すように
レーザープリンタ９の印刷範囲Ｂの左上隅に縮小された
画像が印刷されてしまい、見た目のバランスが悪く、好
ましいものではなかった。
【００１３】
【発明が解決しようとする課題】このため、本発明で
は、ソフトウェアによる画像処理を用いることなく任意
の幅の余白を作り出すことができると共に、ソフトウェ
アによる画像処理を用いることなく印刷位置を調整する
ことができる画像記録制御回路を提供することを目的と
する。
は、ソフトウェアによる画像処理を用いることなく任意
の幅の余白を作り出すことができると共に、ソフトウェ
アによる画像処理を用いることなく印刷位置を調整する
ことができる画像記録制御回路を提供することを目的と
する。
【００１４】
【課題を解決するための手段】画像メモリから画像デー
タを入力し、そのデータを加工してプリンタ等の印刷手
段に出力する画像記録制御回路において、前記画像メモ
リの画像データを送出する画像データ送出手段から前記
印刷手段に送出する各スキャンラインの画像データの前
端部分をマスクする印刷前端マスク回路と、後端部分を
マスクする印刷後端マスク回路と、前記印刷手段のスキ
ャンライン毎の印刷開始タイミングに対して各スキャン
ラインの画像データの前記印刷手段への送出開始を遅延
させる印刷位置調整回路とを設けた。
タを入力し、そのデータを加工してプリンタ等の印刷手
段に出力する画像記録制御回路において、前記画像メモ
リの画像データを送出する画像データ送出手段から前記
印刷手段に送出する各スキャンラインの画像データの前
端部分をマスクする印刷前端マスク回路と、後端部分を
マスクする印刷後端マスク回路と、前記印刷手段のスキ
ャンライン毎の印刷開始タイミングに対して各スキャン
ラインの画像データの前記印刷手段への送出開始を遅延
させる印刷位置調整回路とを設けた。
【００１５】
【作用】本発明によれば、印刷前端マスク回路と印刷後
端マスク回路とにより、画像データ送出手段から印刷手
段に送出される各スキャンラインの画像データの前端と
後端とがマスキングされてから送出されるので、この前
端と後端とがマスキングされたスキャンラインの画像デ
ータで印刷手段は印刷をすることになり、そのため、画
像の両端は余白となる。また、印刷位置調整回路によ
り、印刷手段でのスキャンラインの印刷開始タイミング
に対してスキャンラインの画像データの印刷手段への送
出開始が遅延されるので、印刷手段での画像印刷位置を
シフトすることができる。
端マスク回路とにより、画像データ送出手段から印刷手
段に送出される各スキャンラインの画像データの前端と
後端とがマスキングされてから送出されるので、この前
端と後端とがマスキングされたスキャンラインの画像デ
ータで印刷手段は印刷をすることになり、そのため、画
像の両端は余白となる。また、印刷位置調整回路によ
り、印刷手段でのスキャンラインの印刷開始タイミング
に対してスキャンラインの画像データの印刷手段への送
出開始が遅延されるので、印刷手段での画像印刷位置を
シフトすることができる。
【００１６】
【実施例】本発明の一実施例を図１ないし図７に基づい
て説明する。前記従来例で示した部分と同一部分は同一
符号を用いて示す。本実施例は図２に示すように従来例
に画像記録制御回路２６を追加したもので、従来例の、
密度変換縮小回路１１から印刷手段であるレーザープリ
ンタ９に画像データを送出するＶＤＡＴＡ信号線及び、
レーザープリンタ９からラインコントロール回路２４に
ＬＳＹＮＣを送出するＬＳＹＮＣ信号線に画像記録制御
回路２６を介在させたものである。
て説明する。前記従来例で示した部分と同一部分は同一
符号を用いて示す。本実施例は図２に示すように従来例
に画像記録制御回路２６を追加したもので、従来例の、
密度変換縮小回路１１から印刷手段であるレーザープリ
ンタ９に画像データを送出するＶＤＡＴＡ信号線及び、
レーザープリンタ９からラインコントロール回路２４に
ＬＳＹＮＣを送出するＬＳＹＮＣ信号線に画像記録制御
回路２６を介在させたものである。
【００１７】この画像記録制御回路２６は密度変換縮小
回路１１から入力した一スキャンラインの画像データＩ
ＤＡＴＡ１の前端部及び後端部をマスクしてＶＤＡＴＡ
として出力し、その結果印刷される画像の左端と右端と
に余白を作り出し、さらに、レーザープリンタ９から入
力したＬＳＹＮＣの立下がり（“Ｌ”でイネーブル）を
遅延させてＬＳＹＮＣＢとして出力し、その結果画像を
シフトさせて印刷させるものである。
回路１１から入力した一スキャンラインの画像データＩ
ＤＡＴＡ１の前端部及び後端部をマスクしてＶＤＡＴＡ
として出力し、その結果印刷される画像の左端と右端と
に余白を作り出し、さらに、レーザープリンタ９から入
力したＬＳＹＮＣの立下がり（“Ｌ”でイネーブル）を
遅延させてＬＳＹＮＣＢとして出力し、その結果画像を
シフトさせて印刷させるものである。
【００１８】この画像記録制御回路２６の詳細を図１に
基づいて説明する。基本的には、画像データを入出力と
して余白を作り出すマスク回路２７と、スキャンライン
同期信号を入出力として印刷位置をシフトする印刷位置
調整回路２８とからなっている。
基づいて説明する。基本的には、画像データを入出力と
して余白を作り出すマスク回路２７と、スキャンライン
同期信号を入出力として印刷位置をシフトする印刷位置
調整回路２８とからなっている。
【００１９】まず、前記マスク回路２７は、印刷前端マ
スク回路２９と印刷後端マスク回路３０とＡＮＤ回路３
１とから形成されている。
スク回路２９と印刷後端マスク回路３０とＡＮＤ回路３
１とから形成されている。
【００２０】そして、前記ＡＮＤ回路３１に、前記印刷
前端マスク回路２９の出力（Ａ１）と前記印刷後端マス
ク回路３０の出力（Ａ２）と本マスク回路２７の入力で
ある画像データＩＤＡＴＡ１とが入力され、その結果が
本マスク回路２７の出力である画像データＶＤＡＴＡと
して出力されている。
前端マスク回路２９の出力（Ａ１）と前記印刷後端マス
ク回路３０の出力（Ａ２）と本マスク回路２７の入力で
ある画像データＩＤＡＴＡ１とが入力され、その結果が
本マスク回路２７の出力である画像データＶＤＡＴＡと
して出力されている。
【００２１】前記印刷前端マスク回路２９は、レーザー
プリンタ９の励起レーザーの照射位置（以下印刷ヘッド
と記す）が、設定された位置（印刷左端からの画素数で
設定）に達するまで入力した画素データの“Ｈ”
（黒）、“Ｌ”（白）によらず、出力する画素データの
値を“Ｌ”（白）として出力するためのもので、そのた
め、データバスでＣＰＵ２０から送られてくる設定値
（画素数）を保存するラッチＩＣ３２と、ＶＣＬＫをカ
ウントするカウンタ３３と、これらのカウンタ３３と前
記ラッチＩＣ３２との値を比較する比較回路３４と、こ
の比較回路３４からパルスが入ると出力状態を反転させ
て保持すフリップフロップ回路３５とから形成され、前
記フリップフロップ回路３５の出力が前記ＡＮＤ回路３
１にむけて出力されている。
プリンタ９の励起レーザーの照射位置（以下印刷ヘッド
と記す）が、設定された位置（印刷左端からの画素数で
設定）に達するまで入力した画素データの“Ｈ”
（黒）、“Ｌ”（白）によらず、出力する画素データの
値を“Ｌ”（白）として出力するためのもので、そのた
め、データバスでＣＰＵ２０から送られてくる設定値
（画素数）を保存するラッチＩＣ３２と、ＶＣＬＫをカ
ウントするカウンタ３３と、これらのカウンタ３３と前
記ラッチＩＣ３２との値を比較する比較回路３４と、こ
の比較回路３４からパルスが入ると出力状態を反転させ
て保持すフリップフロップ回路３５とから形成され、前
記フリップフロップ回路３５の出力が前記ＡＮＤ回路３
１にむけて出力されている。
【００２２】前記印刷後端マスク回路３０は、レーザー
プリンタ９の印刷ヘッドが、設定された位置（印刷前端
からの画素数で設定）に達するとそれ以降は、入力した
画素データの“Ｈ”（黒）、“Ｌ”（白）によらず、出
力する画素データの値を“Ｌ”（白）として出力するた
めのもので、そのため、データバスでＣＰＵ２０から送
られてくる設定値（画素数）を保存するラッチＩＣ３６
と、ＶＣＬＫをカウントするカウンタ３７と、これらの
カウンタ３７と前記ラッチＩＣ３６との値を比較する比
較回路３８と、この比較回路３８からパルスが入ると出
力状態を反転させて保持するフリップフロップ回路３９
と、このフリップフロップ回路３９の出力を反転する反
転回路４０とから形成され、前記反転回路４０の出力が
前記ＡＮＤ回路３１へ向けて出力されている。
プリンタ９の印刷ヘッドが、設定された位置（印刷前端
からの画素数で設定）に達するとそれ以降は、入力した
画素データの“Ｈ”（黒）、“Ｌ”（白）によらず、出
力する画素データの値を“Ｌ”（白）として出力するた
めのもので、そのため、データバスでＣＰＵ２０から送
られてくる設定値（画素数）を保存するラッチＩＣ３６
と、ＶＣＬＫをカウントするカウンタ３７と、これらの
カウンタ３７と前記ラッチＩＣ３６との値を比較する比
較回路３８と、この比較回路３８からパルスが入ると出
力状態を反転させて保持するフリップフロップ回路３９
と、このフリップフロップ回路３９の出力を反転する反
転回路４０とから形成され、前記反転回路４０の出力が
前記ＡＮＤ回路３１へ向けて出力されている。
【００２３】つぎに、印刷位置調整回路２８は、出力シ
フト回路４１と、ＬＳＹＮＣセレクタ回路４２と、ＯＲ
回路４３とから形成されている。
フト回路４１と、ＬＳＹＮＣセレクタ回路４２と、ＯＲ
回路４３とから形成されている。
【００２４】そして、前記セレクタ回路４２に前記出力
シフト回路４１の出力と本印刷位置調整回路２８の入力
であるＬＳＹＮＣとＣＰＵ２０からの制御ビットが入力
され、前記ＯＲ回路４３に、前記セレクタ回路４２の出
力が入力され、その結果が本印刷位置調整回路２８の出
力であるＬＳＹＮＣＢとして出力されている。しかし、
この印刷位置調整回路２８は、前記セレクタ回路４２を
省いて、前記出力シフト回路４１の出力とＬＳＹＮＣと
を前記ＯＲ回路４３に直接入力したものと基本的には等
価で、動作の説明はこの等価回路でできる。この等価回
路で省略した前記セレクタ回路４２は、入力であるＬＳ
ＹＮＣと出力であるＬＳＹＮＣＢとを選択的にスルーに
することができるようにした回路で、ラッチＩＣ２１に
収納されている制御ビットが“Ｌ”ならばスルーにな
り、“Ｈ”ならば前記等価回路の動作をするように設計
されている。
シフト回路４１の出力と本印刷位置調整回路２８の入力
であるＬＳＹＮＣとＣＰＵ２０からの制御ビットが入力
され、前記ＯＲ回路４３に、前記セレクタ回路４２の出
力が入力され、その結果が本印刷位置調整回路２８の出
力であるＬＳＹＮＣＢとして出力されている。しかし、
この印刷位置調整回路２８は、前記セレクタ回路４２を
省いて、前記出力シフト回路４１の出力とＬＳＹＮＣと
を前記ＯＲ回路４３に直接入力したものと基本的には等
価で、動作の説明はこの等価回路でできる。この等価回
路で省略した前記セレクタ回路４２は、入力であるＬＳ
ＹＮＣと出力であるＬＳＹＮＣＢとを選択的にスルーに
することができるようにした回路で、ラッチＩＣ２１に
収納されている制御ビットが“Ｌ”ならばスルーにな
り、“Ｈ”ならば前記等価回路の動作をするように設計
されている。
【００２５】前記出力シフト回路４１は、レーザープリ
ンタ９の印刷ヘッドが、設定された位置（印刷前端から
の画素数で設定）に達するまで、入力しているスキャン
ライン同期信号がイネーブルになっても、ディスイネー
ブルとして出力し、画像メモリであるページメモリ１２
からのレーザープリンタ９へのデータ送出を印刷開始か
ら遅らせるためのもので、そのため、データバスでＣＰ
Ｕ２０から送られてくる設定値（画素数）を保存するラ
ッチＩＣ４４と、ＶＣＬＫをカウントするカウンタ４５
と、これらのカウンタ４５と前記ラッチＩＣ４４との値
を比較する比較回路４６と、この比較回路４６からパル
スが入ると出力状態を反転させて保持するフリップフロ
ップ回路４７と、このフリップフロップ回路４７の出力
を反転する反転回路４８とから形成され、前記反転回路
４８の出力が前記ＯＲ回路４３へ向けて出力されてい
る。
ンタ９の印刷ヘッドが、設定された位置（印刷前端から
の画素数で設定）に達するまで、入力しているスキャン
ライン同期信号がイネーブルになっても、ディスイネー
ブルとして出力し、画像メモリであるページメモリ１２
からのレーザープリンタ９へのデータ送出を印刷開始か
ら遅らせるためのもので、そのため、データバスでＣＰ
Ｕ２０から送られてくる設定値（画素数）を保存するラ
ッチＩＣ４４と、ＶＣＬＫをカウントするカウンタ４５
と、これらのカウンタ４５と前記ラッチＩＣ４４との値
を比較する比較回路４６と、この比較回路４６からパル
スが入ると出力状態を反転させて保持するフリップフロ
ップ回路４７と、このフリップフロップ回路４７の出力
を反転する反転回路４８とから形成され、前記反転回路
４８の出力が前記ＯＲ回路４３へ向けて出力されてい
る。
【００２６】なお、ＬＳＹＮＣを反転したものが前記各
カウンタ３３，３７，４５のイネーブル端子と前記各フ
リップフロップ回路３５，３９，４７のリセット端子に
接続され、ＶＣＬＫが前記各カウンタ３３，３７，４５
に入力されている。
カウンタ３３，３７，４５のイネーブル端子と前記各フ
リップフロップ回路３５，３９，４７のリセット端子に
接続され、ＶＣＬＫが前記各カウンタ３３，３７，４５
に入力されている。
【００２７】このような構成において、例えば、図３に
示すようにレーザープリンタ９の印刷範囲Ｂ内の左端に
とじ代Ｃのある用紙に印刷するときに、原稿範囲Ｄに元
の原稿の幅が一致するように縮小率を設定し、そして印
刷開始点を原稿範囲Ｄの左端であるＥ点に設定して印刷
を開始すれば、縮小した原稿を全体的に右にシフトして
原稿範囲Ｄに印刷することができるので、大変便利であ
る。
示すようにレーザープリンタ９の印刷範囲Ｂ内の左端に
とじ代Ｃのある用紙に印刷するときに、原稿範囲Ｄに元
の原稿の幅が一致するように縮小率を設定し、そして印
刷開始点を原稿範囲Ｄの左端であるＥ点に設定して印刷
を開始すれば、縮小した原稿を全体的に右にシフトして
原稿範囲Ｄに印刷することができるので、大変便利であ
る。
【００２８】この印刷の過程を図４に示すタイミングチ
ャートに基づいて説明する。なお、印字開始点Ｅ点はレ
ーザープリンタ９の印刷範囲Ｂの左端から３２０画素と
し、３２０画素から３３６画素までと３１００画素以降
は余白Ｆと設定する。また、画像データの密度変換と縮
小は従来の密度変換縮小回路１１で行われるので、ここ
では詳しい説明は省くが、図５に示すように、ページメ
モリ１２に、原稿範囲Ｄに幅が一致するように密度変換
縮小回路１１で縮小された原稿データが収納されてい
て、このページメモリ１２にＩＤＡＴＡ１信号線が直接
接続されていると仮想すれば良い。
ャートに基づいて説明する。なお、印字開始点Ｅ点はレ
ーザープリンタ９の印刷範囲Ｂの左端から３２０画素と
し、３２０画素から３３６画素までと３１００画素以降
は余白Ｆと設定する。また、画像データの密度変換と縮
小は従来の密度変換縮小回路１１で行われるので、ここ
では詳しい説明は省くが、図５に示すように、ページメ
モリ１２に、原稿範囲Ｄに幅が一致するように密度変換
縮小回路１１で縮小された原稿データが収納されてい
て、このページメモリ１２にＩＤＡＴＡ１信号線が直接
接続されていると仮想すれば良い。
【００２９】まず、ＣＰＵ２０によって、原稿全体を印
刷範囲の左端から３２０画素だけ右にシフトして印刷す
るため、ラッチＩＣ４４に３２０が書き込まれ、さらに
原稿をマスクして余白とするため、ラッチＩＣ３２に３
３６が、ラッチＩＣ３６に３１００が書き込まれる。
刷範囲の左端から３２０画素だけ右にシフトして印刷す
るため、ラッチＩＣ４４に３２０が書き込まれ、さらに
原稿をマスクして余白とするため、ラッチＩＣ３２に３
３６が、ラッチＩＣ３６に３１００が書き込まれる。
【００３０】そして、レーザープリンタ９が印字動作を
始めると、ＬＳＹＮＣが出力される（ディスイネーブル
からイネーブル（“Ｌ”）にされる）（タイミング
１）。するとカウンタ３３，３７，４５がイネーブルと
なりＶＣＬＫをカウントし始める。そして、印刷ヘッド
が３２０画素目まで来ると、比較回路４６からパルスが
出されＬＳＹＮＣＢが出力され（ディスイネーブルから
イネーブルとされ）、ＩＤＡＴＡ１の入力が開始される
（タイミング２）。そして、印刷ヘッドが３３６画素目
まで来ると、比較回路３４からパルスが出され印刷前端
マスク回路２９の出力（Ａ１）が“Ｈ”となり、入力画
像をマスクして余白を作成するために今までＩＤＡＴＡ
１によらず常に“Ｌ”（白）だったＶＤＡＴＡがＩＤＡ
ＴＡ１に即して出力され始める（タイミング３）。そし
て、印刷ヘッドが３１００画素目まで来ると、比較回路
３８からパルスが出され印刷後端マスク回路３０の出力
（Ａ２）が“Ｌ”となり、ＶＤＡＴＡが再びＩＤＡＴＡ
１によらず“Ｌ”（白）となり、以降の入力画像はマス
クされ白として出力される（タイミング４）。そして、
印刷ヘッドがレーザープリンタ９の印刷範囲後端まで来
ると、ＬＳＹＮＣの出力が停止され（“Ｈ”）、ＬＳＹ
ＮＣＢの出力も停止される（タイミング５）。
始めると、ＬＳＹＮＣが出力される（ディスイネーブル
からイネーブル（“Ｌ”）にされる）（タイミング
１）。するとカウンタ３３，３７，４５がイネーブルと
なりＶＣＬＫをカウントし始める。そして、印刷ヘッド
が３２０画素目まで来ると、比較回路４６からパルスが
出されＬＳＹＮＣＢが出力され（ディスイネーブルから
イネーブルとされ）、ＩＤＡＴＡ１の入力が開始される
（タイミング２）。そして、印刷ヘッドが３３６画素目
まで来ると、比較回路３４からパルスが出され印刷前端
マスク回路２９の出力（Ａ１）が“Ｈ”となり、入力画
像をマスクして余白を作成するために今までＩＤＡＴＡ
１によらず常に“Ｌ”（白）だったＶＤＡＴＡがＩＤＡ
ＴＡ１に即して出力され始める（タイミング３）。そし
て、印刷ヘッドが３１００画素目まで来ると、比較回路
３８からパルスが出され印刷後端マスク回路３０の出力
（Ａ２）が“Ｌ”となり、ＶＤＡＴＡが再びＩＤＡＴＡ
１によらず“Ｌ”（白）となり、以降の入力画像はマス
クされ白として出力される（タイミング４）。そして、
印刷ヘッドがレーザープリンタ９の印刷範囲後端まで来
ると、ＬＳＹＮＣの出力が停止され（“Ｈ”）、ＬＳＹ
ＮＣＢの出力も停止される（タイミング５）。
【００３１】以上のタイミング１からタイミング５まで
を各スキャンラインごとに繰り返して印刷すれば、全体
に右にシフトして原稿を印刷することができる。
を各スキャンラインごとに繰り返して印刷すれば、全体
に右にシフトして原稿を印刷することができる。
【００３２】また、印刷の縦方向へのシフトは、ラッチ
ＩＣ４４に無限大を書き込んでおき、ＣＰＵ２０でＬＳ
ＹＮＣをカウントして、印刷ヘッドが印刷開始点Ｅを含
むスキャンラインに達した時に横方向の設定値（３２
０）をラッチＩＣ４４に書き込むするようにすれば良
い。
ＩＣ４４に無限大を書き込んでおき、ＣＰＵ２０でＬＳ
ＹＮＣをカウントして、印刷ヘッドが印刷開始点Ｅを含
むスキャンラインに達した時に横方向の設定値（３２
０）をラッチＩＣ４４に書き込むするようにすれば良
い。
【００３３】また、原稿上下端にも原稿をマスクする余
白を設定するときには、ラッチＩＣ３６にゼロを書き込
んで置けばそのスキャンラインをすべて白にすることが
できる。
白を設定するときには、ラッチＩＣ３６にゼロを書き込
んで置けばそのスキャンラインをすべて白にすることが
できる。
【００３４】さらに、図６に示すように原稿Ｇの必要な
部分Ｈだけを取り出して、図７に示すように用紙Ｉの別
の位置に印刷することもできる。
部分Ｈだけを取り出して、図７に示すように用紙Ｉの別
の位置に印刷することもできる。
【００３５】なお、本実施例では余白を設定したが、余
白なしと設定することや、両端でなく片側だけに設定す
ることもできるものである。
白なしと設定することや、両端でなく片側だけに設定す
ることもできるものである。
【００３６】また、画像メモリは必ずしもページメモリ
に限定されず、印刷手段の処理速度等の整合性によって
適宜なフロッピディスク等の画像メモリを採用すること
ができる。
に限定されず、印刷手段の処理速度等の整合性によって
適宜なフロッピディスク等の画像メモリを採用すること
ができる。
【００３７】
【発明の効果】本発明は上述のように、画像メモリから
画像データを入力し、そのデータを加工してプリンタ等
の印刷手段に出力する画像記録制御回路において、前記
画像メモリの画像データを送出する画像データ送出手段
から前記印刷手段に送出する各スキャンラインの画像デ
ータの前端部分をマスクする印刷前端マスク回路と、後
端部分をマスクする印刷後端マスク回路と、前記印刷手
段のスキャンライン毎の印刷開始タイミングに対して各
スキャンラインの画像データの前記印刷手段への送出開
始を遅延させる印刷位置調整回路とを設けたので、印刷
前端マスク回路と印刷後端マスク回路とにより、画像デ
ータ送出手段から印刷手段に送出される各スキャンライ
ンの画像データの前端と後端とをマスキングすることが
でき、この前端と後端とがマスキングされたスキャンラ
インの画像データで印刷手段は印刷をすることになり、
そのため、印刷される画像の両端をソフトウェアによる
画像処理なしに余白とすることができ、処理が速く使用
者を待たせることがないものとなる。また、印刷位置調
整回路により、印刷手段でのスキャンラインの印刷開始
タイミングに対して各スキャンラインの画像データの印
刷手段への送出開始を遅延させることができ、そのた
め、印刷手段での画像印刷位置をソフトウェアによる画
像処理なしに任意にシフトすることができ、処理が速く
使用者を待たせることがないものとなる。
画像データを入力し、そのデータを加工してプリンタ等
の印刷手段に出力する画像記録制御回路において、前記
画像メモリの画像データを送出する画像データ送出手段
から前記印刷手段に送出する各スキャンラインの画像デ
ータの前端部分をマスクする印刷前端マスク回路と、後
端部分をマスクする印刷後端マスク回路と、前記印刷手
段のスキャンライン毎の印刷開始タイミングに対して各
スキャンラインの画像データの前記印刷手段への送出開
始を遅延させる印刷位置調整回路とを設けたので、印刷
前端マスク回路と印刷後端マスク回路とにより、画像デ
ータ送出手段から印刷手段に送出される各スキャンライ
ンの画像データの前端と後端とをマスキングすることが
でき、この前端と後端とがマスキングされたスキャンラ
インの画像データで印刷手段は印刷をすることになり、
そのため、印刷される画像の両端をソフトウェアによる
画像処理なしに余白とすることができ、処理が速く使用
者を待たせることがないものとなる。また、印刷位置調
整回路により、印刷手段でのスキャンラインの印刷開始
タイミングに対して各スキャンラインの画像データの印
刷手段への送出開始を遅延させることができ、そのた
め、印刷手段での画像印刷位置をソフトウェアによる画
像処理なしに任意にシフトすることができ、処理が速く
使用者を待たせることがないものとなる。
【図１】本発明の一実施例を示す回路図である。
【図２】ブロック図である。
【図３】印刷位置を示す説明図である。
【図４】タイミングチャートである。
【図５】画像データが仮想的に縮小されている状態を示
す説明図である。
す説明図である。
【図６】原稿を示す説明図である。
【図７】印刷位置を示す説明図である。
【図８】従来の技術による、画像メモリに白データが挿
入された状態を示す説明図である。
入された状態を示す説明図である。
【図９】従来例を示すブロック図である。
【図１０】密度変換縮小回路を示す回路図である。
【図１１】縮小印字された位置を示す説明図である。
９ 印刷手段 １２ 画像メモリ ２０ 画像データ送出手段 ２６ 画像記録制御回路 ２８ 印刷位置調整回路 ２９ 印刷前端マスク回路 ３０ 印刷後端マスク回路
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.5 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｎ 1/23 Ｚ 9186−5Ｃ 1/38 4226−5Ｃ
Claims (1)
- 【請求項１】 画像メモリから画像データを入力し、そ
のデータを加工してプリンタ等の印刷手段に出力する画
像記録制御回路において、前記画像メモリの画像データ
を送出する画像データ送出手段から前記印刷手段に送出
する各スキャンラインの画像データの前端部分をマスク
する印刷前端マスク回路と、後端部分をマスクする印刷
後端マスク回路と、前記印刷手段のスキャンライン毎の
印刷開始タイミングに対して各スキャンラインの画像デ
ータの前記印刷手段への送出開始を遅延させる印刷位置
調整回路とを設けたことを特徴とする画像記録制御回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4273282A JPH06122260A (ja) | 1992-10-13 | 1992-10-13 | 画像記録制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4273282A JPH06122260A (ja) | 1992-10-13 | 1992-10-13 | 画像記録制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06122260A true JPH06122260A (ja) | 1994-05-06 |
Family
ID=17525678
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4273282A Pending JPH06122260A (ja) | 1992-10-13 | 1992-10-13 | 画像記録制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06122260A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4873608A (en) * | 1988-02-05 | 1989-10-10 | Hakko Metal Industries Limited | Electric soldering iron |
| JPH0880656A (ja) * | 1994-09-13 | 1996-03-26 | Nec Corp | ラインサーマルヘッド制御装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63254860A (ja) * | 1987-04-13 | 1988-10-21 | Hitachi Ltd | プリンタ制御装置 |
-
1992
- 1992-10-13 JP JP4273282A patent/JPH06122260A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63254860A (ja) * | 1987-04-13 | 1988-10-21 | Hitachi Ltd | プリンタ制御装置 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4873608A (en) * | 1988-02-05 | 1989-10-10 | Hakko Metal Industries Limited | Electric soldering iron |
| JPH0880656A (ja) * | 1994-09-13 | 1996-03-26 | Nec Corp | ラインサーマルヘッド制御装置 |
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