JPH0362090A - フラットパネル表示制御回路 - Google Patents

フラットパネル表示制御回路

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JPH0362090A
JPH0362090A JP1198354A JP19835489A JPH0362090A JP H0362090 A JPH0362090 A JP H0362090A JP 1198354 A JP1198354 A JP 1198354A JP 19835489 A JP19835489 A JP 19835489A JP H0362090 A JPH0362090 A JP H0362090A
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data
crt
lcd
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JP1198354A
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Hiroteru Yoshida
善田　浩輝
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Toshiba Corp
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Toshiba Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 ［発明の目的］ （産業上の利用分野） この発明は、特にパーソナルコンピュータに用いて好適
なフラットパネル表示制御回路に関する。
（従来の技術） 近年パーソナルコンピュータの分野に於いて、ラップト
ツブと称されるタイプのデイスプレィ−体形のパーソナ
ルコンピュータが主流をしめつつある。この種ラップト
ツブタイプのパーソナルコンピュータに設けられるデイ
スプレィとしては、プラズマ、ＬＣＤ等の表示器を用い
たフラットパネルタイプのデイスプレィが広く使用され
る。ところがパーソナルコンピュータの流通ソフトウェ
アは未だＣＲＴ用に作成されたものが多く、従って上記
したようなフラットパネルタイプのデイスプレィを設け
たデイスプレィ一体形のラップトツブパーソナルコンピ
ュータに於いては、ＣＲＴ用に作成された流通ソフトウ
ェアに対処するための対策を講する必要がある。
また、その他に、ＣＲＴ用の表示コントローラをそのま
まフラットパネル用に使用する目的と、ＣＲＴデイスプ
レィとフラットパネルディスプレイに同時に同一画面を
表示する目的のいずれか一つ又は複数の目的のために、
フレームメモリと呼ばれる表示画面のデータを蓄えてお
く特殊なメモリが内蔵される。更に、そのフレームメモ
リをコントロール（リード・ライト）するコントローラ
を用い、画面のデータを一旦フレームメモリに蓄え、そ
れをフラットパネルディスプレイに必要なタイミングで
読み出し表示する回路を備える必要がある。このフレー
ムメモリは表示データを蓄えるためのデータ書込みと表
示のための読み出しの２つのポートが必要であり、通常
の１ポートのＤＲＡＭを使用したとき、この２つのポー
トを時分割で制御する必要がある。
この際、一定時間内にアクセス（リード・ライト）する
スピードは、ＤＲＡＭ、ＳＲＡＭによりそれぞれ決めら
れており、パネル表示のためのリードスピード約４０ｎ
ｓ／ドツト（単色、単階調）を２分割すると約２９ｎ　
ｓ／ドツト（単色、単階調）の読み出しスピードが必要
となるため、標準的なアクセススピードを持つＤＲＡＭ
　（１６０ｎｓ：サイクルタイム）を使う場合、８ドツ
ト＝１６０ｎｓ程度のデータを同時にリードする必要が
ある。１６階調の表示を行なう場合は、この４倍で、８
ドツトＸ４−３２ビツトのデータを一度にリードしなけ
ればならず、８ビツト幅のＳＲＡＭ４個、又は、４ビツ
ト幅のＤＲＡＭ８個が必要となる。６４０Ｘ４８０の解
像度で１６階調（４ビツト）の表示を行なうためには、
６４０ｘ４８０ｘｌ、１７Ｍビットのメモリが必要で、
ＳＲＡＭを使う場合は３２ＫＸ８ビツト（２５６にビッ
ト）４個で１Ｍビットにしかならず、５１２にビットの
メモリは４倍単位のメモリ標準からはずれるため、３２
ＫＸ８ビツトＳＲＡＭ８個を使用せざるを得ない（ＩＭ
のＳＲＡＭ４個は価格面から非現実的である）。結局、
フレームメモリとしては、３２ＫＸ８ビツト（２５６に
ビット）８個、又は６４ＫＸ４ビツト（２５６にビット
）８個のメモリ素子が必要となる。
（発明が解決しようとする課題） このようにフラットパネルディスプレイを使用する表示
機構に於いては、フラットパネルディスプレイに表示す
るためだけに使用されるフレームメモリの他に、通常の
表示データを蓄えるＶＲＡＭと呼ばれるメモリが別途必
要であるため、ハードウェア構成に於いて、ＰＣＢ　（
プリントサーキットボード）の表示回路に占める実装領
域がきくなり、構成が繁雑化する等の問題があった。
この本発明は上記実情に鑑みなされたもので、デュアル
ポートメモリと呼ばれる書き込み用と読み出し用の２つ
のポートを有するＤＲＡＭを使用して、コンパクトかつ
廉価な構成でフラットパネルディスプレイを表示ドライ
ブ制御できるフラットパネル表示制御回路を提供するこ
とを目的とする。
［発明の構成］ （課題を解決するための手段） 本発明のフラットパネル表示制御回路は、ビデオＲＡＭ
と、ビデオＲＡＭに書込まれた表示データをプログラマ
フルに設定された画面制御情報に従い表示するＣＲＴ表
示コントローラと、ＣＲＴ表示コントローラにより生成
されるＣＲＴ表示データがＣＲＴ表示タイミングにて書
込まれるデュアルポートメモリと、デュアルポートメモ
リからフラットパネルディスプレイの表示タイミングに
て表示データを得、フラットパネルディスプレイにその
表示データを表示するフラットパネルディスプレイ表示
回路とで構成される。
（作用） 上述したように本発明に於いてはフラットパネル画面情
報を記憶するフレームバッファとしてデュアルポートメ
モリを使用することによって、フレームバッファの個数
を減らしＰＣＢに占める表示用回路の実装面積を減じる
ことを特徴とする。
例えば、６４０Ｘ４８０Ｘ１６階調の表示ＬＣＤ上で実
現するためのフレームメモリの構成を説明すると以下の
ようになる。即ち、２５６Ｋｘ４ビツト（１Ｍビット）
のデュアルポートメモリ２個と、それをコントロールす
るＬＣＤ表示制御回路（１つのゲートアレイにおさめる
）を設け、表示ＬＣＤとして１６階調インタフェースＬ
ＣＤを使用し、コンパクトな１６階調ＬＣＤ表示回路を
実現する。これにより、従来技術では８個必要であった
ＬＣＤ表示用フレームバッファを２個にすることができ
、ＬＣＤ表示回路をコンパクトにすることができる。
（実施例） 以下、図面を参照して本発明の実施例について説明する
。
図に於いて、１はＣＲＴ表示コントローラであり、ＣＰ
Ｕバス１００を通して図示せぬＣＰＵからセットされた
レジスタの内容に従いＶＲＡＭ（ビデオＲＡＭ、、）２
に書き込まれた情報を表示する。２は表示情報を貯える
ＶＲＡＭ　（ビデオＲＡ　Ｍ　）であり、ＶＲＡＭデー
タバス１０】を介して表示情報がリード／ライトされる
。３はＬＣＤ表示！ＩＩ御回路であり、ＣＲ７表示コン
トローラ１から出力されたＶＲＡＭ２上のＣＲＴ表示デ
ータを一旦デュアルポートメモリ４に記憶し、ＬＣＤ表
示タイミングで読み出し、ＬＣＤ５上に表示する。４は
ＬＣＤ表示制御回路３の制御の下に画面情報を記憶する
デュアルポートメモリであり、表示データを蓄えるため
のデータ書込み用ポートと表示のための読み出し用ポー
トの２つのボートをもつ。このデュアルポートメモリ４
は、ＬＣＤ表示制御回路３の制御の下に、ＣＲＴ表示タ
イミングに従い表示すべきデータが書き込まれ、ＬＣＤ
表示タイミングに従い読み出される。５はＬＣＤ表示制
御回路３の制御の下に、デュアルポートメモリ４より読
み出した画面情報を表示出力するＬＣＤである。１００
はＣＰＵバスであり、ＣＰＵが必要に応じてＣＲＴ表示
表示表示コント−ローラ１蔵レジスタ及びＶＲＡＭ２に
データをライト又はリードする場合に使用する。１０１
はＣＰＵのＶＲＡＭライト／リード又は表示のためのリ
ードを目的としたＶＲＡＭデータバスであり、ＣＲ７表
示コントローラ１がＶＲＡＭ２をライト／リードする場
合に使用される。１０２はＣＲＴ表示表示コントローラ
１から出力されるＣＲＴ表示データであり、ＣＲＴに表
示するタイミングで出力される。１０３はデュアルポー
トメモリライトデータであり、ＣＲＴに表示するタイミ
ングで画面データをデュアルポートメモリ４にライトす
る。１０４はデュアルポートメモリリードデータであり
、ＬＣＤ５に表示するタイミングで画面データをデュア
ルポートメモリ４からリードする。
１０５はＬＣＤ表示データであり、１６階調の場合４ビ
ツトでＬＣＤ５にインタフェースする。
以下、本発明の実施例に於ける動作について説明する。
先ずＣＰＵによってＣＲＴ表示コントローラ１内蔵のレ
ジスタに表示タイミングを、ＶＲＡＭ２に表示情報を書
き込む。ＣＲ７表示コントローラ１はこの表示タイミン
グに従ってＶＲＡＭ２より表示情報を読み出し、ＣＲＴ
表示データ１０２を出力する。ここまでは通常のＣＲＴ
コントローラ１の動作であり、ＣＲＴ表示データ１０２
はそのままＣＲＴに表示することも可能である。このＣ
ＲＴコントローラ１に書き込まれる各種レジスタの値は
ＣＲＴ用のものであり、ＣＲＴ用に作られたアプリケー
ションソフトウェア及び基本人出力制御システム（Ｂｉ
Ｏ２）は、そのまま処理できる。ＬＣＤ表示制御回路３
はこのＣＲＴ表示データ１０２を受けてデュアルポート
メモリ４に同一タイミングで記憶する。
デュアルポートメモリ４は６４０ｘ４８０ｘ１６階調の
表示を行なう場合、２５６Ｋｘ４ビツトのものを２個使
用する。各メモリのアドレスは表示画面の１画素（ビク
セル）を指定し、ＬＣＤの上画面用に１つ、ＬＣＤの子
画面用に１つ合計２個のデュアルポートメモリを使う。
各アドレスには４ビツトのデータを入れることができ、
４ビット−１６階調のデータを１つのアドレスにライト
する。ＣＲＴの表示タイミングは１画素４０ｎｓのため
、８画素を１ブロツクとし、８画素おきにデータをライ
トし、デュアルポートメモリ４のパラレルライト（通常
１６０ｎｓのサイクルタイム）のサイクルタイムを満足
させる。
この場合４０ｎ　ｓ　Ｘ８＝３２０ｎ　ｓのサイクルタ
イムのライトとなる。つまり１フレーム（画面）目は０
，８．１６・・・画素をライトし、２フレ一ム回は１，
９．１７・・・画素をライトし、３フレーム目は２，１
０．１９・・・・・・のように、８フレームで１つの画
面全体をデュアルポートメモリ４に書き込む。ＣＲ７表
示データ１０２はＣＲＴの表示テイミングで常に転送さ
れているため、このように８フレームで１画面データを
転送しても、ＬＣＤの画面イメージがくずれることはな
い。この書き込みの動作と同時に、ＬＣＤ表示制御回路
３はデュアルポートメモリ４よりＬＣＤの表示タイミン
グに従ってその画面データをリードする。この動作はＬ
ＣＤの主画面用デュアルポートメモリと子画面用デュア
ルポートメモリが平行して行なわれ、デュアルポートメ
モリ４の読み出し用シリアルリードポートよりシリアル
に画素データをリードする。デュアルポートメモリ４の
シリアルリードボートのシリアルリードサイクルは約４
０ｎｓのため、ＬＣＤの表示のためのリードサイクルに
十分間に合う。Ｌ　ＣＤ′表示制御回路３はこのデュア
ルポートメモリリードデータ１０４を受けてＬＣＤ５に
ＬＣＤ表示データ１０５を送り出す。１６階調表示の場
合、このデータのビット幅は４ビツトになり、主画面と
子画面を合わせると８ビツトとなる。ＬＣＤ５はこのＬ
ＣＤ表示データ１０５を受けて１６階調の表示を行なう
。
このようなデュアルポートメモリを用いたＬＣＤの表示
ドライブ制御機構により、従来８個必要であったＬＣＤ
表示用フレームバッファを２個にすることができ、これ
によりＬＣＤ表示回路を小さくすることができ実装エリ
アを削減できる。
尚、上記した本発明の実施例ではＬＣＤでの使用のみを
例示して説明したが、プラズマ等のフラットパネルディ
スプレイにても同様の手法により実現可能である。
［発明の効果］ 以上説明のように本発明のフラットパネル表示制御回路
によれば、ビデオＲＡＭと、ビデオＲＡＭに書込まれた
表示データをプログラマブルに設定された画面制御情報
に従い表示するＣＲＴ表示コントローラと、このＣＲＴ
表示コントローラにより生成されるＣＲ７表示データが
ＣＲＴ表示タイミングに同期して書込まれるデュアルポ
ートメモリと、このデュアルポートメモリからフラット
パネルディスプレイの表示タイミングに同期して表示デ
ータを得、この表示データをフラットパネルディスプレ
イに表示するフラットパネルディスプレイ表示回路とを
備えた構成としたことにより、ＬＣＤ表示用フレームバ
ッファの使用メモリ個数を大幅に削減でき、これにより
ＬＣＤ表示回路を小形化できる。
【図面の簡単な説明】
第１図は本発明の実施例を示すブロック図である。 １・・・ＣＲＴ表示コントローラ、２・・・ＶＲＡＭ。 ３・・・ＬＣＤ表示制御回路、４・・・デュアルポート
メモリ、５・・・ＬＣＤ、１００・・・ＣＰＵバス、１
０１・・・ＶＲＡＭデータバス、１０２・・・ＣＲ７表
示データ、１０３・・・デュアルポートメモリライトデ
ータ、１０４・・・デュアルポートメモリリ ードデータ、 ５・・・　Ｌ ＣＤ表示データ。

Claims (1)

    【特許請求の範囲】
  1. ビデオＲＡＭと、ビデオＲＡＭに書込まれた表示データ
    をプログラマブルに設定された画面制御情報に従い表示
    するＣＲＴ表示コントローラと、このＣＲＴ表示コント
    ローラにより生成されるＣＲＴ表示データがＣＲＴ表示
    タイミングに同期して書込まれるデュアルポートメモリ
    と、このデュアルポートメモリからフラットパネルディ
    スプレイの表示タイミングに同期して表示データを得、
    この表示データをフラットパネルディスプレイに表示す
    るフラットパネルディスプレイ表示回路とを具備するこ
    とを特徴とするフラットパネル表示制御回路。
JP1198354A 1989-07-31 1989-07-31 フラットパネル表示制御回路 Pending JPH0362090A (ja)

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