JP5542325B2 - 半導体デバイスの製造方法 - Google Patents
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Description
前記LTVの値がステッパーの焦点深度(1μm程度)より大きくなった場合には、ステッパーを用いて半導体領域の微細パターンの形成を試みても、所望の微細なパターンを形成することができず、所望の特性の半導体デバイスを作製できないという問題が発生した。
そのため、前記ショットキーバリアダイオードのような半導体デバイスでは、基板を薄型化するとともに、微細パターンからなる半導体領域を形成することが、半導体特性を向上させるために不可欠であった。
また、特許文献2は、半導体装置作製用SiC単結晶基板とその製造方法に関するものであり、SiC単結晶インゴットからSiC単結晶基板を形成する工程が開示されている。また、特許文献3は、SiC単結晶基板の製造方法に関するものであり、SiC単結晶基板の加工変質部を、反応ガスを用いたエッチングにより除去する工程が開示されている。さらに、特許文献4は、発光部と表面電極との間に電流ブロック層を設けた発光ダイオードに関するものである。特許文献2〜4では、数μm/h程度のエッチング速度でSiCのドライエッチングを行うことが記載されている。
しかし、これらの方法を用いても、上記課題を解決することはできなかった。
(1) SiC単結晶基板の表面にN型エピタキシャル層を形成した後、前記N型エピタキシャル層の表面に、ステッパーによるフォトリソグラフィー法を用いて微細パターンからなるP型不純物領域及びP型不純物領域に対してオーミック接触する表面オーミックコンタクト電極を形成する工程と、前記P型不純物領域及び前記表面オーミックコンタクト電極を覆うようにシリコン酸化膜(SiO 2 )からなる保護膜を形成した後、前記保護膜の平坦化を行う工程と、前記SiC単結晶基板の板厚を薄くする基板薄型化工程と、前記SiC単結晶基板の裏面に裏面オーミックコンタクト電極を形成する工程と、前記P型不純物領域及び前記表面オーミックコンタクト電極と接続され、N型エピタキシャル層表面に対してショットキー接触するショットキー金属部を形成した後、前記ショットキー金属部を覆うように表面パッド電極を形成する工程と、を具備することを特徴とする半導体デバイスの製造方法。
(2) 前記基板薄型化工程が、前記SiC単結晶基板の裏面を研磨する工程であることを特徴とする(1)に記載の半導体デバイスの製造方法。
(3) 前記基板薄型化工程が、前記SiC単結晶基板の裏面をドライエッチングする工程であることを特徴とする(1)に記載の半導体デバイスの製造方法。
(実施形態1)
図1は、本発明の実施形態である半導体デバイスの一例を示す断面図であって、PN接合領域とショットキー接合領域を複合化したショットキーバリアダイオードの一例を示すものである。
図1に示すように、本発明の実施形態である半導体デバイス101は、SiC単結晶基板1と、SiC単結晶基板1の表面1aに形成されたN型エピタキシャル層2と、N型エピタキシャル層2の表面2aに形成された微細パターンからなるP型不純物領域3、4及び表面オーミックコンタクト電極5と、P型不純物領域3、4及び表面オーミックコンタクト電極5と接続されたショットキー金属部8と、ショットキー金属部8を覆うように形成された表面パッド電極9と、SiC単結晶基板1の裏面1bに形成された裏面オーミックコンタクト電極7と、裏面オーミックコンタクト電極7を覆うように形成された裏面パッド電極11と、を有して概略構成されている。
なお、後述する半導体デバイスの製造方法において説明するように、P型不純物領域3、4は、P型不純物濃度の違いにより、低濃度P型不純物領域3と、高濃度P型不純物領域4とされている。
なお、電極全体で前記ショットキー接合領域が占める面積の割合を大きくすることにより、順方向に電流を流したときの電圧降下を小さくして、電力損失を小さくすることができる。
たとえば、半導体デバイス101を、配線基板(図示略)に実装する際に、前記配線基板の一の端子部と前記端子接合部とを結ぶように、アルミワイヤーボンディングするとともに、前記配線基板の他の端子部に、裏面パッド電極11を接合して配置する。これにより、半導体デバイス101の裏面パッド電極11と表面パッド電極9に電圧を印加することができる。
なお、半導体デバイス101は、ショットキーバリアダイオードに限られるものではなく、MOSFETなどでもよい。
図2〜図9は、本発明の実施形態である半導体デバイスの製造方法の一例を説明する工程断面図である。なお、図1で示した部材と同じ部材については同じ符号を付して示している。
本発明の実施形態である半導体デバイス101の製造方法は、SiC単結晶基板1の表面1aにステッパーによるフォトリソグラフィー法を用いて、微細パターンからなるP型不純物領域3、4及び表面オーミックコンタクト電極5を形成する工程(微細パターン形成工程)と、P型不純物領域3、4及び表面オーミックコンタクト電極5を覆うように保護膜6を形成した後、保護膜6の平坦化を行う工程(保護膜平坦化工程)と、SiC単結晶基板1の板厚を薄くする基板薄型化工程と、SiC単結晶基板1の裏面1bに裏面オーミックコンタクト電極7を形成する工程(裏面オーミックコンタクト電極形成工程)と、P型不純物領域3、4及び表面オーミックコンタクト電極5と接続されたショットキー金属部8を形成した後、ショットキー金属部8を覆うように表面パッド電極9を形成する工程(表面パッド電極形成工程)と、を具備する。
まず、図2に示すように、SiC単結晶基板(N型半導体基板)1上にN型エピタキシャル層2を形成する。
次に、CVD法により、N型エピタキシャル層2上に酸化膜を形成する。
次に、前記酸化膜上にレジストを塗布した後、ステッパーによるフォトレジストパターンを形成する。ステッパーを用いることにより微細パターンからなるフォトレジストパターンを形成することができる。その後、前記酸化膜をドライエッチングして窓部を形成する。
なお、前記炭化膜は、スパッタ法の代わりに、有機物を塗布した後、熱処理をして形成しても良い。
図3は、低濃度P型不純物領域3と高濃度P型不純物領域4形成後の時点の状態を示す断面工程図である。
次に、前記金属膜上にレジストを塗布した後、ステッパーによるフォトレジストパターンを形成する。ステッパーを用いることにより微細パターンからなるフォトレジストパターンを形成することができる。その後、前記金属膜をドライエッチングして表面オーミックコンタクト電極5を形成する。表面オーミックコンタクト電極5は、複数の高濃度P型不純物領域4に接続され、オーミックコンタクトを形成する。
CVD法により、オーミックコンタクト電極5を形成したN型エピタキシャル層2上に、たとえば、シリコン酸化膜(SiO2)からなる保護膜6を形成する。
次に、CMP(Chemical Mechanical Polishing)法により、保護膜6の平坦化を行う。図4は、この時点の状態を示す断面工程図である。
平坦化した保護膜6の平坦面6aを基準として、次の基板薄型化工程を行うことで、薄型化する基板1の裏面1bを平坦化することができる。
図5に示すように、SiC単結晶基板1の裏面1bを研磨して、SiC単結晶基板1の厚さtを150〜350μmとする。研磨手段は、特に限定されず、公知の方法を用いることができる。
なお、前記SiC単結晶基板の裏面をドライエッチングしてSiC単結晶基板1を薄型化してもよい。効率的に薄型化することができる。
スパッタ法または蒸着法で、P型不純物領域3、4を形成したSiC単結晶基板1の裏面に、例えば、Niからなる金属膜を形成する。
次に、熱処理(例えば、950℃の熱処理)を不活性ガス雰囲気または真空中で行って、裏面オーミックコンタクト電極7とする。これにより、裏面オーミックコンタクト電極7は、SiC単結晶基板1の裏面と良好なオーミックコンタクトを形成する。図6は、この時点の状態を示す断面工程図である。
次に、図7に示すように、保護膜6を除去する。
次に、オーミックコンタクト電極5を形成したN型エピタキシャル層2上にレジストを塗布した後、焦点深度の大きいミラープロジェクションアライナーまたはコンタクトアライナーをによる露光、その後の現像により、フォトレジストパターンを形成する。焦点深度の大きいミラープロジェクションアライナーまたはコンタクトアライナーを用いることにより、製造工程を低価格化することができる。
次に、スパッタ法または蒸着法で、窓部を形成したレジスト上に、例えば、チタンまたはモリブデンなどからなる金属膜を形成する。
次に、前記レジストを除去(リフトオフ)することにより、窓部に形成された金属膜のみをオーミックコンタクト電極5を覆うように残すことができる。
次に、ショットキー障壁φb制御のための熱処理(例えば、600℃での熱処理)を不活性ガス雰囲気で行い、ショットキー金属部8を形成する。ショットキー金属部8は、SiC単結晶基板1に接続され、ショットキーコンタクトを形成している。図8は、この時点の状態を示す断面工程図である。
次に、ショットキー金属部8を形成したN型エピタキシャル層2上にレジストを塗布した後、焦点深度の大きいミラープロジェクションアライナーまたはコンタクトアライナーによる露光、その後の現像により、フォトレジストパターンを形成する。
次に、スパッタ法で、窓部を形成したレジスト上に、例えば、アルミニウムからなる金属膜を形成する。
次に、前記レジストを除去(リフトオフ)することにより、窓部に形成された金属膜のみをショットキー金属部8を覆うように残すことができる。
これにより、ショットキー金属部8に接続された表面パッド電極9を形成する。図9は、この時点の状態を示す断面工程図である。
次に、ミラープロジェクションアライナーまたはコンタクトアライナーによる露光、その後の現像により、パターン化されたパッシベーション膜10を形成する。図10は、この時点の状態を示す断面工程図であって、表面パッド電極9の表面の一部が露出され、表面パッド電極9の端部9cのみを覆うようにパッシベーション膜10が形成されている。
最後に、スパッタ法で、裏面オーミックコンタクト電極7上に、裏面パッド電極11として、例えば、Ni/Agなどからなる2層の金属膜を形成する。
以上の工程により、図1に示す半導体デバイス101を作製する。
(実施例1)
図1に示す半導体デバイスを、次の条件で製造した。
<微細パターン形成工程>
まず、SiC単結晶基板(N型半導体基板)上にN型エピタキシャル層を形成した。次に、CVD法により、N型エピタキシャル層上に酸化膜を形成した。次に、前記酸化膜上にレジストを塗布した後、ステッパーによる微細パターンからなるフォトレジストパターンを形成した。その後、前記酸化膜をドライエッチングして窓部を形成した。次に、窓部が形成された前記酸化膜をマスクとして用いて、P型不純物となるアルミニウムをイオン注入した。その後、再び前記酸化膜上にレジストを塗布した後、ステッパーによるフォトレジストパターンを形成、その後、前記酸化膜をドライエッチングして追加の窓部を形成する。次に、窓部が形成された前記酸化膜をマスクとして用いて、P型不純物となるアルミニウムまたはボロンをN型エピタキシャル層2に再度イオン注入した。次に、1700℃の熱処理を不活性ガス雰囲気で行った。これにより、低濃度P型不純物領域および高濃度P型不純物領域を形成した。
次に、CVD法により、表面オーミックコンタクト電極を形成したN型エピタキシャル層上に、シリコン酸化膜(SiO2)からなる保護膜を形成した。次に、CMPにより、前記保護膜の平坦化を行った。
次に、SiC単結晶基板1の裏面を研磨して、SiC単結晶基板の厚さを約250μmとした。研磨手段としては、特に限定されず、公知の方法を用いた。
次に、スパッタ法で、P型不純物領域を形成したSiC単結晶基板の裏面にNiからなる金属膜を形成した。次に、950℃の熱処理を不活性ガス雰囲気で行って、裏面オーミックコンタクト電極とした。次に前記保護膜を除去した。
次に、スパッタ法で、ショットキー金属部を形成したN型エピタキシャル層上にレジストを塗布した後、焦点深度の大きいミラープロジェクションアライナーによる露光、その後の現像により、フォトレジストパターンを形成した。次に、スパッタ法で、前記窓部を形成したレジスト上に、アルミニウムからなる金属膜を形成した。前記レジストを除去(リフトオフ)して、表面パッド電極を形成した。
次に、微細パターン形成工程でステッパーを用いずP型不純物領域及び表面オーミックコンタクト電極を形成したことと、保護膜平坦化工程と基板薄型化工程とを行わなかった他は実施例1と同様にして、半導体デバイス(比較例1サンプル)を作製した。
図11は、逆方向に電圧を印加したときに、逆方向に流れる電流(以下、逆方向電流)の値を示すグラフである。ここで、逆方向電流は漏れ電流(以下、リーク電流)である。図11に示すように、逆電圧の値を大きくしたとき、半導体デバイス(実施例1サンプル)の方が、半導体デバイス(比較例1サンプル)よりも、リーク電流の値が小さいという結果が得られた。つまり、リーク電流を小さくして、半導体デバイスの信頼性を向上させることができた。
Claims (3)
- SiC単結晶基板の表面にN型エピタキシャル層を形成した後、前記N型エピタキシャル層の表面に、ステッパーによるフォトリソグラフィー法を用いて微細パターンからなるP型不純物領域及びP型不純物領域に対してオーミック接触する表面オーミックコンタクト電極であって、P型不純物領域からはみ出さない様にP型不純物領域上に形成される表面オーミック電極を形成する工程と、
前記P型不純物領域及び前記表面オーミックコンタクト電極を覆うようにシリコン酸化膜(SiO2)からなる保護膜を形成した後、前記保護膜の平坦化を行う工程と、
前記SiC単結晶基板の板厚を薄くする基板薄型化工程と、
前記SiC単結晶基板の裏面に裏面オーミックコンタクト電極を形成する工程と、
前記裏面オーミックコンタクト電極形成後に、前記保護膜を除去する工程と、
前記P型不純物領域及び前記表面オーミックコンタクト電極と接続され、N型エピタキシャル層表面に対してショットキー接触するショットキー金属部を形成した後、前記ショットキー金属部を覆うように表面パッド電極を形成する工程と、を具備することを特徴とする半導体デバイスの製造方法。 - 前記基板薄型化工程が、前記SiC単結晶基板の裏面を研磨する工程であることを特徴とする請求項1に記載の半導体デバイスの製造方法。
- 前記基板薄型化工程が、前記SiC単結晶基板の裏面をドライエッチングする工程であることを特徴とする請求項1に記載の半導体デバイスの製造方法。
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