JP5509259B2 - 電子機器 - Google Patents

電子機器 Download PDF

Info

Publication number
JP5509259B2
JP5509259B2 JP2012122742A JP2012122742A JP5509259B2 JP 5509259 B2 JP5509259 B2 JP 5509259B2 JP 2012122742 A JP2012122742 A JP 2012122742A JP 2012122742 A JP2012122742 A JP 2012122742A JP 5509259 B2 JP5509259 B2 JP 5509259B2
Authority
JP
Japan
Prior art keywords
film
transistor
insulating film
substrate
semiconductor device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2012122742A
Other languages
English (en)
Other versions
JP2012227530A (ja
JP2012227530A5 (ja
Inventor
潤 小山
浩二 大力
奨 岡崎
芳隆 守屋
舜平 山崎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Semiconductor Energy Laboratory Co Ltd
Original Assignee
Semiconductor Energy Laboratory Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Semiconductor Energy Laboratory Co Ltd filed Critical Semiconductor Energy Laboratory Co Ltd
Priority to JP2012122742A priority Critical patent/JP5509259B2/ja
Publication of JP2012227530A publication Critical patent/JP2012227530A/ja
Publication of JP2012227530A5 publication Critical patent/JP2012227530A5/ja
Application granted granted Critical
Publication of JP5509259B2 publication Critical patent/JP5509259B2/ja
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • H01L27/1259Multistep manufacturing methods
    • H01L27/1262Multistep manufacturing methods with a particular formation, treatment or coating of the substrate
    • H01L27/1266Multistep manufacturing methods with a particular formation, treatment or coating of the substrate the substrate on which the devices are formed not being the final device substrate, e.g. using a temporary substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • H01L27/1218Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs with a particular composition or structure of the substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • H01L27/1255Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs integrated with passive devices, e.g. auxiliary capacitors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/786Thin film transistors, i.e. transistors with a channel being at least partly a thin film
    • H01L29/78603Thin film transistors, i.e. transistors with a channel being at least partly a thin film characterised by the insulating substrate or support
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10KORGANIC ELECTRIC SOLID-STATE DEVICES
    • H10K19/00Integrated devices, or assemblies of multiple devices, comprising at least one organic element specially adapted for rectifying, amplifying, oscillating or switching, covered by group H10K10/00
    • H10K19/10Integrated devices, or assemblies of multiple devices, comprising at least one organic element specially adapted for rectifying, amplifying, oscillating or switching, covered by group H10K10/00 comprising field-effect transistors
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10KORGANIC ELECTRIC SOLID-STATE DEVICES
    • H10K77/00Constructional details of devices covered by this subclass and not covered by groups H10K10/80, H10K30/80, H10K50/80 or H10K59/80
    • H10K77/10Substrates, e.g. flexible substrates
    • H10K77/111Flexible substrates
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/12Passive devices, e.g. 2 terminal devices
    • H01L2924/1204Optical Diode
    • H01L2924/12044OLED
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02EREDUCTION OF GREENHOUSE GAS [GHG] EMISSIONS, RELATED TO ENERGY GENERATION, TRANSMISSION OR DISTRIBUTION
    • Y02E10/00Energy generation through renewable energy sources
    • Y02E10/50Photovoltaic [PV] energy
    • Y02E10/549Organic PV cells
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02PCLIMATE CHANGE MITIGATION TECHNOLOGIES IN THE PRODUCTION OR PROCESSING OF GOODS
    • Y02P70/00Climate change mitigation technologies in the production process for final industrial or consumer products
    • Y02P70/50Manufacturing or production processes characterised by the final manufactured product

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Ceramic Engineering (AREA)
  • Manufacturing & Machinery (AREA)
  • Thin Film Transistor (AREA)
  • Electroluminescent Light Sources (AREA)
  • Element Separation (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
  • Metal-Oxide And Bipolar Metal-Oxide Semiconductor Integrated Circuits (AREA)

Description

本発明は、可撓性を有する半導体装置および当該半導体装置の作製方法に関する。
近年、プラスチック等の可撓性を有する基板上にトランジスタ等で構成される集積回路
を設ける技術が注目されている。可撓性を有する基板上に集積回路を設けることによって
形成された半導体装置は、半導体基板やガラス基板等の基板を用いる場合に比べ、軽量化
やコストダウン等を達成することが可能となる。また、可撓性を有する半導体装置は折り
曲げ等が可能となるため、様々な分野、場所への適用が期待されている。
しかしながら、可撓性を有する基板上にトランジスタ等の素子を具備する集積回路を設
けることによって形成された半導体装置に、外部から曲げ等の物理的な力(外力)を加え
た場合、半導体装置に生じる応力によって、当該半導体装置に含まれるトランジスタ等の
素子が損傷し、トランジスタ等の素子の特性に影響を及ぼす恐れがある。
本発明は上記問題を鑑み、可撓性を有し、曲げ等の物理的変化に対して耐性を有する半
導体装置および当該半導体装置の作製方法を提供することを目的とする。
上記目的を達成するために本発明は以下の手段を講じる。
本発明の半導体装置は、可撓性を有する基板上に設けられた、半導体膜、半導体膜上に
ゲート絶縁膜を介して設けられたゲート電極およびゲート電極を覆って設けられた層間絶
縁膜とを有する複数のトランジスタと、複数のトランジスタの間に設けられた屈折部分と
を有していることを特徴とする。屈折部分は、例えば、層間絶縁膜に開口部等の空間を形
成することにより設けることができる。なお、屈折部分とは、曲げ等の物理的な力を半導
体装置に加えた場合に、半導体装置の内部において、他の部分に比べて選択的に大きいひ
ずみ(物体の形や体積の変化)が生じる部分のことをいう。
本発明の半導体装置の他の構成として、可撓性を有する基板上に設けられた、半導体膜
、半導体膜上にゲート絶縁膜を介して設けられたゲート電極およびゲート電極を覆って設
けられた層間絶縁膜とを有する複数のトランジスタと、複数のトランジスタの間に設けら
れた屈折部分とを有し、屈折部分は、層間絶縁膜に設けられた開口部に層間絶縁膜より弾
性率が低い物質が充填されて設けられていることを特徴としている。また、本発明では、
開口部に充填する物質として他にも、層間絶縁膜よりガラス転移点が低い物質や塑性を有
する物質を設けることができる。
また、上記構成において、トランジスタとして、薄膜トランジスタ(TFT)、単結晶
の半導体膜にチャネル領域を設けた電界効果型トランジスタ(FET)または有機トラン
ジスタ等を用いることができる。また、トランジスタに限られず、半導体装置にダイオー
ドや容量素子等の素子が含まれる場合には、それらの素子の間に屈折部分を設けることが
可能である。
本発明の半導体装置の作製方法は、第1の基板上に剥離層を形成し、剥離層上に第1の
絶縁膜を形成し、第1の絶縁膜上に薄膜トランジスタを形成し、薄膜トランジスタを覆う
ように第2の絶縁膜を形成し、第2の絶縁膜上に薄膜トランジスタと電気的に接続する導
電膜を形成し、第2の絶縁膜および導電膜を覆うように第3の絶縁膜を形成し、第2の絶
縁膜および第3の絶縁膜に選択的に第1の開口部を形成し、第1の開口部に第2の絶縁膜
および第3の絶縁膜より弾性率が低い物質を設け、第1の絶縁膜、第2の絶縁膜および第
3の絶縁膜に選択的に第2の開口部を形成して剥離層を露出させ、第3の絶縁膜の表面に
接着面を有するフィルムを接着させて、第1の絶縁膜から剥離層および第1の基板を剥離
し、第2の基板上に第1の絶縁膜を固着することを特徴としている。また上記構成におい
て、第1の開口部に第2の絶縁膜および第3の絶縁膜より弾性率が低い物質の代わりに、
第2の絶縁膜および第3の絶縁膜よりガラス転移点が低い物質や塑性を有する物質等を設
けることができる。
また、本発明の半導体装置の他の作製方法として、導電膜のパターンが形成された基板
上にトランジスタを含む複数の集積回路を導電膜のパターンと電気的に接続するように貼
り合わせて設け、複数の集積回路を覆うように絶縁膜を形成し、複数の集積回路の間に位
置する絶縁膜に凹部を形成することを特徴としている。また、絶縁膜に凹部を形成した後
に、凹部に絶縁膜より弾性率が低い物質、絶縁膜よりガラス転移点が低い物質または絶縁
膜より塑性を有する物質等を設けることも可能である。
また、本発明の半導体装置の他の作製方法として、基板上にトランジスタを含む複数の
集積回路を貼り合わせて設け、複数の集積回路を電気的に接続する導電膜を形成し、複数
の集積回路を覆うように絶縁膜を形成し、複数の集積回路の間に位置する絶縁膜に凹部を
形成することを特徴としている。また、絶縁膜に凹部を形成した後に、凹部に絶縁膜より
弾性率が低い物質、絶縁膜よりガラス転移点が低い物質または絶縁膜より塑性を有する物
質等を設けることも可能である。集積回路を電気的に接続する導電膜は、液滴吐出法やス
クリーン印刷等の印刷法を用いて形成することができる。なお、液滴吐出法とは、導電性
や絶縁性等を有する材料を含んだ組成物の液滴(ドットともいう)を選択的に吐出(噴射
)して任意の場所に形成する方法であり、その方式によってはインクジェット法とも呼ば
れている。
可撓性を有する基板上に設けられた複数の集積回路を有する半導体装置を形成する場合
に、複数の集積回路間や当該集積回路に含まれるトランジスタ等の素子間に屈折部分を形
成することによって、半導体装置に曲げ等の外力を加えた場合であっても、屈折部分に選
択的にひずみが生じて曲がるため、トランジスタ等の素子に加わる応力を低減させ、当該
トランジスタ等の素子が破損する割合を低減することができる。また、トランジスタ等の
素子の特性へ影響を及ぼすことを防止することができる。また、半導体装置の内部に選択
的に屈折部分を設けることによって、より小さい力によって当該半導体装置を曲げること
が可能となる。
本発明の半導体装置の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の使用形態の一例を示す図。 本発明の半導体装置の使用形態の一例を示す図。 本発明の半導体装置を表示装置に適用した一例を示す図。 本発明の半導体装置を表示装置に適用した一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の作製方法の一例を示す図。 本発明の半導体装置の使用形態の一例を示す図。 本発明の半導体装置の一例を示す図。 本発明の半導体装置の使用形態の一例を示す図。
本発明の実施の形態について、図面を用いて以下に説明する。但し、本発明は以下の説
明に限定されず、本発明の趣旨及びその範囲から逸脱することなくその形態及び詳細を様
々に変更し得ることは当業者であれば容易に理解される。従って、本発明は以下に示す実
施の形態の記載内容に限定して解釈されるものではない。なお、以下に説明する本発明の
構成において、同じものを指す符号は異なる図面間で共通して用いる場合がある。
(実施の形態1)
本実施の形態では、本発明の半導体装置の一構成例について図面を参照して説明する。
一般的に、物体に応力が加えられることによって、物体の形や体積の変化(「ひずみ」
ともいう)が生じる。可撓性基板上に設けられた集積回路を有する半導体装置に曲げ等の
物理的な力により応力が加えられることにより、集積回路に含まれるトランジスタ等の素
子にひずみが生じて破損し、当該トランジスタ等の素子の特性に影響が生じる恐れがある
。そのため、本実施の形態で示す半導体装置150は、プラスチック等の可撓性を有する
基板上に設けられた集積回路152a〜152dの間に屈折部分153が設けられている
(図1(A))。屈折部分153は、集積回路152a〜152d間であればどのように
設けてもよく、例えば、屈折部分を図1(A)に示すように集積回路152aおよび集積
回路152bと集積回路152cおよび集積回路152dの間に連続して配置するように
設けてもよいし、集積回路152aと集積回路152bの間または集積回路152cと集
積回路152dの間に部分的に配置するように設けてもよい。
なお、屈折部分とは、曲げる等の物理的な力が半導体装置に加えられた場合に、半導体
装置の内部において、他の部分に比べて選択的に大きいひずみ(物体の形や体積の変化)
が生じる部分をいう。例えば、半導体装置のある部分に屈折部分を設けて、半導体装置を
湾曲させた場合、半導体装置の内部に応力が生じるが、当該応力によって生じるひずみは
選択的に屈折部分に発生し、当該屈折部分が屈折することによって半導体装置が曲がる。
また、半導体装置の内部に選択的に屈折部分を設けることにより屈折部分に選択的に大き
いひずみが生じるため、当該屈折部分を設けない場合に比べて、より弱い力で曲率半径が
小さくなるように曲げることが可能となる。従って、集積回路に設けられたトランジスタ
等の素子に加わる応力を低減させて当該トランジスタ等の素子が破損することを防止する
ことができる。
屈折部分153は、他の部分に比べて曲がりやすい物質を形成することによって設ける
。なお、本明細書において、屈折部分に設ける物質を便宜上屈折物質と記載することがあ
る。
屈折部分に設ける物質としては、屈折部分以外の部分に設ける物質と比較して曲がりや
すい性質を有する物質であればよく、例えば、弾性を示す物質や塑性を有する物質を用い
ることができる。なお、弾性を示す物質を用いる場合には、屈折部分に設ける物質の弾性
率(応力/ひずみの比)を他の領域に設ける物質の弾性率より低くなるように設ける。ま
た、塑性を有する物質を用いる場合には、屈折部分に設ける物質を他の領域に設ける物質
より塑性を有するように設けることが好ましい。なお、ここでいう弾性とは、外力によっ
て形や体積に変化を生じた物体が、力を取り去ると再びもとの状態に回復する性質をいう
。また、ここでいう塑性とは、外力によって変形しやすく、力を取り去ってもひずみが残
る性質をいう。
弾性を示す物質としては、弾性限界が高い物質が好ましく、例えば、ゴムのように力を
加えると大きく変形し、その力を除くと元の形状に戻る性質を有する物質を用いることが
できる。具体的には、ゴム弾性を示す高分子化合物等が挙げられる。他にも、弾性と同時
に粘性も兼ね備えた性質(粘弾性)を示す高分子化合物等を用いることも可能である。
塑性を有する物質としては、外力によって変形しやすく、力を取り去ってもひずみが残
る性質を有する高分子化合物等の絶縁物を用いることができる。また、他にも、延性や展
性を示すAu、Ag、Al、Cu等の金属等を用いて設けることも可能である。従って、
本発明において、屈折部分に塑性を有する物質を設けた場合には、物理的な力を加えて半
導体装置を湾曲させた際に、物理的な力を取り除いた後でも湾曲させたまま保持すること
ができる。
また、屈折部分にガラス転移温度を有する高分子等の有機化合物を用いる場合には、屈
折部分に設ける物質のガラス転移点を他の領域に設ける物質のガラス転移点より低くする
ように設ける。ガラス転移点が低い物質は、ガラス転移点が高い物質と比較して粘弾性が
高くなるため、ガラス転移点が低い物質とガラス転移点が高い物質とを設けた場合、応力
が加わった際にガラス転移点が低い物質に選択的に大きいひずみが生じる。このように、
ガラス転移点を変化させることによって、屈折部分と他の領域を同様の物質で設けること
ができる。
また、屈折部分に設ける物質は、他の領域に設ける物質より硬度が低くなるように設け
てもよい。また、トランジスタ等を含む曲げたくない領域の上方に硬度の大きい材料を用
いた保護膜を設けてもよい。なお、物質の硬度は、ビッカース硬度試験等で評価すればよ
い。
また、応力が加えられた際に選択的に大きいひずみが生じるため、曲げ耐性の高い物質
を屈折部分に設けることが好ましい。弾性体を用いる場合には弾性限界が高い物質を用い
ることが好ましい。高い曲げ耐性を有する物質を用いることによって半導体装置の耐性を
向上させることが可能となる。
次に、図1(A)におけるa−b間の断面構造の模式図を図1(B)に示す。
図1(B)において、半導体装置150は、可撓性を有する基板151に設けられた集
積回路152a〜152dを有しており、ここでは、集積回路152a〜152dが絶縁
膜154、156〜158とトランジスタ155と屈折物質163からなる素子形成層1
80とを有している場合を示している。より具体的には、可撓性を有する基板151上に
絶縁膜154を介してトランジスタ155が設けられ、トランジスタ155を覆うように
絶縁膜156〜158が設けられ、絶縁膜156〜158に形成された開口部131に屈
折物質163が設けられている。
基板151としては、可撓性を有するフィルム状の基板等を用いることができ、例えば
、ポリプロピレン、ポリエステル、ビニル、ポリフッ化ビニル、塩化ビニルなどからなる
フィルム、繊維質な材料からなる紙、基材フィルム(ポリエステル、ポリアミド、無機蒸
着フィルム、紙類等)と接着性合成樹脂フィルム(アクリル系合成樹脂、エポキシ系合成
樹脂等)との積層フィルム等を利用することができる。また、可撓性を有する金属基板を
用いてもよい。例えば、ステンレス基板等を用いることができる。
集積回路152a〜152dは、トランジスタ、ダイオード等の素子を有している。例
えば、ダイオードとしては、可変容量ダイオード、ショットキーダイオードまたはトンネ
ルダイオード等の各種ダイオードを適用することができる。本発明では、これらのトラン
ジスタやダイオード等を用いることよって、CPU、メモリまたはマイクロプロセッサ等
のありとあらゆる集積回路を設けることができる。
絶縁膜154としては、酸化珪素(SiOx)、窒化珪素(SiNx)、酸化窒化珪素
(SiOxNy)(x>y)、窒化酸化珪素(SiNxOy)(x>y)等の酸素または
窒素を有する絶縁膜の単層構造、またはこれらの積層構造で設けることができる。例えば
、絶縁膜154を2層構造で設ける場合、1層目の絶縁膜として窒化酸化珪素膜で設け、
2層目の絶縁膜として酸化窒化珪素膜を設けるとよい。また、絶縁膜154を2層構造で
設ける場合に代えて、3層構造で設ける場合、1層目の絶縁膜として酸化窒化珪素膜を設
け、2層目の絶縁膜として窒化酸化珪素膜を設け、3層目の絶縁膜として酸化窒化珪素膜
を設けるとよい。
絶縁膜156としては、スパッタ法やプラズマCVD法等により、酸化珪素(SiOx
)、窒化珪素(SiNx)、酸化窒化珪素(SiOxNy)(x>y)、窒化酸化珪素(
SiNxOy)(x>y)等の酸素または窒素を有する絶縁膜やDLC(ダイヤモンドラ
イクカーボン)等の炭素を含む膜の単層構造、またはこれらの積層構造で設けることがで
きる。
絶縁膜157、158としては、上記酸化珪素(SiOx)、窒化珪素(SiNx)、
酸化窒化珪素(SiOxNy)(x>y)、窒化酸化珪素(SiNxOy)(x>y)等
の酸素または窒素を有する絶縁膜やDLC(ダイヤモンドライクカーボン)等の炭素を含
む膜はもちろん、その他にもエポキシ、ポリイミド、ポリアミド、ポリビニルフェノール
、ベンゾシクロブテン、アクリル等の有機材料、シロキサン系材料等の単層または積層構
造で設けることができる。
トランジスタ155としては、例えば、薄膜トランジスタ(TFT)で設けてもよいし
、Si等の半導体基板上に当該基板をチャネルとして形成した電界効果型トランジスタ(
FET)で設けてもよいし、チャネル領域を有機化合物材料により形成した有機TFTで
設けてもよい。また、トランジスタ155によって、CPU、メモリまたはマイクロプロ
セッサ等のありとあらゆる集積回路を設けることができる。ここでは、トランジスタ15
5として、nチャネル型半導体とpチャネル型半導体とを組み合わせたCMOS回路を有
する薄膜トランジスタを設けた例を示している。また、半導体膜に不純物領域(ソース領
域、ドレイン領域、LDD領域を含む)設け、ゲート電極の側面と接するように絶縁膜(
サイドウォール)を設けている。また、nチャネル型の半導体膜にLDDを形成し、pチ
ャネル型の半導体膜にはLDDを設けていない例を示しているが、もちろんpチャネル型
の半導体膜にもnチャネル型半導体膜と同様にLDD領域を設けてもよい。また、ソース
領域およびドレイン領域とゲート電極の一方または両方に、ニッケル、モリブデンまたは
コバルト等のシリサイド層を設けた構成としてもよい。薄膜トランジスタや有機TFTで
設けた場合、半導体膜を島状に設けるため、半導体装置に曲げ等の外力を加えた場合であ
っても、半導体膜に加わる応力を低減させて破損等を防止することができる。
屈折物質163としては、ここでは、絶縁膜157および絶縁膜158との積層体また
は絶縁膜156〜158の積層体と比較して曲がりやすい物質を設ける。例えば、ポリエ
チレン、酢酸ビニル、エチレン酢酸ビニル、ポリスチレン、ポリウレタン、ポリプロピレ
ン、ポリフッ化ビニル、塩化ビニル、ポリエステル、ポリアミドまたはポリイミド等の有
機材料やAu、Ag、CuまたはAl等の延性や展性に富んだ金属等を用いて設けること
ができる。また、上記材料を用いる場合、絶縁膜156、絶縁膜157および絶縁膜15
8に用いる物質より弾性率が低くなるように設ける。また、屈折物質163として、高分
子化合物を用いる場合は、絶縁膜156、絶縁膜157および絶縁膜158に用いる物質
よりガラス転移点が低くなるように設ける。屈折物質163に用いる材料として、絶縁膜
156〜158のうち少なくとも一つと同様の材料を用いて形成してもよく、この場合に
は、絶縁膜156〜158のうち少なくとも一つに用いる材料と屈折物質163として用
いる材料におけるそれぞれのガラス転移点が異なるように形成し、屈折物質163として
用いる材料のガラス転移点が絶縁膜156〜158のうち少なくとも一つに用いる材料の
ガラス転移点より低くなるように設ける。例えば、絶縁膜156、絶縁膜157または絶
縁膜158に有機材料を用いる場合、絶縁膜156、絶縁膜157または絶縁膜158に
設ける有機材料のガラス転移点を室温より高くなるように設け、屈折物質163として用
いる有機材料のガラス転移点を室温より低くなるように設けることができる。
なお、上記図1(B)では、屈折部分153として、絶縁膜156〜158形成された
開口部131に屈折物質163を充填することによって設ける例を示したが、屈折物質1
63を設ける代わりに絶縁膜156、157または158に切込みをいれたり、開口部に
何も設けずに空間160としたりすることによって、屈折部分153を設けることもでき
る(図1(C))。このように、絶縁膜156〜158の積層体の一部または全部に切込
みや空間を設けることによって、半導体装置に応力が加えられた時に、当該切込みや空間
の部分に応力を集中させトランジスタ等に加わる応力を低減させることができる。
なお、図1においては、基板151に設けられたCPUやメモリ等の各種機能を有する
集積回路152a〜152dの間に屈折部分153を設ける構造としたが、これに限られ
ず、応力が加わるのを避けたい部分以外であればどこに設けても構わない。例えば、集積
回路152a〜152dの領域内に設けることも可能である。この場合の一例を図2に示
す。
図2(A)においては、集積回路152a〜152dをそれぞれ複数のブロックに分割
して、各ブロックの間に屈折部分を設けた場合を示している。より具体的には、集積回路
152bを例に挙げると、集積回路152bがブロック161a〜161fの6つの領域
に分割され、それぞれのブロックの間に、応力が加えられた際に選択的にひずみが生じる
屈折部分162a、162b、162c等が設けられている。各ブロック間に設けられる
屈折部分162a〜162cは、トランジスタを避けて設けられている。
図2(A)におけるc−d間の断面構造の模式図を図2(B)に示す。
可撓性を有する基板151上に絶縁膜154を介してブロック161a〜161cの各
領域に含まれるトランジスタ155が設けられ、トランジスタ155を覆うように絶縁膜
156〜158が設けられ、絶縁膜156〜158に形成された開口部132a、132
bにそれぞれ屈折物質164a、164bが設けられている。また、開口部132aはブ
ロック161aと161bの間に設けられ、開口部132bはブロック161bと161
cの間に設けられている。
また、図2(C)に示すように、屈折物質164a、164bを設ける代わりに絶縁膜
156、157または158に切込みをいれたり、開口部に何も設けずに空間165a、
165bを設けたりする構造とすることも可能である。
なお、屈折部分はトランジスタとトランジスタの間ごとに設けることもできる。
以上のように、半導体装置に屈折部分を設けることによって、半導体装置を曲げた場合
に当該屈折部分に選択的にひずみが生じて曲がるため、屈折部分以外の領域に設けられた
トランジスタ等の素子の破損等を防止することができる。また、半導体装置をある曲率半
径を有するように曲げる場合、屈折部分を設けた半導体装置は当該屈折部分を設けない半
導体装置に比べて、より小さい力を加えることによって曲げることができるため、トラン
ジスタ等に加わる応力を低減することができる。
(実施の形態2)
本実施の形態では、本発明の半導体装置の作製方法の一例について図面を参照して説明
する。
本実施の形態では、一旦ガラス等の剛性を有する基板上にトランジスタ等の素子を含む
素子形成層を設けた後に、剥離法を用いて当該剛性を有する基板上にから素子形成層を分
離させ、可撓性を有する基板上に素子形成層を設けることによって半導体装置を作製する
例を示す。
ここでは、1枚の基板170上に剥離層171を介して12個の素子形成層180を設
けた後に当該基板170から素子形成層180の剥離を行う例を示す(図3(A))。
まず、基板170上に剥離層171を形成し、当該剥離層171上に、絶縁膜154、
薄膜トランジスタ(TFT)175、絶縁膜156、絶縁膜157、導電膜194および
絶縁膜158からなる素子形成層180を形成する(図4(A))。具体的には、剥離層
171上に絶縁膜154を介して薄膜トランジスタ175を形成し、当該トランジスタを
覆うように絶縁膜156、157を形成し、絶縁膜157上に薄膜トランジスタ175の
不純物領域と接続するように導電膜194を形成し、当該導電膜194を覆うように絶縁
膜158を形成する。また、基板170と剥離層171との間に下地膜として絶縁膜を形
成してもよい。基板170と剥離層171との間に絶縁膜を設けることによって、基板1
70から剥離層171への汚染等を防止することができる。
次に、絶縁膜156〜158を選択的に除去することによって開口部172a、172
bを設ける(図4(B))。開口部172a、172bは、線状、円状等どのような形状
に設けてもよく、トランジスタ175を避けた部分に設ける。また、開口部172a、1
72bは、フォトリソグラフィ法やレーザ光の照射により設けることができる。
次に、開口部172a、172bにそれぞれ屈折物質173a、173bを設ける(図
4(C))。
次に、基板170から素子形成層180の剥離を行う。ここでは、素子形成層180に
選択的にレーザ光を照射して開口部176を形成後、物理的な力を用いて基板170から
素子形成層180を剥離する。また他の剥離法として、開口部176を形成して剥離層1
71を露出させた後、開口部176にエッチング剤を導入することによって、剥離層17
1を除去した後に、剥離を行っても良い(図5(A))。この場合、剥離層171を全て
除去してもよいし、エッチングの条件を制御することによって剥離層171の一部を残す
ように除去を行ってもよい。ここでは、剥離層171の一部を残すように剥離層171の
除去を行う。剥離層171の一部を残すように除去を行うことによって、剥離層171を
除去した後も素子形成層180が基板170から完全に剥離せず、バラバラになることを
防ぐことができる。さらに、エッチング時間の短縮やエッチング剤の使用量の低減を図る
ことができるため作業効率の向上および低コスト化を達成することができる。
次に、絶縁膜158の表面に粘着性を有するフィルム177を貼り合わせて設け、素子
形成層180を基板170から剥離させる(図5(B))。ここでは、基板170と素子
形成層180における絶縁膜154とが、残存した剥離層によって一部つながれているた
め、物理的手段を用いて基板170から素子形成層180を剥離させる。
次に、素子形成層180を、可撓性を有する基板151および基板159で封止する(
図3(B)、図5(C))。封止の具体例を図6(A)に示す。基板170から剥離した
側の素子形成層180の表面をフィルム状の基板151に接着させて、フィルム177を
剥離させ、その後フィルム177から剥離した側の素子形成層180の表面をフィルム状
の基板159に接着させて封止を行う。この際、加熱処理及び加圧処理の一方又は両方を
行う封止ロール192、フィルム状の基板159が巻き付けられた供給ロール191及び
ベルトコンベア190を用いると、順次、基板151、159に封止された半導体装置を
形成することができる。次に、切断手段193により、基板151、159を切断する。
以上の工程によって、可撓性を有する半導体装置を設けることができる(図6(B))
。なお、素子形成層180を基板159で封止せずに、可撓性を有する基板151上に設
け段階で完成としてもよい。以下に、上記工程において用いる材料等についての具体的な
説明を行う。
基板170としては、ガラス基板、石英基板、金属基板、半導体基板やステンレス基板
の一表面に絶縁膜を形成したもの等を用いることができる。このような基板であれば、そ
の面積や形状に大きな制限はないため、基板170として、例えば、1辺が1メートル以
上であって、矩形状のものを用いれば、生産性を格段に向上させることができる。このよ
うな利点は、円形のシリコン基板を用いる場合と比較すると、大きな優位点である。また
、本実施の形態では、剥離された基板170は再利用することができため、より低コスト
で半導体装置を作製することができる。例えば、原価の高い石英基板を用いた場合であっ
ても、繰り返し石英基板を利用することにより、低コストで半導体装置を作製することが
できるといった利点を有している。
基板170と剥離層171の間に下地膜として絶縁膜を設ける場合には、酸化珪素(S
iOx)、窒化珪素(SiNx)、酸化窒化珪素(SiOxNy)(x>y)、窒化酸化
珪素(SiNxOy)(x>y)等の酸素または窒素を有する絶縁膜の単層構造、または
これらの積層構造を用いることができる。これらの絶縁膜は、スパッタ法やプラズマCV
D法等の各種CVD法を用いて形成することができる。
剥離層171としては、金属膜や金属膜と金属酸化膜の積層構造やSi等の半導体膜や
酸化珪素膜等を用いることができる。金属膜としては、タングステン(W)、モリブデン
(Mo)、チタン(Ti)、タンタル(Ta)、ニオブ(Nd)、ニッケル(Ni)、コ
バルト(Co)、ジルコニウム(Zr)、亜鉛(Zn)、ルテニウム(Ru)、ロジウム
(Rh)、鉛(Pd)、オスミウム(Os)、イリジウム(Ir)から選択された元素ま
たは前記元素を主成分とする合金材料若しくは化合物材料からなる膜を、単層又は積層し
て形成する。また、これらの材料からなる膜は、スパッタ法やプラズマCVD法等の各種
CVD法を用いて形成することができる。金属膜と金属酸化膜の積層構造としては、上記
金属膜を形成した後に、酸素雰囲気下におけるプラズマ処理、酸素雰囲気下における加熱
処理を行うことによって、金属膜表面に当該金属膜の酸化物を設けることができる。例え
ば、金属膜としてスパッタ法により形成したタングステン膜を設けた場合、タングステン
膜にプラズマ処理を行うことによって、タングステン膜表面にタングステン酸化物からな
る金属酸化膜を形成することができる。また、この場合、タングステンの酸化物は、WO
xで表され、Xは2〜3であり、Xが2の場合(WO)、Xが2.5の場合(W
)、Xが2.75の場合(W11)、Xが3の場合(WO)などがある。タングス
テンの酸化物を形成するにあたり、上記に挙げたXの値に特に制約はなく、エッチングレ
ート等を基に、どの酸化物を形成するかを決めるとよい。また、金属酸化膜の他にも、金
属窒化物や金属酸化窒化物を用いてもよい。この場合、上記金属膜に窒素雰囲気下または
O雰囲気下でプラズマ処理や加熱処理を行えばよい。また、他の方法として金属膜を
形成した後に、絶縁膜154を酸素雰囲気下でスパッタ法を用いて形成することによって
金属膜表面に金属酸化膜を設けることができる。また、金属膜を形成した後に、金属をタ
ーゲットとして酸素雰囲気下でスパッタを行うことにより金属膜表面に金属酸化膜を設け
ることも可能である。この場合、金属膜と金属酸化膜は異なる金属元素で設けることが可
能となる。なお、これらの方法も窒素雰囲気下または窒素と酸素雰囲気下でスパッタを行
うことにより金属膜上に金属窒化物や金属酸化窒化物を形成することができる。
素子形成層180は、少なくとも絶縁膜154、薄膜トランジスタ175、絶縁膜15
6、絶縁膜157および絶縁膜158を有している。素子形成層180によってCPU、
メモリまたはマイクロプロセッサ等のありとあらゆる集積回路を設けることができる。ま
た、素子形成層180は、薄膜トランジスタ175に加えてアンテナを有した形態もとり
うる。例えば、薄膜トランジスタで構成される集積回路は、アンテナで発生した交流の電
圧を用いて動作を行い、アンテナに印可する交流の電圧を変調することにより、リーダ/
ライタへの送信を行うことができる。なお、アンテナは、薄膜トランジスタとともに形成
してもよいし、薄膜トランジスタとは別個に形成し、後に電気的に接続するようにして設
けてもよい。
絶縁膜154としては、スパッタ法やプラズマCVD法等により、酸化珪素(SiOx
)、窒化珪素(SiNx)、酸化窒化珪素(SiOxNy)(x>y)、窒化酸化珪素(
SiNxOy)(x>y)等の酸素または窒素を有する絶縁膜の単層構造、またはこれら
の積層構造を用いて形成することができる。例えば、絶縁膜154を2層構造で設ける場
合、1層目の絶縁膜として窒化酸化珪素膜を形成し、2層目の絶縁膜として酸化窒化珪素
膜を形成するとよい。また、絶縁膜154を3層構造で設ける場合、1層目の絶縁膜とし
て酸化窒化珪素膜を形成し、2層目の絶縁膜として窒化酸化珪素膜を形成し、3層目の絶
縁膜として酸化窒化珪素膜を形成するとよい。
薄膜トランジスタ175としては、どのような構造としてもよく、例えば不純物領域(
ソース領域、ドレイン領域、LDD領域を含む)を形成してもよいし、pチャネル型、n
チャネル型またはpチャネル型とnチャネル型の半導体を組み合わせたCMOS回路で設
けてもよい。また、半導体膜の上方に設けられるゲート電極の側面と接するように絶縁膜
(サイドウォール)を形成してもよいし、ソース領域およびドレイン領域とゲート電極の
一方または両方に、ニッケル、モリブデンまたはコバルト等のシリサイド層を形成しても
よい。薄膜トランジスタ175における半導体として、非晶質半導体または結晶質半導体
を用いることができるが、より特性の高い薄膜トランジスタを用いる場合には、結晶質半
導体を用いて薄膜トランジスタを設けることが好ましい。この場合、絶縁膜154上にス
パッタ法、LPCVD法、プラズマCVD法等により非晶質半導体膜を形成し、続いて、
非晶質半導体膜を結晶化法(レーザ結晶化、RTAまたはファーネスアニール炉を用いる
熱結晶化法、結晶化を助長する金属元素を用いる熱結晶化法、結晶化を助長する金属元素
を用いる熱結晶化法とレーザ結晶化法を組み合わせた方法等)により結晶化して、結晶質
半導体膜を形成する。
絶縁膜156としては、上記実施の形態で示した材料と同様の材料を用いて形成するこ
とができる。
絶縁膜157、158としては、上記実施の形態で示した材料と同様の材料を用いて形
成することができる。特にエポキシ、ポリイミド、ポリアミド、ポリビニルフェノール、
ベンゾシクロブテン、アクリル等の有機材料、シロキサン系材料等の材料は、スピンコー
ティング法、液滴吐出法または印刷法等を用いることによって形成することができるため
、平坦化や処理時間の効率化を図ることができる。また、絶縁膜157、158は、同じ
材料を用いて形成してもよいし、別々の材料を用いて形成してもよい。
導電膜194としては、Al、Ni、C、W、Mo、Ti、Pt、Cu、Ta、Au、
Mnから選ばれた一種の元素または当該元素を複数含む合金からなる単層または積層構造
を用いることができる。例えば、当該元素を複数含む合金からなる導電膜として、例えば
CとTiを含有したAl合金(Al−Ti−C)、Niを含有したAl合金(Al−Ni
)、CとNiを含有したAl合金(Al−Ni−C)、CとMnを含有したAl合金(A
l−Mn−C)等を用いることができる。
屈折物質173a、173bとしては、上記実施の形態で示した屈折物質163に示し
た材料と同様の材料を用いて形成することができる。また、屈折物質173a、173b
は、液滴吐出法、スクリーン印刷等の印刷法またはスピンコート法等を用いることによっ
て設けることができる。
エッチング剤としては、ハロゲン化物を含む気体又は液体を用いることができ、例えば
ClF(三フッ化塩素)、NF(三フッ化窒素)、BrF(三フッ化臭素)、HF
(フッ化水素)を使用することができる。なお、HFを使用する場合には、剥離層として
酸化珪素膜を用いる。
フィルム177としては、可撓性のフィルムを利用することができ、少なくとも一方の
面に粘着剤を有する面が設けてある。例えば、ポリエステル等の基材として用いるベース
フィルム上に粘着剤が設けてあるシート材を利用することができる。粘着剤としては、ア
クリル樹脂等を含んだ樹脂材料または合成ゴム材料からなる材料を用いることができる。
基板151、159としては、可撓性のフィルムを利用することができ、例えば、ポリ
プロピレン、ポリエステル、ビニル、ポリフッ化ビニル、塩化ビニルなどからなるフィル
ム、繊維質な材料からなる紙、基材フィルム(ポリエステル、ポリアミド、無機蒸着フィ
ルム、紙類等)と接着性合成樹脂フィルム(アクリル系合成樹脂、エポキシ系合成樹脂等
)との積層フィルム等を利用することができる。また、フィルムは、加熱処理と加圧処理
により、被処理体と熱圧着されるものであり、加熱処理と加圧処理を行う際には、フィル
ムの最表面に設けられた接着層か、または最外層に設けられた層(接着層ではない)を加
熱処理によって溶かし、加圧により接着する。なお、フィルム177と基板159とを用
いて素子形成層180の封止を行ってもよい。
また、本発明の半導体装置は上記構成に限られず、他の構成で設けることも可能である
。その具体例に関して図7〜図10を参照して説明する。
上述した半導体装置の構成では、屈折部分に絶縁膜156〜158より曲がりやすい物
質を充填した例を示したが、図7(A)に示すように、屈折部分に何も充填せずに空間1
78a、178bとして設けることも可能である。空間178a、178bは、フォトリ
ソグラフィ法やレーザ光の照射等によって設けることができる。また、物理的な手段を用
いて切込み等を形成してもよい。
このように、絶縁膜156〜158を選択的に除去して空間を設けることによって、半
導体装置に曲げる等の外力を加えた場合、空間178a、178bで設けた屈折部分に選
択的にひずみを集中させることが可能となる。その結果、トランジスタに応力が加わるこ
とによるひずみを低減させすることができるため、トランジスタの損傷等を防止すること
ができる。また、屈折部分を空間で設けることによって、材料を充填する工程を省くこと
ができるため、作製工程の効率化を達成することが可能となる。
また、図7(B)、図7(C)に示すように、屈折部分としては、素子形成層180を
貫通するように屈折物質181a、181bを設けて(図7(C))もよいし、貫通させ
ずに素子形成層の内部に設けて(図7(B))もよい。それぞれの作製工程について、図
8、図9を参照して説明する。
はじめに、図7(B)に示した半導体装置の作製工程について、図8に示す。
まず、基板170上に剥離層171を形成し、剥離層171上に絶縁膜154、薄膜ト
ランジスタ155、絶縁膜156、絶縁膜157を形成する(図8(A))。
次に、薄膜トランジスタ155の半導体膜の不純物領域と電気的に接続する導電層を設
けるために、絶縁膜156および絶縁膜157に選択的に開口部195を形成し、薄膜ト
ランジスタ155の半導体膜を露出させる。なお、このとき同時に開口部182a、18
2bを形成する(図8(B))。
次に、開口部182a、182bに屈折物質179a、179bを設け、開口部195
に導電膜194を設ける(図8(C))。
次に、導電膜194を覆うように絶縁膜158を形成し、絶縁膜154、156〜15
8に開口部183を形成して剥離層171を露出させる(図8(D))。
その後、上記図5(B)、(C)に示した工程と同様に行うことによって半導体装置が
完成する(図7(B))。図8に示した方法を用いることによって、開口部195と同時
に開口部182a、182bを設けることが可能となるため、作製工程を簡略化すること
ができる。
次に、図7(C)に示した半導体装置の作製工程について、図9に示す。
まず、基板170上に剥離層171を形成し、剥離層171上に絶縁膜154、薄膜ト
ランジスタ(TFT)155、絶縁膜156、絶縁膜157、導電膜194および絶縁膜
158からなる素子形成層180を形成する(図9(A))。
次に、絶縁膜154、156〜158を選択的に除去することによって開口部184a
、184b、185を設ける(図9(B))。また、開口部184a、184bは、フォ
トリソグラフィ法やレーザ光の照射により設けることができる。
次に、開口部184a、184bに屈折物質181a、181bを設ける(図9(C)
)。
その後、上記図5(B)、(C)に示した工程と同様に行うことによって半導体装置が
完成する図7(C)。図9に示した方法を用いることによって、開口部184a、184
b、185を同時に設けた場合には、作製工程を簡略化することができる。また、素子形
成層180を貫通するように屈折部分を設けることによって、半導体装置に曲げる等の力
を加えた場合であっても、薄膜トランジスタ等の破損を効果的に防止することができる。
また、図9(B)において、開口部184a、184bに何も設けずに屈折部分を空間
として設けることも可能である。この場合、開口部184a、184bからもエッチング
剤を導入することが可能となるため、剥離層171を効率的に除去することができる。
また、図9において、絶縁膜154、156〜158および剥離層171を除去するこ
とによって開口部186a、186b、187設けてもよい(図10(A))。この場合
、開口部186a、186bに設けられた屈折物質188a、188bは、基板170と
接続している。そのため、剥離層171を完全に除去した場合であっても、基板170と
素子形成層180が屈折物質188a、188bによって接続されているため、バラバラ
になることを防止することができる。その後、物理的手段を用いて基板170から素子形
成層180を剥離し、封止処理を行うことによって半導体装置を作製することができる。
また、図29(A)に示すようにトランジスタ175等を含む曲げたくない領域に保護
膜196を設けた構成としてもよい。保護膜196は、少なくともトランジスタ間に設け
られる物質(ここでは屈折物質173a、173b)より曲がりにくい物質で設ける。例
えば、保護膜196としては、屈折物質173a、173bより弾性率が高い物質、ガラ
ス転移点が高い物質、硬度が高い物質または塑性を有さない物質等を用いることができる
。また、保護膜196は、トランジスタ175の上方だけでなく下方に設けることも可能
である。保護膜196としては、W、Ti、Mo、Ni、Ta、Mn等の金属やフェノー
ル樹脂、尿素樹脂、メラミン樹脂、不飽和ポリエステル樹脂、アクリル樹脂、エポキシ樹
脂、ケイ素樹脂等の熱硬化性樹脂等を用いることができる。他にも、いわゆるセラミック
ス等の硬度の高い物質を用いることができる。また、屈折物質173a、173bと同様
の材料を用いることも可能であるが、その場合であっても屈折物質173a、173bに
用いる材料より弾性率が高い物質、ガラス転移点が高い物質、硬度が高い物質または塑性
を有さない材料で形成する。
また、図29(B)に示すように図29(A)の構成に加えて、当該保護膜が設けられ
ていない部分の基板151と基板159の一方または両方に凹部197を設けた構成とし
てもよい。なお、図29(B)では、トランジスタの上方と下方に保護膜196を設けた
例を示している。また、図29(B)における保護膜196は、トランジスタ間に位置す
る部分198における絶縁膜等の積層体より曲がりにくい物質で設ければよく、部分19
8に屈折物質を設けることも可能である。このように、素子形成層を封止するフィルム状
の基板に凹部を設けることによって、半導体装置に応力が加わった場合、当該凹部に応力
が集中するため、トランジスタに加わる応力を低減し破損を防止することができる。
なお、本実施の形態では、半導体装置の作製方法として、ガラス等の剛性を有する基板
上に素子形成層を設けた後に、素子形成層を剥離して可撓性を有する基板上に設ける方法
を示したが本発明の半導体装置の作製方法はこれに限られない。例えば、ガラス基板やS
i等の半導体基板上に素子形成層を設けた後に、当該ガラス基板やSi等の半導体基板を
研削処理や研磨処理によって薄膜化してもよい。この場合、剥離を行わなくとも可撓性を
有する半導体装置を作製することが可能となる。また、集積回路に設ける素子として薄膜
トランジスタを設けた例を示したが、これに限られずダイオードや容量素子等を設ける場
合であっても同様にダイオードや容量素子間に屈折部分を設けることができる。
なお、本実施の形態は上記実施の形態と自由に組み合わせて行うことができる。
(実施の形態3)
本実施の形態では、上記実施の形態で示した半導体装置とは異なる構成について図面を
参照して説明する。
半導体装置に設けられる集積回路において、トランジスタが単体または単体に近い状態
で配置された場合、静電気による破壊や外部からの応力による破壊等が起こりやすくなる
。そこで、図11に示すように、トランジスタの周囲にシリコン等の半導体や金属等から
なるダミーパターンまたはダミートランジスタを設けることによって、静電気や応力によ
るトランジスタの破壊を低減することができる。以下に図11を参照して説明する。
図11(A)は、トランジスタ251のソースドレイン方向に隣接してダミートランジ
スタ252a、252bを配置した例を示している。図11(B)は、図11(A)にお
けるg−h間の断面図を示している。ダミートランジスタ252a、252bは、トラン
ジスタ251と同様に設けることができる。
また、図11(C)に示すように、トランジスタ251のソースドレイン方向に垂直な
方向に隣接してダミートランジスタ253a、253bを設けることもできる。もちろん
、図11(D)に示すように、トランジスタ251の四方にダミートランジスタ254a
〜254hを設けてもよい。このように、単体または単体に近い状態で配置されているト
ランジスタの周囲にダミートランジスタを設けることによって、静電気や応力等によって
トランジスタ251が破壊されることを防止することができる。
また、図11(E)に示すように、トランジスタ251の周囲に半導体、金属または絶
縁膜等を用いてダミーパターン255を設けてもよい。ダミーパターン255は、上記実
施の形態で示したような曲がりやすい物質を適用することによって、半導体装置を曲げた
場合に選択的にダミーパターン255にひずみが生じて曲がるため、トランジスタ251
に生じるひずみを抑制し当該トランジスタの破壊を防止することができる。
なお、図11に示したダミートランジスタやダミーパターンとあわせて、上記実施の形
態に示した屈折部分を設けることによって、半導体装置に曲げ等の物理的な力を加えた場
合であっても、より効果的に半導体装置におけるトランジスタ等の破壊を防止することが
できる。
また、半導体装置に加わる応力によって生じるひずみを考慮してトランジスタを設ける
ことによって、トランジスタ等の破壊を効果的に防止することができる。例えば、半導体
装置を曲面に貼り合わせて設ける場合、曲面の母線の方向とトランジスタのキャリアが移
動する方向とがそろうように設けることが望ましい(図19)。このように設けることに
よって、錐面、柱面等の母線の移動によって描かれる曲面を有するように曲がってしまう
場合でも、トランジスタに影響が生じることを抑制することができる。
また、応力等によるトランジスタ等の素子の破壊を防止するためには、トランジスタ等
の素子の活性領域(シリコンアイランド部分)の面積の全体の面積に対して占める割合を
5〜50%とすることが好ましい。
なお、本実施の形態は上記実施の形態と自由に組み合わせて行うことができる。
(実施の形態4)
上記実施の形態で示した半導体装置の作製方法とは異なる例について図面を参照して説
明する。
本実施の形態では、基板上に集積回路を貼り合わせて設ける例を示す。
図12(A)に示すように、基板260上に集積回路261a〜261dを貼り合わせ
ることによって設ける(図12(A))。基板260上に設けられた集積回路261a〜
261dはそれぞれ配線262により電気的に接続されている。図12(A)におけるi
−j間の断面構造の模式図を図12(B)に示す。
図12(B)において、集積回路261a、261bの端子部272a、272bと配
線262とが電気的に接続されている。ここでは、接着剤として機能する樹脂266に含
まれる導電性粒子267を介して端子部272a、272bと配線262との接続を行っ
ている。また、集積回路を構成するトランジスタとしては、薄膜トランジスタ(TFT)
、半導体基板にチャネル領域を形成して設ける電界効果型トランジスタ(FET)または
有機トランジスタ等を用いることができる。ここでは、単結晶シリコン基板270をチャ
ネル領域として設けた電界効果型トランジスタ271を用いた例を示す。単結晶シリコン
等の半導体基板を用いてトランジスタのチャネル領域を形成することによって、高い特性
を有するトランジスタを形成することができる。
図12に示したように、基板260上に集積回路261a〜261dを貼り合わせるこ
とによって半導体装置を形成する場合、あらかじめ配線262が設けられている基板26
0上に集積回路261a〜261dを設ける方法(図13(A))と、基板260上に集
積回路261a〜261dを貼り合わせて設けた後に配線262を形成する方法(図13
(B))がある。以下に、それぞれの方法に関して、図面を参照して説明する。
図13(A)に示すように、あらかじめ配線が形成されている基板上に集積回路を設け
る場合は、集積回路に設けられた端子部と基板上に設けられた配線とを電気的に接続する
ように貼り合わせる。ここでは、基板260上にあらかじめ形成されている配線262と
集積回路261a、261bに露出するように設けられた端子部272a、272bとを
電気的に接続する(図14(A))。ここでは、接着剤として機能する樹脂266に含ま
れる導電性粒子267を介して端子部272a、272bと配線262とを接続する(図
14(B))。
一方、図13(B)に示すように、基板上に集積回路を設けた後に配線を形成する場合
は、集積回路に設けられた端子部と基板上に設けられた導電膜とを電気的に接続するよう
に貼り合わせた後に、配線として機能する導電膜を形成する。ここでは、基板260上に
あらかじめ形成されている導電膜263と集積回路261a、261bに露出するように
設けられた端子部272a、272bとを電気的に接続した(図15(A))後に、液滴
吐出法やスクリーン印刷等の印刷法により配線として機能する導電膜265を形成する(
図15(B))。なお、ここでは、基板260上にあらかじめ形成されている導電膜26
3をアライメントマーカーとして利用することにより、基板260上に集積回路を精確に
貼り合わせて設けることができる。なお、液滴吐出法とは、導電性や絶縁性等を有する材
料を含んだ組成物の液滴(ドットともいう)を選択的に吐出(噴射)して任意の場所に形
成する方法であり、その方式によってはインクジェット法とも呼ばれている。
配線262、導電膜263、導電膜265として、金(Au)、銀(Ag)、白金(P
t)、ニッケル(Ni)、タングステン(W)、クロム(Cr)、モリブデン(Mo)、
鉄(Fe)、コバルト(Co)、銅(Cu)、パラジウム(Pd)、炭素(C)、アルミ
ニウム(Al)、マンガン(Mn)、チタン(Ti)、タンタル(Ta)等から選ばれた
一種の元素または当該元素を複数含む合金からなる単層または積層構造を用いることがで
きる。
また、液滴吐出法やスクリーン印刷法等を用いて導電膜265を形成する場合には、あ
らかじめ基板260に配線として機能する導電膜265を設ける部分に凹部273を設け
ておくことにより、より的確に導電膜265を基板260上に形成することができる(図
16(A)、(B))。基板260に設ける凹部273は、基板260に配線パターンを
有するニッケル(Ni)、コバルト(Co)、銅(Cu)、鉄(Fe)、亜鉛(Zn)等
の金属またはこれらの合金からなる金属製の金型やシリコンを加工した型等をプレスする
ことにより設けることができる。また、他にも、基板260にレーザ光を照射することに
よって、配線パターンを有する凹部を形成することができる。また、レーザ光等の照射に
より、凹部を設けるのではなく、基板260における表面の性質(親水性や疎水性等)を
変化させることによって、選択的に吐出された液滴が着弾するようにすることも可能であ
る。
また、基板260上に形成される配線として機能する2つの導電膜265と導電膜27
5が交叉する場合には、2つの導電膜が電気的に接続しないように導電膜265と導電膜
275の交叉する部分にのみ液滴吐出法により絶縁膜274を設ける(図16(C))。
導電膜が交叉する部分にのみ絶縁膜を形成することによって、材料の利用効率や工程の効
率化を達成することができる。
次に、基板260上に設けられた複数の集積回路を封止する場合について、図17を参
照して説明する。
図17(A)に示すように、基板260上に複数の集積回路を設ける場合、半導体装置
に応力が加わることにより生じたゆがみによって集積回路が破損しないように封止を行う
ことが好ましい。そのため、半導体装置に応力が加えられた場合に集積回路と集積回路の
間に、選択的にゆがみが生じて曲がる屈折部分を設ける。さらに、より微細な集積回路を
多数設けることによって、集積回路間に形成される屈折部分が増加するため半導体装置を
曲げた場合に集積回路の破損を防止することができる。図17(A)のk−l間の断面図
の一例を図17(B)、(C)に示す。
図17(B)において、基板260上に設けられた集積回路間に選択的にひずみが生じ
て曲がりやすい物質282が設けられ、当該集積回路を覆うように可撓性を有するフィル
ム281が設けられている。物質282は、集積回路やフィルム281より曲がりやすけ
ればよく、例えば集積回路やフィルム281より、弾性率が低い物質、塑性を示す物質ま
たはフィルム281よりガラス転移温度が低い物質等を用いることができる。
また、図17(C)に示すように、集積回路を可撓性を有するフィルム281等で覆う
場合に、集積回路間に空間284を形成するように封止を行うことによって集積回路間に
屈折部分を設けることもできる。また、屈折部分における基板260に凹凸のパターン2
83を設けることによって、屈折部分に応力を集中させて半導体装置を曲げることにより
、集積回路に応力が加わることを防止することが可能となる。また、図17(B)、(C
)において、上記図29で示したようにフィルム281を設ける前にトランジスタの上方
に保護膜を設けた構成とすることもできる。
なお、本実施の形態では、フェイスダウン型の半導体装置の例を示したが、もちろんフ
ェイスアップ型の半導体装置とすることも可能である(図18(A))。ここでは、基板
260上に導電膜285を有する集積回路を貼り合わせた後に液滴吐出法や印刷法等を用
いて導電膜265を形成することにより導電膜285と導電膜265とを接続している。
他にも、ワイヤボンディング法等により実装することによってフェイスアップ型の半導体
装置を設けることも可能である。
また、本実施の形態では、集積回路として半導体基板にチャネル領域を形成して設ける
電界効果型トランジスタ(FET)を用いた例を示したが、これに限られず、例えば薄膜
トランジスタ(TFT)を用いることも可能である(図18(B))。この場合、上記実
施の形態で示したように薄膜トランジスタ175間においても屈折部分286を設けるこ
とによって、半導体装置を曲げる場合により小さい力で大きく曲げることができ且つトラ
ンジスタの破損を防止することができる。
なお、本実施の形態は上記実施の形態と自由に組み合わせて行うことができる。
(実施の形態5)
本実施の形態では、上記実施の形態で示した可撓性を有する半導体装置にアンテナを設
けることによって、非接触でデータのやりとりができる半導体装置を作製することができ
る。非接触でデータのやりとりが可能である半導体装置は、一般的にRFID(Radi
o Frequency Identification)タグ(ICタグ、ICチップ
、RFタグ(Radio Frequency)、無線タグ、電子タグ、無線チップとも
いう)と呼ばれることもある。以下に、非接触でデータのやりとりが可能である半導体装
置の一例について図面を参照して説明する。
一般的に非接触でデータのやりとりが可能である半導体装置(以下、RFIDタグとも
よぶ)は、集積回路とアンテナとを有しており、アンテナを介して非接触で外部の機器(
リーダ/ライタ)間とデータのやりとりを行うことができる。そのため、上記実施の形態
で示した半導体装置にアンテナとして機能する導電膜を設けることによって、非接触でデ
ータのやりとりが可能である半導体装置を作製することができる。例えば、図1に示した
半導体装置150にアンテナとして機能する導電膜を設けることができる。この場合、図
1における集積回路152a〜152dとしては、例えば、電源回路、クロック発生回路
、復調回路、変調回路、記憶回路、他の回路の制御を行う制御回路のうち少なくとも一つ
等が含まれている。次に、アンテナを設けた具体的な構成例を図20、図21に示す。
図20(A)は、上記実施の形態1で示した半導体装置にアンテナとして機能する導電
膜291を設けた例を示している。導電膜291は、上記実施の形態2の図4において、
絶縁膜158上に形成することによって設けることができる。また、導電膜291を覆う
ように絶縁膜292を形成した後に、屈折部分となる部分に開口部を形成し、当該開口部
に屈折物質173a、173bを充填して設ける。
導電膜291としては、銅(Cu)、アルミニウム(Al)や銀(Ag)や金(Au)
、クロム(Cr)、モリブデン(Mo)、チタン(Ti)、タンタル(Ta)、タングス
テン(W)、ニッケル(Ni)等の金属、金属化合物を1つまたは複数有する導電材料を
用いて形成することができる。また、絶縁膜292は、酸化珪素(SiOx)、窒化珪素
(SiNx)、酸化窒化珪素(SiOxNy)(x>y)、窒化酸化珪素(SiNxOy
)(x>y)等の酸素または窒素を有する絶縁膜、DLC(ダイヤモンドライクカーボン
)等の炭素を含む膜、エポキシ、ポリイミド、ポリアミド、ポリビニルフェノール、ベン
ゾシクロブテン、アクリル等の有機材料、シロキサン系材料等の単層または積層構造を用
いて形成することができる。
もちろん、図7に示す構造に、アンテナとして機能する導電膜を設けることによって、
非接触でデータのやりとりが可能な半導体装置を作製することも可能である。
図20(B)は、アンテナとして機能する導電膜293が設けられたアンテナ用基板2
94を上記実施の形態1で示した半導体装置の素子形成層と貼り合わせて設けた例を示し
ている。この場合、素子形成層とアンテナ用基板は別途作製したものを用いる。
素子形成層とアンテナ用基板は、接着剤として機能する樹脂295によって貼り合わさ
れており、絶縁膜158上に形成された導電膜299とアンテナとして機能する導電膜2
93が樹脂295に含まれる導電性粒子296を介して電気的に接続されている。
このように、アンテナは、素子形成層にアンテナとして機能する導電膜を直接形成して
設けてもよいし、アンテナ用基板にアンテナとして機能する導電膜を別途形成した後に素
子形成層と貼り合わせることによって設けてもよい。
図21は、上記実施の形態4で示した半導体装置にアンテナを設けた例を示している。
ここでは、アンテナとして機能する導電膜297があらかじめ設けられた基板260上に
、集積回路261a〜261dを設けることによって非接触でデータのやりとりが可能な
半導体装置を作製している(図21(A))。この場合、集積回路261a〜261dに
は、例えば、電源回路、クロック発生回路、復調回路、変調回路、記憶回路、他の回路の
制御を行う制御回路のうち少なくとも一つ等が含まれている。
また、アンテナとして機能する導電膜297は配線262と同様に設けておくことがで
きる。この場合、アンテナとして機能する導電膜297と集積回路との接続は、上記実施
の形態4と同様に、導電膜298と集積回路の端子部272とが接着剤として機能する樹
脂266に含まれる導電性粒子267を介して行うことができる(図21(B))。
なお、上記図15に示したように、基板260に集積回路261a〜261bを形成し
た後に、配線となる導電膜と共にアンテナとして機能する導電膜297を液滴吐出法や印
刷法等を用いて形成することも可能である。
また、本実施の形態は、上記図20、図21の構成に限られず、上記実施の形態に示し
た半導体装置にアンテナを設けた構成であればどのように組み合わせて設けてもよい。
次に、非接触でデータのやりとりが可能である半導体装置の適用例に関して図面を参照
して以下に説明する。
RFIDタグ80は、非接触でデータを交信する機能を有し、電源回路81、クロック
発生回路82、データ復調回路83、データ変調回路84、他の回路を制御する制御回路
85、記憶回路86およびアンテナ87を有している(図22(A))。なお、記憶回路
は1つに限定されず、複数であっても良く、SRAM、フラッシュメモリ、ROMまたは
FeRAM等や有機化合物層を記憶素子部に用いたものを用いることができる。
リーダ/ライタ88から電波として送られてきた信号は、アンテナ87において電磁誘
導により交流の電気信号に変換される。電源回路81では、交流の電気信号を用いて電源
電圧を生成し、電源配線を用いて各回路へ電源電圧を供給する。クロック発生回路82は
、アンテナ87から入力された交流信号を基に、各種クロック信号を生成し、制御回路8
5に供給する。復調回路83では、当該交流の電気信号を復調し、制御回路85に供給す
る。制御回路85では、入力された信号に従って各種演算処理を行う。記憶回路86では
、制御回路85において用いられるプログラムやデータ等が記憶されている他、演算処理
時の作業エリアとしても用いることができる。そして、制御回路85から変調回路84に
データが送られ、変調回路84から当該データに従ってアンテナ87に負荷変調を加える
ことができる。リーダ/ライタ88は、アンテナ87に加えられた負荷変調を電波で受け
取ることにより、結果的にデータを読み取ることが可能となる。
また、RFIDタグは、各回路への電源電圧の供給を電源(バッテリ)を搭載せず電波
により行うタイプとしてもよいし、電源(バッテリ)を搭載して電波と電源(バッテリ)
により各回路に電源電圧を供給するタイプとしてもよい。
上記実施の形態で示した構成を用いることによって、折り曲げることが可能なRFID
タグを作製することが可能となるため、曲面を有する物体に貼り付けて設けることが可能
となる。
次に、可撓性を有するRFIDタグの使用形態の一例について説明する。表示部321
を含む携帯端末の側面には、リーダ/ライタ320が設けられ、品物322の側面にはR
FIDタグ323が設けられる(図22(B))。品物322が含むRFIDタグ323
にリーダ/ライタ320をかざすと、表示部321に品物322の原材料や原産地、生産
工程ごとの検査結果や流通過程の履歴等、更に品物322の説明等の商品に関する情報が
表示される。また、商品326をベルトコンベアにより搬送する際に、リーダ/ライタ3
24と、商品326に設けられたRFIDタグ325を用いて、該商品326の検品を行
うことができる(図22(C))。このように、システムにRFIDを活用することで、
情報の取得を簡単に行うことができ、高機能化と高付加価値化を実現する。また、上記実
施の形態で示したように、曲面を有する物体に貼り付けた場合であっても、RFIDタグ
に含まれるトランジスタ等の損傷を防止し、信頼性の高いRFIDタグを提供することが
可能となる。
また、上述した非接触データのやりとりが可能である半導体装置における信号の伝送方
式は、電磁結合方式、電磁誘導方式またはマイクロ波方式等を用いることができる。伝送
方式は、実施者が使用用途を考慮して適宜選択すればよく、伝送方式に伴って最適なアン
テナを設ければよい。
例えば、半導体装置における信号の伝送方式として、電磁結合方式または電磁誘導方式
(例えば13.56MHz帯)を適用する場合には、磁界密度の変化による電磁誘導を利
用するため、アンテナとして機能する導電膜を輪状(例えば、ループアンテナ)、らせん
状(例えば、スパイラルアンテナ)に形成する。
また、半導体装置における信号の伝送方式として、マイクロ波方式(例えば、UHF帯
(860〜960MHz帯)、2.45GHz帯等)を適用する場合には、信号の伝送に
用いる電磁波の波長を考慮してアンテナとして機能する導電層の長さ等の形状を適宜設定
すればよく、例えば、アンテナとして機能する導電膜を線状(例えば、ダイポールアンテ
ナ)、平坦な形状(例えば、パッチアンテナ)またはリボン型の形状等に形成することが
できる。また、アンテナとして機能する導電膜の形状は線状に限られず、電磁波の波長を
考慮して曲線状や蛇行形状またはこれらを組み合わせた形状で設けてもよい。
次にRFIDタグを実装した商品の管理方法の一例に関して図面を参照して説明する。
図30は、セット商品の受注生産管理システムの一例を示すブロック図である。図30
に示すシステムでは、消費者等である複数の個人がセット商品を注文した場合に、当該セ
ット商品の管理センターが商品の受注データに従って製造元Aおよび製造元Bから商品を
調達した後に、個人へセット商品を発送する一例を示している。なお、ここでは便宜上、
個人1〜個人3が商品を注文する場合を示す。
個人1〜個人3は、LAN等のネットワークを介して、管理センターが提供するセット
商品の内容に関して閲覧し、希望するセット商品を注文することができる。なお、ここで
は、商品Aと商品Bとの組み合わせたものをセット商品とする。なお、商品Aは、a1、
a2、a3・・・anの複数の商品を有しており、商品Bは、b1、b2、b3・・・b
nの複数の商品を有している。個人は商品Aおよび商品Bからそれぞれ希望の商品を組み
合わせてセット商品とすることができる。
例えば、商品A(例えば茶器)と商品B(例えば茶葉)からなるセット商品を考えた場
合、商品Aは、茶器の形状等が異なる複数の商品a1、a2、a3・・・anを有してお
り、商品Bは、茶葉の種類が異なる複数の商品b1、b2、b3・・・bnを有しており
、個人1〜個人3は、商品Aおよび商品Bから希望の商品の組み合わせをセット商品とし
て注文する。なお、ここでは、個人1がa1とb1の組み合わせからなるセット商品1を
、個人2がa2とb2の組み合わせからなるセット商品2を、個人3がa3とb3の組み
合わせからなるセット商品3を注文する場合を示している。
個人1〜3から注文があった場合、管理センターは、受注データに従って製造元Aおよ
び製造元Bに当該商品の発注を行う。製造元Aは、管理センターから送られてきた受注デ
ータAに従って商品a1、a2、a3を製造する。また、商品を製造する際に受注データ
Aに従ってそれぞれの商品にRFIDタグを設ける。また、製造元Bも同様に、管理セン
ターから送られてきた受注データBに従って、RFIDタグを備えた商品b1、b2、b
3の製造を行う。なお、RFIDタグの識別番号等は、あらかじめ管理センターで注文の
あった商品に割り当てて管理されている。その後、製造元Aおよび製造元Bから、それぞ
れRFIDタグが設けられた商品(a1、a2、a3)および商品(b1、b2、b3)
が管理センターに送られる。
管理センターでは、製造元Aおよび製造元Bから送られてきた商品を個別受注品データ
に従って、a1〜a3およびb1〜b3を組み合わせることによって、セット商品1(a
1+b1)、セット商品2(a2+b2)およびセット商品3(a3+b3)とする。な
お、ここではa1〜a3およびb1〜b3に設けられたRFIDタグを用いることによっ
て、中身等を確認せずに容易に複数の商品を識別して、セット商品1〜セット商品3とす
ることができる。その後、管理センターは、当該セット商品1〜セット商品3をそれぞれ
個人1〜個人3に発送する。
このように、複数の商品を組み合わせて一つのセット商品とする場合、あらかじめ組み
合わせられる商品にRFIDタグを設けることによって、異なる製造元に発注した場合で
あっても、RFIDタグを用いて識別を行うことによって少ない労力で容易に複数の商品
を識別して所望のセット商品とすることが可能となる。また、製造する商品に管理された
RFIDタグをあらかじめ設けることによって、製造から販売までの期間の商品の紛失や
盗難等を効果的に抑制し、コストを低減することができる。また、本実施の形態で示した
ように可撓性を有するRFIDタグを用いることによって、曲面を有する商品など様々な
商品に設けることが可能となる。
また、上述した以外にも可撓性を有するRFIDタグの用途は広範にわたり、非接触で
対象物の履歴等の情報を明確にし、生産・管理等に役立てる商品であればどのようなもの
にも適用することができる。例えば、紙幣、硬貨、有価証券類、証書類、無記名債券類、
包装用容器類、書籍類、記録媒体、身の回り品、乗物類、食品類、衣類、保健用品類、生
活用品類、薬品類及び電子機器等に設けて使用することができる。これらの例に関して図
23を用いて説明する。
紙幣、硬貨とは、市場に流通する金銭であり、特定の地域で貨幣と同じように通用する
もの(金券)、記念コイン等を含む。有価証券類とは、小切手、証券、約束手形等を指す
(図23(A)参照)。証書類とは、運転免許証、住民票等を指す(図23(B)参照)
。無記名債券類とは、切手、おこめ券、各種ギフト券等を指す(図23(C)参照)。包
装用容器類とは、お弁当等の包装紙、ペットボトル等を指す(図23(D)参照)。書籍
類とは、書物、本等を指す(図23(E)参照)。記録媒体とは、DVDソフト、ビデオ
テープ等を指す(図23(F)参照)。乗物類とは、自転車等の車両、船舶等を指す(図
23(G)参照)。身の回り品とは、鞄、眼鏡等を指す(図23(H)参照)。食品類と
は、食料品、飲料等を指す。衣類とは、衣服、履物等を指す。保健用品類とは、医療器具
、健康器具等を指す。生活用品類とは、家具、照明器具等を指す。薬品類とは、医薬品、
農薬等を指す。電子機器とは、液晶表示装置、EL表示装置、テレビジョン装置(テレビ
受像機、薄型テレビ受像機)、携帯電話等を指す。
紙幣、硬貨、有価証券類、証書類、無記名債券類等にRFIDタグを設けることにより
、偽造を防止することができる。また、包装用容器類、書籍類、記録媒体等、身の回り品
、食品類、生活用品類、電子機器等にRFIDタグを設けることにより、検品システムや
レンタル店のシステムなどの効率化を図ることができる。乗物類、保健用品類、薬品類等
にRFIDタグを設けることにより、偽造や盗難の防止、薬品類ならば、薬の服用の間違
いを防止することができる。RFIDタグの設け方としては、物品の表面に貼ったり、物
品に埋め込んだりして設ける。例えば、本ならば紙に埋め込んだり、有機樹脂からなるパ
ッケージなら当該有機樹脂に埋め込んだりするとよい。上記実施の形態で示した構造を有
する可撓性を有するRFIDタグを用いることによって、紙等に設けた場合であっても、
半導体装置を用いてRFIDタグを設けることにより、当該RFIDタグに含まれる素子
の破損等を防止することができる。
このように、包装用容器類、記録媒体、身の回り品、食品類、衣類、生活用品類、電子
機器等にRFIDタグを設けることにより、検品システムやレンタル店のシステムなどの
効率化を図ることができる。また乗物類にRFIDタグを設けることにより、偽造や盗難
を防止することができる。また、動物等の生き物に埋め込むことによって、個々の生き物
の識別を容易に行うことができる。例えば、家畜等の生き物にセンサを備えたRFIDタ
グを埋め込むことによって、生まれた年や性別または種類等はもちろん現在の体温等の健
康状態を容易に管理することが可能となる。
なお、本実施の形態は、上記実施の形態と自由に組み合わせて行うことができる。
(実施の形態6)
本実施の形態では、上記実施の形態で示した半導体装置を表示装置に適用した場合の一
例について図面を参照して説明する。
ここでは、一例として、可撓性を有する基板400上に画素領域401と駆動回路40
2、403とが設けられた表示装置について示す(図24(A))。
画素領域401は、信号線として機能する配線405a、405bと電源線として機能
する配線406a、406bと配線405a、405b、406a、406bと垂直方向
に延びた走査線として機能する配線423とを有しており、当該信号線として機能する配
線、電源線として機能する配線および走査線として機能する配線に囲まれるように薄膜ト
ランジスタ(TFT)421、422および画素部407とが設けられている。また、画
素部と画素部の間に、屈折部分404が設けられている(図24(B))。屈折部分40
4を設けることによって、表示装置を曲げた場合(表示装置に応力が加えられた場合)、
屈折部分に選択的にひずみが生じ、当該屈折部分404が選択的に曲がる。
ここでは、TFT421のソースまたはドレイン領域の一方が配線405bに接続され
他方がTFT422のゲート電極に接続されている。また、TFT422のソースまたは
ドレイン領域の一方が配線406bに接続され他方が画素部407に接続されている。さ
らに、配線406aと配線405bとの間に屈折部分404が設けられている。
次に、図24(B)におけるo−p間の断面構造を図25に示す。
基板400上にTFT422が設けられ、TFT422のソースまたはドレイン領域の
一方が配線406bに接続され、他方が画素部407に接続されている。画素部407は
、画素電極411、発光層412および対向電極413とを有しており、TFT422の
ソースまたはドレイン電極の他方が画素電極411に接続されている。また、画素部と画
素部の間に屈折部分404として、開口部441に屈折物質442が設けられている。屈
折物質442は、絶縁膜431〜435の積層体より曲がりやすい物質を充填することに
よって設けられている(図25(A))。例えば、屈折物質442は、絶縁膜431〜4
35の積層体より弾性率が低い物質、塑性を有する物質またはガラス転移点が低い物質等
を用いて設けることができる。また、410は対向基板である。
なお、屈折物質442は、上記構成に限られず絶縁膜431〜435のいずれかを除去
して設けることができる。例えば、図25(B)に示すように、絶縁膜431〜434を
除去して設けられた開口部443に絶縁膜431〜434の積層体より曲がりやすい物質
からなる屈折物質444を設け、その上に絶縁膜435を設けた構成としてもよい。なお
、開口部441、443に屈折物質442、444を設けずに空間としてもよい。
次に、上述した表示装置の作製方法の一例に関して、図面を用いて簡単に説明する。
まず、基板170上に剥離層171を形成し、当該剥離層171上に、絶縁膜431、
トランジスタ422、絶縁膜432、433、配線405a、405b、トランジスタ4
22のソースまたはドレイン領域に接続する配線、画素電極411および絶縁膜434か
らなる素子形成層445を形成する(図26(A))。具体的には、剥離層171上に絶
縁膜431を介して薄膜トランジスタ422を形成し、当該トランジスタ422を覆うよ
うに絶縁膜433を形成し、当該絶縁膜433上に配線405a、405b、画素電極4
11および薄膜トランジスタ422の不純物領域と接続する導電膜を形成し、画素電極4
11の端部を覆うように絶縁膜434を形成する。
次に、基板170から素子形成層445の剥離を行う。ここでは、素子形成層445に
選択的にレーザ光を照射して開口部446a〜446cを形成後、物理的な力を用いて基
板170から素子形成層445を剥離する。また、他の剥離法として、絶縁膜431〜4
34を選択的に除去して開口部446a〜446cを形成することにより、剥離層171
を露出させた後、開口部446a〜446cにエッチング剤を導入することにより、剥離
層171を除去する(図26(B))。剥離層171を全て除去してもよいが、ここでは
、剥離層171の一部を残すように除去を行う。
次に、絶縁膜434の表面に粘着性を有するフィルム177を貼り合わせて設け、素子
形成層445を基板170から剥離させる(図26(C))。ここでは、基板170と素
子形成層445における絶縁膜431とが、残存した剥離層によって一部つながれている
ため、物理的手段を用いて基板170から素子形成層445を剥離させる。
次に、基板170から剥離した側の素子形成層445の表面をフィルム状の基板151
に接着させて、フィルム177を剥離させる(図27(A))。
次に、画素電極411上に発光層412、対向電極413および屈折物質444a〜4
44cをそれぞれ選択的に形成する(図27(B))。発光層412および対向電極41
3の形成は、屈折物質444a〜444cを形成した後に行ってもよいし形成前に行って
もよい。また、開口部446a〜446cに屈折物質444a〜444cを設けずに空間
とすることも可能である。また、発光層412および対向電極413は、液滴吐出法を用
いて選択的に形成してもよいし、スクリーン印刷やグラビア印刷法等の印刷法を用いて形
成してもよい。ここでは、液滴吐出法を用いることによって選択的に発光層412および
対向電極413を形成する。また、カラー表示可能な表示装置を形成する場合には、R、
G、Bの3色を発光する発光層をそれぞれ選択的に形成する。このように、液滴吐出法や
印刷法を用いて発光層を形成することによって、無駄な材料を減らすことができるためコ
ストを削減することが可能となる。
発光層412としては、低分子系材料、中分子材料(オリゴマー、デンドリマーを含む
)、または高分子系材料等の有機化合物材料を単層または積層構造を、蒸着マスクを用い
た蒸着法、インクジェット法、スピンコート法等によって形成することができる。また、
他にも、発光層412として、無機化合物材料を用いて単層または積層構造で設けること
も可能である。一般的に、発光層に用いられる発光材料が有機化合物であるか、無機化合
物であるかによって、前者は有機EL素子、後者は無機EL素子と呼ばれており、本実施
の形態ではどちらを適用してもよい。
無機EL素子は、その素子構成により、分散型無機EL素子と薄膜型無機EL素子とに
分類される。前者は、発光材料の粒子をバインダ中に分散させた発光層を有し、後者は、
蛍光材料の薄膜からなる発光層を有している点に違いがある。しかし、そのメカニズムは
共通しており、高電界で加速された電子による母体材料又は発光中心の衝突励起により発
光が得られる。本実施の形態において、無機EL素子を適用する場合には、分散型無機E
L素子又は薄膜型無機EL素子のいずれかを適用すればよい。
次に、対向電極413を覆うように絶縁膜435を形成した後に、基板151と基板1
59を用いることによって封止を行う(図27(C))。
以上の工程により、可撓性を有する表示装置を形成することができる。なお、図27(
B)において、屈折物質444a〜444cを設けずに、図27(C)において、絶縁膜
435を形成した後に形成することによって、図25(A)に示す表示装置を作製するこ
とができる。
なお、ここでは、表示装置の作製方法として、ガラス等の剛性を有する基板上に素子形
成層を設けた後に、素子形成層を剥離して可撓性を有する基板上に設ける方法を示したが
本発明の表示装置の作製方法はこれに限られない。例えば、ガラス基板やSi等の半導体
基板上に素子形成層を設けた後に、当該ガラス基板やSi等の半導体基板を研削処理や研
磨処理によって薄膜化してもよい。この場合、剥離を行わなくとも可撓性を有する表示装
置を作製することが可能となる。
次に、上述した可撓性を有する半導体装置を用いて作製した表示装置の用途に関して図
面を参照して説明する。
図28(A)はディスプレイであり、本体4101、支持台4102、表示部4103
を含む。表示部4103は可撓性を有する基板を用いて形成されており、軽量で薄型のデ
ィスプレイを実現できる。また、表示部4103を湾曲させることも可能であり、支持台
4102から取り外して壁に掛けることも可能である。本実施の形態または上記実施の形
態で示した可撓性を有する半導体装置を表示部4103や回路等に用いることによって、
可撓性を有するディスプレイを作製することができる。
図28(B)は巻き取り可能な大型ディスプレイであり、本体4201、表示部420
2を含む。本体4201および表示部4202は可撓性を有する基板を用いて形成されて
いるため、ディスプレイを折り畳んだり、巻き取ったりして持ち運ぶことが可能である。
本実施の形態または上記実施の形態で示した可撓性を有する半導体装置を表示部4202
や回路等に用いることによって、可撓性を有し、軽量、薄型の大型のディスプレイを作製
することができる。
図28(C)は、シート型のコンピュータであり、本体4401、表示部4402、キ
ーボード4403、タッチパッド4404、外部接続ポート4405、電源プラグ440
6等を含んでいる。表示部4402は可撓性を有する基板を用いて形成されており、軽量
で薄型のコンピュータを実現できる。また、電源プラグ4406の部分に収納スペースを
設けることによって表示部2402を巻き取って収納することが可能である。本実施の形
態または上記実施の形態で示した可撓性を有する半導体装置を表示部4402や回路等に
用いることによって、可撓性を有し、軽量、薄型のコンピュータを作製することができる
図28(D)は、20〜80インチの大型の表示部を有する表示装置であり、本体43
00、操作部であるキーボード4301、表示部4302、スピーカー4303等を含む
。また、表示部4302は可撓性を有する基板を用いて形成されており、キーボード43
01を取り外して本体4300を折り畳んだり巻き取ったりして持ち運ぶことが可能であ
る。本実施の形態または上記実施の形態で示した可撓性を有する半導体装置を表示部43
02や回路等に用いることによって、可撓性を有し、軽量、薄型の大型表示装置を作製す
ることができる。
図28(E)は電子ブックであり、本体4501、表示部4502、操作キー4503
等を含む。またモデムが本体4501に内蔵されていても良い。表示部4502は可撓性
基板を用いて形成されており、折り曲げることができる。さらに、表示部4502は文字
等の静止画像はもちろん動画も表示することが可能となっている。本実施の形態または上
記実施の形態で示した可撓性を有する半導体装置を表示部4502や回路等に用いること
によって、可撓性を有し、軽量、薄型の電子ブックを作製することができる。
図28(F)はICカードであり、本体4601、表示部4602、接続端子4603
等を含む。表示部4602は可撓性基板を用いて軽量、薄型のシート状になっているため
、カードの表面に張り付けて形成することができる。また、ICカードを非接触でデータ
の受信が行える場合に外部から取得した情報を表示部4602に表示することが可能とな
っている。本実施の形態または上記実施の形態で示した可撓性を有する半導体装置を表示
部4602や回路等に用いることによって、可撓性を有し、軽量、薄型のICカードを作
製することができる。
以上の様に、本発明の適用範囲は極めて広く、あらゆる分野の電子機器や情報表示手段
に用いることが可能である。なお、本実施の形態は上記実施の形態と自由に組み合わせて
行うことができる。
131 開口部
132a 開口部
132b 開口部
150 半導体装置
151 基板
152a 集積回路
152b 集積回路
152c 集積回路
152d 集積回路
153 屈折部分
154 絶縁膜
155 トランジスタ
156 絶縁膜
157 絶縁膜
158 絶縁膜
159 基板
161a ブロック
161b ブロック
161c ブロック
161d ブロック
161e ブロック
161f ブロック
162a 屈折部分
162b 屈折部分
162c 屈折部分
163 屈折物質
164a 屈折物質
164b 屈折物質
165a 空間
165b 空間
170 基板
171 剥離層
172a 開口部
172b 開口部
173a 屈折物質
173b 屈折物質
175 薄膜トランジスタ
176 開口部
177 フィルム
178a 空間
178b 空間
179a 屈折物質
179b 屈折物質
180 素子形成層
181a 屈折物質
181b 屈折物質
182a 開口部
182b 開口部
183 開口部
184a 開口部
184b 開口部
185 開口部
186a 開口部
186b 開口部
187 開口部
188a 屈折物質
188b 屈折物質
189a 屈折物質
189b 屈折物質
190 ベルトコンベア
191 供給ロール
192 封止ロール
193 切断手段
194 導電膜
195 開口部
196 保護膜
197 凹部
198 部分
251 トランジスタ
252a ダミートランジスタ
252b ダミートランジスタ
253a ダミートランジスタ
253b ダミートランジスタ
254a ダミートランジスタ
254b ダミートランジスタ
254c ダミートランジスタ
254d ダミートランジスタ
254e ダミートランジスタ
254f ダミートランジスタ
254g ダミートランジスタ
254h ダミートランジスタ
255 ダミーパターン
260 基板
261a 集積回路
261b 集積回路
261c 集積回路
261d 集積回路
262 配線
263 導電膜
265 導電膜
266 樹脂
267 導電性粒子
270 単結晶シリコン基板
271 電界効果型トランジスタ
272 端子部
272a 端子部
272b 端子部
273 凹部
274 絶縁膜
275 導電膜
281 フィルム
282 物質
283 凹凸パターン
284 空間
285 導電膜
286 屈折部分
291 導電膜
292 絶縁膜
293 導電膜
294 基板
295 樹脂
296 導電膜
297 導電膜
298 導電膜
80 RFID
81 電源回路
82 クロック発生回路
83 データ復調回路
84 データ変調回路
85 制御回路
86 記憶回路
87 アンテナ
88 リーダ/ライタ
320 リーダ/ライタ
321 表示部
322 品物
323 RFID
325 RFID
326 商品
400 基板
401 画素領域
402 駆動回路
403 駆動回路
404 屈折部分
405a 配線
405b 配線
406a 配線
406b 配線
407 画素部
410
411 画素電極
412 発光層
413 対向電極
421 薄膜トランジスタ
422 薄膜トランジスタ
423 配線
431 絶縁膜
432 絶縁膜
433 絶縁膜
434 絶縁膜
435 絶縁膜
441 開口部
442 屈折物質
443 開口部
444 屈折物質
444a 屈折物質
444b 屈折物質
444c 屈折物質
445 素子形成層
446a 開口部
446b 開口部
446c 開口部
4101 本体
4102 支持台
4103 表示部
4201 本体
4202 表示部
4300 本体
4301 キーボード
4302 表示部
4303 スピーカー
4401 本体
4402 表示部
4403 キーボード
4404 タッチパッド
4405 外部接続ポート
4406 電源プラグ
4501 本体
4502 表示部
4503 操作キー
4601 本体
4602 表示部
4603 接続端子

Claims (3)

  1. 可撓性を有する基板を有し、
    前記基板上に第1のトランジスタを有し、
    前記基板上に第2のトランジスタを有し、
    前記第1のトランジスタ上及び前記第2のトランジスタ上に絶縁膜を有し、
    前記絶縁膜に開口部を有し、
    前記開口部は、前記第1のトランジスタと前記第2のトランジスタとの間に位置し、
    前記開口部内に第1の金属を有し、
    前記絶縁膜上に第2の金属を有し、
    前記絶縁膜上に第3の金属を有し、
    前記第2の金属は、前記開口部と重ならず、
    前記第3の金属は、前記開口部と重ならず、
    前記第1のトランジスタのチャネル形成領域は、前記第2の金属と重なる領域を有し、
    前記第2のトランジスタのチャネル形成領域は、前記第3の金属と重なる領域を有し、
    前記第1の金属は、Au、Ag、Cu、又はAlのいずれかであり、
    前記第2の金属及び前記第3の金属は、前記第1の金属より硬度が高い物質を有することを特徴とする電子機器
  2. フィルムを有し、
    前記フィルム上に第1のトランジスタを有し、
    前記フィルム上に第2のトランジスタを有し、
    前記第1のトランジスタ上及び前記第2のトランジスタ上に絶縁膜を有し、
    前記絶縁膜に開口部を有し、
    前記開口部は、前記第1のトランジスタと前記第2のトランジスタとの間に位置し、
    前記開口部内に第1の金属を有し、
    前記絶縁膜上に第2の金属を有し、
    前記絶縁膜上に第3の金属を有し、
    前記第2の金属は、前記開口部と重ならず、
    前記第3の金属は、前記開口部と重ならず、
    前記第1のトランジスタのチャネル形成領域は、前記第2の金属と重なる領域を有し、
    前記第2のトランジスタのチャネル形成領域は、前記第3の金属と重なる領域を有し、
    前記第1の金属は、Au、Ag、Cu、又はAlのいずれかであり、
    前記第2の金属及び前記第3の金属は、前記第1の金属より硬度が高い物質を有することを特徴とする電子機器
  3. プラスチック基板を有し、
    前記プラスチック基板上に第1のトランジスタを有し、
    前記プラスチック基板上に第2のトランジスタを有し、
    前記第1のトランジスタ上及び前記第2のトランジスタ上に絶縁膜を有し、
    前記絶縁膜に開口部を有し、
    前記開口部は、前記第1のトランジスタと前記第2のトランジスタとの間に位置し、
    前記開口部内に第1の金属を有し、
    前記絶縁膜上に第2の金属を有し、
    前記絶縁膜上に第3の金属を有し、
    前記第2の金属は、前記開口部と重ならず、
    前記第3の金属は、前記開口部と重ならず、
    前記第1のトランジスタのチャネル形成領域は、前記第2の金属と重なる領域を有し、
    前記第2のトランジスタのチャネル形成領域は、前記第3の金属と重なる領域を有し、
    前記第1の金属は、Au、Ag、Cu、又はAlのいずれかであり、
    前記第2の金属及び前記第3の金属は、前記第1の金属より硬度が高い物質を有することを特徴とする電子機器
JP2012122742A 2005-02-25 2012-05-30 電子機器 Expired - Fee Related JP5509259B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2012122742A JP5509259B2 (ja) 2005-02-25 2012-05-30 電子機器

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
JP2005051867 2005-02-25
JP2005051867 2005-02-25
JP2012122742A JP5509259B2 (ja) 2005-02-25 2012-05-30 電子機器

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
JP2006045181A Division JP5046529B2 (ja) 2005-02-25 2006-02-22 半導体装置

Related Child Applications (2)

Application Number Title Priority Date Filing Date
JP2013238724A Division JP5732514B2 (ja) 2005-02-25 2013-11-19 半導体装置
JP2013239445A Division JP5703362B2 (ja) 2005-02-25 2013-11-20 半導体装置

Publications (3)

Publication Number Publication Date
JP2012227530A JP2012227530A (ja) 2012-11-15
JP2012227530A5 JP2012227530A5 (ja) 2014-01-09
JP5509259B2 true JP5509259B2 (ja) 2014-06-04

Family

ID=36969892

Family Applications (4)

Application Number Title Priority Date Filing Date
JP2012122742A Expired - Fee Related JP5509259B2 (ja) 2005-02-25 2012-05-30 電子機器
JP2013238724A Active JP5732514B2 (ja) 2005-02-25 2013-11-19 半導体装置
JP2013239445A Expired - Fee Related JP5703362B2 (ja) 2005-02-25 2013-11-20 半導体装置
JP2014243057A Expired - Fee Related JP5918837B2 (ja) 2005-02-25 2014-12-01 半導体装置

Family Applications After (3)

Application Number Title Priority Date Filing Date
JP2013238724A Active JP5732514B2 (ja) 2005-02-25 2013-11-19 半導体装置
JP2013239445A Expired - Fee Related JP5703362B2 (ja) 2005-02-25 2013-11-20 半導体装置
JP2014243057A Expired - Fee Related JP5918837B2 (ja) 2005-02-25 2014-12-01 半導体装置

Country Status (3)

Country Link
US (2) US7566633B2 (ja)
JP (4) JP5509259B2 (ja)
CN (1) CN100573881C (ja)

Families Citing this family (61)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8123896B2 (en) * 2004-06-02 2012-02-28 Semiconductor Energy Laboratory Co., Ltd. Laminating system
EP1886355A4 (en) * 2005-05-31 2015-04-01 Semiconductor Energy Lab SEMICONDUCTOR COMPONENT
US7651932B2 (en) * 2005-05-31 2010-01-26 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing antenna and method for manufacturing semiconductor device
US7727859B2 (en) * 2005-06-30 2010-06-01 Semiconductor Energy Laboratory Co., Ltd Semiconductor device and manufacturing method thereof
US7652214B2 (en) * 2005-11-02 2010-01-26 Panasonic Corporation Electronic component package
JP2007256914A (ja) * 2006-02-21 2007-10-04 Seiko Epson Corp アクティブマトリクス基板、電気光学装置、電子機器
JP2008066567A (ja) * 2006-09-08 2008-03-21 Ricoh Co Ltd 配線パターンとこれを用いた電子素子、有機半導体素子、積層配線パターンおよび積層配線基板
US8137417B2 (en) 2006-09-29 2012-03-20 Semiconductor Energy Laboratory Co., Ltd. Peeling apparatus and manufacturing apparatus of semiconductor device
TWI611565B (zh) * 2006-09-29 2018-01-11 半導體能源研究所股份有限公司 半導體裝置的製造方法
US7941919B2 (en) * 2007-01-29 2011-05-17 Board Of Regents, The University Of Texas System Method of assembling an electronic textile
EP1970952A3 (en) * 2007-03-13 2009-05-06 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
US7973316B2 (en) * 2007-03-26 2011-07-05 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing semiconductor device
US7851804B2 (en) * 2007-05-17 2010-12-14 Semiconductor Energy Laboratory Co., Ltd. Display device
TWI423519B (zh) * 2007-09-04 2014-01-11 Mitsubishi Electric Corp Radio frequency identification tag
WO2010035627A1 (en) 2008-09-25 2010-04-01 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
JP2011003522A (ja) 2008-10-16 2011-01-06 Semiconductor Energy Lab Co Ltd フレキシブル発光装置、電子機器及びフレキシブル発光装置の作製方法
TWI574423B (zh) * 2008-11-07 2017-03-11 半導體能源研究所股份有限公司 半導體裝置和其製造方法
CN104597651B (zh) 2009-05-02 2017-12-05 株式会社半导体能源研究所 显示设备
KR102446215B1 (ko) 2009-05-02 2022-09-22 가부시키가이샤 한도오따이 에네루기 켄큐쇼 표시 장치
US8766269B2 (en) 2009-07-02 2014-07-01 Semiconductor Energy Laboratory Co., Ltd. Light-emitting device, lighting device, and electronic device
KR102009813B1 (ko) 2009-09-16 2019-08-12 가부시키가이샤 한도오따이 에네루기 켄큐쇼 발광 장치 및 이의 제조 방법
TWI589042B (zh) * 2010-01-20 2017-06-21 半導體能源研究所股份有限公司 發光裝置,撓性發光裝置,電子裝置,照明設備,以及發光裝置和撓性發光裝置的製造方法
KR101174834B1 (ko) 2012-04-05 2012-08-17 주식회사 다보씨앤엠 공정필름을 이용한 필름형 디스플레이 기판의 제조방법 및 이에 사용되는 필름형 디스플레이 기판 제조용 공정필름
KR102481056B1 (ko) 2012-08-10 2022-12-27 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 전자 장치
TWI613709B (zh) * 2013-02-20 2018-02-01 財團法人工業技術研究院 半導體元件結構及其製造方法與應用其之畫素結構
JP2014182306A (ja) * 2013-03-19 2014-09-29 Japan Display Inc 表示装置、電子機器及び表示装置の製造方法
US9209207B2 (en) 2013-04-09 2015-12-08 Apple Inc. Flexible display with bent edge regions
KR102281568B1 (ko) 2013-04-15 2021-07-23 가부시키가이샤 한도오따이 에네루기 켄큐쇼 발광 장치
US11145838B2 (en) 2013-05-21 2021-10-12 Samsung Display Co., Ltd. Organic light emitting diode display and method of manufacturing the same
US9203050B2 (en) * 2013-05-21 2015-12-01 Samsung Display Co., Ltd. Organic light emitting diode display and method of manufacturing the same
US9472507B2 (en) 2013-06-17 2016-10-18 Samsung Display Co., Ltd. Array substrate and organic light-emitting display including the same
US9269914B2 (en) 2013-08-01 2016-02-23 Semiconductor Energy Laboratory Co., Ltd. Light-emitting device, electronic device, and lighting device
TWI642094B (zh) 2013-08-06 2018-11-21 半導體能源研究所股份有限公司 剝離方法
TWI663722B (zh) 2013-09-06 2019-06-21 Semiconductor Energy Laboratory Co., Ltd. 發光裝置以及發光裝置的製造方法
US9937698B2 (en) 2013-11-06 2018-04-10 Semiconductor Energy Laboratory Co., Ltd. Peeling method and light-emitting device
CN103545321B (zh) * 2013-11-11 2017-03-15 京东方科技集团股份有限公司 显示基板和含有该显示基板的柔性显示装置
TWI732735B (zh) 2013-12-03 2021-07-11 日商半導體能源研究所股份有限公司 剝離裝置以及疊層體製造裝置
KR102107456B1 (ko) * 2013-12-10 2020-05-08 삼성디스플레이 주식회사 플렉시블 표시 장치 및 이의 제조 방법
CN104752365A (zh) * 2013-12-27 2015-07-01 昆山国显光电有限公司 一种柔性显示器及其制备方法
KR102396850B1 (ko) * 2014-01-06 2022-05-11 메디데이타 솔루션즈, 인코포레이티드 봉지형 컨포멀 전자 시스템 및 디바이스, 및 이의 제조 및 사용 방법
JP6603486B2 (ja) 2014-06-27 2019-11-06 株式会社半導体エネルギー研究所 発光装置の作製方法
US9799829B2 (en) 2014-07-25 2017-10-24 Semiconductor Energy Laboratory Co., Ltd. Separation method, light-emitting device, module, and electronic device
WO2016059497A1 (en) 2014-10-17 2016-04-21 Semiconductor Energy Laboratory Co., Ltd. Light-emitting device, module, electronic device, and method for manufacturing light-emitting device
KR102524983B1 (ko) * 2014-11-28 2023-04-21 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치, 모듈, 및 전자 기기
KR102343656B1 (ko) 2015-01-15 2021-12-27 삼성디스플레이 주식회사 유기 발광 표시 장치
CN107710313B (zh) * 2015-06-18 2020-01-10 夏普株式会社 柔性电子器件和柔性电子器件的制造方法
CN108738377B (zh) * 2015-07-30 2020-11-10 株式会社半导体能源研究所 发光装置的制造方法、发光装置、模块及电子设备
US10259207B2 (en) 2016-01-26 2019-04-16 Semiconductor Energy Laboratory Co., Ltd. Method for forming separation starting point and separation method
JP2017147044A (ja) * 2016-02-15 2017-08-24 株式会社ジャパンディスプレイ 表示装置、および表示装置の作製方法
JP6715708B2 (ja) * 2016-07-08 2020-07-01 株式会社ジャパンディスプレイ 表示装置
CN109845400B (zh) * 2016-10-13 2021-10-22 夏普株式会社 有机el显示装置和有机el显示装置的制造方法
CN106585069A (zh) * 2016-12-23 2017-04-26 武汉华星光电技术有限公司 柔性基板、面板及丝网印刷机制作柔性基板、面板的方法
WO2018179214A1 (ja) * 2017-03-30 2018-10-04 シャープ株式会社 可撓性表示装置
TWI645389B (zh) * 2017-11-15 2018-12-21 友達光電股份有限公司 可撓性電子裝置
US20210367078A1 (en) * 2018-03-06 2021-11-25 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
CN108847134B (zh) * 2018-06-13 2021-05-14 云谷(固安)科技有限公司 一种可拉伸显示屏装置及其制造方法
CN109378327B (zh) * 2018-09-26 2021-02-12 云谷(固安)科技有限公司 显示面板及显示装置
CN110028908A (zh) * 2018-12-25 2019-07-19 瑞声科技(新加坡)有限公司 玻璃软膜结构及其制作方法
CN109686251B (zh) * 2018-12-25 2021-12-31 厦门天马微电子有限公司 一种柔性显示面板及显示装置
CN110028909A (zh) * 2018-12-25 2019-07-19 瑞声科技(新加坡)有限公司 玻璃软膜结构及其制作方法
CN114137754B (zh) * 2021-11-30 2022-10-21 绵阳惠科光电科技有限公司 曲面屏及显示装置

Family Cites Families (24)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3360919B2 (ja) * 1993-06-11 2003-01-07 三菱電機株式会社 薄膜太陽電池の製造方法,及び薄膜太陽電池
CN1143394C (zh) * 1996-08-27 2004-03-24 精工爱普生株式会社 剥离方法、溥膜器件的转移方法和薄膜器件
US6199533B1 (en) * 1999-02-01 2001-03-13 Cummins Engine Company, Inc. Pilot valve controlled three-way fuel injection control valve assembly
KR100694561B1 (ko) 1999-02-24 2007-03-13 히다치 막셀 가부시키가이샤 Ic소자 및 그 제조방법 및 ic소자를 탑재한 정보담체및 그 제조방법
JP4748859B2 (ja) 2000-01-17 2011-08-17 株式会社半導体エネルギー研究所 発光装置の作製方法
US7060153B2 (en) * 2000-01-17 2006-06-13 Semiconductor Energy Laboratory Co., Ltd. Display device and method of manufacturing the same
US20010053559A1 (en) * 2000-01-25 2001-12-20 Semiconductor Energy Laboratory Co., Ltd. Method of fabricating display device
JP4495295B2 (ja) 2000-03-15 2010-06-30 株式会社日立製作所 有価証券類の不正利用防止方法および有価証券類の不正利用防止システム
JP2002083866A (ja) * 2000-09-07 2002-03-22 Sanyo Electric Co Ltd 半導体装置及びその製造方法
ATE430377T1 (de) * 2001-02-16 2009-05-15 Ignis Innovation Inc Flexible anzeigevorrichtung
GB0108309D0 (en) * 2001-04-03 2001-05-23 Koninkl Philips Electronics Nv Matrix array devices with flexible substrates
DE10122324A1 (de) * 2001-05-08 2002-11-14 Philips Corp Intellectual Pty Flexible integrierte monolithische Schaltung
TW564471B (en) * 2001-07-16 2003-12-01 Semiconductor Energy Lab Semiconductor device and peeling off method and method of manufacturing semiconductor device
JP4524561B2 (ja) * 2001-07-24 2010-08-18 セイコーエプソン株式会社 転写方法
JP2003109773A (ja) * 2001-07-27 2003-04-11 Semiconductor Energy Lab Co Ltd 発光装置、半導体装置およびそれらの作製方法
JP3956697B2 (ja) 2001-12-28 2007-08-08 セイコーエプソン株式会社 半導体集積回路の製造方法
TWI272641B (en) * 2002-07-16 2007-02-01 Semiconductor Energy Lab Method of manufacturing a semiconductor device
JP4566578B2 (ja) * 2003-02-24 2010-10-20 株式会社半導体エネルギー研究所 薄膜集積回路の作製方法
JP4748943B2 (ja) * 2003-02-28 2011-08-17 株式会社半導体エネルギー研究所 半導体装置の作製方法
TWI328837B (en) * 2003-02-28 2010-08-11 Semiconductor Energy Lab Semiconductor device and method of manufacturing the same
JP2005032979A (ja) * 2003-07-14 2005-02-03 Canon Inc 有機薄膜トランジスタおよびその製造方法
US7566640B2 (en) 2003-12-15 2009-07-28 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing thin film integrated circuit device, noncontact thin film integrated circuit device and method for manufacturing the same, and idtag and coin including the noncontact thin film integrated circuit device
US7271076B2 (en) * 2003-12-19 2007-09-18 Semiconductor Energy Laboratory Co., Ltd. Manufacturing method of thin film integrated circuit device and manufacturing method of non-contact type thin film integrated circuit device
JP4060289B2 (ja) * 2004-05-26 2008-03-12 株式会社半導体エネルギー研究所 携帯型コンピュータ

Also Published As

Publication number Publication date
JP2014068029A (ja) 2014-04-17
JP5732514B2 (ja) 2015-06-10
CN1832179A (zh) 2006-09-13
US20060202206A1 (en) 2006-09-14
JP5918837B2 (ja) 2016-05-18
US7906784B2 (en) 2011-03-15
JP2012227530A (ja) 2012-11-15
US7566633B2 (en) 2009-07-28
US20090194771A1 (en) 2009-08-06
CN100573881C (zh) 2009-12-23
JP2014068028A (ja) 2014-04-17
JP2015062252A (ja) 2015-04-02
JP5703362B2 (ja) 2015-04-15

Similar Documents

Publication Publication Date Title
JP5918837B2 (ja) 半導体装置
JP5046529B2 (ja) 半導体装置
JP7250882B2 (ja) 半導体装置、電子機器
US8373172B2 (en) Semiconductor device and method for manufacturing semiconductor device
JP5350616B2 (ja) 半導体装置

Legal Events

Date Code Title Description
A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20131119

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20131129

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20131203

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20131226

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20140318

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20140324

R150 Certificate of patent or registration of utility model

Ref document number: 5509259

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

LAPS Cancellation because of no payment of annual fees