JP5201326B2 - 多層配線の製造方法 - Google Patents
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- 238000004519 manufacturing process Methods 0.000 title claims description 57
- 239000010408 film Substances 0.000 claims description 595
- 229910052751 metal Inorganic materials 0.000 claims description 101
- 239000002184 metal Substances 0.000 claims description 101
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 92
- 229910052814 silicon oxide Inorganic materials 0.000 claims description 90
- 238000000034 method Methods 0.000 claims description 85
- 150000002736 metal compounds Chemical class 0.000 claims description 76
- 238000005530 etching Methods 0.000 claims description 75
- 239000010949 copper Substances 0.000 claims description 52
- 239000011229 interlayer Substances 0.000 claims description 48
- 239000010936 titanium Substances 0.000 claims description 37
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical group [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 claims description 36
- 229910052719 titanium Inorganic materials 0.000 claims description 36
- 230000004888 barrier function Effects 0.000 claims description 33
- 238000004380 ashing Methods 0.000 claims description 30
- 239000010410 layer Substances 0.000 claims description 30
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 27
- 239000010703 silicon Substances 0.000 claims description 27
- 229910052710 silicon Inorganic materials 0.000 claims description 27
- 229910052581 Si3N4 Inorganic materials 0.000 claims description 22
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims description 22
- 238000004544 sputter deposition Methods 0.000 claims description 15
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 claims description 11
- 229910010271 silicon carbide Inorganic materials 0.000 claims description 11
- 229910052721 tungsten Inorganic materials 0.000 claims description 10
- 238000007747 plating Methods 0.000 claims description 9
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 claims description 9
- 239000010937 tungsten Substances 0.000 claims description 9
- 229910045601 alloy Inorganic materials 0.000 claims description 7
- 239000000956 alloy Substances 0.000 claims description 7
- 229910052782 aluminium Inorganic materials 0.000 claims description 7
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 claims description 7
- 150000004767 nitrides Chemical class 0.000 claims description 7
- 239000002245 particle Substances 0.000 claims description 7
- 239000000126 substance Substances 0.000 claims description 7
- 229910052715 tantalum Inorganic materials 0.000 claims description 7
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 claims description 7
- 238000005498 polishing Methods 0.000 claims description 6
- 238000000151 deposition Methods 0.000 claims 8
- 239000000463 material Substances 0.000 description 35
- 229910004298 SiO 2 Inorganic materials 0.000 description 34
- 239000010409 thin film Substances 0.000 description 31
- 229920002120 photoresistant polymer Polymers 0.000 description 30
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 26
- 229910052802 copper Inorganic materials 0.000 description 26
- 238000006116 polymerization reaction Methods 0.000 description 10
- 239000004065 semiconductor Substances 0.000 description 10
- 238000000206 photolithography Methods 0.000 description 9
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 8
- 230000009977 dual effect Effects 0.000 description 8
- 229910052760 oxygen Inorganic materials 0.000 description 8
- 239000001301 oxygen Substances 0.000 description 8
- 239000007769 metal material Substances 0.000 description 7
- 239000000758 substrate Substances 0.000 description 7
- KPUWHANPEXNPJT-UHFFFAOYSA-N disiloxane Chemical class [SiH3]O[SiH3] KPUWHANPEXNPJT-UHFFFAOYSA-N 0.000 description 6
- 239000012528 membrane Substances 0.000 description 6
- 238000005229 chemical vapour deposition Methods 0.000 description 5
- 244000132059 Carica parviflora Species 0.000 description 4
- 235000014653 Carica parviflora Nutrition 0.000 description 4
- 239000005441 aurora Substances 0.000 description 4
- 230000015572 biosynthetic process Effects 0.000 description 4
- 230000003197 catalytic effect Effects 0.000 description 4
- 239000011248 coating agent Substances 0.000 description 4
- 238000000576 coating method Methods 0.000 description 4
- -1 divinylsiloxane Chemical class 0.000 description 4
- 238000005516 engineering process Methods 0.000 description 4
- 231100000572 poisoning Toxicity 0.000 description 4
- 230000000607 poisoning effect Effects 0.000 description 4
- 238000009413 insulation Methods 0.000 description 3
- 238000001552 radio frequency sputter deposition Methods 0.000 description 3
- 238000009281 ultraviolet germicidal irradiation Methods 0.000 description 3
- 238000009792 diffusion process Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- 229910052799 carbon Inorganic materials 0.000 description 1
- 229910052681 coesite Inorganic materials 0.000 description 1
- 229910052906 cristobalite Inorganic materials 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000001312 dry etching Methods 0.000 description 1
- 230000005684 electric field Effects 0.000 description 1
- NBVXSUQYWXRMNV-UHFFFAOYSA-N fluoromethane Chemical compound FC NBVXSUQYWXRMNV-UHFFFAOYSA-N 0.000 description 1
- 238000009616 inductively coupled plasma Methods 0.000 description 1
- 125000002496 methyl group Chemical group [H]C([H])([H])* 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 239000011148 porous material Substances 0.000 description 1
- 239000000377 silicon dioxide Substances 0.000 description 1
- 235000012239 silicon dioxide Nutrition 0.000 description 1
- 229910052682 stishovite Inorganic materials 0.000 description 1
- 230000001629 suppression Effects 0.000 description 1
- 229910052905 tridymite Inorganic materials 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
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- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
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- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
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- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
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- H01L21/76807—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics for dual damascene structures
- H01L21/76808—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics for dual damascene structures involving intermediate temporary filling with material
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
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- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76829—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing characterised by the formation of thin functional dielectric layers, e.g. dielectric etch-stop, barrier, capping or liner layers
- H01L21/76834—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing characterised by the formation of thin functional dielectric layers, e.g. dielectric etch-stop, barrier, capping or liner layers formation of thin insulating films on the sidewalls or on top of conductors
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Description
図1(a)から(g)は本発明の第1の実施例に係る多層配線構造の製造プロセスを模式的に示す断面図である。第1の実施例は、上側からシリコン酸化膜/チタン薄膜/シリコン酸化膜/ポーラスSiOCH膜(第2のマスク用絶縁膜/金属または金属化合物膜/第1のマスク用絶縁膜/第1の被エッチング絶縁膜)の構造で、シリコン酸化膜/チタン薄膜/シリコン酸化膜によるハードマスクプロセスにより溝加工を行うことにより、低誘電率膜のアッシングダメージを生じずに寸法ずれを少なくできるものである。
図3から図5は本発明の第2の実施例にかかわる多層配線構造の製造プロセスを模式的に示す断面図である。第2の実施例は、上側からシリコン酸化膜/ポーラスSiOCH/シリコン酸化膜/SiOCHの絶縁膜構造(第1のマスク用絶縁膜/第2の被エッチング絶縁膜/ストッパー絶縁膜/第1の被エッチング絶縁膜)にビアとトレンチが同時に形成されている、いわゆるデュアルダマシンCu配線の形成にあたり、最上面のシリコン酸化膜上に金属薄膜とシリコン酸化膜を形成することにより、ポーラスSiOCHへのダメージを抑制しながら、寸法ずれを抑制するものである。
図6は本発明の第3の実施例にかかわる多層配線構造の製造プロセスを模式的に示す断面図である。第3の実施例は、上側からシリコン酸化膜/ポーラスSiOCH/シリコン酸化膜/SiOCHの絶縁膜構造にビアとトレンチが同時に形成されている。このようなデュアルダマシンCu配線の形成にあたり、最上面のシリコン酸化膜上に金属薄膜とシリコン酸化膜を形成することにより、ポーラスSiOCHへのダメージを抑制しながら、面内均一性を確保するものである。
図7は本発明の第4の実施例にかかわる多層配線構造の製造プロセスを模式的に示す断面図である。第4の実施例は、シリコン酸化膜/ポーラスSiOCH/シリコン酸化膜/SiOCHの絶縁膜構造にビアとトレンチが同時に形成されている、いわゆるデュアルダマシンCu配線の形成にあたり、最上面のシリコン酸化膜上にシリコン窒化膜と金属薄膜とシリコン酸化膜を形成することにより、ポーラスSiOCHへのダメージを抑制しながら、寸法ばらつきを抑制するものである。この際、実施例2および3と異なる点は、完全なハードマスクプロセスであるため、ビアポイズニングや再工事不可といった問題を回避し、かつビアファーストプロセスであるため、トレンチファーストプロセスに比べて目合わせずれマージンも高い特徴を持つ。
Claims (19)
- 第1の被エッチング絶縁膜上に第1のマスク用絶縁膜を形成する工程と、
前記第1のマスク用絶縁膜上に金属または金属化合物を成膜する工程と、
前記金属または金属化合物の上面に第2のマスク用絶縁膜を形成する工程と、
前記第2のマスク用絶縁膜上にレジストパターンを形成し、前記レジストパターンをマスクとして前記第2のマスク用絶縁膜、金属または金属化合物膜を順次エッチングした後に前記レジストパターンを剥離する工程と、
前記第2のマスク用絶縁膜と、前記金属または金属化合物膜とをマスクとして、前記第1のマスク用絶縁膜、前記第1の被エッチング絶縁膜をエッチングする工程と、
を含み、
前記第1の被エッチング絶縁膜がシリコン酸化膜よりも低い比誘電率を持つことを特徴とする多層配線の製造方法。 - 前記エッチング工程で形成された溝あるいは孔に対し、バリア膜及びCuスパッタ膜をスパッタした後Cuめっきを行い、Cu膜を形成する工程と、前記Cu膜、前記バリア膜、前記第2のマスク用絶縁膜、前記金属または金属化合物膜、前記第1のマスク用絶縁膜の一部を化学的機械的研磨して除去する工程と、を含むことを特徴とする請求項1に記載の多層配線の製造方法。
- 前記金属または金属化合物膜が、チタン、タンタル、タングステン、アルミニウムまたは、それらを1種類以上含む合金、および前記金属の酸化物あるいは窒化物であることを特徴とする請求項1あるいは2に記載の多層配線の製造方法。
- 前記第2のマスク用絶縁膜がシリコン酸化膜であることを特徴とする請求項1から3のいずれか一項に記載の多層配線の製造方法。
- 前記第1のマスク用絶縁膜の全てを化学的機械的研磨して除去することを特徴とする請求項1から4のいずれか一項に記載の多層配線の製造方法。
- 前記第1のマスク用絶縁膜がシリコン酸化膜であるか、または、シリコン酸化膜よりも低い比誘電率を持つことを特徴とする請求項1から5のいずれか一項に記載の多層配線の製造方法。
- 第1の被エッチング絶縁膜、ストッパー絶縁膜、第2の被エッチング絶縁膜をこの順に形成する工程と、
前記第2の被エッチング絶縁膜上に第1のマスク用絶縁膜を成膜する工程と、
前記第1のマスク用絶縁膜上に金属または金属化合物を成膜する工程と、
前記金属または金属化合物の上面に第2のマスク用絶縁膜を形成する工程と、
前記第2のマスク用絶縁膜上にビア孔レジストパターンを形成し、前記ビア孔レジストパターンをマスクに前記第2のマスク用絶縁膜、前記金属または金属化合物膜、前記第1のマスク用絶縁膜を順次エッチングした後に前記ビア孔レジストパターンを剥離する工程と、
さらにトレンチ溝レジストパターンを前記第2のマスク用絶縁膜上に形成し、前記第2のマスク用絶縁膜と、前記金属または金属化合物膜を順次エッチングした後に前記トレンチ溝レジストパターンを剥離する工程と、
前記第1のマスク用絶縁膜に形成されたビア孔パターンをマスクとして、前記第2の被エッチング絶縁膜、前記ストッパー絶縁膜、前記第1の被エッチング絶縁膜を順次エッチングしながら、前記第2のマスク用絶縁膜と前記金属または金属化合物膜に形成されたトレンチ溝パターンをマスクとして、前記第1のマスク用絶縁膜、前記第2の被エッチング絶縁膜を順次エッチングして溝/孔同時加工する工程と、
を含み、
前記第1の被エッチング絶縁膜がシリコン酸化膜よりも低い比誘電率を持つことを特徴とする多層配線の製造方法。 - 請求項7に記載の多層配線の製造方法において、前記被エッチング膜のそれぞれに形成される最終形状のトレンチ溝及びビア孔はエッチングによって同時に形成されることを特徴とする多層配線の製造方法。
- 第1の被エッチング絶縁膜、ストッパー絶縁膜、第2の被エッチング絶縁膜をこの順に形成する工程と、
前記第2の被エッチング絶縁膜上に第1のマスク用絶縁膜を成膜する工程と、
前記第1のマスク用絶縁膜上に金属または金属化合物を成膜する工程と、
前記金属または金属化合物の上面に第2のマスク用絶縁膜を形成する工程と、
前記第2のマスク用絶縁膜上にビア孔レジストパターンを形成し、前記第2のマスク用絶縁膜、金属または金属化合物膜、前記第1のマスク用絶縁膜、前記第2の被エッチング絶縁膜を順次エッチングした後に前記ビア孔レジストパターンを剥離する工程と、
さらにトレンチ溝レジストパターンを前記第2のマスク用絶縁膜上に形成し、前記第2のマスク用絶縁膜と、前記金属または金属化合物膜を順次エッチングした後に前記トレンチ溝レジストパターンを剥離する工程と、
前記第1のマスク用絶縁膜と前記第2の被エッチング絶縁膜に形成されたビア孔パターンをマスクとして、前記ストッパー絶縁膜、前記第1の被エッチング絶縁膜を順次エッチングしながら、前記第2のマスク用絶縁膜と前記金属または金属化合物膜に形成されたトレンチ溝パターンをマスクとして、前記第1のマスク用絶縁膜、前記第2の被エッチング絶縁膜を順次エッチングして溝/孔同時加工する工程と、
を含み、
前記第1の被エッチング絶縁膜がシリコン酸化膜よりも低い比誘電率を持つことを特徴とする多層配線の製造方法。 - 第1の被エッチング絶縁膜、ストッパー絶縁膜、第2の被エッチング絶縁膜をこの順に形成する工程と、
前記第2の被エッチング絶縁膜上に第1のマスク用絶縁膜を成膜する工程と、
前記第1のマスク用絶縁膜上に金属または金属化合物を成膜する工程と、
前記金属または金属化合物の上面に第2のマスク用絶縁膜を形成する工程と、
前記第2のマスク用絶縁膜上にビア孔レジストパターンを形成し、前記第2のマスク用絶縁膜、金属または金属化合物膜、前記第1のマスク用絶縁膜、前記第2の被エッチング絶縁膜、前記ストッパー絶縁膜、前記第1の被エッチング絶縁膜を順次エッチングした後に前記ビア孔レジストパターンを剥離する工程と、
さらにトレンチ溝レジストパターンを前記第2のマスク用絶縁膜上に形成し、前記第2のマスク用絶縁膜と、前記金属または金属化合物膜を順次エッチングした後に前記トレンチ溝レジストパターンを剥離する工程と、
前記第2のマスク用絶縁膜と前記金属または金属化合物膜に形成された前記トレンチ溝パターンをマスクとして、前記第1のマスク用絶縁膜、第2の被エッチング絶縁膜を順次エッチングして溝/孔同時加工する工程と、
を含み、
前記第1の被エッチング絶縁膜がシリコン酸化膜よりも低い比誘電率を持つことを特徴とする多層配線の製造方法。 - 第1の被エッチング絶縁膜、ストッパー絶縁膜、第2の被エッチング絶縁膜をこの順に形成する工程と、
前記第2の被エッチング絶縁膜上に第1のマスク用絶縁膜、第2のマスク用絶縁膜をこの順に成膜する工程と、
前記第2のマスク用絶縁膜上に金属または金属化合物を成膜する工程と、
前記金属または金属化合物の上面に第3のマスク用絶縁膜を形成する工程と、
前記第3のマスク用絶縁膜上にビア孔レジストパターンを形成し、前記第3のマスク用絶縁膜、金属または金属化合物膜、前記第2のマスク用絶縁膜を順次エッチングした後に前記ビア孔レジストパターンを剥離する工程と、
さらにトレンチ溝レジストパターンを前記第3のマスク用絶縁膜上に形成し、前記第3のマスク用絶縁膜と、前記金属または金属化合物膜を順次エッチングした後に前記トレンチ溝レジストパターンを剥離する工程と、
前記第2のマスク用絶縁膜に形成されたビア孔パターンをマスクとして、前記第1のマスク用絶縁膜、前記第2の被エッチング絶縁膜、前記ストッパー絶縁膜、前記第1の被エッチング絶縁膜を順次エッチングしながら、前記第3のマスク用絶縁膜と前記金属または金属化合物膜に形成されたトレンチ溝パターンをマスクとして、前記第2のマスク用絶縁膜、前記第1のマスク用絶縁膜、前記第2の被エッチング絶縁膜を順次エッチングして溝/孔同時加工する工程と、
を含み、
前記第1の被エッチング絶縁膜がシリコン酸化膜よりも低い比誘電率を持つとことを特徴とする多層配線の製造方法。 - 少なくともシリコン酸化膜よりも低い比誘電率を持つ絶縁膜の1層からなる層間絶縁膜にレジストマスクを用いてビア孔及びトレンチ溝の内のいずれか一方を形成し、アッシングによって前記レジストマスクを除去することを含む配線構造の製造方法において、
前記レジストマスクを形成する前に、前記層間絶縁膜上に第1のマスク用絶縁膜、金属または金属化合物からなるハードマスク、及び第2のマスク用絶縁膜をこの順で形成し、前記レジストマスクを用いて前記層間絶縁膜をエッチングしてビア孔及びトレンチ溝の内のいずれか一方を形成した後、アッシングによって前記レジストマスクを除去する際に前記第2のマスク用絶縁膜を前記ハードマスクからのパーティクルの発生防止用に使用することを特徴とする配線構造の製造方法。 - 請求項12に記載の配線構造の製造方法において、前記層間絶縁膜は、この順に積層された第1及び第2の層間絶縁膜を備え、前記第1及び第2の層間絶縁膜が前記ハードマスクおよび前記第2のマスク絶縁膜をマスクとして、二層同時にビア孔及びトレンチ溝の内の少なくとも一方が形成されることを特徴とする配線構造の製造方法。
- 請求項12に記載の配線構造の製造方法において、前記層間絶縁膜は、この順に積層された第1及び第2の層間絶縁膜を備え、前記第1及び第2の層間絶縁膜が前記ハードマスクおよび前記第2のマスク絶縁膜をマスクとして、二層別々にビア孔及びトレンチ溝の内の少なくとも一方が形成されることを特徴とする配線構造の製造方法。
- 請求項14に記載の配線構造の製造方法において、前記第1及び第2の層間絶縁膜の二層の内の一方にビア孔及びトレンチ溝の内のいずれか一方のみが形成され、前記第1及び第2の層間絶縁膜の二層の内の他方にビア孔及びトレンチ溝の内の他方のみが形成されることを特徴とする配線構造の製造方法。
- 請求項14に記載の配線構造の製造方法において、前記第1及び第2の層間絶縁膜の二層にビア孔及びトレンチ溝の内の互いに異なる孔部が形成されることを特徴とする配線構造の製造方法。
- 請求項16に記載の配線構造の製造方法において、前記第1の層間絶縁膜にビア孔、前記第2の層間絶縁膜にトレンチ溝が形成されることを特徴とする配線構造の製造方法。
- 請求項12に記載の配線構造の製造方法において、前記第1のマスク用絶縁膜の下部にさらに下部マスク用絶縁膜を形成することを特徴とする配線構造の製造方法。
- 請求項12に記載の配線構造の製造方法において、前記第1及び第2のマスク用絶縁膜の夫々は、シリコン窒化膜、シリコン炭化膜、シリコン炭窒化膜、及びSiOCHの内の少なくとも一種からなり、前記ハードマスクは、チタン、タンタル、タングステン、アルミニウム、それらの合金、それらの酸化物、及びそれらの窒化物の内の少なくとも一種からなることを特徴とする配線構造の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007539991A JP5201326B2 (ja) | 2005-10-06 | 2006-10-06 | 多層配線の製造方法 |
Applications Claiming Priority (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005293385 | 2005-10-06 | ||
JP2005293385 | 2005-10-06 | ||
JP2007539991A JP5201326B2 (ja) | 2005-10-06 | 2006-10-06 | 多層配線の製造方法 |
PCT/JP2006/320428 WO2007043634A1 (ja) | 2005-10-06 | 2006-10-06 | 多層配線の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPWO2007043634A1 JPWO2007043634A1 (ja) | 2009-04-16 |
JP5201326B2 true JP5201326B2 (ja) | 2013-06-05 |
Family
ID=37942855
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2007539991A Expired - Fee Related JP5201326B2 (ja) | 2005-10-06 | 2006-10-06 | 多層配線の製造方法 |
Country Status (2)
Country | Link |
---|---|
JP (1) | JP5201326B2 (ja) |
WO (1) | WO2007043634A1 (ja) |
Families Citing this family (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8071475B2 (en) * | 2007-09-28 | 2011-12-06 | Sandisk 3D Llc | Liner for tungsten/silicon dioxide interface in memory |
JP5600447B2 (ja) * | 2010-03-05 | 2014-10-01 | 株式会社日立ハイテクノロジーズ | プラズマエッチング方法 |
JP5487469B2 (ja) * | 2010-03-29 | 2014-05-07 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
JP6061610B2 (ja) | 2012-10-18 | 2017-01-18 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
JP6515537B2 (ja) * | 2014-04-08 | 2019-05-22 | セイコーエプソン株式会社 | 有機el装置の製造方法、有機el装置、電子機器 |
TWI777164B (zh) * | 2015-03-30 | 2022-09-11 | 日商半導體能源研究所股份有限公司 | 半導體裝置的製造方法 |
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JP2005159008A (ja) * | 2003-11-26 | 2005-06-16 | Fujitsu Ltd | 半導体装置の製造方法 |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6620727B2 (en) * | 2001-08-23 | 2003-09-16 | Texas Instruments Incorporated | Aluminum hardmask for dielectric etch |
JP2004158821A (ja) * | 2002-09-10 | 2004-06-03 | Hitachi Ltd | 半導体装置の製造方法 |
JP2004214566A (ja) * | 2003-01-08 | 2004-07-29 | Renesas Technology Corp | 半導体装置の製造方法および半導体装置 |
JP2005175396A (ja) * | 2003-12-15 | 2005-06-30 | Tokyo Ohka Kogyo Co Ltd | ダマシン法を用いた配線の形成方法及び該配線形成に用いるシリカ系被膜形成用塗布液 |
-
2006
- 2006-10-06 WO PCT/JP2006/320428 patent/WO2007043634A1/ja active Application Filing
- 2006-10-06 JP JP2007539991A patent/JP5201326B2/ja not_active Expired - Fee Related
Patent Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
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JP2005159008A (ja) * | 2003-11-26 | 2005-06-16 | Fujitsu Ltd | 半導体装置の製造方法 |
Also Published As
Publication number | Publication date |
---|---|
JPWO2007043634A1 (ja) | 2009-04-16 |
WO2007043634A1 (ja) | 2007-04-19 |
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