JP4719821B2 - 画像表示装置およびその制御方法 - Google Patents

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Description

本発明は、画像表示装置およびその制御方法に関し、特に電流駆動型の発光素子を用いた画像表示装置およびその制御方法に関する。
電流駆動型の発光素子を用いた画像表示装置として、有機エレクトロルミネッセンス(EL)素子を用いた画像表示装置が知られている。この自発光する有機EL素子を用いた有機EL表示装置は、液晶表示装置に必要なバックライトが不要で装置の薄型化に最適である。また、視野角にも制限がないため、次世代の表示装置として実用化が期待されている。また、有機EL表示装置に用いられる有機EL素子は、各発光素子の輝度がそこに流れる電流値により制御される点で、液晶セルがそこに印加される電圧により制御されるのとは異なる。
有機EL表示装置では、通常、画素を構成する有機EL素子がマトリクス状に配置される。複数の行電極(走査線)と複数の列電極(データ線)との交点に有機EL素子を設け、選択した行電極と複数の列電極との間にデータ信号に相当する電圧を印加するようにして有機EL素子を駆動するものをパッシブマトリクス型の有機ELディスプレイと呼ぶ。
一方、複数の走査線と複数のデータ線との交点にスイッチング薄膜トランジスタ(TFT:Thin Film Transistor)を設け、このスイッチングTFTに駆動素子のゲートを接続し、選択した走査線を通じてこのスイッチングTFTをオンさせて信号線からデータ信号を駆動素子に入力する。この駆動素子によって有機EL素子を駆動するものをアクティブマトリクス型の有機EL表示装置と呼ぶ。
アクティブマトリクス型の有機EL表示装置は、各行電極(走査線)を選択している期間のみ、それに接続された有機EL素子が発光するパッシブマトリクス型の有機EL表示装置とは異なり、次の走査(選択)まで有機EL素子を発光させることが可能であるため、走査線数が増大してもディスプレイの輝度減少を招くようなことはない。従って、アクティブマトリクス型の有機EL表示装置は、低電圧で駆動でき、低消費電力化が可能となる。
特許文献1には、アクティブマトリクス型の有機EL表示装置における画素部の回路構成が開示されている。
図16は、特許文献1に記載された従来の有機EL表示装置における画素部の回路構成図である。同図における画素部500は、カソードが負電源線(電圧値はVEE)に接続された有機EL素子505、ドレインが正電源線(電圧値はVDD)に接続されソースが有機EL素子505のアノードに接続されたn型薄膜トランジスタ(n型TFT)504、n型TFT504のゲート−ソース間に接続されn型TFT504のゲート電圧を保持する容量素子503、有機EL素子505の両端子間を略同電位とする第3スイッチング素子509、信号線506から映像信号を選択的にn型TFT504のゲートに印加する第1スイッチング素子501、及びn型TFT504のゲート電位を所定電位に初期化する第2スイッチング素子502という簡単な回路素子により構成される。以下、画素部500の発光動作を説明する。
まず、第2スイッチング素子502を、第2走査線508から供給される走査信号によりオン状態とし、参照電源線から供給される所定の電圧VREFをn型TFT504のゲートに印加してn型TFT504のソース−ドレイン間電流が流れないようn型TFT504を初期化する(S101)。
次に、第2スイッチング素子502を、第2走査線508から供給される走査信号によりオフ状態とする(S102)。
次に、第1スイッチング素子501を、第1走査線507から供給される走査信号によりオン状態とし、信号線506から供給される信号電圧をn型TFT504のゲートに印加する(S103)。このとき、第3スイッチング素子509のゲートには、第1走査線507が接続されており、第1スイッチング素子501の導通と同時に導通する。これによって有機EL素子505の端子間電圧に影響されずに、容量素子503には信号電圧に対応した電荷が蓄積される。また、第3スイッチング素子509が導通している間は有機EL素子505に電流が流れないので、有機EL素子505は発光しない。
次に、第3スイッチング素子509を、第1走査線507から供給される走査信号によりオフ状態とし、容量素子503に蓄積された電荷に対応する信号電流をn型TFT504から有機EL素子505へ供給する(S104)。このとき、有機EL素子505が発光する。
上述した一連の動作により、1フレーム期間において、信号線から供給される信号電圧に対応した輝度で有機EL素子505が発光することになる。
特開2005−4173号公報
しかしながら、特許文献1に記載された従来の有機EL表示装置は、信号電圧をn型TFT504のゲートに記録した際(S103)に、n型TFT504がオン状態となり、第3スイッチング素子509を介して負電源線に電流が流れ込んでしまう。この電流が、第3スイッチング素子509及び負電源線の抵抗成分に流れることにより、n型TFT504のソース電位が変動してしまう。つまり、容量素子503に保持すべき電圧が変動してしまう。
上述したように、アモルファスSiに代表されるn型TFTによってソース接地動作する画素回路を構成する場合、駆動n型TFTのゲート−ソース間の電圧を保持する機能を有する容量素子の両端電極に、正確な電位を記録することが困難となる。よって、信号電圧に対応した正確な信号電流が流れないため発光素子が正確に発光せず、結果的には映像信号を反映した高精度な画像表示がなされない。
上記課題に鑑み、本発明は、簡単な画素回路で、n型駆動TFTのゲート−ソース間の電圧を保持する静電保持容量の両端電極に、信号電圧に対応した正確な電位を記録することができる発光画素を有する画像表示装置を提供することを目的とする。
上記目的を達成するために、本発明の一態様に係る画像表示装置は、発光素子と、電圧を保持するコンデンサと、ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、前記駆動素子のドレイン電極の電位を決定するための第1電源線と、前記発光素子の第2電極に電気的に接続された第2電源線と、前記コンデンサの第1電極の電圧値を規定する参照電圧を供給する第3電源線と、前記コンデンサの第1電極に前記参照電圧を設定するための第1スイッチング素子と、前記コンデンサの第2電極に信号電圧を供給するデータ線と、一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第2電極に電気的に接続され、前記データ線と前記コンデンサの第2電極との導通及び非導通を切り換える第2スイッチング素子と、前記発光素子の第1電極と、前記コンデンサの第2電極とを接続するための第3スイッチング素子と、前記第1スイッチング素子、前記第2スイッチング素子及び前記第3スイッチング素子を制御する駆動回路とを備え、前記駆動回路は、前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させ、前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONすることを特徴とする。
本発明の画像表示装置およびその制御方法によれば、駆動n型TFTに流れる電流は常に発光素子経由のみとなるので、参照電源線及び信号線には流れない。よって、駆動n型TFTのゲート−ソース間の電圧を保持する機能を有する容量素子の両端電極に、正確な電位を記録することができ、映像信号を反映した高精度な画像表示をすることが可能となる。
図1は、本発明の画像表示装置の電気的な構成を示すブロック図である。 図2は、本発明の実施の形態1に係る表示部の有する発光画素の回路構成及びその周辺回路との接続を示す図である。 図3Aは、本発明の実施の形態1及び2に係る画像表示装置の制御方法の動作タイミングチャートである。 図3Bは、本発明の実施の形態1及び2に係る画像表示装置の制御方法の変形例を示す動作タイミングチャートである。 図4は、本発明の実施の形態1に係る画像表示装置の動作フローチャートである。 図5Aは、本発明の実施の形態1に係る画像表示装置の信号電圧書き込み時における画素回路の導通状態を表す図である。 図5Bは、本発明の実施の形態1に係る画像表示装置の発光時における画素回路の導通状態を表す図である。 図6は、本発明の実施の形態2に係る表示部の有する発光画素の回路構成及びその周辺回路との接続を示す図である。 図7は、本発明の実施の形態2に係る画像表示装置の動作フローチャートである。 図8は、本発明の実施の形態3に係る表示部の有する発光画素の回路構成及びその周辺回路との接続を示す図である。 図9は、本発明の実施の形態3に係る画像表示装置の制御方法の動作タイミングチャートである。 図10は、本発明の実施の形態3に係る画像表示装置の動作フローチャートである。 図11は、本発明の実施の形態3に係る表示部における発光画素の変形例を示す回路構成及びその周辺回路との接続を示す図である。 図12は、本発明の実施の形態3に係る画像表示装置における発光画素の制御方法の変形例を示す動作タイミングチャートである。 図13は、本発明の実施の形態3に係る画像表示装置の発光画素の変形例を示す動作フローチャートである。 図14は、本発明の実施の形態2及び3を組み合わせた発光画素の回路構成及びその周辺回路との接続を示す図である。 図15は、本発明の画像表示装置を内蔵した薄型フラットTVの外観図である。 図16は、特許文献1に記載された従来の有機EL表示装置における画素部の回路構成図である。
請求項1に記載の態様の画像表示装置は、発光素子と、電圧を保持するコンデンサと、ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、前記駆動素子のドレイン電極の電位を決定するための第1電源線と、前記発光素子の第2電極に電気的に接続された第2電源線と、前記コンデンサの第1電極の電圧値を規定する参照電圧を供給する第3電源線と、前記コンデンサの第1電極に前記参照電圧を設定するための第1スイッチング素子と、前記コンデンサの第2電極に信号電圧を供給するデータ線と、一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第2電極に電気的に接続され、前記データ線と前記コンデンサの第2電極との導通及び非導通を切り換える第2スイッチング素子と、前記発光素子の第1電極と、前記コンデンサの第2電極とを接続するための第3スイッチング素子と、前記第1スイッチング素子、前記第2スイッチング素子及び前記第3スイッチング素子を制御する駆動回路とを備え、前記駆動回路は、前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させ、前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONするものである。
本態様によると、前記発光素子の第1電極と、前記コンデンサの第2電極及び前記第2スイッチング素子の間のノードと、を接続する第3スイッチング素子を設け、前記第3スイッチング素子をOFFしている間に、前記信号電圧に対応する電圧を前記コンデンサに保持させ、前記信号電圧に対応する電圧が前記コンデンサに保持された後に、前記第3スイッチング素子をONするものである。これにより、駆動素子のソース電極と前記コンデンサの第2電極とを非接続とした状態で信号電圧に対応する電圧を前記コンデンサに設定できる。即ち、前記信号電圧に対応する電圧が前記コンデンサに保持されるのを完了する前に、前記駆動トランジスタのソース電極から前記コンデンサに電流が流れ込むのを防止できる。そのため、前記信号電圧に対応する電圧を前記コンデンサに正確に保持できるので、前記コンデンサに保持すべき電圧が変動して、映像信号を反映した発光量にて前記発光素子が正確に発光しないことを防止できる。その結果、映像信号を反映して発光量にて前記発光素子を正確に発光させ、映像信号を反映した高精度な画像表示を実現できる。
また、請求項に記載の態様の画像表示装置は、さらに、第2参照電圧を供給する第4電源線と、前記コンデンサの第2電極と前記第4電源線との間に設けられた第2コンデンサとを備え、前記第2コンデンサは、前記第3スイッチング素子がONしている間に前記駆動素子のソース電位を記憶するものである。
本態様によると、前記コンデンサの第2電極と前記第4電源線との間に第2コンデンサを設け、前記第3スイッチング素子がONしている間に前記駆動素子のソース電位を前記第2コンデンサに記憶させる。これにより、前記第2コンデンサには定常状態における駆動素子のソース電位を記憶させ、その後に前記第3スイッチング素子をOFFにしても、前記コンデンサの第2電極の電位が確定するので、前記駆動素子のゲート電圧が確定される。また、前記駆動素子のソース電位は定常状態にあるので、前記第2コンデンサは前記駆動素子のゲート−ソース間電圧を安定させることになる。
請求項2に記載の態様の画像表示装置は、請求項1記載の画像表示装置において、前記発光素子の第1電極はアノード電極であり、前記発光素子の第2電極はカソード電極であり、前記第1電源線の電圧は、前記第2電源線の電圧より高く、前記第1電源線から前記第2電源線に向けて電流が流れるものである。
本態様によると、前記駆動素子をN型トランジスタで構成している。
請求項3に記載の態様の画像表示装置は、請求項1または2に記載の画像表示装置において、前記第1スイッチング素子と前記駆動回路とを接続し、前記第1スイッチング素子を制御する信号を前記第1スイッチング素子に伝達する第1走査線と、前記第2スイッチング素子と前記駆動回路とを接続し、前記第2スイッチング素子を制御する信号を前記第2スイッチング素子に伝達する第2走査線と、前記第3スイッチング素子と前記駆動回路とを接続し、前記第3スイッチング素子を制御する信号を前記第3スイッチング素子に伝達する第3走査線とを備えるものである。
本態様によると、前記第1スイッチング素子と前記駆動回路とを接続し前記駆動回路が前記第1スイッチング素子を制御するのに用いる第1走査線と、前記第2スイッチング素子と前記駆動回路とを接続し前記駆動回路が前記第1スイッチング素子を制御するのに用いる第2走査線と、前記第3スイッチング素子と前記駆動回路とを接続し前記駆動回路が前記第1スイッチング素子を制御するのに用いる第3走査線と、を設けてもよい。
請求項4に記載の態様の画像表示装置は、請求項3に記載の画像表示装置において、前記第1走査線と前記第2走査線とは共通の走査線である。
本態様によると、前記第1走査線と前記第2走査線とを共通の走査線としてもよい。この場合、スイッチング素子を制御する走査線の本数を削減できるので、回路構成を簡素化できる。
請求項に記載の態様の画像表示装置は、請求項5に記載の画像表示装置において、前記第3電源線と前記第4電源線とは共通の電源線である。
本態様によると、前記第3電源線と前記第4電源線とは共通の電源線であってもよい。
請求項に記載の態様の画像表示装置は、請求項に記載の画像表示装置において、前記第3電源線と前記第4電源線とは別個の電源線である。
本態様によると、前記第3電源線と前記第4電源線とは別個の電源線であってもよい。この場合、前記コンデンサの電圧調整と、前記第2コンデンサの電圧調整とが独立になされるので、回路調整の自由度が向上する。
また、請求項に記載の態様の画像表示装置は、発光素子と、電圧を保持するコンデンサと、ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、前記駆動素子のドレイン電極の電位を決定するための第1電源線と、前記発光素子の第2電極に電気的に接続された第2電源線と、前記コンデンサの第2電極の電圧値を規定する参照電圧を供給する第3電源線と、前記コンデンサの第2電極に前記参照電圧を設定するための第1スイッチング素子と、前記コンデンサの第1電極に信号電圧を供給するデータ線と、一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第1電極に電気的に接続され、前記データ線と前記コンデンサの第1電極との導通及び非導通を切り換える第2スイッチング素子と、前記発光素子の第1電極と、前記コンデンサの第2電極とを接続するための第3スイッチング素子と、前記第1スイッチング素子、前記第2スイッチング素子及び前記第3スイッチング素子を制御する駆動回路とを備え、前記駆動回路は、前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させ、前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONするものである。
本態様によると、前記発光素子の第1電極と、前記コンデンサの第2電極及び前記第1スイッチング素子の間のノードと、を接続する第3スイッチング素子を設け、前記第3スイッチング素子をOFFしている間に、前記信号電圧に対応する電圧を前記コンデンサに保持させ、前記信号電圧に対応する電圧が前記コンデンサに保持された後に、前記第3スイッチング素子をONするものである。これにより、駆動素子のソース電極と前記コンデンサの第2電極とを非接続とした状態で前記コンデンサに電圧を設定できる。即ち、前記信号電圧に対応する電圧が前記コンデンサに保持されるのを完了する前に、前記駆動トランジスタのソース電極から前記コンデンサに電流が流れ込むのを防止できる。そのため、前記信号電圧に対応する電圧を前記コンデンサに正確に保持できるので、前記コンデンサに保持すべき電圧が変動して、映像信号を反映して前記発光素子が発光量にて正確に発光しないことを防止できる。その結果、映像信号を反映して発光量にて前記発光素子を正確に発光させ、映像信号を反映した高精度な画像表示を実現できる。
また、請求項に記載の態様の画像表示装置は、さらに、第2参照電圧を供給する第4電源線と、前記コンデンサの第2電極と前記第4電源線との間に設けられた第2コンデンサとを備え、前記第2コンデンサは、前記第3スイッチング素子がONしている間に前記駆動素子のソース電位を記憶するものである。
本態様によると、前記コンデンサの第2電極と前記第4電源線との間に第2コンデンサを設け、前記第3スイッチング素子がONしている間に前記駆動素子のソース電位を前記第2コンデンサに記憶させる。これにより、前記第2コンデンサには定常状態における駆動素子のソース電位を記憶させ、その後に前記第3スイッチング素子をOFFにしても、前記コンデンサの第2電極の電位が確定するので、前記駆動素子のゲート電圧が確定される。また、前記駆動素子のソース電圧は定常状態にあるので、前記第2コンデンサは前記駆動素子のゲート−ソース間電圧を安定させることになる。
請求項に記載の態様の画像表示装置は、請求項8記載の画像表示装置において、前記発光素子の第1電極はアノード電極であり、前記発光素子の第2電極はカソード電極であり、前記第1電源線の電圧は、前記第2電源線の電圧より高く、前記第1電源線から前記第2電源線に向けて電流が流れるものである。
本態様によると、前記駆動素子をN型トランジスタで構成している。
請求項に記載の態様の画像表示装置は、請求項またはに記載の画像表示装置において、前記第1スイッチング素子と前記駆動回路とを接続し、前記第1スイッチング素子を制御する信号を前記第1スイッチング素子に伝達する第1走査線と、前記第2スイッチング素子と前記駆動回路とを接続し、前記第2スイッチング素子を制御する信号を前記第2スイッチング素子に伝達する第2走査線と、前記第3スイッチング素子と前記駆動回路とを接続し、前記第3スイッチング素子を制御する信号を前記第3スイッチング素子に伝達する第3走査線とを備えるものである。
本態様によると、前記第1スイッチング素子と前記駆動回路とを接続し前記駆動回路が前記第1スイッチング素子を制御するのに用いる第1走査線と、前記第2スイッチング素子と前記駆動回路とを接続し前記駆動回路が前記第1スイッチング素子を制御するのに用いる第2走査線と、前記第3スイッチング素子と前記駆動回路とを接続し前記駆動回路が前記第1スイッチング素子を制御するのに用いる第3走査線と、を設けてもよい。
請求項10に記載の態様の画像表示装置は、請求項に記載の画像表示装置において、前記第1走査線と前記第2走査線とは共通の走査線である。
本態様によると、前記第1走査線と前記第2走査線とを共通の走査線としてもよい。この場合、スイッチング素子を制御する走査線の本数を削減できるので、回路構成を簡素化できる。
請求項11に記載の態様の画像表示装置は、請求項に記載の画像表示装置において、前記第3電源線と前記第4電源線とは共通の電源線である。
本態様によると、前記第3電源線と前記第4電源線とは共通の電源線であってもよい。
請求項12に記載の態様の画像表示装置は、請求項に記載の画像表示装置において、前記第3電源線と前記第4電源線とは別個の電源線である。
本態様によると、前記第3電源線と前記第4電源線とは別個の電源線であってもよい。この場合、前記コンデンサの電圧調整と、前記第2コンデンサの電圧調整とが独立になされるので、回路調整の自由度が向上する。
また、請求項13に記載の態様の画像表示装置は、複数の画素部を有する画像表示装置であって、前記複数の画素部の中の隣接する第1画素部と第2画素部とは、それぞれ、発光素子と、電圧を保持するコンデンサと、ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、前記駆動素子のドレイン電極の電位を決定するための第1電源線と、前記発光素子の第2電極に電気的に接続された第2電源線と、前記コンデンサの第1電極の電圧値を規定する参照電圧を供給する第3電源線と、前記コンデンサの第1電極に前記参照電圧を設定するための第1スイッチング素子と、前記コンデンサの第2電極に信号電圧を供給するデータ線と、一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第2電極に電気的に接続され、前記データ線と前記コンデンサの第2電極との導通及び非導通を切り換える第2スイッチング素子と、前記発光素子の第1電極と前記コンデンサの第2電極とを接続するための第3スイッチング素子と、前記第1スイッチング素子を制御する信号を前記第1スイッチング素子に伝達する第1走査線と、前記第2スイッチング素子を制御する信号を前記第2スイッチング素子に伝達する第2走査線と、前記第3スイッチング素子を制御する信号を前記第3スイッチング素子に伝達する第3走査線とを備え、前記画像表示装置は、前記第1走査線を介して前記第1スイッチング素子に接続され、前記第2走査線を介して前記第2スイッチング素子に接続され、前記第3走査線を介して前記第3スイッチング素子に接続され、前記第1スイッチング素子、前記第2スイッチング素子及び前記第3スイッチング素子を制御する駆動回路を備え、前記駆動回路は、前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させ、前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONし、前記第1画素部に含まれる前記第1走査線と、前記第1画素部に含まれる前記第2走査線と、前記第2画素部に含まれる前記第3走査線とは、前記駆動回路からの共通の走査線から分岐している。
本態様によると、隣接する画素部間で走査線を共用することにより、スイッチング素子を制御する走査線の本数を削減できるので、画像表示装置としての回路構成を簡略化でき、また、前記走査線を介してスイッチング素子を制御する駆動回路を簡素化できる。
また、請求項13に記載の態様の画像表示装置は、さらに、第2参照電圧を供給する第4電源線と、前記コンデンサの第2電極と前記第4電源線との間に設けられた第2コンデンサとを備え、前記第2コンデンサは、前記第3スイッチング素子がONしている間に前記駆動素子のソース電位を記憶するものである。
本態様によると、前記コンデンサの第2電極と前記第4電源線との間に第2コンデンサを設け、前記第3スイッチング素子がONしている間に前記駆動素子のソース電位を前記第2コンデンサに記憶させる。これにより、前記第2コンデンサには定常状態における駆動素子のソース電位を記憶させ、その後に前記第3スイッチング素子をOFFにしても、前記コンデンサの第2電極の電位が確定するので、前記駆動素子のゲート電圧が確定される。また、前記駆動素子のソース電圧は定常状態にあるので、前記第2コンデンサは前記駆動素子のゲート−ソース間電圧を安定させることになる。
また、請求項14に記載の態様の画像表示装置は、請求項1〜13のうちいずれか1項に記載の画像表示装置において、前記発光素子は、有機EL発光素子である。
本態様によると、前記発光素子を有機EL発光素子としてもよい。
また、請求項15に記載の態様の画像表示装置の制御方法は、発光素子と、電圧を保持するコンデンサと、ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、第1電極が前記コンデンサの第2電極に接続された第2コンデンサと、前記駆動素子のドレイン電極の電位を決定するための第1電源線と、前記発光素子の第2電極に電気的に接続された第2電源線と、前記コンデンサの第1電極の電圧値を規定する参照電圧を供給する第3電源線と、前記第2コンデンサの第2電極の電圧値を規定する第2参照電圧を供給する第4電源線と、前記コンデンサの第1電極に前記参照電圧を設定するための第1スイッチング素子と、前記コンデンサの第2電極に信号電圧を供給するデータ線と、一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第2電極に電気的に接続され、前記データ線と前記コンデンサの第2電極との導通及び非導通を切り換える第2スイッチング素子と、前記発光素子の第1電極と前記コンデンサの第2電極とを接続するための第3スイッチング素子とを備えた画像表示装置の制御方法であって、前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させる第1ステップと、前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONさせる第2ステップと、前記第3スイッチング素子がONしている間に、前記第2コンデンサに前記駆動素子のソース電位を保持させる第3ステップと、を含むものである。
また、請求項16に記載の態様の画像表示装置の制御方法は、発光素子と、電圧を保持するコンデンサと、ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、第1電極が前記コンデンサの第2電極に接続された第2コンデンサと、前記駆動素子のドレイン電極の電位を決定するための第1電源線と、前記発光素子の第2電極に電気的に接続された第2電源線と、前記コンデンサの第2電極の電圧値を規定する参照電圧を供給する第3電源線と、前記第2コンデンサの第2電極の電圧値を規定する第2参照電圧を供給する第4電源線と、前記コンデンサの第2電極に前記参照電圧を設定するための第1スイッチング素子と、前記コンデンサの第1電極に信号電圧を供給するデータ線と、一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第1電極に電気的に接続され、前記データ線と前記コンデンサの第1電極との導通及び非導通を切り換える第2スイッチング素子と、前記発光素子の第1電極と、前記コンデンサの第2電極とを接続するための第3スイッチング素子とを備えた画像表示装置の制御方法であって、前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させる第1ステップと、前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONさせる第2ステップと、前記第3スイッチング素子がONしている間に、前記第2コンデンサに前記駆動素子のソース電位を保持させる第3ステップと、を含むものである。
以下、本発明の好ましい実施の形態を図に基づき説明する。なお、以下では、全ての図を通じて同一又は相当する要素には同じ符号を付して、その重複する説明を省略する。
(実施の形態1)
本実施の形態における画像表示装置は、マトリクス状に配置された複数の発光画素を備え、各発光画素は、発光素子と、コンデンサと、ゲートが当該コンデンサの第1電極に接続されソースが発光素子に接続された駆動素子と、当該駆動素子のソースと当該コンデンサの第2電極との導通及び非導通を切り換える第3スイッチング素子と、参照電源線と当該コンデンサの第1電極との導通及び非導通を切り換える第1スイッチング素子と、データ線と当該コンデンサの第2電極との導通及び非導通を切り換える第2スイッチング素子とを備える。以上の構成により、上記コンデンサの両端電極に、信号電圧に対応した正確な電位を記録することが可能となる。よって、映像信号を反映した高精度な画像表示をすることが可能となる。
以下、本発明の実施の形態について、図面を参照しながら説明する。
図1は、本発明の画像表示装置の電気的な構成を示すブロック図である。同図における画像表示装置1は、制御回路2と、メモリ3と、走査線駆動回路4と、信号線駆動回路5と、表示部6とを備える。
また、図2は、本発明の実施の形態1に係る表示部の有する発光画素の回路構成及びその周辺回路との接続を示す図である。同図における発光画素10は、スイッチングトランジスタ11、12及び19と、静電保持容量13と、駆動トランジスタ14と、有機EL素子15と、信号線16と、走査線17及び18と、参照電源線20と、正電源線21と、負電源線22とを備える。また、周辺回路は、走査線駆動回路4と、信号線駆動回路5とを備える。
図1及び図2に記載された構成要素について、以下、その接続関係および機能を説明する。
制御回路2は、走査線駆動回路4、信号線駆動回路5、及びメモリ3の制御を行う機能を有する。メモリ3には、各発光画素の補正データなどが記憶されており、制御回路2は、メモリ3に書き込まれた補正データを読み出し、外部から入力された映像信号を、その補正データに基づいて補正して、信号線駆動回路5へと出力する。
走査線駆動回路4は、走査線17及び18に接続されており、走査線17及び18に走査信号を出力することにより、発光画素10の有するスイッチングトランジスタ11、12及び19の導通・非導通を制御する機能を有する駆動回路である。
信号線駆動回路5は、信号線16に接続されており、映像信号に基づいた信号電圧を発光画素10へ出力する機能を有する駆動回路である。
表示部6は、複数の発光画素10を備え、外部から画像表示装置1へ入力された映像信号に基づいて画像を表示する。
スイッチングトランジスタ11は、ゲートが第2走査線である走査線17に接続され、ソース及びドレインの一方がデータ線である信号線16に接続され、ソース及びドレインの他方が静電保持容量13の第2電極である電極132に接続された第2スイッチング素子である。スイッチングトランジスタ11は、信号線16の信号電圧を静電保持容量13の電極132に印加するタイミングを決定する機能を有する。
スイッチングトランジスタ12は、ゲートが第1走査線である走査線17に接続され、ソース及びドレインの一方が第1参照電源線である参照電源線20に接続され、ソース及びドレインの他方が静電保持容量13の第1電極である電極131に接続された第1スイッチング素子である。スイッチングトランジスタ12は、参照電源線20の参照電圧VREFを静電保持容量13の電極131に印加するタイミングを決定する機能を有する。スイッチングトランジスタ11及び12は、例えば、n型の薄膜トランジスタ(n型TFT)で構成される。
なお、前記第1走査線及び前記第2走査線を共通の走査線17とすることで、スイッチングトランジスタを制御する走査線の本数を削減できるので、回路構成を簡素化できる。
静電保持容量13は、第1電極である電極131が駆動トランジスタ14のゲートに接続され、第2電極である電極132がスイッチングトランジスタ19を介して駆動トランジスタ14のソースに接続されたコンデンサである。静電保持容量13は、信号線16から供給された信号電圧に対応した電圧を保持し、例えば、スイッチングトランジスタ11及び12がオフ状態となった後に、駆動トランジスタ14のゲート・ソース電極間電位を安定的に保持し、駆動トランジスタ14から有機EL素子15へ供給する電流を安定化する機能を有する。
駆動トランジスタ14は、ドレインが第2電源線である正電源線21に接続され、ソースが有機EL素子15のアノードに接続された駆動素子である。駆動トランジスタ14は、ゲート−ソース間に印加された信号電圧に対応した電圧を、当該信号電圧に対応したドレイン電流に変換する。そして、このドレイン電流を信号電流として有機EL素子15に供給する。駆動トランジスタ14は、例えば、n型の薄膜トランジスタ(n型TFT)で構成される。
有機EL素子15は、カソードが第2電源線である負電源線22に接続された発光素子であり、駆動トランジスタ14により上記信号電流が流れることにより発光する。
スイッチングトランジスタ19は、ゲートが第3走査線である走査線18に接続され、ソース及びドレインの一方が駆動トランジスタ14のソースに接続され、ソース及びドレインの他方が静電保持容量13の電極132に接続された第3スイッチング素子である。スイッチングトランジスタ19は、静電保持容量13に保持された電位を駆動トランジスタ14のゲート・ソース電極間に印加するタイミングを決定する機能を有する。スイッチングトランジスタ19は、例えば、n型の薄膜トランジスタ(n型TFT)で構成される。
信号線16は、信号線駆動回路5に接続され、発光画素10を含む画素列に属する各発光画素へ接続され、発光強度を決定する信号電圧を供給する機能を有する。
また、画像表示装置1は、画素列数分の信号線16を備える。
走査線17は、第1走査線及び第2走査線であり、走査線駆動回路4に接続され、発光画素10を含む画素行に属する各発光画素に接続されている。これにより、走査線17は、発光画素10を含む画素行に属する各発光画素へ上記信号電圧を書き込むタイミングを供給する機能、及び当該発光画素の有する駆動トランジスタ14のゲートに参照電圧VREFを印加するタイミングを供給する機能を有する。
走査線18は、第3走査線であり、走査線駆動回路4に接続されている。これにより、走査線18は、静電保持容量13の電極132の電位を駆動トランジスタ14のソースに印加するタイミングを供給する機能を有する。
また、画像表示装置1は、画素行数分の走査線17及び18を備える。
なお、図1、図2には記載されていないが、参照電源線20、第1電源線である正電源線21及び第2電源線である負電源線22は、それぞれ、他の発光画素にも接続されており電圧源に接続されている。
次に、本実施の形態に係る画像表示装置1の制御方法について図3A〜図5Bを用いて説明する。
図3Aは、本発明の実施の形態1に係る画像表示装置の制御方法の動作タイミングチャートである。同図において、横軸は時間を表している。また縦方向には、上から順に、走査線17、走査線18、及び信号線16に発生する電圧の波形図が示されている。また、図4は、本発明の実施の形態1に係る画像表示装置の動作フローチャートである。
まず、時刻t0において、走査線駆動回路4は、走査線18の電圧レベルをHIGHからLOWに変化させ、スイッチングトランジスタ19をオフ状態とする。これにより、駆動トランジスタ14のソースと静電保持容量13の電極132とは非導通となる(図4のS11)。なお、本実施の形態において、例えば、走査線18の電圧レベルのHIGHは+20V、LOWは−10Vに設定されている。
次に、時刻t1において、走査線駆動回路4は、走査線17の電圧レベルをLOWからHIGHに変化させ、スイッチングトランジスタ11及び12をオン状態とする。図5Aは、本発明の実施の形態1に係る画像表示装置の信号電圧書き込み時における画素回路の導通状態を表す図である。同図に記載されているように、静電保持容量13の電極131には参照電源線20の参照電圧VREFが印加され、電極132には信号線16より信号電圧Vdataが印加される(図4のS12)。つまり、ステップS12では、発光画素10に印加すべき信号電圧に対応した電荷を静電保持容量13に保持させている。
また、駆動トランジスタ14のソースと静電保持容量13の電極132とは、ステップS11の動作により非導通となっている。さらに、参照電源線20の参照電圧VREFは、駆動トランジスタ14のゲートに印加されるが、駆動トランジスタ14がオフ状態となる電位に設定されている。よって、このとき、駆動トランジスタ14のソース−ドレイン電流は流れないので、有機EL素子15は発光しない。なお、本実施の形態において、例えば、走査線17の電圧レベルのHIGHは+20V、LOWは−10Vに設定されている。また、VREFは0Vに、Vdataは−5V〜0Vに設定されている。
時刻t1〜時刻t2の期間、走査線17の電圧レベルがHIGHであるので、発光画素10の電極132には信号線16から信号電圧Vdataが印加され、同様に、発光画素10を含む画素行に属する各発光画素に対し信号電圧が供給される。
この期間において、参照電源線20には容量性負荷のみが接続されているので、定常電流による電圧降下は発生しない。またスイッチングトランジスタ12のドレイン−ソース間に発生する電位差は、静電保持容量13の充電が完了した際は0Vとなる。信号線16とスイッチングトランジスタ11についても同様である。よって、静電保持容量13の電極131及び電極132には、それぞれ、信号電圧に対応した正確な電位VREF及びVdataが書き込まれる。
次に、時刻t2において、走査線駆動回路4は、走査線17の電圧レベルをHIGHからLOWに変化させ、スイッチングトランジスタ11及び12をオフ状態とする。これにより、静電保持容量13の電極131と参照電源線20とは非導通となり、かつ、静電保持容量13の電極132と信号線16とは非導通となる(図4のS13)。
次に、時刻t3において、走査線駆動回路4は、走査線18の電圧レベルをLOWからHIGHに変化させ、スイッチングトランジスタ19をオン状態とする。図5Bは、本発明の実施の形態1に係る画像表示装置の発光時における画素回路の導通状態を表す図である。同図に記載されているように、駆動トランジスタ14のソースと静電保持容量13の電極132とは導通する(図4のS14)。また、静電保持容量13の電極131は、参照電源線20と遮断され、電極132は信号線16と遮断されている。よって、駆動トランジスタ14のゲート電位はソース電位の変動と共に変化し、かつ、ゲート−ソース間には、静電保持容量13の両端電圧である(VREF−Vdata)が印加されるので、この(VREF−Vdata)に対応した信号電流が有機EL素子15に流れる。なお、本実施の形態において、例えば、駆動トランジスタ14のソース電位はスイッチングトランジスタ19の導通により、0Vから10Vに変化する。また、正電源線の電圧VDDは+20V、負電源線の電圧VEEは0Vに設定されている。
時刻t3〜時刻t4の期間、ゲート−ソース間には、静電保持容量13の両端電圧である(VREF−Vdata)が印加され続け、上記信号電流が流れることにより有機EL素子15は発光を持続する。
t0〜t4の期間は、画像表示装置1の有する全発光画素の発光強度が更新される1フレーム期間に相当し、t4以降においてもt0〜t4の期間の動作が繰り返される。
図3Bは、本発明の実施の形態1に係る画像表示装置の制御方法の変形例を示す動作タイミングチャートである。
まず、時刻t10において、走査線駆動回路4は、実施の形態1における図3Aに記載された時刻t0での動作と、図3Aに記載された時刻t1での動作とを同時に実行する(図4のS11とS12)。つまり、駆動トランジスタ14のソースと静電保持容量13の電極132とが非導通となり、同時に、静電保持容量13の電極131には参照電圧VREFが印加され、電極132には信号電圧Vdataが印加される。
時刻t10〜時刻t11の期間では、実施の形態1における図3Aに記載された時刻t1〜時刻t2の期間と同様の状態が実現される。走査線17の電圧レベルがHIGHであるので、発光画素10の電極132には信号線16から信号電圧Vdataが印加され、同様に、発光画素10を含む画素行に属する各発光画素に対し信号電圧が供給される。
この期間において、参照電源線20には容量性負荷のみが接続されているので、定常電流による電圧降下は発生しない。またスイッチングトランジスタ12のドレイン−ソース間に発生する電位差は、静電保持容量13の充電が完了した際は0Vとなる。信号線16とスイッチングトランジスタ11についても同様である。よって、静電保持容量13の電極131及び電極132には、それぞれ、信号電圧に対応した正確な電位VREF及びVdataが書き込まれる。
次に、時刻t11において、走査線駆動回路4は、実施の形態1における図3Aに記載された時刻t2での動作と、図3Aに記載された時刻t3での動作とを同時に実行する(図4のS13とS14)。つまり、静電保持容量13の電極131と参照電源線20とは非導通となり、静電保持容量13の電極132と信号線16とは非導通となり、駆動トランジスタ14のソースと静電保持容量13の電極132とは導通する。このとき、駆動トランジスタ14のゲート−ソース間には、静電保持容量13の両端電圧である(VREF−Vdata)が印加されるので、この(VREF−Vdata)に対応した信号電流が有機EL素子15に流れる。
時刻t11〜時刻t12の期間、ゲート−ソース間には、静電保持容量13の両端電圧である(VREF−Vdata)が印加され続け、上記信号電流が流れることにより有機EL素子15は発光を持続する。
t10〜t12の期間は、画像表示装置1の全発光画素の発光強度が更新される1フレーム期間に相当し、t12以降においてもt10〜t12の期間の動作が繰り返される。
以上のように、本発明の実施の形態1に係る画像表示装置およびその制御方法によれば、駆動トランジスタに流れる電流は、常に発光素子経由のみとなるので、電源線及び信号線には定常電流は流れない。よって、駆動トランジスタのゲート−ソース間に印加すべき電圧を保持する機能を有する静電保持容量の両端電極に、正確な電位を記録することができ、映像信号を反映した高精度な画像表示をすることが可能となる。
なお、本実施の形態において、図3Aに記載された動作タイミングでは、走査線18の時刻t3及び時刻t4におけるタイミングを、走査線17のタイミングと独立に制御することにより、1フレーム期間内における発光時間、つまりDuty制御を任意に調整することができる。一方、図3Bに記載された動作タイミングでは、走査線17及び18は連動する。よって、走査線制御回路が簡素になるため回路規模を小さくすることができ、スイッチングトランジスタ11および前記スイッチングトランジスタ12がn(p)型であり、前記スイッチングトランジスタ19がp(n)型である場合には、走査線17および18を同一配線として走査線駆動回路4の出力本数を削減できるが、上記Duty制御は不可能であり1フレーム期間内において100%発光を持続する。
(実施の形態2)
本実施の形態における画像表示装置は、マトリクス状に配置された複数の発光画素を備え、各発光画素は、発光素子と、コンデンサと、ゲートが当該コンデンサの第1電極に接続されソースが発光素子に接続された駆動素子と、当該駆動素子のソースと当該コンデンサの第2電極との導通及び非導通を切り換える第3スイッチング素子と、参照電源線と当該コンデンサの第2電極との導通及び非導通を切り換える第1スイッチング素子と、データ線と当該コンデンサの第1電極との導通及び非導通を切り換える第2スイッチング素子とを備える。以上の構成により、上記コンデンサの両端電極に、信号電圧に対応した正確な電位を記録することが可能となる。よって、映像信号を反映した高精度な画像表示をすることが可能となる。
以下、本発明の実施の形態について、図面を参照しながら説明する。
図6は、本発明の実施の形態2に係る表示部の有する発光画素の回路構成及びその周辺回路との接続を示す図である。同図における発光画素30は、スイッチングトランジスタ19、31及び32と、静電保持容量13と、駆動トランジスタ14と、有機EL素子15と、信号線16と、走査線17及び18と、参照電源線20と、正電源線21と、負電源線22とを備える。また、周辺回路は、走査線駆動回路4と、信号線駆動回路5とを備える。
本実施の形態に係る発光画素30は、実施の形態1に係る発光画素10と比較して、静電保持容量13の両端電極へのスイッチングトランジスタの接続のみが構成として異なる。
図6に記載された構成要素について、図2に記載された実施の形態1に係る構成要素と同じ点は説明を省略し、以下、異なる点についてのみ、その接続関係および機能を説明する。
走査線駆動回路4は、走査線17及び18に接続されており、走査線17及び18に走査信号を出力することにより、発光画素30の有するスイッチングトランジスタ19、31及び32の導通・非導通を制御する機能を有する駆動回路である。
信号線駆動回路5は、信号線16に接続されており、映像信号に基づいた信号電圧を発光画素30へ出力する機能を有する駆動回路である。
スイッチングトランジスタ31は、ゲートが第2走査線である走査線17に接続され、ソース及びドレインの一方がデータ線である信号線16に接続され、ソース及びドレインの他方が静電保持容量13の電極131に接続された第2スイッチング素子である。スイッチングトランジスタ31は、信号線16の信号電圧を静電保持容量13の電極131に印加するタイミングを決定する機能を有する。
スイッチングトランジスタ32は、ゲートが第1走査線である走査線17に接続され、ソース及びドレインの一方が参照電源線20に接続され、ソース及びドレインの他方が静電保持容量13の電極132に接続された第1スイッチング素子である。スイッチングトランジスタ32は、参照電源線20の参照電圧VREFを静電保持容量13の電極132に印加するタイミングを決定する機能を有する。スイッチングトランジスタ31及び32は、例えば、n型の薄膜トランジスタ(n型TFT)で構成される。
静電保持容量13は、信号線16から供給された信号電圧に対応した電荷を保持し、例えば、スイッチングトランジスタ31及び32がオフ状態となった後に、駆動トランジスタ14のゲート・ソース電極間電位を安定的に保持し、駆動トランジスタ14から有機EL素子15へ供給する電流を安定化する機能を有するコンデンサである。
信号線16は、信号線駆動回路5に接続され、発光画素30を含む画素列に属する各発光画素へ接続され、発光強度を決定する信号電圧を供給する機能を有する。
また、実施の形態2に係る画像表示装置は、画素列数分の信号線16を備える。
走査線17は、発光画素30を含む画素行に属する各発光画素へ上記信号電圧を書き込むタイミングを供給する機能、及び当該発光画素の有する駆動トランジスタ14のゲートに参照電圧VREFを印加するタイミングを供給する機能を有する。
次に、本実施の形態に係る画像表示装置の制御方法について図3A及び図7を用いて説明する。
図3Aは、本発明の実施の形態2に係る画像表示装置の制御方法の動作タイミングチャートである。また、図7は、本発明の実施の形態2に係る画像表示装置の動作フローチャートである。
まず、時刻t0において、走査線駆動回路4は、走査線18の電圧レベルをHIGHからLOWに変化させ、スイッチングトランジスタ19をオフ状態とする。これにより、駆動トランジスタ14のソースと静電保持容量13の第2電極である電極132とは非導通となる(図7のS21)。なお、本実施の形態において、例えば、走査線18の電圧レベルのHIGHは+20V、LOWは−10Vに設定されている。
次に、時刻t1において、走査線駆動回路4は、走査線17の電圧レベルをLOWからHIGHに変化させ、スイッチングトランジスタ31及び32をオン状態とする。このとき、静電保持容量13の第1電極である電極131には信号線16より信号電圧Vdataが印加され、電極132には参照電源線20の参照電圧VREFが印加される(図7のS22)。つまり、ステップS22では、発光画素30に印加すべき信号電圧に対応した電荷を静電保持容量13に保持させている。
また、駆動トランジスタ14のソースと静電保持容量13の電極132とは、ステップS21の動作により非導通となっている。信号線16の最大電位VDHは、駆動トランジスタ14のゲートに印加されると駆動トランジスタ14がオフ状態となる電位に設定されている。よって、このとき、駆動トランジスタ14のソース−ドレイン電流は流れないので、有機EL素子15は発光しない。なお、本実施の形態において、例えば、VREFは0Vに、Vdataは−5V(VDH)〜0V、VDDは+20V、VEEは0Vに設定されている。
さらに、参照電源線20の電位VREFは、後述するステップS24における駆動トランジスタ14のゲート−ソース間電圧が(VDH−VREF)のときに、有機EL素子15に最大の信号電流値を供給できるように最大信号電位VDHが調整されている。
時刻t1〜時刻t2の期間、走査線17の電圧レベルがHIGHであるので、発光画素30の電極131には信号線16から信号電圧Vdataが印加され、同様に、発光画素30を含む画素行に属する各発光画素に対し信号電圧が供給される。
この期間において、静電保持容量13の電極131及び電極132は、有機EL素子15に電流供給する正電源線21、負電源線22及び有機EL素子15のアノードと切り離されている。よって、参照電源線20には容量性負荷のみが接続されているので、定常電流による電圧降下は発生しない。またスイッチングトランジスタ32のドレイン−ソース間に発生する電位差は、静電保持容量13の充電が完了した際は0Vとなる。信号線16とスイッチングトランジスタ31についても同様である。これにより、静電保持容量13の電極131及び電極132には、それぞれ、信号電圧に対応した正確な電圧Vdata及びVREFが書き込まれる。
次に、時刻t2において、走査線駆動回路4は、走査線17の電圧レベルをHIGHからLOWに変化させ、スイッチングトランジスタ31及び32をオフ状態とする。これにより、静電保持容量13の電極131と信号線16とは非導通となり、かつ、静電保持容量13の電極132と参照電源線20とは非導通となる(図7のS23)。
次に、時刻t3において、走査線駆動回路4は、走査線18の電圧レベルをLOWからHIGHに変化させ、スイッチングトランジスタ19をオン状態とする。このとき、駆動トランジスタ14のソースと静電保持容量13の電極132とは導通する(図7のS24)。また、静電保持容量13の電極131は信号線16と遮断され、電極132は参照電源線20と遮断されている。よって、駆動トランジスタ14のゲート電位は変化し、かつ、ゲート−ソース間には、静電保持容量13の両端電圧である(Vdata−VREF)の電位差が印加されるので、この(Vdata−VREF)に対応した信号電流が有機EL素子15に流れる。なお、本実施の形態において、例えば、駆動トランジスタ14のソース電位はスイッチングトランジスタ19の導通により、+2Vから+10Vに変化する。また、正電源線の電圧VDDは+20V、負電源線の電圧VEEは0Vに設定されている。
時刻t3〜時刻t4の期間、ゲート−ソース間には、静電保持容量13の両端電圧である(Vdata−VREF)が印加され続け、上記信号電流が流れることにより有機EL素子15は発光を持続する。
t0〜t4の期間は、全発光画素の発光強度が更新される1フレーム期間に相当し、t4以降においてもt0〜t4の期間の動作が繰り返される。
図3Bは、本発明の実施の形態2に係る画像表示装置の制御方法の変形例を示す動作タイミングチャートである。
まず、時刻t10において、走査線駆動回路4は、実施の形態2における図3Aに記載された時刻t0での動作と、図3Aに記載された時刻t1での動作とを同時に実行する(図7のS21とS22)。つまり、駆動トランジスタ14のソースと静電保持容量13の電極132とが非導通となり、同時に、静電保持容量13の電極131には信号電圧Vdataが印加され、電極132には参照電圧VREFが印加される。
時刻t10〜時刻t11の期間では、実施の形態2における図3Aに記載された時刻t1〜時刻t2の期間と同様の状態が実現される。走査線17の電圧レベルがHIGHであるので、発光画素30の電極131には信号線16から信号電圧Vdataが印加され、同様に、発光画素30を含む画素行に属する各発光画素に対し信号電圧が供給される。
この期間において、参照電源線20には容量性負荷のみが接続されているので、定常電流による電圧降下は発生しない。またスイッチングトランジスタ32のドレイン−ソース間に発生する電位差は、静電保持容量13の充電が完了した際は0Vとなる。信号線16とスイッチングトランジスタ31についても同様である。よって、静電保持容量13の電極131及び電極132には、それぞれ、信号電圧に対応した正確な電位Vdata及びVREFが書き込まれる。
次に、時刻t11において、走査線駆動回路4は、実施の形態2における図3Aに記載された時刻t2での動作と、図3Aに記載された時刻t3での動作とを同時に実行する(図7のS23とS24)。つまり、静電保持容量13の電極131と信号線16とは非導通となり、静電保持容量13の電極132と参照電源線20とは非導通となり、駆動トランジスタ14のソースと静電保持容量13の電極132とは導通する。このとき、駆動トランジスタ14のゲート−ソース間には、静電保持容量13の両端電圧である(Vdata−VREF)が印加されるので、この(Vdata−VREF)に対応した信号電流が有機EL素子15に流れる。
時刻t11〜時刻t12の期間、ゲート−ソース間には、静電保持容量13の両端電圧である(Vdata−VREF)が印加され続け、上記信号電流が流れることにより有機EL素子15は発光を持続する。
t10〜t12の期間は、全発光画素の発光強度が更新される1フレーム期間に相当し、t12以降においてもt10〜t12の期間の動作が繰り返される。
図3Bに記載された動作タイミングでは、走査線17及び18は連動する。よって、走査線制御回路が簡素になるため回路規模を小さくすることができ、スイッチングトランジスタ31およびスイッチングトランジスタ32がn(p)型であり、前記スイッチングトランジスタ19がp(n)型である場合には、走査線17および18を同一配線として走査線駆動回路4の出力本数を削減できる。
以上のように、本発明の実施の形態2に係る画像表示装置およびその制御方法によれば、駆動トランジスタに流れる電流は常に発光素子経由のみとなるので、電源線及び信号線には定常電流は流れない。よって、駆動トランジスタのゲート−ソース間の電圧を保持する機能を有する静電保持容量の両端電極に、正確な電位を記録することができ、映像信号を反映した高精度な画像表示をすることが可能となる。
(実施の形態3)
本実施の形態における画像表示装置は、マトリクス状に配置された複数の発光画素を備え、各発光画素は、発光素子と、コンデンサと、ゲートが当該コンデンサの第1電極に接続されソースが発光素子に接続された駆動素子と、当該駆動素子のソースと当該コンデンサの第2電極との導通及び非導通を切り換える第3スイッチング素子と、第1参照電源線と当該コンデンサの第1電極との導通及び非導通を切り換える第1スイッチング素子と、データ線と当該コンデンサの第2電極との導通及び非導通を切り換える第2スイッチング素子と、当該コンデンサの第2電極と第2参照電源線との間に接続された第2コンデンサとを備える。以上の構成により、上記コンデンサの両端電極に、信号電圧に対応した正確な電位を保持することが可能となるとともに、第3スイッチング素子のオン・オフ状態によらず安定な発光が実現される。
以下、本発明の実施の形態について、図面を参照しながら説明する。
図8は、本発明の実施の形態3に係る表示部の有する発光画素の回路構成及びその周辺回路との接続を示す図である。同図における発光画素40は、スイッチングトランジスタ11、12及び19と、静電保持容量13及び41と、駆動トランジスタ14と、有機EL素子15と、信号線16と、走査線17及び18と、参照電源線20と、正電源線21と、負電源線22とを備える。また、周辺回路は、走査線駆動回路4と、信号線駆動回路5とを備える。
本実施の形態に係る発光画素40は、実施の形態1に係る発光画素10と比較して、静電保持容量13の電極132と参照電源線20との間に静電保持容量41が接続されていることのみが構成として異なる。
図8に記載された構成要素について、図2に記載された実施の形態1に係る構成要素と同じ点は説明を省略し、以下、異なる点についてのみ、その接続関係および機能を説明する。
静電保持容量41は、静電保持容量13の第2電極である電極132と第4電源線である参照電源線20との間に接続された第2コンデンサである。静電保持容量41は、まず、定常状態において駆動トランジスタ14のソース電位を、スイッチングトランジスタ19が導通している状態で記憶する。その後、スイッチングトランジスタ19がオフ状態となっても、静電保持容量13の電極132の電位が確定されるので駆動トランジスタ14のゲート電圧が確定される。一方、駆動トランジスタ14のソース電位は既に定常状態であるので、静電保持容量41は、結果的に駆動トランジスタ14のゲート−ソース間電圧を安定化させる機能を有する。
なお、静電保持容量41は、スイッチングトランジスタ12のソース及びドレインの一方が接続されている第1電源線である参照電源線20と異なる参照電源線に接続されていてもよい。例えば、正電源線VDDや負電源線VEEであっても良い。この場合、レイアウトの自由度が向上し、素子間のスペースをより広く確保することが可能になり、歩留まりが向上する。
一方、本実施の形態のように、上記参照電源が共通化されていることにより、参照電源線の本数を削減することができるので、画素回路を簡略化することが可能となる。
次に、本実施の形態に係る画像表示装置の制御方法について図9及び図10を用いて説明する。
図9は、本発明の実施の形態3に係る画像表示装置の制御方法の動作タイミングチャートである。また、図10は、本発明の実施の形態3に係る画像表示装置の動作フローチャートである。
まず、時刻t20において、走査線駆動回路4は、走査線17の電圧レベルをLOWからHIGHに変化させ、スイッチングトランジスタ11及び12をオン状態とする。このとき、静電保持容量13の第1電極である電極131には参照電源線20の参照電圧VREFが印加され、第2電極である電極132には信号線16より信号電圧Vdataが印加される(図10のS31)。つまり、ステップS31では、発光画素40に印加すべき信号電圧に対応した電荷を静電保持容量13に保持させる。
時刻t20〜時刻t21の期間、走査線17の電圧レベルがHIGHであるので、発光画素40の電極132には信号線16から信号電圧Vdataが印加され、同様に、発光画素40を含む画素行に属する各発光画素に対し信号電圧が供給される。
この期間において、参照電源線20には容量性負荷のみが接続されているので、定常電流による電圧降下は発生せず、スイッチングトランジスタ12のドレイン−ソース間に発生する電位差は、静電保持容量13の充電が完了した際は0Vとなる。信号線16とスイッチングトランジスタ11についても同様である。よって、静電保持容量13の電極131及び電極132には、それぞれ、信号電圧に対応した正確な電位VREF及びVdataが書き込まれる。
次に、時刻t21において、走査線駆動回路4は、走査線17の電圧レベルをHIGHからLOWに変化させ、スイッチングトランジスタ11及び12をオフ状態とする。これにより、静電保持容量13の電極131と参照電源線20とは非導通となり、かつ、静電保持容量13の電極132と信号線16とは非導通となる(図10のS32)。
時刻t21から微小時間経過したt21’において、走査線駆動回路4は、走査線18の電圧レベルをLOWからHIGHに変化させ、スイッチングトランジスタ19をオン状態とする。これにより、駆動トランジスタ14のソースと静電保持容量13の電極132とは導通する(図10のS32)。また、静電保持容量13の電極131は、参照電源線20と遮断され、電極132は信号線16と遮断されている。よって、駆動トランジスタ14のゲート電位は変化し、かつ、ゲート−ソース間には、静電保持容量13の両端電圧である(VREF−Vdata)が印加されるので、この(VREF−Vdata)に対応した信号電流が有機EL素子15に流れる。なお、本実施の形態において、駆動トランジスタ14のソース電位、正電源線の電圧VDD、負電源線の電圧VEEは、例えば、実施の形態1に記載された電圧値と同様である。
時刻t21’〜時刻t22の期間、ゲート−ソース間には、静電保持容量13の両端電圧である(VREF−Vdata)が印加され続け、上記信号電流が流れることにより有機EL素子15は発光を持続する。
次に、時刻t22において、走査線駆動回路4は、走査線18の電圧レベルをHIGHからLOWに変化させ、スイッチングトランジスタ19をオフ状態とする(図10のS33)。このとき、定常状態であれば、スイッチングトランジスタ19がオフ状態となっても、駆動トランジスタ14のソース電位を静電保持容量41が記憶している。よって、静電保持容量13の電極132の電位が確定され、結果的に電極131の電位、つまり駆動トランジスタ14のゲート電位が安定化される。一方、駆動トランジスタ14のソース電位は定常状態において一定であるので、駆動トランジスタ14のゲート−ソース間電圧は安定化される。つまり、定常状態においては、スイッチングトランジスタ19のオン・オフの状態によらず、上記信号電流が安定化される。
上述した動作により、発光画素40が1水平期間の時間で定常状態に到達するならば、走査線18の走査信号波形およびタイミングは、同列で後段の発光画素に接続された走査線17の走査信号波形およびタイミングと共通化することが可能となる。
図11は、本発明の実施の形態3に係る表示部における発光画素の変形例を示す回路構成及びその周辺回路との接続を示す図である。同図における発光画素10Aは、スイッチングトランジスタ11A、12A及び19Aと、静電保持容量13A及び41Aと、駆動トランジスタ14Aと、有機EL素子15Aと、信号線16と、走査線17A及び17Bと、参照電源線20と、正電源線21と、負電源線22とを備える。また、発光画素10Bは、スイッチングトランジスタ11B、12B及び19Bと、静電保持容量13B及び41Bと、駆動トランジスタ14Bと、有機EL素子15Bと、信号線16と、走査線17B及び17Cと、参照電源線20と、正電源線21と、負電源線22とを備える。また、周辺回路は、走査線駆動回路4と、信号線駆動回路5とを備える。
発光画素10A及び10Bの回路構成および各回路構成要素の機能は、図8に記載された発光画素40と同様であるので、説明を省略する。
発光画素10Bは、発光画素10Aと同じ画素列で、かつ、発光画素10Aの一行後段に配置されている。
発光画素10Aに接続された走査線17Bは、発光画素10Bにも接続されている。
次に、本実施の形態に係る画像表示装置の制御方法の変形例について図12及び図13を用いて説明する。
図12は、本発明の実施の形態3に係る画像表示装置における発光画素の制御方法の変形例を示す動作タイミングチャートである。また、図13は、本発明の実施の形態3に係る画像表示装置の発光画素の変形例を示す動作フローチャートである。
まず、時刻t30において、走査線駆動回路4は、走査線17Aの電圧レベルをLOWからHIGHに変化させ、スイッチングトランジスタ11A及び12Aをオン状態とする。このとき、静電保持容量13Aの第1電極である電極131Aには参照電源線20の参照電圧VREFが印加され、第2電極である電極132Aには信号線16より信号電圧VAdataが印加される(図13のS41)。
時刻t30〜時刻t31の期間、走査線17Aの電圧レベルがHIGHであるので、画素Aである発光画素10Aの電極132Aには信号線16から信号電圧VAdataが印加され、同様に、発光画素10Aを含む画素行に属する各発光画素に対し信号電圧が供給される。
この期間において、静電保持容量13Aには、信号電圧VAdataに対応した正確な電位が書き込まれる。
次に、時刻t31において、走査線駆動回路4は、走査線17Aの電圧レベルをHIGHからLOWに変化させ、スイッチングトランジスタ11A及び12Aをオフ状態とする。これにより、静電保持容量13Aの電極131Aと参照電源線20とは非導通となり、かつ、静電保持容量13Aの電極132Aと信号線16とは非導通となる(図13のS42)。
時刻t31から微小時間経過したt31’において、走査線駆動回路4は、走査線17Bの電圧レベルをLOWからHIGHに変化させ、スイッチングトランジスタ19Aをオン状態とする。これにより、駆動トランジスタ14Aのソースと静電保持容量13Aの電極132Aとは導通する(図13のS42)。また、静電保持容量13Aの電極131Aは、参照電源線20と遮断され、電極132Aは信号線16と遮断されている。よって、駆動トランジスタ14Aのゲート電位は変化し、(VREF−VAdata)に対応した信号電流が有機EL素子15Aに流れる。
また、時刻t31’において、走査線駆動回路4は、走査線17Bの電圧レベルをLOWからHIGHに変化させることにより、画素Bである発光画素10Bにおけるスイッチングトランジスタ11B及び12Bをオン状態とする。このとき、静電保持容量13Bの第1電極である電極131Bには参照電源線20の参照電圧VREFが印加され、第2電極である電極132Bには信号線16より信号電圧VBdataが印加される(図13のS42)。
時刻t31〜時刻t32の期間、走査線17Bの電圧レベルがHIGHであるので、発光画素10Bの電極132Bには信号線16から信号電圧VBdataが印加され、同様に、発光画素10Bを含む画素行に属する各発光画素に対し信号電圧が供給される。
この期間において、静電保持容量13Bには、信号電圧VBdataに対応した正確な電位が書き込まれる。
またこの期間、発光画素10Aにおける駆動トランジスタ14Aのゲート−ソース間には、静電保持容量13Aの両端電圧である(VREF−VAdata)が印加され続け、駆動電流が流れることにより有機EL素子15Aは発光を持続する。
次に、時刻t32において、走査線駆動回路4は、走査線17Bの電圧レベルをHIGHからLOWに変化させ、スイッチングトランジスタ19Aをオフ状態とする(図13のS43)。このとき、スイッチングトランジスタ19Aがオフ状態となっても、駆動トランジスタ14Aのソース電位を静電保持容量41Aが記憶している。よって、駆動トランジスタ14Aのゲート−ソース間電圧は安定化される。つまり、スイッチングトランジスタ19Aのオン・オフの状態によらず、発光画素10Aの信号電流が安定化される。
また、時刻t32において、走査線17Bの電圧レベルがHIGHからLOWに変化することにより、スイッチングトランジスタ11B及び12Bがオフ状態となる。これにより、静電保持容量13Bの電極131Bと参照電源線20とは非導通となり、かつ、静電保持容量13Bの電極132Bと信号線16とは非導通となる(図13のS43)。
また、時刻t32から微小時間経過したt32’において、走査線駆動回路4は、走査線17Cの電圧レベルをLOWからHIGHに変化させ、スイッチングトランジスタ19Bをオン状態とする。これにより、駆動トランジスタ14Bのソースと静電保持容量13Bの電極132Bとは導通する(図13のS43)。また、静電保持容量13Bの電極131Bは、参照電源線20と遮断され、電極132Bは信号線16と遮断されている。よって、駆動トランジスタ14Bのゲート電位は変化し、(VREF−VBdata)に対応した駆動電流が有機EL素子15Bに流れる。
時刻t32〜時刻t33の期間、発光画素10Bにおける駆動トランジスタ14Bのゲート−ソース間には、静電保持容量13Bの両端電圧である(VREF−VBdata)が印加され続け、駆動電流が流れることにより有機EL素子15Bは発光を持続する。
次に、時刻t33において、走査線駆動回路4は、走査線17Cの電圧レベルをHIGHからLOWに変化させ、スイッチングトランジスタ19Bをオフ状態とする。このとき、スイッチングトランジスタ19Bがオフ状態となっても、駆動トランジスタ14Bのソース電位を静電保持容量41Bが記憶している。よって、駆動トランジスタ14Bのゲート−ソース間電圧は安定化される。つまり、スイッチングトランジスタ19Bのオン・オフの状態によらず、発光画素10Bの信号電流が安定化される。
上述したt30〜t33の動作を、同列かつ後段である発光画素へと順次繰り返すことにより、一定の遅延時間をもって行毎に発光することが可能となる。
以上のように、第2コンデンサである静電保持容量41が発光画素10へ配置されることにより、スイッチングトランジスタ19のオン・オフ状態によらず安定発光が持続されるので、画素列において隣接する発光画素間で走査線を共用することが可能となる。よって、スイッチングトランジスタを制御する走査線の本数を削減することができるので、画像表示装置としての回路構成を簡略化することが可能となる。また、上記走査信号を出力する駆動回路の簡略化も実現できる。
以上のように、実施の形態1〜3で述べた簡単な画素回路を構成することにより、ソース接地動作するn型駆動TFTのゲート−ソース間に印加すべき電圧を保持するコンデンサの両端電極に、信号電圧に対応した正確な電位を記録することが可能となる。よって、映像信号を反映した高精度な画像表示をすることが可能となる。さらに、上記n型駆動TFTのソース電位を記憶する第2コンデンサが配置されることにより、当該n型駆動TFTのゲート−ソース間電圧は安定に保たれるので駆動電流の安定化、つまり安定な発光動作が可能となる。
なお、本発明に係る画像表示装置は、上述した実施の形態に限定されるものではない。実施の形態1〜3およびそれらの変形例における任意の構成要素を組み合わせて実現される別の実施形態や、実施の形態1〜3およびそれらの変形例に対して本発明の主旨を逸脱しない範囲で当業者が思いつく各種変形を施して得られる変形例や、本発明に係る表示装置を内蔵した各種機器も本発明に含まれる。
例えば、実施の形態2および実施の形態3を組み合わせた画素回路も、本発明に含まれる。図14は、本発明の実施の形態2及び3を組み合わせた発光画素の回路構成及びその周辺回路との接続を示す図である。同図に記載された発光画素50は、スイッチングトランジスタ19、31及び32と、静電保持容量13及び51と、駆動トランジスタ14と、有機EL素子15と、信号線16と、走査線17及び18と、参照電源線20と、正電源線21と、負電源線22とを備える。また、周辺回路は、走査線駆動回路4と、信号線駆動回路5とを備える。
発光画素50は、図8に記載された実施の形態3に係る発光画素40と比較して、静電保持容量13の両端電極へのスイッチングトランジスタの接続のみが構成として異なる。
静電保持容量51は、静電保持容量13の電極132と参照電源線20との間に接続された第2コンデンサであり、実施の形態3の発光画素40の有する静電保持容量41と同様に、駆動トランジスタ14のゲート−ソース間電圧を安定化させる機能を有する。
よって発光画素50の回路構成を有する表示部においても、図11に記載されたような隣接する発光画素間での走査線の共用化が実現できる。よって、実施の形態3と同様に、スイッチングトランジスタを制御する走査線の本数を削減することができるので、画像表示装置としての回路構成を簡略化することが可能となる。
なお、静電保持容量51は、スイッチングトランジスタ32のソース及びドレインの一方が接続されている参照電源線20と異なる参照電源線に接続されていてもよい。例えば正電源線VDDや負電源線VEEであっても良い。この場合、レイアウトの自由度が向上し、素子間のスペースをより広く確保することが可能になり、歩留まりが向上する。
なお、実施の形態1〜3を通じて、スイッチングトランジスタ12及び32(第1スイッチング素子)と、スイッチングトランジスタ11及び31(第2スイッチング素子)とを同一の走査線17にて同様に制御したが、当該第1スイッチング素子と当該第2スイッチング素子とをそれぞれ異なる走査線(第1走査線と第2走査線)にて、独立にオン・オフ制御してもよい。この場合、信号線16から静電保持容量13(コンデンサ)への信号電圧の印加と、参照電源線20から静電保持容量13への参照電圧の印加とが独立にタイミング制御される。これによっても、1フレーム内における発光のDuty制御を実行することが可能となる。
なお、以上述べた実施の形態では、スイッチングトランジスタのゲートの電圧レベルがHIGHの場合にオン状態になるn型トランジスタとして記述しているが、これらをp型トランジスタで形成し、走査線の極性を反転させた画像表示装置でも、上述した各実施の形態と同様の効果を奏する。
また、本発明に係る実施の形態では、スイッチングトランジスタは、ゲート、ソース及びドレインを有するFETであることを前提として説明してきたが、これらのトランジスタには、ベース、コレクタ及びエミッタを有するバイポーラトランジスタが適用されてもよい。この場合にも、本発明の目的が達成され同様の効果を奏する。
また、例えば、本発明に係る表示装置は、図15に記載されたような薄型フラットTVに内蔵される。本発明に係る画像表示装置が内蔵されることにより、映像信号を反映した高精度な画像表示が可能な薄型フラットTVが実現される。
本発明は、特に、画素信号電流により画素の発光強度を制御することで輝度を変動させるアクティブ型の有機ELフラットパネルディスプレイに有用である。
1 画像表示装置
2 制御回路
3 メモリ
4 走査線駆動回路
5 信号線駆動回路
6 表示部
10、10A、10B、30、40、50 発光画素
11、11A、11B、12、12A、12B、19、19A、19B、31、32 スイッチングトランジスタ
13、13A、13B、41、41A、41B、51 静電保持容量
14、14A、14B 駆動トランジスタ
15、15A、15B、505 有機EL素子
16、506 信号線
17、17A、17B、17C、18 走査線
20 参照電源線
21 正電源線
22 負電源線
131、131A、131B、132、132A、132B 電極
500 画素部
501 第1スイッチング素子
502 第2スイッチング素子
503 容量素子
504 n型薄膜トランジスタ(n型TFT)
507 第1走査線
508 第2走査線
509 第3スイッチング素子

Claims (16)

  1. 発光素子と、
    電圧を保持するコンデンサと、
    ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、
    第1電極が前記コンデンサの第2電極に接続された第2コンデンサと、
    前記駆動素子のドレイン電極の電位を決定するための第1電源線と、
    前記発光素子の第2電極に電気的に接続された第2電源線と、
    前記コンデンサの第1電極の電圧値を規定する参照電圧を供給する第3電源線と、
    前記第2コンデンサの第2電極の電圧値を規定する第2参照電圧を供給する第4電源線と、
    前記コンデンサの第1電極に前記参照電圧を設定するための第1スイッチング素子と、
    前記コンデンサの第2電極に信号電圧を供給するデータ線と、
    一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第2電極に電気的に接続され、前記データ線と前記コンデンサの第2電極との導通及び非導通を切り換える第2スイッチング素子と、
    前記発光素子の第1電極と、前記コンデンサの第2電極とを接続するための第3スイッチング素子と、
    前記第1スイッチング素子、前記第2スイッチング素子及び前記第3スイッチング素子を制御する駆動回路と、を備え、
    前記駆動回路は、
    前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させ、
    前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONし、
    前記第3スイッチング素子がONしている間に、前記第2コンデンサに前記駆動素子のソース電位を保持させる
    画像表示装置。
  2. 前記発光素子の第1電極はアノード電極であり、前記発光素子の第2電極はカソード電極であり、
    前記第1電源線の電圧は、前記第2電源線の電圧より高く、前記第1電源線から前記第2電源線に向けて電流が流れる
    請求項1に記載の画像表示装置。
  3. 前記第1スイッチング素子と前記駆動回路とを接続し、前記第1スイッチング素子を制御する信号を前記第1スイッチング素子に伝達する第1走査線と、
    前記第2スイッチング素子と前記駆動回路とを接続し、前記第2スイッチング素子を制御する信号を前記第2スイッチング素子に伝達する第2走査線と、
    前記第3スイッチング素子と前記駆動回路とを接続し、前記第3スイッチング素子を制御する信号を前記第3スイッチング素子に伝達する第3走査線とを備える
    請求項1又は請求項2に記載の画像表示装置。
  4. 前記第1走査線と前記第2走査線とは共通の走査線である
    請求項3に記載の画像表示装置。
  5. 前記第3電源線と前記第4電源線とは共通の電源線である
    請求項1に記載の画像表示装置。
  6. 前記第3電源線と前記第4電源線とは別個の電源線である
    請求項1に記載の画像表示装置。
  7. 発光素子と、
    電圧を保持するコンデンサと、
    ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、
    第1電極が前記コンデンサの第2電極に接続された第2コンデンサと、
    前記駆動素子のドレイン電極の電位を決定するための第1電源線と、
    前記発光素子の第2電極に電気的に接続された第2電源線と、
    前記コンデンサの第2電極の電圧値を規定する参照電圧を供給する第3電源線と、
    前記第2コンデンサの第2電極の電圧値を規定する第2参照電圧を供給する第4電源線と、
    前記コンデンサの第2電極に前記参照電圧を設定するための第1スイッチング素子と、
    前記コンデンサの第1電極に信号電圧を供給するデータ線と、
    一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第1電極に電気的に接続され、前記データ線と前記コンデンサの第1電極との導通及び非導通を切り換える第2スイッチング素子と、
    前記発光素子の第1電極と、前記コンデンサの第2電極とを接続するための第3スイッチング素子と、
    前記第1スイッチング素子、前記第2スイッチング素子及び前記第3スイッチング素子を制御する駆動回路と、を備え、
    前記駆動回路は、
    前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させ、
    前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONし、
    前記第3スイッチング素子がONしている間に、前記第2コンデンサに前記駆動素子のソース電位を保持させる
    画像表示装置。
  8. 前記発光素子の第1電極はアノード電極であり、前記発光素子の第2電極はカソード電極であり、
    前記第1電源線の電圧は、前記第2電源線の電圧より高く、前記第1電源線から前記第2電源線に向けて電流が流れる
    請求項に記載の画像表示装置。
  9. 前記第1スイッチング素子と前記駆動回路とを接続し、前記第1スイッチング素子を制御する信号を前記第1スイッチング素子に伝達する第1走査線と、
    前記第2スイッチング素子と前記駆動回路とを接続し、前記第2スイッチング素子を制御する信号を前記第2スイッチング素子に伝達する第2走査線と、
    前記第3スイッチング素子と前記駆動回路とを接続し、前記第3スイッチング素子を制御する信号を前記第3スイッチング素子に伝達する第3走査線とを備える
    請求項又は請求項に記載の画像表示装置。
  10. 前記第1走査線と前記第2走査線とは共通の走査線である
    請求項に記載の画像表示装置。
  11. 前記第3電源線と前記第4電源線とは共通の電源線である
    請求項に記載の画像表示装置。
  12. 前記第3電源線と前記第4電源線とは別個の電源線である
    請求項に記載の画像表示装置。
  13. 複数の画素部を有する画像表示装置であって、
    前記複数の画素部の中の隣接する第1画素部と第2画素部とは、それぞれ、
    発光素子と、
    電圧を保持するコンデンサと、
    ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、
    第1電極が前記コンデンサの第2電極に接続された第2コンデンサと、
    前記駆動素子のドレイン電極の電位を決定するための第1電源線と、
    前記発光素子の第2電極に電気的に接続された第2電源線と、
    前記コンデンサの第1電極の電圧値を規定する参照電圧を供給する第3電源線と、
    前記第2コンデンサの第2電極の電圧値を規定する第2参照電圧を供給する第4電源線と、
    前記コンデンサの第1電極に前記参照電圧を設定するための第1スイッチング素子と、
    前記コンデンサの第2電極に信号電圧を供給するデータ線と、
    一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第2電極に電気的に接続され、前記データ線と前記コンデンサの第2電極との導通及び非導通を切り換える第2スイッチング素子と、
    前記発光素子の第1電極と前記コンデンサの第2電極とを接続するための第3スイッチング素子と、
    前記第1スイッチング素子を制御する信号を前記第1スイッチング素子に伝達する第1走査線と、
    前記第2スイッチング素子を制御する信号を前記第2スイッチング素子に伝達する第2走査線と、
    前記第3スイッチング素子を制御する信号を前記第3スイッチング素子に伝達する第3走査線と、を備え、
    前記画像表示装置は、
    前記第1走査線を介して前記第1スイッチング素子に接続され、前記第2走査線を介して前記第2スイッチング素子に接続され、前記第3走査線を介して前記第3スイッチング素子に接続され、前記第1スイッチング素子、前記第2スイッチング素子及び前記第3スイッチング素子を制御する駆動回路を備え、
    前記駆動回路は、
    前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させ、
    前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONし、
    前記第3スイッチング素子がONしている間に、前記第2コンデンサに前記駆動素子のソース電位を保持させ、
    前記第1画素部に含まれる前記第1走査線と、前記第1画素部に含まれる前記第2走査線と、前記第2画素部に含まれる前記第3走査線とは、前記駆動回路からの共通の走査線から分岐している
    画像表示装置。
  14. 前記発光素子は、有機EL発光素子である
    請求項1〜請求項13のうちいずれか1項に記載の画像表示装置。
  15. 発光素子と、
    電圧を保持するコンデンサと、
    ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、
    第1電極が前記コンデンサの第2電極に接続された第2コンデンサと、
    前記駆動素子のドレイン電極の電位を決定するための第1電源線と、
    前記発光素子の第2電極に電気的に接続された第2電源線と、
    前記コンデンサの第1電極の電圧値を規定する参照電圧を供給する第3電源線と、
    前記第2コンデンサの第2電極の電圧値を規定する第2参照電圧を供給する第4電源線と、
    前記コンデンサの第1電極に前記参照電圧を設定するための第1スイッチング素子と、
    前記コンデンサの第2電極に信号電圧を供給するデータ線と、
    一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第2電極に電気的に接続され、前記データ線と前記コンデンサの第2電極との導通及び非導通を切り換える第2スイッチング素子と、
    前記発光素子の第1電極と前記コンデンサの第2電極とを接続するための第3スイッチング素子とを備えた画像表示装置の制御方法であって、
    前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させる第1ステップと、
    前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONさせる第2ステップと、
    前記第3スイッチング素子がONしている間に、前記第2コンデンサに前記駆動素子のソース電位を保持させる第3ステップと、を含む
    画像表示装置の制御方法。
  16. 発光素子と、
    電圧を保持するコンデンサと、
    ゲート電極が前記コンデンサの第1電極に接続され、ソース電極が前記発光素子の第1電極に接続され、前記コンデンサに保持された電圧に応じたドレイン電流を前記発光素子に流すことにより前記発光素子を発光させる駆動素子と、
    第1電極が前記コンデンサの第2電極に接続された第2コンデンサと、
    前記駆動素子のドレイン電極の電位を決定するための第1電源線と、
    前記発光素子の第2電極に電気的に接続された第2電源線と、
    前記コンデンサの第2電極の電圧値を規定する参照電圧を供給する第3電源線と、
    前記第2コンデンサの第2電極の電圧値を規定する第2参照電圧を供給する第4電源線と、
    前記コンデンサの第2電極に前記参照電圧を設定するための第1スイッチング素子と、
    前記コンデンサの第1電極に信号電圧を供給するデータ線と、
    一方の端子が前記データ線に電気的に接続され、他方の端子が前記コンデンサの第1電極に電気的に接続され、前記データ線と前記コンデンサの第1電極との導通及び非導通を切り換える第2スイッチング素子と、
    前記発光素子の第1電極と、前記コンデンサの第2電極とを接続するための第3スイッチング素子とを備えた画像表示装置の制御方法であって、
    前記第3スイッチング素子をOFFしている間に、前記第1スイッチング素子及び前記第2スイッチング素子をONして前記信号電圧に対応する電圧を前記コンデンサに保持させる第1ステップと、
    前記信号電圧に対応する電圧が前記コンデンサに保持された後、前記第1スイッチング素子及び前記第2スイッチング素子をOFFして前記第3スイッチング素子をONさせる第2ステップと、
    前記第3スイッチング素子がONしている間に、前記第2コンデンサに前記駆動素子のソース電位を保持させる第3ステップと、を含む
    画像表示装置の制御方法。
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011164641A (ja) * 2008-10-07 2011-08-25 Panasonic Corp 画像表示装置およびその制御方法
WO2013021417A1 (ja) * 2011-08-09 2013-02-14 パナソニック株式会社 表示装置

Families Citing this family (36)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5359141B2 (ja) * 2008-02-06 2013-12-04 セイコーエプソン株式会社 電気光学装置、その駆動方法、電子機器
CN102150196B (zh) * 2009-09-08 2013-12-18 松下电器产业株式会社 显示面板装置以及其控制方法
KR101591556B1 (ko) 2009-12-09 2016-02-03 가부시키가이샤 제이올레드 표시 장치 및 그 제어 방법
KR101142660B1 (ko) 2010-02-09 2012-05-03 삼성모바일디스플레이주식회사 화소 및 이를 이용한 유기전계발광 표시장치
CN102405492B (zh) * 2010-04-05 2015-07-15 株式会社日本有机雷特显示器 有机电致发光显示装置及其控制方法
JP5414808B2 (ja) * 2010-09-06 2014-02-12 パナソニック株式会社 表示装置およびその駆動方法
JP5415565B2 (ja) * 2010-09-06 2014-02-12 パナソニック株式会社 表示装置およびその駆動方法
JP5627694B2 (ja) * 2010-09-06 2014-11-19 パナソニック株式会社 表示装置
KR101383976B1 (ko) 2010-09-06 2014-04-10 파나소닉 주식회사 표시 장치 및 그 제어 방법
KR101319702B1 (ko) 2010-09-06 2013-10-29 파나소닉 주식회사 표시 장치 및 그 제어 방법
KR101868640B1 (ko) * 2011-07-25 2018-06-18 가부시키가이샤 제이올레드 표시 장치 및 표시 장치의 구동 방법
KR101842722B1 (ko) 2011-08-09 2018-03-27 가부시키가이샤 제이올레드 표시 장치
JP5781544B2 (ja) * 2011-08-09 2015-09-24 株式会社Joled 画像表示装置
JP5832399B2 (ja) 2011-09-16 2015-12-16 株式会社半導体エネルギー研究所 発光装置
JP5927484B2 (ja) * 2011-11-10 2016-06-01 株式会社Joled 表示装置及びその制御方法
WO2013076774A1 (ja) * 2011-11-24 2013-05-30 パナソニック株式会社 表示装置及びその制御方法
JP5756865B2 (ja) 2011-11-24 2015-07-29 株式会社Joled 表示装置及びその制御方法
KR101399159B1 (ko) * 2011-12-01 2014-05-28 엘지디스플레이 주식회사 유기발광 표시장치
JPWO2013118219A1 (ja) 2012-02-08 2015-05-11 パナソニック株式会社 El表示装置およびその製造方法
JP6128738B2 (ja) * 2012-02-28 2017-05-17 キヤノン株式会社 画素回路及びその駆動方法
WO2013171936A1 (ja) * 2012-05-15 2013-11-21 パナソニック株式会社 表示装置
JPWO2013171938A1 (ja) 2012-05-16 2016-01-07 株式会社Joled 表示装置
KR20130140445A (ko) * 2012-06-14 2013-12-24 삼성디스플레이 주식회사 표시장치, 전원제어장치 및 그 구동 방법
CN103198794B (zh) * 2013-03-29 2015-12-02 京东方科技集团股份有限公司 像素电路及其驱动方法、有机发光显示面板及显示装置
CN103310732B (zh) * 2013-06-09 2015-06-03 京东方科技集团股份有限公司 一种像素电路及其驱动方法、显示装置
TWI534789B (zh) * 2013-09-13 2016-05-21 國立交通大學 一種主動矩陣顯示器裝置的畫素電路及其驅動方法
CN104680968B (zh) * 2013-11-27 2017-08-29 北京大学深圳研究生院 像素电路及其显示装置和一种像素电路驱动方法
KR102296945B1 (ko) * 2014-07-04 2021-09-01 엘지디스플레이 주식회사 유기 발광 표시 장치 및 그 제조 방법
CN104318897B (zh) * 2014-11-13 2017-06-06 合肥鑫晟光电科技有限公司 一种像素电路、有机电致发光显示面板及显示装置
KR102333868B1 (ko) * 2014-12-10 2021-12-07 엘지디스플레이 주식회사 Oled 표시 장치
CN104409047B (zh) * 2014-12-18 2017-01-18 合肥鑫晟光电科技有限公司 像素驱动电路、像素驱动方法和显示装置
CN104882099B (zh) * 2015-06-10 2017-08-25 京东方科技集团股份有限公司 一种像素驱动电路、阵列基板和显示装置
TWI569252B (zh) * 2015-11-27 2017-02-01 友達光電股份有限公司 像素驅動電路及其驅動方法
KR102621678B1 (ko) * 2016-09-30 2024-01-09 삼성디스플레이 주식회사 표시 장치 및 그의 제조방법
CN109461424A (zh) * 2019-01-21 2019-03-12 惠科股份有限公司 一种显示面板的驱动电路、驱动方法及显示装置
CN110061035A (zh) * 2019-04-24 2019-07-26 合肥京东方卓印科技有限公司 阵列基板及显示装置

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001083924A (ja) * 1999-09-08 2001-03-30 Matsushita Electric Ind Co Ltd 電流制御型発光素子の駆動回路および駆動方法
JP2003186438A (ja) * 2001-12-19 2003-07-04 Hitachi Ltd 画像表示装置
JP2003208127A (ja) * 2001-11-09 2003-07-25 Sanyo Electric Co Ltd 表示装置
JP2004246204A (ja) * 2003-02-14 2004-09-02 Sony Corp 画素回路、表示装置、および画素回路の駆動方法
JP2006072303A (ja) * 2004-09-01 2006-03-16 Au Optronics Corp 有機発光表示装置およびその表示ユニット
JP2006301159A (ja) * 2005-04-19 2006-11-02 Seiko Epson Corp 電子回路、その駆動方法、電気光学装置および電子機器
JP2008203655A (ja) * 2007-02-21 2008-09-04 Sony Corp 表示装置及びその駆動方法

Family Cites Families (22)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20030103022A1 (en) 2001-11-09 2003-06-05 Yukihiro Noguchi Display apparatus with function for initializing luminance data of optical element
JP4484451B2 (ja) * 2003-05-16 2010-06-16 奇美電子股▲ふん▼有限公司 画像表示装置
JP3772889B2 (ja) 2003-05-19 2006-05-10 セイコーエプソン株式会社 電気光学装置およびその駆動装置
KR101057206B1 (ko) * 2004-04-30 2011-08-16 엘지디스플레이 주식회사 유기발광소자
US20060007070A1 (en) * 2004-06-02 2006-01-12 Li-Wei Shih Driving circuit and driving method for electroluminescent display
JP4645881B2 (ja) * 2004-07-08 2011-03-09 ソニー株式会社 画素回路及、アクティブマトリクス装置及び表示装置
KR101057275B1 (ko) * 2004-09-24 2011-08-16 엘지디스플레이 주식회사 유기발광소자
JP2006184576A (ja) 2004-12-27 2006-07-13 Toshiba Matsushita Display Technology Co Ltd 自発光型表示装置及びアレイ基板
JP2006276254A (ja) * 2005-03-28 2006-10-12 Sanyo Electric Co Ltd 発光回路および発光表示装置
TWI282537B (en) * 2005-04-21 2007-06-11 Au Optronics Corp Display units
KR101160830B1 (ko) * 2005-04-21 2012-06-29 삼성전자주식회사 표시 장치 및 그 구동 방법
US20070273618A1 (en) * 2006-05-26 2007-11-29 Toppoly Optoelectronics Corp. Pixels and display panels
KR101245218B1 (ko) 2006-06-22 2013-03-19 엘지디스플레이 주식회사 유기발광다이오드 표시소자
JP4887203B2 (ja) 2006-11-14 2012-02-29 三星モバイルディスプレイ株式會社 画素、有機電界発光表示装置、および有機電界発光表示装置の駆動方法
KR100926591B1 (ko) 2007-07-23 2009-11-11 재단법인서울대학교산학협력재단 유기 전계 발광 표시 장치
JP5254998B2 (ja) 2008-01-07 2013-08-07 パナソニック株式会社 表示装置及び駆動方法
KR20110011592A (ko) 2008-05-28 2011-02-08 파나소닉 주식회사 표시 장치, 표시 장치의 제조 방법 및 제어 방법
WO2009144913A1 (ja) 2008-05-29 2009-12-03 パナソニック株式会社 表示装置およびその駆動方法
JP5010030B2 (ja) 2008-07-04 2012-08-29 パナソニック株式会社 表示装置及びその制御方法
JP4972209B2 (ja) 2008-07-04 2012-07-11 パナソニック株式会社 表示装置及びその制御方法
WO2010041426A1 (ja) * 2008-10-07 2010-04-15 パナソニック株式会社 画像表示装置およびその制御方法
WO2010070798A1 (ja) 2008-12-18 2010-06-24 パナソニック株式会社 有機エレクトロルミネッセンス表示装置及びその製造方法

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001083924A (ja) * 1999-09-08 2001-03-30 Matsushita Electric Ind Co Ltd 電流制御型発光素子の駆動回路および駆動方法
JP2003208127A (ja) * 2001-11-09 2003-07-25 Sanyo Electric Co Ltd 表示装置
JP2003186438A (ja) * 2001-12-19 2003-07-04 Hitachi Ltd 画像表示装置
JP2004246204A (ja) * 2003-02-14 2004-09-02 Sony Corp 画素回路、表示装置、および画素回路の駆動方法
JP2006072303A (ja) * 2004-09-01 2006-03-16 Au Optronics Corp 有機発光表示装置およびその表示ユニット
JP2006301159A (ja) * 2005-04-19 2006-11-02 Seiko Epson Corp 電子回路、その駆動方法、電気光学装置および電子機器
JP2008203655A (ja) * 2007-02-21 2008-09-04 Sony Corp 表示装置及びその駆動方法

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011164641A (ja) * 2008-10-07 2011-08-25 Panasonic Corp 画像表示装置およびその制御方法
WO2013021417A1 (ja) * 2011-08-09 2013-02-14 パナソニック株式会社 表示装置
JPWO2013021417A1 (ja) * 2011-08-09 2015-03-05 パナソニック株式会社 表示装置

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