JP2867539B2 - サーマルラインプリンタ - Google Patents

サーマルラインプリンタ

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JP2867539B2
JP2867539B2 JP2242390A JP2242390A JP2867539B2 JP 2867539 B2 JP2867539 B2 JP 2867539B2 JP 2242390 A JP2242390 A JP 2242390A JP 2242390 A JP2242390 A JP 2242390A JP 2867539 B2 JP2867539 B2 JP 2867539B2
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Description

【発明の詳細な説明】 産業上の利用分野 本発明は、サーマルヘッドに適切なエネルギーを印加
し、更にサーマルヘッドへの印字データ転送の高速性が
得られるサーマルラインプリンタに関する。
従来の技術 近年、サーマルラインプリンタは印字速度の高速性お
よび高印字品質が常に要求されている。以下に従来のサ
ーマルラインプリンタについて説明する。
ライン型サーマルヘッドへの印加エネルギー制御は第
９図A,B図に示すようにサーマルヘッドの発熱素子の熱
時定数を利用してサーマルヘッドへの印加エネルギーを
制御する方法か、マイクロコンピュータ内部のソフト計
算によりサーマルヘッドへ補正印字データを転送する方
法か、または多数のシフトレジスタで補正印字データ発
生回路を構成するものであった。
発明が解決しようとする課題 しかしながら、上記の従来の構成、その中でも第９図
を利用したサーマルヘッドの蓄熱制御は、サーマルヘッ
ドへの印加パルスが１ドットライン一括に印加されるた
め、サーマルヘッドの１ドットライン単位の蓄熱の影響
はなくすことができても発熱素子１つ１つに注目すれば
蓄熱の影響はなくならず、１ドットごとに発色サイズの
異なったドットが印字され印字品質が著しく低下する。
また、マイクロコンピュータのソフト計算による方法
は現在の印字データと過去の印字データとの補正印字デ
ータをソフト的に計算して作成するため、データ処理時
間が非常に長くかかり印字速度の高速性は得られない。
また、多数のシフトレジスタを利用する方法は制御回路
のコストが非常に高くなるとともに、シフトレジスタを
取付けるための実装スペースを多く必要とするなどの問
題点を有していた。あるいは、ゲートアレイ化のように
大きな投資を必要としていた。
本発明は、上記問題点を解決するために、サーマルヘ
ッドの蓄熱制御に必要な印字データの記憶や低容量の外
部メモリ１つのみで行い、マイクロコンピュータの制御
効率を上げるため印字データの処理および外部メモリの
制御の大部分をハードウエアで行い、低コストで高印字
品質、更に高速印字を実現できるサーマルラインプリン
タを提供することを目的とする。
課題を解決するための手段 上記目的を達成するために、本発明のサーマルライン
プリンタは、ホストまたはマイクロコンピュータから出
力されたパラレルの印字データをシリアルの印字データ
に変換するパラレルシリアル変換器と、このパラレルシ
リアル変換器からの２ドットライン分以上の印字データ
を補正印字データとして記憶するとともにその書込みと
読み出しが非同期に行える外部メモリと、この外部メモ
リおよび前記パラレルシリアル変換器の動作を制御する
コントロール回路と、前記パラレルシリアル変換器から
直接転送されるシリアル印字データまたは前記外部メモ
リを介して転送される種々のシリアル印字データのいず
れかを選択してサーマルヘッドに転送する補正印字デー
タの選択回路と、前記パラレルシリアル変換器で変換さ
れたシリアルの印字データ数をカウントし所定の印字デ
ータ数をカウントした時点で前記コントロール回路から
前記外部メモリへの制御信号を停止させる第１のカウン
ターと、前記外部メモリから前記サーマルヘッドに転送
する補正印字データ数をカウントし所定の補正印字デー
タ数カウントした時点で前記コントロール回路から前記
外部メモリへの制御信号を停止させる第２のカウンター
とを備えたものである。
また、本発明においては、ホストまたはマイクロコン
ピュータから出力されたパラレルの印字データをシリア
ルの印字データに変換するパラレルシリアル変換器と、
このパラレルシリアル変換器からの２ドットライン分以
上の印字データを補正印字データとして記憶するととも
にその書き込みと読み出しが非同期に行える外部メモリ
と、この外部メモリの読み出しと書き込みのタイミング
を制御する制御回路と、前記パラレルシリアル変換器か
ら直接転送されるシリアル印字データまたは前記外部メ
モリを介して転送される種々のシリアル印字データのい
ずれかを選択してサーマルヘッドに転送する補正印字デ
ータの選択回路と、前記パラレルシリアル変換器で変換
されたシリアルの印字データ数をカウントする第１のカ
ウンターと、この第１のカウンターの出力によりパラレ
ルシリアル変換器と前記外部メモリの書き込みを停止さ
せる第１の外部クロック停止回路と、前記外部メモリか
ら前記サーマルヘッドに転送する補正印字データ数をカ
ウントする第２のカウンターと、この第２のカウンター
の出力によりサーマルヘッドへの印字データ転送を停止
させる第２の外部クロック停止回路とを備えたものであ
る。
作用 本発明は、ハードウエア上で、１ワード毎にパラレル
シリアル変換を行い、サーマルヘッドに印字データを転
送しながらメモリ内の印字データの書き換えを行うか、
またはハードウエア上で、メモリ内部の印字データをサ
ーマルヘッドに補正印字データとして転送するという２
種類の動作を行う。また、サーマルヘッドへのデータ転
送は、ハードウエア上で１ワードまたは１ドットライン
毎に行われる。このように補正印字データをサーマルヘ
ッドに加えることによって、発熱素子１つ１つへの印加
エネルギーの大きさを発色の前歴の組合せによって可変
することができ、適切なエネルギーをサーマルヘッドに
印加することができる。更にサーマルヘッドへの補正印
字データ転送速度を高速にすることができる。
実施例 以下本発明の一実施例について、図面を参考にしなが
ら説明する。
実施例１ 第１図は本発明の一実施例を示す構成図で、１はマイ
クロコンピュータ、２はホストまたはマイクロコンピュ
ータ１から出力された現在の印字データ（パラレルデー
タ）をシリアルデータに変換するパラレルシリアル変換
器、３はこのパラレルシリアル変換器２を介してホスト
またはマイクロコンピュータ１から出力された現在の印
字データを記憶、または記憶しておいた現在および過去
の印字データを出力する外部メモリ（RAM）、４は外部
メモリ３の書き込み、読み出しのアドレスの初期値設定
または書き込みアドレス用クロック、読み出しアドレス
用クロックおよびパラレルシリアル変換用クロックの制
御などを行う外部メモリコントロール回路、5,6は外部
メモリ３またはパラレルシリアル変換器２から出力され
た印字データの個数を監視するカウンターであり、カウ
ンター５はパラレルシリアル変換器２で変換されるシリ
アルデータの個数を監視する８ビット監視用カウンター
であり、カウンター６はサーマルヘッド13に転送された
補正印字データの数を監視する１ドットライン監視用カ
ウンターである。
７は各種の補正印字データを選択してサーマルヘッド
13に転送する補正印字データ選択回路、8,9はインバー
タ、10,11はANDゲート、12は外部クロック発生用発振回
路、13はライン型のサーマルヘッドである。
ここで、外部メモリ３についての詳細を説明すると、
外部メモリ３は、書き込みと読み出しのアドレスの初期
値が外部から設定されそのアドレスを外部クロックによ
り順次カウントする書き込み，読み出し独立のアドレス
発生用カウンターを内蔵し、書き込み，読み出しの非同
期動作が可能なものである。もちろん、アドレス発生用
カウンターは内蔵されてなくても良い。
以上のように構成されたサーマルラインプリンタの制
御回路について、以下に第１図の構成図と第２図の動作
全体のタイミングチャートおよび第３図のRAMのメモリ
ーマップを用いて説明する。
ここでは、２ドットライン過去までの印字データを使
用してサーマルヘッドを制御する方法を説明する。
まず、第２図において、ホストまたはマイクロコンピ
ュータ１からの現在の印字データをサーマルヘッド12に
転送するし、それが１ドットライン分終了すると、ラ
ッチパルスを出力してサーマルヘッド13への補正印字
データを保持する。ここで保持されたデータはヘッドス
トローブのONの間にデータ“1"ならば発色有り、デー
タ“0"ならば発色なしの動作を行う。
次に前記ラッチパルスを出力した後、現在の印字デ
ータと１ドットライン過去の印字データの反転データと
の論理積である補正印字データをサーマルヘッド13に１
ドットライン分転送し、ヘッドストローブがONから
OFFになると、これと同時にラッチパルスを出力して
サーマルヘッド13への補正印字データを保持する。ここ
で保持された補正印字データはヘッドストローブのON
の間にデータ“1"ならば発色あり、データ“0"ならば発
色なしの動作を行う。
次に前記ラッチパルスを出力した後、現在の印字デ
ータと２ドットライン過去の印字データの反転データと
の論理積である補正印字データをサーマルヘッド13に転
送し、ヘッドストローブがONからOFFになると、こ
れと同時にラッチパルスを出力してサーマルヘッド13
への補正印字データを保持する。ここで保持された補正
印字データは、ヘッドストローブのONの間にデータ
“1"ならば発色あり、データ“0"ならば発色なしの動作
を行う。
次に最初の現在の印字データ転送に戻り前記動作を
繰り返す。
次に、上記動作について、さらに詳細に説明する。
第２図において、現在の補正印字データ転送は、ま
ず第１図のマイクロコンピュータ１またはホストからの
現在の印字データをパラレルシリアル変換器２に転送
し、そこで保持する。そして、パラレルシリアル変換器
２では、外部メモリコントロール回路４から出力される
パラレルシリアル変換用外部クロックに同期させてパラ
レルデータをシリアルデータに変換し、このシリアルデ
ータに変換された新しい現在の印字データを補正印字デ
ータ選択回路７に転送しながら、外部メモリ３の最下位
ビット（現在の印字データ格納空間）に、アドレスの０
番地から書き込んで行く。この時の外部メモリ３の書き
込み用アドレスは、外部メモリコントロール回路４から
出力されるライト用外部クロックに同期して変化する。
この場合、外部メモリ３は、書き込みと読み出しが非
同期に行えるメモリのため、前記書き込み動作以前に外
部メモリ３の最下位ビットに書き込まれてあった古い印
字データ１ビットをアドレスの０番地から先に読み出し
ておいて、新しい印字データが書き込まれると同時に、
外部メモリ３の最下位ビットから１つ上位のビット（１
ドットライン過去の印字データ格納空間）に１ドットラ
イン過去の印字データとして書き込んで行く。これと同
時に、前記書き込み動作以前に外部メモリ３の最下位ビ
ットから１つ上位のビットに書き込まれてあった１ドッ
トライン過去の印字データ１ビットを先に読み出してお
いて、外部メモリ３の最下位ビットから２つ上位のビッ
ト（２ドットライン過去の印字データ格納空間）に２ド
ットライン過去の印字データとして書き込んで行く。
上記動作を１バイト分終了すると、８ビット監視用カ
ウンターであるカウンター５がカウントアップし、外部
メモリコントロール回路４から出力される全ての外部ク
ロックを停止させ、そして次の印字データをパラレルシ
リアル変換器２に転送して前記動作を繰り返す。そし
て、１ドットライン分の補正印字データをサーマルヘッ
ド13に転送すると、１ドットライン監視用カウンターで
あるカウンター６がカウントアップし、外部メモリコン
トロール回路４から出力される全ての外部クロックを停
止させ、サーマルヘッド13にラッチ信号を転送して補正
印字データを保持する。ここで保持された補正印字デー
タは第２図に示したヘッドストローブのONの間に発色
する。ただし、この場合、補正印字データ選択回路７で
はＡを選択してサーマルヘッドに補正印字データを転送
している。
次に、現在の印字データと１ドットライン過去の印字
データとの補正印字データの転送は、ヘッドストロー
ブがONしている間に行う。これは次のヘッドストロー
ブのONの間にサーマルヘッド13の発熱素子を発色させ
るためのデータ転送である。これは、第１図に示した外
部メモリ３に書き込まれてある種々の印字データを外部
メモリコントロール回路４から出力されるリード用外部
クロックに同期させてアドレスの０番地から読み出して
行く。そこで読み出された１ドットライン過去の印字デ
ータをインバータ８で反転させ、その反転データと現在
の印字データとの論理積をANDゲート10でとった補正印
字データをサーマルヘッド13に転送する。そして、１ド
ットライン分の補正印字データが転送されると、カウン
ター６がカウントアップし、外部メモリコントロール回
路４から出力される全ての外部クロックを停止させる。
そしてヘッドストローブがONからOFFに変わったとこ
ろで、サーマルヘッド13にラッチ信号を転送し、補正印
字データを保持する。ここで保持された補正印字データ
は第２図に示したヘッドストローブのONの間に発色す
る。ただし、この場合、補正印字データ選択回路７では
Ｂを選択させる。またこの場合、外部メモリ３では読み
出し動作を行うだけで書き込み動作は行わない。
次の現在の印字データと２ドットライン過去の印字デ
ータとの補正印字データ転送は、ヘッドストローブ
がONしている間に行う。これは次のヘッドストローブ
のONしている間にサーマルヘッドを発色させるためのデ
ータ転送である。
この場合、前回の補正印字データ転送と同様の動作
を行うが、この場合補正印字データ選択回路７ではＣを
選択するところだけが異なっている。
このように動作することにより、第３図に示すように
常に１ドットライン分の現在の印字データは、外部メモ
リ３（RAM）の最下位ビットにシリアルに格納され、１
ドットライン過去の印字データは外部メモリ３の最下位
ビットから１つ上位のビットにシリアルに格納され、２
ドットライン過去の印字データは外部メモリの最下位ビ
ットから２つ上位のビットにシリアルに格納される。
実施例２ 第４図は本発明の他の実施例示す構成図で、第１図と
同一部分については同一番号を付している。図におい
て、１マイクロコンピュータ、２はホストまたはマイク
ロコンピュータ１から出力された現在の印字データ（パ
ラレルデータ）をシリアルデータに変換するパラレルシ
リアル変換器、３はホストまたはマイクロコンピュータ
１から出力された現在の印字データを記憶、または記憶
しておいた現在および過去の印字データを出力する外部
メモリ（RAM）、５はパラレルシリアル変換器２で変換
されるシリアルデータの数を監視する８ビット監視用カ
ウンターとしてのカウンター、６はサーマルヘッドへ転
送された補正印字データの数を監視する１ドットライン
監視用カウンターとしてのカウンター、７は各種の補正
印字データを選択してサーマルヘッド13に転送する補正
印字データ選択回路、14は前記カウンター５がカウント
アップした場合にパラレルシリアル交換と外部メモリ３
のアドレスのカウントを停止させ、またカウンター５の
リセット後から再びパラレルシリアル変換と外部メモリ
３のアドレスのカウントを開始させる第１の外部クロッ
ク停止回路、15は第１の外部クロック停止回路14内のＤ
フリップフロップ回路、16は前記カウンター６がカウン
トアップした場合にサーマルヘッド13への補正印字デー
タの転送を停止させ、またカウンター６のリセット後か
ら再びサーマルヘッド13への補正印字データ転送を開始
させる第２の外部クロック停止回路、17は第２の外部ク
ロック停止回路16内のＤフリップフロップ回路、18は外
部メモリ３から読み出された印字データをその外部メモ
リ３に書き込むために、読み出しアドレスの初期値から
書き込みアドレスの初期値を必要な分だけ遅らせる読み
出し書き込みタイミング制御回路、19は読み出し書き込
みタイミング制御回路内18の遅れ監視用カウンター、20
はＤフリップフロップ回路、21は遅延回路、22〜27はイ
ンバータ、28〜31はORゲート、32〜35はANDゲート、36
はNANDゲート、37,38はNORゲートである。
以上のように構成されたサーマルラインプリンタの制
御回路においてのサーマルヘッドの制御方法は実施例１
とほぼ同様である。
次に、上記制御回路の動作について、詳細に説明す
る。第２図において、現在の印字データ転送１は、まず
第４図のマイクロコンピュータまたはホストからの現
在の印字データ（第１バイト目）をパラレルシリアル変
換器２に転送し、そこで保持する。そして外部メモリ３
の読み出し用アドレスの初期値（０番地）を設定し、読
み出し用クロックでアドレスをカウントして外部メモリ
３の０番地から印字データを読み出して行く。そして、
前記読み出し用クロックを読み出し書き込みタイミング
制御回路18内の遅れ監視用カウンター19で監視し、２ク
ロックの遅れをカウントアップすると、Ｄフリップフロ
ップ回路20がリセットされ、その出力によって外部メモ
リ３の書き込みアドレスの初期値（０番地）が設定さ
れ、パラレルシリアル変換器２に保持されているパラレ
ルデータをパラレルシリアル変換用外部クロックに同期
させてシリアルデータに変換し、シリアルに変換された
現在の印字データを補正印字データ選択回路７に転送す
ると同時に、書き込み用クロックでアドレスをカウント
して２クロック以前に外部メモリ３から出力された過去
の印字データとシリアルに変換された現在の印字データ
とを同時に外部メモリ３へ書き込んで行く。ただし、前
記２クロックというものは使用する外部メモリによって
その数は異なっている。
上記動作を１バイト分終了すると、８ビット監視カウ
ンターであるカウンター５がカウントアップし、第１の
外部クロック停止回路14のＤフリップフロップ回路15を
リセットする。それによって、外部クロック発生用発振
回路12から出力される外部クロックを停止させ、パラレ
ルシリアル変換と外部メモリ３のアドレスのカウントに
よる書き込みを停止させる。また、次（第２バイト目）
の印字データをパラレルシリアル変換器２に転送してそ
こに保持させておき、そしてカウンター５をリセットす
ると、自動的に前記動作を繰り返す。ただし、第２バイ
ト目以降の動作は外部メモリ３のアドレスの初期値を設
定する必要がなく、第１バイト目の印字データの読み出
しと書き込みアドレスに続けて行なう。
上記動作繰り返し、１ドットライン分の補正印字デー
タをサーマルヘッド13に転送すると、１ドットライン監
視カウンターであるカウンター６がカウントアップし、
第２の外部クロック停止回路16内のＤフリップフロップ
回路17をリセットする。それによって、外部クロック発
生用発振回路12から出力される外部クロックを停止さ
せ、現在の印字データ転送が終了する。ただし、この
場合補正印字データ選択回路７ではＡを選択してサーマ
ルヘッド13に補正印字データを転送している。
次に、現在の印字データと１ドットライン過去の印字
データとの補正印字データ転送については、まず第４
図の構成図に示した外部メモリ３の読み出しアドレスの
初期値を設定し、読み出し用クロックでアドレスをカウ
ントし読み出しアドレスの０番地から種々の印字データ
を読み出して行く。この場合、外部メモリ３への印字デ
ータの書き込みは行わず、またカウンター５がカウント
アップしても外部クロックを停止させることはない。
次に、そこで読み出された過去の印字データをインバ
ータ8,9で反転させ、その反転データと現在の印字デー
タとの論理積をANDゲート10,11でとった補正印字データ
をサーマルヘッド13に転送し、そして１ドットライン分
の補正印字データが転送されると、１ドットライン監視
用のカウンター６がカウントアップし、外部クロック発
生用発振回路12から出力される外部クロックを停止さ
せ、現在の印字データと１ドットライン過去の印字デー
タとの補正印字データ転送が終了する。ただし、この
場合、補正印字データ選択回路７ではＢを選択させる。
次の現在の印字データと２ドットライン過去の印字デ
ータとの補正印字データ転送は、前回の補正印字デー
タ転送と同様の動作を行うが、この場合補正印字デー
タ選択回路７ではＣを選択するところだけが異なってい
る。
このように制御を行うと、第３図に示すように常に１
ドットライン分の現在の印字データは、外部メモリ３の
最下位ビットにシリアルに格納され、１ドットライン過
去の印字データは外部メモリ３の最下位ビットから１つ
上位のビットにシリアルに格納され、２ドットライン過
去の印字データは外部メモリ３の最下位ビットから２つ
上位のビットにシリアルに格納される。
実施例３ 第５図は本発明の他の実施例を示す構成図で、この実
施例では実施例１の第１図の外部メモリ３と補正印字デ
ータ選択回路７との間に、ANDゲート39を追加したもの
である。
以上のように構成された制御回路でのサーマルヘッド
の制御方法と詳細動作については前記実施例１と同様で
ある。
実施例４ 第６図は本発明の他の実施例を示す構成図で、この実
施例では実施例２の第４図の外部メモリ３と補正印字デ
ータ選択回路７との間にANDゲート39を追加したもので
ある。
以上のように構成された制御回路でのサーマルヘッド
の制御方法と詳細動作については前記実施例２と同様で
ある。
上記実施例1,2の構成によれば、第７図に示すよう
に、また実施例3,4の構成によれば、第８図に示すよう
に、発熱素子１つ１つに着目してみると、１ドット過去
と２ドット過去の発熱素子の発色の組合せによってサー
マルヘッドへの印加エネルギーの大きさを調整し、例え
ば１ドット過去と２ドット過去の発熱素子の発色が連続
して行われている場合はサーマルヘッドに印加するエネ
ルギーを小さくし、過去に発色していない場合はエネル
ギーを大きくすることによって発熱素子１つ１つについ
ての蓄熱の影響をなくすことができるものである。
尚、上記実施例では２ドットライン過去までの印字デ
ータを用いて補正する方法を示したが、３ドットライン
過去以上も同様に行うことができるものである。
また、ヘッドストローブ信号については説明のため、
１ドットライン中に補正印字データを転送するためにON
/OFFを行ったが、必ずしもON/OFFを毎回行わないで発所
時間を管理するだけでもよい。
発色の効果 以上のように本発明は、サーマルヘッドの印字データ
に各種の補正印字データを加えることによって、サーマ
ルヘッドの発熱素子１つ１つについて適切なエネルギー
を印加でき、またハードウエア構成で補正印字データを
作成し、外部発振手段から出力された外部クロックに同
期させてサーマルヘッドに補正印字データを転送してい
るため、マイクロコンピュータのソフト計算による方法
に比べてデータ転送速度が高速になり、更に現在および
過去の印字データの記憶を外部メモリ１つのみで行うこ
とができるという効果が得られる。そして、これにより
低コストで高印字品質および高速印字可能という優れた
効果を有するサーマルラインプリンタを実現できるもの
である。
【図面の簡単な説明】
第１図，第４図，第５図および第６図はそれぞれ本発明
の実施例によるサーマルラインプリンタの制御回路を示
す構成図、第２図はデータ転送動作全体のタイミングチ
ャート、第３図は外部メモリのメモリーマップ、第７図
および第８図はそれぞれヘッド印加エネルギー決定アル
ゴリズムを説明するための説明図、第９図A,Bは発熱素
子の熱時定数を用い、かつコンデンサの充放電を利用し
た従来のサーマルヘッドの蓄熱制御方式を説明するため
の概略回路図および入力積分回路の電圧波形図である。 １……マイクロコンピュータ、２……パラレルシリアル
変換器、３……外部メモリ（RAM）、5,6……カウンタ
ー、７……選択回路、12……発振回路、13……サーマル
ヘッド、14……第１の外部クロック停止回路、16……第
２の外部クロック停止回路、18……読み出し書き込みタ
イミング制御回路。
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.6，ＤＢ名) B41J 2/35 - 2/36

Claims (3)

    (57)【特許請求の範囲】
  1. 【請求項１】ホストまたはマイクロコンピュータから出
    力されたパラレルの印字データをシリアルの印字データ
    に変換するパラレルシリアル変換器と、このパラレルシ
    リアル変換器からの２ドットライン分以上の印字データ
    を補正印字データとして記憶するとともにその書き込み
    と読み出しが非同期に行える外部メモリと、この外部メ
    モリおよび前記パラレルシリアル変換器の動作を制御す
    るコントロール回路と、前記パラレルシリアル変換器か
    ら直接転送されるシリアル印字データまたは前記外部メ
    モリを介して転送される種々のシリアル印字データのい
    ずれかを選択してサーマルヘッドに転送する補正印字デ
    ータの選択回路と、前記パラレルシリアル変換器で変換
    されたシリアルの印字データ数をカウントし所定の印字
    データ数をカウントした時点で前記コントロール回路か
    ら前記外部メモリへの制御信号を停止させる第１のカウ
    ンターと、前記外部メモリから前記サーマルヘッドに転
    送する補正印字データ数をカウントし所定の補正印字デ
    ータ数をカウントした時点で前記コントロール回路から
    前記外部メモリへの制御信号を停止させる第２のカウン
    ターとを備えたサーマルラインプリンタ。
  2. 【請求項２】ホストまたはマイクロコンピュータから出
    力されたパラレルの印字データをシリアルの印字データ
    に変換するパラレルシリアル変換器と、このパラレルシ
    リアル変換器からの２ドットライン分以上の印字データ
    を補正印字データとして記憶するとともにその書き込み
    と読み出しが非同期に行える外部メモリと、この外部メ
    モリの読み出しと書き込みのタイミングを制御する制御
    回路と、前記パラレルシリアル変換器から直接転送され
    るシリアル印字データまたは前記外部メモリを介して転
    送される種々のシリアル印字データのいずれかを選択し
    てサーマルヘッドに転送する補正印字データの選択回路
    と、前記パラレルシリアル変換器で変換されたシリアル
    の印字データ数をカウントする第１のカウンターと、こ
    の第１のカウンターの出力によりパラレルシリアル変換
    器と前記外部メモリの書き込みを停止させる第１の外部
    クロック停止回路と、前記外部メモリから前記サーマル
    ヘッドに転送する補正印字データ数をカウントする第２
    のカウンターと、この第２のカウンターの出力によりサ
    ーマルヘッドへの印字データ転送を停止させる第２の外
    部クロック停止回路とを備えたサーマルラインプリン
    タ。
  3. 【請求項３】外部メモリとして、書き込みと読み出しの
    アドレスの初期値が外部から設定されかつそのアドレス
    が外部クロックにより順次カウントされるカウンターを
    内蔵したメモリを用いた請求項１または２記載のサーマ
    ルラインプリンタ。
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