JP2014115434A5 - - Google Patents
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Description
一方、アレイ基板ＡＲは、表示エリアＤＳＰ外に引き出されたゲート線Ｙ（Ｙ１〜Ｙｎ）と接続されたゲートドライバＹＤと、表示エリアＤＳＰ外に引き出されたソース線Ｘ（Ｘ１〜Ｘｍ）と接続されたソースドライバＸＤと、ゲートドライバＹＤ及びソースドライバＸＤを制御するコントローラＣＮＴとを備えており、これらは表示エリアＤＳＰ外の絶縁基板２０上に形成される。
以上のような構成において、ゲートドライバＹＤは、コントローラＣＮＴによる制御に基づいて、ｎ本のゲート線Ｙに走査信号（駆動信号）を順次に供給する。一方、ソースドライバＸＤは、コントローラＣＮＴによる制御に基づいて、各行のスイッチング素子Ｗが走査信号によってオンするタイミングでｍ本のソース線Ｘにそれぞれ映像信号（駆動信号）を供給する。これにより、ゲート線Ｙからの走査信号によってオンされたスイッチング素子Ｗは、ソース線Ｘからの映像信号に応じた画素電位、すなわち第１電極Ｅ１の電位に対する画素電位を、ドレイン電極ＷＤと接続された第２電極Ｅ２に設定することが可能となっている。
ソース電極ＷＳ、ソース線Ｘ、ドレイン電極ＷＤ及び半導体層ＳＣ上には、これらを覆う第１絶縁膜２４が形成されている。この第１絶縁膜２４は、パッシベーション膜として機能し、例えば窒化シリコン（ＳｉＮ）膜、酸化シリコン（ＳｉＯ）膜または有機絶縁膜から構成される。なお、本実施の形態１では、第１絶縁膜２４は、二層の絶縁膜２４ａ，２４ｂから構成されている。
図１に戻って、第１電極Ｅ１上には、これを覆う第２絶縁膜２６が形成されている。この第２絶縁膜２６は、第１絶縁膜２４と同様に、パッシベーション膜として機能し、例えば窒化シリコン（ＳｉＮ）膜、酸化シリコン（ＳｉＯ）膜または有機絶縁膜から構成される。
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