JP2014082493A - ハイブリッド積層基板及びその製造方法、並びにパッケージ基板 - Google Patents
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Abstract
【解決手段】コア層10と、コア層の上部、下部または上下部に感光性樹脂材質からなる少なくとも一つ以上の第1絶縁層30と、コア層の上部、下部または上下部に非感光性樹脂材質からなる少なくとも一つ以上の第2絶縁層50と、を含んでなるハイブリッド積層基板及びそれを含むパッケージ基板、並びにハイブリッド積層基板の製造方法である。
【選択図】図1A
Description
また、ハイブリッド積層基板が電子素子15を内蔵する積層基板である場合、コア層10上に回路パターンを形成する段階で、コア層10にキャビティ11を形成した後、キャビティ内に電子素子15を内蔵することができる。
11 キャビティ
15 電子素子
20 微細パターンまたは微細パターン層
25 微細ビアまたはフォトビア
30 第1絶縁層
40 ワイドパターンまたはワイドパターン層
45 ワイドビアまたはレーザービア
50 第2絶縁層
65、65´、65´´ スルーホール
70 半田レジスト層
Claims (19)
- コア層と、
前記コア層の上部、下部または上下部に感光性樹脂材質からなる少なくとも一つ以上の第1絶縁層と、
前記コア層の上部、下部または上下部に非感光性樹脂材質からなる少なくとも一つ以上の第2絶縁層と、を含んでなる、ハイブリッド積層基板。 - 前記コア層の上部、下部または上下部に前記第1及び第2絶縁層が混合積層されたハイブリッド積層構造が形成される、請求項1に記載のハイブリッド積層基板。
- 前記ハイブリッド積層構造内に上下部を相互連結するためのスルーホールが形成される、請求項2に記載のハイブリッド積層基板。
- 前記第1絶縁層は、上部及び下部に形成されたパターンを連結する少なくとも一つ以上の小さいサイズの微細ビアを含み、
前記第2絶縁層は、上部及び下部に形成されたパターンを連結する少なくとも一つ以上の大きいサイズのワイドビアを含む、請求項1に記載のハイブリッド積層基板。 - 前記微細ビアはフォトビアであって、前記第1絶縁層の上部に形成され、信号伝送ラインを含む微細パターン層が前記フォトビアと連結され、
前記ワイドビアはレーザービアであって、前記第2絶縁層の上部に形成され、グランド及び電力配電回路網(PDN)のうち何れか一つ以上を含むワイドパターン層が前記レーザービアと連結される、請求項4に記載のハイブリッド積層基板。 - 前記微細ビアはフォトビアであり、前記ワイドビアはレーザービアであって、
前記第1絶縁層に形成された多数の前記フォトビアは少なくとも2以上の異なるサイズを有する、請求項4に記載のハイブリッド積層基板。 - 前記第1絶縁層の前記感光性樹脂材質は、感光性ポリヒドロキシスチレン(PHS)、感光性ポリベンゾオキサゾール(PBO)、感光性ポリイミド(PI)、感光性ベンゾシクロブテン(BCB)、感光性ポリシロキサン、感光性エポキシ、ノボラック(Novolac)樹脂から選択される何れか一つ以上を含む、請求項1に記載のハイブリッド積層基板。
- 前記第2絶縁層は、プリプレグ(PPG)、ABF(Ajinomoto build−up film)、樹脂付き銅箔(RCC)、液晶ポリマー(LCP)、テフロンのうち何れか一つの材料からなる、請求項1に記載のハイブリッド積層基板。
- 前記積層基板の外層に形成された半田レジスト(SR)層をさらに含む、請求項1に記載のハイブリッド積層基板。
- 前記コア層はキャビティを含み、
前記キャビティに電子素子が内蔵されており、
前記電子素子が内蔵された前記コア層に前記第1及び第2絶縁層が積層される、請求項1乃至9の何れか一項に記載のハイブリッド積層基板。 - 前記第1及び第2絶縁層が混合積層されたハイブリッド積層構造にキャビティが形成され、
前記キャビティに電子素子が内蔵される、請求項1乃至9の何れか一項に記載のハイブリッド積層基板。 - ICを含むパッケージ基板であって、
請求項1乃至9の何れか一項に記載のハイブリッド積層基板と、
前記ハイブリッド積層基板上にまたは内部に実装されたICチップと、を含むパッケージ基板。 - 前記ICチップは、前記コア層の上部、下部または上下部に前記第1及び第2絶縁層が混合積層されたハイブリッド積層構造の外側に実装され、
前記ICチップに近い絶縁層が前記第1絶縁層であり、前記ICチップから遠ざかる内側に前記第2絶縁層が形成される、請求項12に記載のパッケージ基板。 - 前記ICチップは、前記コア層の上部、下部または上下部に前記第1及び第2絶縁層が混合積層されたハイブリッド積層構造の内側に形成されたキャビティに内蔵される、請求項12に記載のパッケージ基板。
- コア層を準備した後、前記コア層上に回路パターンを形成する段階と、
感光性樹脂材質からなる少なくとも一つ以上の第1絶縁層及び非感光性樹脂材質からなる少なくとも一つ以上の第2絶縁層を前記コア層の上部、下部または上下部に積層し、パターンを形成する段階と、を含んでなる、ハイブリッド積層基板の製造方法。 - 前記第1及び第2絶縁層を積層する段階で、前記コア層の上部、下部または上下部に前記第1及び第2絶縁層が混合積層されたハイブリッド積層構造を形成する、請求項15に記載のハイブリッド積層基板の製造方法。
- 前記第1及び第2絶縁層を積層し、パターンを形成する段階で、
積層された前記第1絶縁層に露光、現象及びめっきを行うことで、前記第1絶縁層の上部及び下部に形成されたパターンを連結する少なくとも一つ以上の小さいサイズの微細フォトビアを形成し、
積層された前記第2絶縁層にレーザー穿孔を行うことで、前記第2絶縁層の上部及び下部に形成されたパターンを連結する少なくとも一つ以上の大きいサイズのワイドレーザービアを形成する、請求項15に記載のハイブリッド積層基板の製造方法。 - 前記第1及び第2絶縁層を積層し、パターンを形成する段階で、
前記第1絶縁層の上部に、信号伝送ラインを含む微細パターン層を前記微細フォトビアと連結されるように形成し、
前記第2絶縁層の上部に、グランド及び電力配電回路網(PDN)のうち何れか一つ以上を含むワイドパターン層を前記ワイドレーザービアと連結されるように形成する、請求項17に記載のハイブリッド積層基板の製造方法。 - 前記第1及び第2絶縁層を積層し、パターンを形成する段階の後に、
外側に半田レジスト(SR)層を形成する段階をさらに含む、請求項15に記載のハイブリッド積層基板の製造方法。
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Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN106373939A (zh) * | 2016-11-18 | 2017-02-01 | 江阴长电先进封装有限公司 | 一种封装基板的结构及其封装方法 |
KR20170142811A (ko) * | 2016-06-20 | 2017-12-28 | 삼성전기주식회사 | 팬-아웃 반도체 패키지 |
JP2017228756A (ja) * | 2016-06-20 | 2017-12-28 | サムソン エレクトロ−メカニックス カンパニーリミテッド. | ファン−アウト半導体パッケージ |
JP2021510935A (ja) * | 2018-04-13 | 2021-04-30 | 安徽▲雲▼塔▲電▼子科技有限公司 | インダクタ積層構造 |
Families Citing this family (17)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP6513786B2 (ja) * | 2014-05-06 | 2019-05-15 | インテル コーポレイション | 集積アンテナを備えた多層パッケージ |
CN105592639B (zh) * | 2014-10-23 | 2019-01-25 | 碁鼎科技秦皇岛有限公司 | 电路板及其制作方法 |
KR102356809B1 (ko) * | 2014-12-26 | 2022-01-28 | 삼성전기주식회사 | 인쇄회로기판 및 그 제조방법 |
JP6160656B2 (ja) * | 2015-06-18 | 2017-07-12 | ウシオ電機株式会社 | 配線基板の製造方法、配線基板及び配線基板製造装置 |
US10356916B2 (en) | 2015-06-29 | 2019-07-16 | Samsung Electro-Mechanics Co., Ltd. | Printed circuit board with inner layer and outer layers and method of manufacturing the same |
KR20170002179A (ko) * | 2015-06-29 | 2017-01-06 | 삼성전기주식회사 | 인쇄회로기판 및 인쇄회로기판의 제조방법 |
KR20170033191A (ko) * | 2015-09-16 | 2017-03-24 | 삼성전기주식회사 | 인쇄회로기판 및 그 제조 방법 |
KR20170050192A (ko) * | 2015-10-29 | 2017-05-11 | 삼성전기주식회사 | 인쇄회로기판 및 인쇄회로기판 제조방법 |
CN106373938B (zh) * | 2016-11-18 | 2019-02-26 | 江阴长电先进封装有限公司 | 一种混合密度封装基板的结构及其封装方法 |
WO2018165819A1 (zh) * | 2017-03-13 | 2018-09-20 | 深圳修远电子科技有限公司 | 电路连线方法 |
TWI642333B (zh) * | 2017-10-25 | 2018-11-21 | 欣興電子股份有限公司 | 電路板及其製造方法 |
TWI642334B (zh) | 2017-10-25 | 2018-11-21 | 欣興電子股份有限公司 | 電路板及其製造方法 |
US11488881B2 (en) | 2018-03-26 | 2022-11-01 | Taiwan Semiconductor Manufacturing Company, Ltd. | Semiconductor device and method of manufacture |
CN109461716A (zh) * | 2018-10-29 | 2019-03-12 | 中国电子科技集团公司第十三研究所 | 混合型多芯片组件及其制备方法 |
JP7293056B2 (ja) * | 2019-09-12 | 2023-06-19 | キオクシア株式会社 | 半導体装置およびその製造方法 |
KR20210155981A (ko) * | 2020-06-17 | 2021-12-24 | 엘지이노텍 주식회사 | 인쇄회로기판 및 이의 제조 방법 |
JP2022032293A (ja) * | 2020-08-11 | 2022-02-25 | 日本メクトロン株式会社 | 配線体およびその製造方法 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1154938A (ja) * | 1997-07-31 | 1999-02-26 | Kyocera Corp | 多層配線基板 |
WO2010010911A1 (ja) * | 2008-07-23 | 2010-01-28 | 日本電気株式会社 | 半導体装置及びその製造方法 |
WO2010134511A1 (ja) * | 2009-05-20 | 2010-11-25 | 日本電気株式会社 | 半導体装置及び半導体装置の製造方法 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR19990047208A (ko) * | 1997-12-03 | 1999-07-05 | 이형도 | 다층인쇄회로기판의 제조방법 |
JP3956204B2 (ja) * | 2002-06-27 | 2007-08-08 | 日本特殊陶業株式会社 | 積層樹脂配線基板及びその製造方法、積層樹脂配線基板用金属板 |
US7186919B2 (en) * | 2004-08-16 | 2007-03-06 | Samsung Electro-Mechanics Co., Ltd. | Printed circuit board including embedded capacitors and method of manufacturing the same |
US20100006334A1 (en) * | 2008-07-07 | 2010-01-14 | Ibiden Co., Ltd | Printed wiring board and method for manufacturing the same |
US20110110061A1 (en) * | 2009-11-12 | 2011-05-12 | Leung Andrew Kw | Circuit Board with Offset Via |
KR101085727B1 (ko) * | 2010-05-25 | 2011-11-21 | 삼성전기주식회사 | 임베디드 인쇄회로기판 및 이의 제조 방법 |
JP2012204831A (ja) * | 2011-03-23 | 2012-10-22 | Ibiden Co Ltd | 電子部品内蔵配線板及びその製造方法 |
-
2012
- 2012-10-16 KR KR1020120114668A patent/KR101472633B1/ko not_active IP Right Cessation
-
2013
- 2013-10-01 TW TW102135450A patent/TW201422093A/zh unknown
- 2013-10-04 JP JP2013208883A patent/JP2014082493A/ja active Pending
- 2013-10-15 CN CN201310482153.XA patent/CN103731979A/zh active Pending
- 2013-10-16 US US14/055,335 patent/US20140104798A1/en not_active Abandoned
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1154938A (ja) * | 1997-07-31 | 1999-02-26 | Kyocera Corp | 多層配線基板 |
WO2010010911A1 (ja) * | 2008-07-23 | 2010-01-28 | 日本電気株式会社 | 半導体装置及びその製造方法 |
WO2010134511A1 (ja) * | 2009-05-20 | 2010-11-25 | 日本電気株式会社 | 半導体装置及び半導体装置の製造方法 |
Cited By (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20170142811A (ko) * | 2016-06-20 | 2017-12-28 | 삼성전기주식회사 | 팬-아웃 반도체 패키지 |
JP2017228756A (ja) * | 2016-06-20 | 2017-12-28 | サムソン エレクトロ−メカニックス カンパニーリミテッド. | ファン−アウト半導体パッケージ |
KR102003390B1 (ko) * | 2016-06-20 | 2019-07-24 | 삼성전자주식회사 | 팬-아웃 반도체 패키지 |
US10600748B2 (en) | 2016-06-20 | 2020-03-24 | Samsung Electronics Co., Ltd. | Fan-out semiconductor package |
US10714437B2 (en) | 2016-06-20 | 2020-07-14 | Samsung Electronics Co., Ltd. | Fan-out semiconductor package |
US11011482B2 (en) | 2016-06-20 | 2021-05-18 | Samsung Electronics Co., Ltd. | Fan-out semiconductor package |
CN106373939A (zh) * | 2016-11-18 | 2017-02-01 | 江阴长电先进封装有限公司 | 一种封装基板的结构及其封装方法 |
CN106373939B (zh) * | 2016-11-18 | 2019-04-19 | 江阴长电先进封装有限公司 | 一种封装基板的结构及其封装方法 |
JP2021510935A (ja) * | 2018-04-13 | 2021-04-30 | 安徽▲雲▼塔▲電▼子科技有限公司 | インダクタ積層構造 |
US11631516B2 (en) | 2018-04-13 | 2023-04-18 | Anhui Yunta Electronic Technologies Co., Ltd. | Inductor stack structure |
Also Published As
Publication number | Publication date |
---|---|
KR101472633B1 (ko) | 2014-12-15 |
CN103731979A (zh) | 2014-04-16 |
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TW201422093A (zh) | 2014-06-01 |
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