JP2008091853A - 半導体装置およびその製造方法 - Google Patents
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Abstract
【解決手段】N-ドリフト層1には、当該N-ドリフト層1の不純物濃度が極大となる箇所が少なくとも1か所ある。また、N-ドリフト層1の不純物濃度は、不純物濃度が極大となる箇所からPベース層2およびPコレクタ層4の方向に向かって低くなる。さらに、少なくともN-ドリフト層1の不純物濃度が極大となる箇所には、酸素原子と酸素よりも軽い元素が含まれている。
【選択図】図1
Description
かつ低損失なスイッチング特性(ターンオフ・ターンオン損失)や低い導通損失(飽和電圧)の素子を得ることができる。しかし、この場合、内部の余剰キャリアが減少するため、上述した素子の破壊や発振が起こりやすくなってしまうという問題点がある。
ズ量は1.0×1012/cm2であった。そして、アルミアブソーバーを用いてプロト
ンの飛程がシリコン表面、すなわちプロトンの照射面から約50μmの深さになるように
した。なお、プロトンの照射面には、10000オングストロームの厚さの熱酸化膜を形成した。
図1は、実施の形態1にかかる半導体装置の構成、ネットドーピング濃度およびプロトン分布を示す図である。図1において半導体装置の断面図100に示すように、N-ドリフト層1の一方の主面側に、Pベース層2が形成されている。また、N-ドリフト層1の他方の主面側には、N-ドリフト層1より不純物濃度が高いN型のコレクタバッファ層3が形成されている。また、コレクタバッファ層3の表面には、Pコレクタ層4が形成されている。
つづいて、実施の形態2にかかる半導体装置の製造プロセスについて説明する。実施の形態2にかかる半導体装置の構成は、実施の形態1にかかる半導体装置の構成と同様であるが、製造プロセスが異なる。具体的には、実施の形態1では、イオン注入およびパルス照射によってコレクタバッファ層3を形成したが、実施の形態2では、プロトンのシャドードナーによってコレクタバッファ層3を形成する。
図12は、実施の形態3にかかる半導体装置の構成およびネットドーピング濃度を示す図である。実施の形態3では、N-ドリフト層1のブロードバッファ構造をアクセプタの補償によって形成する。図12において半導体装置の断面図1200に示すように、実施の形態3の半導体装置は、図1に示す実施の形態1の半導体装置のコレクタバッファ層3を薄くした構成である。その他の構成は実施の形態1と同様であるので、同一の符号を付して説明を省略する。
図21は、実施の形態4にかかる半導体装置の構成、ネットドーピング濃度を示す図である。図21において半導体装置の断面図2100に示すように、N-ドリフト層2101の一方の主面の一部に、Pエミッタ層2102が形成されている。また、N-ドリフト層2101の他方の主面側には、コレクタバッファ層2103が形成されている。また、コレクタバッファ層2103の表面には、P+コレクタ層2104が形成されている。また、P+コレクタ層2104の表面にはコレクタ電極2109が形成されている。
5Ndm < Nb ・・・(1)
WA >> WB ・・・(3)
WM/5 > WB ・・・(4)
WA >> WM/5 > WB ・・・(5)
WA > WM ・・・(6)
2 Pベース層
3 コレクタバッファ層
4 Pコレクタ層
5 エミッタ電極
6 ゲート絶縁膜
7 ゲート電極
8 N+ソース領域
9 コレクタ電極
Claims (14)
- 第1導電型ドリフト層と、当該第1導電型ドリフト層の第1主面側に選択的に形成された第2導電型ベース層と、当該第2導電型ベース層の表面に選択的に形成された第1導電型ソース領域と、前記第2導電型ベース層のうち前記第1導電型ドリフト層と前記第1導電型ソース領域とに挟まれる部分に接するゲート絶縁膜と当該ゲート絶縁膜に接するゲート電極とからなるMOSゲート構造と、前記第1導電型ソース領域と前記第2導電型ベース層とに接触するエミッタ電極と、前記第1導電型ドリフト層の第2主面側に形成された第2導電型コレクタ層と、当該第2導電型コレクタ層に接触するコレクタ電極と、を備える半導体装置であって、
前記第1導電型ドリフト層中に当該第1導電型ドリフト層の不純物濃度が極大となる箇所が少なくとも1か所あり、かつ前記第1導電型ドリフト層の不純物濃度が、前記極大となる箇所から前記第2導電型ベース領域および前記第2導電型コレクタ層の両方に向かって低くなり、
さらに、前記第1導電型ドリフト層中の少なくとも当該第1導電型ドリフト層の不純物濃度が極大となる箇所に、酸素原子と酸素よりも軽い元素が含まれていることを特徴とする半導体装置。 - 前記酸素より軽い元素が水素であることを特徴とする請求項1に記載の半導体装置。
- 前記第1導電型ドリフト層と前記第2導電型コレクタ層との間に設けられた第1導電型バッファ層を備え、
前記第1導電型バッファ層の不純物濃度は、前記第1導電型ドリフト層の平均不純物濃度の5倍よりも大きいことを特徴とする請求項1または2に記載の半導体装置。 - 前記第2導電型コレクタ層の厚さは、前記第1導電型ドリフト層において当該第1導電型ドリフト層の平均不純物濃度よりも不純物濃度が高い領域の厚さよりも厚いことを特徴とする請求項1〜3のいずれか一つに記載の半導体装置。
- 上記請求項1〜4のいずれか一つに記載の半導体装置を製造するにあたって、
前記第1導電型ドリフト層となる第1導電型の半導体基板中に酸素を導入する工程と、
前記半導体基板の第1主面または第2主面にイオン化した荷電粒子を照射して、同半導体基板中の前記第1導電型ドリフト層に結晶欠陥を導入する工程と、
熱処理を行って、前記第1導電型ドリフト層に導入された結晶欠陥を回復させることにより、前記第1導電型ドリフト層の一部のネットドーピング濃度を前記半導体基板の当初のネットドーピング濃度よりも高くする工程と、
を含むことを特徴とする半導体装置の製造方法。 - 前記イオン化した荷電粒子がプロトンであることを特徴とする請求項5に記載の半導体装置の製造方法。
- 上記請求項1〜4のいずれか一つに記載の半導体装置を製造するにあたって、
前記第1導電型ドリフト層となる第1導電型の半導体基板の第1主面および第2主面から前記半導体基板の不純物濃度よりも低い濃度の第2導電型不純物を導入して、最大不純物濃度が前記半導体基板中の不純物濃度よりも低い前記第2導電型不純物層を形成する工程と、
を含むことを特徴とする半導体装置の製造方法。 - 前記半導体基板は、N型シリコン基板であり、
前記第2導電型不純物は、ボロンよりも拡散係数が大きいP型不純物元素であることを特徴とする請求項7に記載の半導体装置の製造方法。 - 前記第2導電型不純物は、アルミニウムもしくはガリウム、または白金もしくは亜鉛のいずれか一方であることを特徴とする請求項8に記載の半導体装置の製造方法。
- 前記半導体基板のいずれか一方の主面から導入される前記P型不純物元素は、アルミニウムまたはガリウムであり、前記半導体基板の他方の主面から導入される前記P型不純物元素は、白金または亜鉛であることを特徴とする請求項8に記載の半導体装置の製造方法。
- アルミニウムまたはガリウムは、ドーズ量1×1012atoms/cm2以下でイオン
注入されることを特徴とする請求項10に記載の半導体装置の製造方法。 - アルミニウムまたはガリウムのイオン注入後、1000℃以上1200℃以下の温度で熱処理を行うことを特徴とする請求項11に記載の半導体装置の製造方法。
- 白金または亜鉛は、ドーズ量1×1013atoms/cm2以下でイオン注入されるこ
とを特徴とする請求項10〜12のいずれか一つに記載の半導体装置の製造方法。 - 白金または亜鉛の導入後、400℃以上1000℃以下の温度で熱処理を行うことを特徴とする請求項13に記載の半導体装置の製造方法。
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