JP2007097019A - 遅延回路及びそれを用いた映像信号処理回路 - Google Patents
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Abstract
【解決手段】充電用・放電用トランジスタとそれらのソースに接続された容量素子とを有したスイッチド・キャパシタ部を複数有し、入力信号が充電用トランジスタのドレイン各々に対して共通に入力され且つ容量素子を充電させるように接続されるとともに、放電用トランジスタのドレイン各々から容量素子を放電させて出力信号が出力されるように接続されるスイッチド・キャパシタ群と、充電用及び放電用トランジスタのゲート各々のオン・オフを制御して容量素子各々を入力信号に基づいて順次充電させるとともに、当該順次充電の際に前回充電しておいた容量素子を放電させることで出力信号を順次出力させるスイッチング制御部と、を有し、隣接する二つの前記スイッチド・キャパシタ部において、双方の充電用・放電用トランジスタ同士を隣接させ、双方の充電用・放電用トランジスタのドレインを共通させる。
【選択図】 図6
Description
Csb = Cdb = (W+α)×(Ld+α) ・・・ 式(1)
図1は、本発明に係るテレビ受信システムの構成図である。
チューナ120は、アンテナ110で受信したテレビジョン放送の映像信号の中から、受信対象とするチャンネルの信号を抽出した後にそれを増幅出力するフロントエンド処理回路である。尚、テレビジョン放送の映像信号は、PAL方式又はSECAM方式に準拠したものであり、テレビカメラによって撮像された色の三原色(R、G、B)情報を有する。
映像中間周波処理回路140は、中間周波フィルタ130において抽出された中間周波信号IFを検波してコンポジット信号SCを抽出する回路である。
クランプ回路150は、映像中間周波処理回路140より抽出されたコンポジット信号SCのペデスタルレベルを所定レベルに固定化するための回路である。
YC分離回路160は、クランプ回路150から供給されるコンポジット信号SCを、輝度信号Yとクロマ信号Cとに同期分離する回路である。
輝度信号処理回路170は、YC分離回路160から供給される輝度信号Yのコントラスト調整やブランキング調整を行う回路である。
色復調回路190は、主に、色信号処理回路180での各種処理が施されたクロマ信号C’に基づいて、色差信号R−Y、B−Yを復調する回路である。
RGBドライバ210は、マトリクス回路200から供給された3つのR信号、G信号、B信号に基づいて、ディスプレイ220に所望のカラー映像を再現するための駆動信号ROUT、GOUT、BOUTを生成する駆動回路である。
図2は、本発明の『遅延回路』の一実施形態に係る1H遅延回路400を有したアナログカラーテレビ用の映像信号処理回路300の構成図である。尚、映像信号処理回路300は、PAL方式の映像信号を主に処理対象とするものであるが、SECAMデコーダ500を外付けすることでSECAM方式の映像信号についても処理可能である。尚、映像信号処理回路300は、SECAMデコーダ500も併せて集積化する実施形態としてもよい。また、映像信号処理回路300は、バイポーラとCMOSの両方を使えるBiCMOSプロセスによって設計・製造される集積回路とする。
スイッチ回路601は、同期検波回路191から同時に供給されるPAL方式の場合の色差信号B−Y、R−Y、又は、クランプ回路600から交互に供給されるSECAM方式の場合の色差信号B−Y、R−Yのいずれか一方を、受信した映像信号のアナログカラーテレビ方式に従って選択する回路である。
図4は、1H遅延回路400の回路構成の一例を示した図である。
1H遅延回路400は、スイッチド・キャパシタ群412と、スイッチング制御回路413と、を有する。尚、1H遅延回路400は、色差信号B−Y、R−Yそれぞれに設けられる。
図5に示すタイミングチャートに基づいて、図4に示した1H遅延回路400の動作例を説明する。
図6は、図12に示したNMOSトランジスタの一般的な断面構造を用いて、図4に示した本発明に係るスイッチング・キャパシタ群412のうち、NMOSトランジスタN1〜N8のレイアウトならびに各種接続関係を説明する図である。尚、P型シリコン基板16a、16b、16d、16fは、それぞれ分離させて図示してあるが、同一のシリコンウェハ上に形成されたものである。
12 ソース電極 13 多結晶ポリシリコン
14 二酸化シリコン 15 N+領域
16 P型シリコン基板 17 ドレイン
18 ゲート 19 ソース
110 アンテナ 120 チューナ
130 中間周波フィルタ 140 映像中間周波処理回路
150、600 クランプ回路 160 YC分離回路
170 輝度信号処理回路 171 遅延ライン
172 シャープネス調整部 173 ブラック・ストレッチ処理部
174 コントラスト調整部 180 色信号処理回路
181 ゲイン調整部 182 カラーキラー回路
190 色復調回路 191 同期検波回路
192、193 乗算器 194 副搬送波信号発振器
195 位相シフタ 196 LPF
198 加算器 199 カラークランプ回路
200 マトリクス回路 210 RGBドライバ
220 ディスプレイ 300 映像信号処理回路
400 1H遅延回路 412 スイッチド・キャパシタ群
701、413 スイッチング制御回路
702、411 ボルテージフォロワ
410a〜410d スイッチド・キャパシタ部
703a〜703b スイッチド・キャパシタ部
500 SECAMデコーダ
600 クランプ回路
601 スイッチ回路
Claims (4)
- 入力信号を遅延させた出力信号を得る遅延回路において、
充電用MOSトランジスタ及び放電用MOSトランジスタと前記充電用及び前記放電用MOSトランジスタのソースに接続されて前記充電用及び前記放電用MOSトランジスタのゲートのオン・オフによって充放電がなされる容量素子とを有したスイッチド・キャパシタ部を複数有し、前記入力信号が前記充電用MOSトランジスタのドレイン各々に対して共通に入力され且つ前記容量素子を充電させるように接続されるとともに、前記放電用MOSトランジスタのドレイン各々から前記容量素子を放電させて前記出力信号が出力されるように接続されるスイッチド・キャパシタ群と、
前記充電用及び前記放電用MOSトランジスタのゲート各々のオン・オフを制御することで、前記容量素子各々を前記入力信号に基づいて順次充電させていくととともに、当該順次充電の際に前回充電しておいた前記容量素子を放電させることで前記出力信号を順次出力させていくスイッチング制御部と、を有しており、
前記複数のスイッチド・キャパシタ部のうち隣接する二つの前記スイッチド・キャパシタ部において、双方の前記充電用MOSトランジスタ同士を隣接させるとともに双方の前記放電用MOSトランジスタ同士を隣接させ、前記双方の充電用MOSトランジスタのドレインを共通させるとともに前記双方の放電用MOSトランジスタのドレインを共通させること、
を特徴とする遅延回路。 - 撮像された色の三原色情報を有したテレビジョン放送の映像信号に基づいて輝度信号とクロマ信号を復調し、さらに、前記輝度信号の輝度信号処理と並行して前記クロマ信号の色復調処理の過程で当該クロマ信号を二つの色差信号に復調し、前記輝度信号と前記二つの色差信号に基づいて前記複合映像信号が有する前記三原色情報を再生する映像信号処理回路において、
充電用MOSトランジスタ及び放電用MOSトランジスタと前記充電用及び前記放電用MOSトランジスタのソースに接続されて前記充電用及び前記放電用MOSトランジスタのゲートのオン・オフによって充放電がなされる容量素子とを有したスイッチド・キャパシタ部を複数有し、前記復調後の色差信号が前記充電用MOSトランジスタのドレイン各々に対して共通に入力され且つ前記容量素子を充電させるように接続されるとともに、前記放電用MOSトランジスタのドレイン各々から前記容量素子を放電させて前記色差信号を1H期間遅延させた信号が出力されるように接続されるスイッチド・キャパシタ群と、
前記充電用及び前記放電用MOSトランジスタのゲート各々のオン・オフを制御することで、前記容量素子各々を前記色差信号に基づいて順次充電させていくととともに、当該順次充電の際に前回充電しておいた前記容量素子を放電させることで前記色差信号を1H期間遅延させた信号を順次出力させていくスイッチング制御部と、
前記1H期間遅延させる前と後の前記色差信号を加算する加算器と、
前記加算器の加算結果と前記輝度信号処理後の輝度信号とに基づいて前記三原色の情報を再生するマトリクス回路と、を有しており、さらに、
前記複数のスイッチド・キャパシタ部のうち隣接する二つの前記スイッチド・キャパシタ部において、双方の前記充電用MOSトランジスタ同士を隣接させるとともに双方の前記放電用MOSトランジスタ同士を隣接させ、前記双方の充電用MOSトランジスタのドレインを共通させるとともに前記双方の放電用MOSトランジスタのドレインを共通させること、を特徴とする映像信号処理回路。 - 前記映像信号は、PAL(Phase Alternation by Line)方式又はSECAM(SEquential Couleur A Memoire)方式に準拠した信号であること、を特徴とする請求項2に記載の映像信号処理回路。
- 前記映像信号処理回路は、BiCMOSプロセスによって形成された回路であること、を特徴とする請求項2又は3に記載の映像信号処理回路。
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