JP2007073560A - 薄膜トランジスタの製法 - Google Patents
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Abstract
【解決手段】 酸化亜鉛(ZnO)を主成分とする酸化物からなる半導体薄膜と、シリコン系絶縁膜からなり該半導体薄膜に接するゲート絶縁膜を有する薄膜トランジスタの製法において、前記半導体薄膜の形成と前記ゲート絶縁膜の形成が、真空中にて連続した工程で行われることを特徴とする薄膜トランジスタの製法。
【選択図】 図2
Description
このトップゲート構造は、基板116上にソース・ドレイン電極117、酸化亜鉛半導体薄膜118、ゲート絶縁膜119、ゲート電極120をこの順に積層して構成されている。
このゲート絶縁膜119は、化学気相成長(CVD)法にて200〜500nmの厚みで形成されることが多い。
ゲート絶縁膜の成膜は、従来、真空装置内で半導体薄膜を形成し、大気中に取り出し、パターン加工した後、再度真空装置内にてゲート絶縁膜を形成するといったように、半導体薄膜の形成とは不連続な工程にて行われる。
このような問題を解決するため、シリコン半導体では、界面清浄化のために各種洗浄方式が用いられる。例えば金属不純物、イオン性不純物、粒子状不純物の除去にはRCA洗浄といった酸を用いたウェット洗浄を、表面酸化物の除去にはフッ化水素酸(HF)を用いたウェット洗浄を、有機物の除去にはUVやオゾン処理といったドライ洗浄を製造工程の随所に用いることが考えられる。
基板1の材料は、ガラスに限定されず、プラスチックや金属箔に絶縁物をコーティングしたもの等、絶縁物であれば使用可能である。
ソース・ドレイン電極2は、例えば、インジウムスズ酸化物(ITO)、n+ZnO等の導電性酸化物、金属、もしくは前記導電性酸化物により少なくとも一部を被覆された金属により形成される。
ソース、ドレイン電極2に用いられる金属としては、Ti、Cr、Ta、Mo、W、Al、Cu、Niの単層もしくは積層体、或いは合金であってTi、Cr、Ta、Mo、W、Al、Cu、Si、Niのうち、少なくとも一種類以上を含有する合金、が用いられる。この合金の具体例としては、TiW、TaW、MoW、MoSi、AlCu、AlSi、NiSi等の合金が例示できる。
ソース・ドレイン電極2を前記導電性酸化物により少なくとも一部分を被覆された金属にて形成する例としては、後述する図1(b)に示されるような構造が考えられるが、金属あるいは導電性酸化物にて直接形成する構造も考えられる。
ソース・ドレイン電極2の厚みは、特に限定されないが、例えば30nm〜150nmに形成され、好ましくは、ソース・ドレイン電極2上に形成される半導体薄膜3の段差部での断線を防止するため、図1(b)の構造では導電性酸化物の膜厚を半導体薄膜3より薄く(例えば、約40nm)、また直接形成する構造では金属あるいは導電性酸化物の膜厚を半導体薄膜3より薄く(例えば、約40nm)形成することが望ましい。
半導体薄膜3は、ソース・ドレイン電極2の電極間のチャンネルを形成するように配置されており、ソース電極により電流が供給され、ドレイン電極により放出される。
半導体薄膜3は、酸化亜鉛(ZnO)を主成分とする酸化物半導体薄膜から形成されている。
この半導体薄膜3の厚みは、特に限定されないが、例えば約25〜200nmに形成され、好ましくは、約50〜100nm程度に形成される。
図1(b)は、ソース・ドレイン電極2と、半導体薄膜3との接合部分の一例を示した図であり、アルミニウム(Al)上にチタン(Ti)を積層した配線を形成し、インジウムスズ酸化物(ITO)によりこの積層体の一部を被覆する構造が示されている。
図1(b)において、ソース・ドレイン電極2は、アルミニウム層18、チタン層19、インジウムスズ酸化物(ITO)層20から形成され、半導体薄膜3は符号21として示されている。
基板17上にアルミニウム層18が設けられ、その少なくとも上面がチタン層19により被覆され、チタン層19の一部と基板上の一部を被覆してインジウムスズ酸化物(ITO)層20が存在し、インジウムスズ酸化物(ITO)層20の一部にて半導体薄膜21とコンタクトしている。
この第一ゲート絶縁膜4は、SiNx、SiOx、あるいはSiON等のシリコン系の化合物により、プラズマ化学気相成長(PCVD)法等を用いて形成され、半導体薄膜3に積層される。
第一ゲート絶縁膜の厚みは、特に限定されないが、例えば約20〜100nmに、好ましくは約50nmに形成される。
第二ゲート絶縁膜6は、SiNx、SiOx、あるいはSiON等のシリコン系の化合物により、プラズマ化学気相成長(PCVD)法等を用いて形成することができる。この第二ゲート絶縁膜6の厚みは、例えば、200〜400nmに形成され、好ましくは、約300nmに形成される。
ゲート電極7はCr、Tiといった金属膜からなり、その厚みは、例えば、50〜100nmに形成される。
表示電極8の厚みは、特に限定されないが、例えば約50〜100nmに形成される。
図2(1)に示される如く、ガラス基板1上全面に、マグネトロンスパッタ法等によりTi、Cr等の金属を例えば100nmの厚みで形成し、フォトリソグラフィーによりソース・ドレイン電極2を形成する。図示されていないが、ソース・ドレイン金属膜上にn+ZnOやインジウムスズ酸化物(ITO)等の透明導電膜が積層されている場合もある。
この際、半導体薄膜3の表面を清浄化する目的で、真空中にてプラズマ化学気相成長(PCVD)装置に基板を搬送後、酸素(O2)あるいは亜酸化窒素(N2O)といった酸化性ガスを用いたプラズマにより、基板表面を清浄化することが好ましい。特に、酸化性ガスとして酸素を用いた場合は、ArやXe、He、Krといった希ガスを酸素に添加したプラズマを用いることで、酸素ラジカルの発生量が増大し、半導体薄膜表面に吸着された有機成分や水分に対するクリーニング効率が増大すると同時に、添加ガスによるスパッタ効果により半導体薄膜表面の金属不純物が除去可能となるため、より好ましい。さらに、酸素ラジカル濃度が大きな状態で半導体薄膜の表面清浄化の工程を行うことで、半導体薄膜からの酸素脱離を防止することができ、酸素欠損による欠陥に起因するリーク電流を低減できる。
第一ゲート絶縁膜4の形成に際しては、大面積基板への成膜が可能なプラズマ化学気相成長(PCVD)法を用いることが好ましい。また、第一ゲート絶縁膜4としてSiOxを用いた場合には、SiOxの成膜後に、引き続きAr等の希ガスと酸素の混合ガスにてプラズマ処理を行うことが好ましい。この理由は、プラズマ処理を行うことでSiOx膜の酸化が促進し、絶縁耐圧が更に向上するからである。
第二ゲート絶縁膜6の形成方法は、特に限定されないが、例えば、プラズマ化学気相成長(PCVD)装置にて、SiNxを約200〜400nmの厚みで形成する。
第二ゲート絶縁膜6の形成は、プラズマ化学気相成長(PCVD)法を用いることが好ましい。この理由は、プラズマ化学気相成長(PCVD)法を用いることで、良好な第二ゲート絶縁膜6を大面積にわたり、形成できるからである。
その後フォトリソグラフィーとエッチングにてソース・ドレイン電極上にコンタクトホールを開口する。
この基板9は、絶縁体として設けられ、SiO2とAl2O3を成分とする無アルカリガラスによって形成されている。基板9の材料は、ガラスに限定されず、プラスチックや金属箔に絶縁物をコーティングしたもの等、絶縁物であれば使用可能である。
ゲート電極10はCr、Ti、Al、Ta、Wやその合金といった金属膜からなり、その厚みは、例えば約100nmに形成される。
このゲート絶縁膜11としては、SiNx、SiOx、あるいはSiON等のシリコン系化合物の膜を利用することができるが、SiNxが用いられることが多い。このゲート絶縁膜11の厚みは、例えば約200〜400nmに、好ましくは約300nmに形成される。
この半導体薄膜12は、酸化亜鉛(ZnO)を成分として形成される。
この半導体薄膜12の厚みは、特に限定されないが、例えば約50〜100nmに、好ましくは、約60nm程度に形成される。
この絶縁膜13としては、SiNx、SiOx、あるいはSiON等のシリコン系化合物の膜を利用することができるが、半導体薄膜12を保護する膜としての機能性からSiNxの膜を用いることが好ましい。この絶縁膜13の厚みは、例えば約30〜100nmに、好ましくは約50nmに形成される。
第一オーバーコート絶縁膜14を設けることで、絶縁膜13が被覆していない酸化亜鉛半導体薄膜12の側表面を確実に被覆することができる。
この第一オーバーコート絶縁膜14としては、特に限定されないが、例えばSiNx等のシリコン系化合物の膜を利用することができる。
この第一オーバーコート絶縁膜14の厚みは、例えば約150〜300nmに、好ましくは約200nmに形成される。
このソース・ドレイン電極15は、金属材料、例えば、Ti、Cr、Al、Mo、W、Taやこれらの合金もしくはインジウムスズ酸化物(ITO)やn+ZnOと酸化物材料等により形成される。また、これら電極15の厚みは、特に限定されないが、例えば約50〜300nmに形成される。
第二オーバーコート絶縁膜16を設けることにより、薄膜トランジスタ101のデバイス全体をより確実に保護することができる。
この第二オーバーコート絶縁膜16としては、特に限定されないが、例えば不純物に対する保護能に優れるSiNx膜を利用することができる。
第二オーバーコート絶縁膜16の厚みは、特に限定されないが、例えば約150〜500nmに、好ましくは300nmに形成される。
このゲート絶縁膜11の形成方法は、特に限定されないが、大面積基板への成膜が可能なプラズマ化学気相成長(PCVD)法を用いることが好ましく、例えば、SiNxを約200〜400nmの厚みで形成する。
ゲート絶縁膜11の成膜後に、酸素(O2)あるいは亜酸化窒素(N2O)といった酸化性ガスを用いたプラズマにより、基板表面を清浄化することが好ましい。特に、酸化性ガスとして酸素を用いた場合は、ArやXe、He、Krといった希ガスを酸素に添加したプラズマを用いることで、酸素ラジカルの発生量が増大し、半導体薄膜表面に吸着された有機成分や水分に対するクリーニング効率が増大すると同時に、添加ガスによるスパッタ効果により半導体薄膜表面の金属不純物が除去可能となるため、より好ましい。
この半導体薄膜12の形成方法は、特に限定されないが、例えばスパッタリング法にて酸化亜鉛半導体薄膜を約50〜100nmの厚みに形成する。
半導体薄膜12の形成に際しては、スパッタリング法あるいはイオンプレーティング法が好ましく用いられる。この理由は、酸化亜鉛(ZnO)の薄膜を大面積にわたり形成できるためである。
絶縁膜13は、各種化学気相成長(CVD)法を用いて形成することができる。
絶縁膜13の形成に際しては、プラズマ化学気相成長(PCVD)法を用いることが好ましい。この理由は、プラズマ化学気相成長(PCVD)法を用いることで、プラズマ処理と絶縁膜13の成膜を連続工程にて行うことができるからである。
絶縁膜13の厚みは例えば約30〜70nmに、好ましくは約50nmに形成される。
絶縁膜13の成膜前に、酸素(O2)あるいは亜酸化窒素(N2O)といった酸化性ガスを用いたプラズマにより、半導体薄膜12の表面を清浄化することが好ましい。特に、酸化性ガスとして酸素を用いた場合は、ArやXe、He、Krといった希ガスを酸素に添加したプラズマを用いることで、酸素ラジカルの発生量が増大し、半導体薄膜表面に吸着された有機成分や水分に対するクリーニング効率が増大すると同時に、添加ガスによるスパッタ効果により半導体薄膜表面の金属不純物が除去可能となるため、より好ましい。さらに、酸素ラジカル濃度が大きな状態で半導体薄膜の表面清浄化の工程を行うことで、半導体薄膜からの酸素脱離を防止することができ、酸素欠損による欠陥に起因するリーク電流を低減できる。
この絶縁膜13及び半導体薄膜12に対する一連のパターニングには、特に限定されず各種エッチング法を用いることができるが、例えば、絶縁膜13をCF4+O2等のガスを用いてドライエッチングし、次いでパターニングされた絶縁膜13をマスクとして0.2%HNO3溶液にて半導体薄膜12に対しウェットエッチングを行う方法が例示できる。
この第一オーバーコート絶縁膜14は、特に限定されないが、例えばSiNx等のシリコン系膜からなり、具体的にはSiH4+NH3等のガスを用いたプラズマ化学気相成長(PCVD)法を用いてSiNxを200nmの厚さで形成する。このプラズマ化学気相成長(PCVD)法を用いたSiNxの形成に用いるガスの成分としては、シランSiH4の代わりにテトラメチルシラン(CH3)4Siを用いても同様に行うことができる。
上記と同様の理由により、第一オーバーコート絶縁膜の成膜前の工程として、半導体薄膜の少なくとも一部が露出した状態で酸素(O2)あるいは亜酸化窒素(N2O)といった酸化性ガスを用いたプラズマにより、半導体薄膜12の表面を清浄化することが好ましい。この清浄化により、半導体薄膜12の上表面だけでなく、側表面にも良好な界面を形成することができる。
さらに、酸素ラジカル濃度が大きな状態で半導体薄膜の表面清浄化の工程を行うことで、半導体薄膜からの酸素脱離を防止することができ、酸素欠損による欠陥に起因するリーク電流を低減できる。
該コンタクトホール部分はフォトリソグラフィーとエッチングにより、絶縁膜13及び第一オーバーコート絶縁膜14を貫通して半導体薄膜12の表面に達する部分まで形成する。
二つのコンタクトホール部分は後述するソース・ドレイン電極を構成するソース電極、ドレイン電極によりそれぞれ充填される。
ソース・ドレイン電極15としては、マグネトロンスパッタ法にてTi、Cr、Al、Mo、W、Taやこれらの合金もしくはインジウムスズ酸化物(ITO)やn+ZnO等の酸化物材料を例えば約100nmの厚みで形成する。
ソース・ドレイン電極15はソース電極とドレイン電極からなり、上記の二つのコンタクトホール部分をそれぞれ充填して、間隔を有して形成される。
この第二オーバーコート絶縁膜16は、特に限定されないが、例えば不純物に対する保護能に優れるSiNx膜を利用することができ、具体的にはSiH4+NH3等のガスを用いたプラズマ化学気相成長(PCVD)法を用いてSiNxを200nmの厚さで形成する。このプラズマ化学気相成長(PCVD)法を用いたSiNxの形成に用いるガスの成分としては、シランSiH4の代わりにテトラメチルシラン(CH3)4Siを用いても同様に行うことができる。
この理由は、ゲート絶縁膜11と半導体薄膜12を真空中にて連続して行うことにより、両層の間に不純物の少ない良好な界面を形成することができるからである。
更に、上記したゲート絶縁膜11の形成工程と半導体薄膜12の形成工程に加えて、絶縁膜13の形成工程を続いて連続して行うことが好ましい。
この理由は、半導体薄膜12と絶縁膜13の間に不純物の少ない良好な界面を形成することができ、半導体薄膜12からの酸化亜鉛(ZnO)成分の還元脱離を防止することで、リーク電流の発生を抑止することができるからである。
酸化亜鉛半導体薄膜12にプラズマ処理を施す場合は、少なくともこのプラズマ処理と絶縁膜13の形成工程を真空中で連続して行うことが好ましい。
この理由は、半導体薄膜12と絶縁膜13の間に清浄な界面を形成することによって、良好なTFT特性を持たせることができるからである。
以下の方法(図2参照)により、本発明に係る製法に基づくトランジスタ(図1参照)を作成した。
まず、SiO2とAl2O3を主成分とする無アルカリガラスからなる基板1上にインジウムスズ酸化物(ITO)からなるソース・ドレイン電極2を40nmの厚みで形成した。
前記基板1及びソース・ドレイン電極2上の全面に半導体薄膜3として酸化亜鉛(ZnO)半導体薄膜を50nmの厚さで真空中においてRFスパッタリング法にて形成した。
その後、酸化亜鉛を形成した基板を真空中において界面制御形絶縁膜の成膜のため、プラズマ化学気相成長(PCVD)装置に搬送した。試験例で用いたプラズマ化学気相成長(PCVD)装置は、平行平板型の電極構造を持ち、接地電極上に設置した基板をヒーターにより加熱し、陽極側に高周波電力を投入し、電極間でのプラズマ放電を利用して膜を形成する。この装置においては、比較的容易に大面積に均一な厚さの薄膜を形成可能であるため、量産に適している。
前記半導体薄膜3の形成後、連続して半導体薄膜3に酸素(O2)及びArを含有したプラズマを用いてプラズマ処理を行った。これにより、表面が清浄化された酸化亜鉛半導体膜を得た。プラズマ処理を行った後、真空中にて連続して第一ゲート絶縁膜4となるSiO2の成膜を行った。SiO2の成膜はSiH4+N2Oガスを用いたプラズマ化学気相成長(PCVD)にて行い、膜厚は50nmに設定した。
ついで0.2%HNO3溶液にてZnO薄膜に対しウェットエッチングを行った。フォトレジストを除去し、前記第一ゲート絶縁膜4及びソース・ドレイン電極2を被覆するように、前記基板1、ソース・ドレイン電極2、ZnO半導体薄膜3、及び第一ゲート絶縁膜4上全面に亘ってSiNxからなる第二ゲート絶縁膜6を300nmの厚みで形成した。
この第二ゲート絶縁膜6の形成は、SiH4+NH3+N2ガスを用いたプラズマ化学気相成長(PCVD)法を用い、250℃にて行った。
ついで、Crからなるゲート電極7をゲート絶縁膜6上に100nmの厚みで形成する。ゲート電極の形成と同時に、前記ゲート電極7と同一材料により、前記コンタクトホールを介してソース・ドレイン電極を外部に取り出す電極であるコンタクト部5を形成し、その後、インジウムスズ酸化物(ITO)からなる表示電極8をこの一部上に100nmの厚みで形成してトランジスタを作成した。
比較例として、上記した方法において、酸化亜鉛半導体薄膜の積層工程までは試験例と同様に行った後、酸化亜鉛半導体薄膜層にフォトレジストをコーティングし、0.2%HNO3溶液にて酸化亜鉛半導体薄膜に対しウェットエッチングを行った。フォトレジストを除去し、第二ゲート絶縁膜、ゲート電極部、表示電極部を実施例と同様に積層してトランジスタを作成した。
試験例及び比較例のトランジスタを用い、ゲート電圧の変化に伴うドレイン電流の大きさを測定することにより、その伝達特性の評価を行った。
その結果を図5に示す。
これは、試験例のトランジスタにおいて、酸化亜鉛半導体薄膜と第一ゲート絶縁膜を真空中にて連続成膜したことで、酸化亜鉛半導体薄膜表面の有機汚染や金属不純物の付着が防止され、清浄な酸化亜鉛半導体薄膜とゲート絶縁膜との界面が形成されたことによるものと考えられる。
このオフ電流改善効果も、前記立ち上がり特性の改善効果同様、酸化亜鉛半導体薄膜と第一ゲート絶縁膜を真空中にて連続成膜したことで、酸化亜鉛半導体薄膜表面の有機汚染や金属不純物の付着が防止され、清浄な酸化亜鉛半導体薄膜とゲート絶縁膜との界面が形成され、界面リーク電流が減少したものと考えられる。
2 ソース・ドレイン電極
3 半導体薄膜
4 第一ゲート絶縁膜
4a フォトレジスト
5 コンタクト部
6 ゲート絶縁膜
7 ゲート電極
8 表示電極
9 基板
10 ゲート電極
11 ゲート絶縁膜
12 半導体薄膜
13 絶縁膜
14 第一オーバーコート絶縁膜
15 ソース・ドレイン電極
16 第二オーバーコート絶縁膜
17 基板
18 アルミニウム層
19 チタン層
20 インジウムスズ酸化物(ITO)層
21 半導体薄膜
100 トップゲート型薄膜トランジスタ
101 ボトムゲート型薄膜トランジスタ
Claims (11)
- 酸化亜鉛(ZnO)を主成分とする酸化物からなる半導体薄膜と、シリコン系絶縁膜からなり該半導体薄膜に接するゲート絶縁膜を有する薄膜トランジスタの製法において、前記半導体薄膜の形成と前記ゲート絶縁膜の形成が、真空中にて連続した工程で行われることを特徴とする薄膜トランジスタの製法。
- 前記半導体薄膜の形成が、スパッタリング法あるいはイオンプレーティング法にて行われることを特徴とする請求項1記載の薄膜トランジスタの製法。
- 前記ゲート絶縁膜の形成がプラズマ化学気相成長(PCVD)法により行われることを特徴とする請求項1又は2記載の薄膜トランジスタの製法。
- 前記薄膜トランジスタがトップゲート型薄膜トランジスタであって、前記半導体薄膜を形成後、前記ゲート絶縁膜を形成する際、その前工程として、該半導体薄膜を酸化性ガスを用いたプラズマ雰囲気にて表面処理を実施し、該表面処理に引き続き、真空中にて連続してゲート絶縁膜を形成することを特徴とする請求項1乃至3のいずれかに記載の薄膜トランジスタの製法。
- 前記酸化性ガスとして酸素もしくは亜酸化窒素(N2O)を用いることを特徴とする請求項4に記載の薄膜トランジスタの製法。
- 前記酸化性ガスとして酸素を用いる場合において、He、Ar、Xe、Krのうち、少なくとも1種類以上のガスを酸素と併用することを特徴とする請求項5に記載の薄膜トランジスタの製法。
- 前記薄膜トランジスタがボトムゲート型薄膜トランジスタであって、前記ゲート絶縁膜と半導体薄膜を真空中にて連続した工程で形成後、該半導体薄膜全面を被覆して設けられる絶縁膜の形成をさらに真空中にて連続で行うことを特徴とする請求項1乃至3のいずれかに記載の薄膜トランジスタの製法。
- 前記薄膜トランジスタがボトムゲート型薄膜トランジスタであって、前記ゲート絶縁膜と半導体薄膜を真空中にて連続した工程で形成後、該半導体薄膜全面を被覆して設けられる絶縁膜の形成の前工程として、前記半導体薄膜に酸化性ガスを用いたプラズマ雰囲気にて表面処理を実施し、該表面処理に引き続き、真空中にて連続して前記絶縁膜を形成することを特徴とする請求項7に記載の薄膜トランジスタの製法。
- 前記薄膜トランジスタがボトムゲート型薄膜トランジスタであって、前記ゲート絶縁膜と半導体薄膜及び半導体薄膜上の絶縁膜を真空中にて連続した工程で形成後、前記半導体薄膜並びに絶縁膜を薄膜トランジスタの活性層の形状に加工した後、前記半導体薄膜の少なくとも一部が露出した状態で酸化性ガスを用いたプラズマ雰囲気にて表面処理を実施し、該表面処理に引き続き、真空中にて連続して保護膜を形成することを特徴とする請求項7に記載の薄膜トランジスタの製法。
- 前記酸化性ガスとして酸素もしくは亜酸化窒素(N2O)を用いることを特徴とする請求項8又は9に記載の薄膜トランジスタの製法。
- 前記酸化性ガスとして酸素を用いる場合において、He、Ar、Xe、Krのうち、少なくとも1種類以上のガスを酸素と併用することを特徴とする請求項10に記載の薄膜トランジスタの製法。
Priority Applications (1)
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Publications (2)
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JP4870404B2 JP4870404B2 (ja) | 2012-02-08 |
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ID=37934789
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Date | Code | Title | Description |
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A621 | Written request for application examination |
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RD02 | Notification of acceptance of power of attorney |
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A131 | Notification of reasons for refusal |
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A977 | Report on retrieval |
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A521 | Written amendment |
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TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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R150 | Certificate of patent or registration of utility model |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20141125 Year of fee payment: 3 |
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R250 | Receipt of annual fees |
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LAPS | Cancellation because of no payment of annual fees |