DE60005875T2 - Herstellungsverfahren für einen porösen Siliziumdioxid-Film - Google Patents
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Description
- Die vorliegende Erfindung betrifft ein Verfahren zur Ausbildung eines isolierenden Films als Zwischenschicht und genauer ein Verfahren zur Ausbildung eines isolierenden Films mit niedriger Dielektrizitätskonstante als Zwischenschicht, was für ein hochintegriertes Halbleiterbauteil erforderlich ist. Der Halbleiterbauteile betreffende Fortschritt bei der hohen Integration hat in den vergangenen Jahren zu einem engeren Abstand zwischen den Verdrahtungsleitungen geführt. Eine engerer Abstand zwischen den Verdrahtungsleitungen verursacht eine erhöhte Kapazität zwischen den Verdrahtungsleitungen, daher besteht Nachfrage nach der Ausbildung eines isolierenden Films als Zwischenschicht, der eine niedrige Dielektrizitätskonstante aufweist.
- Mit dem jüngsten Fortschritt der hohen Integration von LSI-Bauteilen wurden die Verdrahtungsleitungen in den Mikromaßstab überführt und mehrschichtig ausgeschaltet. Ebenso gab es Anstieg der Kapazität zwischen den Verdrahtungsleitungen. Ein solcher Anstieg der Kapazität hat die Betriebsgeschwindigkeiten stark vermindert. Somit wurden diesbezügliche Verbesserungen stark angefordert. Als eine Verbesserungsmaßnahme ist ein Verfahren zur Verringerung der Kapazität zwischen den Verdrahtungslinien untersucht worden. Dieses Verfahren nutzt einen isolierenden Film als Zwischenschicht, der eine niedrigere Dielektrizitätskonstante als das gegenwärtig für isolierende Filme als Zwischenschicht genutzte SiO2 aufweist.
- Typische isolierende Filme als Zwischenschichten mit niedriger Dielektrizitätskonstante die gegenwärtig untersucht werden, sind (1) ein SiOF-Film und (2) ein organischer isolierender Film mit niedriger Dielektrizitätskonstante. Diese Filme sollen nun beschrieben werden.
- (1) SiOF-Film
- sEin SiOF-Film wird unter Anwendung eines Gases ausgebildet, enthaltend F, und durch Ersetzen einer Si-F-Bindung für einen Teil der Si-O-Bindungen in dem SiO2. Dieser SiOF-Film weist eine relative Dielektrizitätskonstante auf, die mit steigender Konzentration von F im Film monoton sinkt.
- Zur Ausbildung solcher SiOF-Filme sind zahlreiche Verfahren berichtet worden (siehe Seite 82 der monatlichen Zeitschrift "Semiconductor World", Ausgabe Februar 1996). Am vielversprechensten unter diesen Verfahren ist eines zur Ausbildung eines SiOF-Films unter Anwendung von SiH4, O2, Ar und SiF4 als Quellgase und unter Anwendung eines hochdichten plasmaverstärkten CVD-Verfahrens (HDPCVD-Verfahren). Eine relative Dielektrizitätskonstante eines über dieses Verfahren ausgebildeten SiOF-Films liegt im Bereich von 3,1 bis 4,0 (schwankt in Abhängigkeit der F-Konzentration im Film). Dieser Wert ist niedriger als eine relative Dielektrizitätskonstante von 4,0 für SiO2, das herkömmlich für den isolierenden Film als Zwischenschicht genutzt worden ist.
- (2) Organischer isolierender Film mit niedriger Dielektrizitätskonstante
- Als ein isolierender Film, der eine niedrigere Dielektrizitätskonstante (3,0 oder darunter) im Vergleich zum SiOF-Film aufweist, steht nun eine organischer isolierender Film mit niedriger Dielektrizitätskonstante im Zentrum der Aufmerksamkeit. Tabelle 1 zeigt einige wenige organische isolierende Filme geringer Dielektrizitätskonstante, die beschrieben worden sind, und die jeweiligen relativen Dielektrizitätskonstanten und thermischen Zersetzungstemperaturen derselben. TABELLE 1
- Der SiOF-Film ist jedoch dahingehend nachteilig, dass ein Anstieg der F-Konzentration im Film zu einer Verringerung der Beständigkeit gegen Feuchtigkeitsabsorption führt. Diese verringerte Beständigkeit gegen Feuchtigkeitsabsorption stellt ein ernsthaftes Problem dar, da die Transistoreigenschaften und die Haftung einer oberen metallischen Sperrschicht beeinträchtigt sind.
- Ein Abblättern tritt in dem organischen isolierenden Film mit einer niedrigen Dielektrizitätkonstante leicht auf und zwar aufgrund der schlechten Haftung auf dem Silikonwafer oder dem SiO2-Film. Darüber hinaus ist der organische isolierende Film dahingehend nachteilig, dass die Wärmebeständigkeit gering ist, da seine thermische Zersetzungstemperatur um 400 °C liegt. Der Nachteil der geringen Wärmebeständigkeit stellt ein Problem für das Annealen eines Wafers bei hoher Temperatur dar.
- Die EP-A-0 435 161 offenbart ein Verfahren zur Produktion eines Halbleiterbauteils, die Abscheidung eines CVD-SiO2-Films bei einer gegebenen ersten O3-Konzentration gemäß einer TEOS-O3-Reaktion, der eine weitere Abscheidung eines CVD-SiO2-Films an einer bei einer zweiten O3-Konzentration erfolgt, die höher als die erste O3-Konzentration ist, nach dem TEOS-O3-Verfahren, um einen CVD-SiO2-Film mit einer vorbestimmten Dicke und einer wenig unebenen Oberfläche auszubilden.
- Die US-A-5,614,270 offenbart eine über Flüssigphasenabscheidung gezogene SiO2Schicht, die einer Sauerstoff- oder Wasserstoff-Plasmabehandlung unterworfen wird, um ihre physikalischen und elektrischen Eigenschaften zu verbessern.
- ZUSAMMENFASSUNG DER ERFINDUNG
- Es ist eine Aufgabe der vorliegenden Erfindung, ein Verfahren zur Ausbildung eines isolierenden Films mit einer niedrigen Dielektrizitätskonstanten als Zwischenschicht, wie in Anspruch 1 definiert, bereitzustellen, welcher Film gute Beständigkeit gegen Feuchtigkeitsabsorption und Wärmebeständigkeit aufweist.
- Gemäß dem Verfahren der Erfindung zur Ausbildung eines isolierenden Films als Zwischenschicht wird zunächst ein poröser SiO2-Film auf einem zu bildenden Objekt ausgebildet. Dieser poröse SiO2-Film wird unter Anwendung eines chemischen Dampfabscheidungsverfahrens ausgebildet, das Quellgase nutzt, enthaltend TEOS (Tetraethoxysilan) und O3, worin die Konzentration des O3 geringer als diejenige ist, die zum Oxidieren des TEOS erforderlich ist. Dementsprechend bilden sich viele Lücken in dem Film. In anderen Worten wird auf diese Weise dem ausgebildeten SiO2-Film Porosität verliehen.
- Daher ist eine Dielektrizitätskonstante des porösen SiO2-Films kleiner als diejenige eines üblichen SiO2-Films, der keine Porosität aufweist.
- Das Verfahren zur Ausbildung des oben genannten porösen SiO2-Films wird auf einen Damascene Prozess bzw. Einkerbungsprozess angewandt. Gemäß diesem Einkerbungsprozess wird eine Verdrahtungsschicht aus Cu (Kupfer) mit geringem elektrischen Widerstand ausgebildet. Durch Kombinieren der Verdrahtungsschicht aus Cu (Kupfer) mit dem oben genannten porösen SiO2-Film ist es möglich, ein Halbleiterbauteil bereitzustellen, worin die parasitische Kapazität einer Verdrahtungsleitung gering und die Datenverarbeitungsgeschwindigkeit hoch ist.
- Viertens wird gemäß dem Verfahren der vorliegenden Erfindung zur Ausbildung eines isolierenden Films als Zwischenschicht nach Ausbildung des oben genannten porösen SiO2-Films eine H-Plasmabehandlung (Wasserstoff-Plasmabehandlung) durchgeführt. Dementsprechend wird eine Si-H-Bindung für eine freie Bindung des Si in einer Si-O-Bindung in der Oberfläche der Lücke ersetzt, und kann die Oberfläche der Lücke somit stabil gestaltet werden.
- Daher kann der Eintritt von Feuchtigkeit von der Oberfläche der Lücke her verhindert werden und ist es möglich, einen isolierenden Film als Zwischenschicht auszubilden, der gute Beständigkeit gegen Feuchtigkeitsabsorption aufweist.
- KURZE BESCHREIBUNG DER ZEICHNUNGEN
- Die
1A bis1G sind Querschnittsansichten, von denen jede ein Verfahren zur Ausbildung eines isolierenden Films als Zwischenschicht gemäß einer ersten Ausführungsform der vorliegenden Erfindung zeigt; - die
2A bis2L sind Querschnittsansichten, von denen jede ein Verfahren zur Ausbildung eines isolierenden Films als Zwischenschicht gemäß einer zweiten Ausführungsform der Erfindung zeigt. - BESCHREIBUNG DER BEVORZUGTEN AUSFÜHRUNGSFORMEN
- Als nächstes sollen die bevorzugten Ausführungsformen der vorliegenden Erfindung unter Bezugnahme auf die angefügten Zeichnungen beschrieben werden.
- Erste Ausführungsform nur zur Veranschaulichung
- Die
1A bis1G sind Querschnittsansichten, von denen jede eine erste Ausführungsform der vorliegenden Erfindung veranschaulicht. - Zunächst wird, wie in
1A gezeigt, ein BPSG-Film102 (Borphosphorsilikatglasfilm) auf einem Siliziumsubstrat101 gebildet. Anschließend wird, nachdem ein Aluminiumfilm auf dem BPSG-Film102 ausgebildet wurde, eine Aluminiumverdrahtungsschicht103 durch Mustern des Aluminiumfilms ausgebildet. Das Siliziumsubstrat101 , der BPSG-Film102 und die Aluminiumverdrahtungsschicht103 , die auf diese Weise ausgebildet wurden, stellen ein zu formendes Objekt104 dar. - Dann wird, wie in
1B gezeigt, ein SiO2-Film105 (darunter liegender isolierender Film) auf dem auszubildenden Objekt104 gebildet. Dieser SiO2-Film105 wird über ein plasmaverstärktes CVD-Verfahren (plasmaverstärktes chemisches Dampfabscheidungsverfahren) ausgebildet, und SiH4 und N2O werden als Quellgase genutzt. Die Filmdicke dieses SiO2-Films105 beträgt 100nm. - Anschließend wird, wie in
1C gezeigt, ein poröser SiO2-Film106 auf dem SiO2-Film105 (dem darunter liegenden isolierenden Film) ausgebildet. Dieser poröse SiO2-Film106 wird mit Hilfe eines atmosphärischen CVD-Verfahren (atmosphärisches chemisches Dampfabscheidungsverfahren) ausgebildet. Für das CVD-Verfahren sind TEOS (Tetraethoxysilan), O3 geringer Konzentration und O2 in dem Quellgas enthalten. Hier wird das O3 geringer Konzentration als das O3 mit einer Konzentration definiert, die geringer als diejenige ist, die zum Oxidieren des TEOS erforderlich ist. Genauer beträgt die Strömungsgeschwindigkeit des TEOS 25 sccm und diejenige von O2 7,5 slm. Das O3 ist in dem O2 in 1–2 % gemäß Verhältnis der Strömungsgeschwindigkeit enthalten. - Darüber hinaus ist auch N2 (Stickstoff) mit einer Strömungsgeschwindigkeit von 1–3 slm im Quellgas enthalten. Die Temperatur des Siliziumsubstrats
101 wird während der Ausbildung des SiO2-Films106 auf 400 °C gehalten. - Im Allgemeinen wurde im Falle des atmosphärischen CVD-Verfahrens, das TEOS und O3 als Quellgase nutzt, das folgende für eine dadurch ausgebildeten SiO2-Film entdeckt. D. h., dass mit steigender Konzentration von O3 im Quellgas die Oxidation des TEOS schneller auf einem Wafer voranschreitet, um einen SiO2-Film mit guter Fließfähigkeit zu erhalten. Im Gegenzug ist mit sinkender Konzentration von O3 die Oxidation des TEOS unzureichend. Dementsprechend verbleiben dann, wenn die Konzentration von O3 niedrig ist, viele CH- oder OH-Radikale in einem auf dem Wafer ausgebildeten SiO2-Film. Insbesondere tritt dann, wenn es sich bei einem darunter liegendem Film um einen SiO2-Film handelt, ein anormales Wachstum eines SiO2-Films mit rauer Oberfläche auf, indem man O3 in niedrigen Konzentration mit TEOS verwendet.
- Der poröse SiO2-Film
106 wird durch Anwendung des oben genannten anormalen Wachstums des SiO2-Films ausgebildet, und viele Lücken bilden sich in dem Film. - Dann wird, wie in
1D ezeigt, eine H-Plasmabehandlung (Wasserstoff-Plasmabehandlung) an dem porösen SiO2 Film106 ausgeführt. - Diese H-Plasmabehandlung erfolgt durch Bereitstellen von H2 mit 600 sccm an eine Kammer (nicht gezeigt) und Anlegen einer RF-Energie an obere und untere Elektroden (nicht gezeigt), die einander in der Kammer gegenüberliegen. Die an die obere Elektrode angelegte RF-Energie hat einer Frequenz von 13,56 MHz und eine Energie von 50 W. Andererseits weist die RF-Energie, die an die untere Elektrode angelegt wird, eine Frequenz von 400 kHZ und eine Energie von 400 W auf. Darüber hinaus beträgt während der H-Plasmabehandlung der Druck in der Kammer 0,1 ~ 0,2 Torr, und die Temperatur des Siliziumsubstrats
101 wird auf 400 °C gehalten. Noch weiterhin dauert die H-Plasmabehandlung 60 Sekunden. - Die H-Plasmabehandlung ersetzt Si-H-Bindungen für freie Bindungen des Si in einer Si-O-Bindung an der Oberfläche der Lücke. Dementsprechend wird es OH-Radikalen und Wasser erschwert, an die freien Bindungen des Si zu binden, was die Feuchtigkeitsabsorptionsbeständigkeit des Films verbessert.
- Anschließend wird, wie in
1E gezeigt, ein SiO2-Film107 auf dem porösen SiO2-Film106 ausgebildet. Dieser SiO2-Film107 wird über ein atmosphärisches CVD-Verfahren ausgebildet, für das ein Quellgas, enthaltend O2, O3 und TEOS, genutzt wird. Diesmal beträgt die Strömungsgeschwindigkeit des TEOS 25 sccm und diejenige von O2 7,5 slm. Darüber hinaus enthält das O2 O3 in 5 ~ 6 % im Verhältnis der Strömungsgeschwindigkeit, was für die Oxidation des TEOS ausreichend ist. Dementsprechend weist; wie oben beschrieben, der SiO2-Film107 gute Fließfähigkeit auf. Somit wird sogar dann, wenn der darunter ausgebildete SiO2-Film106 konvexe und konkarve Stellen in der Oberfläche aufweist, der SiO2-Film107 so ausgebildet, dass er eine nahezu glatte Oberflächenform aufweist, und ein Selbsteinebnen wird durchgeführt. - Darüber hinaus ist auch N2 (Stickstoff) mit einer Strömungsgeschwindigkeit von 1 ~ 3 in dem Quellgas enthalten. Und die Temperatur des Siliziumsubstrats
101 wird während der Bildung des SiO2-Films107 auf 400 °C gehalten. - Im Anschluss werden, wie in
1F gezeigt, der SiO2-Film107 und der poröse SiO2-Film106 , die über einer konvexen Stelle103a der Aluminiumverdrahtungsschicht ausgebildet sind, zum Planarisieren über ein CMP-Verfahren (chemisch mechanisches Polierverfahren) poliert. Nach vollständigem Polieren sind der SiO2-Film105 (darunter liegender isolierender Film), der auf der konvexen Stelle103a der Aluminiumverdrahtungsschicht ausgebildet ist, wie auch der poröse SiO2-Film106 der auf einer konkarven Stelle103b derselben Schicht ausgebildet ist, auf der Oberfläche exponiert. - Anschließend wird, wie in
1G gezeigt, ein SiO2-Film108 (isolierender Deckfilm) auf dem SiO2-Film105 (darunter liegenden isolierenden Film), der auf der konvexen Stelle103a der Aluminiumverdrahtungsschicht ausgebildet ist, und auf dem porösen SiO2-Film106 , der auf der konkaven Stelle103b derselben ausgebildet ist, gebildet. Dieser SiO2-Film108 wird über ein plasmaverstärktes CVD-Verfahren ausgebildet. Die diesmal genutzten Quellgase sind SiH4 und N2O, und die Filmdicke des SiO2-Films108 beträgt 100nm. - Das oben genannte Verfahren zur Ausbildung der SiO2-Filme
105 (darunter liegender isolierender Film),106 und108 (isolierender Deckfilm) führt zur Bildung eines isolierenden Films als Zwischenschicht mit niedriger Dielektrizitätskonstanter auf dem zu bildenden Objekt104 , der gute Wärmebeständigkeit und Beständigkeit gegen Feuchtigkeitsabsorption aufweist. D. h., dass eine Dielektrizitätskonstante desselben 2,0 bis 3,0 beträgt, da der SiO2-Film106 porös ist. Dieser Wert ist kleiner als eine Dielektrizitätskonstante von 4,0 eines übliche SiO2-Films. Auch kann, da der üblich SiO2-Film108 auf dem porösen SiO2-Film106 ausgebildet ist, der Eintritt von Feuchtigkeit in den SiO2-Film106 verhindert werden. - Darüber hinaus kann die H-Plasmabehandlung für den SiO2-Film
106 die Beständigkeit des Films106 gegen Feuchtigkeitsabsorption verbessern. - Noch weiterhin weisen die SiO2-Filme
105 ,106 und108 verbesserte Wärmebeständigkeit im Vergleich zum organischen isolierenden Film des Standes der Technik auf, da diese Filme hauptsächlich aus Si und O bestehen. - Zweite Ausführungsform
- Die
2A bis2L sind Querschnittsansichten, von denen jede eine zweite Ausführungsform veranschaulicht. - Die zweite Ausführungsform ist ein Fall der Anwendung der ersten Ausführungsform auf ein Einschnittsverfahren (damascene process).
- Zunächst wird, wie in
2A gezeigt, ein BPSG-Film202 (Borphosphorsilikatglasfilm) auf einem Siliziumsubstrat201 gebildet. Nach Ausbildung einer Aluminiumschicht auf dem BPSG-Film202 wird eine Aluminiumverdrahtungsschicht203 durch Mustern der Aluminiumschicht gebildet. Anschließend stellen das Siliziumsubstrat201 der BPSG-Film202 und die Aluminiumverdrahtungsschicht203 ein zu bildendes Objekt204 dar. - Im Folgenden wird, wie in
2B gezeigt ein SiO2-Film205 (darunter liegender isolierender Film) mit einer Filmdicke von 100 nm auf der Aluminiumverdrahtungsschicht203 ausgebildet. Dieser SiO2-Film205 wird über ein plasmaverstärktes CVD-Verfahren (plasmaverstärktes chemisches Dampfabscheidungsverfahren) ausgebildet, und SiH4 und N2O werden als Quellgase genutzt. - Dann wird, wie in
2C gezeigt, ein SiO2-Film206 mit einer Filmdicke von 500 nm auf dem SiO2-Film205 (darunter liegenden isolierenden Film) ausgebildet. Dieser SiO2-Film206 wird über ein atmosphärisches CVD-Verfahren (atmosphärisches chemisches Dampfabscheidungsverfahren) ausgebildet, für das das Quellgas genutzt wird, welches O2, O3 in geringer Konzentration und TEOS (Tetraethoxysilan) enthält. - Hier wird das O3 in geringer Konzentration als das O3 definiert; welches eine geringere Konzentration als diejenigen hat, die zum Oxidieren des TEOS erforderlich ist. Insbesondere beträgt die Strömungsgeschwindigkeit des TEOS 25 sccm und diejenige von O2 7,5 slm. Das O3 ist in dem O2 in 1 ~ 2 % nach Verhältnis der Strömungsgeschwindigkeit enthalten.
- Wie oben in der ersten Ausführungsform beschrieben, wird dem SiO2-Film
206 Porosität verliehen, da O3 geringer Konzentration verwendet wird. Daher bilden sich viele Lücken in dem SiO2-Film206 . - Es sei angemerkt, dass auch N2 (Stickstoff) mit einer Strömungsgeschwindigkeit von 1 – 3 slm in dem Quellgas enthalten ist. Die Temperatur des Siliziumsubstrats
201 wird während der Bildung des SiO2-Films206 auf 400 °C gehalten. - Anschließend wird, wie in
2D gezeigt, eine H-Plasmabehandlung (Wasserstoff-Plasmabehandlung) an dem SiO2-Film206 durchgeführt. Die Verfahrensbedingungen für die H-Plasmabehandlung sind dieselben, wie in der ersten Ausführungsform erläutert. Dementsprechend wird diese durch Bereitstellen von N2 mit 600 sccm an eine Kammer (nicht gezeigt) und Anlegen einer RF-Energie an obere und untere Elektroden (nicht gezeigt) durchgeführt, die einander in der Kammer gegenüber liegen. Die an die obere Elektrode angelegte RF-Energie weist eine Frequenz von 13,56 MHz und eine Energie von 50 W auf. Andererseits hat die an die untere Elektrode angelegte RF-Energie eine Frequenz von 400 kHz und eine Energie von 400 W. Weiterhin beträgt während der H-Plasmabehandlung der Druck in der Kammer 0,1 ~ 0,2 Torr, und die Temperatur des Siliziumsubstrats201 wird auf 400 °C gehalten. Noch weiterhin dauert die N-Plasmabehandlung 60 Sekunden. - Die H-Plasmabehandlung ersetzt Si-H-Bindungen für freie Bindungen des Si in einer Si-O-Bindung in der Oberfläche der Lücke. Dementsprechend wird es OH-Radikalen und Wasser erschwert, an die freien Bindungen des Si zu binden, was die Feuchtigkeitsabsorptionsbeständigkeit des Films verbessert.
- Anschließend werden, wie in
2E gezeigt, die SiO2-Filme205 und206 gemustert, um einen Einschnitt (damascene trench) 207 zu bilden. Dieser Einschnitt207 erreicht die unterhalb des SiO2-Films206 ausgebildete Aluminiumverdrahtungsschicht203 . - Anschließend wird, wie in
2F gezeigt, ein SiO2-Film208 (zweiter isolierender Film) auf dem SiO2-Film206 und den Seiten- und Bodenanteilen des Einschnittes207 gebildet. Dieser SiO2-Film208 wird über ein plasmaverstärktes CVD-Verfahren ausgebildet, und SiH4 und N2O werden als Quellgase genutzt. Mit Hilfe dieses auf den Seitenteilen des Einschnittes207 ausgebildeten SiO2-Films208 kann in dem Einschnitt207 später verborgenes Cu am Dispergieren innerhalb des porösen SiO2-Films206 gehindert werden. - Anschließend erfolgt, wie in
2G gezeigt, ein anisotropes Ätzen des SiO2-Films208 (zweiten isolierenden Films). Während dieses Ätzens den auf den Bodenteilen des Einschnittes207 ausgebildeten SiO2-Film208 eliminiert, wird der auf den Seitenteilen des Einschnittes207 ausgebildete SiO2-Film208 in diesem Ätzen nicht eliminiert. Der verbleibende SiO2-Film208 stellt einen die Seitenwände isolierenden Film auf dem Seitenteil des Einschnittes207 dar. - Anschließend wird, wie in
2N gezeigt, ein Cu(Kupfer)-platierter Film209 in dem Einschnitt207 und auf dem SiO2-Film206 ausgebildet. Der in dem Einschnitt207 ausgebildete Cu-platierte Film209 wird als Cu-Verdrahtungsleitung genutzt. - Anschließend wird, wie in
21 gezeigt, der auf dem SiO2-Film206 ausgebildete Cu-platierte Film209 poliert und über ein CMP-Verfahren (chemisch mechanisches Polierverfahren) eliminiert. Dementsprechend verbleibt der Cu-platierte Film ausschließlich in dem Einschnitt207 . - Anschließend wird, wie in
2J gezeigt, ein TiN-Film210 als metallische Sperre auf dem Einschnitt207 ausgebildet. Dementsprechend kann man das Cu in dem Einschnitt207 daran hindern, in einen SiO2-Film zu dispergieren, der später über dem Einschnitt207 ausgebildet wird. - Anschließend erfolgt ein Mustern, wie in
2K gezeigt, um einem TiN-Film210a zu belassen, der über dem Einschnitt207 ausgebildet ist, und der in anderen Teilen gebildete TiN-Film210 wird zum Eliminieren geätzt. - Anschließend wird, wie in
2L gezeigt, ein SiO2-Film211 (isolierender Deckfilm) auf dem SiO2-Film206 und dem TiN-Film210a gebildet. Dieser SiO2-Film211 wird über ein plasmaverstärktes CVD-Verfahren ausgebildet, und SiH4 und N2O werden als Quellgase genutzt. - Das obige Verfahren führt zur Bildung eines isolierenden Films als Zwischenschicht mit niedriger Dielektrizitätskonstante auf dem zu bildenden Objekt
204 , der gute Wärmebeständigkeit und Beständigkeit gegen Feuchtigkeitsabsorption aufweist. Dies meint, dass der SiO2-Film206 porös ist und eine Dielektrizitätskonstante von 2,0 bis 3,0 hat. Dieser Wert ist kleiner als eine Dielektrizitätskonstante von 4,0 eines übliche SiO2-Films. Auch kann, da der übliche SiO2-Film211 (isolierender Deckfilm) auf dem porösen SiO2-Film206 ausgebildet ist, der Eintritt von Feuchtigkeit in den SiO2-Film206 verhindert werden. - Darüber hinaus kann die H-Plasmabehandlung am SiO2-Film
206 die Beständigkeit gegen Feuchtigkeitsabsorption des Films206 verbessern. - Noch weiterhin weisen die SiO2-Filme
206 und 211 im Vergleich zum organischen isolierenden Film des Standes der Technik bessere Wärmebeständigkeit auf, da diese Filme hauptsächlich aus Si und 0 bestehen.
Claims (6)
- Verfahren zum Ausbilden eines isolierenden Films als Zwischenschicht, umfassend die Schritte: Ausbilden eines porösen SiO2-Films (
206 ) auf einem Objekt (204 ), der durch eine chemische Dampfabscheidung ausgebildet wird, die ein Ausgangsmaterialgas nutzt, enthaltend TEOS (Tetraethoxysilan) und O3, worin das O3 in dem Ausgangsmaterialgas in einer Konzentration von 1 – 2 % der Strömungsgeschwindigkeit im O2 enthalten ist, welche Konzentration niedriger als diejenige Konzentration ist, die zum Oxidieren des TEOS erforderlich ist; Ausbilden eines Einschnitts (207 ) (Damaszene trench) in dem porösen SiO2-Film (206 ), worin der Einschnitt (207 ) das zu bildende Objekt (204 ) erreicht; Ausbilden eines isolierenden Seitenwandfilms auf einem Seitenteil des Einschnittes (207 ); Versenken eines metallischen Films (209 ) in dem Einschnitt (207 ); und Ausbilden eines metallischen Sperrfilms (210a ) auf dem metallischen Film (209 ). - Verfahren gemäß Anspruch 1, zusätzlich umfassend die Schritte: Ausbilden eines darunter liegenden isolierenden Films (
105 ,205 ) auf dem Objekt (104 ,204 ) vor Ausbilden des porösen SiO2-Films (106 ,206 ); und Ausbilden des porösen SiO2-Films (106 ,206 ) auf dem darunter liegenden isolierenden Film (105 ,205 ). - Verfahren gemäß Anspruch 1, zusätzlich umfassend den Schritt: Polieren einer Oberfläche des SiO2-Films (
107 ) mit Hilfe eines CMP-Verfahrens (chemisch mechanisches Polierverfahren). - Verfahren gemäß einem der Ansprüche 1 bis 3, zusätzlich umfassen den Schritt: Ausbilden eines isolierenden Abdeckfilms (
211 ) auf dem porösen SiO2-Film (206 ) und dem metallischen Sperrfilm (210a ) nach Bildung des metallischen Sperrfilms (210a ). - Verfahren gemäß einem der Ansprüche 1 bis 4, zusätzlich umfassend den Schritt: Durchführen einer Wasserstoff-Plasmabehandlung an dem porösen SiO2-Film (
106 ,206 ) nach Ausbildung des porösen SiO2-Films (106 ,206 ). - Verfahren nach einem der Ansprüche 1 bis 5, worin das Objekt (
104 ) ein Siliziumsubstrat (101 ,201 ) umfasst.
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US8524616B2 (en) * | 2008-11-12 | 2013-09-03 | Microchip Technology Incorporated | Method of nonstoichiometric CVD dielectric film surface passivation for film roughness control |
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Family Cites Families (16)
Publication number | Priority date | Publication date | Assignee | Title |
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