DE102009044639A1 - Bauelement mit einem Halbleiterchip - Google Patents
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- H01L2224/0401—Bonding areas specifically adapted for bump connectors, e.g. under bump metallisation [UBM]
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- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/04105—Bonding areas formed on an encapsulation of the semiconductor or solid-state body, e.g. bonding areas on chip-scale packages
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- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/12105—Bump connectors formed on an encapsulation of the semiconductor or solid-state body, e.g. bumps on chip-scale packages
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- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32245—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
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- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73267—Layer and HDI connectors
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- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/82—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected by forming build-up interconnects at chip-level, e.g. for high density interconnects [HDI]
- H01L2224/821—Forming a build-up interconnect
- H01L2224/82101—Forming a build-up interconnect by additive methods, e.g. direct writing
- H01L2224/82103—Forming a build-up interconnect by additive methods, e.g. direct writing using laser direct writing
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- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/8319—Arrangement of the layer connectors prior to mounting
- H01L2224/83192—Arrangement of the layer connectors prior to mounting wherein the layer connectors are disposed only on another item or body to be connected to the semiconductor or solid-state body
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- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
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- H01L2224/8385—Bonding techniques using a polymer adhesive, e.g. an adhesive based on silicone, epoxy, polyimide, polyester
- H01L2224/83855—Hardening the adhesive by curing, i.e. thermosetting
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- H01L2225/1005—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/1011—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
- H01L2225/1017—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support
- H01L2225/1035—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support the device being entirely enclosed by the support, e.g. high-density interconnect [HDI]
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Abstract
Die Erfindung betrifft ein Bauelement (100) mit einer Metallschicht (10), einem Halbleiterchip (11), der elektrisch an die Metallschicht (10) gekoppelt und darüber platziert ist, einem Kapselungsmaterial (12), das die Metallschicht (10) und den Halbleiterchip (11) bedeckt, und mindestens einem Durchgangsloch (17), das durch das Kapselungsmaterial (12) verläuft, wobei das mindestens eine Durchgangsloch (17) einen Abschnitt der Metallschicht (10) exponiert, der von außerhalb des Bauelements (100) zugänglich ist.
Description
- Die vorliegende Erfindung betrifft ein Bauelement mit einem Halbleiterchip und ein Verfahren zu dessen Herstellung.
- Die Miniaturisierung ist ein anhaltender Trend in der Technologie der Kapselung von integrierten Schaltungen in Richtung kleineren Skalen für Halbleiterbauelemente. Verschiedene Techniken können verwendet werden, um kleinere Halbleiterpackages herzustellen, wie etwa Chip-Skale-Packaging, Wafer-Level-Packaging oder Chip-Stapeln.
- Der vorliegenden Erfindung liegt die Aufgabe zugrunde, ein Bauelement mit einem Halbleiterchip anzugeben, das sich für die Stapelung von Bauelementen eignet. Ferner soll ein Herstellungsverfahren für ein derartiges Bauelement angegeben werden.
- Die der Erfindung zugrunde liegende Aufgabenstellung wird durch die Merkmale der unabhängigen Patentansprüche gelöst. Vorteilhafte Ausgestaltungen und Weiterbildungen der Erfindung sind in den Unteransprüchen angegeben.
- Die vorliegenden Zeichnungen sind aufgenommen, um ein eingehenderes Verständnis von Ausführungsformen zu vermitteln, und sind in diese Beschreibung aufgenommen und stellen einen Teil dieser dar. Die Zeichnungen veranschaulichen Ausführungsformen und dienen zusammen mit der Beschreibung der Erläuterung von Prinzipien von Ausführungsformen. Andere Ausführungsformen und viele der beabsichtigten Vorteile von Ausführungsformen lassen sich ohne weiteres verstehen, wenn sie durch Be zugnahme auf die folgende ausführliche Beschreibung besser verstanden werden. Die Elemente der Zeichnungen sind relativ zueinander nicht notwendigerweise maßstabsgetreu. Gleiche Bezugszahlen bezeichnen entsprechende ähnliche Teile.
-
1 zeigt schematisch eine Querschnittsansicht einer Ausführungsform eines Bauelements mit einem Halbleiterchip, einem Kapselungsmaterial und einem Durchgangsloch durch das Kapselungsmaterial. -
2 zeigt schematisch eine Querschnittsansicht einer Ausführungsform eines Moduls mit zwei aufeinandergestapelten Bauelementen. -
3A bis3M zeigen schematisch eine Querschnittsansicht einer Ausführungsform eines Verfahrens zum Herstellen eines Bauelements mit einem Träger, einem Halbleiterchip, einem Kapselungsmaterial und einem Durchgangsloch durch das Kapselungsmaterial. -
4A bis4K zeigen schematisch eine Querschnittsansicht einer Ausführungsform eines Verfahrens zum Herstellen eines Bauelements mit einem Halbleiterchip, einem Kapselungsmaterial und einem Durchgangsloch durch das Kapselungsmaterial. -
5A bis5C zeigen schematisch eine Querschnittsansicht einer Ausführungsform eines Verfahrens zum Herstellen eines Moduls mit zwei aufeinandergestapelten Bauelementen und das Montieren des Moduls auf einer Leiterplatte. -
6 zeigt schematisch eine Querschnittsansicht einer Ausführungsform eines Bauelements mit einem Halbleiterchip, ei nem Laminatmaterial und einem Durchgangsloch durch das Laminatmaterial. -
7 zeigt schematisch eine Querschnittsansicht einer Ausführungsform eines Bauelements mit einem Halbleiterchip, einem Träger, einem Kapselungsmaterial und einem Durchgangsloch durch den Träger und das Kapselungsmaterial. - In der folgenden ausführlichen Beschreibung wird auf die beiliegenden Zeichnungen Bezug genommen, die einen Teil hiervon bilden und in denen als Veranschaulichung spezifische Ausführungsformen gezeigt sind, in denen die Erfindung praktiziert werden kann. In dieser Hinsicht wird Richtungsterminologie wie etwa „Oberseite”, „Unterseite”, „Vorderseite”, „Rückseite”, „vorderer”, „hinterer” usw. unter Bezugnahme auf die Orientierung der beschriebenen Figur(en) verwendet. Weil Komponenten von Ausführungsformen in einer Reihe verschiedener Orientierungen positioniert sein können, wird die Richtungsterminologie zu Zwecken der Darstellung verwendet und ist in keinerlei Weise beschränkend. Es versteht sich, dass andere Ausführungsformen benutzt und strukturelle oder logische Änderungen vorgenommen werden können, ohne von dem Schutzbereich der vorliegenden Erfindung abzuweichen. Die folgende ausführliche Beschreibung ist deshalb nicht in einem beschränkenden Sinne zu verstehen, und der Schutzbereich der vorliegenden Erfindung wird durch die beigefügten Ansprüche definiert.
- Es versteht sich, dass die Merkmale der verschiedenen hierin beschriebenen Ausführungsbeispiele miteinander kombiniert werden können, sofern nicht spezifisch etwas anderes angegeben ist.
- Die Ausdrücke „gekoppelt” und/oder „elektrisch gekoppelt” sollen, wie sie in dieser Anmeldung verwendet werden, nicht bedeuten, dass die Elemente notwendigerweise direkt zusammengekoppelt sind; dazwischenliegende Elemente können zwischen den „gekoppelten” oder „elektrisch gekoppelten” Elementen vorgesehen sein.
- Bauelemente, die einen oder mehrere Halbleiterchips enthalten, werden unten beschrieben. Die Halbleiterchips können von unterschiedlichen Typen sein, können durch verschiedene Technologien hergestellt werden und können beispielsweise integrierte elektrische, elektrooptische oder elektromechanische Schaltungen oder passive Elemente enthalten. Die integrierten Schaltungen können beispielsweise als integrierte Logikschaltungen, integrierte Analogschaltungen, integrierte Mischsignalschaltungen, integrierte Leistungsschaltungen, Speicherschaltungen oder integrierte passive Elemente ausgelegt sein. Weiterhin können die Halbleiterchips als MEMS (mikroelektromechanische Systeme) konfiguriert sein und können mikromechanische Strukturen wie etwa Brücken, Membranen oder Zungenstrukturen enthalten. Die Halbleiterchips können als Sensoren oder Aktuatoren, beispielsweise Drucksensoren, Beschleunigungssensoren, Drehsensoren, Magnetfeldsensoren, Elektromagnetfeldsensoren, Mikrofone usw. konfiguriert sein. Die Halbleiterchips können als Antennen und/oder diskrete passive Elemente und/oder Chipstapel konfiguriert sein. Halbleiterchip, in die solche funktionalen Elemente eingebettet sind, enthalten im Allgemeinen Elektronikschaltungen, die zum Ansteuern der funktionalen Elemente oder zum weiteren Verarbeiten von von den funktionalen Elementen generierten Signalen dienen. Die Halbleiterchips brauchen nicht aus einem spezifischen Halbleitermaterial, beispielsweise Si, SiC, SiGe, GaAs, hergestellt zu sein und können weiterhin anorganische und/oder organische Materialien enthalten, die keine Halbleiter sind, wie etwa beispielsweise diskrete passive Elemente, Antennen, Isolatoren, Kunststoffe oder Metalle. Zudem können die Halbleiterchips gekapselt oder ungekapselt sein.
- Die Halbleiterchips können Kontaktelemente (oder Kontaktpads oder Elektroden oder Kontaktflächen) aufweisen, die das Herstellen eines elektrischen Kontakts mit den in den Halbleiterchips enthaltenen integrierten Schaltungen gestatten. Eine oder mehrere Metallschichten können auf den Kontaktelementen der Halbleiterchips aufgebracht sein. Die Metallschichten können mit einer beliebigen gewünschten geometrischen Gestalt und mit einer beliebigen gewünschten Materialzusammensetzung hergestellt werden. Die Metallschichten können beispielsweise in Form einer einen Bereich bedeckenden Schicht vorliegen. Jedes gewünschte Metall oder jede gewünschte Metalllegierung, beispielsweise aus Aluminium, Titan, Gold, Silber, Kupfer, Palladium, Platin, Nickel, Chrom oder Nickel-Vanadium, kann als das Material verwendet werden. Die Metallschichten brauchen nicht homogen zu sein oder nur aus einem Material hergestellt zu sein, das heißt, verschiedene Zusammensetzungen und Konzentrationen der in den Metallschichten enthaltenen Materialien sind möglich.
- Die Bauelemente können eine oder mehrere Metallschichten enthalten. Die Metallschichten können beispielsweise zum Herstellen einer Umverdrahtungsschicht verwendet werden. Die Metallschichten können als Verdrahtungsschichten zum Herstellen eines elektrischen Kontakts mit den Halbleiterchips von außerhalb der Bauelemente oder zum Herstellen eines elektrischen Kontakts mit anderen Halbleiterchips und/oder Komponenten, die in den Bauelementen enthalten sind, verwendet werden. Die Metallschichten können mit einer beliebigen ge wünschten geometrischen Gestalt und mit einer beliebigen gewünschten Materialzusammensetzung hergestellt werden. Die Metallschichten können beispielsweise aus Leiterbahnen bestehen, können aber auch in der Form einer einen Bereich bedeckenden Schicht vorliegen. Beliebige gewünschte Metalle, beispielsweise Kupfer, Aluminium, Nickel, Palladium, Silber, Zinn oder Gold, Metalllegierungen oder Metallstapel können als das Material verwendet werden. Die Metallschichten brauchen nicht homogen oder aus nur einem Material hergestellt zu sein, das heißt, verschiedene Zusammensetzungen und Konzentrationen der in den Metallschichten enthaltenen Materialien sind möglich. Weiterhin können die Metallschichten über oder unter oder zwischen elektrisch isolierenden Schichten angeordnet sein.
- Die Halbleiterchips können auf Trägern platziert werden. Die Träger können von beliebiger Gestalt oder Größe sein und aus einem beliebigen Material bestehen. Während der Fabrikation der Bauelemente können die Träger miteinander verbunden sein. Die Träger können auch aus einem Stück hergestellt werden. Die Träger können untereinander durch Verbindungsmittel verbunden werden, mit dem Zweck, einige der Träger im Verlauf der Fabrikation zu trennen. Die Trennung der Träger kann durch mechanisches Sägen, einen Laserstrahl, Schneiden, Stanzen, Fräsen, Ätzen oder ein beliebiges anderes angebrachtes Verfahren ausgeführt werden. Die Träger können elektrisch leitend sein. Sie können beispielsweise vollständig aus Metallen oder Metalllegierungen, beispielsweise Kupfer, Kupferlegierungen, Eisen-Nickel, Aluminium, Aluminiumlegierungen oder anderen angebrachten Materialien hergestellt werden. Die Träger können beispielsweise ein Systemträger (Leadframe) oder ein Teil eines Systemträgers sein. Weiterhin können die Träger mit einem elektrisch leitenden Material elektroche misch beschichtet werden, beispielsweise Kupfer, Silber, Eisen-Nickel oder Nickelphosphor. Es kann auch vorgesehen werden, dass die Träger während der Produktion der Bauelemente von den Bauelementen entfernt werden.
- Die Bauelemente können ein Kapselungsmaterial enthalten, das elektrisch isolieren kann. Das Kapselungsmaterial kann einen beliebigen Bruchteil einer beliebigen Anzahl von Oberflächen der Komponenten des Bauelements bedecken. Das Kapselungsmaterial kann verschiedenen Funktionen dienen. Es kann beispielsweise verwendet werden, um Komponenten des Bauelements elektrisch voneinander und/oder von externen Komponenten zu isolieren, doch kann das Kapselungsmaterial auch als eine Plattform zum Montieren von anderen Komponenten, beispielsweise Verdrahtungsschichten, verwendet werden. Das Kapselungsmaterial kann auch zum Herstellen von Packages (Gehäusen, Kapselungen) vom Fan-Out-Typ verwendet werden. Bei einem Package vom Fan-Out-Typ befinden sich mindestens einige der externen Kontaktelemente und/oder Leiterbahnen, die den Halbleiterchip mit den externen Kontaktelementen verbinden, seitlich außerhalb des Umrisses des Halbleiterchips oder schneiden zumindest den Umriss des Halbleiterchips. Somit wird bei Packages vom Fan-Out-Typ ein peripher äußerer Teil des Package des Halbleiterchips in der Regel (zusätzlich) dazu verwendet, das Package elektrisch mit externen Anwendungen wie etwa Anwendungsplatinen usw. zu verbinden. Dieser äußere Teil des Package, der den Halbleiterchip umgibt, vergrößert effektiv den Kontaktbereich des Package bezüglich des „Footprint” des Halbleiterchips (Anordnung der Kontaktelemente auf dem Halbleiterchip), was zu gelockerten Einschränkungen im Hinblick auf Package-Padgröße und -teilung bezüglich späterer Verarbeitung führt, zum Beispiel der Montage auf der zweiten Ebene.
- Das Kapselungsmaterial kann unter Einsatz verschiedener Techniken auf den Komponenten des Bauelements abgeschieden werden. Beispielsweise kann das Kapselungsmaterial durch Drucken oder aus einer Gasphase oder einer Lösung oder durch Einsatz irgendeinen anderen angebrachten Verfahrens abgeschieden werden. Das Kapselungsmaterial kann beispielsweise Silikonmaterial enthalten oder kann ganz aus Silikon (oder polymerisierten Siloxanen oder Polysiloxanen) bestehen. Das Kapselungsmaterial kann ein Elastizitätsmodul von beispielsweise unter 100 MPa aufweisen. Das Kapselungsmaterial kann thermisch leitend sein, so dass es die von den Halbleiterchips erzeugte Wärme abführen kann. Es kann auch vorgesehen werden, dass die Bauelemente Kapselungsmaterial enthalten, das thermisch isoliert.
- Weiterhin kann es sich bei dem Kapselungsmaterial um ein entsprechendes duroplastisches, thermoplastisches oder wärmehärtendes Material oder Laminat (Prepreg) handeln und es kann Füllmaterialien enthalten. Diese Art von Kapselungsmaterial kann beispielsweise durch Formpressen, Spritzgießen, Pulversintern, Vergießen, Dispensieren, Jetting oder Lamination abgeschieden werden.
- Eine oder mehrere Durchgangslöcher können in dem Kapselungsmaterial erzeugt werden. Die Durchgangslöcher können beispielsweise Abschnitte einer Metallschicht exponieren (freilegen), um das Herstellen einer elektrischen Verbindung mit der Metallschicht von außerhalb des Bauelements zu gestatten. Die Durchgangslöcher können groß genug sein, um Lötkugeln oder Lötabscheidungen aufzunehmen. Dies kann dazu verwendet werden, Bauelemente aufeinander zu stapeln. Die Durchgangslöcher können beispielsweise durch Laserabtragung, Ätzen, foto lithografisches Strukturieren, mechanisches Bohren oder irgendeinen anderen geeigneten Prozess, der einem Fachmann bekannt ist, hergestellt werden.
- Die unten beschriebenen Bauelemente enthalten externe Kontaktelemente, die von beliebiger Gestalt oder Größe sein und aus einem beliebigen Material bestehen können. Die externen Kontaktelemente können von außerhalb des Bauelements zugänglich sein und können somit das Herstellen eines elektrischen Kontakts mit den Halbleiterchips von außerhalb des Bauelements gestatten. Weiterhin können die externen Kontaktelemente thermisch leiten und können als Kühlkörper dienen, um die von den Halbleiterchips erzeugte Wärme abzuführen. Die externen Kontaktelemente können aus einem beliebigen gewünschten elektrisch leitenden Material bestehen. Die externen Kontaktelemente können externe Kontaktpads enthalten. Lötmaterial kann auf den externen Kontaktpads abgeschieden werden. Das Lötmaterial kann die Gestalt von Lötkugeln aufweisen und kann beispielsweise aus SnPb, SnAg, SnAgCu, SnAgCuNi, SnAu, SnCu und/oder SnBi bestehen.
-
1 zeigt schematisch eine Querschnittsansicht eines Bauelements100 . Das Bauelement100 enthält eine Metallschicht10 , einen Halbleiterchip11 und ein Kapselungsmaterial12 . Die Metallschicht10 weist eine erste Fläche13 und eine zweite Fläche14 gegenüber der ersten Fläche13 auf. Der Halbleiterchip11 weist eine erste Fläche15 und eine zweite Fläche16 gegenüber der ersten Fläche15 auf. Der Halbleiterchip11 ist über der Metallschicht10 platziert, wobei seine erste Fläche15 der ersten Fläche13 der Metallschicht10 zugewandt ist. Weiterhin ist der Halbleiterchip11 elektrisch an die Metallschicht10 gekoppelt. Das Kapselungsmaterial12 bedeckt die erste Fläche13 der Metallschicht10 und den Halbleiterchip11 . Mindestens ein Durchgangsloch17 verläuft von der ersten Fläche13 der Metallschicht10 durch das Kapselungsmaterial12 . Das Durchgangsloch17 ist ungefüllt oder mindestens nicht vollständig mit einem Material gefüllt, so dass das Durchgangsloch17 von außerhalb des Bauelements100 zugänglich ist. Weiterhin ist der Abschnitt der ersten Fläche13 der Metallschicht10 , der durch das Durchgangsloch17 exponiert (freigelegt) ist, von außerhalb des Bauelements100 zugänglich. -
2 zeigt schematisch eine Querschnittsansicht eines Moduls200 . Das Modul200 besteht aus einem ersten Bauelement20 und einem zweiten Bauelement21 . Das erste Bauelement20 enthält einen ersten Halbleiterchip22 und mehrere erste externe Kontaktpads23 , die elektrisch an den ersten Halbleiterchip22 gekoppelt sind. Das zweite Bauelement21 enthält eine Metallschicht10 mit einer ersten Fläche13 und einen zweiten Halbleiterchip11 mit einer ersten Fläche15 . Der zweite Halbleiterchip11 ist so an der Metallschicht10 angebracht, dass seine erste Fläche15 der ersten Fläche13 der Metallschicht10 zugewandt ist. Das zweite Bauelement21 enthält weiterhin ein Kapselungsmaterial, das die erste Fläche13 der Metallschicht10 und den Halbleiterchip11 bedeckt. Mehrere Durchgangslöcher17 verlaufen von der ersten Fläche13 der Metallschicht10 durch das Kapselungsmaterial12 . Das Modul200 enthält weiterhin mehrere Lötbumps (Lothöcker, Lotdepots, Lotabscheidungen)24 , die die Metallschicht10 elektrisch an die ersten externen Kontaktpads23 koppeln, wobei jeder der Lötbumps24 mindestens teilweise in einem jeweiligen der Durchgangslöcher17 platziert ist. - Die
3A bis3M zeigen schematisch eine Querschnittsansicht einer Ausführungsform eines Verfahrens zum Herstellen eines Bauelements300 , das in3M gezeigt ist. Das Bauelement300 ist eine Implementierung des in1 gezeigten Bauelements100 . Die Details des Bauelements300 , die unten beschrieben sind, können deshalb gleichermaßen auf das Bauelement100 angewendet werden. Ähnliche oder identische Komponenten der Bauelemente100 und300 sind mit den gleichen Bezugszahlen bezeichnet. - Wie in
3A gezeigt, wird ein Träger30 bereitgestellt. Bei dem Träger30 kann es sich um eine Platte oder eine Folie handeln, die aus einem starren Material hergestellt ist, beispielsweise einem Metall oder einer Metalllegierung, wie etwa Kupfer, Aluminium, Nickel, CuFeP, Stahl oder rostfreiem Stahl. Der Träger30 kann eine flache obere Oberfläche aufweisen, auf der später die Halbleiterchips11 platziert werden. Die Gestalt des Trägers30 ist nicht auf eine beliebige geometrische Gestalt beschränkt, und der Träger30 kann eine entsprechende Größe aufweisen. Beispielsweise kann die Dicke des Trägers30 im Bereich von 50 μm bis 1 mm liegen. Weiterhin kann der Träger30 strukturiert sein. Der Träger30 kann beispielsweise ein Systemträger oder ein Teil eines Systemträgers sein. Zudem kann der Träger30 mit einem elektrisch leitenden Material elektrochemisch beschichtet sein, beispielsweise Kupfer, Silber, Eisen-Nickel oder Nickelphosphor. - Ein Material
31 , beispielsweise ein Klebematerial, kann auf der oberen Oberfläche des Trägers30 abgeschieden sein, wie in3B gezeigt. Das Klebematerial31 kann aus einem Polymer oder einem beliebigen anderen geeigneten Material bestehen. Das Klebematerial31 kann Silikon, d. h. polymerisierte Siloxane oder Polysiloxane, oder fluoriertes Silikon enthalten oder kann ganz aus Silikon bestehen. Das Klebematerial31 kann weiterhin eine Mischung aus Silikon und Epoxidharz oder eine Mischung aus Silikon und Polyimid sein. Nach dem Härten kann das Klebematerial31 ein Elastizitätsmodul von unter 100 MPa, unter 50 MPa oder 20 MPa oder 10 MPa oder 5 MPa oder 2 MPa oder 1 MPa oder 500 kPa oder 200 kPa oder 100 kPa oder 50 kPa oder 20 kPa aufweisen. Der Elastizitätsmodul ist auch als der Young'sche Modul, E-Modul oder Zugbeanspruchung bekannt. Der Elastizitätsmodul kann definiert werden als das Verhältnis aus Belastung, die Druckeinheiten aufweist, zur Verformung, die dimensionslos ist; deshalb besitzt der Elastizitätsmodul selbst Druckeinheiten. - Der Elastizitätsmodul des Klebematerials
31 , wie oben beschrieben, kann eine schwimmende Montage der Halbleiterchips11 gestatten. Wegen der verschiedenen Wärmeausdehnungskoeffizienten des Trägers30 und der Halbleiterchips11 ist eine schwimmende Montage des Halbleiterchips11 erwünscht, um die während Temperaturzyklen induzierte mechanische Belastung zu reduzieren. Als ein Beispiel besitzt Kupfer, aus dem der Träger30 hergestellt sein kann, einen Wärmeausdehnungskoeffizienten von etwa 17 × 10–6/K, und Silizium, aus dem die Halbleiterchips11 hergestellt sein können, besitzt einen Wärmeausdehnungskoeffizienten von etwa 3 × 10–6/K. - Das Klebematerial
31 kann eine Wärmeleitfähigkeit von beispielsweise im Bereich zwischen 0,1 W/mK und 5 W/mK oder höher aufweisen. Alternativ kann das Klebematerial31 thermisch isolieren. Das Klebematerial31 kann ein geringes Ausgasen während der Härtung und eine hohe Thixotropie aufweisen. Elastosil kann für das Klebematerial31 verwendet werden, beispielsweise Elastosil RT705, das im Handel erhältlich ist. - Das Klebematerial
31 kann an jenen Plätzen der oberen Oberfläche des Trägers30 abgeschieden werden, wo später die Halbleiterchips11 platziert werden. Das Klebematerial31 kann beim Abscheiden flüssig, viskos oder wachsartig sein. Die Abscheidung des Klebematerials31 kann beispielsweise durch Siebdruck, Schablonendruck, Dispensieren oder ein beliebiges anderes geeignetes Verfahren durchgeführt werden. - Wie in
3C gezeigt, werden zwei Halbleiterchips11 sowie möglicherweise weitere Halbleiterchips über den Inseln des auf dem Träger30 abgeschiedenen Klebematerials31 platziert. Wenngleich die Inseln aus dem Klebematerial31 und die Halbleiterchips11 in3C die gleichen Flächeninhalte aufweisen, können ihre Flächeninhalte verschieden sein. Die Halbleiterchips11 können in einem Array angeordnet sein. Weiterhin kann ein beliebiges geeignetes Array von Halbleiterchips11 auf dem Träger30 platziert werden (in3C sind nur zwei der Halbleiterchips11 gezeigt). Beispielsweise können auf dem Träger30 mehr als 50 oder 500 oder 1000 Halbleiterchips11 platziert werden. Die Halbleiterchips11 werden mit einem größeren Abstand, als sie sich in dem Wafer-Verbund befunden haben, auf dem Träger30 umgesetzt. Die Halbleiterchips11 können auf dem gleichen Halbleiterwafer hergestellt worden sein, können aber alternativ auf verschiedenen Wafern hergestellt worden sein. Weiterhin können die Halbleiterchips11 physisch identisch sein, können aber auch verschiedene integrierte Schaltungen enthalten und/oder andere Komponenten darstellen und/oder können verschiedene Außenabmessungen und/oder Geometrien aufweisen. Die Halbleiterchips11 können eine Dicke im Bereich zwischen 50 μm und mehreren hundert Mikrometern aufweisen. Die Halbleiterchips11 können so auf dem Träger30 platziert sein, dass ihre ersten Flächen15 von dem Träger30 wegweisen und ihre zweiten Flächen16 gegenüber den ersten Flächen15 zum Träger30 hinweisen. Die ersten und zweiten Flächen15 ,16 können die Haupto berflächen der Halbleiterchips11 sein. Die ersten Flächen15 können aktive Hauptflächen15 der Halbleiterchips11 sein, auf denen sich Kontaktpads32 befinden können. Die in den Halbleiterchips11 eingebetteten integrierten Schaltungen können über die Kontaktpads32 , die aus einem Metall, beispielsweise Aluminium oder Kupfer, hergestellt sein können, elektrisch zugänglich sein. - Eine Pick-and-Place-Anlage (Aufnehm-und-Absetz-Anlage) kann verwendet werden, die in der Lage ist, die Halbleiterchips
11 aufzugreifen und sie auf dem Klebematerial31 zu platzieren. Die Halbleiterchips11 können in das Klebematerial31 gedrückt werden. - Nach der Platzierung der Halbleiterchips
11 kann das Klebematerial31 durch eine Wärmebehandlung bei moderaten Temperaturen, beispielsweise Temperaturen von weniger als 200°C oder 140°C oder 100°C mehrere Minuten lang gehärtet werden. Die Wärmebehandlung kann durch Einsatz einer Heizplatte oder eines Ofens ausgeführt werden. - Um die Positionen und Winkel der auf dem Träger
30 platzierten Halbleiterchips11 zu speichern, kann eine Fotoabbildung ausgeführt werden. Je nach der Genauigkeit des zum Platzieren der Halbleiterchips11 verwendeten Positionierungssystems ist die Fotoabbildung möglicherweise nicht erforderlich. - Vor der Abscheidung des Kapselungsmaterials
12 kann ein Nivellierungsprozess ausgeführt werden, um die ersten Flächen15 der Halbleiterchips11 auszurichten. Dazu kann ein weiterer Träger, beispielsweise ein Wafer, auf die Halbleiterchips11 gedrückt werden. Der Nivellierungsprozess kann vor oder nach dem Härten des Klebematerials31 durchgeführt werden. - Wie in
3D gezeigt, wird das Kapselungsmaterial12 auf den Halbleiterchips11 und den exponierten (freiliegenden) Oberflächen des Trägers30 abgeschieden. Die Lücken zwischen den Halbleiterchips11 werden ebenfalls mit dem Kapselungsmaterial12 gefüllt. Die Höhe d1 des Kapselungsmaterials12 über den ersten Flächen15 der Halbleiterchips11 kann mindestens 10 μm und etwa 30 μm betragen. Das Kapselungsmaterial12 kann nach seiner Abscheidung planare Sektionen auf seiner oberen Oberfläche liefern, die planparallel zu der oberen Oberfläche des Trägers30 sind. Diese planaren Oberflächen können zum Montieren von anderen Komponenten wie etwa einer Umverdrahtungsschicht verwendet werden. - Das zum Bedecken der Halbleiterchips
11 verwendete Kapselungsmaterial12 kann elektrisch isolierend und aus einem Polymer oder einem beliebigen anderen geeigneten Material hergestellt sein. Das Kapselungsmaterial12 kann Silikon oder fluoriertes Silikon enthalten oder kann ganz aus Silikon bestehen. Das Kapselungsmaterial12 kann weiterhin eine Mischung aus Silikon und Epoxidharz oder eine Mischung aus Silikon und Polyimid sein. Nach dem Härten kann das Kapselungsmaterial12 einen Elastizitätsmodul von unter 100 MPa, unter 50 MPa oder 20 MPa oder 10 MPa oder 5 MPa oder 2 MPa oder 1 MPa oder 500 kPa oder 200 kPa oder 100 kPa oder 50 kPa oder 20 kPa aufweisen. Der Elastizitätsmodul kann bei etwa 3 MPa liegen. Das Kapselungsmaterial12 kann eine Wärmeleitfähigkeit von beispielsweise im Bereich zwischen 0,1 W/mK und 5 W/mK oder höher aufweisen. Das Kapselungsmaterial12 kann ein geringes Ausgasen während der Härtung und eine niedrige Thixotropie aufweisen. Elastosil kann für das Kapselungsmaterial12 verwendet werden, obgleich es hochthixotrop ist, beispielsweise Elastosil RT705, das im Handel erhältlich ist. - Der Elastizitätsmodul des Kapselungsmaterials
12 wie oben beschrieben kann eine schwimmende Montage der Halbleiterchips11 bezüglich der Metallfolie10 gestatten, die später über den Halbleiterchips11 platziert wird. Aufgrund der verschiedenen Wärmeausdehnungskoeffizienten der Halbleiterchips11 und der Metallfolie10 ist eine schwimmende Montage des Halbleiterchips11 gewünscht, um die während Temperaturzyklen induzierte mechanische Belastung zu reduzieren. - Das Kapselungsmaterial
12 kann während seiner Abscheidung flüssig, viskos oder wachsartig sein. Die Abscheidung des Kapselungsmaterials12 kann beispielsweise durch Siebdruck, Schablonendruck, Dispensieren oder irgendein anderes angemessenes Verfahren erfolgen. - Das Kapselungsmaterial
12 kann nach seiner Abscheidung durch eine Wärmebehandlung bei moderaten Temperaturen, beispielsweise Temperaturen von unter 120°C oder 100°C oder 80°C für mehrere Minuten, halbgehärtet werden. Die Wärmebehandlung kann unter Einsatz einer Heizplatte oder eines Ofens erfolgen. - Das Kapselungsmaterial
12 kann strukturiert werden, um Ausschnitte oder Durchgangslöcher33 herzustellen, die von der oberen Oberfläche des Kapselungsmaterials12 hinunter zu Kontaktpads32 der Halbleiterchips11 reichen, wie in3E gezeigt. Das Aspektverhältnis der Durchgangslöcher33 , das das Verhältnis der Höhe zu der Breite der Durchgangslöcher33 ist, kann von dem Verfahren abhängen, das zum Füllen der Durchgangslöcher33 mit elektrisch leitendem Material verwendet wird. Das Kapselungsmaterial12 kann beispielsweise durch Laserabtragung strukturiert werden. Es kann vorgesehen wer den, dass der Durchmesser der Durchgangslöcher33 nicht größer als 50 μm ist, wenn eine Laserstrukturierung verwendet wird. Die Laserstrukturierung kann bei einer Ausführungsform verwendet werden, wenn die Genauigkeit des zum Platzieren der Halbleiterchips11 verwendeten Positionierungssystems niedrig ist, und Fotoabbildung durchgeführt worden ist, um die Positionen und Winkel der auf dem Träger30 platzierten Halbleiterchips11 zu speichern. Andere Techniken zum Herstellen der Durchgangslöcher33 sind chemisches Ätzen oder fotolithografische Strukturierung, wenn das Kapselungsmaterial12 eine lichtempfindliche Komponente enthält. Eine weitere Alternative besteht darin, für die Abscheidung des Kapselungsmaterials12 eine Drucktechnologie zu verwenden, wie etwa Siebdruck oder Schablonendruck, und mindestens Abschnitte der Kontaktpads32 exponiert zu lassen, wenn das Kapselungsmaterial12 auf den Träger30 und die Halbleiterchips11 gedruckt wird. - Lötmaterial
34 kann in den Durchgangslöchern33 platziert werden, wie in3F gezeigt. Das Lötmaterial34 kann durch Siebdruck oder andere geeignete Druckverfahren aufgebracht werden. Bei einer anderen Ausführungsform können vorgeformte Lötkugeln mit Durchmessern, die nicht größer sind als die Durchmesser der Durchgangslöcher33 , durch Bürsten oder Walzen in die Durchgangslöcher33 eingefügt werden. Weiterhin kann das Lötmaterial34 oder irgendein anderes elektrisch leitendes Material in die Durchgangslöcher33 gefüllt werden, indem Druck verwendet wird, um das Material in flüssigem Zustand in die Durchgangslöcher33 zu füllen. Es kann vorgesehen werden, dass das Lötmaterial34 von der oberen Oberfläche des Kapselungsmaterials12 vorsteht, was bedeutet, dass das in den Durchgangslöchern33 abgeschiedene Lötmaterial34 eine Höhe aufweist, die größer ist als die Höhe d1. Das Lötmaterial34 kann aus Metalllegierungen hergestellt sein, die beispielsweise aus den folgenden Materialien bestehen: SnPb, SnAg, SnAgCu, SnAgCuNi, SnAu, SnCu und SnBi. Das Lötmaterial34 kann Flussmaterial enthalten, das eine geringe Ausgasung aufweist. Die Kontaktpads32 der Halbleiterchips11 können eine lötbare Oberfläche aufweisen. - Als eine Alternative zu dem Lötmaterial
34 können andere elektrisch leitende Materialien, wie etwa elektrisch leitender Kleber oder Metallteilchen (Nanoteilchen) in den Durchgangslöchern33 abgeschieden werden. Die Metallteilchen können beispielsweise aus einem Metall wie etwa Silber, Gold, Kupfer, Zinn oder Nickel bestehen. Die Abmessungen (mittlerer Durchmesser) der Metallteilchen können kleiner als 100 nm und bei einer Ausführungsform kleiner als 50 nm oder 10 nm sein. Es kann auch vorgesehen sein, dass nur ein Bruchteil der Metallteilchen solche Abmessungen aufweist. Beispielsweise können mindestens 10% oder 20% oder 30% oder 40% oder 50% oder 60% oder 70% der Metallteilchen Abmessungen kleiner als 100 nm oder 50 nm oder 10 nm aufweisen. Die anderen Metallteilchen können größere Abmessungen aufweisen. - Auf dem Kapselungsmaterial
12 kann eine Umverdrahtungsschicht hergestellt werden. Eine Möglichkeit zum Herstellen der Umverdrahtungsschicht besteht darin, einen standardmäßigen PCB(gedruckte Leiterplatte)-Industrieprozessfluss zu verwenden. Wie in3G gezeigt, kann eine Metallschicht10 , beispielsweise eine Metallfolie, mit ihrer ersten Fläche13 auf der oberen Oberfläche der Kapselungsschicht12 aufgebracht werden. Die Metallfolie10 kann aus Kupfer, Aluminium oder irgendeinem anderen Metall, irgendeiner anderen Metalllegierung oder irgendeinem anderen Metallstapel hergestellt sein. Die Metallfolie10 kann lötbar sein, so dass sie sich an Stellen, wo ein Lötprozess durchgeführt wird, nicht vollstän dig auflöst. Die Dicke der Metallfolie10 , beispielsweise eine Kupferfolie, kann im Bereich zwischen 6 und 500 μm und insbesondere im Bereich zwischen 8 und 200 μm liegen. Die Metallschicht10 kann auch aus gestapelten Metallschichten bestehen. Beispielsweise können eine Kupferschicht, eine Nickelschicht und eine weitere Kupferschicht aufeinander gestapelt werden. Jede der drei Schichten kann eine Dicke von mindestens 1 μm aufweisen. Die im Vergleich zu einer aus beispielsweise reinem Kupfer hergestellte Folie reduzierte Dicke der gestapelten Metallschichten kann auf die geringere Löslichkeit von Nickel durch Lötmaterial zurückzuführen sein. Anstelle der Nickelschicht können andere Metallschichten verwendet werden, die im Lötmaterial eine geringere Löslichkeit als Kupfer aufweisen. - Die Metallfolie
10 kann auf die darunter liegenden Strukturen laminiert werden, indem Vakuum und Druck für eine Zeit ausgeübt werden, die sich dafür eignet, dass die Metallfolie10 an dem Kapselungsmaterial12 haftet. Weiterhin kann während der Laminierung der Metallfolie10 Wärme einwirken. Nach dem Laminieren der Metallfolie10 können Wärme und Druck ausgeübt werden, um das in das Kapselungsmaterial12 eingebettete Lötmaterial34 zu schmelzen. Die Temperatur kann im Bereich zwischen 200 und 400°C liegen. Durch Schmelzen des Lötmaterials34 wird ein Lötprozess initiiert, der gelötete Verbindungen zwischen den Kontaktpads32 der Halbleiterchips11 und der Metallfolie10 erzeugt. Aufgrund der während des Lötprozesses einwirkenden Wärme kann das Kapselungsmaterial12 gehärtet werden und sich fest mit der Metallfolie10 verbinden. Die Metallfolie10 kann perforiert sein, um ein Ausgasen des Kapselungsmaterials12 und des Lötmaterials34 während des Härtens zu gestatten. - Wenn elektrisch leitender Kleber anstelle des Lötmaterials
34 in den Durchgangslöchern33 abgeschieden wird, kann eine Temperatur über beispielsweise 150°C angelegt werden, um den Kleber zu härten. Wenn Metallteilchen (Nanoteilchen) in den Durchgangslöchern33 abgeschieden werden, kann eine Temperatur einwirken, die hoch genug ist, um die Metallteilchen zu sintern. Die Temperatur kann beispielsweise höher als 150 oder 200°C liegen und hängt von dem Durchmesser der Metallteilchen ab. - Auf der Metallfolie
10 kann ein Trockenresistfilm laminiert werden, der fotostrukturierbar ist. Durch Exposition gegenüber Licht mit einer geeigneten Wellenlänge können in dem Resistfilm Vertiefungen ausgebildet werden. Dazu können ein Laserstrahl und die während der Fotoabbildung aufgezeichneten Daten verwendet werden. Wenn die Genauigkeit des zum Platzieren der Halbleiterchips11 verwendeten Positionierungssystems hoch genug ist, kann der Resistfilm selektiv gegenüber dem Licht der geeigneten Wellenlänge, das durch eine Maske emittiert wird, exponiert werden. Danach wird der Resistfilm entwickelt, und die dadurch exponierten Abschnitte der Metallfolie10 werden geätzt. Danach wird der Resistfilm abgelöst und nur die strukturierte Metallfolie10 bleibt auf dem Kapselungsmaterial12 , wie in3H gezeigt. - Eine Schicht
35 , die aus einem Silikonmaterial und einem formbaren elektrisch isolierenden Material bestehen kann, kann auf die strukturierte Metallfolie10 und die exponierten Abschnitte des Kapselungsmaterials12 aufgebracht werden, wie in3I gezeigt. Die Schicht35 kann elektrisch isolierend und thermisch leitend sein. Die Schicht35 kann beispielsweise eine Dicke von etwa 20 μm aufweisen. Die Schicht35 kann beispielsweise durch Siebdruck oder Schablonendruck gedruckt werden, wobei externe Kontaktpads36 an entsprechenden Orten offen bleiben. Die Schicht35 kann danach gehärtet und gereinigt werden. Zudem kann vor der Abscheidung der Schicht35 eine weitere Schicht aus der Gasphase abgeschieden werden, beispielsweise durch Sputtern. Die weitere Schicht kann aus amorphem Kohlenstoff, beispielsweise HDMC, oder einem Keramikmaterial bestehen. Die Schicht35 kann verhindern, dass Lötmaterial zwischen Leiterbahnen überbrückt und Kurzschlüsse erzeugt. Die Schicht35 sorgt auch für einen Schutz vor der Umgebung. - Die Schicht
35 kann fotostrukturierbar sein. Durch Exposition gegenüber Licht mit einer geeigneten Wellenlänge und nachfolgende Entwicklung können in der Schicht35 Vertiefungen ausgebildet werden, um die externen Kontaktpads36 zu exponieren. - Lötmaterial
37 kann auf den Oberflächen der externen Kontaktpads36 , von der Schicht35 exponiert, aufgebracht werden, wie in3J gezeigt. Das Lötmaterial37 kann durch Drucken aufgebracht werden, beispielsweise Schablonendruck, gefolgt von einem Wärmebehandlungsprozess, um das Lötmaterial37 zu schmelzen. Das Lötmaterial kann beispielsweise aus SnPb, SnAg, SnAgCu, SnAgCuNi, SnAu, SnCu und/oder SnBi bestehen. Die externen Kontaktpads36 und das Lötmaterial37 können später als externe Kontaktelemente verwendet werden, um die Bauelemente300 elektrisch an andere Komponenten zu koppeln, beispielsweise eine PCB. Die externen Kontaktpads36 können seitlich von den Kontaktpads32 der Halbleiterchips11 verschoben sein. Vor dem Aufbringen des Lötmaterials37 können die externen Kontaktpads36 gereinigt werden, beispielsweise durch RIE (reaktives Ionenätzen) oder chemische Reini gung, um Lötstoppmaterial und/oder eingebettetes Material zu entfernen, das auf den externen Kontaktpads36 zurückgeblieben ist. Anstelle des Lötmaterials37 können andere Materialien, beispielsweise NiAu, auf den Oberflächen der externen Kontaktpads36 aufgebracht werden, die eine Oxidation der externen Kontaktpads36 verhindern. - Vor oder nach dem Aufbringen des Lötmaterials
37 können Durchgangslöcher38 , die durch den Träger30 verlaufen, hergestellt werden, wie in3K gezeigt. Die Durchgangslöcher38 können im Wesentlichen orthogonal zu der ersten Fläche13 der Metallfolie10 sein. Die Durchgangslöcher38 exponieren Abschnitte des Kapselungsmaterials12 . Der Durchmesser d2 der Durchgangslöcher38 ist nicht notwendigerweise gleichförmig und kann im Bereich von 200 bis 800 μm liegen, der Durchmesser d2 kann größer als 210 oder 220 oder 230 oder 240 oder 250 oder 260 oder 270 oder 280 oder 290 oder 300 μm sein. Der Querschnitt der Durchgangslöcher38 (parallel zu der ersten Fläche13 der Metallfolie10 ) kann eine beliebige geeignete Gestalt aufweisen, beispielsweise kann er kreisförmig, rechteckig oder quadratisch sein. Der Querschnitt jedes der Durchgangslöcher38 kann eine Fläche von mindestens 3,0 × 104 oder 3,2 × 104 oder 3,4 × 104 oder 3,6 × 104 oder 3,8 × 104 oder 4,0 × 104 oder 4,5 × 104 oder 5,0 × 104 oder 5,5 × 104 oder 6,0 × 104 oder 6,5 × 104 oder 7,0 × 104 μm2 aufweisen. Die Querschnitte der Durchgangslöcher38 können groß genug sein, um später Lötbumps aufzunehmen, beispielsweise Lötkugeln. - Der Träger
30 kann über ein beliebiges angebrachtes Verfahren strukturiert werden, um die Durchgangslöcher38 herzustellen, beispielsweise durch Ätzen, einen Stanzprozess, Laserabtragung, mechanisches Bohren. Beispielsweise kann ein trockener fotostrukturierbarer Resistfilm auf den Träger30 laminiert werden. Vertiefungen können in den Resistfilm durch Exposition zu Licht mit einer geeigneten Wellenlänge ausgebildet werden. Dazu kann ein Laserstrahl verwendet werden, oder der Resistfilm kann selektiv zu dem Licht der geeigneten Wellenlänge, das durch eine Maske emittiert wird, exponiert werden. Danach wird der Resistfilm entwickelt, und die dadurch exponierten Abschnitte des Trägers30 werden geätzt. Danach wird der Resistfilm abgelöst und nur der strukturierte Träger30 bleibt zurück, wie in3K gezeigt. Die Umverdrahtungsschicht kann während des Ätzprozesses beispielsweise dadurch geschützt werden, dass der Ätzprozess nur auf einer Seite des Bauelements300 durchgeführt wird. - Durchgangslöcher
39 können in dem Kapselungsmaterial12 an Plätzen hergestellt werden, wo das Kapselungsmaterial12 durch die Durchgangslöcher38 exponiert worden ist, wie in3L gezeigt. Die Durchgangslöcher39 können beispielsweise im Wesentlichen orthogonal zu der ersten Fläche13 der Metallfolie10 verlaufen und können Abschnitte der ersten Fläche13 der Metallfolie10 exponieren. Der Durchmesser d3 der Durchgangslöcher39 ist nicht notwendigerweise gleichförmig und kann im Bereich von 200 bis 800 μm liegen, der Durchmesser d3 kann größer als 210 oder 220 oder 230 oder 240 oder 250 oder 260 oder 270 oder 280 oder 290 oder 300 μm sein. Der Querschnitt der Durchgangslöcher39 (parallel zu der ersten Fläche13 der Metallfolie10 ) kann eine beliebige geeignete Gestalt aufweisen, beispielsweise kann er kreisförmig, rechteckig oder quadratisch sein. Der Querschnitt jedes der Durchgangslöcher39 kann eine Fläche von mindestens 3,0 × 104 oder 3,2 × 104 oder 3,4 × 104 oder 3,6 × 104 oder 3,8 × 104 oder 4,0 × 104 oder 4,5 × 104 oder 5,0 × 104 oder 5,5 × 104 oder 6,0 × 104 oder 6,5 × 104 oder 7,0 × 104 μm2 aufweisen. Die Querschnitte der Durchgangslöcher39 können groß genug sein, um später Lötbumps aufzunehmen, beispielsweise Lötkugeln. - Die Durchgangslöcher
39 können durch einen Laserstrahl oder durch ein beliebiges anderes angemessenes Verfahren hergestellt werden. Im Fall der Laserabtragung kann der Laserabtragungsprozess durch die Metallfolie10 gestoppt werden. Nach der Herstellung der Durchgangslöcher38 und39 können die dadurch exponierten Abschnitte der ersten Fläche13 der Metallfolie10 gereinigt werden, indem beispielsweise RIE oder chemische Reinigung verwendet wird, um eingebettetes Material zu entfernen, das auf den exponierten Abschnitten der Metallfolie10 zurückgeblieben ist. - Der Durchmesser d2 der Durchgangslöcher
38 kann gleich dem Durchmesser d3 der Durchgangslöcher39 sein, oder der Durchmesser d2 kann größer sein als der Durchmesser d3. Im letzteren Fall kann jedes der Durchgangslöcher39 bezüglich des jeweiligen Durchgangslochs38 zentriert sein. Der größere Durchmesser d2 der Durchgangslöcher38 kann verhindern, dass Lötmaterial in Kontakt mit dem elektrisch leitenden Träger30 kommt, nachdem Lötbumps in den Durchgangslöchern38 ,39 platziert sind. Ein derartiger Kurzschluss kann auch vermieden werden, indem die Durchgangslöcher38 und/oder39 mit einer elektrisch isolierenden Lötstoppschicht beschichtet werden. Im Allgemeinen sind die Durchgangslöcher38 ,39 ungefüllt oder mindestens nicht vollständig gefüllt, so dass exponierte Abschnitte der ersten Fläche13 der Metallfolie10 von außerhalb des Bauelements300 zugänglich sind. - Wie in
3M gezeigt, werden die Bauelemente300 voneinander getrennt, indem der Träger30 , das Kapselungsmaterial12 und die Umverdrahtungsschicht beispielsweise durch Sägen, Schneiden, Laserabtragung oder Ätzen getrennt werden. - Die durch das obenbeschriebene Verfahren hergestellten Bauelemente
300 sind Packages vom Fan-Out-Typ. Das Kapselungsmaterial12 gestattet, dass sich die Umverdrahtungsschicht über den Umriss des Halbleiterchips11 hinaus erstreckt. Die externen Kontaktelemente36 ,37 brauchen deshalb nicht innerhalb des Umrisses des Halbleiterchips11 angeordnet sein, sondern können über einen größeren Bereich verteilt sein. Der vergrößerte Bereich, der für eine Anordnung der externen Kontaktelemente36 ,37 infolge des Kapselungsmaterials12 zur Verfügung steht, bedeutet, dass die externen Kontaktelemente36 ,37 nicht nur in einem großen Abstand voneinander angeordnet sein können, sondern dass gleichermaßen die größte Anzahl von externen Kontaktelementen36 ,37 , die dort angeordnet werden können, im Vergleich zu der Situation höher liegt, wenn alle externen Kontaktelemente36 ,37 innerhalb des Umrisses des Halbleiterchips11 angeordnet sind. - Für einen Fachmann ist es offensichtlich, dass die in
3M gezeigten Bauelemente300 und die Herstellung davon wie oben beschrieben nur als ein Ausführungsbeispiel gedacht sind und viele Variationen möglich sind. Beispielsweise können weitere Halbleiterchips oder passive Elemente von unterschiedlichen Typen in dem gleichen Bauelement300 enthalten sein. Die Halbleiterchips und passiven Elemente können hinsichtlich Funktion, Größe, Herstellungstechnologie usw. differieren. Zudem kann die Umverdrahtungsschicht mehr als eine Metallschicht enthalten. - Bei der oben beschriebenen und in
3A bis3M gezeigten Ausführungsform wird das in den Durchgangslöchern33 abge schiedene Lötmaterial34 nach der Laminierung der Metallfolie10 geschmolzen. Das Lötmaterial34 kann geschmolzen werden, wenn das auf den externen Kontaktpads36 abgeschiedene Lötmaterial37 geschmolzen wird, das heißt, nach der Abscheidung des Lötmaterials34 wird seine Schmelztemperatur erst erreicht, wenn das Lötmaterial37 geschmolzen wird. Wenn elektrisch leitender Kleber oder Metallteilchen anstelle des Lötmaterials34 verwendet werden, wird der elektrisch leitende Kleber gehärtet oder die Metallteilchen werden gesintert, wenn das Lötmaterial37 geschmolzen wird. - Gemäß einer Ausführungsform kann das auf den Halbleiterchips
11 abgeschiedene Kapselungsmaterial12 von dem Kapselungsmaterial12 verschieden sein, das auf den exponierten Abschnitten des Trägers30 abgeschieden ist und die Seitenflächen der Halbleiterchips11 bedeckt. Die beiden Kapselungsmaterialien12 können beispielsweise hinsichtlich ihres Elastizitätsmoduls und/oder ihrer Wärmeleitfähigkeit und/oder ihrer Thixotropie differieren. - Gemäß einer Ausführungsform kann das Kapselungsmaterial
12 unter Verwendung von zwei Abscheidungsprozessen abgeschieden werden. Bei einem ersten Prozess wird das Kapselungsmaterial12 auf den exponierten Teilen des Trägers30 derart abgeschieden, dass die obere Oberfläche des Kapselungsmaterials12 und die ersten Flächen15 des Halbleiterchips11 eine im Wesentlichen gemeinsame Ebene bilden. Bei einem zweiten Prozess wird eine Schicht aus dem Kapselungsmaterial12 mit einer Dicke d1 auf dem zuvor abgeschiedenen Kapselungsmaterial12 und den Halbleiterchips11 abgeschieden. Bei einer weiteren Ausführungsform wird in dem ersten Prozess das Kapselungsmaterial12 auf den exponierten Teilen des Trägers30 derart abgeschieden, dass das Kapselungsmaterial12 um etwa die Höhe d1 höher ist als die Halbleiterchips11 . Bei dem zweiten Prozess wird das Kapselungsmaterial12 nur auf den ersten Flächen15 der Halbleiterchips11 abgeschieden. - Gemäß einer Ausführungsform werden nach der Abscheidung des Kapselungsmaterials
12 keine Durchgangslöcher33 in dem Kapselungsmaterial12 erzeugt, wie in3E gezeigt, sondern die Metallfolie10 wird auf die obere Oberfläche des Kapselungsmaterials12 laminiert und strukturiert. Nach dem Strukturieren der Metallfolie10 kann das Kapselungsmaterial12 strukturiert werden, um die Durchgangslöcher33 zu erzeugen. Danach kann das Lötmaterial34 in den Durchgangslöchern33 platziert werden und kann geschmolzen werden, um zwischen den Kontaktpads32 der Halbleiterchips11 und der Metallfolie10 eine elektrische Verbindung herzustellen. Als Alternative zu dem Lötmaterial34 kann elektrisch leitendes Klebematerial in den Durchgangslöchern33 platziert werden. Weiterhin können anstelle des Lötmaterials34 Nanopasten, die aus Metallteilchen wie etwa Kupfer oder Silber bestehen, mit Abmessungen im Nanometerbereich verwendet werden. Während des Aufbringens können die Metallteilchen in einem Lösungsmittel dispergiert sein, das später verdampft. Die Metallteilchen werden gesintert, um elektrisch leitende Verbindungen herzustellen. - Gemäß einer Ausführungsform wird nach der Herstellung der Durchgangslöcher
33 , wie in3E gezeigt, ein elektrisch leitendes Material in den Durchgangslöchern33 und auf der oberen Oberfläche des Kapselungsmaterials12 abgeschieden, wodurch eine Umverdrahtungsschicht gebildet wird. Das elektrisch leitende Material füllt möglicherweise die Durchgangslöcher33 nicht vollständig, sondern beschichtet nur die Wände der Durchgangslöcher33 . Das elektrisch leitende Material kann durch stromlose und/oder galvanische Abscheidungsprozes se hergestellt werden. Dabei wird eine Keimschicht zuerst stromlos auf der oberen Oberfläche des Kapselungsmaterials12 und den exponierten Gebieten der Kontaktelemente32 abgeschieden. Für die Keimschicht, die üblicherweise eine Dicke von weniger als 1 μm aufweist, können Materialien wie etwa Palladium oder Titan verwendet werden. Die Dicke der Keimschicht kann vergrößert werden, indem eine weitere Schicht aus einem elektrisch leitenden Material auf der Keimschicht abgeschieden wird. Beispielsweise kann eine Schicht aus Kupfer stromlos auf der Keimschicht abgeschieden werden. Diese Kupferschicht kann eine Dicke von unter 1 μm aufweisen. Danach kann eine weitere Schicht aus Kupfer galvanisch abgeschieden werden, die eine Dicke von über 5 μm aufweisen kann. Die stromlose Kupferabscheidung kann auch entfallen. - Gemäß einer Ausführungsform wird das Kapselungsmaterial
12 auf den Träger30 aufgebracht, bevor die Halbleiterchips11 über dem Träger30 platziert werden. In diesem Fall werden die Halbleiterchips11 in das Kapselungsmaterial12 gedrückt. - Die
4A bis4K zeigen schematisch eine Querschnittsansicht einer Ausführungsform eines Verfahrens zum Herstellen eines Bauelements400 , das in4K gezeigt ist. Das Bauelement400 ist eine Implementierung des in1 gezeigten Bauelements100 . Die Einzelheiten des Bauelements400 , die unten beschrieben sind, können deshalb gleichermaßen auf das Bauelement100 angewendet werden. Ähnliche oder identische Komponenten der Bauelemente100 und400 sind mit den gleichen Bezugszahlen bezeichnet. - Zur Herstellung des Bauelements
400 wird ein Träger40 bereitgestellt, wie in4A gezeigt. Der Träger40 kann eine Platte sein, die aus einem starren Material hergestellt ist, beispielsweise einem Metall wie etwa Nickel, Stahl oder rostfreiem Stahl, einem Laminat, einem Film oder einem Materialstapel. Der Träger40 kann mindestens eine flache Oberfläche aufweisen, auf der Komponenten des Bauelements400 platziert werden können. Die Gestalt des Trägers40 ist nicht auf irgendeine geometrische Gestalt begrenzt, beispielsweise kann der Träger40 rund oder quadratisch sein. Der Träger40 kann eine angebrachte Größe aufweisen. Ein Klebeband41 , beispielsweise ein doppelseitiges Klebeband, kann auf den Träger40 laminiert werden, wie in4B gezeigt. - Wie in
4C gezeigt, werden zwei oder mehr Halbleiterchips11 über dem Träger40 platziert. Die Halbleiterchips11 können auf dem Klebeband41 so fixiert werden, dass die ersten Flächen15 der Halbleiterchips11 dem Träger40 zugewandt sind. Kontaktpads32 können auf den ersten Flächen15 der Halbleiterchips11 angeordnet sein. - Die Halbleiterchips
11 werden in einem größeren Abstand, als sie sich in dem Wafer-Verbund befunden haben, auf dem Träger40 umgesetzt. Die Halbleiterchips11 können physisch identisch sein, können aber auch verschiedene integrierte Schaltungen enthalten und/oder andere Komponenten darstellen. - Nachdem die Halbleiterchips
11 auf dem Träger40 montiert worden sind, werden die Halbleiterchips11 mit einem Kapselungsmaterial12 bedeckt, wie in4D gezeigt. Das Kapselungsmaterial12 kann beispielsweise ein duroplastisches oder wärmehärtendes Formmaterial sein. Auch die Lücke zwischen den Halbleiterchips11 werden mit dem Kapselungsmaterial12 gefüllt. Das Kapselungsmaterial12 kann auf einem Epoxidmaterial basieren und kann ein Füllmaterial enthalten, das aus kleinen Teilchen von Glas (SiO2) besteht, oder andere elek trisch isolierende mineralische Füllmaterialien wie Al2O3 oder organische Füllmaterialien. Formpressen, Spritzgießen, Pulversintern oder andere angemessene Ausformtechniken oder andere Gießtechniken können verwendet werden, um das Kapselungsmaterial12 aufzutragen. - Als eine Alternative zu dem Ausformmaterial kann anderes Polymermaterial als das Kapselungsmaterial
12 zum Bedecken der Halbleiterchips11 verwendet werden. Das Polymermaterial12 kann die Gestalt einer elektrisch isolierenden Folie oder Lage aufweisen, die auf die Halbleiterchips11 und den Träger40 laminiert wird. Wärme und Druck können für eine Zeit ausgeübt werden, die geeignet ist, dass die Polymerfolie oder -lage12 an der darunter liegenden Struktur haftet. Auch die Spalte zwischen den Halbleiterchips11 werden mit dem Polymermaterial12 gefüllt. Das Polymermaterial12 kann beispielsweise ein Prepreg (abgekürzt für vorimprägnierte Fasern) sein, das eine Kombination aus einer Fasermatte, beispielsweise Glas- oder Carbonfasern, und einem Harz, beispielsweise einem duroplastischen Material, ist. Prepreg-Materialien werden üblicherweise zum Herstellen von PCBs (gedruckten Leiterplatten) verwendet. Wohlbekannte Prepreg-Materialien, die in der PCB-Industrie verwendet werden und die hier als das Polymermaterial12 verwendet werden können, sind: FR-2, FR-3, FR-4, FR-5, FR-6, G-10, CEM-1, CEM-2, CEM-3, CEM-4 und CEM-5. Prepreg-Materialien sind zweistufige Materialien, die beim Aufbringen über den Halbleiterchips11 flexibel sind und während einer Wärmebehandlung gehärtet werden. Für die Laminierung des Prepreg können die gleichen oder ähnliche Prozesse wie bei der PCB-Herstellung verwendet werden. - Die mit dem Kapselungsmaterial
12 bedeckten Halbleiterchips11 werden von dem Träger40 gelöst und das Klebeband41 wird von den Halbleiterchips11 und dem Kapselungsmaterial12 abgezogen, wie in4E gezeigt. Das Klebeband41 kann Wärmetrenneigenschaften aufweisen, die das Entfernen des Klebebands41 während einer Wärmebehandlung gestatten. Das Entfernen des Klebebands41 von dem Träger40 wird bei einer angemessenen Temperatur ausgeführt, die von den Wärmetrenneigenschaften des Klebebands41 abhängt und üblicherweise über 150°C liegt. - Nach dem Lösen des Trägers
40 und des Klebebands41 bilden die ersten Flächen15 der Halbleiterchips11 , die zuvor an dem Träger40 angebracht waren, sowie die untere Oberfläche des Kapselungsmaterials12 eine gemeinsame planare Oberfläche42 . Wie in4F bis4H gezeigt, kann eine Umverdrahtungsschicht auf der Oberfläche42 aufgebracht werden. - Bei der vorliegenden Ausführungsform enthält die Umverdrahtungsschicht eine Metallschicht
10 und dielektrische Schichten43 ,44 . Die Umverdrahtungsschicht kann auch weitere Metallschichten und dielektrische Schichten enthalten. Die dielektrische Schicht43 wird auf der planaren Oberfläche42 abgeschieden, wie in4F gezeigt. Die Metallschicht10 wird auf der dielektrischen Schicht43 so aufgebracht, dass ihre erste Fläche13 der dielektrischen Schicht43 zugewandt ist und elektrische Kontakte zu den Kontaktpads32 der Halbleiterchips11 hergestellt werden, wie in4G gezeigt. Die dielektrische Schicht43 besitzt Öffnungen, um diese elektrischen Kontakte herzustellen. Die dielektrische Schicht44 wird danach auf der dielektrischen Schicht43 und der zweiten Fläche14 der Metallschicht10 aufgebracht, wie in4H gezeigt. Die dielektrische Schicht44 wird in Bereichen geöffnet, wo externe Kontaktpads36 angeordnet sind. - Die dielektrischen Schichten
43 ,44 können auf unterschiedliche Weisen hergestellt werden. Beispielsweise können die dielektrischen Schichten43 ,44 aus einer Gasphase oder aus einer Lösung abgeschieden werden oder können auf die darunter liegende Struktur laminiert werden. Weiterhin können Dünnschichttechnologieverfahren oder ein standardmäßiger PCB-Industrieprozessfluss für das Aufbringen der dielektrischen Schichten43 ,44 verwendet werden. Jede der dielektrischen Schichten43 ,44 kann bis zu 10 μm dick sein. Zum Herstellen von elektrischen Kontakten können die dielektrischen Schichten43 ,44 beispielsweise unter Einsatz von fotolithografischen Verfahren und/oder Ätzverfahren und/oder Lasertechniken geöffnet werden. - Die Metallschicht
10 kann beispielsweise durch Metallisierung gefolgt von einem Strukturieren der Metallschicht hergestellt werden, um die Leiterbahnen der Verdrahtungsschicht auszubilden. Jedes gewünschte Metall, beispielsweise Aluminium, Nickel, Palladium, Silber, Zinn, Gold oder Kupfer, oder eine beliebige gewünschte Metalllegierung kann als das Material verwendet werden. - Die Metallschicht
10 kann auch galvanisch hergestellt werden. Dazu wird üblicherweise zuerst eine Keimschicht, beispielsweise eine Palladiumschicht, abgeschieden, was stromlos oder durch eine Tintenstrahldrucktechnik ausgeführt werden kann. Die Keimschicht kann dann als eine Elektrode für die galvanische Abscheidung einer weiteren elektrisch leitenden Schicht, beispielsweise einer Kupferschicht, verwendet werden. - Eine weitere Technik, die zum Herstellen der Metallschicht
10 eingesetzt werden kann, ist die Laserdirektstrukturierung. Im Fall der Laserdirektstrukturierung wird eine elektrisch isolierende Polymerfolie an der gewünschten Oberfläche angebracht. Die Schaltungsdefinition erfolgt unter Einsatz eines Laserstrahls, der spezielle Additive in der Polymerfolie aktiviert, um die nachfolgende selektive elektrochemische Abscheidung zu gestatten. - Lötbumps
37 , beispielsweise Lötkugeln oder Löthalbkugeln, können auf den externen Kontaktpads36 platziert werden, wie in4I gezeigt. Die Lötbumps37 können durch Kugelplatzierung oder eine beliebige andere angebrachte Technik aufgebracht werden. Die dielektrische Schicht44 kann eine Lötstoppschicht sein, die verhindert, dass Lot zwischen den Leiterbahnen überbrückt und Kurzschlüsse erzeugt. Die dielektrische Schicht44 sorgt auch für Schutz vor der Umgebung. - Vor oder nach der Platzierung der Lötbumps
37 können Durchgangslöcher45 hergestellt werden, die sich durch die Kapselungsschicht12 und die dielektrische Schicht43 erstrecken, wie in4J gezeigt. Die Durchgangslöcher45 exponieren Abschnitte der ersten Fläche13 der Metallschicht10 . Der Durchmesser d4 der Durchgangslöcher45 kann im Bereich von 200 bis 800 μm liegen, in einer oder mehreren Ausführungsformen kann der Durchmesser d4 größer als 210 oder 220 oder 230 oder 240 oder 250 oder 260 oder 270 oder 280 oder 290 oder 300 μm sein. Der Querschnitt der Durchgangslöcher45 (parallel zu der ersten Fläche13 der Metallschicht10 ) kann eine beliebige angemessene Gestalt aufweisen, beispielsweise kann er kreisförmig, rechteckig oder quadratisch sein. Der Querschnitt jedes der Durchgangslöcher45 kann eine Fläche von mindestens 3,0 × 104 oder 3,2 × 104 oder 3,4 × 104 oder 3,6 × 104 oder 3,8 × 104 oder 4,0 × 104 oder 4,5 × 104 oder 5,0 × 104 oder 5,5 × 104 oder 6,0 × 104 oder 6,5 × 104 oder 7,0 × 104 μm2 aufweisen. Die Querschnitte der Durchgangslöcher45 können groß genug sein, um später Lötbumps aufzunehmen, beispielsweise Lötkugeln. Die Durchgangslöcher45 können durch eine beliebige angebrachte Technik hergestellt werden, beispielsweise Ätzen, einen Stanzprozess, Laserabtragung, Fotostrukturierung oder mechanisches Bohren. Die exponierten Abschnitte der ersten Fläche13 der Metallschicht10 können beispielsweise durch RIE oder chemische Reinigung gereinigt werden, um etwaiges eingebettetes Material, das auf diesen Oberflächen zurückgeblieben ist, zu entfernen. - Wie in
4K gezeigt, werden die Bauelemente400 voneinander getrennt, indem das Kapselungsmaterial12 und die Umverdrahtungsschicht beispielsweise durch Sägen, Schneiden, Fräsen, Ätzen oder einen Laserstrahl getrennt werden. - Die
5A bis5C zeigen schematisch eine Querschnittsansicht einer Ausführungsform eines Verfahrens zum Herstellen von Modulen500 und501 , die in5B bzw.5C gezeigt sind. Die Module500 und501 sind Implementierungen des in2 gezeigten Moduls200 . Die Einzelheiten der Module500 und501 , die unten beschrieben sind, können deshalb gleichermaßen auf das Modul200 angewendet werden. Ähnliche oder identische Komponenten der Module200 ,500 und501 sind mit den gleichen Bezugszahlen bezeichnet. - Wie in
5A gezeigt, werden ein Bauelement20 und ein Bauelement21 bereitgestellt. Das Bauelement20 enthält einen Halbleiterchip22 und mehrere, elektrisch über eine Verdrahtungsschicht50 an den Halbleiterchip22 gekoppelte externe Kontaktpads23 . Lötbumps24 sind an den externen Kontaktpads23 angebracht. Weiterhin können der Halbleiterchip22 und andere Komponenten des Bauelements20 in ein Package oder Gehäuse51 eingebettet sein, das elektrisch isolierend sein kann. Das Bauelement20 kann unter Verwendung einer der oben in Verbindung mit der Herstellung der Bauelemente300 und400 beschriebenen Herstellungstechnologien hergestellt werden. Bei einer weiteren Ausführungsform kann das Bauelement20 beispielsweise ein BGA-Bauelement (Ball Grid Array) oder ein beliebiges anderes Bauelement sein, das Lötbumps auf der Bodenseite enthält, die für eine externe elektrische Verbindung des Bauelements verwendet werden. Anstelle von Lötbumps können beliebige andere externe Kontaktelemente an der Bodenfläche des Bauelements20 angebracht sein, die gestatten, dass das Bauelement20 von der Komponente, auf der das Bauelement20 montiert ist, absteht. Solche externen Kontaktelemente können beispielsweise Kupferpfosten sein, die an die externen Kontaktpads23 angeschlossen sein und Lötabscheidungen auf ihren Bodenseiten aufweisen können. - Das Bauelement
21 kann beispielsweise das Bauelement100 ,300 oder400 sein. Bei der in5A gezeigten Ausführungsform ist das Bauelement21 als das Bauelement400 verkörpert. Das Bauelement21 enthält eine Metallschicht10 , einen Halbleiterchip11 und ein Kapselungsmaterial12 . In dem Kapselungsmaterial12 sind Durchgangslöcher17 ausgebildet, um Abschnitte der ersten Fläche13 der Metallschicht10 zu exponieren. - Wie in
5B gezeigt, ist das Bauelement20 so auf das Bauelement21 gestapelt, dass die Durchgangslöcher17 die Lötbumps24 aufnehmen. Die Lötbumps24 sind auf den exponierten Abschnitten der ersten Fläche13 der Metallschicht10 platziert. Beispielsweise kann die Höhe h2 der Durchgangslö cher17 mindestens 40% oder 50% oder 60% oder 80% oder 90% der Höhe h1 der Lötbumps24 betragen. Weiterhin kann der Durchmesser d5 der Lötbumps24 kleiner oder gleich dem Durchmesser d6 der Durchgangslöcher17 sein. Falls das Bauelement21 als das in3M gezeigte Bauelement300 implementiert wird, entspricht jedes Durchgangsloch17 einem der Durchgangslöcher38 und dem jeweiligen Durchgangsloch39 . Falls das Bauelement21 als das in4K gezeigte Bauelement400 implementiert ist, entspricht jedes Durchgangsloch17 einem der Durchgangslöcher45 . - Die Lötbumps
24 werden geschmolzen, um einen Lötprozess zu initiieren, der gelötete Verbindungen zwischen den externen Kontaktpads23 des Bauelements20 und der Metallschicht10 des Bauelements21 produziert, so dass die Bauelemente20 und21 elektrisch aneinander gekoppelt sind. Folglich gestatten die Durchgangslöcher17 das Herstellen eines Moduls500 , das aus den gestapelten Bauelementen20 und21 mit einer reduzierten Höhe besteht. Es kann vorgesehen werden, dass weitere Bauelemente auf dem Modul500 gestapelt werden. - Das Modul
500 kann auf einer Leiterplatte52 montiert werden, beispielsweise einer PCB, wie schematisch in5C gezeigt. Die Lötbumps37 des Bauelements21 können der Leiterplatte52 zugewandt sein. Die Leiterplatte52 kann Kontaktpads53 aufweisen, und das Modul500 kann unter Verwendung der Lötbumps37 an die Kontaktpads53 gelötet sein. Es kann vorgesehen werden, dass das Schmelzen der Lötbumps24 und das Schmelzen der Lötbumps37 zur gleichen Zeit durchgeführt werden. - Die
6 und7 zeigen schematisch Querschnittsansichten eines Bauelements600 bzw.700 . Beide Bauelemente600 und700 sind Implementierungen des in1 gezeigten Bauelements100 . Ähnliche oder identische Komponenten der Bauelemente100 ,600 und700 sind somit mit den gleichen Bezugszahlen bezeichnet. Die Bauelemente600 und700 können als das in5A bis5C gezeigte Bauelement21 verwendet werden. - Bei dem Bauelement
600 ist das Kapselungsmaterial12 ein Laminatmaterial12 , in das der Halbleiterchip11 eingebettet ist. Das Laminatmaterial12 bedeckt die erste Fläche15 und die zweite Fläche16 des Halbleiterchips11 . Die Kontaktpads32 der Halbleiterchips11 sind über Durchverbindungen34 elektrisch an die strukturierte Metallschicht10 gekoppelt. Eine strukturierte Metallschicht60 ist auf der anderen Seite des Laminatmaterials12 angeordnet. Beide strukturierten Metallschichten10 und60 sind durch Durchverbindungen61 durch das Laminatmaterial12 elektrisch aneinander gekoppelt. Die strukturierte Metallschicht60 ist mit einer elektrisch isolierenden Schicht62 bedeckt, die wärmeleitend sein kann. Die Metallschichten10 ,60 und die Durchverbindungen34 ,61 können durch stromlose und galvanische Abscheidung eines Metalls oder über eine beliebige andere angemessene Technik hergestellt werden. Die Durchgangslöcher17 verlaufen durch das Laminatmaterial12 und exponieren Abschnitte der Metallschicht10 . Das Laminatmaterial12 kann beispielsweise ein Prepregmaterial sein wie etwa FR-2, FR-3, FR-4, FR-5, FR-6, G-10, CEM-1, CEM-2, CEM-3, CEM-4 und CEM-5. - Gemäß einer Ausführungsform können die Metallschicht
60 , die Durchverbindungen61 und die elektrisch isolierende Schicht62 des Bauelements600 auch entfallen. - Bei dem Bauelement
700 wird der Halbleiterchip11 unter Verwendung eines Klebematerials31 an einen Träger30 montiert, wobei die zweite Fläche16 des Halbleiterchips11 dem Träger30 zugewandt ist. Die Seitenflächen des Halbleiterchips11 und der Träger30 sind mit einem Kapselungsmaterial12 bedeckt, das das gleiche Kapselungsmaterial12 sein kann, wie es für das obenbeschriebene Bauelement300 verwendet wird. Weiterhin können Bumps (Höcker, Depots)65 auf der ersten Fläche15 des Halbleiterchips11 durch das Kapselungsmaterial12 ausgebildet werden. Die strukturierte Metallschicht10 kann auf dem Kapselungsmaterial12 und bei einer Ausführungsform den Bumps65 abgeschieden werden. Eine elektrisch isolierende Schicht35 ist auf der strukturierten Metallschicht10 abgeschieden. Die elektrisch isolierende Schicht35 lässt externe Kontaktelemente36 an entsprechenden Orten offen. Lötkugeln37 können auf den auf dem Träger30 angeordneten externen Kontaktelementen36 platziert werden. Weiterhin können Durchgangslöcher17 durch den Träger30 und das Kapselungsmaterial12 verlaufen, um Abschnitte der Metallschicht10 zu exponieren. - Die Durchgangslöcher
17 sind möglicherweise nicht direkt über den Lötkugeln37 angeordnet. Es kann vorgesehen werden, dass die Durchgangslöcher17 und die Lötkugeln37 seitlich voneinander weg verschoben werden. Falls die Durchgangslöcher17 und die Lötkugeln37 aufeinander positioniert sind, wie in7 gezeigt, kann die Metallschicht10 eine ausreichende Dicke aufweisen, um von beiden Seiten aus gelötet werden zu können, oder kann aus mehreren Metallschichten bestehen. - Wenngleich ein bestimmtes Merkmal oder ein bestimmter Aspekt einer Ausführungsform der Erfindung bezüglich nur einer von mehreren Implementierungen offenbart worden sein mag, kann außerdem ein derartiges Merkmal oder ein derartiger Aspekt mit einem oder mehreren anderen Merkmalen oder Aspekten der anderen Implementierungen kombiniert werden, wie für eine gegebene oder bestimmte Anwendung erwünscht und vorteilhaft sein kann. Weiterhin soll in dem Ausmaß, in dem die Ausdrücke „enthalten”, „haben”, „mit” oder andere Varianten davon entweder in der ausführlichen Beschreibung oder den Ansprüchen verwendet werden, solche Ausdrücke auf eine Weise ähnlich dem Ausdruck „umfassen” einschließend sein. Weiterhin versteht sich, dass Ausführungsformen der Erfindung in diskreten Schaltungen, teilweise integrierten Schaltungen oder ganz integrierten Schaltungen oder Programmierungsmitteln implementiert sein können. Außerdem ist der Ausdruck „beispielhaft” lediglich als ein Beispiel anstatt das Beste oder Optimale gemeint. Es ist auch zu verstehen, dass hierin dargestellte Merkmale und/oder Elemente mit bestimmten Abmessungen relativ zueinander zum Zweck der Vereinfachung und zum leichten Verständnis dargestellt worden sind und dass tatsächliche Abmessungen von den hierin dargestellten wesentlich differieren können.
- Wenngleich hierin spezifische Ausführungsformen dargestellt und beschrieben worden sind, versteht der Durchschnittsfachmann, dass eine Vielzahl alternativer und/oder äquivalenter Implementierungen für die gezeigten und beschriebenen spezifischen Ausführungsformen substituiert werden können, ohne von dem Schutzbereich der vorliegenden Erfindung abzuweichen. Die vorliegende Anmeldung soll alle Adaptationen oder Variationen der hierin erörterten spezifischen Ausführungsformen abdecken. Deshalb soll die vorliegende Erfindung nur durch die Ansprüche und die Äquivalente davon beschränkt werden.
Claims (24)
- Bauelement (
100 ), umfassend: eine Metallschicht (10 ), die eine erste Schichtfläche (13 ) umfasst, einen Halbleiterchip (11 ), der eine erste Chipfläche (15 ) umfasst, wobei der Halbleiterchip (11 ) elektrisch an die Metallschicht (10 ) gekoppelt und darüber platziert ist und die erste Schichtfläche (13 ) der ersten Chipfläche (15 ) zugewandt ist, ein Kapselungsmaterial (12 ), das die erste Schichtfläche (13 ) und den Halbleiterchip (11 ) bedeckt, und mindestens ein Durchgangsloch (17 ), das durch das Kapselungsmaterial (12 ) verläuft, wobei das mindestens eine Durchgangsloch (17 ) einen Abschnitt der ersten Schichtfläche (13 ) exponiert, der von außerhalb des Bauelements (100 ) zugänglich ist. - Bauelement (
100 ) nach Anspruch 1, wobei das mindestens eine Durchgangsloch (17 ) einen Querschnitt von mindestens 3 × 104 μm2 aufweist. - Bauelement (
100 ) nach Anspruch 1 oder 2, weiterhin umfassend: ein Array von Lötbumps (37 ), die elektrisch an die Metallschicht (10 ) gekoppelt sind. - Bauelement (
100 ) nach Anspruch 3, wobei eine zweite Schichtfläche (14 ) der Metallschicht (10 ) den Lötbumps (37 ) zugewandt ist und die zweite Schichtfläche (14 ) sich gegenüber der ersten Schichtfläche (13 ) befindet. - Bauelement (
100 ) nach einem der vorhergehenden Ansprüche, weiterhin umfassend: ein Metallelement (30 ), das eine zweite Chipfläche (16 ) des Halbleiterchips (11 ) bedeckt, wobei die zweite Chipfläche (16 ) der ersten Chipfläche (13 ) gegenüber liegt. - Bauelement (
100 ) nach Anspruch 5, wobei das mindestens eine Durchgangsloch (38 ) durch das Metallelement (30 ) verläuft. - Bauelement (
100 ) nach Anspruch 5 oder 6, wobei ein Querschnitt des mindestens einen Durchgangslochs (38 ) in einem Gebiet des Metallelements (30 ) größer ist als ein Querschnitt des mindestens einen Durchgangslochs (17 ) in einem Gebiet des Kapselungsmaterials (12 ). - Bauelement (
100 ) nach einem der Ansprüche 5 bis 7, wobei ein erstes Material (31 ) zwischen der zweiten Chipfläche (16 ) und dem Metallelement (30 ) angeordnet ist und das erste Material (31 ) Silikon umfasst. - Bauelement (
100 ) nach einem der vorhergehenden Ansprüche, wobei das Kapselungsmaterial (12 ) einen Elastizitätsmodul von weniger als 100 MPa aufweist. - Bauelement (
100 ) nach einem der vorhergehenden Ansprüche, wobei das Kapselungsmaterial (12 ) Silikon umfasst. - Bauelement (
100 ) nach einem der vorhergehenden Ansprüche, wobei das mindestens eine Durchgangsloch (17 ) einen Querschnitt von mindestens 6 × 104 μm2 aufweist. - Bauelement (
100 ) nach einem der vorhergehenden Ansprüche, wobei das mindestens eine Durchgangsloch (17 ) in einer Richtung orthogonal zu der ersten Schichtfläche (14 ) verläuft. - Bauelement (
100 ) nach einem der vorhergehenden Ansprüche, wobei das mindestens eine Durchgangsloch (17 ) eine Länge von mindestens 150 μm aufweist. - Bauelement (
100 ) nach einem der vorhergehenden Ansprüche, wobei der Halbleiterchip (11 ) ein Array von Kontaktelementen (32 ) umfasst, das auf der ersten Chipfläche (15 ) angeordnet ist. - Bauelement (
300 ), umfassend: einen Träger (30 ), ein auf dem Träger (30 ) abgeschiedenes erstes Material (31 ), wobei das erste Material (31 ) einen Elastizitätsmodul von unter 100 MPa aufweist, einen über dem ersten Material (31 ) platzierten Halbleiterchip (11 ), ein auf dem Träger (30 ) und dem Halbleiterchip (11 ) abgeschiedenes zweites Material (12 ), wobei das zweite Material (12 ) einen Elastizitätsmodul von unter 100 MPa aufweist, eine Metallschicht (10 ) umfassend eine erste Fläche (13 ) und eine der ersten Fläche (13 ) gegenüberliegende zweite Fläche (14 ), wobei die Metallschicht (10 ) über dem zweiten Material (12 ) platziert ist und ihre erste Fläche (13 ) dem zweiten Material (12 ) zugewandt ist, und mindestens ein Durchgangsloch (38 ,39 ), das von der ersten Fläche (13 ) der Metallschicht (10 ) durch das zweite Material (12 ) und den Träger (30 ) verläuft. - Bauelement (
100 ) nach Anspruch 15, wobei das erste Material (31 ) und/oder das zweite Material (12 ) Silikon umfasst. - Bauelement (
100 ) nach Anspruch 15 oder 16, wobei das erste Material (31 ) und/oder das zweite Material (12 ) elektrisch isolierend ist. - Bauelement (
100 ) nach einem der Ansprüche 15 bis 17, wobei das mindestens eine Durchgangsloch (38 ,39 ) einen Querschnitt von mindestens 3 × 104 μm2 aufweist. - Modul (
200 ), umfassend: ein erstes Bauelement (20 ), umfassend: einen ersten Halbleiterchip (22 ), und mehrere erste externe Kontaktpads (23 ), die elektrisch an den ersten Halbleiterchip (22 ) gekoppelt sind; ein zweites Bauelement (21 ), umfassend: eine Metallschicht (10 ), die eine erste Schichtfläche (13 ) umfasst, einen zweiten Halbleiterchip (11 ), der eine erste Chipfläche (15 ) umfasst, wobei der zweite Halbleiterchip (11 ) an der Metallschicht (10 ) angebracht ist und die erste Chipfläche (15 ) der ersten Schichtfläche (13 ) zugewandt ist, ein Kapselungsmaterial (12 ), das die erste Schichtfläche (13 ) und den Halbleiterchip (10 ) bedeckt, und mehrere Durchgangslöcher (17 ), die von der ersten Schichtfläche (13 ) durch das Kapselungsmaterial (12 ) verlaufen; und mehrere Lötbumps (24 ), die die Metallschicht (10 ) elektrisch an die ersten externen Kontaktpads (23 ) koppeln, wobei jedes der Lötbumps (24 ) mindestens teilweise in einem jeweiligen der Durchgangslöcher (24 ) platziert ist. - Bauelement (
200 ) nach Anspruch 19, wobei mindestens 50% jedes Lötbumps (24 ) in einem jeweiligen der Durchgangslöcher (17 ) platziert ist. - Verfahren zum Herstellen eines Moduls, umfassend: Bereitstellen eines ersten Bauelements (
20 ), das einen ersten Halbleiterchip (22 ) und mehrere erste externe Kontaktelemente (23 ), die elektrisch an den ersten Halbleiterchip (22 ) gekoppelt sind, umfasst; Bereitstellen eines zweiten Bauelements (21 ), das einen zweiten Halbleiterchip (11 ), mehrere zweite externe Kontaktelemente (37 ) und eine Metallschicht (10 ) umfasst, die eine erste Fläche (13 ) und eine der ersten Fläche (13 ) gegenüberliegende zweite Fläche (14 ) aufweist, wobei die erste Fläche (13 ) der Metallschicht (10 ) dem zweiten Halbleiterchip (11 ) zugewandt ist und die zweite Fläche (14 ) der Metallschicht (10 ) den mehreren zweiten externen Kontaktelementen (37 ) zugewandt ist; und Löten der ersten externen Kontaktelemente (24 ) an die erste Fläche (13 ) der Metallschicht (10 ). - Verfahren nach Anspruch 21, wobei das zweite Bauelement (
21 ) weiterhin ein Kapselungsmaterial (12 ) umfasst, das die erste Fläche (13 ) der Metallschicht (10 ) und den zweiten Halbleiterchip (11 ) bedeckt. - Verfahren nach Anspruch 22, wobei das Kapselungsmaterial (
12 ) Öffnungen (17 ) umfasst, welche die erste Fläche (13 ) der Metallschicht (10 ) exponieren und konfiguriert sind, die ersten externen Kontaktelemente (24 ) aufzunehmen. - Verfahren nach einem der Ansprüche 21 bis 23, wobei die ersten externen Kontaktelemente Lötbumps (
24 ) sind.
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