CN1797155A

CN1797155A - 液晶显示器件

Info

Publication number: CN1797155A
Application number: CNA2005100824341A
Authority: CN
Inventors: 张容豪; 金彬; 文秀焕; 赵南旭; 尹洙荣
Original assignee: LG Philips LCD Co Ltd
Current assignee: LG Display Co Ltd
Priority date: 2004-12-31
Filing date: 2005-06-30
Publication date: 2006-07-05
Anticipated expiration: 2025-06-30
Also published as: TWI313444B; JP4713246B2; US20060145991A1; US8049704B2; KR20060078492A; KR101166580B1; CN100401175C; TW200622970A; JP2006189767A

Abstract

一种液晶显示(LCD)器件，包括：液晶板，具有多个由多条选通线和数据线限定的像素，并且具有为每个像素配置薄膜晶体管所形成的像素区；选通驱动单元，其由非晶半导体形成，并形成在所述液晶板上，用于将脉冲宽度大于所述像素区中薄膜晶体管的导通时间的扫描信号输入到所述选通线；以及数据驱动单元，与所述数据线相连接，用于将图像信号输入到所述数据线。

Description

液晶显示器件

技术领域

本发明涉及一种液晶显示(LCD)器件，更具体地，涉及一种LCD器件，能够通过增加施加给选通线的扫描信号的置位脉冲宽度，来防止由于信号降低而引起的劣化(inferiority)。

背景技术

液晶显示(LCD)器件是一种透明的平板显示器件，广泛应用于各种电子装置，诸如移动电话、PDA、笔记本电脑等。由于LCD器件具有轻、薄、短、小的特征，并且能够实现高的图像质量，所以在实际生活中有着比其它平板显示器件更多的应用。此外，随着数字TV、高图像质量的TV、墙式安装的TV需求的日益增加，正在对应用于这些TV的大LCD进行更加积极地研究。

按照驱动液晶分子的方法将LCD器件划分为若干种器件。在该若干种器件中，有源矩阵薄膜晶体管LCD器件由于快速响应时间和较少残留图像的原因而被主要使用。

图1示出了TFT LCD板的结构。如图所示，在液晶板1上形成多条水平和垂直排列的用于限定多个像素的选通线3和数据线5。在各个像素中排列有薄膜晶体管，即开关元件，在通过选通线3将扫描信号输入到像素时，这些开关元件开关，从而将通过数据线5输入的图像信号施加到液晶层9。附图标记11表示存储电容器，用于在下一个扫描信号输入到像素之前维持输入的数据信号。

将来自选通驱动单元20的扫描信号施加给选通线3，同时将来自数据驱动单元34的图像信号施加给数据线5。通常，选通驱动单元20和数据驱动单元34形成为驱动器集成电路(IC)，并且排列在液晶板1的外部。然而，近来，正在对选通驱动单元20一体形成在液晶板上的LCD器件进行积极的研究。当选通驱动单元20一体形成在液晶板1上时，可减小该LCD器件的体积，而且还可以降低制造成本。

数据驱动单元34被安装在用于使液晶板1和印刷电路板36相连接的柔性电路板30上，并且通过数据线5将图像信号施加到液晶层9上。在印刷电路板36上形成有定时控制器和线路。

图2示意性地示出了选通驱动单元20的结构。如图所示，选通驱动单元20具有多个移位寄存器22。信号顺序地从移位寄存器22输出并且施加到选通线G1到Gn。移位寄存器22与时钟生成单元24相连，从而可以将从时钟生成单元24产生的时钟信号施加给移位寄存器22。将启动电压输入到移位寄存器22，并且在第一个移位寄存器之后，将前一个移位寄存器的输出信号作为启动电压输入到下一个移位寄存器。

图3是一个波形图，示出了输入到移位寄存器的启动信号S、时钟信号C1、C2、C3和C4，以及从移位寄存器22输出的输出电压Vout1到Voutn。当分别将启动信号S和时钟信号C1、C2、C3和C4输入到各级移位寄存器时，各级的移位寄存器22输出信号Vout1到Voutn，从而顺序地将这些输出信号施加给选通线。

选通驱动单元与液晶板部分一体形成。即，移位寄存器22一体形成在具有液晶板部分的基底上。因此，与在液晶板部分的像素区上形成薄膜晶体管(开关元件)相类似，通过光刻来形成构成移位寄存器22的晶体管等。通常通过使用非晶硅来制造晶体管。具有使用非晶硅制造的晶体管的移位寄存器所应用的选通驱动单元存在下面的问题。

当来自移位寄存器22的输出电压作为扫描信号施加到像素区中的薄膜晶体管时，该薄膜晶体管导通，同时，从数据驱动单元施加的图像信号通过被导通的薄膜晶体管的沟道对存储电容器充电(charge)。即，在如图3所示的矩形波输出电压的第一个周期中(1H，即液晶板的薄膜晶体管导通的周期或将信号施加给像素的时间)，信号被施加给液晶层，同时信号对存储电容器充电。

通常，已知非晶硅具有低的场效应迁移率。低的场效应迁移率妨碍了施加给像素区中薄膜晶体管的扫描信号(即移位寄存器的输出电压)成为良好的矩形波。如图4所示，信号上升的时间和信号下降的时间均被延迟，从而在理想的矩形波上形成下降的尾部区域(tail region)。该矩形波使得薄膜晶体管的导通时间减少，从而降低了图像信号对液晶板充电的有效时间，因此使得LCD器件的图像质量恶化。

随着LCD器件分辨率的提高，用于充电图像信号的时间减少了。例如，就QVGA-LCD器件来说，在一个像素中对图像信号充电的时间大约为60μsec。与此相对应的，就具有高分辨率的XGA-LCD器件来说，用于在一个像素中对图像信号充电的时间大约为20μsec。随着充电时间减少，由低的场效应迁移率引起的扫描信号的降低使得有效充电时间减少得更多。所以，在高分辨率的情况下，LCD器件的图像质量下降得更多。

为了解决因低的场效应迁移率引起的问题，就不得不将薄膜晶体管制造为具有非常大的尺寸(例如，数千个μm)。然而，由于用于形成选通驱动单元的区域被大大增加，该方法实际上是不可能的。

发明内容

因此，本发明的一个目的是提供一种LCD器件，能够通过将扫描信号的脉冲宽度增加为超过薄膜晶体管的导通时间，来防止由于信号降低而引起的劣化，该扫描信号通过选通线施加到像素区内的薄膜晶体管。

本发明的另一个目的是提供一种LCD器件，在不增加LCD尺寸或制造成本的前提下，能够通过将交叠的扫描信号施加给相邻的选通线，来有效地防止由于信号降低而引起的劣化。

为了实现这些和其它的优点并根据本发明的目的，如这里所具体实现和广义描述的，提供了一种LCD器件，包括：液晶板，具有多个由多条选通线和数据线限定的像素，并且具有通过为每个像素提供薄膜晶体管所形成的像素区；在液晶板上形成的选通驱动单元，用于将扫描信号输入到所述选通线，所述扫描信号具有大于像素区中薄膜晶体管的导通时间的脉冲宽度；以及连接到数据线的数据驱动单元，用于将图像信号输入到所述数据线。

选通驱动单元包括：用于将扫描信号施加到奇数编号的选通线的第一选通驱动单元；以及用于将扫描信号施加到偶数编号的选通线的第二选通驱动单元。所述第一选通驱动单元和第二选通驱动单元分别顺序地输出同步信号，并且从所述第一和第二驱动单元输出并施加给相邻选通线的扫描信号的脉冲宽度相互交叠。

第一选通驱动单元和第二选通驱动单元分别包括：用于输出时钟信号的时钟信号生成单元；以及多个移位寄存器，其根据从所述时钟信号生成单元输入的时钟信号来输出输出电压。所述移位寄存器包括：在其输出端上形成的第一和第二晶体管；连接到第一和第二晶体管的每一个栅极的触发器(flip flop)；以及逻辑门，用于接收时钟信号和启动信号并且将这些信号施加到所述触发器。

根据下面结合附图对本发明的详细描述，本发明的前述和其它的目的、特征、方面和优点将变得更加显而易见。

附图说明

所包括的附图用于进一步理解本发明，其结合在此构成说明书一部分，举例说明了本发明的实施例，并且与说明书一起用于解释本发明的原理。

在附图中：

图1是示出了一般的液晶显示(LCD)器件的平面图；

图2是示出了根据现有技术的LCD器件的选通驱动单元的结构的框图；

图3是示出了图2中选通驱动单元的波形图；

图4是示出了根据现有技术的来自选通驱动单元的输出电压脉冲的波形图；

图5是示出了根据本发明的LCD器件的选通驱动单元的波形图；

图6是示出了从根据现有技术的选通驱动单元输出的扫描信号脉冲的波形图，以及示出了从根据本发明的选通驱动单元输出的扫描信号脉冲的波形图；

图7示出了根据本发明的LCD器件；

图8是示出了根据本发明的LCD器件的选通驱动单元的结构的框图；

图9是示出了根据本发明的LCD器件的选通驱动单元的电路图；以及

图10是示出了图9中选通驱动单元的波形图。

具体实施方式

现在将参照附图中示出的示例详细地描述本发明的优选实施例。

为了防止施加到像素区中形成的薄膜晶体管的扫描信号失真(即由于信号降低而引起的输出波的尾部)，使用如下的方法。第一，增加薄膜晶体管的尺寸，从而将较低的场效应迁移率的影响减到最小。第二，以多晶硅而不是非晶硅来形成薄膜晶体管，从而增加场效应迁移率。第一种方法实际上是不可能的，因为随着薄膜晶体管尺寸的增加，一体形成在液晶板上的选通驱动单元的尺寸也会增加。第二种方法实际上是可能的但并不很好，这是因为其制造成本高、制造工艺复杂。

本发明通过最简单的方法来防止施加给选通线的扫描信号失真。即，本发明在不使用多晶硅也不增加选通驱动单元尺寸的情况下，来防止施加给选通线的扫描信号失真。

扫描信号的失真减少了薄膜晶体管(即像素区中的开关元件)的导通时间，从而缩短了在像素中充电源信号的时间(薄膜晶体管的导通时间)。因此，如果薄膜晶体管的导通时间保持一设定时间，则不需要对半导体层进行结晶或增加薄膜晶体管尺寸。

在本发明中，对薄膜晶体管的导通时间，即施加到薄膜晶体管(像素区中的开关元件)的扫描信号的宽度进行控制，从而完全导通薄膜晶体管一段预定时间，以此防止LCD器件的劣化。

图5示出了从移位寄存器输出的、且通过选通线施加给像素区中的薄膜晶体管的输出电压(即扫描信号，Vout1、Vout2、Vout3和Vout4)。各个输出电压都被输入到各个选通线，从而对连接到各个选通线的各个薄膜晶体管进行操作。如图所示，将输入到特定选通线的输出电压的脉冲宽度增加为与输入到相邻选通线的信号的脉冲宽度相交叠。因此，即使信号因非晶半导体的低的场效应迁移率而降低，连接到相应选通线的薄膜晶体管也可以完全导通一段预定时间。同时，增加从时钟生成单元产生的、要输入到移位寄存器的时钟信号的置位脉冲(set pulse)，使得相邻脉冲相互交叠。

图6的波形图示出了施加给液晶板的数据线的源数据、施加给选通线的现有技术中的扫描信号、以及根据本发明的扫描信号。如图所示，为了完全将源信号充电到像素中，必须得将薄膜晶体管的导通持续源信号的一个脉冲宽度H。然而，在现有技术中，其脉冲减少了周期t1的扫描信号通过选通线施加到像素区中薄膜晶体管。因此，虽然对于周期H1来说，薄膜晶体管完全导通，但对于周期t1来说，该薄膜晶体管是部分导通的(即薄膜晶体管仅由超过阈值电压的信号导通)。所以，仅有通过薄膜晶体管施加到数据线的一部分源数据输入到像素中。

在本发明中，施加到选通线的扫描信号的脉冲宽度增加了周期t2。周期t2表示信号被降低的时间，其与现有技术中的信号降低的周期t1相同(即t1＝t2)。因此，完整的矩形波脉冲向像素输入了周期H，从而像素区中的薄膜晶体管导通了周期H。所以，将完整的源信号充电到了像素中。

在本发明中使用非晶半导体的情况下，扫描信号的脉冲宽度差不多增加了被降低的信号宽度(该被降低的信号宽度考虑了由于低的场效应迁移率而引起的信号降低)那么多，从而将像素区内的薄膜晶体管导通了一段所希望的时间，而完全地将源信号充电到像素中。因此，如图5所示，交叠的信号被施加到相邻的选通线。

图7示出了根据本发明的LCD器件。除了驱动单元120a和120b之外，图7所示的LCD器件与图1中示出的LCD器件相同，因此将省略对其的详细的说明。

如图所示，在液晶板101的外侧区域上形成两个选通驱动单元120a和120b。选通驱动单元120a和120b由同一工艺与像素区中的薄膜晶体管一体地形成，并且其中具有非晶半导体的薄膜晶体管。第一选通驱动单元120a与在像素区中形成的选通线103中的奇数编号的选通线相连，而第二选通驱动单元120b与偶数编号的选通线相连。即，选通线103交替地连接到第一选通驱动单元120a和第二选通驱动单元120b，从而扫描信号从选通驱动单元120a和120b施加到选通线103。

第一选通驱动单元120a和第二选通驱动单元120b分别顺序地输出电压(扫描信号)。从第一选通驱动单元120a和第二选通驱动单元120b输出的输出信号相互交叠，并且将该交叠的信号施加到相邻的选通线103。

在本发明中，用于将扫描信号施加到选通线的第一选通驱动单元120a和第二选通驱动单元120b在液晶板的两侧排列。但选通驱动单元的结构和位置并不重要。即，在通过输出脉冲宽度增加了的信号使像素区中薄膜晶体管完全导通一规定时间的条件下，可以形成一个选通驱动单元或者可以形成两个选通驱动单元。同样，在从第一和第二选通驱动单元顺序地输出信号、然后将被交叠的信号施加给选通线的条件下，可以在任意位置放置第一和第二选通驱动单元。

下面参照图8来详细地解释第一和第二选通驱动单元120a和120b的结构。

图8是示出了在选通驱动单元120a和120b上形成的移位寄存器的结构的框图，该选通驱动单元120a和120b用于将信号输出到像素区的选通线。

如图所示，第一选通驱动单元120a和第二选通驱动单元120b分别具有多个第一移位寄存器122a和第二移位寄存器122b。信号从第一移位寄存器122a和第二移位寄存器122b顺序地输出，然后分别施加到奇数编号的选通线G1到G(2n-1)和偶数编号的选通线G2到G2n。

第一移位寄存器122a和第二移位寄存器122b分别与第一时钟信号生成单元124a和第二时钟信号生成单元124b相连，从而第一时钟信号生成单元124a和第二时钟信号生成单元124b生成的时钟信号施加到第一移位寄存器122a和第二移位寄存器122b。启动信号S1和启动信号S2分别被输入到第一移位寄存器122a和第二移位寄存器122b。这里，在第一级之后，各个第一移位寄存器122a和第二移位寄存器122b的前一级的输出信号作为启动信号输入到下一级。

从第一移位寄存器122a和第二移位寄存器122b输出的、并施加到选通线G1到G2n的扫描信号的脉冲宽度差不多增加了像素区中薄膜晶体管的导通时间那么多，从而与相邻的信号部分地交叠。下面将描述用于输出信号的选通驱动单元的移位寄存器。

图9是示出了根据本发明的图8的选通驱动单元的电路图，其中示出了触发器。为了解释移位寄存器的功能而示出了该触发器，并不表示一个具体的电子元件。因此，可以将术语触发器替换为用于表明功能的合适的术语。

如图9所示，第一晶体管112a和第二晶体管112b与第一选通驱动单元120a的第一级移位寄存器的输出端相连。同样，第三晶体管113a和第四晶体管113b与第二选通驱动单元120b的第一级移位寄存器的输出端相连。第一和第二晶体管112a和112b的各个栅极、以及第三和第四晶体管113a和113b的各个栅极分别与第一触发器114a和第二触发器114b的Q端和Qb端相连。

第一逻辑门116a和第二逻辑门116b与第一触发器114a的S和R输入端相连，而第三逻辑门117a和第四逻辑门117b与第二触发器114b的S和R输入端相连。

第一晶体管112a和第三晶体管113a的各个源极与时钟生成单元(未示出)相连，而时钟信号C1和C2分别被输入到该源极。输出端与第一晶体管112a和第三晶体管113a的各个漏极相连，同时与第二晶体管112b和第四晶体管113b的各个源极相连。此外，第二晶体管112b和第四晶体管113b的各个漏极接地。时钟信号C1B和C2B以及启动信号S1分别被输入到逻辑门116a、116b、117a和117b，这些逻辑门116a、116b、117a和117b分别与第一触发器114a和第二触发器114b的S和R输入端相连。

图10的波形图示出了选通驱动单元120a和120b的启动信号S1和时钟信号C1、C1B、C2和C2B，以及从输出端输出并施加到选通线的输出电压Vout1、Vout2、Vout3和Vout4。在图10中，基于第一选通驱动单元和第二选通驱动单元来示出波形。

如图所示，从第一时钟生成单元(未示出)输出的时钟信号C1和C1B是对现有技术中的时钟信号增加了2倍的信号，并且被同步，从而顺序地施加到第一选通驱动单元的移位寄存器。同样，从第二时钟生成单元(未示出)输出的时钟信号C2和C2B是对现有技术中的时钟信号增加了2倍的信号，并且被同步，从而顺序地施加到第二选通驱动单元120b的移位寄存器。从第一选通驱动单元120a和第二选通驱动单元120b的第一级的移位寄存器输出的高状态信号(即C1、C2、C1B和C2B)的脉冲宽度相互交叠差不多半个周期(即交叠度不限于半个周期)。

下面将详细地描述通过启动信号S1及时钟信号C1、C1B、C2和C2B进行的移位寄存器的操作及其输出波形。

如图9所示，在将低状态的启动信号S1输入到第一选通驱动单元120a的第一级移位寄存器、并且输入低状态的时钟信号C1和C1B时，这些低信号就被分别施加到第一触发器114a的S和R输入端。因此，第一触发器114a保持先前的状态，Q端输出高信号，而Qb端输出低信号。因此，第一晶体管112a导通而第二晶体管112b截止，从而时钟信号C1作为输出电压Vout1输出，而该输出电压Vout1为低。

然后，如果将高状态的启动信号S1和低状态的时钟信号C1和C1B输入到移位寄存器，则低信号就被分别施加到触发器114的S和R输入端。因此，触发器114a保持先前的状态，Q端输出高信号，而Qb端输出低信号。因此，第一晶体管112a导通而第二晶体管112b截止，从而时钟信号C1作为输出电压Vout1输出，而该输出电压Vout1为低。

然后，如果时钟信号C1在启动信号S1保持高状态的情形下变高时，高状态的时钟信号C1就通过导通的第一晶体管112a输出。因此，输出电压Vout1为高。保持高状态的输出电压Vout1直到时钟信号C1B变高为止。即，当时钟信号C1B变高(启动信号S1为低)时，低信号和高信号分别被输入到第一触发器114a的S和R端。因此，触发器114a被重置，并且低信号和高信号分别被输出到Q和Qb输出端。因此，第一晶体管112a截止，而第二晶体管112b导通，以使得输出电压Vout1为低。

然后，如果将低状态的启动信号S1、高状态的时钟信号C1以及低状态的时钟信号C1B输入到移位寄存器，则低信号就分别被施加到触发器114的S和R输入端。因此，触发器114保持先前的状态，Q端输出低信号，而Qb端输出高信号。因此，第一晶体管112a导通而第二晶体管112b截止，从而输出电压Vout1为低，而继续保持输出电压Vout1的低状态。

当将启动信号S1输入到第一级移位寄存器时，从第一级移位寄存器的输出端输出该输出电压Vout1，并且将输出电压施加到LCD器件的第一选通线。

将从第一选通驱动单元120a的第一级的移位寄存器输出的输出电压Vout1作为启动信号输入到下一级的移位寄存器，从而使能下一级移位寄存器。对该下一级的移位寄存器进行类似于第一级的移位寄存器操作，从而输出与第一输出电压Vout1同步的第三输出电压Vout3，并且将该输出电压Vout3施加到第三选通线。随着该操作的重复，将顺序的输出电压Vout1到Vout(2n-1)施加到奇数编号的选通线。

将与输入到第一选通驱动单元120a的第一级移位寄存器中的时钟信号C1和C1B交叠差不多半个周期的时钟信号C2和C2B输入到第二选通驱动单元120b的第一级的移位寄存器。当时钟信号C2和C2B以及启动信号S1被输入到移位寄存器时，输出与第一输出电压Vout1差不多交叠半个周期的第二输出电压Vout2，从而将其施加到第二选通线。将第二输出电压Vout2作为启动信号输入到下一级的移位寄存器，以此输出顺序的第四输出电压Vout4，以便将其施加到第四选通线。随着上述操作的重复，将与从第一选通驱动单元120a的移位寄存器输出的输出电压Vout1-Vout(2n-1)交叠差不多半个周期的输出电压Vout2-Vout2n施加到第二选通驱动单元120b的移位寄存器的偶数编号的选通线。

如上所述，在本发明的LCD器件中，在液晶板上提供具有多个用于顺序地输出输出电压的移位寄存器的第一选通驱动单元和第二选通驱动单元，从而分别将输出电压施加到奇数编号的选通线和偶数编号的选通线。从第一和第二选通驱动单元(该第一和第二选通驱动单元用于交替地将扫描信号施加到奇数编号的选通线和偶数编号的选通线)的移位寄存器输出的输出电压具有大于薄膜晶体管(像素区的开关元件)导通周期的脉冲宽度，使得扫描信号相互交叠差不多给定的脉冲宽度(例如半个周期)，因此，当在移位寄存器上形成的薄膜晶体管由非晶半导体形成时，即使扫描信号具有因低的场效应迁移率而部分降低的脉冲，施加到液晶板内的像素区中的薄膜晶体管的信号也会完全地导通薄膜晶体管。因此，防止了当薄膜晶体管的导通时间降低所引起的LCD器件的劣化。

分别从第一选通驱动单元和第二选通驱动单元的移位寄存器输出的扫描信号增加的脉冲宽度(即在相邻信号间的交叠宽度)并不限于半个周期。也就是说，可以根据扫描信号因非晶半导体的低场效应迁移率的降低程度而控制扫描信号增加的脉冲宽度，只要像素区中的薄膜晶体管可以完全导通就行。

如上所述，在本发明中，将施加到选通线的扫描信号的脉冲宽度增加为超过像素区中薄膜晶体管的导通时间。因此，薄膜晶体管总可以保持一段预定时间的导通状态，即使扫描信号被降低也是如此。因此，可以在不增加形成于选通驱动单元上的薄膜晶体管尺寸也不使用昂贵的多晶硅的情况下，防止由于信号降低而引起的LCD器件的劣化。

由于可以不脱离本发明精神或实质特征地以多种方式来具体实现本发明，因此应当理解上述实施例不限于前面描述的任何细节，除非另有说明，否则应当在如所附权利要求定义的精神和范围之内广泛地解释，因此，落入到本发明权利要求的范围或这种范围的等同物之内的所有改变和修改都被所附权利要求所涵盖。

Claims

1、一种液晶显示器件，包括：

液晶板，具有由多条选通线和数据线限定的多个像素，并且具有为每个像素配置薄膜晶体管所形成的像素区；

选通驱动单元，其由非晶半导体形成，并形成在所述液晶板上，用于将脉冲宽度大于所述像素区中薄膜晶体管的导通时间的扫描信号输入到所述选通线；以及

数据驱动单元，与所述数据线相连接，用于将图像信号输入到所述数据线。

2、根据权利要求1所述的液晶显示器件，其中所述选通驱动单元包括：

用于将扫描信号施加到奇数编号的选通线的第一选通驱动单元；以及

用于将扫描信号施加到偶数编号的选通线的第二选通驱动单元。

3、根据权利要求2所述的液晶显示器件，其中所述第一选通驱动单元和第二选通驱动单元分别顺序地输出同步信号。

4、根据权利要求2所述的液晶显示器件，其中从所述第一选通驱动单元和第二选通驱动单元输出的、且施加给相邻选通线的扫描信号具有相互交叠的脉冲宽度。

5、根据权利要求4所述的液晶显示器件，其中施加给相邻选通线的扫描信号具有相互交叠差不多半个周期的脉冲宽度。

6、根据权利要求2所述的液晶显示器件，其中所述第一选通驱动单元和第二选通驱动单元分别包括：

用于输出时钟信号的时钟信号生成单元，以及

多个移位寄存器，其根据从所述时钟信号生成单元输入的时钟信号来输出输出电压。

7、根据权利要求6所述的液晶显示器件，其中所述第一移位寄存器被提供启动信号。

8、根据权利要求7所述的液晶显示器件，其中在输入到第二级之后的所述移位寄存器的启动信号是前一级的输出电压。

9、根据权利要求6所述的液晶显示器件，其中所述第一选通驱动单元和第二选通驱动单元输出具有部分相互交叠的脉冲的时钟信号。

10、根据权利要求2所述的液晶显示器件，其中所述第一选通驱动单元和第二选通驱动单元排列在所述液晶板的两侧，从而将所述信号施加到奇数编号的选通线和偶数编号的选通线。

11、一种液晶显示器件，包括：

液晶板，具有多个由多条选通线和数据线限定的像素，并且具有为每个像素配置薄膜晶体管所形成的像素区；

选通驱动单元，其在所述液晶板上以非晶半导体形成，用于将相互交叠的扫描信号分别输入相邻的选通线；以及

12、根据权利要求11所述的液晶显示器件，其中施加给相邻选通线的扫描信号具有相互交叠差不多半个周期的脉冲宽度。

13、根据权利要求11所述的液晶显示器件，其中所述选通驱动单元包括：

14、根据权利要求13所述的液晶显示器件，其中所述第一选通驱动单元和第二选通驱动单元分别包括：

用于输出时钟信号的时钟信号生成单元，以及

15、根据权利要求14所述的液晶显示器件，其中所述第一选通驱动单元和第二选通驱动单元排列在所述液晶板的两侧，从而将所述信号施加到奇数编号的选通线和偶数编号的选通线。