KR100995637B1 - 쉬프트 레지스터 - Google Patents
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Abstract
Description
Claims (14)
- 제1 및 제2 구동 전압과, 제1 및 제2 클럭 신호 중 어느 하나의 클럭 신호를 이용하여 입력된 스타트 펄스를 쉬프트시켜 각각의 출력 신호와 다음단의 스타트 펄스로 공급하는 다수개의 스테이지들로 이루어진 쉬프트 레지스터에 있어서, 상기 스테이지들 각각은제1 및 제2 노드의 제어에 따라 상기 어느 하나의 클럭 신호와 상기 제2 구동 전압을 선택적으로 출력 라인으로 공급하는 출력 버퍼부와;상기 스타트 펄스에 응답하여 제1 노드를 상기 제1 구동 전압으로 프리차지시키기는 프리차지부와;상기 스타트 펄스와 다음단 스테이지의 출력 신호를 이용하여 상기 제2 노드의 논리상태가 상기 제1 노드의 논리상태와 반대가 되도록 상기 제1 및 제2 구동 전압을 선택적으로 공급하는 제2 노드 제어부와;상기 제2 노드 및 상기 다음단 스테이지의 출력신호의 논리상태에 따라 상기 제1 노드에 상기 제2 구동 전압을 공급하는 제1 노드 제어부를 구비하는 것을 특징으로 하는 쉬프트 레지스터.
- 제 1 항에 있어서,상기 제1 및 제2 클럭 신호는 위상 반전된 것을 특징으로 하는 쉬프트 레지스터.
- 제 1 항에 있어서,상기 제1 및 제2 클럭 신호는 상기 다수의 스테이지에 교번적으로 공급된 것을 특징으로 하는 쉬프트 레지스터.
- 제 1 항에 있어서,상기 제1 구동 전압은 상기 제2 구동 전압 보다 높은 것을 특징으로 하는 쉬프트 레지스터.
- 제 1 항 내지 제 4 항 중 어느 한 항에 있어서,상기 프리차지부는상기 제1 구동 전압의 입력 라인과 상기 제1 노드 사이에 접속되어 상기 스타트 펄스에 의해 제어하는 제1 트랜지스터를 구비하는 것을 특징으로 하는 쉬프트 레지스터.
- 제 5 항에 있어서,상기 제2 노드 제어부는상기 제1 구동 전압 입력 라인과 제3 노드에 다이오드형으로 접속된 제2 트랜지스터와;상기 제2 트랜지스터와 병렬 접속되어 상기 다음단 스테이지의 출력 신호에 의해 제어되는 제3 트랜지스터와;상기 제3 노드와 상기 제2 구동 전압의 입력 라인 사이에 접속되어 상기 스타트 펄스에 의해 제어되는 제4 트랜지스터와;상기 제4 트랜지스터와 병렬 접속되어 상기 제1 노드에 의해 제어되는 제5 트랜지스터와;상기 제1 구동 전압 입력 라인과 상기 제2 노드 사이에 접속되어 상기 제3 노드에 의해 제어되는 제6 트랜지스터와;상기 제2 노드와 상기 제2 구동 전압 입력 라인 사이에 접속되어 상기 제1 노드에 의해 제어되는 제7 트랜지스터를 구비하는 것을 특징으로 하는 쉬프트 레지스터.
- 제 6 항에 있어서,상기 출력 버퍼부가 상기 제2 구동 전압을 공급하는 기간에 상기 제2 및 제3 노드에는 항상 상기 제1 구동 전압이 공급되는 것을 특징으로 하는 쉬프트 레지스터.
- 제 6 항에 있어서,상기 제1 노드 제어부는상기 제1 노드와 상기 제2 구동 전압 입력 라인 사이에 접속되어 상기 제2 노드에 의해 제어되는 제8 트랜지스터를 구비하는 것을 특징으로 하는 쉬프트 레지스터.
- 제 8 항에 있어서,상기 출력 버퍼부는상기 어느 하나의 클럭 신호 입력 라인과 상기 출력 라인 사이에 접속되어 상기 제1 노드에 의해 제어되는 제9 트랜지스터와;상기 출력 라인과 상기 제2 구동 전압 입력 라인 사이에 접속되어 상기 제2 노드에 의해 제어되는 제10 트랜지스터를 구비하는 것을 특징으로 하는 쉬프트 레지스터.
- 제 9 항에 있어서,상기 출력 버퍼부는상기 제9 트랜지스터에 접속되어, 상기 프리차지된 제1 노드를 어느 하나의 클럭 신호를 이용하여 부트스트래핑시키기 위한 캐패시터를 추가로 구비하는 것을 특징으로 하는 쉬프트 레지스터.
- 제 9 항에 있어서,상기 제1 노드 제어부는상기 제8 트랜지스터와 병렬 접속되어 상기 다음단 스테이지의 출력 신호에 의해 제어되는 제11 트랜지스터를 추가로 구비하는 것을 특징으로 하는 쉬프트 레지스터
- 제 1 항에 있어서,상기 스테이지는 동일 채널 타입의 트랜지스터로 구성된 것을 특징으로 하는 쉬프트 레지스터.
- 제 1 항에 있어서,상기 스테이지는 NPMOS 트랜지스터로 구성된 것을 특징으로 하는 쉬프트 레지스터.
- 제 1 항에 있어서,상기 스테이지는 아모퍼스-실리콘 박막 트랜지스터로 구성된 것을 특징으로 하는 쉬프트 레지스터.
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