CN106486085A - 移位寄存器电路、驱动方法、goa电路和显示装置 - Google Patents

移位寄存器电路、驱动方法、goa电路和显示装置 Download PDF

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Abstract

本发明提供一种移位寄存器电路、驱动方法、GOA(阵列基板行驱动)电路和显示装置。所述移位寄存器电路包括GOA子电路，所述GOA子电路包括上拉节点，所述移位寄存器电路还包括关机控制单元；所述关机控制单元用于当接收到显示面板的关机控制信号时，控制开启电压输出线向栅极驱动信号输出端施加开启电压，并控制所述上拉节点与所述关闭电压输出线连接。本发明所通过采用关机控制单元可以消除关机残影，并能防止关机后上拉节点的残留电压使得该被所述上拉节点控制的晶体管的特性漂移，从而在一定程度上防止不良发生。

Description

移位寄存器电路、驱动方法、GOA电路和显示装置
技术领域
本发明涉及显示驱动技术领域，尤其涉及一种移位寄存器电路、驱动方法、GOA(Gate On Array，阵列基板行驱动)电路和显示装置。
背景技术
在现有技术中，栅极驱动芯片(Gate Driver IC)具有Xon(关机瞬间的栅线开启)功能，Xon功能的实现方式为：在关机瞬间Xon信号被置于高电平，触发栅极驱动芯片所有输出通道同时输出TFT(薄膜晶体管)开启电压，使所有行的TFT(薄膜晶体管)全部开启，释放像素电极上残留的电荷。然而该技术存在一定问题，如关机瞬间所有电压都处于下降阶段，此时所有通道同时输出开启电压(开启电压的电压值一般与高电压Vgh相同，约为27V)，会导致栅极驱动芯片驱动能力不足，不能使所有的栅线都打开，会存在线残影等。并且，现有技术未在显示面板关机时对栅极驱动电路包括的移位寄存器单元中的上拉节点的电位进行复位，从而会导致关机后由于上拉节点的残留电压使得该被所述上拉节点控制的晶体管的特性漂移，从而会导致显示不良发生。
发明内容
本发明的主要目的在于提供一种移位寄存器电路、驱动方法、GOA电路和显示装置，解决现有的栅极驱动芯片实现Xon功能时由于栅极驱动芯片的驱动能力不足不能使所有的栅线都打开，会存在线残影等现象，并现有技术未在显示面板关机时对移位寄存器电路包括的GOA子电路中的上拉节点的电位进行复位，从而会导致关机后由于上拉节点的残留电压使得该被所述上拉节点控制的晶体管的特性漂移，从而会导致显示不良发生的问题。
为了达到上述目的，本发明提供了一种移位寄存器电路，包括用于输出栅极驱动信号的GOA子电路，所述GOA子电路的栅极驱动信号输出端用于输出栅极驱动信号，所述GOA子电路包括上拉节点，所述移位寄存器电路还包括关机控制单元；
所述关机控制单元分别与所述栅极驱动信号输出端、所述上拉节点、开启电压输出线和关闭电压输出线连接，用于当接收到所述显示面板的关机控制信号时，控制所述开启电压输出线向所述栅极驱动信号输出端施加开启电压，以使得与相应行栅线连接的像素单元中的薄膜晶体管都导通，并控制所述上拉节点与所述关闭电压输出线连接；
所述关闭电压输出线为地线或负电压输出线。
实施时，所述关机控制单元包括：
输出控制模块，分别与所述栅极驱动信号输出端和所述开启电压输出线连接，用于当接收到所述显示面板的关机控制信号时，控制所述开启电压输出线向所述栅极驱动信号输出端施加开启电压。
实施时，所述关机控制单元还包括：
第一上拉节点控制模块，分别与所述上拉节点和所述关闭电压输出线连接，用于当接收到所述显示面板的关机控制信号时，控制所述上拉节点与所述关闭电压输出线连接。
实施时，所述输出控制模块包括：输出控制晶体管，栅极与用于输出所述关机控制信号的关机控制信号输出线连接，第一极与所述开启电压输出线连接，第二极与所述栅极驱动信号输出端连接；
所述第一上拉节点控制模块包括：第一上拉节点控制晶体管，栅极与所述关机控制信号输出线连接，第一极与所述上拉节点连接，第二极与所述关闭电压输出线连接。
实施时，所述GOA子电路包括：
第二上拉节点控制模块，分别与输入端、复位端、第一时钟信号输出端、下拉节点和所述上拉节点连接，用于在输入端、复位端、第一时钟信号输出端、下拉节点和所述上拉节点的控制下控制所述上拉节点的电位；
充放电模块，第一端与所述上拉节点连接，第二端与所述栅极驱动信号输出端连接；
下拉节点控制模块，分别与所述第一时钟信号输出端和所述上拉节点连接，用于在所述第一时钟信号输出端和所述上拉节点的控制下控制所述下拉节点的电位；以及，
输出模块，分别与所述栅极驱动信号输出端、所述上拉节点、所述下拉节点、第一时钟信号输出端、第二时钟信号输出端和低电平输出端连接，用于当所述上拉节点的电位为第一电平时控制所述栅极驱动信号输出端与所述第二时钟信号输出端连接，当所述下拉节点的电位和/或所述第一时钟信号输出端输出的第一时钟信号为第一电平时控制栅极驱动信号输出端与所述低电平输出端连接。
实施时，所述GOA子电路还包括：
复位模块，分别与所述复位端、所述栅极驱动信号输出端和所述低电平输出端连接，用于在所述复位端的控制下控制所述栅极驱动输出端是否与所述低电平输出端连接。
实施时，所述下拉节点控制模块包括：
第一下拉节点控制晶体管，栅极与所述上拉节点连接，第一极与所述下拉节点连接，第二极与低电平输出端连接；
第二下拉节点控制晶体管，栅极和第一极都与所述第一时钟信号输出端连接；
第三下拉节点控制晶体管，栅极与所述第二下拉节点控制晶体管的第二极连接，第二极与所述下拉节点连接；以及，
第四下拉节点控制晶体管，栅极所述上拉节点连接，第一极与所述第三下拉节点控制晶体管的栅极连接，第二极与所述低电平输出端连接；
所述输出模块包括:
上拉晶体管，栅极与所述上拉节点连接，第一极与所述第二时钟信号输出端连接，第二极与所述栅极驱动信号输出端连接；
下拉晶体管，栅极与所述下拉节点连接，第一极与所述栅极驱动信号输出端连接，第二极与所述低电平输出端连接；以及，
输出晶体管，栅极与所述第一时钟信号输出端连接，第一极与所述栅极驱动信号输出端连接，第二极与所述低电平输出端连接；
所述关机控制单元具体用于当接收到所述关机控制信号时，控制所述上拉节点与所述关闭电压输出线连接，以使得所述第一下拉节点控制晶体管和所述上拉晶体管都关闭。
本发明还提供了一种移位寄存器电路的驱动方法，应用于上述的移位寄存器电路，所述移位寄存器电路的驱动方法包括：
当关机控制单元接收到显示面板的关机控制信号时，所述关机控制单元控制开启电压输出线向栅极驱动信号输出端施加开启电压，以使得与相应行栅线连接的像素单元中的薄膜晶体管都导通，并控制上拉节点与关闭电压输出线连接；
所述关闭电压输出线为地线或负电压输出线。
本发明还提供了一种GOA电路，包括多个级联的上述的移位寄存器电路；
除了第一级移位寄存器电路之外，每一级移位寄存器电路包括的GOA子电路的输入端都与相邻上一级移位寄存器电路包括的GOA子电路的栅极驱动信号输出端连接；
除了最后一级移位寄存器电路之外，每一级移位寄存器电路包括的GOA子电路的复位端都与相邻下一级移位寄存器电路包括的GOA子电路的栅极驱动信号输出端连接。
本发明还提供了一种显示装置，包括上述的GOA电路。
与现有技术相比，本发明所述的移位寄存器电路、驱动方法、GOA电路和显示装置，通过采用关机控制单元在显示面板关机时控制所有的栅极驱动信号输出端与开启电压输出线连接，以使得与所述相应行栅线连接的像素单元中的薄膜晶体管都导通，从而释放像素电极上残留的电荷，以消除关机残影，由于本发明实施例所述的移位寄存器电路不是通过栅极驱动芯片(Gate Driver IC)来驱动所有栅线开启，因此不存在由于栅极驱动芯片驱动能力不足，不能使所有的栅线都打开，会存在线残影等的问题，并且本发明实施例所述的移位寄存器电路通过关机控制单元在显示面板关机时控制上拉节点与关闭电压输出线连接，防止关机后上拉节点的残留电压使得该被所述上拉节点控制的晶体管的特性漂移，从而在一定程度上防止不良发生。
附图说明
图1是本发明实施例所述的移位寄存器电路的结构图；
图2是本发明另一实施例所述的移位寄存器电路的结构图；
图3是本发明又一实施例所述的移位寄存器电路的结构图；
图4是本发明所述的移位寄存器电路的一具体实施例的电路图；
图5是图4所示的移位寄存器电路的具体实施例在正常显示时的工作时序图；
图6是图4所示的移位寄存器电路的具体实施例在关机时的工作时序图；
图7是本发明实施例所述的GOA电路的结构图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
如图1所示，本发明实施例所述的移位寄存器电路，包括用于输出栅极驱动信号的GOA子电路10，所述GOA子电路10的栅极驱动信号输出端Output用于输出栅极驱动信号，所述GOA子电路10包括上拉节点PU，所述移位寄存器电路还包括关机控制单元11；
所述关机控制单元11分别与所述栅极驱动信号输出端Output、所述上拉节点PU、开启电压输出线Von和关闭电压输出线Voff连接，用于当接收到所述显示面板的关机控制信号时，控制所述开启电压输出线Von向所述栅极驱动信号输出端Output连接，以使得与相应行栅线连接的像素单元中的薄膜晶体管(图1中未示出)都导通，并控制所述上拉节点PU与所述关闭电压输出线Voff连接；
所述关闭电压输出线Voff为地线或负电压输出线。
在实际操作时，所述栅极驱动信号输出端Output与相应行栅线连接，由于与所述相应行栅线连接的像素单元中的薄膜晶体管一般为n型薄膜晶体管，因此Von输出的开启电压为能够控制所述薄膜晶体管都导通的高电平；
由于所述GOA子电路10包括的晶体管的类型一般也为n型，因此在具体实施时，所述关闭电压输出线可以为地线或负电压输出线，以防止关机后上拉节点PU的残留电压使得该被所述上拉节点PU控制的晶体管打开或存在特性漂移。
本发明实施例所述的移位寄存器电路通过采用关机控制单元11在显示面板关机时控制开启电压输出线Von向栅极驱动信号输出端Output施加开启电压，以使得与所述相应行栅线连接的像素单元中的薄膜晶体管都导通，从而释放像素电极上残留的电荷，以消除关机残影，由于本发明实施例所述的移位寄存器电路不是通过栅极驱动芯片(GateDriver IC)来驱动所有栅线开启，因此不存在由于栅极驱动芯片驱动能力不足，不能使所有的栅线都打开，会存在线残影等的问题，并且本发明实施例所述的移位寄存器电路通过关机控制单元11在显示面板关机时控制上拉节点PU与关闭电压输出线Voff连接，以防止关机后上拉节点PU的残留电压使得该被所述上拉节点PU控制的晶体管打开或存在特性漂移，从而在一定程度上防止不良发生。
具体的，所述关机控制单元可以包括：
输出控制模块，分别与所述栅极驱动信号输出端和所述开启电压输出线连接，用于当接收到所述显示面板的关机控制信号时，控制所述开启电压输出线向所述栅极驱动信号输出端施加开启电压。
具体的，所述关机控制单元还可以包括：
第一上拉节点控制模块，分别与所述上拉节点和所述关闭电压输出线连接，用于当接收到所述显示面板的关机控制信号时，控制所述上拉节点与所述关闭电压输出线连接。
根据一种具体实施方式，如图2所示，所述关机控制单元11可以包括：
输出控制模块111，分别与所述栅极驱动信号输出端Output和所述开启电压输出线Von连接，用于当接收到所述显示面板的关机控制信号时，控制所述开启电压输出线Von向所述栅极驱动信号输出端Output施加开启电压；以及，
第一上拉节点控制模块112，分别与所述上拉节点PU和所述关闭电压输出线Voff连接，用于当接收到所述显示面板的关机控制信号时，控制所述上拉节点PU与所述关闭电压输出线Voff连接。
所述关机控制单元11可以通过其包括的输出控制模块111、第一上拉节点控制模块112，分别在关机时控制栅极驱动信号输出端Output的电压状态、上拉节点PU的电压状态。
根据一种具体实施方式，所述输出控制模块包括：输出控制晶体管，栅极与用于输出所述关机控制信号的关机控制信号输出线连接，第一极与所述开启电压输出线连接，第二极与所述栅极驱动信号输出端连接；
所述第一上拉节点控制模块包括：第一上拉节点控制晶体管，栅极与所述关机控制信号输出线连接，第一极与所述上拉节点连接，第二极与所述关闭电压输出线连接。
如图3所示，所述输出控制模块111包括：输出控制晶体管MOC，栅极与用于输出所述关机控制信号的关机控制信号输出线T1连接，源极与所述开启电压输出线Von连接，漏极与所述栅极驱动信号输出端Output连接；
所述第一上拉节点控制模块包括112：第一上拉节点控制晶体管MUC，栅极与所述关机控制信号输出线T1连接，源极与所述上拉节点PU连接，漏极与所述关闭电压输出线Voff连接。
在具体实施时，所述GOA子电路可以包括：
第二上拉节点控制模块，分别与输入端、复位端、第一时钟信号输出端、下拉节点和所述上拉节点连接，用于在输入端、复位端、第一时钟信号输出端、下拉节点和所述上拉节点的控制下控制所述上拉节点的电位；
充放电模块，第一端与所述上拉节点连接，第二端与所述栅极驱动信号输出端连接；
下拉节点控制模块，分别与所述第一时钟信号输出端和所述上拉节点连接，用于在所述第一时钟信号输出端和所述上拉节点的控制下控制所述下拉节点的电位；以及，
输出模块，分别与所述栅极驱动信号输出端、所述上拉节点、所述下拉节点、第一时钟信号输出端、第二时钟信号输出端和低电平输出端连接，用于当所述上拉节点的电位为第一电平时控制所述栅极驱动信号输出端与所述第二时钟信号输出端连接，当所述下拉节点的电位和/或所述第一时钟信号输出端输出的第一时钟信号为第一电平时控制栅极驱动信号输出端与所述低电平输出端连接。
具体的，本发明实施例所述的移位寄存器电路，所述GOA子电路还包括：
复位模块，分别与所述复位端、所述栅极驱动信号输出端和所述低电平输出端连接，用于在所述复位端的控制下控制所述栅极驱动输出端是否与所述低电平输出端连接。
具体的，所述下拉节点控制模块可以包括：
第一下拉节点控制晶体管，栅极与所述上拉节点连接，第一极与所述下拉节点连接，第二极与低电平输出端连接；
第二下拉节点控制晶体管，栅极和第一极都与所述第一时钟信号输出端连接；
第三下拉节点控制晶体管，栅极与所述第二下拉节点控制晶体管的第二极连接，第二极与所述下拉节点连接；以及，
第四下拉节点控制晶体管，栅极所述上拉节点连接，第一极与所述第三下拉节点控制晶体管的栅极连接，第二极与所述低电平输出端连接；
所述输出模块包括:
上拉晶体管，栅极与所述上拉节点连接，第一极与所述第二时钟信号输出端连接，第二极与所述栅极驱动信号输出端连接；
下拉晶体管，栅极与所述下拉节点连接，第一极与所述栅极驱动信号输出端连接，第二极与所述低电平输出端连接；以及，
输出晶体管，栅极与所述第一时钟信号输出端连接，第一极与所述栅极驱动信号输出端连接，第二极与所述低电平输出端连接；
所述关机控制单元具体用于当接收到所述关机控制信号时，控制所述上拉节点与所述关闭电压输出线连接，以使得所述第一下拉节点控制晶体管和所述上拉晶体管都关闭。
在接收到关机控制信号时，关机控制单元控制将上拉节点的电位拉低，从而使得所述上拉晶体管和所述第一下拉控制晶体管都关闭。
下面通过一具体实施例来说明本发明所述的移位寄存器电路。
相对于传统的移位寄存器电路，本实施例所述的GOA子电路的外围控制线增加了关机控制信号输出线T1和开启电压输出线Von；
以GOA电路包括的第N级移位寄存器电路(N为奇数)驱动单元为例，其电路图如图4所示，所述移位寄存器电路的一具体实施例包括14个TFT(Thin Film Transistor，薄膜晶体管)、1个电容、2个时钟信号(第一时钟信号CLK1和第二时钟信号CLK2)、开启电压输出线Von、关机控制信号输出线T1(用于控制消除关机残影)、输入端INPUT，低电平输出线VSS、复位端RESET以及栅极驱动信号输出端Output；VSS输出直流低电平信号，CLK1与CLK2为周期相同、幅值不同的时钟信号(交替控制移位寄存器电路)，CLK1与CLK2反相，这里需要说明的是，第N+1级移位寄存器电路(N为奇数)为偶数级移位寄存器电路，相比于第N级移位寄存器电路，结构上CLK1与CLK2位置互换，其余基本结构相同，这里不多做介绍。
在图4中，标号为PU的为上拉节点，标号为PD的为下拉节点，标号为PD_CN的为下拉控制节点。
在图4中，关闭电压输出线采用低电平输出线VSS，也即关闭电压为低电平，所述低电平可以为地电平，也可以为负电压。
在图4所示的具体实施例中，M15为输出控制晶体管，M14为第一上拉节点控制晶体管，M6为第一下拉节点控制晶体管，M9为第二下拉节点控制晶体管，M5为第三下拉节点控制晶体管，M8为第四下拉节点控制晶体管，M3为上拉晶体管，M11为下拉晶体管，M12为输出晶体管；
第二上拉节点控制模块包括输入晶体管M1、复位晶体管M2、第二上拉节点控制晶体管M13、第三上拉节点控制晶体管M10；
复位模块包括输出复位晶体管M4；充放电模块包括存储电容C1。
在图4中，所有的晶体管都为n型晶体管，当第一极为源极时，第二极为漏极；当第一极为漏极时，第二极为源极。
以第N级移位寄存器电路(N为奇数)为例进行正常显示时序说明。当液晶面板正常显示时，第N级移位寄存器电路的工作时序如图5所示。此时，T1输出低电平，M14和M15都关闭，由INPUT输入的输入信号将M3打开，将第二时钟信号CLK2输入Output，产生输出的栅极驱动信号。当RESET输出的复位信号输入后，M1关闭，M2开启，PU与VSS相连，PU的电位被拉至低电平，M3关闭。此时第一时钟信号CLK1为高电平信号，M9开启，下拉控制节点PD_CN的电位被置于高电平，M5开启，PD的电位升到高电平，M11开启，Output被VSS输出的低电平信号置于低电平。以此类推，第N级移位寄存器电路、第N+1级移位寄存器电路、第N+2级移位寄存器电路……依次产生相应的栅极驱动信号，对液晶面板进行驱动，完成液晶面板的正常显示。
同样以第N级移位寄存器电路(N为奇数)为例进行关机瞬间时序说明。在液晶面板关机瞬间，第N级移位寄存器电路的工作时序如图6所示。在关机瞬间T1输出高电平信号，此时M14和M15都打开，PU的电位被VSS拉低，被置于低电平，M3关闭，此时Output输出的栅极驱动信号变为Von输出的开启电压(Von输出的开启电压的电压值一般与高电压Vgh相同，约为27V)，与相应的栅线连接的薄膜晶体管(该薄膜晶体管为位于像素单元内的薄膜晶体管)打开，释放像素电极中的电荷，达到消除关机残影的效果。以此类推，第N级移位寄存器电路、第N+1级移位寄存器电路、第N+2级移位寄存器电路……分别产生相应的栅极驱动信号，液晶面板上的AA区(Active Area，有效显示区)中的与所有栅线连接的薄膜晶体管都打开，同时释放像素电极中的电荷，达到对整个显示面板消除关机残影的效果。这里需要说明的是，在关机瞬间，在T1输出的信号的控制下，M15打开，通过VSS将PU的电位拉低，不仅将M3关闭，Output输出开启电压，还有一个重要作用就是在关机瞬间将PU的电位拉低，防止关机后PU的残留电压对移位寄存器电路内M3、M6等TFT特性的影响。如果不对PU进行放电，M3和M6可能被误打开，并且M3的TFT特性和M6的TFT特性会相应漂移，造成不良显示，影响液晶面板的品质。
本发明实施例所述的移位寄存器电路的驱动方法，应用于上述的移位寄存器电路，所述移位寄存器电路的驱动方法包括：
当关机控制单元接收到显示面板的关机控制信号时，所述关机控制单元控制开启电压输出线向栅极驱动信号输出端施加开启电压，以使得与相应行栅线连接的像素单元中的薄膜晶体管都导通，并控制上拉节点与关闭电压输出线连接；
所述关闭电压输出线为地线或负电压输出线。
本发明实施例所述的GOA电路包括多个级联的上述的移位寄存器电路。
在本发明实施例所述的GOA电路中，除了第一级移位寄存器电路之外，每一级移位寄存器电路包括的GOA子电路的输入端都与相邻上一级移位寄存器电路包括的GOA子电路的栅极驱动信号输出端连接；
除了最后一级移位寄存器电路之外，每一级移位寄存器电路包括的GOA子电路的复位端都与相邻下一级移位寄存器电路包括的GOA子电路的栅极驱动信号输出端连接。
在图7中，S1标示第一级移位寄存器电路，S2标示第二移位寄存器电路，S3标示第三移位寄存器电路，S4标示第四移位寄存器电路，VSS为低电平输出线，CLK1为第一时钟信号，CLK2为第二时钟信号,T1为关机控制信号输出线，Von为开启电压输出线；
S1的输入端INPUT接入起始信号STV；
G1标示第一级移位寄存器电路S1的栅极驱动信号输出端；
S1的复位端与S2的栅极驱动信号输出端G2连接；
G1与S2的输入端连接；
G2与S3的输入端连接；S2的复位端与S3的栅极驱动信号输出端G3连接；
G3与S4的输入端连接，G4与S3的复位端连接。
本发明实施例所述的显示装置包括上述的GOA电路。
以上所述是本发明的优选实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本发明所述原理的前提下，还可以作出若干改进和润饰，这些改进和润饰也应视为本发明的保护范围。

Claims (10)

1.一种移位寄存器电路，包括用于输出栅极驱动信号的GOA子电路，所述GOA子电路的栅极驱动信号输出端用于输出栅极驱动信号，所述GOA子电路包括上拉节点，其特征在于，所述移位寄存器电路还包括关机控制单元；
所述关机控制单元分别与所述栅极驱动信号输出端、所述上拉节点、开启电压输出线和关闭电压输出线连接，用于当接收到所述显示面板的关机控制信号时，控制所述开启电压输出线向所述栅极驱动信号输出端施加开启电压，以使得与相应行栅线连接的像素单元中的薄膜晶体管都导通，并控制所述上拉节点与所述关闭电压输出线连接；
所述关闭电压输出线为地线或负电压输出线。
2.如权利要求1所述的移位寄存器电路，其特征在于，所述关机控制单元包括：
输出控制模块，分别与所述栅极驱动信号输出端和所述开启电压输出线连接，用于当接收到所述显示面板的关机控制信号时，控制所述开启电压输出线向所述栅极驱动信号输出端施加开启电压。
3.如权利要求2所述的移位寄存器电路，其特征在于，所述关机控制单元还包括：
第一上拉节点控制模块，分别与所述上拉节点和所述关闭电压输出线连接，用于当接收到所述显示面板的关机控制信号时，控制所述上拉节点与所述关闭电压输出线连接。
4.如权利要求3所述的移位寄存器电路，其特征在于，所述输出控制模块包括：输出控制晶体管，栅极与用于输出所述关机控制信号的关机控制信号输出线连接，第一极与所述开启电压输出线连接，第二极与所述栅极驱动信号输出端连接；
所述第一上拉节点控制模块包括：第一上拉节点控制晶体管，栅极与所述关机控制信号输出线连接，第一极与所述上拉节点连接，第二极与所述关闭电压输出线连接。
5.如权利要求1至4中任一权利要求所述的移位寄存器电路，其特征在于，所述GOA子电路包括：
第二上拉节点控制模块，分别与输入端、复位端、第一时钟信号输出端、下拉节点和所述上拉节点连接，用于在输入端、复位端、第一时钟信号输出端、下拉节点和所述上拉节点的控制下控制所述上拉节点的电位；
充放电模块，第一端与所述上拉节点连接，第二端与所述栅极驱动信号输出端连接；
下拉节点控制模块，分别与所述第一时钟信号输出端和所述上拉节点连接，用于在所述第一时钟信号输出端和所述上拉节点的控制下控制所述下拉节点的电位；以及，
输出模块，分别与所述栅极驱动信号输出端、所述上拉节点、所述下拉节点、第一时钟信号输出端、第二时钟信号输出端和低电平输出端连接，用于当所述上拉节点的电位为第一电平时控制所述栅极驱动信号输出端与所述第二时钟信号输出端连接，当所述下拉节点的电位和/或所述第一时钟信号输出端输出的第一时钟信号为第一电平时控制栅极驱动信号输出端与所述低电平输出端连接。
6.如权利要求5所述的移位寄存器电路，其特征在于，所述GOA子电路还包括：
复位模块，分别与所述复位端、所述栅极驱动信号输出端和所述低电平输出端连接，用于在所述复位端的控制下控制所述栅极驱动输出端是否与所述低电平输出端连接。
7.如权利要求5所述的移位寄存器电路，其特征在于，
所述下拉节点控制模块包括：
第一下拉节点控制晶体管，栅极与所述上拉节点连接，第一极与所述下拉节点连接，第二极与低电平输出端连接；
第二下拉节点控制晶体管，栅极和第一极都与所述第一时钟信号输出端连接；
第三下拉节点控制晶体管，栅极与所述第二下拉节点控制晶体管的第二极连接，第二极与所述下拉节点连接；以及，
第四下拉节点控制晶体管，栅极所述上拉节点连接，第一极与所述第三下拉节点控制晶体管的栅极连接，第二极与所述低电平输出端连接；
所述输出模块包括:
上拉晶体管，栅极与所述上拉节点连接，第一极与所述第二时钟信号输出端连接，第二极与所述栅极驱动信号输出端连接；
下拉晶体管，栅极与所述下拉节点连接，第一极与所述栅极驱动信号输出端连接，第二极与所述低电平输出端连接；以及，
输出晶体管，栅极与所述第一时钟信号输出端连接，第一极与所述栅极驱动信号输出端连接，第二极与所述低电平输出端连接；
所述关机控制单元具体用于当接收到所述关机控制信号时，控制所述上拉节点与所述关闭电压输出线连接，以使得所述第一下拉节点控制晶体管和所述上拉晶体管都关闭。
8.一种移位寄存器电路的驱动方法，应用于如权利要求1至7中任一权利要求所述的移位寄存器电路，其特征在于，所述移位寄存器电路的驱动方法包括：
当关机控制单元接收到显示面板的关机控制信号时，所述关机控制单元控制开启电压输出线向栅极驱动信号输出端施加开启电压，以使得与相应行栅线连接的像素单元中的薄膜晶体管都导通，并控制上拉节点与关闭电压输出线连接；
所述关闭电压输出线为地线或负电压输出线。
9.一种GOA电路，其特征在于，包括多个级联的如权利要求1至7中任一权利要求所述的移位寄存器电路；
除了第一级移位寄存器电路之外，每一级移位寄存器电路包括的GOA子电路的输入端都与相邻上一级移位寄存器电路包括的GOA子电路的栅极驱动信号输出端连接；
除了最后一级移位寄存器电路之外，每一级移位寄存器电路包括的GOA子电路的复位端都与相邻下一级移位寄存器电路包括的GOA子电路的栅极驱动信号输出端连接。
10.一种显示装置，其特征在于，包括如权利要求9所述的GOA电路。
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