WO1987002501A1 - Circuit for generating brake pulses - Google Patents

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WO1987002501A1
WO1987002501A1 PCT/JP1986/000522 JP8600522W WO8702501A1 WO 1987002501 A1 WO1987002501 A1 WO 1987002501A1 JP 8600522 W JP8600522 W JP 8600522W WO 8702501 A1 WO8702501 A1 WO 8702501A1
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WO
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pulse
motor
gate
brake
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Application number
PCT/JP1986/000522
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English (en)
French (fr)
Inventor
Ayumu Okutani
Yukinori Konushi
Original Assignee
Sanyo Electric Co., Ltd.
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    • HELECTRICITY
    • H02GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02PCONTROL OR REGULATION OF ELECTRIC MOTORS, ELECTRIC GENERATORS OR DYNAMO-ELECTRIC CONVERTERS; CONTROLLING TRANSFORMERS, REACTORS OR CHOKE COILS
    • H02P3/00Arrangements for stopping or slowing electric motors, generators, or dynamo-electric converters
    • H02P3/06Arrangements for stopping or slowing electric motors, generators, or dynamo-electric converters for stopping or slowing an individual dynamo-electric motor or dynamo-electric converter
    • H02P3/08Arrangements for stopping or slowing electric motors, generators, or dynamo-electric converters for stopping or slowing an individual dynamo-electric motor or dynamo-electric converter for stopping or slowing a dc motor
    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B15/00Driving, starting or stopping record carriers of filamentary or web form; Driving both such record carriers and heads; Guiding such record carriers or containers therefor; Control thereof; Control of operating function
    • G11B15/18Driving; Starting; Stopping; Arrangements for control or regulation thereof
    • G11B15/1808Driving of both record carrier and head
    • G11B15/1875Driving of both record carrier and head adaptations for special effects or editing
    • GPHYSICS
    • G11INFORMATION STORAGE
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    • G11B15/4673Controlling, regulating, or indicating speed in arrangements for recording or reproducing wherein both record carriers and heads are driven by controlling the speed of the tape while the head is rotating
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    • G11B15/18Driving; Starting; Stopping; Arrangements for control or regulation thereof
    • G11B15/46Controlling, regulating, or indicating speed
    • G11B15/48Starting; Accelerating; Decelerating; Arrangements preventing malfunction during drive change

Definitions

  • the present invention relates to a brake pulse generation circuit, and more specifically, to a video tape that intermittently moves a tape in order to perform slow-through slow reproduction.
  • intermittent slow regeneration has been performed in a Helical-scan VTR.
  • tapes are driven intermittently. This is realized by repeating still reproduction and normal reproduction at predetermined P intervals.
  • a VTR is usually provided with an intermittent drive circuit, and this intermittent drive circuit is briefly described.
  • RF switching pulse the tape is activated to perform normal playback, and furthermore, a control played during tape driving.
  • the stop position of the tape in the still playback state is important.
  • the stop position of the table in such a still playback state is greatly affected by the pulse width of the brake pulse. That is, if the pulse width of the brake pulse is smaller than the proper value, the tape will stop before the correct position, and if it is larger than the proper value, the tape will stop. This is because the running direction of the pump is reversed.
  • FIG. 1 shows a circuit for detecting the reverse rotation of a cabin motor used in the conventional eccentric drive circuit as described above. It is a figure. First, the configuration of the circuit shown in FIG. 1 will be described.
  • a magnetoresistive element 2 is provided, which is arranged at a predetermined distance from each other, and outputs of the magnetoresistive elements 2 and 3 are output from amplifiers 3 and 4 and a waveform shaping comparator 5. , 6 through 90 to each other. Supplied as FG signals with different phases. Of these FG signals, signal FG1 is applied to the data input of D-type flip-flop 7, and signal FG2 is applied to the data of D-type flip-flop 7. It is applied to the input. Then, the Q output of the D-type flip-flop 7 is supplied as a reverse discrimination output of the cabinet motor.
  • FIG. 2 is a waveform diagram for explaining the operation of the circuit shown in FIG.
  • the D-type flip-flop 7 is the signal FG2 rising at the clock input and the level of the signal FG1 applied to the data input at the rising edge of the signal FG2. Latch. Therefore, as is apparent from FIG. 2, when the capstan motor is rotating forward, the signal FG is output. At the rising edge of 2, the H level of the signal FG1 is always latched by the D-type flip-flop 7 and is output as a positive rotation discrimination output. . However, the application of the brake pulse causes the capture motor to reverse, causing the L level of signal FG1 to rise at the rise of signal FG2. When touched, D-type flip-flop 7 provides an output that indicates the reverse detection of the capstan motor. The intermittent drive circuit stops application of the brake pulse to the keystone motor in response to the detection of the reverse rotation of the keystone motor.
  • the present invention provides an appropriate pulse width with a small temporal shift from the actual reverse rotation of the capstan motor to the detection of the reverse rotation. It is an object of the present invention to provide a brake pulse generating circuit for generating a brake pulse having the same.
  • a brake pulse generating circuit is a video tape recorder that intermittently drives a tape at a predetermined time during a tape drive in a video tape recorder.
  • a brake pulse having a pulse width corrected to reversely brake the pump motor is created and applied to the capstan motor.
  • the first latch means for latching the bell at the rising edge of the second FG signal, and the level of the second FG signal at the rising edge of the first FG signal.
  • a second latch means for latching the inverted signal of the first FG signal at the falling edge of the second FG signal; and a second latch means for latching the inverted signal of the first FG signal at the falling edge of the second FG signal.
  • Fourth latch means for latching the inverted signal level at the falling edge of the first FG signal; and first, second, third and fourth latch means.
  • a first gate for outputting a signal indicating the detection of reverse rotation of the cabinet motor based on the output of the touch means, and a brake pulse is terminated in response to the first gate output.
  • a second gate for correcting a certain pulse width of the rake pulse and a first and a second gate for correcting the pulse width.
  • a third gate that corrects the motor drive signal so that the motor drive signal is terminated in response to the gate output of the third gate.
  • the capstan motor is activated by a start pulse based on a head exchange signal.
  • the means for generating a brake pulse generates a brake pulse in response to a control signal reproduced during tape running.
  • the first, second, third and fourth latch means are D-type flip-flops. This is realized by the flop.
  • a means for disabling the third gate except for the period during which the rake pulse is generated is further included. Yes.
  • the capstan motor is only driven by the girder at a predetermined time after the end of the corrected brake pulse.
  • the rotation direction of the capstan motor is detected at each edge of the first and second FG signals.
  • the time from the actual reverse rotation of the capstan motor to the detection of reverse rotation is small, and the capture motor is reversed using a brake pulse having a corrected pulse width.
  • the tape can be controlled in the still playback mode. It can be stopped at the correct position.
  • the motor drive signal may be terminated by mistake due to the noise of the FG signal at the time of starting the capstan motor. Therefore, there is no loss of tape startup.
  • the tape is sent in a slightly positive direction after the end of the brake pulse, and thereby the tape by the reverse rotation of the capacitor motor.
  • the displacement of the stop position can be used.
  • FIG. 1 is a schematic block diagram showing a circuit for detecting a reverse rotation of a capstan motor, which is used in a conventional drive circuit.
  • FIG. 2 is a waveform diagram for explaining the operation of the circuit shown in FIG.
  • FIG. 3 is a circuit diagram of a brake pulse generating circuit according to an embodiment of the present invention.
  • FIG. 4 is a circuit diagram showing an internal configuration of the intermittent drive circuit shown in FIG.
  • FIG. 5 is a waveform diagram for explaining the operation of the circuits shown in FIGS. 3 and 4.
  • FIG. 6 is a waveform diagram showing the relationship between signals FG1 and FG2 during normal rotation and reverse rotation of the caster motor.
  • FIG. 3 shows a brake pulse operation according to an embodiment of the present invention.
  • FIG. 4 is a circuit diagram showing a circuit.
  • the intermittent drive circuit 10 is constituted by an IC (approximately 875), and a head switch (RFSW) given via a terminal 44 is provided. Based on the signal a and the reproduction control signal d given via the terminal 45, a start pulse c is outputted via the terminal 48, and the terminal 47 is outputted. And outputs the brake pulse f via the terminal 46 and the motor drive signal g via the terminal 46.
  • the brake pulse f is input to the cap motor control signal correction circuit 1.1 via the terminal 36 and the motor drive signal g is input to the cap motor control signal correction circuit 1.1 via the terminal 35.
  • This capstan motor control signal correction circuit 11 is a circuit composed of a CMOS gate array, and the FG signal obtained from the capstan motor is obtained. Thus, the direction of rotation of the capstan motor is determined, and the detected brake pulse j and the corrected motor drive signal k are output. . That is, the signal FG1 is input to the capacitor motor control signal correction circuit 11 via the terminal 37, and the signal FG2 is also input via the terminal 38. This signal is input to the absolute motor control signal correction circuit 11.
  • the first D-type flip-flop 21 latches the level of the signal FG1 at the rise of the signal FG2, and outputs the inverted level of the signal FG1.
  • the second D-type flip-flop 22 latches the level of the signal FG2 at the rise of the signal FG1. Output.
  • the third D-type flip-flop 23 latches the inversion level of the signal FG1 through the inverter 12 at the falling of the signal FG2, and furthermore, The inverted level is output to the output.
  • the fourth D-type flip-flop 24 latches the inversion level of the signal FG2 passing through the inverter 13 below the signal FG1. Output.
  • the D-type flip-flops 21 and 23 are set at the rising edge of the output of the inverter 14, and the D-type flip-flops 22 and 24 are set. Is reset at the rise of the output of the inverter 14.
  • the outputs of the D-type flip-flops 21, 22, 23 and 24 and the output of the inverter 14 are supplied to a 5-input NOR gate 25. Further, the output h of the NOR gate 25 and the output of the inverter 15 are input to the AND gate 27, and the output of the AND gate 27 is connected to the inverter 19 After that, it is output as the corrected pulse j (negative logic) via the output terminal 30 after being inverted, and the capstan motor driving circuit (see FIG. (Not shown) is applied to the forward / reverse direction terminal (FZ100). The output of the AND gate 27 is supplied to the C terminal of the mono multi 29 via the inverter 16.
  • the output i of the EX-OR gate 28 which receives the motor drive signal g and the output of the inverter 15, the output i of the mono multi 29, and the NOR gate 2
  • the output h of 5 is given to the OR gate 26 of 3 inputs.
  • the output of the OR gate 26 is inverted as a result of the inverter 18 and then output as a motor drive signal corrected via the output terminal 31. Further, the output of the inverter 18 is inverted through the open-drain type inverter 20 and then corrected through the terminal 32.
  • a time constant circuit (capacitance C 1 and resistance R 2) for the mono multi 29 can be connected to the terminal 33 in some cases. Further, the output of the monomulti 29 is inverted via the inverter 17 and then output as a positive-direction transmission pulse £ via the terminal 34.
  • the speed control circuit 42 Based on the signal FG 1 input via the terminal 43, the speed control circuit 42 generates a key during the period between the start pulse c and the brake pulse f. It controls the speed of the yabstan motor. Then, the start pulse c, the corrected brake pulse j inverted by the inverter 41, and the output of the speed control circuit 42 are each a diode. The voltage is applied to the cabinet motor drive circuit (not shown) via the terminals D, D 2, and D 3 via the terminal 40 as a servo voltage. In addition, the first transistor Q1 is switched by the fc-th switching means for disconnecting the supply of the above-mentioned support voltage from the driving circuit of the capacitor motor S. Ah is, that are controlled by Tsu by the system muco emissions collected by filtration Lumpur circuit (not shown) or al the applied M c oN signal. No.
  • the transistor Q2 is switching means for cutting off the application of the control signal Mc0N to the transistor Q1.
  • the corrected motor drive Controlled by signal k, and because of the open drain type, the The output k of the terminal 32 is connected to the terminal 46 of the intermittent drive circuit 10 via the resistor R 1, and is equivalently pulled up.
  • FIG. 4 is an internal block diagram showing the configuration of the intermittent drive circuit 10 shown in FIG. 3, and FIGS. 5 and 6 are diagrams of FIG. FIG. 6 is a waveform chart for explaining the operation of the circuit shown in FIG.
  • the starter in the intermittent drive circuit 10 starts.
  • the start pulse mono multi 5 2 is triggered and the terminal 4 is triggered.
  • the start pulse c is generated and the motor drive signal g of the H repelle is output from the terminal 46.
  • FIG. 6A shows the relationship between the signals FG 1 and FG 2 during normal rotation of the capacitor motor
  • FIG. 6B shows the relationship between the signals FG 1 and FG 2.
  • the relationship between the signals FG 1 and FG 2 at the time of reverse rotation of the motor is shown.
  • the D-type flip-flops 21, 22, 23, etc. The outputs of D and F 24 are all at the level, and when the capstan motor rotates in reverse, as shown in Fig. 6B, the D-type flip-flop 2
  • the outputs of 1, 22, 23 and 24 all become H level.
  • the D-type flip-flops 2 ⁇ and 23 are set at the rising edge of the output of the inverter 14, and the D-type flip-flops 2 2 , 24 are reset at the rising edge of the output of the inverter 14, so that at the end of the motor drive signal g, the D-type flip-flop
  • the outputs of the tops 21, 22, 23 and 24 are all at the L level around the normal rotation. At this time, as described above, when the motor drive signal g at the terminal 46 of the intermittent drive circuit 10 becomes H level, the output of the inverter 14 becomes low level.
  • the output of NOR gate 25 is at H level.
  • the breaker 'f' is at the H level, so the output of EX-0R gate 28 outputs the rising edge of motor drive signal g and Is rising to the H level. Therefore, the output of the OR gate 26 is at the H level at the time of the rise of the motor drive signal g and at the time of the rotation, whereby the second transistor Q is output. 2 turns on.
  • the tracking mono-multi 52 inside the intermittent drive circuit 10 is triggered. Further, at the falling edge of the output e of the tracking mono multi 52 a, the brake pulse mono multi 53 is triggered, and the 28th pin of the IC 10 is triggered. That is, a negative logic brake pulse f as shown in FIG. 5 is output from the terminal 47. Then, the motor drive signal g provided from the drive circuit 10 falls at the same time as the end of the brake pulse f. The end points of the brake pulse f and the motor drive signal g supplied from these drive circuits 10 should be selected appropriately according to the external time constant of IC 10. Is set longer.
  • the end point of the brake pulse f and the motor drive signal g supplied from the intermittent drive circuit 10 is set longer, but the D-type When the flip-flops 21, 22, 23, and 24 detect reverse rotation of the cabin motor, the correction brake pulse j is generated at that point. Since the recording is terminated, the tape stops at the correct position, and it is possible to realize good still reproduction.
  • a mono-multi 29 is provided, and a capacitor C 1 shown by a broken line in FIG. 3 is connected to a terminal 33 to set a time constant.
  • the monomulti 29 triggered by the output of the AND gate 27 provides an H-level output for a predetermined time.
  • the positive-going transmission pulse £ obtained by inverting the output of the monomulti 29 by the impeller 17 is output by the impeller 60.
  • the tape is sent in a slightly square direction after the end of the correction brake pulse j.
  • the motor drive signal k for this period is also extended over the period shown by the broken line.
  • Terminal 31 is used by connecting a transistor externally when the drain capacity of output terminal 32 due to open drain is insufficient. be able to .
  • the present invention provides a video tape that performs intermittent slow playback by intermittently driving the tape to slowly and periodically resume still and normal playback at predetermined intervals. It can be widely applied to recorders.

Landscapes

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Description

明 細 書
ブ レ ー キパルス作成回 路
技術分野
こ の発明 は 、 ブ レ ー キパルス作成回路 に 関 し 、 よ り 特定 的に は 、 閭欠 ス ロ ー再生を行な う た め に テ ープを 間欠的に |g動 する ビ デオ テ ー プ レ コ ーダ ( V T R ) に おい て テ ー プ を停止させる た めのプ レ ーキパルス を作成す る回路 に 関 す る 。
背景技術
従来、 ヘ リ カ ルス キ ャ ン方式 の V T R に お い て 、 間欠 ス ロ ー再生が行なわ れて い るが 、 こ の 圜欠ス ロ ー再生 は 、 テ ー プを 間欠的 に駆動 し て ス チル再生 と通常再生 と を所定 の P 隔で繰返す こ と に よ っ て実現さ れる 。 こ の よ う な 間欠ス ロ ー 再生を実行 す る た め に 、 V T R に お い て は通常、 間欠 駆動回路 が設 け ら れて お り 、 こ の 間欠駆動回路 は 、 簡単 に 説明 する と 、 通常の ヘ ッ ド 換信号 ( R F ス イ ッ チ ングパ ルス ) に 応答 し て テ ープを起動 して通常再生を行な い 、 さ ら に テ ー プ走行時に 再生 さ れる コ ン ト ロ ー ル信号 に応答 し てテ ープを停止させて ス チル再生 を行な う よ う に機能す る c よ り 具体的 に 説明 する と 、 間欠駆動 回 路 は 、 通常再生 を 行な う と き に は 、 へ ッ ド切換信号 に応答 し て ス タ ー 卜 パル ス を発生 し て こ れをダイ レ ク 卜 ド ラ イ プの キ ヤ プス タ ン モ 一タ に 印加 し 、 こ の キ ヤ プス タ ン モ ー タ を急速に 回転せ し め る 。 一方ス チル再生 を行な う とき に は 、 再生 さ れた コ ン 卜 ロ ール信号に応答 してプ レ ーキパルスを発生 し て これを キ ヤ ブス タ ン モ ー タ に 印加 し 、 キ ヤ プス タ ン モ ー タ を逆転 させて テ ープを制動 す る 。 そ し て 、 上述の ス タ ー 卜 パルス と ブ レ ー キパルス と の 間 の テ ープ走行期間中 は 、 後述す る キ ヤ プス タ ンモ ー タ の F G ( frequency generator ) 信号 を利用:して キ ヤ プス タ ン モ ー タ の速度制御 を行な う 。
こ こで、 上述の よ う な間欠ス ロ ー再生 に おい て 、 スチル 再生状態に おける テープの停止位置が 重要で あ る 。 すなわ ち 、 スチル再生状態に おいて 、 ノ イ ズを確実に 垂直プラ ン キ ング期間 に追い込 ま な ければ、 ノ イズ レ スの 間欠ス ロ ー 再生を実現す る こ と はできないか らで ある 。 こ の よ う な 、 ス チル再'生状態に おけ る テ ー ブの停止位置は 、 プ レー キパ ルスのパルス幅に よ っ て大きな影轡を受け る 。 す なわ ち 、 プ レ ー キパルス のパルス幅が適正値よ り 小 さ け ればテ ー プ は正 し い位置よ り 前 に停止 し て し ま う し 、 適正値よ り 大き ければテ ー プの走行方向 が逆転 し て し ま う か ら で あ る 。
そ こで 、 従来の V T Rで は 、 キ ヤ プス タ ンモ ー タ か ら 2 相の F G信号を取出 し て こ の 2 相の F G信号 に よ り キ ヤ プ ス タ ンモ ー タ の逆転を判別 し 、 逆転が検出さ れた 時点でプ レ ー キパルスの印加を停止す る よ う に構成 し て い た 。 こ の よ う な従来の技術 に つ いて は 、 た と え ば曰 本国特許出願公 開公報 5 8 — 8 3 3 6 7 ; 曰 本国の 刊行物 で あ る " シ ヤ ー プ技法 " , 1 9 8 4 年, 第 2 9 号, PP1 2 5 〜 1 2 9 ; 周 じ く " N ational T echnical R eport: " , 第 2 8 巻第 3 号 , 1 9 8 2年 6月 : お よび 曰 本国特許出願公開公報 5 7 — 7 6 9 8 4 に おい て 開示さ れ て い る 。
第 1 図 は 、 上述の よ う な従来の 圜欠駆勁回路 に 用 い ら れ る 、 キ ヤ ブス タ ン モ ー タ の逆転検出の た めの回 路を示 す溉 1§プ ロ ッ ク 図であ る 。 ま ず 、 第 1 図 に 示 し た 回路の構成 に つ い て 説明 す る 。
第 ^! 図 に おい て 、 キ ヤ プス タ ンモ ー タ ( 図示せず ) と周 時 に 回転 す る磁石 1 の外周 が 多数の棰 に着磁 さ れて い る 。 ま た 、 互い に所定閭 隔離れて 配置さ れた磁気抵抗素子 2 が 設け ら れて お り 、 そ れ ら の出力 は 、 ア ン プ 3 , 4 、 波形整 形用 コ ンパ レ ー タ 5 , 6を介 し て 、 互い に 9 0 。 位相の異 な る F G信号 と し て供給 され る 。 こ れ ら の F G信号の う ち 、 信号 F G 1 が D型 フ リ ッ プフ ロ ッ プ 7 のデー タ 入力 に 印加 さ れ 、 信号 F G 2 が D型 フ リ ッ プフ ロ ッ プ 7 の ク ロ ッ ク 入 力 に 印加さ れる 。 そ し て D型 フ リ ッ プ フ ロ ッ プ 7の Q出力 が 、 キ ヤ ブス タ ン モ ー タ の逆転判別出力 と し て供給さ れる 。
次 に 、 第 2 図 は 、 第 1 図 に示 し た 回路 の動作を説明す る た め の波形図 で あ る 。
次に 、 第 2 図を参照 し て第 1 図 に 示 し た キ ヤプス タ ン モ — タ 逆転検出回路の 動作 に つ い て 説明 する 。 D型フ リ ッ プ フ ロ ッ プ 7 は 、 ク ロ ッ ク 入力 に 印 .¾さ れた信号 F G 2 の立 ち 上が り で 、 デー タ 入力 に 印加 さ れた信号 F G 1 の レ ベル をラ ッ チす る 。 し た が っ て 、 第 2 図か ら 明 ら かな よ う に 、 キ ヤ プス タ ン モ ー タ が正 回転 し て い る と き に は 、 信号 F G 2 の立ち上が り に おいて必ず信号 F G 1 の H レベルが D 型 フ リ ッ プ フ ロ ッ プ 7 に よ っ て ラ ッ チさ れ て 正回転の判別 出 力 と し て 出力 さ れる 。 し か し なが ら 、 プ レ ー キパルス の印 加 に よ っ て キ ヤ プス タ ン モー タ の逆転が生 じ 、 信号 F G 2 の立ち上が り に おいて信号 F G 1 の L レベルがラ ッ チさ れ る と、 D 型 フ リ ッ プ フ ロ ッ プ 7 は キ ヤ プス タ ン モ ー タ の逆 ¾検出を知 らせる 出力 を与える 。 間欠駆動回路 は こ の キ ヤ プス タ ン モ ー タ 逆転検出 に応 じ て 、 プ レ ー キパルスの キ ^ プス タ ン モ ー タ への印加を停止する 。
し か し なが ら 、 上述の よ う な従来の 間欠駆動 回路で は 、
2 つ の F G信号の う ち一方の F <3信号 の 1 つ のエ ッ ジ ( た と えぱ第 2 図の例 に おい て は信号 F G 2 の なち 上が り ) の タ ィ ミ ングで し か 、 他方の F G信号 ( た と えば信号 F G 1 ) の レ ベルの ラ ッ チすなわ ち キ ヤ プス タ ン モ ー タ の回転方向 の検出がでさないので 、 キ ヤ プス タ ンモ ー タ の実際の逆転 か ら逆転検出出力 が得 ら れる ま での時間 的 ずれが大きい場 合があ り 、 こ の よ う な場合に は適正 なパルス幅のプ レ ー キ ルス が得 ら れないおそ れがあ る 。 ま た 、 従来の間欠 動 回路で は 、 キ ヤ ブス タ ンモ ー タ の起動 時の F G信号が不安 定 で ノ イ ズが混入 し てい る場合 に第 1 図 に 示 し た判別回路 が誤動作 しテ ープの起動 に失敗する おそ れがある 。
発明 の 開示
そ こで 、 こ の発明 は 、 キ ヤ プス タ ン モー タ の実際の逆転 か ら 逆転検出 ま での時閩的ず れが少ない適正なパルス幅を 有するブ レ ー キパルス を発生 するブ レ ー キパルス作成回路 を提供 し ょ う と する も の であ る 。
こ の発明 に よ るブ レ ー キパルス作成回路 は 、 所定 の 時閭 閭隔で テ ー プを 間欠的に駆動 す る ビデオ テ ー プ レ コ ー ダ に お いて テ ープ走行中 に キ ヤ プス タ ンモ ー タ を逆転制動す る た め に 補正 さ れたパルス幅を有するプ レ ー キパルス を作成 して キ ヤ プス タ ンモ ー タ に 印加するも ので あ り 、 キ ヤ プス タ ン モ ー タ を駆動 す る た め の モ ー タ 駆動信 号 を キ ヤ プス タ ンモ ー タ に 供給する た めの手段 と 、 キ ヤ プス タ ンモ ー タ の 逆転制 動 時に 一定のパルス幅を有するプ レ ー キパルスを発 生 して キ ヤ プス タ ン モー タ に 印加す る手段 と 、 キ ヤ プス タ ン モ ー タ の回 転 に 関連 し て 、 互い に位相の異な る第 1 お よ び第 2 の F G信号を発生する手段 と 、 第 1 の F G信号の レ ベルを第 2 の F G信号の 立 ち 上が り で ラ ッ チする第 1 の ラ ツ チ手段 と 、 第 2 の F G信号の レベルを第 1 の F G信号の 立ち 上が り で ラ ッ チす る第 2 の ラ ッ チ手段 と 、 第 1 の F G 信号の反転信号の レ ペルを第 2 の F G 信号の立ち 下が り で ラ ッ チする第 3 の ラ ッ チ手段 と 、 第 2 の F G信 号の反転信 号の レベルを第 1 の F G信号の立 ち 下が り で ラ ッ チす る第 4 の ラ ッ チ手段 と 、 第 1 , 第 2 , 第 3 お よ び第 4 の ラ ッ チ 手段出力 に基づいて キ ヤブス タ ン モ ー タ の逆転検出 を示す 信号を出力 する第 1 のゲー ト と 、 第 1 のゲ一 卜 出力 に応答 し てプ レ ーキパルス が終了する よ う に プ レ ー キパルスの一 定のパルス幅を補正 す る第 2 のゲー 卜 と 、 第 1 お よ び第 2 のゲー 卜 出力 に 応答 し て モ ー タ 駆動信号が終了する よ う に モー タ 駆動信号を補正 する第 3 のゲー 卜 と を備え る こ と を 特徴 と して いる 。
こ の よ う なプ レー キパルス作成回路 の好ま し い実施態様 で は 、 キ ヤ プス タ ン モ ー タ はヘ ッ ド ¾換信号 に基づ く ス タ 一 卜 パルス に よ っ て起動さ れ 、 ブ レ ー キパルスの発生手段 は テ ー プ走行時に 再生 さ れた コ ン ト ロ ール信号 に応答 し てブ レ ー キパルスを発生する 。
こ の よ う なプ レ ー キパルス作成回路の さ ら に好 ま し い実 施態様で は、 第 1 , 第 2 , 第 3 お よ び第 4 の ラ ッ チ手段 は D型 フ リ ッ プ フ ロ ッ プで実現 さ れる 。
こ の よ う なプ レ ー キパルス作成回路 のさ ら に好ま し い実 施態様で は 、 プ レ ー キパルスの発生期間以外 は第 3 のゲ— 卜 を不能化する手段を さ ら に含んで い る 。
こ の よ う なブ レ ー キパルス作成回-路の さ ら に好ま し い実 施態様で は 、 補正 さ れたブ レー キパルス の終了後、 所定 時 闥 だけ キ ヤ プス タ ン モ ー タ を正方向 に |g動 す る手段 を含ん でいる 。
こ の よ う に 、 こ の発明 に よ れば、 第 1 お よ び第 2 の F G 信号の各 エ ッ ジ に おい て キ ヤ プス タ ン モ ー タ の回転方向 を 検出 して いる ので 、 キ ヤ プス タ ン モ ー タ の実際の逆転か ら 逆転検出 ま での時間 的ず れがホさ い補 正 さ れたパルス幅を 有するブ レ ーキパルス を用 いて キ ヤ プス タ ンモー タ を逆転 制 動 す る こ と ができ 、 ス チル再生状態に お い て テ ー プを適 正 な位置に停止させ る こ と がで き る 。
ま た 、 こ の発明 に よ れば、 キ ヤ プス タ ン モ ー タ の起動 時 に おける F G信号の ノ イ ズの た め に モ ー タ 駆動信号が誤 つ て終了 す る よ う な こ と がな く 、 し た が っ て テ ー プの起動 に 失胶す る よ う な こ と はない 。
ま た 、 こ の発明 に よ れば、 ブ レ ー キパルス終了後 に テ 一 プを少 し 正方向 に送る こ と に よ り 、 キ ヤ ブス タ ン モ ー タ の 逆転に よ るテ ープ停止位置のズ レを補僂する こ と ができる 。
図 面の簡単な説明 '
第 1 図 は 、 従来の圜欠駆動回路 に 用 い ら れる 、 キ ヤ プス タ ン モ ー タ の逆転検出の た め の回路を示す概略プ ロ ッ ク 図 である 。
第 2 図 は 、 第 1 図 に'示 し た 回路の動作を説明 る た めの 波形図 であ る 。
第 3 図 は 、 こ の発明 の一実施例で あ るブ レ ーキパルス作 成回 路の回路図であ る 。
第 4 図 は 、 第 3 図 に示 し た 間欠駆動 回路の 内部構成を示 す回路図である 。
第 5 図 は 、 第 3 図 お よび第 4 図 に 示 し た 回路 の動作を説 明 す る た めの波形図であ る 。
第 6 図 は、 キ ヤ ブス タ ンモ ー タ の正転時お よび逆転時に おける信号 F G 1 と F G 2 と の関係を示す波形図 で あ る 。
発明を実施す るた めの最良の形態
第 3 図 は 、 こ の発明 の一実施例 で あ る ブ レ ー キパルス作 成回路を示す 回路図である 。
ま ず 、 第 3図を参照 して こ の発明 の一実施例で あ るプ レ ー キパルス作成回路の構成 に つ い て 説明 す る 。
第 3図 に おい て 、 間欠駆動回路 1 0は I C ( ΒΆ 8 7 5 ) に よ っ て構成さ れて お り 、 端 子 4 4を介 し て与え ら れ た へ ッ ド切換 ( R F S W ) 信号 a お よび端子 4 5を介 し て 与え ら れた 再生 コ ン ト ロ ール信 号 d に 基づい て 、 端子 4 8 を介 し て ス タ ー 卜 パルス c を出力 し 、 端子 4 7を介 し てプ レー キパルス f を出力 し 、 そ し て 端子 4 6を介 し て モ ー タ 駆動 信号 g を出力 す る 。 さ ら に 、 ブ レ ー キパルス f は端子 3 6 を介 し て 、 そ し て モ ー タ 駆動信号 g は端子 3 5を介 し て キ ャプス タ ンモ ー タ 制御信号補正回路 1. 1 に入力 さ れる こ の キ ヤ プス タ ン モ ー タ 制御信号補正回路 1 1 は 、 C M O S ゲー ト ア レイ で構成さ れた 回路であ' ¾ 、 キ ヤプス タ ンモ 一 タ か ら 得 ら れた F G信号 に よ っ て キ ヤ プス タ ン モ ー タ の回 転方向を判別 し 、 捕正さ れたプ レ ー キパルス j と補正 さ れ た モ ー タ 駆動信号 k と を 出力 す る ものであ る 。 すなわ ち 、 端子 3 7を介 し て信号 F G 1 がキ ヤ ブス タ ンモ ー タ 制御信 号補 正回路 1 1 に入力 さ れ、 さ ら に端子 3 8 を介 し て信号 F G 2がキ ヤ ブス タ ンモー タ 制御信号補正 回路 1 1 に 入力 さ れる 。 第 1 の D型 フ リ ッ プ フ ロ ッ プ 2 1 は 、 信号 F G 2 の立ち上がり で信号 F G 1 の レベルを ラ ッ チ し 、 そ の反転 ' レベルを出力 する 。 第 2の D型 フ リ ッ プ フ ロ ッ プ 2 2 は 、 信号 F G 1 の立 ち 上が り で信号 F G 2の レベルを ラ ッ チ し て 出力 する 。 第 3 の D型 フ リ ッ プフ ロ ッ プ 2 3 は 、 信号 F G 2の 立ち 下が り で 、 イ ンバ ー タ 1 2 を介す る信号 F G 1 の反転 レベルを ラ ッ チ し 、 さ ら にそ の反転 レベルを出力 す る 。 第 4 の D型 フ リ ッ プ フ ロ ッ プ 2 4 は 、 信号 F G 1 の な ち下が り で 、 イ ンパ ー タ 1 3 を介す る信号 F G 2 の反転 レ ベルを ラ ッ チ し て 出力 する 。 D型 フ リ ッ プフ ロ ッ プ 2 1 , 2 3 は 、 イ ンパ ー タ 1 4 の 出力 の立ち 上が り でセ ッ 卜 さ れ 、 D型 フ リ ツ アフ ロ ッ プ 2 2 , 2 4 は 、 イ ンパ ー タ 1 4の 出 力 の立ち上が り で リ セ ッ 卜 さ れる 。 D型フ リ ッ プフ ロ ッ プ 2 1 , 2 2 , 2 3 お よび 2 4の各出力 と 、 イ ンパ ー タ 1 4 の出力 と が 5入力 の N O Rゲー ト 2 5 に 与え ら れる 。 さ ら に 、 N O Rゲー 卜 2 5の 出力 h と 、 イ ンパ ー タ 1 5の出力 とが A N Dゲー ト 2 7 に 入力 さ れ、 A N Dゲー ト 2 7 の 出 力 は 、 イ ンバ ー タ 1 9 に よ っ て 反転さ れた後出力端子 3 0 を介 し て 、 補正 さ れたプ レ ー キパルス j ( 負論理 ) と し て 出力 さ れ、 キ ヤ プス タ ン モ ー タ 駆動 回路 ( 図示せ ず ) の 正 逆方向指示端子 ( F Z百) に 印加 さ れる 。 ま た 、 A N Dゲ 一 卜 2 7 の出力 は イ ンパ ー タ 1 6 を介 し て モ ノ マルチ 2 9 の C端子 に与え ら れる 。 そ し て モ ー タ 駆動信号 g と イ ンパ — タ 1 5 の出力 と を入力 と す る E X - O Rゲー ト 2 8の 出 力 i と 、 モ ノ マルチ 2 9の出力 と 、 N O Rゲー ト 2 5 の 出 力 h と が 3入力 の O Rゲー 卜 2 6 に 与 え ら れる 。 O Rゲ ー 卜 2 6の出力 は イ ンパー タ 1 8 に よ っ て反転さ れた後出力 端子 3 1 を介 し て補正 さ れ た モ ー タ 駆動信号 と し て 出力 さ れ、 さ ら に イ ンパ ー タ 1 8の出力 は 、 オープ ン ド レイ ン タ イ ブの イ ンパー タ 2 0を介 し て反転さ れた 後端子 3 2 を介 し て補正さ れたモ ー タ 駆動信号! < と し て出力 さ れる 。 ま た 、 端子 3 3 に は 、 場合 に よ っ て モ ノ マルチ 2 9 の た めの時定 数回路 ( 容量 C 1 お よび抵抗 R 2 ) を接続す る こ と がで き る 。 ま た 、 モ ノ マル チ 2 9 の出力 は イ ンパ ー タ 1 7 を介 し て反転さ れた後 、 端子 3 4を介 し て 正方向送 り パルス £ と し て 出力 さ れる 。
さ ら に 、 速度制御 回路 4 2 は、 端子 4 3を介 し て入力 さ れる信号 F G 1 に 基づい て 、 ス タ ー 卜パルス c と プ レ ー キ パルス f と の間の期 圊 中 、 キ ヤ ブス タ ンモー タ の速度制御 を行な う も の であ る 。 そ し て 、 ス タ ー 卜 パルス c と 、 イ ン パ ー タ 4 1 で反転さ れた補正 さ た ブ レ ー キパルス j と 、 速度制御回路 4 2の出力 と が、 そ れぞれダイ オ ー ド D , , D 2 , D 3 を介 し て 、 サー ポ電圧 と し て端子 4 0を介 し て キ ヤ ブス タ ン モ ー タ 駆動 回路 ( 図示せ す ) に 印加 さ れる 。 ま た 、 第 1 の ト ラ ン ジス タ Q 1 は 、 上述のサ ーポ電圧の供 給を キ ヤ ブス タ ン モ ー タ S動回路 か ら 切齄 す fcめの ス イ ツ チング手段であ り 、 システ ムコ ン ト ロ ール回路 ( 図示せず ) か ら 印加 さ れる M c O N信号 に よ っ て制御 さ れて い る 。 第
2の ト ラ ンジス タ Q 2 は 、 上述の制御信号 M c 0 N の ト ラ ン ジス タ Q 1 へ の印加を切る ため の ス イ ッ チング手段 で あ り 、 補正さ れた モ ー タ 駆動信号 k に よ っ て制御さ れて いる ま た 、 イ ンパー タ 2 0は オ ー プン ド レ イ ン タ イ プの た め 、 端子 3 2 の出力 k は抵抗 R 1 を介 て 間欠駆動回路 1 0の 端子 4 6 に 接続さ れ 、 等価的に プル ア ッ プ さ れ て いる 。
次に 、 第 4図 は 、 第 3 図 に 示 し た 間欠駆動 回路 1 0の構 成を示 す 内部 ア ロ ッ ク 図 であ り 、 第 5 図 お よ び第 6図 は 、 第 3 図 に 示 し た 回路 の動作を説明 す る た め の波形図で あ る 。
次 に 、 第 3 図 な い し 第 6図 を参照 し て 、 こ の発明の一実 施例 の動作 に つ い て説明する 。
ま ず 、 第 4 図 お よ び第 5 図 を参照 す る と 、 端子 4 4 に 印 加さ れた ヘ ッ ド切換信号 a の立ち下が り で 、 間欠駆動 回路 1 0内の ス タ ー 卜 位相 モ ノ マルチ が 卜 リ ガ さ れ、 ス タ 一 卜 位相 モ ノ マルチ 5 の出力 b の立ち 下が り でス タ ー 卜 パルス モ ノ ルチ 5 2が 卜 リ ガ さ れて端 子 4 8 に お い て.ス タ ー 卜 パルス c が発生 する と と も に端子 4 6か ら H レペル の モ ー タ 駆動信号 g が出力 さ れる 。
こ こで 、 第 6 A図 は 、 キ ヤ ブス タ ンモ ー タ の正転時 に お け る信号 F G 1 , F G 2の関係を示 し て お り 、 第 6 B図 は 、 キ ヤ プス タ ン モ ー タ の逆転時に お け る信号 F G 1 , F G 2 の関係を示 し て い る 。 そ し て キ ヤ ブス タ ン モ ー タ の正 転時 に は 、 第 6 A図か ら 明 ら かな よ う に 、 D型フ リ ッ プフ ロ ッ プ 2 1 , 2 2 , 2 3 お よ び 2 4の出力 は すべ て し レ ベルに な り 、 キ ヤ プス タ ンモ ー タ の逆転時 に は第 6 B図か ら 明 ら かな よ う に D型 フ リ ッ プ フ ロ ッ プ 2 1 , 2 2 , 2 3 お よ び 2 4 の 出力 はすべ て H レベルに な る 。 こ れは 、 D型 フ リ ツ プ フ ロ ッ プ 2 1 , 2 3 が Q出力 を利用 し て お り 、 D型 フ リ ッ プフ 口 ッ プ 2 2 , 2 4が Q出力 を利用 し て いるか ら で あ る 。 ま た、 D型フ リ ッ プフ ロ ッ プ 2 Ί , 2 3 は 、 イ ンパ ー タ 1 4の出力 の立ち上が り でセ ッ ト さ れ、 D型 フ リ ッ プフ ロ ッ プ 2 2 , 2 4 は周 じ く イ ンパ ー タ 1 4の 出力 の立ち 上 が りで リ セ ッ ト さ れる ので 、 モ ー タ 駆動信号 g の終了 時に おい て は、 D型 フ リ ッ プ フ ロ ッ プ 2 1 , 2 2 , 2 3お よ び 2 4の 出力 はすべて正転時 と周 じ L レ ベル と な っ て い る 。 こ の と き、 前述の よ う に 間欠駆動 回路 1 0の端子 4 6 に お けるモ ー タ 駆動信号 g が H レベル と な る と イ ンパ ー タ 1 4 の出力 は し レ ベル と な り 、 D型フ リ ッ プフ ロ ッ プ 2 1 , 2 2 , 2 3 および 2 4 の出力 はすべて L レベルなので N O R ゲー ト 2 5 の出力 は H レ ベル と な る 。 --方、 第 5 図 に 示 す ' よ う にブ レ ーキパ 'ス f は H レベルな ので E X — 0 Rゲー 卜 2 8 の出力 は、 モー タ 駆動信号 g の 立ち 上が り と周 時 に H レベルに立ち上が つ て いる 。 し た が っ て 、 O Rゲー 卜 2 6の出力 は、 モー タ駆動信号 g の 立ち 上が り と周時 に H レ ベル とな り 、 こ れに よ つ て第 2の 卜 ラ ンジス タ Q 2が オ ン 状態 と なる 。 こ の た め 、 ス チル、 ス ロ ー 再生 時に H レ ベル である M c O N信号 は第 1 の ト ラ ン ジ ス タ Q 1 の ベ ー ス電 極に 印加 さ れず 、 第 1 の ト ラ ン ジス タ Q 1 は オ フ状態 と な るた め 、 間欠駆動回路 1 0の端子 4 8 から ス タ ー 卜 パルス c が キ ヤ ブス タ ン モー タ |g動回路 ( 図示せず ) に供給 さ れ キ ヤプス タ ンモ ー タ が正方向 に 回転を始め る 。
こ の よ う に キ ヤ ブス タ ン モ ー タ が正方向 に 起動 さ れ た後 も 、 前述の よ う に D型 フ リ ッ プ フ ロ ッ プ 2 1 , 2 2 , 2 3 お よ び 2 4の判別出力 は す べ て L レベルの ま ま で あ る 。
次に 、 再生 コ ン ト ロ ール信号 d がテ ープ走行に伴な い再 生 さ れる と 、 間欠駆動 回路 1 0内部の ト ラ ッ キ ング モ ノ マ ルチ 5 2 a が 卜 リ ガさ れ、 さ ら に 卜 ラ ッ キ ングモ ノ マルチ 5 2 a の出力 e の立ち 下が り でブ レ ー キパルス モ ノ マル チ 5 3が 卜 リ ガさ れ、 I C 1 0の 2 8番 ピ ンす なわち端子 4 7か ら 第 5図 に 示す よ う な負 論理の ブ レ ー キパルス f が出 力さ れる 。 そ し て 圜欠駆動回路 1 0か ら 与え ら れる モー タ 駆動信号 g は 、 ブ レ ー キパルス f の終了 と 同 時に 立 ち 下が る 。 こ れら 圜欠駆動 回路 1 0か ら供給さ れるブ レ ー キパル ス f お よ びモ ー タ 駆動信号 g の終了時点は 、 I C 1 0の外 付時定数を適当 に 選択す る こ と に よ っ て 長め に 設定さ れて い る 。
_ こ の よ う なブ レ ー キパルス f が、 キ ヤ ブス タ ン モ ー タ 制 御信号補正 回路 1 1 の端子 3 6に 印加 さ れる と 、 E X—〇 Rゲー ト 2 8の 出力 i が L レベル と な るので 、 O Rゲ一 卜 2 6の出力 は N O Rゲー ト 2 5の出力変化 に従 っ て変化 す る こ と に なる 。 な お 、 この とき モ ノ マルチ 2 9 に は 時定数 回路が接続さ れ て いない の で こ れを無視 す る こ と が できる 。 そ し て 、 N O Rゲー 卜 2 5の出力 は H レ ベルなので A N D ゲ ー 卜 2 7 は開い て お り 、 端子 3 0か ら の出力 j は ア レ ー キパルス f と周 時 に L レ ベルに 立ち 下が る 。 し た が っ て 、 キ ヤ プス タ ン モ ー タ 駆動回路の 正逆方向 指示端子 を 介 し て キ ヤ プス タ ンモ ー タ に逆転ブ レ ー キが付与さ れ、 テ ー プ走行速度が低下 し て い く 。
キ ヤ ブス タ ンモ ー タの回転速度が低下 し て 遂に逆回転状 態 と な る と 、 D型 フ リ ッ プ フ ロ ッ プ 2 1 , 2 2 , 2 3 , 2 4の う ち の少な く と も 1 つ の出力 が H レベル と な り 、 N O R.ゲー 卜 2 5 の出力 は し レ ベル と な つ て キ ヤ プス タ ン モー タ の逆回転が検出さ れる 。 こ の結果 、 A N Dゲー ト 2 7 が 閉 じ る の で 、 端子 3 0か ら の補正 プ レ ー キパルス J が終了 せ し め ら れ、 周時に端子 3 2か ら の補正モー タ 駆動信号 k も終了 せ し め ら れる 。
すなわ ち 、 前述の よ う に 間欠駆動 回路 1 0か ら供給さ れ るプ レ ー キパルス f お よ びモ ー タ驅動信号 g の .終了時点は 長め に 設定さ れて いるが 、 D型 フ リ ッ プフ ロ ッ プ 2 1 , 2 2 , 2 3 お よ び 2 4 に よ り キ ヤ ブス タ ン モ ー タ の逆回転が 検出 さ れる とそ の 時点で補正プ レ ー キパルス j が終了す る の で テ ー プが正 し い位置で停止 し 良好な ス チル再生 を実現 する こ と が可能 と なる 。
さ ら に 、 少な く と もプ レ ーキパルス印加期間 に L レベル と な る E X — O Rゲー ト 2 8の出力 i が O Rゲー 卜 2 6 に 印加さ れて いるが 、 こ れは 、 キ ヤ プス タ ンモー タ 起動時に F G信号に 混入 し た ノ イズの た め に D型 フ リ ッ プ フ ロ ッ プ 2 1 , 2 2 , 2 3 お よび 2 4の 回転方向の誤判別が生 じ て 補 正 モ ー タ |g動信号 k か'誤 っ て L レベル と なる こ と を防止 しテ ープの起動を確実に する た めで あ る 。 さ ら に 、 使用 さ れる キ ヤ ブス タ ン モー タ 、 テ ープ走行系 に よ っ て は 、 補正 ブ レ ー キパルス j の終了 で 直ち に テ ー プ 走行が停止 し ないで逆転状態が暫 く 続 く よ う な場合も あ る 。 こ の よ う な場 ^の た め に 、 モ ノ マル チ 2 9 が 設け ら れ て お り 、 端子 3 3 に 第 3 図 の破線で示 し た コ ンデンサ C 1 を接 続 し て 時定数回路 を形成す る と 、 A N D ゲ 一 卜 2 7 の出力 で 卜 リ ガさ れた モ ノ マルチ 2 9 は所定 時間 にわ た っ て H レ ベルの 出力 を与える 。 そ し て 、 第 5 図の破線 で示 す よ う に 、 モ ノ マルチ 2 9 の 出力 を イ ンパ ー タ 1 7 に よ っ て反転 し た 正方向送 り パルス £ を イ ンパ ー タ 6 0 に よ り さ ら に反転 し てサーポ電圧 に加え る と 、 補正ブ レ ー キパルス j の終了後 に .テ ー プが少 し 正方.向 に 送 ら れる こ と に な る 。 こ の期 閭補 正 モ ー タ 駆動信号 k も破線で示 し た 期 間 に わ た っ て 延長さ る 。
な お 、 端子 3 1 は オ ープン ド レ イ ン に よ る 出力端子 3 2 の ド ラ イ ア能力 が不足 す る と き に外付で ト ラ ン ジ ス タ を接 続 し て 利用 す る こ と ができる 。
産業上の利用 可能性
こ の発明 は 、 テ ープを 間欠的 に 駆動 して ス チル再生 と通 常再生 と を所定の間隔で緩返 す こ と に よ っ て 間欠ス ロ ー 再 生 を行な う ビデオ テ ープ レ コ ー ダに 広 く 適用 する こ と がで ぎ る 。

Claims

請求の範囲
1 . 所定 の時間閭隔でテ ー プを間欠的 に 駆動 する ビデオ テ一プ レ コ ー ダ に お いて テ ー プ走行中 に キ ャ プス タ ンモ ー タ を逆転制動 する た め に 捕正 さ れたパルス幅を有す る プ レ 一キパルスを作成 し て 前記キ ヤ プス タ ンモ一タ に印加す る プ レ一キパルス作成回路であ っ て 、
記キ ヤプス タ ン モ ー タ を駆動 す る た め の モ ー タ 駆動信 号 を m 記キ ャ プス タ ン モ ー タ に供給 す る た め の 手段 ( 1 0 ) と .、
SU記キ ヤ プス タ ンモー ヌ の逆転制動 時に一定のパルス幅 を有 す るプ レ ー キパルス を発生 し て 前記 キ ャ プス タ ン ΐ一 タ に 印加する手段 ( 1 0 ) と 、
刖 記キ ヤ プス タ ン モ ー タ の回転 に 関連 し て 、 Sい に位相 の異 なる第 お よび第 2 の F G信号を発生する手段 と 、
前記第 1 の F G信号の レ ベルを m 記第 2 -の F G信号の立 ち上が り でラ ッ チす る第 Ί の ラ ッ チ手段 ( 2 Ί ) と 、
記第 2 の F G信号の レベルを 8U 第 1 の F G信号の ώ ち上が り でラ ッ チする第 2 のラ ッ チ手段 ( 2 2 ) と 、
記第 1 の F G信号の反転信号の レ ベル を前記第 2 の F G信号の立ち下が り でラ ッ チする第 3 の ラ ツ チ手段 ( 2 3 ) 前記第 2 の F G信号の反転信号の レ ベルを前記第 Ί の F G信号の ώち 下が り で ラ ッ チする第 4 の ラ ッ チ手段 ( 2 4 ) と 、 前記第 1 , 第 2 , 第 3お よ び第 4の ラ ッ チ手段出力 に 基 づい て 前記 キ ヤ ブス タ ン モ ー タ の逆転検出 を示す信号を 出 力 する第 1 のゲー ト ( 2 5 ) と 、
前記第 1 のゲー 卜 出力 に 応答 し て 前記ブ レ ー キパルス が 終了 す る よ う に前記ア レ ー キパルス の一定 のパルス辐を補 正 す る第 2のゲー 卜 〈 2 7 ) と 、
前記第 1 のゲー 卜 出力 に応答 し て 前記 モ ー タ 駆動 信号が 終了 す る よ う に 前記モ ー タ 駔動信号を補正 す る第 3のゲー 卜 ( 2 6 ) と を備えた 、 ブ レ ー キパ ルス作成回路 。
2. 請求の範囲第 1 項に 記戟の ァ レ ー キパルス作成回路 であ っ て 、
前記キ ヤ ブス タ ン モ ー タ は 、 ヘ ッ ド切換信号 に 基づ く ス ' タ ー 卜 パルス に よ っ て起動 さ れる 。
3 . 請求の範囲第 1 項 に 記載のブ レ ー キパルス作成回路 であ っ て 、
前記プ レ ー キパルス の発生手段 ( 1 0 ) は 、 テ ー プ走行 時に 再生 さ れ た コ ン ト ロ ー ル信 号 に応答 し て 前記ブ レ ー キ パルス を発生 す る 。
4 . 請求の範囲第 1 項 に 記載のブ レ ー キパルス作成回路 であ っ て 、
前記第 1 , 第 2 , 第 3お よ び第 4の ラ ッ チ手段 は 、 D型 フ リ ッ プ フ ロ ッ プで あ る 。
5 . 請求の範囲第 1 項に記載のブ レ ー キパルス作成回路 で あ っ て 、 前記ブ レ ー キパルス の発生期 間以外 は前記第 3 の ゲー 卜 を不能化す る手段 ( 2 8 ) を さ ら に 含む 。
6 . 請求の範囲第 1 項に記載のブ レ ー キパルス作成回路 であ っ て 、
前記補正さ れたプ レ ー キパルス の終了後 、 所定の 時間 だ け 訪記キ プス タ ン モ ー タ を 正方向 に駆動 する手段 ( 2 9 ) を含む。
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