TW521493B - Reference voltage circuit - Google Patents
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Description
521493 A7 B7
五、發明説明(D 發明領域: (請先閱讀背面之注意事項再填寫本頁) 本發明係有關於半導體積體電路的參考電壓電路。 習用技術說明= 圖3顯示的電路係爲傳統的參考電壓電路,也就是,該 電路包括一 η通道空乏型MOS電晶體的恆電流電路170,其 源極和閘極接地;Ρ通道增強型MOS電晶體150和151所形 成之電流鏡電路,用以從電晶體170所輸入之電流產生及輸 出鏡射電流;以及η通道增強型MOS電晶體160,其閘極和 汲極互連,用以自電流鏡電路的輸出電流產生參考電壓 Vref 〇 在電晶體150和151是相同大小之情況裡,電晶體170的 汲極電流ID(170)相同於電晶體160的汲極電流ID(160),而 且電晶體160的閘極至源極電壓VGS(160)變成參考電壓Vref 〇 經濟部智慧財產局員工消費合作社印製 爲使參考電壓Vref變成預定的電壓,所有的電晶體必 須在飽和狀態操作。當工作於飽和狀態裡的電晶體Π0的最 小汲極-源極電壓爲VDSAT( 170),以及電晶體150的汲極·源 極電壓爲VDS(150),最小的電源電壓Vdd(min),參考電壓 Vref變成由下列各項方程式所獲得的預定電壓:
Vdd(min) = VDS AT( 170) + VDS( 1 50) ⑴ 當電晶體170的臨限値爲Vt( 170),操作於飽和狀態之空 本紙張尺度適用中國國家標準(CNS ) A4規格(210X297公釐) -4 - 經濟部智慧財產局員工消費合作社印製 521493 A7 B7_ _ 五、發明説明(% 乏型MOS電晶體的最小汲極-源極電壓VDSAT(170)由下列 各項方程式獲得: VDSAT(170) = Vt(170) (2) 正常而言,Vt(170)約是-0.4V,而VDS(150)大約是1.0V ,由式(1),由下式獲得:
Vdd(min) = -0.4V+ 1.0V = 1.4V (3) 在圖3顯示的傳統參考電壓電路中,在低的電源源電壓 的情況中會有問題,電路運作變成不穩定,而且預定的參 考電壓Vref不能被產生。 如果在低電源嘗試獲得預定的參考電壓Vref,必需增 力口 η通道空乏型MOS電晶體的臨限値(使絕對數値接近零 ),或者增加Ρ通道增強型MOS電晶體的臨限値(使絕對 數値接近零),然而,如果如此做,運作變成不可能在高 溫或低溫運作。 發明槪沭: 就以上描述而產生本發明,而且本發明之目的乃藉由 變更電路結構使能夠運作於低電源。 爲了解決問題’依照本發明設計出一種電路結構,使 得甚至在比習知技藝更低的電源下獲得預定的參考電壓 本紙張尺度適用中國國家標準(CNS ) Α4規格(210Χ297公釐) " -5- (請先閲讀背面之注意事項再填寫本頁)
521493 A7 B7 五、發明説明(含
Vref 〇 藉由採用本發明之結構,可以於半導體積體電路中提 供高準確度參考電壓產生器,其能穩定地運作於低電源供 應電壓。 本發明提供一種電路結樽,其中甚至在比習知技藝更 低的電源供應電壓下獲得預定的參考電壓Vref。 圖式之簡單說明= 圖1顯示根據本發明 之電路圖; 圖2顯示根據本發明 之電路圖;以及 圖3顯示傳統參考電壓電路之電路圖 第一具體實施例之參考電壓電路 具體實施例之參考電壓電路 經濟部智慧財產局員工消費合作社印製 元件主要符號說明: 100 、 101 、 102 、 103 、 104 110 、 111 、 160 120 、 121 、 170 150 、 151 200 201 P通道增強型MOS電晶體 η通道增強型MOS電晶體 η通道空乏型MOS電晶體 Ρ通道增強型MOS電晶體 参考電壓電路 啓動電路 較佳賓施例說明: 在下列描述中’本發明的具體實施例將參考圖式而描 (請先閲讀背面之注意事項再填寫本頁)
本紙張尺度適用中國國家標準(CNS ) Α4規格(210Χ297公釐) -6- 521493 A7 B7 五、發明説明(4 述。 圖1顯示根據本發明之第一具體實施例之參考電壓電路 之電路圖。此電路包含一 η通道空乏型(depletion type)金氧 半導體(MOS)電晶體120之恆電流電路,其源極與閘極接地 ;一 η通道增強型(enhancement type)金氧半導體電晶體110 之源極接地放大電路,用以輸出一參考電壓Vref ; — η通 道增強型金氧半導體電晶體111,其閘極連接該參考電壓 Vref ;以及一電流鏡電路,具有ρ通道增強型金氧半導體電 晶體100、101、102,用以自電晶體111所輸入之電流產生及 輸出一鏡射電流(mirrored current)。 電晶體100之汲極電流ID(100)相等於恆電流電晶體120 之汲極電流ID( 120)。於電晶體1〇〇與電晶體1〇2之大小相同 之例子裏,由於電晶體100與電晶體102形成電流鏡電路, 電晶體100之汲極電流ID(IOO)變成相等於電晶體1〇2之汲極 電流ID(102);進一步,由於電晶體111之汲極電流ID(111) 相等於電晶體102之汲極電流ID( 102),最後,汲極電流 ID(120)相等於汲極電流ID(111)。於是,類似於圖3之習知 電路,電晶體111之閘極-源極電壓VGS(lll)成爲參考電壓 Vref 〇 爲使參考電壓Vref成爲一預定電壓,所有電晶體運作 於飽和區。當電晶體1 20運作於飽和區之最小汲極-源極電壓 爲VDSAT(12〇)且電晶體110之臨限電壓爲vt(110)時,爲使 電晶體1 20運作於飽和區,以下關係需要滿足: VDSAT(120) < Vt(110) ⑷ 本紙張尺度適用中國國家標準(CNS ) A4規格(210 X 297公釐) (請先閲讀背面之注意事項再填寫本頁) C· 訂 經濟部智慧財產局員工消費合作社印製 521493 A7 B7 五、發明説明(3 當電晶體120之臨限電壓爲Vt(120)時,通道空乏型金氧 半導體電晶體1 20運作於飽和區之最小汲極-源極電壓爲 VDSAT(120)係由以下方程式獲得: VDSAT(120) < Vt(120) (5) 因此,由方程式(4)、(5),爲使電晶體120運作於飽和 區,以下關係需要滿足:
Vt(120) < Vt(110) (6) 正常來說,Vt(120)約爲-0.4V,Vt(110)約爲 0.6V。 當電晶體100運作於飽和區之最小汲極-源極電壓爲 VDSAT(IOO)且電晶體110之閘極-源極電壓爲VGS(llO)時, 使參考電壓Vref成爲預定電壓之一最小電源電壓Vdd(min) ,係由以下方程式獲得:
Vdd(min) = VDSAT(IOO) + VGS(llO) (7) 正常來說,由於方程式 VDSAT(100) = 0.2V,且 VGS(110) = Vt(110) + 0.4V = 0.6V + 0.4V=1.0V 係被建立,由方程 式(7),Vdd(min)係由以下方程式獲得:
Vdd(min) = 0.2V + 1.0V = 1.2V 本紙張尺度適用中國國家標準(CNS ) A4規格(210X297公釐) (請先閲讀背面之注意事項再填寫本頁) C· 訂 經濟部智慧財產局員工消費合作社印製 -8- 521493 A7 B7 五、發明説明(合 而且,應注意到此電路操作於較習知電路更低之電源 供應電壓。 在圖1之第一較佳具體實施例中,。爲了避免此缺陷, 於一第二較佳具體實施例之參考電壓電路之中,加入一個 如圖2所示之啓動電路(starting circuit)。 圖2所示之電路11包含於圖1所解釋之參考電壓電路200 以及啓動電路201。啓動電路201包含η通道空乏型金氧半 導體電晶體121之恆電流源電路,其源極與閘極接地,以及 Ρ通道增強型金氧半導體電晶體103、104 ;而電晶體103、 102形成電流鏡電路。 由於在電源供應開始之後,電晶體101馬上處於停止 (OFF)狀態,電晶體102之汲極電流ID(102)爲0。由於電晶體 103、102形成電流鏡電路,電晶體103之汲極電流ID(103)亦 爲0。 另一方面,由於電晶體1 2 1係爲恆電流源電路,電晶體 104之閘極電壓變成0。因此,電晶體104變成導通以增加電 晶體111之閘極電壓,而電晶體111變成導通,參考電壓電 路200開始運作,並輸出參考電壓Vref。 於電晶體1 02、1 03爲相同大小之情形中,因爲藉由電 晶體102、103之電流鏡電路,電晶體111之汲極電流變成相 同於電晶體103之汲極電流,當電晶體111充分導通時,電 晶體103之汲極電流亦增加。當電晶體103之汲極電流超過 恆電流源電路之電晶體121之汲極電流時,電晶體104之閘 極電壓變成相同於電源供應電壓Vdd,電晶體104被關閉, 本紙張尺度適用中國國家標準(CNS ) A4規格(210X297公釐) " -9 - (請先閲讀背面之注意事項再填寫本頁)
訂 經濟部智慧財產局員工消費合作社印製 521493 A7 B7 五、發明説明(7) 以及將啓動電路201切離參考電壓電路200。 如上所述,即使於電源供應電壓非常緩慢增加之情形 中,確保可獲得參考電壓Vref。 本發明之參考電壓電路可產生高精確度參考電壓,其 甚至在半導體積體電路中於低電源供應電壓下穩定地運作 (請先閱讀背面之注意事項再填寫本頁) 裝· 訂 經濟部智慧財產局員工消費合作社印製 本紙張尺度適用中國國家標準(CNS ) A4規格(210 X 297公釐) -10-
Claims (1)
- 521493 A8 B8 C8 D8六、申請專利範圍, 1. 一種參考電壓電路,包括: 一第~導電型之第一空乏型金氧半導體電晶體之一第 一恒電流源’該空乏型金氧半導體電晶體之源極與閘極接 地; ~第一導電型之第一增強型金氧半導體電晶體之一源 極接地放大電路,其與該第一金氧半導體電晶體相連接; 一第一導電型之第二增強型金氧半導體電晶體,源極 接地放大電路之一輸出連接至其一閘極;以及 一第二導電型之第三增強型金氧半導體電晶體,用以 自該第二金氧半導體電晶體所輸入之一電流產生以及輸出 一鏡射電流。 2. 如申請專利範圍第i項之參考電壓電路,更包括·· 一第一導電型之第二空乏型金氧半導體電晶體之一第 二恆電流源,其源極與閘極連接至該參考電壓電路;以及 一第二導電型之增強型金氧半導體電晶體,連接至該 第二空乏型金氧半導體電晶體, 其中,該第二導電型之增強型金氧半導體電晶體以及 該第三增強型金氧半導體電晶體形成一電流電路。 (請先閲讀背面之注意事項再填寫本頁) 訂 經濟部智慧財產局員工消費合作社印製 本紙張尺度適用中國國家梯準(CNS ) A4規格(210X297公釐) -11 -
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