KR970017963A - 반도체 장치 및 그 제조방법 - Google Patents
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Abstract
본 발명의 MISFET를 갖는 반도체 장치는, 표면상에 반도체 영역을 갖는 실리콘 기판(2)과; 상기 반도체영역 내에서 분리되어 형성되는 소스 영역(10a) 및 드레인 영역(10b); 상기 반도체 영역 내에서 그리고 상기 소스 영역과 상기 드레인 영역 사이에서 형성되는 채널 영역; 상기 채널 영역 상에 형성되는 게이트 전극(6) 및; 상기 소스 영역 내에서 겹치지고 또한 그 내부의 에너지 갭을 상기 채널 영역에서의 에너지 갭 이상으로 증가시키기에 충분한 탄소농도를 갖는 Si1-xCx로 형성된 영역(8a)을 포함한다. 상기 Si1-xCx로 형성된 영역과 상기 채널 영역의 측면상의 상기 반도체 영역의 또 다른 부분 사이에 형성되는 면은 상기 반도체 장치가 미세화되더라도 고속도 동작을 실현하기 위해 상기 소스 영역(10a)과 상기 채널 영역 사이의 접촉면, 또는 이들 영역의 부근에서 존재한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1a도는 본 발명에 따른 반도체 장치의 제1특징의 제1실시예를 도시한 단면도,
제1b도는 제1a도에 도시된 것과 동일한 반도체 장치의 기판 표면 부근에서의 에너지 밴드를 도시한 다이아그램.
Claims (20)
- 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치에 있어서, 상기 장치는 표면 상에 반도체영역을 갖는 실리콘 기판과; 상기 반도체 영역 내에서 분리되어 형성되는 소스 영역 및 드레인 영역; 상기 반도체 영역 내에서 그리고 상기 소스 영역과 상기 드레인 영역 사이에서 형성되는 체널 영역; 상기 채널 영역상에 형성되는 게이트 전극 및; 상기 소스 영역 내에서 겹쳐지고 또한 그 내부의 에너지 갭을 상기 채널 영역에서의 에너지 갭 이상으로 증가시키기에 충분한 탄소 농도를 갖는 Si1-xCx로 형성된 영역을 포함하고, 상기 금속절연물 반도체 전계효과 트랜지스터는 상기 Si1-xCx로 형성되는 영역과 상기 채널 영역의 측면상의 상기 반도체영역의 또 다른 부분 사이에 형성되는 헤테로 접합면이 상기 소스 영역과 상기 채널 영역 사이의 접촉면, 또는 이들 영역의 부근에서 존재하는 방식으로 구성되는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제1항에 있어서, 상기 헤테로 접합면은 상기 금속 절연물 반도체 전계효과 트랜지스터의 상기 소스 영역과 상기 채널 영역 사이의 pn 접합면과 일치하거나 또는 상기 채널 영역 내에 존재하는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제1항에 있어서, 상기 헤테로 접합면 내의 캐리어의 에너지 갭은 상기 금속 절연물 반도체 전계효과 트랜지스터가 n형일 때는 상기 반도체 영역을 구성하는 물질의 k-공간 내의 전도대 에너지의 제1최저최소점과 제2최저최소점 사이의 에너지 차의 절대값보다 작지만, 상기 금속 절연물 반도체 전계효과 트랜지스터가 p형일때는 가전자대 에너지의 제1최고최대점과 제2최고최대점 사이의 에너지 차의 절대값보다 작은 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제2항에 있어서, 상기 헤테로 접합면 내의 캐리어의 에너지 갭은 상기 금속 절연물 반도체 전계효과 트랜지스터가 n형일 때는 상기 반도체 영역을 구성하는 물질의 k-공간 내의 전도대 에너지의 제1최저최소점과 제2최저최소점 사이의 에너지 차의 절대값보다 작지만, 상기 금속 절연물 반도체 전계효과 트랜지스터가 p형일 때는 가전자대 에너지의 제1최고최대점과 제2최고최대점 사이의 에너지 차의 절대값보다 작은 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제1항에 있어서, 상기 금속 절연물 반도체 전계효과 트랜지스터는 벌크 구조이고, 내부의 에너지 갭을 상기 채널 영역에서의 에너지 갭 이상으로 증가시키기에 충분한 탄소 농도를 갖는 Si1-xCx로 형성되는 또 다른 영역이 또한 상기 드레인 영역에 겹쳐서 형성되고, 상기 드레인 영역에 겹쳐서 Si1-xCx로 형성되는 또 다른 영역과 상기 반도체 영역의 상기 또 다른 부분 사이의 헤테로 접합면이 상기 드레인 영역 내에 형성되는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 내용 없음.
- 제3항에 있어서, 상기 금속 절연물 반도체 전계효과 트랜지스터는 벌크 구조이고, 내부의 에너지 갭을 상기 채널 영역에서의 에너지 갭 이상으로 증가시키기에 충분한 탄소 농도를 갖는 Si1-xCx로 형성되는 또 다른 영역이 또한 상기 드레인 영역에 겹쳐져서 형성되고, 상기 드레인 영역에서 겹쳐져서 Si1-xCx로 형성되는 또 다른 영역과 상기 반도체 영역의 상기 또 다른 부분 사이의 헤테로 접합면이 상기 드레인 영역 내에 형성되는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제4항에 있어서, 상기 금속 절연물 반도체 전계효과 트랜지스터는 벌크 구조이고, 내부의 에너지 갭을 상기 채널 영역에서의 에너지 갭 이상으로 증가시키기에 충분한 탄소 농도를 갖는 Si1-xCx로 형성되는 또 다른 영역이 또한 상기 드레인 영역에 겹쳐져서 형성되고, 상기 드레인 영역에 겹쳐져서 Si1-xCx로 형성되는 또 다른 영역과 상기 반도체 영역의 상기 또 다른 부분 사이의 헤테로 접합면이 상기 드레인 영역 내에 형성되는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치에 있어서, 상기 장치는 표면상에 p형 반도체 영역 및 n형 반도체 영역을 갖는 실리콘 기판과; 상기 p형 반도체 영역 내에 형성되는 n채널 금속 절연물 반도체 전계효과 트랜지스터 및, 상기 n형 반도체 영역 내에 형성되는 p채널 금속 절연물 반도체 전계효과 트랜지스터를 포함하고, 상기 n채널 금속 절연물 반도체 전계효과 트랜지스터는 상기 p형 반도체 영역 내에서 분리되어 형성되는 n형 소스 영역 및 n형 드레인 영역과; 상기 p형 반도체 영역 내에 그리고 상기 n형 소스 영역 및 상기 n형 드레인 영역 사이에 형성되는 제1채널 영역; 상기 제1채널 영역 상에 형성되는 제1게이트 전극; 상기 n형 소스 영역 내에서 겹쳐지고 또한 그 내부의 에너지 갭을 상기 제1채널 영역 내의 에너지 갭 이상으로 증가시키기에 충분한 탄소 농도를 갖는 Si1-xCx로 형성되는 제1영역 및; 상기 Si1-xCx로 형성되는 제1영역과 상기 제1채널 영역이 측면상의 상기 p형 반도체 영역의 상기 또 다른 부분 사이에 형성되고, 상기 n형 소스 영역과 상기 제1채널 영역 사이의 접촉면 또는 이들 영역의 부근에서 존재하는 헤테로 접합면을 포함하고, 상기 p채널 금속 절연물 반도체 전계효과 트랜지스터는 상기 n형 반도체 영역 내에서 분리되어 형성되는 p형 소스 영역 및 p형 드레인 영역과, 상기 n형 반도체 영역 내에 그리고 상기 p형 소스 영역 및 상기 p형 드레인 영역 사이에 형성되는 제2채널 영역; 상기 제2채널 영역 상에 형성되는 제2게이트 전극; 상기 P형 소스영역에서 겹쳐지고 또한 그 내부의 에너지 갭을 상기 제2채널 영역 내의 에너지 갭 이상으로 증가시키기에 충분한 탄소 농도를 갖는 Si1-xCx로 형성되는 제2영역 및; 상기 Si1-xCx로 형성되는 제2영역과 상기 제2채널 영역의 측면상의 상기 n형 반도체 영역의 상기 또 다른 부분 사이에 형성되고, 상기 p형 소스 영역과 상기 제2채널 영역 사이의 접촉면 또는 이들 영역의 부근에서 존재하는 헤테로 접합면을 포함하는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치에 있어서, 상기 장치는 표면상에 형성된 절연 기판 상에 실리콘으로 형성된 반도체층을 갖는 절연물상의 실리콘(SOI)기판과; 상기 반도체층 내에 분리되어 형성되는 소스 영역 및 드레인 영역; 상기 반도체층 내에 그리고 상기 소스 영역 및 상기 드레인 영역 사이에 형성되는 채널 영역; 상기 채널 영역 상에 형성되는 게이트 전극 및; 상기 드레인 영역 내에서 Si1-xCx로 형성되고 또한 그 내부의 에너지 갭을 상기 채널 영역 내의 에너지 갭 이상으로 증가시키기에 충분한 탄소농도를 갖는 영역을 포함하고, 상기 금속 절연물 반도체 전계효과 트랜지스터는 상기 Si1-xCx로 형성되는 영역과 상기 반도체층의 상기 또 다른 부분 사이에 형성되는 헤테로 접합면이 상기 채널 영역의 상기 드레인 영역측상에 존재하는 방식으로 구성되는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치에 있어서, 상기 장치는 표면상에 반도체 영역을 갖는 실리콘 기판과; 상기 반도체 영역 내에 분리되어 형성되는 소스 영역 및 드레인 영역; 상기 반도체 영역 내에 그리고 상기 소스 영역 및 상기 드레인 영역 사이에 형성되는 채널 영역; 상기 채널 영역 상에 형성되는 게이트 전극, 상기 소스 영역 및 상기 드레인 영역의 적어도 한 영역에서 겹쳐지고 또한 그 내부의 에너지 갭을 상기 채널 영역 내의 에너지 갭 이상으로 증가시키기에 충분한 탄소 농도를 갖는 Si1-xCx로 형성되는 영역 및; 상기 적어도 한 영역 상에 금속으로 형성되는 전극을 포함하고, 상기 금속 절연물 반도체 전계효과 트랜지스터는 상기 기판의 깊이 방향을 따라 상기 적어도 하나의 영역과 상기 적어도 하나의 영역 상에 형성되는 상기 전극 사이의 접촉면으로부터 시작하는 탄소 원자의 농도 분포가 상기 기판에서 최대가 되는 방식으로 구성되는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제11항에 있어서, 상기 금속 절연물 반도체 전계효과 트랜지스터는 표면채널형이고, 상기 Si1-xCx로 형성되는 영역은 상기 적어도 하나의 영역의 표면 부근에서 형성되고, 상기 적어도 하나의 영역의 전도형태와 동일한 전도형태를 갖는 실리콘 반도체층이 상기 적어도 하나의 영역과 상기 적어도 하나의 영역 상에 형성되는 상기 전극 사이에 형성되는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제11항에 있어서, 상기 금속 절연물 반도체 전계효과 트랜지스터는 표면채널형이고, 상기 Si1-xCx로 형성되는 영역은 상기 채널 영역 부근보다 상기 적어도 하나의 영역의 상기 전극 아래에서 더 깊게 형성되는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제11항에 있어서, 상기 금속 절연물 반도체 전계효과 트랜지스터는 매립채널형이고, 상기 Si1-xCx로 형성되는 영역은 상기 매립된 채널에 연결되도록 구성되는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제11항에 있어서, 상기 Si1-xCx로 형성되는 영역은 상기 소스 영역에 겹쳐져서 형성되고, 상기 Si1-xCx로 형성되는 영역과 상기 채널 영역의 측면상의 상기 반도체 영역의 상기 다른 부분 사이의 헤테로 접합면은 상기 소스 영역과 상기 채널 영역 사이의 접촉면 또는 이들 영역의 부근에서 존재하는 것을 특징으로 하는 금속 절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제12항에 있어서, 상기 Si1-xCx로 형성되는 영역은 상기 소스 영역에 겹쳐져서 형성되고, 상기 Si1-xCx로 형성되는 영역과 상기 채널 영역의 측면상의 상기 반도체 영역의 상기 다른 부분 사이의 헤테로 접합면은 상기 소스 영역과 상기 채널 영역 사이의 접촉면 또는 이들 영역의 부근에서 존재하는 것을 특징으로 하는 금속절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 제13항에 있어서, 상기 Si1-xCx로 형성되는 영역은 상기 소스 영역에 겹쳐져서 형성되고, 상기 Si1-xCx로 형성되는 영역과 상기 채널 영역의 측면상의 상기 반도체 영역의 상기 다른 부분 사이의 헤테로 접합면은 상기 소스 영역과 상기 채널 영역 사이의 접촉면 또는 이들 영역의 부근에서 존재하는 것을 특징으로 하는 금속절연물 반도체 전계효과 트랜지스터를 갖는 반도체 장치.
- 반도체 장치를 제조하는 방법에 있어서, 상기 방법은 실리콘 기판 상에 게이트 절연막을 형성하는 단계와; 상기 형성된 게이트 절연막 상에 게이트 전극을 형성하는 단계; 상기 게이트 전극을 마스크로 사용하여 탄소 이온을 주입시켜 Si1-xCx층을 형성하는 단계 및; 소스 영역 및 드레인 영역을 형성하는 단계를 포함하는 것을 특징으로 하는 반도체 장치 제조방법.
- 제18항에 있어서, 상기 Si1-xCx층은 그 내부의 에너지 갭을 상기 게이트 전극 아래에 형성되는 채널 영역내 및 상기 실리콘 기판 내의 에너지 갭 이상으로 증가시키기에 충분한 탄소 농도를 갖는 것을 특징으로 하는 반도체 장치 제조방법.
- 반도체 장치를 제조하는 방법에 있어서, 상기 방법은 표면상에 형성되는 절연 기판 상에 실리콘층을 갖는 절연물 상의 실리콘(SOI)기판의 실리콘층 상에 게이트 절연막을 형성하는 단계와; 상기 형성된 게이트 절연막 상에 게이트 전극을 형성하는 단계; 소스 영역 및 드레인 영역을 형성하는 단계 및; 상기 게이트 전극을 마스크로 사용하여 탄소 이온을 주입시켜 Si1-xCx층을 형성하는 단계를 포함하고, 상기 탄소 이온 주입은 상기 드레인 영역 상에 형성되는 상기 Si1-xCx층이 상기 실리콘층 내에 그리고 상기 게이트 전극 아래에 형성되는 상기 채널 영역까지 연장되도록 경사진 주입 각도로 주입되는 것을 특징으로 하는 반도체 장치 제조방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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