KR940010531A - 전력 전압보다 작은 진폭을 갖는 입력 신호를 위한 버퍼 회로 - Google Patents

전력 전압보다 작은 진폭을 갖는 입력 신호를 위한 버퍼 회로 Download PDF

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KR940010531A
KR940010531A KR1019930022853A KR930022853A KR940010531A KR 940010531 A KR940010531 A KR 940010531A KR 1019930022853 A KR1019930022853 A KR 1019930022853A KR 930022853 A KR930022853 A KR 930022853A KR 940010531 A KR940010531 A KR 940010531A
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power terminal
buffer circuit
gate
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KR1019930022853A
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슈이찌 쯔까다
Original Assignee
세끼모또 타다히로
닛본덴기 가부시끼가이샤
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Abstract

전원 전압과 다른 논리 진폭을 갖는 입력 신호를 위한 버퍼 회로가 기술되는데, 이 버퍼 회로는 전원 단자 사이에 직렬로 접속된 P채널 트랜지스터와 N채널 트랜지스터를 포함한다. 이 회로는 최소한 하나의 P채널 트랜지스터 및 N채널 트랜지스터와 대응 전원 단자 사이에 삽입된 다이오드 접속형의 제1트랜지스터 및 제1트랜지스터와 병렬로 접속되고 반전기 회로로부터의 신호와 반대 위상을 갖는 신호에 의해 구동되는 제2트랜지스터를 더 포함한다.

Description

전력 전압보다 작은 진폭을 갖는 입력 신호를 위한 버퍼 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3A도는 본 발명에 따른 제1실시예의 예시적인 회로도.
제3B도는 제3A도에서 도시된 회로의 동작을 나타내는 타이밍 차트.

Claims (9)

  1. 입력 신호가 공급되는 제1노드, 제1전력 단자와 제2노드사이에 접속되고, 상기 제1노드에 접속된 게이트를 갖는 제1트랜지스터, 상기 제2노드와 제3노드 사이에 접속되고, 상기 제1노드에 접속된 게이트를 갖는 제2트랜지스터, 문턱 전압을 갖고, 상기 제3노드와 제2전력 단자 사이에 접속된 제1전압 강하 소자, 상기 제1전압 강하 소자와 병렬로 접속된 제3트랜지스터 및 상기 제2노드로부터 유도된 신호와 반대 위상을 갖는 구동 신호에 의해 상기 제3트랜지스터를 구동하는 구동 회로를 포함하는 것을 특징으로 하는 버퍼 회로.
  2. 제1항에 있어서, 상기 제1전압 강하 소자가 상기 제3노드에 접속된 게이트를 갖는 제4트랜지스터를 포함하는 것을 특징으로 하는 버퍼 회로.
  3. 제1항에 있어서, 상기 제1전압 강하 소자가 각각 다이오드로서 동작하는 다수의 트랜지스터를 포함하는 것을 특징으로 하는 버퍼 회로.
  4. 제2항에 있어서, 상기 구동 회로가 상기 제2노드와 상기 제3트랜지스터의 게이트 사이에 접속된 반전기를 포함하는 것을 특징으로 하는 버퍼 회로.
  5. 제1항에 있어서, 상기 제1트랜지스터와 상기 제1전력 단자 사이에 삽입된 제2전압 강하 소자 및 상기 제2전압 강하 소자와 병렬로 접속된 제4트랜지스터를 포함하고, 상기 제4트랜지스터는 상기 구동 신호에 의해 구동되는 것을 특징으로 하는 버퍼 회로.
  6. 제5항에 있어서, 각각의 상기 제1 및 제2전압 강하 소자가 다이오드접속된 트랜지스터를 포함하는 것을 특징으로 하는 버퍼 회로.
  7. 제5항에 있어서, 상기 구동 회로가 상기 제2노드와 상기 제3 및 제4트랜지스터의 게이트에 공통으로 접속된 출력 단부 사이에 접속된 입력 단부를 갖는 반전기를 포함하는 것을 특징으로 하는 버퍼 회로.
  8. 입력 신호가 공급되는 입력 노드, 제1전력 단자와 회로 노드 사이에 접속되고, 상기 입력 노드에 접속된 게이트를 갖는 제1트랜지스터, 상기 회로 노드와 제2전력 단자 사이에 접속되고, 상기 입력 노드에 접속된 게이트를 갖는 제2트랜지스터, 상기 제1트랜지스터와 상기 제1전력 단자 사이에 삽입되고, 다이오드로서 동작하는 제3트랜지스터, 상기 제3트랜지스터와 병렬로 상기 제1트랜지스터와 상기 제1전력 단자 사이에 삽입된 제4트랜지스터, 상기 제4트랜지스터의 게이트에 접속된 출력 노드 및 상기 회로 노드와 접속된 입력 단부와 상기 출력 노드와 접속된 출력 단부를 갖는 반전기를 포함하는 것을 특징으로 하는 버퍼 회로.
  9. 제8항에 있어서, 상기 제2트랜지스터와 상기 제2전력 단자 사이에 삽입되고 다이오드로서 동작하는 제5트랜지스터 및 상기 제5트랜지스터와 병렬로 상기 제2트랜지스터와 상기 제2전력 단자 사이에 삽입되고, 상기 출력 노드에 접속된 게이트를 갖는 제6트랜지스터를 포함하는 것을 특징으로 하는 버퍼 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930022853A 1992-10-30 1993-10-30 전력 전압보다 작은 진폭을 갖는 입력 신호를 위한 버퍼 회로 KR940010531A (ko)

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JP92-293216 1992-10-30
JP4293216A JPH06152341A (ja) 1992-10-30 1992-10-30 バッファリング回路

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KR940010531A true KR940010531A (ko) 1994-05-26

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ID=17791933

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KR1019930022853A KR940010531A (ko) 1992-10-30 1993-10-30 전력 전압보다 작은 진폭을 갖는 입력 신호를 위한 버퍼 회로

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EP (1) EP0595318A3 (ko)
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JPH06152341A (ja) 1994-05-31
EP0595318A3 (en) 1995-02-15
EP0595318A2 (en) 1994-05-04

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