KR920022534A - 스태틱(static)형 반도체 기억 장치, 전계 효과 트랜지스터 및 그의 제조 방법 - Google Patents
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 이 발명의 1실시예에 의한 전계 효과 트랜지스터로서 박막 트랜지스터의 단면구조를 표시하는 단면도.
제2도는 이 발명의 1실시예에 의한 전계 효과 트랜지스터로서 박막 트랜지스터의 제조방법의 각 공정(A)∼(C)에 있어 단면 구조를 순서로 표시하는 단면도.
제3도는 이 발명의 1실시예에 의한 p채널 박막 트랜지스터의 게이트전압과 드레인 전류와의 관계를 표시하는 그래프.
제4도는 이 발명의 제1의 비교예로서 p채널 박막 트랜지스터의 게이트 전압과 드레인 전류와의 관계를 표시하는 그래프.
Claims (3)
- 주 표면을 가지는 절연성의 기판과, 상기 기판의 주 표면상에 형성된 게이트 전극과, 상기 게이트 전극상에 형성된 절연막과, 상기 게이트 전극상에 상기 절연막을 개재되게하여 형성된 반도체막과, 상기 게이트 전극에 의해 떨어져있는 상기 반도체 막의 한쪽과 다른쪽의 영역에 형성된 불순물 영역을 구비하고, 상기 불순물 영역의 적어도 한쪽은, 상기 게이트 전극에 근접하는 위치에 형성된 제1의 농도로 불순물을 함유하는 제1의 불순물 영역과, 상기 제1의 불순물 영역에 인접되도록 형성되고, 상기 제1의 농도보다 높은 제2의 농도로 불순물을 함유하는 제2의 불순물 영역을 포함하는 전계 효과 트랜지스터.
- 상보형 전계 효과 트랜지스터를 가지는 메모리셀을 구비한 스택틱형 반도체 기억 장치에 있어서, 주 표면가지는 제1도전형의 반도체 기판과, 상기 반도체 기판의 주표면상에 형성된 제2도전형의 전계 효과 트랜지스터와, 상기 제2도전형의 전계 효과 트랜지스터에 전기적으로 접속된 제1도전형의 전계 효과 트랜지스터를 구비하고, 상기 제1도전형의 전계 효과 트랜지스터는, 상기 제2도전형의 전계 효과 트랜지스터의 상반에 형성된 전극과, 상기 게이트 전극상에 형성된 절연막과, 상기 게이트 전극상에 상기 절연막을 개재되게 하여 형성된 반도체막과, 상기 게이트 전극에 의해 떨어진 상기 반도체막의 한쪽과 다른쪽 영역에 형성된 제1도전형의 불순물 영역을 구비하고, 상기 불순물 영역의 적어도 한쪽은, 상기 게이트 전극에 근접하는 위치에 형성하고, 제1의 농도로 제1도전형의 불순물을 함유하는 제1의 불순물 영역과, 상기 제1의 불순물 영역에 인접하도록 형성되고, 상기 제1의 농도보다 높은 제2의 농도로 제1도전형의 불순물을 함유하는 제2의 불순물 영역을 포함하는 스태틱형 반도체 기억 장치.
- 절연성의 기판의 주 표면상에 게이트 전극을 형성하는 공정과, 상기 게이트 전극상에 제1의 절연막을 형성하는 공정과, 상기 게이트 전극상에 상기 제1의 절연막을 개재되게하여 반도체 막을 형성하는 공정과, 상기 게이트 전극상에 상기 제1의 절연막을 개재되게 하여 반도체 막을 형성하는 공정과, 상기 게이트 전극의 영역에서는 제1의 두께를 가지고, 상기 게이트 전극이외의 영역에서는 상기 제1의 두께보다 작은 제2의 두께를 가지는 제2의 절연막을 상기 반도체막의 위에 형성하는 공정과, 상기 제2의 절연막을 통하여 불순물을 이온 주입하는 것에 의해, 상기 게이트 전극이외의 영역에 제1의 농도로 불순물을 함유하는 제1의 불순물 영역을 상기 반도체막내에 형성하는 공정과, 상기 게이트 전극에 근접하는 상기 제1의 불순물 영역의 일부에 있어 절연막이 적어도 상기 제1의 두께를 가지도록 상기 제2의 절연막상에 더욱 제3의 절연막을 선택적으로 형성하는 공정과, 상기 제2의 절연막과 상기 제3의 절연막을 통하여 불순물을 이온 주입하는 것에 의해, 상기 일부이외의 상기 제1의 불순물 영역에 상기 제1의 농도보다 높은 제2의 농도로 불순물을 함유하는 제2의 불순물 영역을 상기 반도체막내에 형성하는 공정을 구비한 전계 효과 트랜지스터의 제조방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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