KR20160100402A - 공동 구동 게이트와 공용 전극에 사용되는 goa 유닛, 구동회로 및 어레이 - Google Patents

공동 구동 게이트와 공용 전극에 사용되는 goa 유닛, 구동회로 및 어레이 Download PDF

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Abstract

본 발명은 공동 구동 게이트와 공용 전극에 사용되는 GOA 유닛, 구동회로 및 어레이에 관한 것이다. 상기 구동회로는 트리거 장치; 제1선택입력회로; 다른 순차로 공용 전극 하이레벨 입력과 게이트극 하이레벨 입력을 각각 상기 트리거 장치의 클럭단에 스트로브(strobe)하여 트리거 출력단의 압력을 끌어올리는 제2선택입력회로; 제n+1과 제n+4게이트극 라인 상의 레벨 신호나 가장자리 신호를 상기 트리거 장치의 리셋 신호로 선택하는 제3선택입력회로; 상기 제n+1과 제n+4게이트극 라인의 제어를 받는 상황에서 게이트극 로우레벨 입력 또는 공용 전극 로우레벨 입력을 각각 상기 트리거 장치의 로우레벨 입력단으로 스트로브하여 그 압력을 끌어내리는 제4선택입력회로; 다른 펄스 순차에서 출력 게이트극 구동 신호 또는 출력 공용 전극 구동신호를 선택하는 선택 출력 회로를 포함한다. 본 발명에 따르면, COM 전압 출력과 GATE 출력은 동기되고, 게이트극 전압 변화의 방향과 반대되며, 이로 인해 효과적으로 피드 스루(feed through)전압을 상쇄시킨다.

Description

공동 구동 게이트와 공용 전극에 사용되는 GOA 유닛, 구동회로 및 어레이{GOA UNIT, DRIVING CIRCUIT AND ARRAY FOR JOINTLY DRIVING GATE AND COMMON ELECTRODE}
본 발명은 액정 디스플레이 기술에 관한 것으로서, 특히 공동 구동 게이트와 공용 전극에 사용되는 GOA 유닛, 구동회로 및 어레이에 관한 것이다.
GOA 기술 즉, 어레이 기판 게이트 구동(Gate Driver on Array)은 게이트 구동 회로（Gate Driver ICs）를 어레이 기판의 Array 상에 직접 제작하여, 외접 실리콘 웨이퍼에 의한 제작을 대체하는 기술이다. 이 기술의 적용으로 게이트극 구동 회로를 바로 패널 주변에 두어 제작 과정을 줄이고, 생산 단가를 낮춘다. 또한, TFT-LCD 패널의 고집적도를 높여 패널이 보다 얇아지게 한다.
그러나, 2차 구동 원리에서, 각종 다른 피드 스루(feed through) 전압이 존재한다. 여기에서 영향이 가장 큰 것은 Cgd를 경유하여 만들어지는 피드 스루(feed through) 전압이다. 이로 인해, 2차 구동시 공용 전극의 전압을 조정하여 그레이 스케일 특성을 바꿀 필요가 있다.
공용 전극(Com)이 직류 구동을 적용할 때, Cgd를 지나는 피드 스루(feed through) 전압은 다음과 같다.
(Vg_high - Vg_low) * Cgd / (Cgd + Clc + Cs) ，
여기에서, Vg_high 와 Vg_low는 각각 게이트극 구동 회로 경로의 온/오프 전압이고, Cgd, Clc 및 Cs는 각각 TFT 기생 커페시턴스, 액정 커페시턴스 및 저장 커페시턴스이다.
피드 스루(feed through) 전압은 주로 TFT 단락 시 게이트극 전압의 변화를 위해 기생 커페시턴스 Cgd를 통해 화소 전압이 낮아져 만들어진 것이다. 화소 전압의 극성이 양이든 음이든 상관 없이, 피드 스루(feed through) 전압은 모두 화소 전압에 대해 음의 방향으로 이끈다.
종래기술에서는 공용 전극의 전압에 대해 보상을 하는 방식으로 피드 스루(feed through) 전압의 영향을 줄인다. 그러나, Clc가 고정된 레퍼런스가 아니기 때문에, 공용 전극의 구동 전압을 조정함으로써 피드 스루(feed through)의 영향을 제거할 수는 없어, 결국 영상의 품질을 개선하고자 하는 목적은 달성되기 어렵게 된다.
현 상황에서, 간단하게 실현 가능한 GOA 회로 설계를 제공하여 피드 스루(feed through) 전압의 감소를 실현, 심지어는 제거하여 디스플레이 장치의 그레이 스케일 품질을 높일 필요가 있다.
상술한 문제점을 해결하기 위해 본 발명은 공동 구동 게이트극 및 공용 전극의 GOA 유닛을 제공한다.
본 발명의 GOA 유닛은 입력단, 클럭단, 리셋단, 로우레벨 입력단 및 트리거출력단을 포함하는 트리거 장치; 병렬 연결된 두 개의 반전 컷오프 다이오드를 포함하되, 상기 다이오드의 양극은 각각 제n-1과 제n+2게이트극 라인 출력과 연결되고, 상기 다이오드의 음극은 출력으로서 상기 입력단과 연결되어, 제n-1과 제n+2게이트극 라인 중의 레벨 신호나 가장자리 신호를 상기 트리거 장치의 활성화 입력으로 선택하는, 제1선택입력회로; 출력이 상기 클럭단과 연결되고, 네 개의 동일 주기 비동기 작업의 클럭 펄스 입력, 및 공용 전극 하이레벨 입력과 게이트극 하이레벨 입력을 포함하고, 다른 순차로 공용 전극 하이레벨 입력과 게이트극 하이레벨 입력을 각각 상기 트리거 장치의 클럭단에 스트로브(strobe)하여 트리거출력단의 압력을 끌어올리는, 제2선택입력회로; 병렬 연결된 두 개의 반전 컷오프 다이오드를 포함하되, 상기 다이오드의 양극은 각각 제n+1과 제n+4게이트극 라인 출력과 연결되고, 상기 다이오드의 음극은 출력으로서 상기 리셋단과 연결되어, 제n+1과 제n+4게이트극 라인 상의 레벨 신호나 가장자리 신호를 상기 트리거 장치의 리셋 신호로 선택하는, 제3선택입력회로; 출력이 상기 로우레벨 입력단과 연결되고, 상기 제n+1과 제n+4게이트극 라인의 제어를 받는 상황에서 게이트극 로우레벨 입력 또는 공용 전극 로우레벨 입력을 각각 상기 트리거 장치의 로우레벨 입력단으로 스트로브하여 그 압력을 끌어내리는, 제4선택입력회로; 입력이 상기 트리거 출력단에 연결되고, 네 개의 동일 주기 비동기 작업의 클럭 펄스 중의 두 개 펄스 순차에서 출력 게이트극 구동 신호 또는 출력 공용 전극 구동신호를 선택하는, 선택 출력 회로;를 포함한다.
본 발명의 일 실시예에 따르면, 상기 반전 컷오프 다이오드는 MOS관 또는 TFT관으로 구성된 다이오드 등가 회로로서, MOS관 또는 TFT관 게이트극은 소스극과 연결되어 상기 양극이 되고, 드레인극은 상기 음극이 된다.
본 발명의 일 실시예에 따르면, 제n-1과 제n+2게이트극 라인 중의 레벨신호나 가장자리 신호는 로우레벨 신호 또는 하강 신호이고, 제n+1과 제n+4게이트극 라인 상의 레벨신호 또는 가장자리 신호는 하이레벨 신호 또는 상승신호이다.
본 발명의 일 실시예에 따르면, 네 개의 동일 주기 비동기 작업의 클럭 펄스 입력은 위상에 있어서 순차적으로 4분의 1 작업 주기의 차이가 난다.
본 발명의 일 실시예에 따르면, 제1항에 있어서, 상기 GOA유닛 회로 출력의 공용 전극 구동 신호는 제n+3 게이트 라인상의 신호와 동기된다.
본 발명의 일 실시예에 따르면, 상기 제2선택입력회로는 네 개의 TFT트렌지스터를 포함하되, 두 개의 TFT트렌지스터의 소스, 드레인극은 서로 연결되고, 두 개의 게이트극은 각각 제2클럭펄스입력 및 제3클럭펄스입력으로 제어되며, 게이트극 하이레벨 입력을 엑세스하는데 이용되고, 다른 두 개의 TFT트렌지스터의 소스, 드레인극이 서로 연결되고, 두 개의 게이트극은 각각 제1클럭펄스입력 및 제4클럭펄스입력으로 제어되며, 공용 전극 하이레벨 입력을 엑세스하는데 이용된다.
본 발명의 일 실시예에 따르면, 상기 제4선택입력회로는 두 개의 TFT트렌지스터를 포함하되, 게이트극은 각각 제n+1 및 제n+4 게이트 라인의 출력과 연결되고, 소스극은 각각 게이트극 로우레벨 입력과 공용 전극 로우레벨 입력과 대응되어 연결된다.
본 발명의 일 실시예에 따르면, 상기 선택 출력 회로는 두 개의 TFT트렌지스터를 포함하되, 두 개의 TFT트렌지스터의 게이트극은 각각 제3클럭펄스입력 및 제1클럭펄스입력으로 제어되며, 두 개의 소스극은 공동으로 트리거 출력단에 연결되어, 다른 순차로 각각 제n게이트 라인 출력과 제n+3공용 전극 라인 출력을 출력하되, 상기 두 개의 펄스 순차는 서로 4분의 3 작업주기의 차이가 난다.
본 발명은 디스플레이 패널 구동 회로를 제공하며, 이는 상술한 임의의 하나의GOA 유닛을 포함하고, 상기 GOA 유닛은 다음 방식으로 직렬된다:
제n-1과 제n+2게이트극 라인 출력은 각각 본급(本級) GOA유닛의 트리거 신호이고, 제n+1과 제n+4게이트극 라인 출력은 각각 본급 GOA 유닛의 리셋신호이며, 네 개의 클럭 라인은 각각 본급 GOA유닛의 제2선택입력회로상의 클럭펄스입력과 연결되어, 주기가 동일하나 위상이 다른 클럭신호를 제공하며, 다른 클럭펄스에서 게이트극 하이레벨 입력과 공용 전극 하이레벨 입력을 각각 스트로브하여 상응하는 풀업(pull-up) 전압을 출력하고,
본급 GOA유닛의 출력은 제n게이트 라인 출력과 제n+3공용 전극 라인 출력이다.
본 발명에서는 그 상면에 상기 구동 회로가 형성되는 어레이를 제공하는데, 상기 어레이는, 횡방향으로 병렬된 게이트 라인 및 공용 전극 라인; 종방향으로 병렬된 클럭입력 라인, 게이트극 하이/로우 레벨 입력 라인, 공용 전극 하이/로우 레벨 입력 라인을 포함하되, 게이트 라인과 공용 전극 라인의 출력은 직렬 위치에서 서로 3개 급의 차이가 나거나, 또는 순차적으로 서로 4분의 3 작업 주기의 차이가 난다.
본 발명에 따르면, COM 전압 출력과 GATE 출력은 동기되고, 게이트극 전압 변화의 방향과 반대되며, 이로 인해 효과적으로 피드 스루(feed through)전압을 상쇄시킨다.
본 발명의 다른 특징 및 장점은 이후 명세서에서 설명할 것이고, 일부 명세서로부터 용이하게 변경되거나 본 발명을 실시함으로써 이해될 것이다. 본 발명의 목적 및 다른 장점은 명세서, 청구항 및 도면에서 특별히 지적한 구조를 통해 실현되거나 달성된다.
도면은 본 발명에 대해 보다 잘 이해하기 위해 제공되며, 명세서의 일부를 구성한다. 본 발명의 실시예는 공통적으로 본 발명을 이해하는데 이용되며, 본 발명의 권리범위를 제한하지 않는다.
도 1은 종래기술에서의 공용 전극이 직류 구동을 적용하는 전압 파형으로서, 여기에서 공용 전극에 저장 커페시턴스Cs(Cs on Com)이 형성된다.
도 2는 종래기술에서 적용하는 GOA 유닛의 내부 회로도이다.
도 3은 종래기술에서 GOA 유닛을 직렬하여 게이트극 2차 구동을 형성한 회로 원리도이다.
도 4는 종래기술에서 게이트를 구동 회로의 펄스순차도이다.
도 5는 본 발명에 따른 공용 전극 구동 회로와 게이트 구동 회로 동기 작업의 전압 파형이다.
도 6은 본 발명의 일 실시예에 따른 GOA 유닛에서 공용 전극 구동 출력을 집적한 내부 회로도이다.
도 7은 본 발명을 적용한 구동회로가 만든 구동 펄스 순서도이다.
본 발명의 실시예 또는 종래기술에서의 기술 방안을 보다 명확하게 설명하도록 하기 위해, 이하에서는 실시예 또는 종래기술에서 설명하는데 필요한 도면에 대해 간단하게 설명할 것이며, 분명하게도, 이하에서 설명하는 도면은 단지 본 발명에서 기재하는 일 실시예일 뿐이고, 본 기술 영역의 통상의 기술자가 창조적인 노력을 들이지 않는 범위 안에서 본 도면을 통해 다른 실시 형태까지도 설명할 수 있는 것으로 보아야 한다.
도 1 내지 도 4에서 도시하는 것은 종래기술의 GOA 구동 회로 및 그것이 만들어내는 펄스 파형도이다. 여기에서 볼 수 있는 바와 같이, 공용 전극 COM상의 전압은 직류전압이다. 각 줄의 게이트 라인（Gate 1，Gate 2，Gate 3，......）상의 전압 펄스는 두 개의 상반된 클럭 시스템의 작용 하에 순차적으로 나타난다. 주사가 마쳐진 모든 게이트 라인의 시간 폭은 한 프레임이고, 이 시간폭은 각 게이트 라인상 펄스의 주기이다. 교차된 두 개의 클럭을 적용하여 트리거 제어를 진행하기 때문에, 게이트 라인 상의 양의 펄스 너비와 클럭 너비는 동일하다.
더 나아가, 도 1에는 동일한 시각에 각 라인상에 나타나는 전압 파형을 도시한다. 101은 게이트극 구동 전압을 표시하고, 102는 소스극 구동 전압 펄스를 표시하며, 103은 화소 전극상의 전압을 표시하고, 104는 소스극 전압과 화소 전압의 차이를 나타내는데, 이 차이값은 피드 스루(feed through) 전압에 상당하다. 이 피드 스루(feed through) 전압을 제거하기 위해, 원래의 COM 전압106을 수정하고, 수정된 COM 전압은 107로 표시되었다. 수정량은 피드 스루(feed through) 전압값과 동일하다. 다만, COM이 직류 구동되므로 전압을 수정하는 것은 쉽지 않다.
종래기술에서는 도 3에서 도시하는 바와 같이, 이 구동 회로는 한 편에 GOA 유닛을 구성하였다. 이러한 GOA 유닛 직렬은 그 각각의 출력에서 도 4가 도시하는 바와 같은 펄스를 형성한다. 도 2에서는 보다 상세하게 GOA 유닛 내부 회로를 도시한다.
도 2에서 도시하는 바와 같이, 이 GOA 유닛은 실질적으로 트리거 장치이다. 이는 4개의 TFT 스위치관과 1개의 커페시터를 포함한다. 여기에서 TFT1은 구동 스위치 트랜지스터이고, TFT2와 TFT3은 리셋 스위치 트랜지스터이며, TFT4는 예비 충전 스위치 트랜지스터이다. Cb는 TFT1의 전위유지 커페시터이고, 주로 TFT4에 의해 제어된다. 종래의 GOA 구동에는 네 개의 제어 신호, 즉, 클럭 신호(Clk), 입력 신호, 리셋 신호(Reset) 및 게이트극 출력 저전위(Vss)를 필요로 한다. 클럭 신호는 게이트 라인이 출력한 풀업(pull-up) 신호이다.
도 3은 종래기술에서 GOA 유닛을 직렬하여 게이트극 2차 구동을 형성한 회로 원리도이다. 종전의 GOA유닛의 출력은 본 GOA유닛의 트리거 신호이고, 다음의 GOA 유닛의 출력은 본 GOA유닛의 리셋신호이다. 클럭 신호는 두 개（Vclk_A，Vclk_B）인데, 각각 홀수 행의 GOA 유닛과 짝수 행의 GOA 유닛에 적용된다. 게이트 라인 출력 전위(Vss)는 게이트 라인상의 출력 펄스의 높이 또는 폭을 결정한다.
상술한 바와 같이, 이러한 것들은 모두 COM 전압을 조정하여, 피드 스루(feed through) 전압을 제거하는 것에 관한 것이다.
이하에서는 본 발명이 상술한 원리를 고려하여 어떻게 COM 전압을 조정할 것인지 소개한다. 상술한 바와 같이, 필요로 하는 COM 전압 변화량은 이미 알고 있는데, 즉 피드 스루(feed through) 전압에 상당하다. 이로 인해, 도 5에서 도시하는 시퀀스를 획득한다. 도 1과 유사하게, 501은 게이트극 구동 전압 펄스를 표시하고, 502는 소스극 구동 전압 펄스를 표시하며, 503은 화소 전극상의 전압을 표시하고, 506은 COM 전압 구동 신호를 표시한다. 도면을 통해 알 수 있듯이, 이러한 상황에서, 피드 스루(feed through)는 이론상 완전하게 COM 전압의 변화량에 의해 제거된다.
이러한 발상에 따라 GOA 구동 회로를 설계한다. 이 구동 회로의 핵심인 GOA 유닛은 도 6에서 도시하는 바와 같다.
GOA 유닛의 출력은 공동 구동 게이트극 및 공용 전극에 적용된다. 이는 주로 트리거(602) 및 일련의 주변부 회로로 구성된다. 이 트리거 장치는 입력단(1), 클럭단(2), 리셋단(3), 로우레벨 입력단(4) 및 트리거 출력단(5)을 포함한다.
공용 전극 구동과 게이트극 구동이 함께 이 트리거를 사용할 수 있도록 하기 위해, 이 GOA 유닛은 제1선택입력회로(603)을 포함한다. 이는 병렬 연결된 두 개의 반전 컷오프 다이오드를 포함한다. 다이오드의 양극은 각각 제n-1과 제n+2게이트극 라인(G[n-1]과 G[n+2]) 출력과 연결되고, 다이오드의 음극은 출력으로서 입력단(1)과 연결되어, 제n-1과 제n+2게이트극 라인(G[n-1]과 G[n+2]) 중의 레벨 신호나 가장자리 신호를 상기 트리거 장치(602)의 활성화 입력으로 선택된다.
도 5에서 도시하는 바와 같이, 이 GOA 유닛은 제3선택입력회로(604)을 포함한다. 이는 마찬가지로 병렬 연결된 두 개의 반전 컷오프 다이오드로 구성된다. 여기에서 위와 동일하게, 다이오드의 양극은 각각 제n+1과 제n+4게이트극 라인 출력(G[n+1]과G[n+4])과 연결되고, 다이오드의 음극은 출력으로서 상기 리셋단(3)과 연결되어, 제n+1과 제n+4게이트극 라인(G[n+1]과G[n+4]) 상의 레벨 신호나 가장자리 신호를 상기 트리거 장치(602)의 리셋 신호로 선택한다.
본 발명에서, 도 6에서 도시하는 바와 같이, 제n-1과 제n+2게이트극 라인(G[n-1] 과G[n+2])의 전압 레벨 신호 또는 가장자리 신호는 로우레벨 신호 또는 하강 신호이고, 제n+1과 제n+4게이트극 라인(G[n+1]과G[n+4]) 상의 전압 레벨신호 또는 가장자리 신호는 하이레벨 신호 또는 상승신호이다.
도 6에서, 상기 다이오드는 모두 T9-T12와 같은 TFT관으로 구성된 다이오드 등가회로를 적용한다. 여기에서 TFT관의 게이트극과 소스극은 연결되어 양극이 되고, 드레인극은 음극이 된다. 물론, 본 발명은 이에 한정되지 않으며, MOS관 등을 적용하여 등가 설계를 할 수도 있다.
본 발명의 GOA유닛은 제2선택입력회로(601)을 포함한다. 제2선택입력회로(601)의 출력은 트리거 장치의 클럭단(2)에 연결되고, 네 개의 동일 주기 비동기 작업의 클럭 펄스 입력(ClkA，ClkB，ClkC，ClkD), 및 공용 전극 하이레벨 입력(Com_2)과 게이트극 하이레벨 입력(Vgh)을 포함하고, 다른 순차로 공용 전극 하이레벨 입력(Com_2)과 게이트극 하이레벨 입력(Vgh)을 각각 상기 트리거 장치(602)의 클럭단(2)에 스트로브(strobe)하여 트리거 출력단(5)의 압력을 한층 더 풀업 시켜, 제n급 게이트극 주사 펄스 출력의 하이레벨 또는 제n+3급 공용 전극 펄스의 하이레벨을 형성한다.
구체적으로, 일 실시예에서, 제2선택입력회로(601)는 네 개의 TFT트렌지스터를 포함하되, 두 개의 TFT트랜지스터(T5，T6)의 소스, 드레인극은 서로 연결되고, 두 개의 게이트극은 각각 제2클럭펄스입력(ClkB) 및 제3클럭펄스입력(ClkC)으로 제어되며, 게이트극 하이레벨 입력을 엑세스(access)하는데 이용되고, 다른 두 개의 TFT트랜지스터(T7，T8)의 소스, 드레인극이 서로 연결되고, 두 개의 게이트극은 각각 제1클럭펄스입력(ClkA) 및 제4클럭펄스입력(ClkD)으로 제어되며, 공용 전극 하이레벨 입력을 엑세스하는데 이용될 수 있다.
바람직하게는, 네 개의 동일 주기 비동기 작업의 클럭 펄스 입력(ClkA，ClkB，ClkC，ClkD)은 위상에 있어서 순차적으로 4분의 1 작업 주기의 차이가 난다. 이렇게 하면, 출력된 게이트 라인 펄스 폭과 공용 전극 라인 펄스 폭은 모두 클럭 펄스 폭의 2분의 1이다.
또한, GOA 유닛은 제4선택입력회로(605)를 더 포함하는데, 그 출력이 상기 로우레벨 입력단(4)과 연결되고, 상기 제n+1과 제n+4게이트극 라인(G[n+1]과G[n+4])의 제어를 받는 상황에서 게이트극 로우레벨 입력 또는 공용 전극 로우레벨 입력을 각각 상기 트리거 장치의 로우레벨 입력단(4)으로 스트로브하여 그 압력을 끌어내려, 제n급 게이트극 주사 펄스 출력의 로우레벨 또는 제n+3급 공용 전극 펄스의 로우레벨을 형성한다.
일 실시예에서, 제4선택입력회로(605)는 바람직하게 두 개의 TFT 트랜지스터(T13，T14)를 포함하는데, 여기에서 게이트극은 각각 제n+1 및 제n+4 게이트 라인의 출력(G[n+1]과G[n+4])과 연결되고, 소스극은 각각 게이트극 로우레벨 입력(Vss)과 공용 전극 로우레벨 입력(Com_1)과 대응되어 연결된다.
GOA 유닛의 선택 출력 회로(606)은 그 입력이 상기 트리거 출력단에 연결되고, 네 개의 동일 주기 비동기 작업의 클럭 펄스 중의 두 개 펄스 순차에서 출력 게이트극 구동 신호 또는 출력 공용 전극 구동신호를 선택한다. 이 두 개의 펄스 순차는 서로 4분의 3 작업주기의 차이가 나는데, 이로 인해 게이트극 구동 신호는 공용 전극 구동신호에 비해 3개의 게이트 라인 펄스 폭 시간만큼 이른 시점에 나타난다.
도 6에서 도시하는 바와 같이, 제n급 GOA 유닛 회로가 출력하는 공용 전극 구동 신호(C[n+3])와 제n+3게이트 라인(G[n+3])상의 신호는 동기된다.
일 실시예에서, 선택 출력 회로(606)는 두 개의 TFT트랜지스터(T15，T16)를 포함하되, 두 개의 TFT트렌지스터의 게이트극은 각각 제3클럭펄스입력(ClkC) 및 제1클럭펄스입력(ClkA)으로 제어되며, 두 개의 소스극은 공동으로 트리거 출력단(5)에 연결되어, 다른 순차로 각각 제n게이트 라인 출력(G[n])과 제n+3공용 전극 라인 출력(G[n+3])을 출력한다.
도 7은 본 발명의 원리 구조에 따른 구동 회로 직렬 후 만들어지는 펄스 시퀀스도이다.
도면에서 볼 수 있는 것처럼, 네 개의 동일 주기 비동기 작업의 클럭 펄스 입력은 위상에 있어서 순차적으로 4분의 1 작업 주기의 차이가 난다. 게이트 라인(Gate1)에 펄스가 나타나는 때, Com1 상에도 펄스가 나타나며, 따라서 게이트극 구동과 공용 전극 구동의 동기 작업을 실현한다.
본 발명에서는 디스플레이 패널 구동 회로를 제공하는데, 이는 상술한 GOA 유닛을 포함하며, 여기에서 GOA 유닛은 다음과 같은 방식으로 직렬된다:
제n-1게이트극 라인 출력(G[n-1])과 제n+2게이트극 라인 출력(G[n+2])은 각각 본급(本級) GOA유닛의 트리거 신호이고, 제n+1게이트극 라인 출력(G[n+1])과 제n+4게이트극 라인 출력(G[n+4])은 각각 본급 GOA 유닛의 리셋신호이며, 네 개의 클럭 라인은 각각 본급 GOA유닛의 제2선택입력회로상의 클럭펄스입력(ClkA，ClkB，ClkC，ClkD)과 연결되어, 주기가 동일하나 위상이 다른 클럭신호를 제공하며, 다른 클럭펄스에서 게이트극 하이레벨 입력과 공용 전극 하이레벨 입력을 각각 스트로브하여 상응하는 풀업(pull-up) 전압을 출력하고,
본급 GOA유닛의 출력은 제n게이트 라인 출력(G[n])과 제n+3공용 전극 라인 출력(C[n+3])이다.
본 발명은 또한 그 위에 상술한 구동 회로를 형성한 어레이 기판을 제공하는데, 이는 다음을 포함한다:
횡방향으로 병렬된 게이트 라인 및 공용 전극 라인;
종방향으로 병렬된 클럭입력 라인, 게이트극 하이/로우 레벨 입력 라인, 공용 전극 하이/로우 레벨 입력 라인을 포함하되, 게이트 라인과 공용 전극 라인의 출력은 직렬 위치에서 서로 3개 급의 차이가 나거나, 또는 순차적으로 서로 4분의 3 작업 주기의 차이가 난다.
최선의 실시예를 통해 본 발명에 대해 설명하였으나, 본 발명의 범위에 벗어나지 않는 한, 이에 대해 각종 개선을 하거나 균등한 부품으로 대체할 수 있을 것이다. 특히, 구조적인 충돌이 없는 한, 각 실시예에서 언급한 각 기술특징은 모두 임의의 방식으로 조합될 수 있다. 본 발명은 본문에서 공개한 특정의 실시예에 한정되는 것이 아니고, 청구항의 범위 내에 속하는 모든 기술특징을 포함하는 것으로 보아야 한다.

Claims (17)

  1. 입력단, 클럭단, 리셋단, 로우레벨 입력단 및 트리거출력단을 포함하는 트리거 장치;
    병렬 연결된 두 개의 반전 컷오프 다이오드를 포함하되, 상기 다이오드의 양극은 각각 제n-1과 제n+2게이트극 라인 출력과 연결되고, 상기 다이오드의 음극은 출력으로서 상기 입력단과 연결되어, 제n-1과 제n+2게이트극 라인 중의 레벨 신호나 가장자리 신호를 상기 트리거 장치의 활성화 입력으로 선택하는, 제1선택입력회로;
    출력이 상기 클럭단과 연결되고, 네 개의 동일 주기 비동기 작업의 클럭 펄스 입력, 및 공용 전극 하이레벨 입력과 게이트극 하이레벨 입력을 포함하고, 다른 순차로 공용 전극 하이레벨 입력과 게이트극 하이레벨 입력을 각각 상기 트리거 장치의 클럭단에 스트로브(strobe)하여 트리거출력단의 압력을 끌어올리는, 제2선택입력회로;
    병렬 연결된 두 개의 반전 컷오프 다이오드를 포함하되, 상기 다이오드의 양극은 각각 제n+1과 제n+4게이트극 라인 출력과 연결되고, 상기 다이오드의 음극은 출력으로서 상기 리셋단과 연결되어, 제n+1과 제n+4게이트극 라인 상의 레벨 신호나 가장자리 신호를 상기 트리거 장치의 리셋 신호로 선택하는, 제3선택입력회로;
    출력이 상기 로우레벨 입력단과 연결되고, 상기 제n+1과 제n+4게이트극 라인의 제어를 받는 상황에서 게이트극 로우레벨 입력 또는 공용 전극 로우레벨 입력을 각각 상기 트리거 장치의 로우레벨 입력단으로 스트로브하여 그 압력을 끌어내리는, 제4선택입력회로;
    입력이 상기 트리거 출력단에 연결되고, 네 개의 동일 주기 비동기 작업의 클럭 펄스 중의 두 개 펄스 순차에서 출력 게이트극 구동 신호 또는 출력 공용 전극 구동신호를 선택하는, 선택 출력 회로;를 포함하는, 공동 구동 게이트극 및 공용 전극에 사용되는 GOA 유닛.
  2. 제1항에 있어서,
    상기 반전 컷오프 다이오드는 MOS관 또는 TFT관으로 구성된 다이오드 등가 회로로서, MOS관 또는 TFT관 게이트극은 소스극과 연결되어 상기 양극이 되고, 드레인극은 상기 음극이 되는, 공동 구동 게이트극 및 공용 전극에 사용되는 GOA 유닛.
  3. 제1항에 있어서,
    제n-1과 제n+2게이트극 라인 중의 레벨신호나 가장자리 신호는 로우레벨 신호 또는 하강 신호이고, 제n+1과 제n+4게이트극 라인 상의 레벨신호 또는 가장자리 신호는 하이레벨 신호 또는 상승신호인, 공동 구동 게이트극 및 공용 전극에 사용되는 GOA 유닛.
  4. 제1항에 있어서,
    네 개의 동일 주기 비동기 작업의 클럭 펄스 입력은 위상에 있어서 순차적으로 4분의 1 작업 주기의 차이가 나는, 공동 구동 게이트극 및 공용 전극에 사용되는 GOA 유닛.
  5. 제1항에 있어서,
    상기 GOA유닛 회로 출력의 공용 전극 구동 신호는 제n+3 게이트 라인상의 신호와 동기된, 공동 구동 게이트극 및 공용 전극에 사용되는 GOA 유닛.
  6. 제5항에 있어서,
    상기 제2선택입력회로는 네 개의 TFT트렌지스터를 포함하되, 두 개의 TFT트렌지스터의 소스, 드레인극은 서로 연결되고, 두 개의 게이트극은 각각 제2클럭펄스입력 및 제3클럭펄스입력으로 제어되며, 게이트극 하이레벨 입력을 엑세스하는데 이용되고,
    다른 두 개의 TFT트렌지스터의 소스, 드레인극이 서로 연결되고, 두 개의 게이트극은 각각 제1클럭펄스입력 및 제4클럭펄스입력으로 제어되며, 공용 전극 하이레벨 입력을 엑세스하는데 이용되는, 공동 구동 게이트극 및 공용 전극에 사용되는 GOA 유닛.
  7. 제5항에 있어서,
    상기 제4선택입력회로는 두 개의 TFT트렌지스터를 포함하되, 게이트극은 각각 제n+1 및 제n+4 게이트 라인의 출력과 연결되고, 소스극은 각각 게이트극 로우레벨 입력과 공용 전극 로우레벨 입력과 대응되어 연결되는, 공동 구동 게이트극 및 공용 전극에 사용되는 GOA 유닛.
  8. 제5항에 있어서,
    상기 선택 출력 회로는 두 개의 TFT트렌지스터를 포함하되, 두 개의 TFT트렌지스터의 게이트극은 각각 제3클럭펄스입력 및 제1클럭펄스입력으로 제어되며, 두 개의 소스극은 공동으로 트리거 출력단에 연결되어, 다른 순차로 각각 제n게이트 라인 출력과 제n+3공용 전극 라인 출력을 출력하되, 상기 두 개의 펄스 순차는 서로 4분의 3 작업주기의 차이가 나는, 공동 구동 게이트극 및 공용 전극에 사용되는 GOA 유닛.
  9. 제n-1과 제n+2게이트극 라인 출력은 각각 본급(本級) GOA유닛의 트리거 신호이고, 제n+1과 제n+4게이트극 라인 출력은 각각 본급 GOA 유닛의 리셋신호이며, 네 개의 클럭 라인은 각각 본급 GOA유닛의 제2선택입력회로상의 클럭펄스입력과 연결되어, 주기가 동일하나 위상이 다른 클럭신호를 제공하며, 다른 클럭펄스에서 게이트극 하이레벨 입력과 공용 전극 하이레벨 입력을 각각 스트로브하여 상응하는 풀업(pull-up) 전압을 출력하고,
    본급 GOA유닛의 출력은 제n게이트 라인 출력과 제n+3공용 전극 라인 출력인, 구동회로.
  10. 제9항에 있어서,
    상기 반전 컷오프 다이오드는 MOS관 또는 TFT관으로 구성된 다이오드 등가 회로로서, MOS관 또는 TFT관 게이트극은 소스극과 연결되어 양극이 되고, 드레인극은 음극이 되는, 구동회로.
  11. 제9항에 있어서,
    제n-1과 제n+2게이트극 라인 중의 레벨신호나 가장자리 신호는 로우레벨 신호 또는 하강 신호이고, 제n+1과 제n+4게이트극 라인 상의 레벨신호 또는 가장자리 신호는 하이레벨 신호 또는 상승신호인, 구동회로.
  12. 제9항에 있어서,
    네 개의 동일 주기 비동기 작업의 클럭 펄스 입력은 위상에 있어서 순차적으로 4분의 1 작업 주기의 차이가 나는, 구동회로.
  13. 제9항에 있어서,
    상기 GOA유닛 회로 출력의 공용 전극 구동 신호는 제n+3 게이트 라인상의 신호와 동기된, 구동회로.
  14. 제13항에 있어서,
    상기 제2선택입력회로는 네 개의 TFT트렌지스터를 포함하되, 두 개의 TFT트렌지스터의 소스, 드레인극은 서로 연결되고, 두 개의 게이트극은 각각 제2클럭펄스입력 및 제3클럭펄스입력으로 제어되며, 게이트극 하이레벨 입력을 엑세스하는데 이용되고,
    다른 두 개의 TFT트렌지스터의 소스, 드레인극이 서로 연결되고, 두 개의 게이트극은 각각 제1클럭펄스입력 및 제4클럭펄스입력으로 제어되며, 공용 전극 하이레벨 입력을 엑세스하는데 이용되는, 구동회로.
  15. 제13항에 있어서,
    상기 제4선택입력회로는 두 개의 TFT트렌지스터를 포함하되, 게이트극은 각각 제n+1 및 제n+4 게이트 라인의 출력과 연결되고, 소스극은 각각 게이트극 로우레벨 입력과 공용 전극 로우레벨 입력과 대응되어 연결되는, 구동회로.
  16. 제13항에 있어서,
    상기 선택 출력 회로는 두 개의 TFT트렌지스터를 포함하되, 두 개의 TFT트렌지스터의 게이트극은 각각 제3클럭펄스입력 및 제1클럭펄스입력으로 제어되며, 두 개의 소스극은 공동으로 트리거 출력단에 연결되어, 다른 순차로 각각 제n게이트 라인 출력과 제n+3공용 전극 라인 출력을 출력하되, 상기 두 개의 펄스 순차는 서로 4분의 3 작업주기의 차이가 나는, 구동회로.
  17. 제9항의 구동회로가 형성되는 어레이로서,
    횡방향으로 병렬된 게이트 라인 및 공용 전극 라인;
    종방향으로 병렬된 클럭입력 라인, 게이트극 하이/로우 레벨 입력 라인, 공용 전극 하이/로우 레벨 입력 라인을 포함하되,
    게이트 라인과 공용 전극 라인의 출력은 직렬 위치에서 서로 3개 급의 차이가 나거나, 또는 순차적으로 서로 4분의 3 작업 주기의 차이가 나는, 어레이.
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