RU2628188C1 - Микросхема goa для совместного возбуждения электрода затвора и общего электрода, схема возбуждения и матрица - Google Patents

Микросхема goa для совместного возбуждения электрода затвора и общего электрода, схема возбуждения и матрица Download PDF

Info

Publication number
RU2628188C1
RU2628188C1 RU2016130156A RU2016130156A RU2628188C1 RU 2628188 C1 RU2628188 C1 RU 2628188C1 RU 2016130156 A RU2016130156 A RU 2016130156A RU 2016130156 A RU2016130156 A RU 2016130156A RU 2628188 C1 RU2628188 C1 RU 2628188C1
Authority
RU
Russia
Prior art keywords
input
circuit
signals
output
gate
Prior art date
Application number
RU2016130156A
Other languages
English (en)
Inventor
Сянян СЮЙ
Original Assignee
Шэньчжэнь Чайна Стар Оптоэлектроникс Текнолоджи Ко., Лтд.
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Шэньчжэнь Чайна Стар Оптоэлектроникс Текнолоджи Ко., Лтд. filed Critical Шэньчжэнь Чайна Стар Оптоэлектроникс Текнолоджи Ко., Лтд.
Application granted granted Critical
Publication of RU2628188C1 publication Critical patent/RU2628188C1/ru

Links

Images

Classifications

    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611—Control of matrices with row and column drivers
    • G09G3/3674—Details of drivers for scan electrodes
    • G09G3/3677—Details of drivers for scan electrodes suitable for active matrices only
    • G—PHYSICS
    • G02—OPTICS
    • G02F—OPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133—Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/136—Liquid crystal cells structurally associated with a semi-conducting layer or substrate, e.g. cells forming part of an integrated circuit
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611—Control of matrices with row and column drivers
    • G09G3/3696—Generation of voltages supplied to electrode drivers
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C19/00—Digital stores in which the information is moved stepwise, e.g. shift registers
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C19/00—Digital stores in which the information is moved stepwise, e.g. shift registers
    • G11C19/28—Digital stores in which the information is moved stepwise, e.g. shift registers using semiconductor elements
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2300/00—Aspects of the constitution of display devices
    • G09G2300/08—Active matrix structure, i.e. with use of active elements, inclusive of non-linear two terminal elements, in the pixels together with light emitting or modulating elements
    • G09G2300/0809—Several active elements per pixel in active matrix panels
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2300/00—Aspects of the constitution of display devices
    • G09G2300/08—Active matrix structure, i.e. with use of active elements, inclusive of non-linear two terminal elements, in the pixels together with light emitting or modulating elements
    • G09G2300/0809—Several active elements per pixel in active matrix panels
    • G09G2300/0842—Several active elements per pixel in active matrix panels forming a memory circuit, e.g. a dynamic memory with one capacitor
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2310/00—Command of the display device
    • G09G2310/02—Addressing, scanning or driving the display screen or processing steps related thereto
    • G09G2310/0264—Details of driving circuits
    • G09G2310/0286—Details of a shift registers arranged for use in a driving circuit
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2310/00—Command of the display device
    • G09G2310/08—Details of timing specific for flat panels, other than clock recovery
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2320/00—Control of display operating conditions
    • G09G2320/02—Improving the quality of display appearance
    • G09G2320/0219—Reducing feedthrough effects in active matrix panels, i.e. voltage changes on the scan electrode influencing the pixel voltage due to capacitive coupling
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611—Control of matrices with row and column drivers
    • G09G3/3648—Control of matrices with row and column drivers using an active matrix
    • G09G3/3655—Details of drivers for counter electrodes, e.g. common electrodes for pixel capacitors or supplementary storage capacitors

Abstract

Изобретение предлагает микросхему GOA (gate driver on array) для совместного возбуждения электрода затвора и общего электрода дисплея с матрицей. Технический результат заключается в снижении проходного напряжения для повышения качества шкалы серого на дисплее. Микросхема включает пусковую схему, первую избирательную входную схему, вторую избирательную входную схему, которая используется для пропускания соответственно входного сигнала высокого уровня для общего электрода и входного сигнала высокого уровня для электрода затвора на выход синхронизации пусковой схемы в разные временные последовательности, чтобы поднять напряжение на выходном выводе пусковой схемы, третью избирательную входную схему, которая используется для выбора сигналов уровня или сигналов фронта на линии затворов n+1 и линии затворов n+4 в качестве сигнала на перезапуск пусковой схемы, четвертую избирательную входную схему, которая используется для того, чтобы понизить напряжение на ней, избирательную выходную схему, вход которой соединен с выходным выводом пусковой схемы, для избирательного вывода сигнала возбуждения электрода затвора или сигнала возбуждения общего электрода. 3 н. и 14 з.п. ф-лы, 7 ил.

Description

Область техники
Настоящее изобретение относится к технической области жидкокристаллических дисплеев и, в частности, к микросхеме GOA для совместного возбуждения электрода затвора и общего электрода, к схеме драйвера и к матрице.
Предпосылки для создания изобретения
Технология GOA, то есть "драйвера затворов на матрице", является технологией, согласно которой схемы драйверов затворов (ИС драйверов затворов) изготавливаются непосредственно на подложке матрицы (матрица), вместо того, чтобы монтировать на последней отдельную кремниевую пластину. В результате применения этой технологии схема драйвера затвора может быть изготовлена непосредственно на периферии панели, что уменьшает объем производственных операций и снижает себестоимость изделия. Помимо этого, еще больше повышается степень интеграции TFT-LCD панели, что еще больше уменьшает толщину панели.
Однако при двухуровневом возбуждении в разных проходных напряжениях преобладает проходное напряжение, генерируемое паразитной емкостью Cgd. Поэтому в случае двухуровневого возбуждения напряжение общего электрода необходимо регулировать, чтобы улучшить качество шкалы серого.
Когда общий электрод СОМ возбуждается постоянным током, проходное напряжение, подаваемое на Cgd, равно:
(Vg_high-Vg_low)*Cgd/(Cgd+Clc+Cs),
где Vg_high и Vg_low соответственно представляют напряжения для размыкания и замыкания металлических дорожек драйвера затвора, и Cgd, Clc и Cs соответственно являются паразитной емкостью тонкопленочного транзистора (ТПТ), емкостью жидкого кристалла и емкостью запоминающего конденсатора.
Поскольку проходное напряжение в основном вызвано снижением пиксельного напряжения при изменении напряжения затвора в случае замыкания ТПТ посредством паразитной емкости Cgd. Независимо от того, является ли пиксельное напряжение положительным или отрицательным, проходное напряжение всегда будет понижать пиксельное напряжение до отрицательного.
В известном уровне техники воздействие проходного напряжения можно уменьшить путем компенсации напряжения общего электрода. Но, поскольку емкость жидкого кристалла Clc не является фиксированным параметром, воздействие проходного напряжения нельзя устранить, регулируя напряжение возбуждения общего электрода, так что задачу улучшения качества изображения трудно выполнить.
В настоящее время есть необходимость предложить простую и осуществимую конструкцию микросхемы GOA для снижения и даже устранения проходного напряжения, чтобы повысить качество шкалы серого на дисплее.
Раскрытие изобретения
Для выполнения вышеуказанных технических задач настоящее изобретение предлагает микросхему GOA для совместного возбуждения электрода затвора и общего электрода, которая включает:
пусковую схему, включающую входной вывод, выход синхроимпульсов, выход сигналов на перезапуск, входной вывод сигналов низкого уровня и выходной вывод пусковой схемы;
первую избирательную входную схему, включающую два обратных отключающих диода, соединенных параллельно, при этом аноды этих диодов соответственно соединены с выходами линии затворов n-1 и линии затворов n+2, и катоды диодов используются в качестве выходов для соединения с входным выводом, чтобы выбирать сигналы уровня или сигналы фронта в линии затворов n-1 и линии затворов n+2 в качестве сигнала входного воздействия пусковой схемы;
вторую избирательную входную схему, выход которой соединен с выводом синхронизации, включающую четыре входа для синхроимпульсов, которые имеют один и тот же цикл, но работают асинхронно, вход высокого уровня для общего электрода и вход высокого уровня для электрода затвора, чтобы соответственно пропускать входной сигнал высокого уровня для общего электрода и входной сигнал высокого уровня для электрода затвора на выход синхроимпульсов пусковой схемы при разных временных последовательностях, чтобы поднять напряжение на выходном выводе пусковой схемы;
третью избирательную входную схему, включающую два обратных отключающих диода, соединенных параллельно, при этом аноды этих диодов соответственно соединены с выходами линии затворов n+1 и линии затворов n+4, и катоды диодов используются в качестве выходов для соединения с выходом перезапуска, чтобы выбирать сигналы уровня или сигналы фронта на линии затворов n+1 и линии затворов n+4 в качестве сигнала на перезапуск пусковой схемы;
четвертую избирательную входную схему, выход которой соединен с входным выводом низкого уровня, для пропускания соответственно входного сигнала низкого уровня для затвора или входного сигнала низкого уровня для общего электрода на входной вывод низкого уровня пусковой схемы под управлением сигналов на линии затворов n+1 и линии затворов n+4, чтобы понизить напряжение на ней;
избирательную выходную схему, вход которой соединен с выходным выводом пусковой схемы, для избирательного вывода сигнала возбуждения затвора или сигнала возбуждения общего электрода в двух из четырех последовательности синхроимпульсов, имеющих один и тот же цикл и работающих асинхронно. Эти две последовательности импульсов имеют разницу в 3/4 рабочего цикла.
Согласно одному варианту осуществления настоящего изобретения каждый обратный отключающий диод является схемой, эквивалентной диоду, состоящему из МОП-транзистора или ТПТ-транзистора, причем затвор МОП-транзистора или ТПТ-транзистора соединен с его истоком, чтобы служить в качестве анода, и сток используется в качестве катода.
Согласно одному варианту осуществления настоящего изобретения сигналы уровня или сигналы фронта в линии затворов n-1 и линии затворов n+2 являются сигналами низкого уровня или сигналами заднего фронта, и сигналы уровня или сигналы фронта на линии затворов n+1 и линии затворов n+4 являются сигналами высокого уровня или сигналами переднего фронта.
Согласно одному варианту осуществления настоящего изобретения четыре входа для синхроимпульсов, имеющие один и тот же цикл и работающие асинхронно, последовательно отличаются по фазе на 1/4 рабочего цикла.
Согласно одному варианту осуществления настоящего изобретения выходной возбуждающий сигнал для общего электрода микросхемы GOA синхронизируется с сигналом на линии затворов n+3.
Согласно одному варианту осуществления настоящего изобретения вторая избирательная входная схема включает четыре ТПТ-транзистора, у которых истоки и стоки двух ТПТ-транзисторов соединены, и два затвора работают под управлением соответственно второго входа для синхроимпульсов и третьего входа для синхроимпульсов для введения входного сигнала высокого уровня для электрода затвора;
истоки и стоки двух других ТПТ-транзисторов соединены, и два затвора работают под управлением соответственно первого входа для синхронизирующих импульсов и четвертого входа для синхроимпульсов, для введения входного сигнала высокого уровня для общего электрода.
Согласно одному варианту осуществления настоящего изобретения четвертая избирательная входная схема включает два ТПТ-транзистора, затворы которых соединены соответственно с выходами линий затворов n+1 и n+4, и истоки соединены соответственно с входным сигналом низкого уровня для затвора и входным сигналом низкого уровня для общего электрода.
Согласно одному варианту осуществления настоящего изобретения избирательная выходная схема включает два ТПТ-транзистора, два затвора которых работают под управлением соответственно третьего входа для синхроимпульсов и первого входа для синхроимпульсов, и два истока вместе соединены с выходным выводом пусковой схемы, чтобы соответственно выводить сигналы линии затворов n и линии общего электрода n+3 при разных временных последовательностях.
Согласно одному аспекту настоящего изобретения также предложена схема возбуждения для панели дисплея, включающая некоторое число любых из вышеописанных микросхем GOA, причем микросхемы GOA расположены каскадом в следующем порядке:
выходные сигналы линий затворов n-1 и n+2 используются соответственно в качестве сигналов для пусковой схемы для этого уровня микросхем GOA; выходные сигналы линий затворов n+1 и n+4 используются соответственно в качестве сигналов на перезапуск для этого уровня микросхем GOA; четыре линии синхронизации соединены соответственно с входами для синхронизирующих импульсов второй избирательной входной схемы для этого уровня микросхем GOA, чтобы подавать синхроимпульсы в одном цикле, но в разной фазе; и входной сигнал высокого уровня для электрода затвора и входной сигнал высокого уровня для общего электрода вводятся соответственно при разных синхроимпульсах, чтобы выводить разные повышающие напряжения;
причем выходные сигналы микросхем GOA этого уровня включают выходные сигналы линии затворов n и линии общего электрода n+3.
Согласно еще одному аспекту настоящего изобретения также предложена матрица с размещенной на ней схемой возбуждения, которая описана выше, причем матрица включает:
линии затворов и линию общего электрода, которые расположены параллельно в поперечном направлении; и
линию входных сигналов синхронизации, линию входных сигналов высокого и низкого уровней для затворов и линию входных сигналов высокого и низкого уровней для общего электрода, которые расположены параллельно в продольном направлении, причем соответствующие параллельные выходы линии затворов и линии общего электрода имеют разницу в имеют разницу в три уровня в каскадном расположении или в 3/4 рабочего цикла на временной последовательности.
Согласно настоящему изобретению, поскольку выходной сигнал напряжения СОМ (для общего электрода) синхронизируется с выходным сигналом GATE (для затворов), и изменение напряжения прямо противоположно напряжению затворов по направлению, происходит эффективное противодействие проходному напряжению, за счет чего улучшается качество шкалы серого дисплея.
Другие признаки и преимущества настоящего изобретения будут изложены ниже в описании и станут частично очевидными из описания или будут поняты при реализации настоящего изобретения. Цели и другие преимущества настоящего изобретения могут быть достигнуты и получены в конструкциях, конкретно указанных в описании, пунктах формулы изобретения и на прилагаемых чертежах.
Краткое описание чертежей
Прилагаемые чертежи предназначены для более глубокого понимания настоящего изобретения являются частью описания и служат для объяснения настоящего изобретения вместе с примерами осуществления настоящего изобретения, но не ограничивают настоящее изобретение. На прилагаемых чертежах:
Фиг. 1 - форма волны напряжения возбуждения общего электрода постоянным током из известного уровня техники, при этом запоминающая емкость Cs (Cs на Com) выполнена на общем электроде;
Фиг. 2 - принципиальная схема микросхемы GOA из известного уровня техники;
Фиг. 3 - схема каскадного расположения микросхем GOA для формирования двухуровневого возбуждения затворов из известного уровня техники;
Фиг. 4 - последовательность импульсов схемы драйвера затворов из известного уровня техники;
Фиг. 5 - формы волны напряжения, разрешающей схеме возбуждения общего электрода синхронизироваться со схемой возбуждения затворов согласно одному аспекту настоящего изобретения;
Фиг. 6 - принципиальная схема микросхемы GOA, интегрирующей выходной сигнал возбуждения общего электрода согласно одному варианту осуществления настоящего изобретения; и
Фиг. 7 - схема последовательности импульсов возбуждения, генерируемых каскадными схемами возбуждения согласно идее настоящего изобретения.
Подробное описание вариантов осуществления
Варианты осуществления настоящего изобретения будут подробно объяснены ниже в связи с прилагаемыми чертежами и примерами. Поэтому процесс использования технических средств настоящего изобретения для решения стоящих технических задач и достижения технического результата, может быть полностью понят и соответственно реализован. Следует сказать, что при отсутствии противоречия варианты осуществления настоящего изобретения и разные признаки из приведенных примеров могут быть объединены между собой, но полученные таким образом технические решения подпадают под объем охраны настоящего изобретения.
На Фиг. 1 - Фиг. 4 показана схема драйвера GOA из известного уровня техники и генерируемая ей последовательность импульсов. Можно видеть, что напряжение на общем электроде СОМ является напряжением постоянного тока. Импульсы напряжения на линиях затворов (Gate 1, Gate 2, Gate 3, …,) появляются последовательно под действием двух последовательностей синхроимпульсов в противофазе. Время сканирования всех линий затворов является длиной фрейма, который также является циклом импульсов на линиях затворов. Поскольку управление пусковой схемой реализуется двумя синхроимпульсами в противофазе, длительность положительного импульса на каждой линии затворов равна длительности синхроимпульса.
Также на Фиг. 1 показаны формы волны напряжения на каждой линии в один и тот же момент времени, где 101 - импульс напряжения возбуждения затвора, 102 - импульс напряжения возбуждения истока, 103 - напряжение на электроде пикселя и 104 - разница между напряжением истока и напряжением пикселя, причем эта разница равна проходному напряжению. Для того, чтобы устранить проходное напряжение, исходное напряжение СОМ 106 может быть скорректировано, и скорректированное напряжение СОМ обозначено числом 107. Эта коррекция равна значению проходного напряжения. Однако скорректировать исходное напряжение на общем электроде СОМ, который возбуждается постоянным током, трудно.
В известном уровне техники, как показано на Фиг. 3, схема возбуждения состоит их микросхем GOA, расположенных на одной стороне. Эти микросхемы GOA расположены каскадом, чтобы сформировать последовательность импульсов, которая показана на Фиг. 4, на их выходах. На Фиг. 2 также показана подробная принципиальная схема микросхемы GOA.
Как показано на Фиг. 2, микросхема GOA по существу является пусковой схемой. Она включает четыре переключающих ТПТ-транзистора (TFT) и один конденсатор, причем TFT1 является переключающим транзистором возбуждения, TFT2 и TFT3 - переключающими транзисторами перезапуска, и TFT4 - переключающим транзистором предварительной зарядки. Cb является конденсатором удержания напряжения TFT1, управляемым в основном транзистором TFT4. Традиционные возбуждающие микросхемы GOA должны иметь четыре управляющих сигнала, т.е., синхронизирующий сигнал Clk, входной сигнал, сигнал перезагрузки Reset и выходной сигнал низкого уровня Vss для затвора. Синхронизирующий сигнал является повышающим выходным сигналом с линии затворов.
На Фиг. 3 показана принципиальная схема микросхем GOA каскадного расположения для формирования одностороннего двухуровневого возбуждения затворов из известного уровня техники. Выходной сигнал предыдущей микросхемы GOA используется в качестве сигнала пусковой схемы для следующей микросхемы GOA, и выходной сигнал этой следующей микросхемы GOA используется в качестве сигнала перезапуска этой микросхемы GOA. Применяются два сигнала синхронизации (Vclk_A, Vclk_B), которые используются соответственно для микросхем GOA в нечетных рядах и микросхем GOA в четных рядах. Выходное напряжение на линии затворов Vss определяет высоту или амплитуду выходного импульса на линии затворов.
Как сказано выше, при этом напряжение общего электрода СОМ не регулируется, так что проходное напряжение не устраняется.
Ниже в настоящем описании изобретения будет объяснено, как регулировать напряжение СОМ в свете вышеупомянутого принципа. Как сказано выше, известно необходимое изменение напряжения СОМ, которое эквивалентно проходному напряжению. Поэтому получается временная последовательность, показанная на Фиг. 5. Подобно Фиг. 1, обозначение 501 представляет импульс напряжения возбуждения затвора, 502 - импульс напряжения возбуждения истока, 503 - напряжение на электроде пикселя, и 506 представляет сигнал возбуждения напряжения СОМ. На этой фигуре можно видеть, что в данном случае проходное напряжение теоретически полностью устраняется за счет изменения напряжения СОМ.
Согласно этой концепции может быть разработана схема возбуждения GOA. Основная микросхема GOA схемы возбуждения GOA показана на Фиг. 6.
Выходной сигнал микросхемы GOA используется для совместного возбуждения затвора и общего электрода. Схема состоит в основном из пусковой схемы 602 и некоторых периферических схем. Пусковая схема включает входной вывод 1, выход синхронизации 2, вывод перезапуска 3, входной вывод низкого уровня 4 и выходной вывод пусковой схемы 5.
Для того, чтобы разрешить пусковой схеме осуществлять совместное возбуждение общего электрода и возбуждение затвора, микросхема GOA также включает первую избирательную входную схему 603, которая включает два обратных отключающих диода, соединенных параллельно. Аноды диодов соединены соответственно с выходами G[n-1] и G[n+2] линий затворов n-1 и n+2, и катоды диодов используются в качестве выходов для соединения с входным выводом 1, чтобы выбирать сигналы уровня или сигналы фронта G[n-1] и G[n+2] с линий затворов n-1 и n+2 в качестве сигнала входного воздействия пусковой схемы 602.
Как показано на Фиг. 6, микросхема GOA также включает третью избирательную входную схему 604. Эта схема состоит из двух обратных отключающих диодов, также соединенных параллельно, при этом, подобно сказанному выше, аноды диодов соединены соответственно с выходами G[n+1] и G[n+4] линий затворов n+1 и n+4, и катоды диодов используются в качестве выходов для соединения с выходом перезапуска 3, чтобы выбирать сигналы уровня или сигналы фронта G[n+1] и G[n+4] с линий затворов n+1 и n+4 в качестве сигнала на перезапуск пусковой схемы 602.
В настоящем изобретении, как показано на Фиг. 6, сигналы уровня или сигналы фронта в линиях затворов n-1 и n+2, G[n-1] и G[n+2], являются сигналами низкого уровня или сигналами заднего фронта, и сигналы уровня или сигналы фронта на линиях затворов n+1 и n+4, G[n+1] и G[n+4], являются сигналами высокого уровня или сигналами переднего фронта.
На Фиг. 6 все диоды применяют эквивалентные схемы, состоящие из ТПТ-транзисторов, например, Т9-Т12, при этом затворы и истоки ТПТ-транзисторов соединены, чтобы служить в качестве анодов, и стоки используются в качестве катодов. Конечно, настоящее изобретение этим не ограничено, например, в эквивалентной схеме могут быть также применены МОП-транзисторы.
Микросхема GOA настоящего изобретения включает вторую избирательную входную схему 601. Выход второй избирательной входной схемы 601 соединен с выводом синхронизации 2 пусковой схемы, может включать четыре ввода синхроимпульсов ClkA, ClkB, ClkC, ClkD, имеющих один и тот же цикл и работающих асинхронно, вход высокого уровня Com_2 для общего электрода и вход высокого уровня Vgh для электрода затвора, и используется соответственно для пропускания входного сигнала высокого уровня для общего электрода Com_2 и входного сигнала высокого уровня Vgh для электрода затвора на выход синхронизации 2 пусковой схемы 602 при разных временных последовательностях, чтобы далее поднять напряжение на выходном выводе пусковой схемы 5, и сформировать выходной импульс высокого уровня для сканирования затворов на уровне n или импульс высокого уровня общего электрода на уровне n+3.
Более конкретно, вторая избирательная входная схема 601 в одном варианте осуществления может включать четыре ТПТ-транзистора, при этом истоки и стоки двух ТПТ-транзисторов Т5, Т6 соединены, и два затвора работают под управлением соответственно второго входа для синхроимпульса ClkB и третьего входа для синхроимпульса ClkC, чтобы получить доступ к входному сигналу высокого уровня для электрода затвора. Истоки и стоки двух других ТПТ-транзисторов Т7, Т8 соединены, и два затвора работают под управлением соответственно первого входа для синхроимпульса ClkA и четвертого входа для синхроимпульса ClkD, чтобы получить доступ к входному сигналу высокого уровня для общего электрода.
Предпочтительно четыре входа для синхронизирующих импульсов ClkA, ClkB, ClkC, ClkD, имеющие один и тот же цикл и работающие асинхронно, последовательно отличаются на 1/4 рабочего цикла по фазе. Таким образом, длительность выходного импульса линии затворов и длительность импульса линии общего электрода равны 1/2 длительности синхроимпульса.
Помимо этого, микросхема GOA также включает четвертую избирательную входную схему 605, выход которой соединен с входным выводом низкого уровня 4, для пропускания соответственно входного сигнала низкого уровня для затвора или входного сигнала низкого уровня для общего электрода на входной вывод низкого уровня 4 пусковой схемы 602 под управлением выходных сигналов G[n+1] и G[n+4] линий затворов n+1 и n+4, чтобы понизить напряжение на ней и сформировать низкий уровень выходного импульса сканирования затворов на уровне n или импульс низкого уровня общего электрода на уровне n+3.
В одном варианте осуществления четвертая избирательная входная схема 605 предпочтительно включает два ТПТ-транзистора Т13, Т14, причем их затворы соединены соответственно с выходами G[n+1] и G[n+4] линий затворов n+1 и n+4, и истоки соединены соответственно с входным сигналом низкого уровня для затвора Vss и входным сигналом низкого уровня для общего электрода Com_1.
Вход избирательной выходной схемы 606 микросхемы GOA соединен с выходным выводом пусковой схемы 5 для избирательного вывода сигнала возбуждения затвора или сигнала возбуждения общего электрода при двух временных последовательностях импульсов на четырех входах для синхронизирующих импульсов, имеющих один и тот же цикл и работающих асинхронно. Два импульса имеют разницу в 3/4 рабочего цикла, так что сигнал возбуждения затвора появляется раньше чем сигнал возбуждения общего электрода при трех длительностях импульсов линий затворов.
Как показано на Фиг. 6, сигнал возбуждения общего электрода С[n+3], выводимый микросхемой GOA на уровне n синхронизирован с сигналом G[n+3] на линии затворов n+3.
В одном варианте осуществления избирательная выходная схема 606 предпочтительно включает два ТПТ-транзистора Т15, Т16, при этом два затвора работают соответственно под управлением третьего входа для синхроимпульсов ClkC и первого входа для синхроимпульсов ClkA, и два истока вместе соединены с выходным выводом пусковой схемы 5, чтобы соответственно выводить выходной сигнал G[n] линии затворов n и выходной сигнал С[n+3] линии общего электрода n+3 при разных временных последовательностях.
На Фиг. 7 показана схема последовательности возбуждающих импульсов, генерируемых каскадными схемами возбуждения, согласно идее настоящего изобретения.
На этой фигуре можно видеть, что четыре входа для синхроимпульсов, имеющих один и тот же цикл и работающих асинхронно, последовательно отличаются на 1/4 рабочего цикла по фазе. Когда импульс появляется на линии затворов Gate1, импульс появляется на Com1, чем достигается синхронная работа по возбуждению затвора и возбуждению общего электрода.
Согласно одному аспекту настоящего изобретения также предложена схема возбуждения для панели дисплея, включающая некоторое множество вышеупомянутых микросхем GOA, при этом микросхемы GOA расположены каскадно в следующем порядке.
Выходной сигнал G[n-1] линии затворов n-1 и выходной сигнал G[n+2] линии затворов n+2 используются соответственно в качестве сигналов для пусковой схемы на этом уровне микросхем GOA, и выходной сигнал G[n+1] линии затворов n+1 и выходной сигнал G[n+4] линии затворов n+4 используются соответственно в качестве сигналов на перезапуск микросхем GOA этого уровня, четыре линии синхронизации соединены соответственно с входами для синхроимпульсов ClkA, ClkB, ClkC, ClkD на второй избирательной входной схеме микросхем GOA этого уровня, чтобы подавать сигналы синхронизации, имеющие один и тот же цикл, но разницу по фазе, и входной сигнал высокого уровня для затвора и входной сигнал высокого уровня для общего электрода пропускаются соответственно при разных синхронизирующих импульсах, чтобы выводить разные повышающие напряжения, при этом выходным сигналом микросхемы GOA на этом уровне является выходной сигнал G[n] линии затворов n и выходной сигнал С[n+3] линии общего электрода n+3.
Настоящее изобретение также предлагает подложку матрицы с выполненной на ней вышеописанной схемой возбуждения, включающей линию затворов и линию общего электрода, которые параллельны в поперечном направлении, и линию входных сигналов синхронизации, линию входных сигналов высокого и низкого уровней для затворов и линию входных сигналов высокого и низкого уровней для общего электрода, которые параллельны в продольном направлении, при этом выходные сигналы линии затворов и линии общего электрода имеют разницу в 3 рабочих цикла в каскадных положениях или 3/4 рабочего цикла на временной последовательности.
Хотя выше описаны варианты осуществления, они являются просто вариантами осуществления для облегчения понимания настоящего изобретения, а не для ограничения настоящего изобретения. Любые изменения или альтернативные решения, которые будут очевидны для специалистов в данной области техники после ознакомления с настоящим описанием, будут подпадать под объем настоящего изобретения. Соответственно, объем настоящего изобретения будет определяться прилагаемой формулой изобретения.

Claims (30)

1. Микросхема GOA для совместного возбуждения электрода затвора и общего электрода, включающая:
пусковую схему, имеющую входной вывод, выход синхронизации, вывод перезапуска, входной вывод низкого уровня и выходной вывод пусковой схемы;
первую избирательную входную схему, включающую два обратных отключающих диода, соединенных параллельно, при этом аноды этих диодов соединены соответственно с выходами линии затворов n-1 и линии затворов n+2 и катоды диодов используются в качестве выходов для соединения с входным выводом, чтобы выбирать сигналы уровня или сигналы фронта на линии затворов n-1 и линии затворов n+2 в качестве сигнала входного воздействия пусковой схемы;
вторую избирательную входную схему, выход которой соединен с выходом синхронизации, включающую четыре входа для синхронизирующих импульсов, которые имеют один и тот же цикл, но работают асинхронно, вход высокого уровня для общего электрода и вход высокого уровня для электрода затвора, чтобы пропускать соответственно входной сигнал высокого уровня для общего электрода и входной сигнал высокого уровня для электрода затвора на выход синхронизации пусковой схемы в разных временных последовательностях, чтобы поднять напряжение на выходном выводе пусковой схемы;
третью избирательную входную схему, включающую два обратных отключающих диода, соединенных параллельно, при этом аноды этих диодов соединены соответственно с выходами линии затворов n+1 и линии затворов n+4 и катоды диодов используются в качестве выходов для соединения с выходом перезапуска, чтобы выбирать сигналы уровня или сигналы фронта на линии затворов n+1 и линии затворов n+4 в качестве сигнала на перезапуск пусковой схемы;
четвертую избирательную входную схему, выход которой соединен с входным выводом низкого уровня для пропускания соответственно входного сигнала низкого уровня для затвора и входного сигнала низкого уровня для общего электрода на входной вывод низкого уровня пусковой схемы под управлением сигналов на линии затворов n+1 и линии затворов n+4, чтобы понизить напряжение на ней; и
избирательную выходную схему, вход которой соединен с выходным выводом пусковой схемы для избирательной подачи сигнала возбуждения электрода затвора или сигнала возбуждения общего электрода в двух из четырех последовательностей синхронизирующих импульсов, имеющих один и тот же цикл и работающих асинхронно.
2. Микросхема GOA по п. 1, отличающаяся тем, что обратный отключающий диод является схемой, эквивалентной диоду, состоящей из МОП-транзистора или ТПТ транзистора, причем затвор МОП-транзистора или ТПТ-транзистора соединен с его истоком, чтобы служить в качестве анода, и сток используется в качестве катода.
3. Микросхема GOA по п. 1, отличающаяся тем, что сигналы уровня или сигналы фронта в линии затворов n-1 и линии затворов n+2 являются сигналами низкого уровня или сигналами заднего фронта и сигналы уровня или сигналы фронта на линии затворов n+1 и линии затворов n+4 являются сигналами высокого уровня или сигналами переднего фронта.
4. Микросхема GOA по п. 1, отличающаяся тем, что четыре входа для синхронизирующих импульсов, имеющих один и тот же цикл и работающих асинхронно, отличаются друг от друга в последовательности на 1/4 рабочего цикла по фазе.
5. Микросхема GOA по п. 1, отличающаяся тем, что сигнал возбуждения общего электрода, выводимый микросхемой GOA, синхронизирован с сигналом на линии затворов n+3.
6. Микросхема GOA по п. 5, отличающаяся тем, что вторая избирательная входная схема включает четыре ТПТ-транзистора,
при этом истоки и стоки двух ТПТ-транзисторов соединены друг с другом и два затвора работают под управлением соответственно второго входа для синхронизирующих импульсов и третьего входа для синхронизирующих импульсов для введения входного сигнала высокого уровня для электрода затвора; и истоки и стоки двух других ТПТ-транзисторов соединены друг с другом и два затвора работают под управлением соответственно первого входа для синхронизирующих импульсов и четвертого входа для синхронизирующих импульсов для введения входного сигнала высокого уровня для общего электрода.
7. Микросхема GOA по п. 5, отличающаяся тем, что четвертая избирательная входная схема включает два ТПТ-транзистора, затворы которых соединены соответственно с выходами линий затворов n+1 и n+4 и истоки которых соединены соответственно с входным сигналом низкого уровня для затвора и входным сигналом низкого уровня для общего электрода.
8. Микросхема GOA по п. 5, отличающаяся тем, что избирательная выходная схема включает два ТПТ-транзистора, два затвора которых работают под управлением соответственно третьего входа для синхроимпульсов и первого входа для синхроимпульсов и два истока которых вместе соединены с выходным выводом пусковой схемы, чтобы выводить соответственно сигналы линии затворов n и линии общего электрода n+3 в разные временные последовательности, при этом эти две последовательности импульсов имеют разницу в 3/4 рабочего цикла.
9. Схема для возбуждения панели дисплея, включающая некоторое множество микросхем GOA по п. 1, отличающаяся тем, что микросхемы GOA расположены каскадом в следующем порядке:
выходные сигналы линий затворов n-1 и n+2 используются соответственно в качестве сигналов пусковой схемы для этого уровня микросхем GOA, выходные сигналы линий затворов n+1 и n+4 используются соответственно в качестве сигналов на перезапуск для микросхем GOA этого уровня и четыре линии синхронизации соединены соответственно с входами для синхроимпульсов на второй избирательной входной схеме этого уровня микросхем GOA, чтобы подавать синхронизирующие сигналы с одним циклом, но в разных фазах, и входной сигнал высокого уровня для электрода затвора и входной сигнал высокого уровня для общего электрода вводятся соответственно при разных синхронизирующих импульсах, чтобы выводить разные повышающие напряжения;
при этом выходные сигналы для этого уровня микросхем GOA включают выходные сигналы линии затворов n и линии общего электрода n+3.
10. Схема по п. 9, отличающаяся тем, что обратный отключающий диод является схемой, эквивалентной диоду, состоящему из МОП-транзистора или ТПТ транзистора, причем затвор МОП-транзистора или ТПТ-транзистора соединен с его истоком, чтобы служить в качестве анода, и сток используется в качестве катода.
11. Схема по п. 9, отличающаяся тем, что сигналы уровня или сигналы фронта в линии затворов n-1 и линии затворов n+2 являются сигналами низкого уровня или сигналами заднего фронта и сигналы уровня или сигналы фронта на линии затворов n+1 и линии затворов n+4 являются сигналами высокого уровня или сигналами переднего фронта.
12. Схема по п. 9, отличающаяся тем, что четыре входа для синхронизирующих импульсов, имеющих один и тот же цикл и работающих асинхронно, отличаются друг от друга в последовательности на 1/4 рабочего цикла по фазе.
13. Схема по п. 9, отличающаяся тем, что сигнал возбуждения общего электрода, выводимый микросхемой GOA, синхронизирован с сигналом на линии затворов n+3.
14. Схема по п. 13, отличающаяся тем, что вторая избирательная входная схема включает четыре ТПТ-транзистора, при этом истоки и стоки двух ТПТ-транзисторов соединены друг с другом и два затвора работают под управлением соответственно второго входа для синхронизирующих импульсов и третьего входа для синхронизирующих импульсов для введения входного сигнала высокого уровня для электрода затвора; и
истоки и стоки двух других ТПТ-транзисторов соединены друг с другом, и эти два затвора работают под управлением соответственно первого входа для синхронизирующих импульсов и четвертого входа для синхронизирующих импульсов для введения входного сигнала высокого уровня для общего электрода.
15. Схема по п. 13, отличающаяся тем, что четвертая избирательная входная схема включает два ТПТ-транзистора, причем их затворы соединены соответственно с выходами линий затворов n+1 и n+4 и истоки соединены соответственно с входным сигналом низкого уровня для затвора и входным сигналом низкого уровня для общего электрода.
16. Схема по п. 13, отличающаяся тем, что избирательная выходная схема включает два ТПТ-транзистора, два затвора которых работают под управлением соответственно третьего входа для синхроимпульсов и первого входа для синхроимпульсов, и два истока которых вместе соединены с выходным выводом пусковой схемы, чтобы выводить соответственно сигналы линии затворов n и линии общего электрода n+3 в разные временные последовательности, при этом эти две последовательности импульсов имеют разницу в 3/4 рабочего цикла.
17. Матрица с размещенной на ней схемой по п. 9, включающая:
линию затворов и линию общего электрода, которые расположены параллельно в поперечном направлении; и
линию входных сигналов синхронизации, линию входных сигналов высокого и низкого уровней для затворов и линию входных сигналов высокого и низкого уровней для общего электрода, которые расположены параллельно в продольном направлении,
при этом соответствующие выходы линии затворов и линии общего электрода имеют разницу в три уровня в смысле каскадного расположения, или в 3/4 рабочего цикла на временной последовательности.
RU2016130156A 2014-01-27 2014-02-20 Микросхема goa для совместного возбуждения электрода затвора и общего электрода, схема возбуждения и матрица RU2628188C1 (ru)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
CN201410040824.1 2014-01-27
CN201410040824.1A CN103928005B (zh) 2014-01-27 2014-01-27 用于共同驱动栅极和公共电极的goa单元、驱动电路及阵列
PCT/CN2014/072288 WO2015109624A1 (zh) 2014-01-27 2014-02-20 用于共同驱动栅极和公共电极的goa单元、驱动电路及阵列

Publications (1)

Publication Number Publication Date
RU2628188C1 true RU2628188C1 (ru) 2017-08-15

Family

ID=51146206

Family Applications (1)

Application Number Title Priority Date Filing Date
RU2016130156A RU2628188C1 (ru) 2014-01-27 2014-02-20 Микросхема goa для совместного возбуждения электрода затвора и общего электрода, схема возбуждения и матрица

Country Status (7)

Country Link
US (1) US9767750B2 (ru)
JP (1) JP6325676B2 (ru)
KR (1) KR101937403B1 (ru)
CN (1) CN103928005B (ru)
GB (1) GB2535936B (ru)
RU (1) RU2628188C1 (ru)
WO (1) WO2015109624A1 (ru)

Families Citing this family (32)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN103474040B (zh) * 2013-09-06 2015-06-24 合肥京东方光电科技有限公司 栅极驱动单元、栅极驱动电路和显示装置
KR20160021942A (ko) * 2014-08-18 2016-02-29 삼성디스플레이 주식회사 표시 장치 및 이의 구동 방법
CN104867439B (zh) * 2015-06-24 2017-04-05 合肥京东方光电科技有限公司 移位寄存器单元及其驱动方法、栅极驱动电路及显示装置
KR102436255B1 (ko) * 2015-12-30 2022-08-26 삼성디스플레이 주식회사 표시 장치
CN105957480B (zh) * 2016-06-13 2018-09-28 深圳市华星光电技术有限公司 栅极驱动电路及液晶显示装置
CN106023940B (zh) * 2016-07-29 2018-07-17 武汉华星光电技术有限公司 一种两级单mos管goa扫描驱动电路及显示面板
KR101882435B1 (ko) * 2016-10-05 2018-08-24 실리콘 디스플레이 (주) 시프트 레지스터
CN108022560B (zh) * 2016-11-01 2023-10-10 合肥鑫晟光电科技有限公司 栅极驱动电路及其驱动方法、显示基板和显示装置
US10424266B2 (en) * 2016-11-30 2019-09-24 Lg Display Co., Ltd. Gate driving circuit and display device using the same
CN106782389A (zh) * 2016-12-30 2017-05-31 武汉华星光电技术有限公司 一种阵列基板行驱动电路
CN106710508B (zh) * 2017-02-17 2020-07-10 京东方科技集团股份有限公司 移位寄存器、栅线驱动方法、阵列基板和显示装置
CN106782287B (zh) * 2017-03-09 2019-08-30 深圳市华星光电半导体显示技术有限公司 具有电荷共享的扫描驱动电路及显示面板
CN108694916B (zh) * 2017-04-12 2020-06-02 京东方科技集团股份有限公司 移位寄存器单元、栅线驱动电路及其驱动方法
CN106875911B (zh) 2017-04-12 2019-04-16 京东方科技集团股份有限公司 移位寄存器单元、栅极驱动电路及其驱动方法
CN106971697A (zh) * 2017-05-16 2017-07-21 昆山龙腾光电有限公司 显示装置
CN107221280B (zh) * 2017-07-04 2018-01-30 深圳市华星光电半导体显示技术有限公司 扫描驱动电路及显示装置
US10460671B2 (en) 2017-07-04 2019-10-29 Shenzhen China Star Optoelectronics Semiconductor Display Technology Co., Lltd Scanning driving circuit and display apparatus
CN107633829B (zh) * 2017-09-27 2020-03-10 京东方科技集团股份有限公司 一种复位电路、移位寄存器及其驱动方法、显示装置
CN107578741B (zh) * 2017-09-28 2020-03-27 京东方科技集团股份有限公司 移位寄存器单元及其驱动方法、栅极驱动电路、显示装置
CN107481659B (zh) * 2017-10-16 2020-02-11 京东方科技集团股份有限公司 栅极驱动电路、移位寄存器及其驱动控制方法
CN107919100B (zh) * 2018-01-04 2020-10-13 深圳市华星光电技术有限公司 一种栅极驱动电路及液晶显示器
CN109147630A (zh) * 2018-09-25 2019-01-04 武汉华星光电半导体显示技术有限公司 一种goa检测电路及其测试方法
CN109461414B (zh) * 2018-11-09 2020-11-06 惠科股份有限公司 一种显示装置的驱动电路及方法
TWI684974B (zh) * 2018-12-27 2020-02-11 友達光電股份有限公司 顯示裝置
CN109599405B (zh) 2019-01-02 2021-04-06 京东方科技集团股份有限公司 阵列基板、显示面板、显示装置及相关方法
CN111971746A (zh) * 2019-03-01 2020-11-20 京东方科技集团股份有限公司 移位寄存器及其驱动方法、以及栅极驱动电路
CN110007628B (zh) * 2019-04-10 2022-02-01 深圳市华星光电半导体显示技术有限公司 Goa电路及显示面板
CN110264940B (zh) * 2019-07-16 2020-11-10 深圳市华星光电半导体显示技术有限公司 驱动电路
CN110728940B (zh) * 2019-09-17 2020-12-08 深圳市华星光电半导体显示技术有限公司 反相器、goa电路及显示面板
CN111210755A (zh) 2020-02-25 2020-05-29 合肥京东方光电科技有限公司 移位寄存器、栅极驱动电路及显示面板
CN111477181B (zh) * 2020-05-22 2021-08-27 京东方科技集团股份有限公司 栅极驱动电路、显示基板、显示装置和栅极驱动方法
CN114005418B (zh) * 2021-10-29 2022-09-20 绵阳惠科光电科技有限公司 公共电压产生电路、显示面板驱动电路和显示装置

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
RU2488180C1 (ru) * 2009-06-25 2013-07-20 Шарп Кабусики Кайся Сдвиговый регистр, устройство отображения, снабженное таковым, и способ возбуждения сдвигового регистра
CN103500551A (zh) * 2013-10-23 2014-01-08 合肥京东方光电科技有限公司 移位寄存器单元、goa电路、阵列基板以及显示装置

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR101277152B1 (ko) * 2006-08-24 2013-06-21 삼성디스플레이 주식회사 게이트 구동회로 및 이를 갖는 표시장치
KR101423235B1 (ko) * 2008-01-04 2014-07-25 삼성디스플레이 주식회사 화소 구동 회로 및 이를 갖는 표시 장치
TWI400686B (zh) * 2009-04-08 2013-07-01 Au Optronics Corp 液晶顯示器之移位暫存器
US9070471B2 (en) * 2009-06-17 2015-06-30 Sharp Kabushiki Kaisha Shift register, display-driving circuit, displaying panel, and displaying device
EP2448119A3 (en) * 2009-06-17 2012-08-22 Sharp Kabushiki Kaisha Shift register, display-driving circuit, displaying panel, and displaying device
BR112012014473A2 (pt) * 2009-12-15 2017-03-14 Sharp Kk circuito de acionamento de linha de sinal de varredura e dispositivo de exibição que inclui o mesmo
CN102237048B (zh) * 2010-04-22 2014-10-08 瀚宇彩晶股份有限公司 闸极波型产生方法及其电路
US20130100105A1 (en) * 2010-06-30 2013-04-25 Sharp Kabushiki Kaisha Signal generator circuit, liquid crystal display device
CN102290040B (zh) * 2011-09-13 2013-09-04 深圳市华星光电技术有限公司 一种液晶面板、液晶显示装置及液晶面板栅极驱动方法
KR101963595B1 (ko) * 2012-01-12 2019-04-01 삼성디스플레이 주식회사 게이트 구동 회로 및 이를 구비한 표시 장치
TWI518666B (zh) * 2013-03-05 2016-01-21 友達光電股份有限公司 顯示裝置及其共同電壓產生電路

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
RU2488180C1 (ru) * 2009-06-25 2013-07-20 Шарп Кабусики Кайся Сдвиговый регистр, устройство отображения, снабженное таковым, и способ возбуждения сдвигового регистра
CN103500551A (zh) * 2013-10-23 2014-01-08 合肥京东方光电科技有限公司 移位寄存器单元、goa电路、阵列基板以及显示装置

Also Published As

Publication number Publication date
CN103928005A (zh) 2014-07-16
GB2535936B (en) 2020-06-17
JP2017504073A (ja) 2017-02-02
KR101937403B1 (ko) 2019-01-10
US9767750B2 (en) 2017-09-19
GB201610478D0 (en) 2016-08-03
US20160240158A1 (en) 2016-08-18
WO2015109624A1 (zh) 2015-07-30
CN103928005B (zh) 2015-12-02
GB2535936A (en) 2016-08-31
JP6325676B2 (ja) 2018-05-16
KR20160100402A (ko) 2016-08-23

Similar Documents

Publication Publication Date Title
RU2628188C1 (ru) Микросхема goa для совместного возбуждения электрода затвора и общего электрода, схема возбуждения и матрица
US11532371B2 (en) Shift register circuit
US10916213B2 (en) Shift register and method for driving the same, gate driving circuit, and display device
RU2488180C1 (ru) Сдвиговый регистр, устройство отображения, снабженное таковым, и способ возбуждения сдвигового регистра
RU2667458C1 (ru) Схема goa и жидкокристаллический дисплей
US9336898B2 (en) Shift register unit, gate driver, and display device
US8737560B2 (en) Shift register unit, gate driving device and liquid crystal display
US9269289B2 (en) Shift register unit, gate driving circuit and display apparatus
US8803782B2 (en) Bidirectional shift register and image display device using the same
US10121442B2 (en) Driving methods and driving devices of gate driver on array (GOA) circuit
WO2019091168A1 (zh) 移位寄存器单元及其驱动方法、栅极驱动电路、显示装置
US10291224B2 (en) Gate driving circuit, driving method thereof, display panel and display device
US20100245305A1 (en) Display driving circuit, display device, and display driving method
US20070019775A1 (en) Shift register circuit with high stability
KR20140129731A (ko) 게이트 쉬프트 레지스터와 이를 이용한 표시장치
US10699659B2 (en) Gate driver on array circuit and liquid crystal display with the same
KR101978782B1 (ko) 게이트 쉬프트 레지스터와 이를 이용한 표시장치
KR20160117707A (ko) 쉬프트 레지스터 및 이를 구비한 표시장치
US9805681B2 (en) Fast gate driver circuit
KR101725208B1 (ko) 인버터