KR100515334B1 - 플라즈마 디스플레이 패널의 구동장치 및 플라즈마디스플레이 장치 - Google Patents

플라즈마 디스플레이 패널의 구동장치 및 플라즈마디스플레이 장치 Download PDF

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Abstract

본 발명은 플라즈마 디스플레이 장치의 주 방전 경로에 존재하는 패턴 임피던스를 감소 시키를 수 있는 플라즈마 디스플레이 패널의 구동장치에 관한 것이다.
본 발명에 따른 구성에 의하면, 플라즈마 디스플레이 패널의 구동 장치에 양의 전압과 음의 전압을 블록킹하는 스위치를 유지 방전 스위치와 백투백 방식으로 연결한다. 따라서, 주 방전 경로에는 스위치 소자를 배치하지 않기 때문에 패턴 임피던스를 감소시켜, 유지 방전 마진을 감소 시키고, 파형 왜곡을 방지할 수 있다.

Description

플라즈마 디스플레이 패널의 구동장치 및 플라즈마 디스플레이 장치{Apparatus for driving plasma display panel and plasma display device thereof}
본 발명은 플라즈마 디스플레이 패널(plasma display panel; PDP)의 구동회로에 관한 것으로, 특히 주 방전 경로에 존재하는 임피던스에 의한 파형 왜곡을 방지하는 구동회로에 관한 것이다.
최근 액정표시장치(liquid crystal display; LCD), 전계 방출 표시장치(field emission display; FED), PDP 등의 평면 표시 장치가 활발히 개발되고 있다. 이들 평면 표시 장치 중에서 PDP는 다른 평면 표시 장치에 비해 휘도 및 발광효율이 높으며 시야각이 넓다는 장점이 있다. 따라서, PDP가 40인치 이상의 대형 표시 장치에서 종래의 CRT(cathode ray tube)를 대체할 표시 장치로서 각광받고 있다.
PDP는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백 만개 이상의 픽셀(pixel)이 매트릭스(matrix)형태로 배열되어 있다. 이러한 PDP는 인가되는 구동 전압 파형의 형태와 방전 셀의 구조에 따라 직류형(DC형)과 교류형(AC형)으로 구분된다.
직류형 PDP는 전극이 방전 공간에 그대로 노출되어 있어서 전압이 인가되는 동안 전류가 방전공간에 그대로 흐르게 되며, 이를 위해 전류제한을 위한 저항을 만들어 주어야 하는 단점이 있다. 반면 교류형 PDP에서는 전극을 유전체층이 덮고 있어 자연스러운 캐패시턴스 성분의 형성으로 전류가 제한되며 방전시 이온의 충격으로부터 전극이 보호되므로 직류형에 비해 수명이 길다는 장점이 있다.
도 1은 AC형 플라즈마 디스플레이 패널의 일부 사시도이다.
도 1에 도시한 바와 같이, 제1유리기판(1) 위에는 유전체층(2) 및 보호막(3)으로 덮인 주사전극(4)과 유지전극(5)이 쌍을 이루어 평행하게 설치된다. 제2유리기판(6) 위에는 절연체층(7)으로 덮인 복수의 어드레스전극(8)이 설치된다. 어드레스전극(8)들 사이에 있는 절연체층(7) 위에는 어드레스 전극(8)과 평행하게 격벽(9)이 형성되어 있다. 또한, 절연체층(7)의 표면 및 격벽(9)의 양측면에 형광체(10)가 형성되어 있다. 제1유리기판(1)과 제2유리기판(6)은 주사전극(4)과 어드레스전극(8) 및 유지전극(5)과 어드레스전극(8)이 직교하도록 방전공간(11)을 사이에 두고 대향하여 배치되어 있다. 어드레스전극(8)과, 쌍을 이루는 주사전극(4)과 유지전극(5)과의 교차부에 있는 방전공간이 방전셀(12)을 형성한다.
도 2는 플라즈마 디스플레이 패널의 전극 배열도를 나타낸다.
도2에 도시한 바와 같이, PDP 전극은 m ×n의 매트릭스 구성을 가지고 있으며, 구체적으로 열 방향으로는 어드레스전극(A1~Am)이 배열되어 있고 행방 향으로는 n행의 주사전극(Y1~Yn) 및 유지전극(X1~Xn)이 지그재그로 배열되어 있다. 이하에서는 주사전극을 "Y 전극", 유지전극을 "X 전극"이라 칭한다. 도 2에 도시된 방전셀(12)은 도 1에 도시된 방전셀(12)에 대응한다.
도 3은 플라즈마 디스플레이 패널을 나타내는 도면이다.
도 3에 도시한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널은 플라즈마 패널(10), 어드레스 구동부(20), 주사·유지 구동부(30) 및 제어부(40)를 포함한다.
플라즈마 패널(10)은 열 방향으로 배열되어 있는 다수의 어드레스 전극(A1~Am), 행 방향으로 지그재그로 배열되어 있는 다수의 주사전극(Y1~Yn) 및 유지전극(X1~Xn)을 포함한다.
어드레스 구동부(20)는 제어부(40)로부터 어드레스 구동 제어 신호를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스 전극에 인가하며, 무효 전력을 회수하여 재사용하는 전력 회수 회로를 포함한다.
주사·유지 구동부(30)는 제어부(40)로부터 유지 방전 신호를 수신하여 주사 전극과 유지 전극에 유지 펄스 전압을 번갈아 입력함으로써 선택된 방전 셀에 대하여 유지 방전을 수행한다.
제어부(40)는 외부로부터 영상 신호를 수신하여 어드레스 구동 제어 신호와 유지 방전 신호를 생성하여 각각 어드레스 구동부(20)와 주사·유지 구동부(30)에 인가한다.
도 4는 종래 기술의 플라즈마 디스플레이 패널의 구동 회로를 도시한 것이다.
일반적으로 교류형 플라즈마 디스플레이 패널의 구동은 유지기간, 소거 기간, 리셋 기간, 어드레싱 기간로 이루어지며, 다양한 파형을 이용하여 패널을 구동시킨다.
상기 주사 구동 회로는 미국특허 4,866,349 및 5,081,400에서 Weber에 의해 제안된 전력 회수 회로와 제 1 램프 펄스 공급부(31), 제 2 램프 펄스 공급부(32), 스캔 전압 공급부를(33)을 포함하고 있다.
이하, 종래 기술에 있어서의 유지 방전 및 전력 회수 동작을 설명한다.
① 스위치(S1)가 도통되기 직전에 스위치(S4)는 도통되어 있고, 패널(C2)의 양단 전압은 0 으로 유지된다. 스위치(S1)가 도통되면, 커패시터(C1)-스위치(S1), 다이오드(D1)-인덕터(L1)-패널(C2)로 LC 공진 회로가 형성되고, 패널(C2)의 양단간의 전압은 Vs까지 증가한다.
② 이후, 스위치(S1)가 차단되고, 스위치(S3)가 도통되면, 이 때의 스위치(S3)의 양단 전압은 0 이므로 영전압 스위칭을 수행하고 패널(C2)의 양단간 전압은 +Vs를 유지하게 된다.
③ 이후, 스위치(S3)가 차단되고 스위치(S2)가 도통되면, 패널(C2)-인덕터(L1)-다이오드(D2)-스위치(S2)-커패시터(C1)의 경로로 LC 공진회로가 형성되어, 패널(C2)의 양단간의 전압은 감소한다.
④ 이후, 스위치(S2)가 차단되고 스위치(S4)가 도통되면, 이 때의 스위치(S4)의 양단 전압은 0이므로 영전압 스위칭을 하게되고, 패널(C2)의 양단간의 전압은 0을 유지하게 된다.
한편, 상기 유지 방전의 펄스는, 제 1 램프 펄스 공급부(31), 제 2 램프 펄스 공급부(32) 및 스캔 전압 공급부(33)으로부터 인가된 파형이 가감되어 다양한 구동 파형을 형성한다. 이때 주 방전 경로(A)에는 스위치(Ypp, Ynp)가 스위칭되어 패널에 다양한 구동 파형을 공급하게 된다. 상기 스위치(Ypp, Ynp)는 소거 또는 주사 동작이 음의 바이어스 레벨에서 실시되는 경우가 존재하므로, 이중의 경로 스위치가 필요하게 된다.
하지만, 상기 주 방전 경로(A)에 형성된 스위치(Ypp, Ynp)는 패턴 임피던스를 증가시키는 요인이 된다. 즉, 전극과 유지 방전 회로간에 형성된 주 방전 경로(A)에는 형성된 패턴 임피던스는 파형을 왜곡시키고, 전압의 오버슈트(overshoot)등에 의해 유지 전압의 마진에 영향을 주는 문제점이 발생한다.
도 5a 및 도 5b는 주 방전 경로의 패턴 임피던스의 영향을 측정한 그래프도이다.
주 방전 경로에 존재하는 패턴 임피던스를 인덕턴스 성분으로 고려할 때, 도 5a는 패턴 임피던스가 없는 경우의 유지 방전 파형을 측정한 것이며, 도 5b는 패턴 임피던스가 0.01 μH일 때의 유지 방전 파형을 측정한 것이다.
도 5b에서 알수 있듯, 주 방전 경로 상에 형성된 패턴 임피던스로 인해 유지 방전 파형은 정상 상태(steady state)에 도달하는 시간이 지연되며, 큰 폭의 오버슈트가 발생한다. 따라서, 이러한 패턴 임피던스는 유지 방전 전압의 마진이 증가시키고, 파형의 안정성을 해치게 된다.
본 발명은 전술한 종래 기술의 문제점을 해결하기 위하여, 본 발명은 주방전 경로에 존재하는 임피던스를 최소로 하는 개선된 플라즈마 디스플레이 패널 구동 회로를 제공한다. 더욱 상세하게는, 유지 방전 회로와 패널 전극 사이에 존재하는 경로상에 어떠한 스위치도 배치하지 않음으로써, 패턴 임피던스를 최소화할 수 있는 플라즈마 디스플레이 패널 구동 회로를 제공한다.
전술한 과제를 해결하기 위하여, 본 발명의 한 특징에 따른 플라즈마 디스플레이 패널의 구동 장치는, 제 1 전압 레벨을 가진 제 1 전압 전원과; 상기 제 1 전압을 상기 구동회로에 인가되도록 허용하는 제 1 스위치와; 상기 제 1 스위치의 일단과 전기적으로 연결되며, 상기 제 1 전압을 상기 전극에 인가하여 일정하게 유지되도록 허용하는 제 2 스위치와; 제 2 전압 레벨을 가진 제 2 전압 전원과; 상기 제 2 전압 전원과 상기 제 1 전압 전원 사이에 배치된 커패시터와; 상기 제 1 스위치가 오프-상태인 동안, 상기 커패시터에 충전된 제 2 전압을 상기 전극에 더 공급하도록 허용하는 제 3 스위치를 포함한다.
여기서, 상기 제 1 스위치 및 상기 제 2 스위치는 각각 제 1 트랜지스터와 제 2 트랜지스터로 구현되고, 상기 제 1 트랜지스터 및 제 2 트랜지스터는 백투백 방식으로 연결된다.
또한, 본 발명의 다른 특징을 가진 디스플레이 구동 장치는, 상기 제 1 트랜지스터의 소스가 상기 제 1 전원과 연결되고, 상기 제 1 트랜지스터와 상기 제 2 트랜지스터의 드레인이 백투백 연결될 수 있다.
또한, 본 발명의 또 다른 특징을 가진 디스플레이 구동 장치는, 상기 제 2 트랜지스터의 드레인이 상기 제 1 전원과 연결되고, 상기 제 1 트랜지스터와 상기 제 2 트랜지스터의 소스가 백투백 연결될 수 있다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다.
도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다. (어떤 부분이 다른 부분과 연결되어 있다고 할 때, 이는 직접적으로 연결되어 있는 경우뿐 아니라 다른 소자를 사이에 두고 전기적으로 연결되어 있는 경우도 포함한다.)
이제 본 발명의 실시예에 따른 구동회로에 대하여 도면을 참고로 하여 상세하게 설명한다.
도 6a 및 도 6b는 본 발명의 실시예에서 사용되는 백투백(back-to-back) 연결을 설명하기 위한 회로도이다.
도 6a 및 도 6b에는 트랜지스터의 백투백 연결에 대응하는 등가회로가 각각 도시되어 있다. 등가회로에 도시된 바와 같이, 백투백 트랜지스터 연결은 바디 다이오드(Dp1, Dp2, Dp3, Dp4)를 형성하고, 트랜지스터(M1, M2, M3, M4)의 게이트 구동 신호에 따라서 구동 신호 스위치(SM1, SM2, SM3, SM4)를 스위칭한다.
따라서, 예를 들어, 도 6a에서 트랜지스터(M1)에 게이트 신호가 인가되지 않아도 트랜지스터(M2)에 게이트 신호가 인가되어 있으면 트랜지스터(M1)로부터 트랜지스터(M2)로 전류가 흐르게 된다.
도 7은 본 발명의 제 1 실시예에 따른 디스플레이 패널 구동 회로를 도시한 것이다.
도 7 에 도시된 바와 같이, 도 4에 도시된 전력 회수 및 유지 방전 회로를 포함한다. 상기 전력 회수는 커패시터(C3), 스위치(Yr, Yf), 다이오드(Dr, Df), 스위치(Ys, Yg), 제 1 전압 전원(Vs)을 포함한다.
또한, 스위치(Yp1)는 스위치(Ys)와 백투백 방식으로 연결되고, 스위치(Yp2)는 스위치(Yg)와 백투백 방식으로 연결된다. 상기 스위치(Yp1, Yp2)는 주 방전 경로를 스위치하게 된다.
상기 유지 방전 회로에 더하여, 상승 램프 파형을 공급하는데 사용되는 제 2 전원(Vset)은 커패시터(Cset)을 경유하여 스위치(Yp1)과 접속되고, 트랜지스터(Yrr)에 접속된다. 도시되지 않았지만 트랜지스터(Yrr)에 게이트에는 구동전압을 램프 상승시키기 위한 정전류 드라이버가 접속될 수 있다.
또한, 본 제 1 실시예는 전원(VscH, VscL), 스위치(Yscs, Ysc, YscL), 커패시터(Csc)를 포함하는 주사 구동부와, 다이오드(Dfr)과 트랜지스터(Yfr)을 포함하는 하강 램프 구동부와, 다이오드(Der), 트랜지스터(Yer)을 포함하는 소거 구동부를 포함한다.
도시되지 않았지만, 상기 트랜지스터(Yfr)와 트랜지스터(Yer)의 게이트에는 구동 파형을 램프 하강시키기 위한 정전류 구동 드라이버가 접속될 수 있다.
상기 주사 구동부와 하강 램프 구동부, 소거 구동부는 균등한 동작을 수행하는 종래의 회로로 구현하여도 상관없으며, 본 실시예에서 구현되는 동작은 후술하기로 한다.
도 7에서 명백히 알수 있듯, 본 발명의 제 1 실시예에서 유지 방전 회로와 전극 사이에 존재하는 주 방전 경로(A)에는 스위치 소자가 전혀 존재하지 않는다. 따라서, 종래 기술과 같이, 주 방전 경로에 의한 패턴 임피던스가 발생하지 않게 된다.
도 8은 본 발명의 실시예에 있어서 주사 전극의 구동 파형과 각각의 스위치의 동작을 도시한 타이밍도이다.
플라즈마 디스플레이 패널의 구동은 유지 방전 기간(t1), 소거 기간(t2), 리셋 기간(t3, t4), 어드레스 기간(t6, t7)으로 이뤄진다.
전압(Vy)은 주사 전극에 인가되는 전압의 파형을 나타낸다. 유지 방전 동작시, 유지 방전 기간(t1)동안 전압(Vs)을 가진 유지 방전 펄스가 반복하여 인가된다. 상기 유지 방전을 위한 전압(Vs)의 펄스가 주사 전극에 인가되는 동안 유지 전극에는 이와 반대의 극성의 펄스가 인가될 수 있다. 상기 유지 방전 동작은 도 4에 도시된 전력 회수 회로의 동작과 동일하게 이뤄진다.
소거 기간(t2)동안 주사 전극의 파형은 램프 하강하며, 전극에 쌓인 벽전하를 소거한다. 리셋기간(t3, t4)에는 강한 방전을 일으키는 전압(Vs+Vset)이 인가된후, 서서히 전압을 하강시켜, 이후 어드레스를 위한 리셋 동작을 수행한다. 이후 어드레스 기간(t6, t7)에서 방전을 시킬 패널을 선택한다.
도 8에 도시된 바와 같이, 유지 방전 동작은 스위치(Yp1, Yp2)가 온상태가 유지되는 동안, 스위치(Ys, Yg)가 순차적으로 스위칭되면서 이루어진다. 이는 도 4에 도시된 회로의 유지 방전 동작과 동일하다.
이후, 트랜지스터(Yer)를 구동하는 정전류 드라이버가 온-상태로 되고, 유지 전압(Vs)은 램프 하강하며, 소거 동작을 수행한다.
도 9은 본 발명의 제 1 실시예에서 리셋 동작을 설명하기 위한 회로도이다.
리셋 동작을 위한 램프 상승을 위하여 기간(t3)에서 순간적으로 스위치(Yp1, Yp2, Ys)가 온 상태가 되어, 전압(Vs) 만큼의 충전한다. 이후, 트랜지스터(Yrr)를 구동하는 정전류 드라이버가 온 상태가 되어, 파형을 전압(Vs+Vset)만큼 램프 상승시킨다. 이후, 트랜지스터(Yrr) 오프 상태가 되며, 스위치(Yp1, Yp2, Yg)가 온 상태가 되어, 전압을 떨어뜨린후, 트랜지스터(Yrr)를 구동하는 정전류 드라이버가 온 상태가 되어 전압을 소정 레벨까지 램프 하강 시킨다.
도 10은 본 발명의 제 1 실시예에서 어드레스 동작을 설명하기 위한 회로도이다.
리셋 동작이 완료된후, 주사 구동 회로(300)에 의해 전압(Vsc)의 펄스가 인가된 후, 어드레스가 일어나는 기간(t7)에서 스위치(YscL)가 온 상태가 되어, 순간적으로 전압레벨을 낮춘다. 여기서, 도시되지 않았지만, 기간(t7)동안 어드레스 전극에 어드레스 전압이 인가되어, 어드레스를 위한 방전이 일어나게 된다.
전술한 바와 같이, 본 발명의 제 1 실시예는 주 방전 경로(A)에 스위치 요소를 배치하지 않고서도 패널을 구동하기 위한 유지, 소거, 리셋, 어드레스 동작을 수행할 수 있음을 알 수 있다.
따라서, 본 발명의 제 1 실시예에 따르면, 주 방전 경로 상에 임피던스 성분을 발생시키지 않으면서도 플라즈마 디스플레이 패널을 구동시킬 수 있는 다양한 파형을 생성 시킬 수 있다.
도 11는 본 발명의 제 2 실시예에 따른 구동 회로를 도시한 것이다.
본 발명의 제 1 실시예와 비교하여 볼 때, 본 발명의 제 2 실시예는 유지 방전 전압을 인가하는 스위치(Ys)가 패턴 스위치(Yp3)와 위치가 바뀌어 백투백 연결된다. 따라서, 인덕터(L1)을 경유한 전류는 스위치(Yp3)를 거쳐 전극에 공급된다.
본 발명의 제 2 실시예의 경우에도 도 8에 도시된 타이밍도에 따라서, 유지 방전, 소거, 리셋 및 어드레스 동작을 수행한다. 따라서, 동작에 대한 자세한 설명은 생략한다.
하지만, 본 발명의 제 2 실시예의 경우에는 전력 회수 회로와 전극 사이의 경로에 스위치(Yp3)를 배치하여, 리셋 구간중 상승 램프 동작시 전력 회수 회로의 내압을 줄일 수 있게 된다.
도 12a 및 도 12b는 램프 상승시의 본 발명의 제 1 실시예와 제 2 실시예의 등가 회로를 각각 도시한 것이다.
도 12a에서 알 수 있듯이, 본 발명의 제 1 실시예에 따르면, 전력 회수회로의 양단에는 전압(Vs+Vset)이 인가된다. 전술한 바와 같이, 램프 상승시에는 스위치(Yp1, Yp2, Ys, Yg)는 모두 오프 상태이나, 도 5a 및 도 5b에 설명된 백투백 연결에서 발생하는 바디 다이오드에 의해 전압(Vs+Vset)이 원으로 표시한 전력회수 회로에 인가되어 내압을 증가시키게 된다.
그러나, 도 12b에 도시된 바와 같이, 본 발명의 제 2 실시예의 경우, 스위치(Ys)와 스위치(Yp3)의 배치가 변경됨에 의해, 램프 상승시에 스위치(Yp3, Yp4)가 오프되어 전압(Vs+Vset)이 전력 회수 회로에 대해 블록킹된다. 따라서, 전력 회수회로의 소자들에 대한 내압을 저감시킬 수 있게 된다.
한편, 본 발명의 제 1 실시예와 제 2 실시예는 종래 기술에 비해 유지 동작을 수행하는 스위치(Ys, Yg)의 내압을 증가시키게 되지만, 현재 고내압용 IGBT(Insulated Gate Bipolar Transistor) 소자가 많이 개발되어 있으며, 그 IGBT 기술개발에 따라 비용도 점점 감소하는 추세이므로, 본 발명에 의해 적은 비용으로 효과적으로 패턴 임피던스의 악영향을 제거할 수 있다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
전술한 바와 같이, 본 발명의 구성에 따라서, 플라즈마 디스플레이 패널의 구동회로의 주 방전 경로에 발생하는 임피던스 성분을 제거하여, 방전의 마진을 감소시킬 수 있으며, 파형의 왜곡을 방지하여 안정적인 방전 동작을 수행할 수 있다.
도 1은 AC형 플라즈마 디스플레이 패널의 일부 사시도이다.
도 2는 플라즈마 디스플레이 패널의 전극 배열도이다.
도 3은 플라즈마 디스플레이 패널을 나타내는 도면이다.
도 4는 종래 기술의 플라즈마 디스플레이 패널의 구동 회로를 도시한 것이다.
도 5a 및 도 5b는 주 방전 경로의 패턴 임피던스의 영향을 측정한 그래프도이다.
도 6a 및 도 6b는 본 발명의 실시예에서 사용되는 백투백(back-to-back) 연결을 설명하기 위한 회로도이다.
도 7은 본 발명의 제 1 실시예에 따른 디스플레이 패널 구동 회로를 도시한 것이다.
도 8은 본 발명의 실시예에 있어서 주사 전극의 구동 파형과 각각의 스위치의 동작을 도시한 타이밍도이다.
도 9은 본 발명의 제 1 실시예에서 리셋 동작을 설명하기 위한 회로도이다.
도 10은 본 발명의 제 1 실시예에서 어드레스 동작을 설명하기 위한 회로도이다.
도 11는 본 발명의 제 2 실시예에 따른 구동 회로를 도시한 것이다.
도 12a 및 도 12b는 램프 상승시의 본 발명의 제 1 실시예와 제 2 실시예의 등가 회로를 각각 도시한 것이다.

Claims (11)

  1. 일방향으로 뻗어 있는 복수의 전극을 포함하는 플라즈마 디스플레이 패널을 구동하는 구동 장치에 있어서,
    유지 기간 동안 제 1 전원에서 제1 전압이 상기 복수의 전극에 인가되도록 동작하며, 백투백 방식으로 연결된 제 1 및 제 2 트랜지스터;
    제 2 전압 레벨을 가진 제 2 전원과 상기 제 1 전원 사이에 배치된 커패시터와;
    리셋 기간에서 상기 제 1 트랜지스터가 오프-상태인 동안, 상기 커패시터에 충전된 전압에 의해 상기 복수의 전극의 전압이 점진적으로 상승하도록 동작하는 제 3 트랜지스터를 포함하는 플라즈마 디스플레이 패널 구동 장치.
  2. 삭제
  3. 제 1 항에 있어서,
    상기 제 1 트랜지스터의 소스는 상기 제 1 전원과 연결되고, 상기 제 1 트랜지스터와 상기 제 2 트랜지스터의 드레인이 백투백 방식으로 연결된 플라즈마 디스플레이 패널 구동 장치.
  4. 제 1 항에 있어서,
    상기 제 2 트랜지스터의 드레인은 상기 제 1 전원과 연결되고, 상기 제 1 트랜지스터와 상기 제 2 트랜지스터의 소스가 백투백 방식으로 연결된 플라즈마 디스플레이 패널 구동 장치.
  5. 제 3 항 또는 4 항에 있어서,
    제 3 트랜지스터에 정전류가 흐르도록 제어하는 정전류 드라이버를 더 포함하는 플라즈마 디스플레이 패널 구동 장치.
  6. 제 3 항 또는 제 4 항에 있어서,
    상기 제 1 전압보다 낮은 전압레벨을 가진 제 3 전원과;
    상기 구동회로가 상기 제 3 전원과 전기적으로 연결되도록 허용하는 제 4 트랜지스터와;
    상기 제 4 트랜지스터와 접속되며, 상기 전극을 상기 제 3 전원과 전기적으로 연결되도록 허용하는 제 5 트랜지스터를 더 포함하는 플라즈마 디스플레이 패널 구동 장치.
  7. 제 6 항에 있어서,
    상기 제 4 트랜지스터와 상기 제 5 트랜지스터는 백투백 방식으로 연결된 디스플레이 패널 구동장치.
  8. 제 7 항에 있어서,
    상기 전극에 인가된 전압을 하강시키는 램프 하강 구동부를 더 포함하는 플라즈마 디스플레이 패널 구동 장치.
  9. 제 7 항에 있어서,
    상기 제 4 트랜지스터 및 제 5 트랜지스터는 절연 게이트형 양극성 트랜지스터(Insulated Gate Bipolar Transistor) 소자로 구현된 플라즈마 디스플레이 구동 장치.
  10. 유지 전극, 주사 전극 및 어드레스 전극 사이에 방전셀이 형성되는 플라즈마 디스플레이 패널, 그리고
    리셋기간, 어드레스 기간 및 유지 기간 동안 상기 유지 전극, 주사 전극 및 어드레스 전극에 구동 전압을 인가하는 구동회로를 포함하며,
    상기 구동회로는,
    유지 기간 동안 제 1 전원에서 제1 전압이 상기 주사 전극에 인가되도록 동작하며, 백투백 방식으로 연결된 제 1 및 제 2 트랜지스터;
    제 2 전압 레벨을 가진 제 2 전원과 상기 제 1 전원 사이에 배치된 커패시터와;
    리셋 기간에서 상기 제 1 트랜지스터가 오프-상태인 동안, 상기 커패시터에 충전된 전압에 의해 상기 주사 전극의 전압이 점진적으로 상승하도록 동작하는 제 3 트랜지스터를 포함하는 플라즈마 디스플레이 장치.
  11. 제 10 항에 있어서,
    상기 구동 회로는,
    상기 제 1 전압보다 낮은 전압 레벨을 가진 제 3 전원과;
    상기 구동회로가 제 3 전원과 전기적으로 연결되도록 허용하는 제 4 트랜지스터와;
    상기 제 4 트랜지스터와 백투백 방식으로 연결되며, 상기 주사 전극을 제 3 전원과 전기적으로 연결되도록 허용하는 제 5 트랜지스터를 더 포함하는 플라즈마 디스플레이 장치.
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