KR100943957B1 - 플라즈마 표시 장치 및 그 구동 장치 - Google Patents

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Abstract

플라즈마 표시 장치의 구동 장치에서, 제1 스위치가 제1 전압을 공급하는 제1 전원과 주사 전극 사이에 연결되어 있으며, 제1 다이오드 및 제2 스위치가 상기 제1 전압보다 높은 제2 전압을 공급하는 제2 전원과 주사 전극 사이에 직렬로 연결되어 있다. 제3 스위치는 제1 다이오드와 제2 스위치 사이의 접점과 전력 회수용 전원 사이에 연결되어 있으며, 제2 다이오드는 상기 제1 다이오드와 상기 제3 스위치에 병렬로 연결되어 있다.
Figure R1020080079433
PDP, 플라즈마, 주사 전극, 트랜지스터, 다이오드, 전류 경로

Description

플라즈마 표시 장치 및 그 구동 장치{PLASMA DISPLAY AND DRIVING APPARATUS THEREOF}
본 발명은 플라즈마 표시 장치 및 그 구동 장치에 관한 것이다.
플라즈마 표시 장치는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 플라즈마 표시 패널을 이용한 표시 장치이다. 플라즈마 표시 패널에는 복수의 셀이 매트릭스 형태로 배열되어 있다. 플라즈마 표시 장치는 한 프레임을 복수의 서브필드로 나누어 구동하면서 영상을 표시한다.
플라즈마 표시 장치에서는 한 각각의 가중치를 가지는 복수의 서브필드로 분할되어 구동된다. 그리고 각 서브필드는 리셋 기간(reset period), 어드레스 기간(address period) 및 유지 기간(sustain period)으로 이루어진다. 리셋 기간에서는 어드레스 방전을 안정적으로 수행하기 위해 방전 셀을 초기화한다. 각 서브필드의 어드레스 기간에서는 복수의 주사 전극에 순차적으로 주사 펄스를 인가하여 켜질 셀과 켜지지 않을 셀을 선택하고, 유지 기간에서는 유지 기간에서 유지 방전을 수행하는 전극에 유지 방전 펄스의 하이 레벨 전압과 로우 레벨 전압을 교대로 인가하여 실제로 영상을 표시하기 위해 켜질 셀에 대하여 유지 방전을 수행한다.
어드레스 기간에서 주사 전압을 인가하는 스위치가 턴온될 경우 접지 전압(예를 들어, 0V 전압)을 인가하는 스위치의 바디 다이오드를 통해 주사 전압을 인가하는 스위치로 원치 않는 전류 경로가 형성된다. 종래에는 이러한 전류 경로를 차단하기 위해서 접지 전압을 인가하는 스위치와 주사 전압을 인가하는 스위치 사이에 별도의 스위치를 추가하였다. 이 별도의 스위치는 주사 전압과 같은 음(-)의 전압과 하이 레벨 전압과 같은 양(+)의 전압을 분리하는데도 사용된다. 따라서, 별도의 스위치는 음의 전압과 양의 전압 사이의 전압 차 이상의 내압을 가진 스위치를 사용해야 하며, 내압이 큰 스위치는 단가가 높은 문제점이 있다.
본 발명이 이루고자 하는 기술적 과제는 단가를 낮출 수 있는 플라즈마 표시 장치 및 그 구동 장치를 제공하는 것이다.
본 발명의 한 특징에 따르면, 주사 전극, 제1 전압을 공급하는 제1 전원과 상기 주사 전극 사이에 연결되어 있는 제1 스위치, 상기 제1 전압보다 높은 제2 전압을 공급하는 제2 전원과 상기 주사전극 사이에 직렬로 연결되어 있는 제1 다이오드 및 제2 스위치, 상기 제1 다이오드와 상기 제2 스위치 사이의 접점과 전력 회수용 전원 사이에 연결되어 있는 제3 스위치, 상기 제1 다이오드와 상기 제3 스위치에 병렬로 연결되어 있는 제2 다이오드를 포함하는 구동 장치가 제공된다.
이때, 상기 제1 다이오드의 캐소드가 상기 제3 스위치의 제1단에 연결되어 있고, 상기 제3 스위치의 제2단이 상기 제2 다이오드의 애노드에 연결되어 있으며, 상기 제2 다이오드의 캐소드가 상기 제1 다이오드의 애노드에 연결되어 있다.
본 발명의 다른 특징에 따르면, 주사 전극, 주사 전압을 공급하는 제1 전원과 상기 주사 전극 사이에 연결되어 있는 제1스위치, 상기 주사 전극에 연결되어 유지 기간 동안 상기 주사 전압보다 높은 로우 레벨 전압과 상기 로우 레벨 전압보다 높은 하이 레벨 전압을 상기 주사 전극에 교대로 인가하는 유지 구동부를 포함하는 플라즈마 표시 장치가 제공된다.
여기서, 유지 구동부는, 상기 로우 레벨 전압을 공급하는 제2 전원에 제1단이 연결되어 있는 제2 스위치, 상기 주사 전극과 상기 제2 스위치의 제2단 사이에 연결되어 상기 제2 스위치의 제2단에서 상기 주사 전극으로의 전류를 차단하는 제1 전류 경로, 상기 제1 전류 경로와 전력 회수용 전원 사이에 연결되어, 턴온 시에 상기 제1 전류 경로를 통하여 상기 주사 전극의 전압을 감소시키는 제3 스위치, 상기 제2 스위치의 제2단에서 상기 주사 전극으로의 전류를 통과시키는 제2 전류 경로를 포함한다.
본 발명의 실시 예에 따르면, 고가의 스위치 대신에 전류 용량이 낮은 복수의 다이오드를 사용함으로써, 원가를 절감할 수 있다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시 예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상 세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시 예에 한정되지 않는다. 그리고 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였으며, 명세서 전체를 통하여 유사한 부분에 대해서는 유사한 도면 부호를 붙였다.
명세서 전체에서, 어떤 부분이 다른 부분과 "연결"되어 있다고 할 때, 이는 "직접적으로 연결"되어 있는 경우뿐 아니라, 그 중간에 다른 소자를 사이에 두고 "전기적으로 연결"되어 있는 경우도 포함한다. 또한 어떤 부분이 어떤 구성요소를 "포함"한다고 할 때, 이는 특별히 반대되는 기재가 없는 한 다른 구성요소를 제외하는 것이 아니라 다른 구성요소를 더 포함할 수 있는 것을 의미한다.
이제 본 발명의 실시 예에 따른 플라즈마 표시 장치 및 그 구동 장치에 대하여 도면을 참고로 하여 상세하게 설명한다.
도 1은 본 발명의 실시 예에 따른 플라즈마 표시 장치의 개략적인 블록도이다.
도 1에 나타낸 바와 같이, 본 발명의 실시 예에 따른 플라즈마 표시 장치는 플라즈마 표시 패널(100), 제어부(200), 어드레스 전극 구동부(300), 주사 전극 구동부(400) 및 유지 전극 구동부(500)를 포함한다.
플라즈마 표시 패널(100)은 세로 방향으로 뻗어 있는 복수의 어드레스 전극(이하, "A 전극"이라 함)(A1~Am), 그리고 가로 방향으로 서로 쌍을 이루면서 뻗어 있는 복수의 유지 전극(이하, "X 전극"이라 함)(X1~Xn) 및 복수의 주사 전극(이하, "Y 전극"이라 함)(Y1~Yn)을 포함한다. 일반적으로 X 전극(X1~Xn)은 각 Y 전 극(Y1~Yn)에 대응해서 형성되며, X 전극(X1~Xn)과 Y 전극(Y1~Yn)이 유지 기간에서 화상을 표시하기 위한 표시 동작을 수행한다. X 전극(X1~Xn)과 Y 전극(Y1~Yn)은 A 전극(A1~Am)과 직교하도록 배치된다. 이때, A 전극(A1~Am)과 X 및 Y 전극(X1~Xn, Y1~Yn)의 교차부에 있는 방전 공간이 셀(110)을 형성한다. 이러한 플라즈마 표시 패널(100)의 구조는 일 예이며, 아래에서 설명하는 구동 파형이 적용될 수 있는 다른 구조의 패널도 본 발명에 적용될 수 있다.
제어부(200)는 외부로부터 영상 신호를 수신하여 A 전극 구동 제어 신호, X 전극 구동 제어 신호 및 Y 전극 구동 제어 신호를 출력 한다. 그리고 제어부(200)는 한 프레임을 복수의 서브필드로 분할하여 구동하며, 각 서브필드는 시간적인 동작 변화로 표현하면 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어진다.
어드레스 전극 구동부(300)는 제어부(200)로부터 A 전극 구동 제어 신호를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 A 전극에 인가한다.
주사 전극 구동부(400)는 제어부(200)로부터 Y 전극 구동 제어 신호를 수신하여 Y 전극에 구동 전압을 인가한다.
유지 전극 구동부(500)는 제어부(200)로부터 X 전극 구동 제어 신호를 수신하여 X 전극에 구동 전압을 인가한다.
도 2는 본 발명의 실시 예에 따른 플라즈마 표시 장치의 구동 파형을 나타내는 도면이다. 도 2에서는 설명의 편의상 하나의 셀을 형성하는 X 전극, Y 전극 및 A 전극에 인가되는 구동 파형만을 도시하였다.
도 2에 나타낸 바와 같이, 리셋 기간의 상승 기간에서는 A 전극 및 X 전극을 기준 전압(도 2에서는 기준 전압을 접지 전압(0V)로 가정함)으로 유지하고, Y 전극의 전압을 Vs 전압에서 Vset 전압까지 점진적으로 증가시킨다. 이처럼, Y 전극의 전압이 증가하는 동안, Y 전극과 X 전극 사이 및 Y 전극과 A 전극 사이에서 약방전이 발생되어, Y 전극에는 (-)벽 전하가 형성되고 X 전극 및 A 전극에는 (+)벽 전하가 형성된다. 한편, 도 2에서는 Y 전극의 전압이 Vs 전압에서 점진적으로 증가하는 것으로 도시하였지만, Y 전극의 전압이 Vs 전압과 다른 전압, 예를 들면 아래에서는 설명하는 VscH 전압과 VscL 전압의 차에 해당하는 전압(VscH-VscL)에서 점진적으로 증가할 수도 있다.
리셋 기간의 하강 기간에서는, A 전극과 X 전극의 전압을 각각 기준 전압과 Ve 전압으로 유지한 상태에서, Y 전극의 전압을 Vs 전압에서 Vnf 전압까지 점진적으로 감소시킨다. 그러면, Y 전극의 전압이 감소하는 중에 Y 전극과 X 전극 사이 및 Y 전극과 A 전극 사이에서 약 방전이 일어나게 되며, 이에 따라 Y 전극에 형성된 (-)벽 전하와 X 전극 및 A 전극에 형성된 (+)벽 전하가 소거된다. 일반적으로 (Vnf-Ve) 전압의 크기는 Y 전극과 X 전극 사이의 방전 개시 전압(Vfxy) 근처로 설정된다. 그러면, Y 전극과 X 전극 사이의 벽 전압이 거의 0V 가 되어, 어드레스 기간에서 어드레스 방전이 일어나지 않은 셀이 유지 기간에서 오방전하는 것을 방지할 수 있다. 한편, 도 2에서는 Y 전극의 전압이 Vs 전압에서 점진적으로 감소하는 것으로 도시하였지만, Y 전극의 전압이 Vs 전압과 다른 전압, 예를 들면 0V 에서 점진적으로 감소할 수도 있다.
어드레스 기간에서는, 켜질 방전 셀을 선택하기 위해서, X 전극에 Ve 전압을 인가한 상태에서, 복수의 Y 전극에 차례로 음극성의 주사 전압(VscL)을 가지는 주사 펄스를 인가한다. 이때, VscL 전압이 인가된 Y 전극과 X 전극에 의해 형성되는 복수의 방전 셀 중에서 켜질 방전 셀을 통과하는 A 전극에 Va 전압을 인가한다. 그러면, Va 전압이 인가된 A 전극과 VscL 전압이 인가된 Y 전극 사이 및 VscL 전압이 인가된 Y 전극과 Ve 전압이 인가된 X 전극 사이에서 어드레스 방전이 일어난다. 이에 따라 Y 전극에는 (+)벽 전하가 형성되고, A 전극 및 X 전극에는 (-)벽 전하가 형성된다. 여기서, VscL 전압이 인가되지 않는 Y 전극에는 VscL 전압보다 높은 음극성의 VscH 전압이 인가되고, 선택되지 않는 방전 셀의 A 전극에는 기준 전압이 인가된다. 이와는 달리, VscL 전압이 인가된 Y 전극과 X 전극에 의해 형성되는 복수의 방전 셀 중에서 꺼질 방전 셀을 통과하는 A 전극에 Va 전압을 인가할 수도 있다.
한편, 어드레스 기간에서 이러한 동작을 수행하기 위해, 주사 전극 구동부(400)는 Y 전극(Y1~Yn)중 VscL 전압을 가지는 주사 펄스가 인가될 Y 전극을 선택한다. 예를 들어, 싱글 구동에서는 수직 방향으로 배열된 순서대로 Y 전극을 선택할 수 있다. 그리고 하나의 Y 전극이 선택되는 경우, 어드레스 전극 구동부(300)는 해당 Y 전극에 의해 형성된 방전 셀 중 켜질 방전 셀을 선택한다. 즉, 어드레스 전극 구동부(300)는 A 전극 중 Va 전압의 어드레스 펄스가 인가될 셀을 선택한다.
유지 기간에서는, Y 전극과 X 전극에 하이 레벨 전압(도 2에서는 Vs 전압)과 로우 레벨 전압(도 2에서는 0V 전압)을 가지는 유지 방전 펄스가 반대 위상으로 인 가한다. 그러면, Y 전극에 Vs 전압이 인가되고 X 전극에 0V 전압이 인가되어 Y 전극과 X 전극 사이에서 유지 방전이 일어나고, 이 유지 방전에 의해 Y 전극과 X 전극에 각각 음극성의 벽 전하 및 양극성의 벽 전하가 형성된다. 이어서, Y 전극에 0V 전압이 인가되고 X 전극에 Vs 전압이 인가되어 Y 전극과 X 전극 사이에서 다시 유지 방전이 일어나고, 이 유지 방전에 의해 Y 전극과 X 전극에 각각 양극성의 벽 전하 및 음극서의 벽 전하가 형성된다. 그리고 이러한 동작이 해당 서브필드의 가중치에 대응하는 횟수만큼 반복되어, 해당 서브필드의 가중치에 해당하는 밝기가 표현된다.
다음으로, 도 3을 참조하여 도 2의 구동 파형을 생성하는 구동 회로에 대해서 상세하게 설명한다. 도 3에서는 복수의 트랜지스터(Sch, Scl, Yset, YscL, Yfr, Ys, Yg, Yr, Yf)를 n채널 트랜지스터로 도시하였으며, 특히 트랜지스터(Sch, Scl, Yset, YscL, Yfr, Ys, Yg, Yf)를 n채널 전계 효과 트랜지스터로, 트랜지스터(Yfr)를 n채널 절연 게이트 양극성 트랜지스터(insulated gate bipolar transistor, IGBT)로 도시하였으며, 이들 트랜지스터에는 소스에서 드레인 방향으로 바디 다이오드가 형성될 수 있다. 그리고 이들 트랜지스터(Sch, Scl, Yset, YscL, Yfr, Ys, Yg, Yr, Yf)는 다른 채널 또는 다른 유형의 트랜지스터로 형성될 수도 있다. 또한, 도 3에서는 트랜지스터를 하나의 트랜지스터로 도시하였지만, 트랜지스터는 각각 병렬로 연결된 복수의 트랜지스터로 형성될 수 있다. 그리고 X 전극과 Y 전극에 의해 형성되는 용량성 성분을 패널 커패시터(Cp)로 도시하였다.
도 3은 본 발명의 실시 예에 따른 주사 전극 구동부의 개략적인 회로도이다.
도 3에 나타낸 바와 같이, 주사 전극 구동부(400)는 유지 구동부(410), 리셋 구동부(420) 및 주사 구동부(430)를 포함한다.
주사 구동부(430)는 주사 회로(431), 커패시터(CscH) 및 트랜지스터(YscL)를 포함하며, 어드레스 기간에서 복수의 Y 전극에 주사 전압(VscL)을 차례로 인가하고, 주사 전압(VscL)이 인가되지 않는 Y 전극에 VscH 전압을 인가한다. 어드레스 기간에서 복수의 Y 전극(Y1-Yn)을 차례로 선택할 수 있도록 각각의 Y 전극(Y1~Yn)에 하나의 주사 회로(431)가 연결될 수 있다. 그리고 일정 개수의 주사 회로(431)가 집적 회로(integrated circuit, IC) 형태로 형성될 수 있다. 한편, 설명의 편의상 하나의 Y 전극에 이에 연결되어 있는 하나의 주사 회로(431)만을 도시하였다. 이러한 주사 회로(431)는 트랜지스터(Sch, Scl)을 포함하며, 두 입력 단자와 출력 단자를 가진다. 트랜지스터(Sch)의 소스와 트랜지스터(Scl)의 드레인은 주사 회로(431)의 출력 단자를 통해 Y 전극에 연결되어 있다. 트랜지스터(Scl)의 소스는 주사 회로(431)의 제1 입력 단자를 통해 커패시터(CscH)의 제1단에 연결되어 있고, 트랜지스터(Sch)의 드레인은 주사 회로(431)의 제2 입력 단자를 통해 커패시터(CscH)의 제2단에 연결되어 있다. 트랜지스터(YscL)의 소스는 전원(VscL)과 연결되어 있고 트랜지스터(YscL)의 드레인은 주사 회로(431)의 제1 입력 단자를 통해 트랜지스터(Scl)의 소스와 연결되어 있다. VscH 전압을 공급하는 전원이 커패시터(CscH)의 제2단에 연결되어 있으며, 이 전원(VscH)과 커패시터(CscH)의 제2단 사이에는 커패시터(CscH)에서 전원(VscH)으로의 전류 경로를 차단하기 위한 다이오드(도시하지 않음)가 연결되어 있을 수 있다. 이때, 트랜지스터(YscL)가 턴온되어 커패시터(CscH)에는 (VscH-VscL) 전압이 충전될 수 있다.
유지 구동부(410)는 전력회수용 커패시터(Cer), 인덕터(L), 다이오드(D1, D2), 트랜지스터(Yr, Yf, Ys, Yg)를 포함한다.
트랜지스터(Yr)의 드레인과 트랜지스터(Yf)의 이미터에 인덕터(L)의 제1단이 연결되어 있고, 인덕터(L)의 제2단에 전력 회수용 커패시터(Cer)의 제1단이 연결되어 있다. 전력 회수용 커패시터(Cer)에는 대략 Vs 전압과 0V 전압의 중간 정도의 전압(Vs/2)이 충전되어 있으며, 전력 회수용 커패시터(Cer)의 제2단은 접지 전원에 연결되어 있다.
다이오드(D2)는 애노드가 트랜지스터(Yf)의 이미터에 연결되고, 캐소드가 다이오드(D1)의 애노드에 연결되어 있으며 또한 주사 회로(431)의 제1 입력 단자를 통해 Y 전극에 연결되어 있다. 다이오드(D1)는 캐소드가 트랜지스터(Yf)의 컬렉터에 연결되고, 애노드가 주사 회로(431)의 제1 입력 단자를 통해 Y 전극에 연결되어 있다.
트랜지스터(Ys)는 드레인이 Vs 전압을 공급하는 전원(Vs)에 연결되고, 소스가 주사 회로(431)를 통해 Y 전극에 연결되어 있다. 트랜지스터(Yg)는 드레인이 다이오드(D1)와 트랜지스터(Yf)의 접점에 연결되고, 소스가 0V 전압을 공급하는 접지 전원(0V)에 연결되어 있다.
이때, 다이오드(D1)는 패널 커패시터(Cp)에서 트랜지스터(Yg)로의 전류 경로가 형성될 수 있도록 하고, 트랜지스터(Yg)에서 트랜지스터(YscL)로의 전류 경로를 차단할 수 있다. 보다 구체적으로, 트랜지스터(YscL)가 턴온될 경우, 트랜지스 터(YscL)를 통해 인가되는 주사 전압(VscL)이 0V 전압보다 낮으므로, 다이오드(D1)가 없으면 트랜지스터(Yg)의 바디 다이오드를 통해 접지 전원, 트랜지스터(Yg)의 바디 다이오드, 트랜지스터(YscL) 및 전원(VscL)으로 전류 경로가 형성될 수 있다. 다이오드(D1)는 트랜지스터(Yg)에서 트랜지스터(YscL)로의 전류 경로를 차단함으로써, 기존에 트랜지스터(Yg)와 트랜지스터(YscL)을 차단하기 위해 사용되던 고가의 트랜지스터를 대신할 수 있다.
다이오드(D2)는 턴온된 트랜지스터(Yf)를 통해 트랜지스터(Yg)에서 Y 전극으로의 전류 경로를 형성한다.
이와 같이, 본 발명의 실시 예에서는 다이오드(D1, D2)를 통해 음극성의 전압(VscL)을 인가하는 트랜지스터(YscL)가 턴온되는 경우 트랜지스터(Yg)의 바디 다이오드와 트랜지스터(YscL)를 통해 접지 전원과 전원(VscL) 사이에 전류 경로가 형성되는 것을 방지할 수 있다.
이 경우, 다이오드(D1)는 트랜지스터(Yg)의 바디 다이오드만큼의 전류 용량을 갖는 다이오드를 사용할 수 있다. 다이오드(D2)는 트랜지스터(Xf)의 전류만 흐르므로, 트랜지스터(Xf)만큼의 전류 용량을 갖는 다이오드를 사용할 수 있다.
한편, 트랜지스터(Yr, Yf)가 바디 다이오드를 가지는 경우 유지 구동부(410)는 다이오드(Dr, Df)를 더 포함할 수 있다.
다이오드(Dr)는 캐소드가 트랜지스터(Yr)의 드레인에 연결되고, 애노드가 인덕터(L)의제1단에 연결되어 있다. 다이오드(Df)는 애노드가 트랜지스터(Yf)의 이미터에 연결되고, 캐소드가 인덕터(L)의 제1단에 연결되어 있다. 다이오드(Dr)는 트 랜지스터(Yr)의 바디 다이오드를 통해 형성될 수 있는 전류 경로를 차단하고, 다이오드(Df)는 트랜지스터(Yf)의 바디 다이오드를 통해 형성될 수 있는 전류 경로를 차단할 수 있다. 이때, 트랜지스터(Yr, Yf)가 바디 다이오드를 가지지 않는다면 다이오드(Dr, Df)가 제거될 수도 있다.
이러한 유지 구동부(411)는 인덕터(L)와 패널 커패시터(Cp)의 공진을 이용하여 Y 전극의 전압을 점진적으로 증가시킨 후 Y 전극에 Vs 전압을 인가하고, LC 공진을 이용하여 Y 전극의 전압을 점진적으로 감소시킨 후 Y 전극에 0V 전압을 인가한다.
한편, 도 3과 달리 인덕터(L)는 제1단이 주사 회로(431)의 제1 입력 단자를 통해 Y 전극에 연결되고, 제2단이 다이오드(D1)의 애노드와 트랜지스터(Yr)의 소스에 연결될 수도 있다. 또한, 도 3에서는 Y 전극의 전압을 상승시키는 공진과 Y 전극의 전압을 감소시키는 공진이 모두 인덕터(L)를 통해서 일어나는 것으로 설명하였지만, 이와는 달리 두 공진이 서로 다른 인덕터를 통해서 일어날 수도 있다. 예를 들면, 하나의 인덕터(도시하지 않음)가 전력 회수용 커패시터(Cer), 다이오드(Dr), 트랜지스터(Yr) 및 패널 커패시터(Cp)로 형성되는 경로 상에 형성되고, 다른 인덕터(도시하지 않음)가 패널 커패시터(Cp), 다이오드(D1), 트랜지스터(Yf), 다이오드(Df) 및 전력 회수용 커패시터(Cer)로 형성되는 경로 상에 형성될 수도 있다.
리셋 구동부(420)는 트랜지스터(Yset, Yfr) 및 제너 다이오드(ZD)를 포함하며, 리셋 기간의 상승 기간에서 Y 전극의 전압을 Vs 전압에서 Vset 전압까지 점진 적으로 증가시키고, 리셋 기간의 하강 기간에서 Y 전극의 전압을 Vs 전압에서 Vnf 전압까지 점진적으로 감소시킨다. 트랜지스터(Yset)는 드레인이 Vset 전압을 공급하는 전원(Vset)에 드레인이 연결되고 소스가 주사 회로(431)의 제1 입력 단자를 통해 Y 전극에 연결되어 있으며, 턴온 시에 Y 전극의 전압이 점진적으로 증가하도록 동작한다. 트랜지스터(Yset)의 바디 다이오드로 인한 전류를 차단하기 위해 트랜지스터(Yset)의 바디 다이오드와 반대 방향으로 다이오드(도시하지 않음)가 형성될 수 있다.
트랜지스터(Yfr)와 제너 다이오드(ZD)는 VscL 전압을 공급하는 전원(VscL)과 주사 회로(431)의 제1 입력 단자 사이에 직렬로 연결되어 있으며, 턴온 시에 Y 전극의 전압이 VscL 전압과 제너 다이오드(ZD)의 항복 전압의 합에 해당하는 전압(Vnf)까지 점진적으로 감소하도록 동작한다. 이와는 달리, 제너 다이오드(ZD)없이 트랜지스터(Yfr)가 Vnf 전압을 공급하는 전원과 주사 회로(431)의 제1 입력 단자 사이에 연결될 수도 있다.
아래에 도 4 내지 도 6에서는 도 3의 구동 회로를 이용하여 도 2의 구동 파형을 생성하는 방법에 대해서 설명한다. 특히, 도 2의 구동 파형 중 어드레스 기간의 일부 기간과 Y 전극과 X 전극에 유지 방전 펄스가 인가되는 유지 기간에 대해서 설명한다.
도 4는 도 2의 구동 파형 중 어드레스 기간과 유지 기간에서의 신호 타이밍을 나타내는 도면이고, 도 5 및 도 6은 도 2의 신호 타이밍에 따른 전류 경로를 나타내는 도면이다.
T1 기간 전에, 트랜지스터(Sch)가 턴온되어 있어 패널 커패시터(Cp)의 Y 전극은 VscH 전압을 유지한다.
도 4를 참고하면, T1 기간에서는 트랜지스터(Sch)가 턴오프되고 트랜지스터(Scl)가 턴온된 상태에서, 트랜지스터(Yg, Yf)를 턴온한다. 그러면, 도 5에 나타낸 바와 같이, 접지 전원(0V), 트랜지스터(Yg, Yf), 다이오드(D2), 트랜지스터(Scl) 및 패널 커패시터(Cp)의 Y 전극으로의 전류 경로가 형성된다(Ⅰ). 이 경로(Ⅰ)에 의해 Y 전극에 0V 전압이 인가된다.
도 2 및 도 4에서는 기간(T1)을 어드레스 기간으로 도시하였으나, 기간(T1)은 어드레스 기간과 유지 기간의 사이 기간일 수 있고, 유지 기간에 포함될 수도 있다.
다음, T2 기간에서는 트랜지스터(Yr)가 턴온되고 트랜지스터(Yg, Yf)가 턴오프된다. 그러면, 도5에 나타낸 바와 같이, 전력회수용 커패시터(Cer), 인덕터(L), 다이오드(Dr), 트랜지스터(Yr), 트랜지스터(Scl) 및 패널 커패시터(Cp)의 Y 전극으로의 전류 경로가 형성된다(Ⅱ). 이 경로(Ⅱ)에 의해 인덕터(L)와패널 커패시터(Cp) 사이에 LC 공진이 발생된다. 이때, 커패시터(Cer)에는 Vs/2 전압이 충전되어 있으므로 LC 공진에 의해 패널 커패시터(Cp)의 Y 전극의 전압이 Vs 전압 근처까지 점진적으로 증가하게 된다.
T3 기간에서는 트랜지스터(Ys)가 턴온되고 트랜지스터(Yr)가 턴오프된다. 그러면, 도 5에 나타낸 바와 같이, 전원(Vs), 트랜지스터(Scl), 패널 커패시터(Cp)의 Y 전극으로의 전류 경로가 형성된다(Ⅲ). 이 경로(Ⅲ)에 의해 Y 전극에 Vs 전압이 인가된다. 한편, T3 기간에서 유지 전극 구동부(500)는 X 전극에 0V 전압을 인가할 수 있다.
T4 기간에서는 트랜지스터(Yf)가 턴온되고 트랜지스터(Ys)가 턴오프된다. 그러면, 도 6에 나타낸 바와 같이, 패널 커패시터(Cp)의 Y 전극, 트랜지스터(Scl), 다이오드(D1), 트랜지스터(Yf), 다이오드(Df), 인덕터(L) 및 전력회수용 커패시터(Cer)로의 전류 경로가 형성된다(Ⅳ). 이 경로(Ⅳ)에 의해 인덕터(L)와패널 커패시터(Cp) 사이에 LC 공진이 발생된다. 이 LC 공진에 의해 패널 커패시터(Cp)에 충전되어 있던 전압이 전력회수용 커패시터(Cer)로 방전되어 패널 커패시터(Cp)의 Y 전극의 전압이 0V 전압 근처까지 감소한다.
T5 기간에서는 트랜지스터(Yg)가 턴온되고 트랜지스터(Yf)가 턴오프된다. 그러면, 도 6에 나타낸 바와 같이, 패널 커패시터(Cp)의 Y 전극, 트랜지스터(Scl), 다이오드(D1), 트랜지스터(Yg) 및 접지 전원(0V)으로의 전류 경로가 형성된다(Ⅴ). 이 경로(Ⅴ)에 의해 Y 전극에 0V 전압이 인가된다. 한편, T5 기간에서 유지 전극 구동부(500)는 X 전극에 Vs 전압을 인가할 수 있다.이와 같은 기간(T2~T5)의 반복으로 Y 전극에 0V 전압과 Vs 전압을 교대로 가지는 유지 방전 펄스가 인가될 수 있다.
이상에서 본 발명의 실시 예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
도 1은 본 발명의 실시 예에 따른 플라즈마 표시 장치의 개략적인 블록도이다.
도 2는 본 발명의 실시 예에 따른 플라즈마 표시 장치의 구동 파형을 나타내는 도면이다.
도 3은 본 발명의 실시 예에 따른 주사 전극 구동부의 개략적인 회로도이다.
도 4는 도 2의 구동 파형 중 어드레스 기간과 유지 기간에서의 신호 타이밍을 나타내는 도면이다.
도 5 및 도 6은 도 2의 신호 타이밍에 따른 전류 경로를 나타내는 도면이다.

Claims (14)

  1. 주사 전극을 포함하는 플라즈마 표시 장치의 구동 장치에 있어서,
    제1 전압을 공급하는 제1 전원과 상기 주사 전극 사이에 연결되는 제1 스위치,
    제1 단자 및 상기 제1 전압보다 높은 제2 전압을 공급하는 제2 전원에 연결되어 있는 제2 단자를 가지며, 턴온 시에 제1 단자에서 제2 단자로 전류 경로가 형성되는 제2 스위치,
    상기 주사 전극에 연결되어 있는 애노드 및 상기 제2 스위치의 제1 단자에 연결되어 있는 캐소드를 가지는 제1 다이오드,
    상기 제1 다이오드와 상기 제2 스위치 사이의 접점에 연결되어 있는 제1 단자 및 전력 회수용 전원에 연결되어 있는 제2 단자를 가지며, 턴온 시에 제1 단자에서 제2 단자로 전류 경로가 형성되는 제3 스위치, 그리고
    상기 제1 다이오드의 애노드에 연결되어 있는 캐소드 및 상기 제3 스위치의 제2 단자에 연결되어 있는 애노드를 가지는 제2 다이오드
    를 포함하는 구동 장치.
  2. 삭제
  3. 제1항에 있어서,
    어드레스 기간에서 상기 제1 스위치가 턴온되어 상기 제1 전압이 상기 주사 전극에 인가되는 구동 장치.
  4. 제1항에 있어서,
    어드레스 기간과 유지 기간 사이에서, 상기 제2 스위치 및 상기 제3 스위치가 턴온되어 상기 주사 전극에 상기 제2 전압이 인가되는 구동 장치.
  5. 제1항에 있어서,
    유지 기간에서, 상기 제3 스위치가 턴온되어 상기 주사 전극의 전압이 감소한 후에, 상기 제2 스위치가 턴온되어 상기 주사 전극에 상기 제2 전압이 인가되는 구동 장치.
  6. 제1항에 있어서,
    상기 전력 회수용 전원과 상기 제3 스위치의 제2 단자 사이에 연결되어 있는 인덕터를 더 포함하는 구동 장치.
  7. 제6항에 있어서,
    상기 제2 전압보다 높은 제3 전압을 공급하는 제3 전원에 연결되어 있는 제1 단자 및 상기 주사 전극에 연결되어 있는 제2 단자를 가지며, 턴온 시에 제1 단자에서 제2 단자로 전류 경로가 형성되는 제4 스위치, 그리고
    상기 전력 회수용 전원에 연결되어 있는 제1 단자 및 상기 주사 전극에 연결되어 있는 제2 단자를 가지며, 턴온 시에 제1 단자에서 제2 단자로 전류 경로가 형성되는 제5 스위치
    를 더 포함하는 구동 장치.
  8. 주사 전극,
    주사 전압을 공급하는 제1 전원과 상기 주사 전극 사이에 연결되어 있는 제1스위치, 그리고
    상기 주사 전극에 연결되어 유지 기간 동안 상기 주사 전압보다 높은 로우 레벨 전압과 상기 로우 레벨 전압보다 높은 하이 레벨 전압을 상기 주사 전극에 교대로 인가하는 유지 구동부
    를 포함하며,
    상기 유지 구동부는,
    제1 단자 및 상기 로우 레벨 전압을 공급하는 제2 전원에 연결되어 있는 제2 단자를 가지며, 턴온 시에 제1 단자에 제2 단자로 전류 경로가 형성되는 제2 스위치,
    상기 주사 전극에 연결되어 있는 제1단과 상기 제2 스위치의 제1 단자에 연결되어 있는 제2단을 가지며, 상기 제2 스위치를 통해 상기 주사 전극에서 상기 제2 전원으로의 전류 경로를 형성하고, 상기 제2 스위치의 제1 단자에서 상기 주사 전극으로의 전류를 차단하는 제1 전류 경로 형성 소자,
    상기 제1 전류 경로 형성 소자의 제2단에 연결되어 있는 제1 단자 및 전력 회수용 전원에 연결되어 있는 제2 단자를 가지며, 턴온 시에 제1 단자에서 제2 단자로 전류 경로가 형성되며 상기 제1 전류 경로 형성 소자를 통하여 상기 주사 전극의 전압을 감소시키는 제3 스위치, 그리고
    상기 제3 스위치의 제2 단자에 연결되어 있는 제1단과 상기 주사 전극에 연결되어 있는 제2단을 가지며, 상기 제2 스위치 및 상기 제3 스위치를 통해 상기 제2 전원에서 상기 주사 전극으로의 전류를 형성하는 제2 전류 경로 형성 소자
    를 포함하는
    플라즈마 표시 장치.
  9. 삭제
  10. 제8항에 있어서,
    상기 제2 전류 경로 형성 소자는 상기 제3 스위치의 제2 단자에 연결되어 있는 애노드와 상기 주사 전극에 연결되어 있는 캐소드를 가지는 제1 다이오드를 포함하는 플라즈마 표시 장치.
  11. 제8항 또는 제10항에 있어서,
    상기 제1 전류 경로 형성 소자는 상기 주사 전극에 연결되어 있는 애노드와 상기 제2 스위치의 제1 단자에 연결되어 있는 캐소드를 가지는 제2 다이오드를 포함하는 플라즈마 표시 장치.
  12. 제8항 또는 제10항에 있어서,
    상기 유지 구동부는
    상기 제3 스위치의 제2 단자와 상기 전력 회수용 전원 사이에 연결되어 있는 인덕터를 더 포함하는 플라즈마 표시 장치.
  13. 제8항 또는 제10항에 있어서,
    어드레스 기간과 유지 기간 사이에서 상기 제2 스위치 및 제3 스위치가 턴온되어 상기 주사 전극에 상기 로우 레벨 전압이 인가되는 플라즈마 표시 장치.
  14. 제8항 또는 제10항에 있어서,
    유지 기간에서, 상기 제3 스위치가 턴온되어 상기 주사 전극의 전압이 감소한 후에 상기 제2 스위치가 턴온되어 상기 주사 전극에 상기 로우 레벨 전압이 인가되는 플라즈마 표시 장치.
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