JPS6061794A - 画面分割表示装置 - Google Patents
画面分割表示装置Info
- Publication number
- JPS6061794A JPS6061794A JP58170973A JP17097383A JPS6061794A JP S6061794 A JPS6061794 A JP S6061794A JP 58170973 A JP58170973 A JP 58170973A JP 17097383 A JP17097383 A JP 17097383A JP S6061794 A JPS6061794 A JP S6061794A
- Authority
- JP
- Japan
- Prior art keywords
- display
- image information
- information memory
- window
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/14—Display of multiple viewports
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Digital Computer Display Output (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く技術分野〉
本発明は、画像情報メモリの任意領域をディスプレイ画
面の任意の位置に表示することかできるウィンドウを複
数持つパーソナルコンピュータに関するものである。
面の任意の位置に表示することかできるウィンドウを複
数持つパーソナルコンピュータに関するものである。
〈従来技術〉
従来、ビットマツプディスプレイ方式を採用しているパ
ーソナルコンピュータにおいて、ディスプレイ画面の任
意O号形区間の表示を反転させたり、ブリンクさせたり
するには、画像情報メモリを書き換える必要があり、非
常に長い時間を要した。
ーソナルコンピュータにおいて、ディスプレイ画面の任
意O号形区間の表示を反転させたり、ブリンクさせたり
するには、画像情報メモリを書き換える必要があり、非
常に長い時間を要した。
〈発明の目的〉
本発明は上記従来の問題点を解決することを目的として
なされたものであり、画像情報メモリの任意の領域をデ
ィスプレイ画面の任意の位置に表示できるウィンドウに
対して、その表示を瞬時にしてプログラムで反転させる
ことができるようにつを割り当てることにより、瞬時に
して行うことができる。
なされたものであり、画像情報メモリの任意の領域をデ
ィスプレイ画面の任意の位置に表示できるウィンドウに
対して、その表示を瞬時にしてプログラムで反転させる
ことができるようにつを割り当てることにより、瞬時に
して行うことができる。
〈実施例〉
従来のディスプレイ回路は第3図に示すようにアドレス
カウンタ1、画像情報メモリ2、表示タイミング回路3
、水平・垂直タイミング回路4から成っており(5はデ
ィスプレイ、6は)くスラインである)、アドレスカウ
ンタによって順に示された画像情報メモリの内容がタイ
ミングの制御を受けてディスプレイに表示されるという
仕組みになっている。このようにアドレスカウンタは画
像情報メモリを順番にしか示さないので第1図(a)(
b)のようなディスプレイ画面を表示させようとすると
当然画像情報メモリの内容もディスプレイ画面と同じも
のでなくてはならなかった。
カウンタ1、画像情報メモリ2、表示タイミング回路3
、水平・垂直タイミング回路4から成っており(5はデ
ィスプレイ、6は)くスラインである)、アドレスカウ
ンタによって順に示された画像情報メモリの内容がタイ
ミングの制御を受けてディスプレイに表示されるという
仕組みになっている。このようにアドレスカウンタは画
像情報メモリを順番にしか示さないので第1図(a)(
b)のようなディスプレイ画面を表示させようとすると
当然画像情報メモリの内容もディスプレイ画面と同じも
のでなくてはならなかった。
以下に説明するウィンドウ機能を用いることにより、+
i!lii像情報メモリはディスプレイ画面と同一でな
くてよく、第2図に示すように画像情報メモリの部分々
々を重ね合せて表示することができる。
i!lii像情報メモリはディスプレイ画面と同一でな
くてよく、第2図に示すように画像情報メモリの部分々
々を重ね合せて表示することができる。
ウィンドウ機能は第4図のように従来のアドレスカウン
タ1と画像情報メモリ2との間にアドレス変換回路7を
置くことによって実現される。すなわち、従来のように
順番に画像情報メモリを示すのではなく、画像情報メモ
リを示すアドレスを任意に変換して画像情メモリの任意
の場所を示し表示させるのである。
タ1と画像情報メモリ2との間にアドレス変換回路7を
置くことによって実現される。すなわち、従来のように
順番に画像情報メモリを示すのではなく、画像情報メモ
リを示すアドレスを任意に変換して画像情メモリの任意
の場所を示し表示させるのである。
このアドレス変換回路を少しくわしく描くと第5図のよ
うになる。ここでアドレス変換の仕組みを第6図で説明
する(同図(a)は画像情報メモリの内容を示し、(b
)はディスプレイ画面を示す)。従来のディスプレイ回
路では、表示スタートアドレスをSADとするとSAD
からディスプレイ画面に対応する部分(第6図面像情報
メモリの点線より上の部分)がそのまま表示されるわけ
である。
うになる。ここでアドレス変換の仕組みを第6図で説明
する(同図(a)は画像情報メモリの内容を示し、(b
)はディスプレイ画面を示す)。従来のディスプレイ回
路では、表示スタートアドレスをSADとするとSAD
からディスプレイ画面に対応する部分(第6図面像情報
メモリの点線より上の部分)がそのまま表示されるわけ
である。
そこで第6図(b)のディスプレイ画面を表示させるに
はBの領域にAの領域がくるようにすればよい。
はBの領域にAの領域がくるようにすればよい。
つまりBを示しているアドレスをAに示し換えてやれば
よいのである。今、Bの領域の先頭アドレスをa、、A
の領域の先頭アドレスをa′とする。壕だ a’ −a−α とする。ここでアドレスカウンタがSADからスタート
してaになった時バイアス値αを加算すれば a+α=a′ となり、Bの領域にAの領域の内容が表示され第6図の
ディスプレイ画面と々るのである。しかし、これだけで
は、Aの領域がどこからどこまでなのかを示す境界情報
が無いのでディスプレイ画面は領域Aとその捷わシー画
面分を表示するだけである○ そこで、その境界を決定する為に第5図の列アドレスカ
ウンタ11、列マツプRAM12、行アドレスカウンタ
13、行マツプRAM14 、プライオリティ・レジス
タ15、ウィンドウ選択回路16が設けられている。列
アドレスカウンタ11は表示クロックDISPCLOC
Kをカウンタのクロック信号に、水平及”び垂直のBL
ANK信号をリセット信号にしてディスプレイ画面の横
方向をカウントしているカウンタである。一方、行アド
レスカウンタ13は水平及び垂直のBLANK信号をク
ロック信号に、垂直同期信号(VSYNC)をリセット
信号にしてディスプレイ画面の縦方向をカウントしてい
るカウンターである。また列マツプRAM12、行マツ
プRAM14の2つのRAMは第7図のように各ウィン
ドウW。〜W3の境界を横方向・縦方向に分割して記憶
させておく画面境界メモリである。
よいのである。今、Bの領域の先頭アドレスをa、、A
の領域の先頭アドレスをa′とする。壕だ a’ −a−α とする。ここでアドレスカウンタがSADからスタート
してaになった時バイアス値αを加算すれば a+α=a′ となり、Bの領域にAの領域の内容が表示され第6図の
ディスプレイ画面と々るのである。しかし、これだけで
は、Aの領域がどこからどこまでなのかを示す境界情報
が無いのでディスプレイ画面は領域Aとその捷わシー画
面分を表示するだけである○ そこで、その境界を決定する為に第5図の列アドレスカ
ウンタ11、列マツプRAM12、行アドレスカウンタ
13、行マツプRAM14 、プライオリティ・レジス
タ15、ウィンドウ選択回路16が設けられている。列
アドレスカウンタ11は表示クロックDISPCLOC
Kをカウンタのクロック信号に、水平及”び垂直のBL
ANK信号をリセット信号にしてディスプレイ画面の横
方向をカウントしているカウンタである。一方、行アド
レスカウンタ13は水平及び垂直のBLANK信号をク
ロック信号に、垂直同期信号(VSYNC)をリセット
信号にしてディスプレイ画面の縦方向をカウントしてい
るカウンターである。また列マツプRAM12、行マツ
プRAM14の2つのRAMは第7図のように各ウィン
ドウW。〜W3の境界を横方向・縦方向に分割して記憶
させておく画面境界メモリである。
ウィンドウ選択回路16は第8図のようになっている。
21.22のTフリソゲフロップは列1行のマツプRA
’MからのデータRow MAP Data。
’MからのデータRow MAP Data。
Column MAP Dataが1になり次の1が来
るまで出力QがlK’&るようになっている。次の23
のアンドゲートは、81.82出力が共に1になる部分
、つまり第7図の各ウィンドウの領域で1になるように
なっている。ウィンドウが4枚の時には21〜23が4
組必要となる。以上の回路を通るとある部分ではウィン
ドウが複数枚重なることがある。ここで15のプライオ
リティレジスタで指定された優先順位に従って重ね合せ
の上下を決定するのが24の優先順位回路である。優先
順位回路を通ると、ある瞬間にはウィンドウは多くとも
1つ選択され(So−83はウィンドウ選択信号である
)、選択されたウィンドウ番号に対応するバイアスレジ
スタ17o〜173がマルチプレクサ18で選択され、
その記憶内容であるバイアス値α。〜α3が、前段のア
ドレスカウンタからのアドレスaに加算され(全加算器
19により)、アドレスa′となり画像情報メモリを示
しウィンドウを表示するのである。
るまで出力QがlK’&るようになっている。次の23
のアンドゲートは、81.82出力が共に1になる部分
、つまり第7図の各ウィンドウの領域で1になるように
なっている。ウィンドウが4枚の時には21〜23が4
組必要となる。以上の回路を通るとある部分ではウィン
ドウが複数枚重なることがある。ここで15のプライオ
リティレジスタで指定された優先順位に従って重ね合せ
の上下を決定するのが24の優先順位回路である。優先
順位回路を通ると、ある瞬間にはウィンドウは多くとも
1つ選択され(So−83はウィンドウ選択信号である
)、選択されたウィンドウ番号に対応するバイアスレジ
スタ17o〜173がマルチプレクサ18で選択され、
その記憶内容であるバイアス値α。〜α3が、前段のア
ドレスカウンタからのアドレスaに加算され(全加算器
19により)、アドレスa′となり画像情報メモリを示
しウィンドウを表示するのである。
更に、表示タイミング回路は、第9図に示されるように
、ウィンドウ毎にノーマル/リバースの切シ換えをI
10ボート31から指定できるようになっている。32
はウィンドウ切換回路である。
、ウィンドウ毎にノーマル/リバースの切シ換えをI
10ボート31から指定できるようになっている。32
はウィンドウ切換回路である。
第5図に示される列マツプRAMI 2、行マツプRA
MI4、プライオリティ ・レジスタ15、バイアスレ
ジスタ178〜173は、プログラムで自由に書き換え
られるので、第9図の■/。ポート31をププログラム
で設定することにより、ディスプレイ効 画面上の任意の枠形区間の表示を反転(リバース)させ
たり、ブリンクさせたりすることが、画像情報メモリの
書き換えなしで可能となシ、瞬時に行うことができる。
MI4、プライオリティ ・レジスタ15、バイアスレ
ジスタ178〜173は、プログラムで自由に書き換え
られるので、第9図の■/。ポート31をププログラム
で設定することにより、ディスプレイ効 画面上の任意の枠形区間の表示を反転(リバース)させ
たり、ブリンクさせたりすることが、画像情報メモリの
書き換えなしで可能となシ、瞬時に行うことができる。
例えば、第7図に示すW。、W3→リバース表示、W工
、W2−ノーマル表示とするときは、■10ボート31
の内容を、第10図のように設定する。また、Wo、W
1→ブリンク表示、W2→ノーマル表示、W3→リバー
ス表示とするときは、所定時間毎に、Iロポートが第1
1図(1) 、 (2)の内容を交互にとるようにする
。
、W2−ノーマル表示とするときは、■10ボート31
の内容を、第10図のように設定する。また、Wo、W
1→ブリンク表示、W2→ノーマル表示、W3→リバー
ス表示とするときは、所定時間毎に、Iロポートが第1
1図(1) 、 (2)の内容を交互にとるようにする
。
〈効果〉
転表示(リバース表示)可能となるものである。
第1図(a) 、 (b)はマルチウィンドウ表示の例
を示す図である。第2図は本発明の説明に供する図であ
り、(a)は画像情報メモリの内容を、まだ(b)はデ
ィスプレイ画面を示す。第3図は従来のディスプレイ回
路を示すブロック図である。第4図は本発明に係るディ
スプレイ回路を示すブロック図である。第5図は第4図
に示すアドレス変換回路の具体的構成を示すブロック図
である。第6図はアドレス変換の説明に供する図であり
、(a)は画像情報メモリの内容を、また(b)はディ
スプレイ画面を示す。第7図は第5図に示す列及び行マ
ツプRA、 Mの説明に供する図である。第8図は第5
図に示すウィンドウ選択回路16の具体的構成を示すブ
ロック図である。第9図は表示タイミング回路の説明に
供するブロック図である。第10図及び第11図(1)
、 (2)は本発明の動作説明に供する図である。 符号の説明 ■、アドレスカウンタ、2:画像情報メモリ、3:表示
タイミング回路、4:水平垂直タイミング回路、5:デ
ィスプレイ、6:バスライン、7:アドレス変換回路、
11:列アドレスカウンタ、12:列マツプRAM、1
3 :行アドレスカウンタ114:行マツプRAM、1
5ニブシイオリティレジスタ、16:ウィンドウ選択回
路、178〜173:バイアスレジスタ、18:マルチ
プーレクサ、19:全加算器、21,22:Tフリップ
フロップ、23:アンドゲート、24:優先順位回路、
31:110ポート、32:ウィンドウ切換回路。 代理人 弁理士 福 士 愛 彦(他2名)(oノ 乙
りノ 第1図 第3図
を示す図である。第2図は本発明の説明に供する図であ
り、(a)は画像情報メモリの内容を、まだ(b)はデ
ィスプレイ画面を示す。第3図は従来のディスプレイ回
路を示すブロック図である。第4図は本発明に係るディ
スプレイ回路を示すブロック図である。第5図は第4図
に示すアドレス変換回路の具体的構成を示すブロック図
である。第6図はアドレス変換の説明に供する図であり
、(a)は画像情報メモリの内容を、また(b)はディ
スプレイ画面を示す。第7図は第5図に示す列及び行マ
ツプRA、 Mの説明に供する図である。第8図は第5
図に示すウィンドウ選択回路16の具体的構成を示すブ
ロック図である。第9図は表示タイミング回路の説明に
供するブロック図である。第10図及び第11図(1)
、 (2)は本発明の動作説明に供する図である。 符号の説明 ■、アドレスカウンタ、2:画像情報メモリ、3:表示
タイミング回路、4:水平垂直タイミング回路、5:デ
ィスプレイ、6:バスライン、7:アドレス変換回路、
11:列アドレスカウンタ、12:列マツプRAM、1
3 :行アドレスカウンタ114:行マツプRAM、1
5ニブシイオリティレジスタ、16:ウィンドウ選択回
路、178〜173:バイアスレジスタ、18:マルチ
プーレクサ、19:全加算器、21,22:Tフリップ
フロップ、23:アンドゲート、24:優先順位回路、
31:110ポート、32:ウィンドウ切換回路。 代理人 弁理士 福 士 愛 彦(他2名)(oノ 乙
りノ 第1図 第3図
Claims (1)
- 1、画像情報メモリの任意の領域をディスプレイ画面の
任意の位置に表示することができるウィンドウを複数持
つパーソナルコンピュータにおいて、画像情報メモリの
内容を書き換えることなしに、ウィンドウ単位に瞬時に
表示を反転させるだめの手段を設けたことを特徴とする
パーソナルコンピュータ。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58170973A JPS6061794A (ja) | 1983-09-14 | 1983-09-14 | 画面分割表示装置 |
US06/647,527 US4694288A (en) | 1983-09-14 | 1984-09-05 | Multiwindow display circuit |
GB08422800A GB2147772B (en) | 1983-09-14 | 1984-09-10 | Multiwindow display circuit |
DE19843433868 DE3433868A1 (de) | 1983-09-14 | 1984-09-14 | Schaltungsanordnung zur darstellung von bildern in unterschiedlichen bildbereichen eines bildfeldes |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58170973A JPS6061794A (ja) | 1983-09-14 | 1983-09-14 | 画面分割表示装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6061794A true JPS6061794A (ja) | 1985-04-09 |
JPH0131195B2 JPH0131195B2 (ja) | 1989-06-23 |
Family
ID=15914789
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58170973A Granted JPS6061794A (ja) | 1983-09-14 | 1983-09-14 | 画面分割表示装置 |
Country Status (4)
Country | Link |
---|---|
US (1) | US4694288A (ja) |
JP (1) | JPS6061794A (ja) |
DE (1) | DE3433868A1 (ja) |
GB (1) | GB2147772B (ja) |
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