JPS60171744A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPS60171744A
JPS60171744A JP59027100A JP2710084A JPS60171744A JP S60171744 A JPS60171744 A JP S60171744A JP 59027100 A JP59027100 A JP 59027100A JP 2710084 A JP2710084 A JP 2710084A JP S60171744 A JPS60171744 A JP S60171744A
Authority
JP
Japan
Prior art keywords
package
semiconductor device
substrate
present
projections
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59027100A
Other languages
English (en)
Inventor
Hisafumi Yoshida
吉田 寿文
Chie Kawashita
川下 智恵
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Microcomputer System Ltd
Hitachi Ltd
Original Assignee
Hitachi Ltd
Hitachi Microcomputer Engineering Ltd
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Filing date
Publication date
Application filed by Hitachi Ltd, Hitachi Microcomputer Engineering Ltd filed Critical Hitachi Ltd
Priority to JP59027100A priority Critical patent/JPS60171744A/ja
Publication of JPS60171744A publication Critical patent/JPS60171744A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/303Surface mounted components, e.g. affixing before soldering, aligning means, spacing means
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/341Surface mounted components
    • H05K3/3421Leaded components
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02PCLIMATE CHANGE MITIGATION TECHNOLOGIES IN THE PRODUCTION OR PROCESSING OF GOODS
    • Y02P70/00Climate change mitigation technologies in the production process for final industrial or consumer products
    • Y02P70/50Manufacturing or production processes characterised by the final manufactured product

Landscapes

  • Engineering & Computer Science (AREA)
  • Manufacturing & Machinery (AREA)
  • Microelectronics & Electronic Packaging (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔技術分野〕 本発明は半導体装置、特に、被実装体に対して面実装さ
れる半導体装置に適用して有効な技術に関する。
〔背景技術〕
半導体装置のうち、面実装により基板等の被実装体に装
着される半導体装置は高密度実装に適しているが、基板
への半田付は実装時の作業性が悪いという問題があった
(たとえば)工業調査会1980年発行、FIC化実装
技術jp140など)。
これは、半導体装置に位置合せ用の目印が存在しないの
で、位置合せに時間がかかるためであり、また半田付は
前に予め接着材で基板上にパッケージ部分を固定するた
めの接着剤の使用によりコストの上昇を来たすという問
題のあることが本発明者によって見い出された。
〔発明の目的〕
本発明の目的は、被実装体の実装位置に対する位置合せ
の容易な半導体装置を提供することにある。
本発明の前記ならびにその他の目的と新規な特徴は、本
明細書の記述および添付図面から明らかになるであろう
〔発明の概要〕
本願において開示される発明のうち代表的なものの概要
を簡単に説明すれば、次の通りである。
すなわち、パッケージの実装面に、被実装体への位置合
せ用の突起または凹部な設けることにより、パッケージ
と被実装体との位置合せを容易にすることができるもの
である。
〔実施例1〕 第1図は本発明による半導体装置の一実施例を示す側面
図、第2図はその裏面図、第3図はその基板への実装状
態を示す部分断面図である。
この実施例では、半導体装置1はいわゆるフラットバッ
クパッケージ型のものであり、そのパッケージ2は樹脂
、セラミック等まで形成され、該パッケージ2の側面か
ら四方向に外部リード3が突出している。
このパッケージ2の裏面すなわち被実装体たとえば基板
4への実装面には、任意の個数、本実施例では2個の位
置合せ用の突起5が設けられている。
したがって、本実施例の半導体装置1を被実装体である
基板4に実装する場合、基板4にパッケージ2の突起5
と適合(嵌合)する孔6を打抜き等で形成おけば、単に
突起5を孔6に対して挿入するだけでパッケージ2の位
置合せを容易に行うことができる。
〔実施例2〕 第4図は本発明の半導体装置をキャリアでの搬送に適用
した例の部分断面図である。
この例では、キャリア7の凹み8内に収容された半導体
装置1の突起5はキャリア7に形成した孔9に対して挿
入されることにより正確な位置合せおよび固定が可能で
あり、搬送中のパッケージ2の位置ずれKよる外部リー
ド30曲がりや隣接リードとの接触等も防止できる。な
お、キャリア7に蓋を用けたり、パッケージ2を上方か
ら押えつける手段な用けたりすることもできる。
〔実施例3〕 第5図は本発明の他の実施例によるパッケージの裏面図
である。
この実施例では、パッケージ2の裏面の中心位置に1つ
だけ位置合せ用の突起5が設けられている。
〔実施例4〕 第6図は本発明のさらに他の実施例によるパッケージの
裏面図である。
この実施例のパッケージ2の裏面には、その長さ方向お
よび幅方向の中心線CLa、CLw よりも外れた位置
に突起5が1個だけ設けられている。
したがって、このパッケージ2は、その実装方向が正し
くない場合は基板4上への実装が不可能であり、いわゆ
る逆挿しが不可能であるので、方向性のあるものについ
て極めて有効である。
〔実施例5〕 第7図は本発明のさらに他の実施例を示すパッケージの
裏面図である。
この実施例では、パッケージ2の裏面の突起は5人と5
Bで示すようにそれぞれ大きさが異なり、パッケージ幅
方向の中心IJCLw に対して非対称であるので、パ
ッケージ2の実装方向が間違っている場合には実装不可
能であり、逆挿しの防止を図ることができる。
〔実施例6〕 第8図は本発明のさらに他の実施例を示すパッケージの
裏面図である。
この場合、パッケージ2の裏面の2個の突起5はパッケ
ージ2の長さ方向の中心線CLa に対して片側にずれ
ており、非対称である。
したがって、この場合も、実装方向の誤りを防止できる
〔実施例7〕 第9図は本発明のさらに他の実施例を示すパッケージの
裏面図である。
本実施例のパッケージ2の裏面の位置合わせ用突起5は
3角形状に3個設けられており、長さ方向の中心線C’
La に対して非対称であり、実装方向の間違いを防止
できる。
〔実施例8〕 第10図は本発明のさらに他の実施例を示すパッケージ
の裏面図である。
この実施例では、パッケージ2の裏面の突起5Cと5D
は同一方向の半円形状であり、幅方向の中心線CLwに
対して非対称であるので、実装方向の誤りを防止できる
〔実施例9〕 第11図は本発明のさらに他の実施例を示す側面図であ
る。
本実施例の半導体装置IAはいわゆるチップキャリア型
の構造であり、パッケージ2人の周囲および裏面にリー
ド用の導電層3Aを持つものである。このパッケージ2
人の裏面には、適当な個数および配置の位置合せ用の穴
10が形成されている。
この場合、被実装体である基板4Aには、穴10と対応
して突起11が形成され、穴10と突起11により、実
装時の位置合せを容易に行うことができる。
〔効 果〕
(1)面実装型のパッケージよりなる半導体装置の実装
面に位置合せ用の突起または穴を設けることにより、面
実装を極めて簡単かつ容易に行うことができる。
(2) 前記[11により、作業効率が向上する。
(3)接着剤を用いる必要がなく面実装できるので、コ
スト的に有利である。
(4) 突起または穴の個数、大きさ、配置等を変えて
パッケージの長さ方向または幅方向の中心線に対して非
対称とすることにより、実装方向の誤りを防止できる。
+53 本発明を搬送用のキャリアに適用すれば、リー
ドの曲り等を生じることなく搬送を行うことが可能であ
る。
(6)突起により、パッケージの放熱効果を向上できる
以上本発明者によってなされた発明を実施例にもとづき
具体的に説明したが、本発明は前記実施例に限定される
ものではなく、その要旨を逸脱しない範囲で種々変更可
能であることはいうまでもない。
たとえば、突起または穴の個数、大きさ、形状。
配置等は様々なものにすることができる。
〔利用分野〕
以上の説明では主として本発明者によってなされた発明
をその背景となった利用分野であるフラットパッケージ
およびフリップチップ型パッケージよりなる半導体装置
に適用した場合について説明した場合について説明した
が、それに限定されるものではな(、たとえば、他の面
実装型の半導体装置にも広(適用できる。
【図面の簡単な説明】
第1図は本発明による一実施例である半導体装置の側面
図、 第2図はその裏面図、 第3図は基板への実装状態の部分断面図、第4図はキャ
リアで搬送する場合の部分断面図、第5図〜第10図は
本発明に用いられるパッケージの各種実施例の裏面図、 第11図は本発明のさらに他の実施例の側面図である。 1、IA・・・半導体装置、2,2人・・・パッケージ
、3・・・外部リード、3人・・・導電層、4,4A・
・・基板(被実装体)、5,5A、5B、5C,5D・
・・位置合せ用の突起、6・・・孔、7・・・キャリア
(被実装体)、8・・・凹み、9・・・、孔、10・・
・位置合せ用の穴、11・・・突起。

Claims (1)

  1. 【特許請求の範囲】 1、面実装されるパンケージよりなる半導体装置におい
    て、パンケージの実装面に、被実装体への位置合せ用の
    突起または凹部な設けたことを特徴とする半導体装置。 2 前記突起または凹部がパッケージの長さ方向または
    幅方向の中心線に対して非対称に設けられていることを
    特徴とする特許請求の範囲第1項記載の半心体装拗。
JP59027100A 1984-02-17 1984-02-17 半導体装置 Pending JPS60171744A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59027100A JPS60171744A (ja) 1984-02-17 1984-02-17 半導体装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59027100A JPS60171744A (ja) 1984-02-17 1984-02-17 半導体装置

Publications (1)

Publication Number Publication Date
JPS60171744A true JPS60171744A (ja) 1985-09-05

Family

ID=12211660

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59027100A Pending JPS60171744A (ja) 1984-02-17 1984-02-17 半導体装置

Country Status (1)

Country Link
JP (1) JPS60171744A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63140637U (ja) * 1987-03-04 1988-09-16

Cited By (1)

* Cited by examiner, † Cited by third party
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