JPH11233765A - 半導体装置および半導体装置の製造方法 - Google Patents
半導体装置および半導体装置の製造方法Info
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- JPH11233765A JPH11233765A JP10029865A JP2986598A JPH11233765A JP H11233765 A JPH11233765 A JP H11233765A JP 10029865 A JP10029865 A JP 10029865A JP 2986598 A JP2986598 A JP 2986598A JP H11233765 A JPH11233765 A JP H11233765A
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
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- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
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Abstract
(57)【要約】
【課題】本発明は、ストライプ状のトレンチゲートを有
するIGBTにおいて、一方向にのみ応力が集中するの
を緩和して、リーク電流の発生や結晶欠陥の発生を防止
できるようにすることを最も主要な特徴とする。 【解決手段】たとえば、IGBT10の終端領域11内
を、配線領域14により、1つのゲートパッド領域12
と3つの素子領域13a,13b,13cとに分割す
る。そして、それぞれに形成されるトレンチゲート15
の向きが、各素子領域13a,13b,13c間で互い
に直交するように、各素子領域13a,13b,13c
を配置する。こうして、各素子領域13a,13b,1
3cにおけるトレンチゲート15の向きを互いに直交さ
せることで、トレンチゲート15のストライプ方向と直
交する一方向のみに集中していた応力の方向を、全体で
略平均化できるようにする構成となっている。
するIGBTにおいて、一方向にのみ応力が集中するの
を緩和して、リーク電流の発生や結晶欠陥の発生を防止
できるようにすることを最も主要な特徴とする。 【解決手段】たとえば、IGBT10の終端領域11内
を、配線領域14により、1つのゲートパッド領域12
と3つの素子領域13a,13b,13cとに分割す
る。そして、それぞれに形成されるトレンチゲート15
の向きが、各素子領域13a,13b,13c間で互い
に直交するように、各素子領域13a,13b,13c
を配置する。こうして、各素子領域13a,13b,1
3cにおけるトレンチゲート15の向きを互いに直交さ
せることで、トレンチゲート15のストライプ方向と直
交する一方向のみに集中していた応力の方向を、全体で
略平均化できるようにする構成となっている。
Description
【0001】
【発明の属する技術分野】この発明は、半導体装置およ
び半導体装置の製造方法に関するもので、特に、複数の
ゲート電極を有する絶縁ゲート型の半導体装置に用いら
れるものである。
び半導体装置の製造方法に関するもので、特に、複数の
ゲート電極を有する絶縁ゲート型の半導体装置に用いら
れるものである。
【0002】
【従来の技術】従来より、複数のゲート電極を有する絶
縁ゲート型の半導体装置としては、IGBT(Insulate
d Gate Bipolar Transistor )が良く知られている。I
GBTでは、オン抵抗やターンオフ損失、限界遮断電流
などの関係から、ゲート電極として、ストライプ状のト
レンチゲート構造が多く採用されている。
縁ゲート型の半導体装置としては、IGBT(Insulate
d Gate Bipolar Transistor )が良く知られている。I
GBTでは、オン抵抗やターンオフ損失、限界遮断電流
などの関係から、ゲート電極として、ストライプ状のト
レンチゲート構造が多く採用されている。
【0003】図6は、ストライプ状のトレンチゲート構
造を採用する、従来のIGBTの構成の要部を概略的に
示すものである。このIGBT100は、たとえば、N
型ベース層101下にP型エミッタ層102が設けられ
たシリコン基板の、上記N型ベース層101上にP型ベ
ース層103が設けられている。このP型ベース層10
3の表面部には、複数のN型ソース領域104が選択的
に設けられている。
造を採用する、従来のIGBTの構成の要部を概略的に
示すものである。このIGBT100は、たとえば、N
型ベース層101下にP型エミッタ層102が設けられ
たシリコン基板の、上記N型ベース層101上にP型ベ
ース層103が設けられている。このP型ベース層10
3の表面部には、複数のN型ソース領域104が選択的
に設けられている。
【0004】また、P型ベース層103の表面部には、
選択的に、上記N型ソース領域104および上記P型ベ
ース層103をそれぞれ貫通し、かつ、上記N型ベース
層101に達する深さのトレンチ105が形成されてい
る。各トレンチ105は、図示断面方向と直交する方向
にそれぞれストライプ状に、かつ、ほぼ同一の長さで設
けられている。
選択的に、上記N型ソース領域104および上記P型ベ
ース層103をそれぞれ貫通し、かつ、上記N型ベース
層101に達する深さのトレンチ105が形成されてい
る。各トレンチ105は、図示断面方向と直交する方向
にそれぞれストライプ状に、かつ、ほぼ同一の長さで設
けられている。
【0005】そして、各トレンチ105内には、絶縁ゲ
ート膜106を介して、低抵抗化されたポリシリコンが
埋め込まれて、トレンチ型のゲート電極(トレンチゲー
ト)107がそれぞれ形成されている。各トレンチゲー
ト107の上部には、上記N型ソース領域104の上面
の一部をそれぞれ含んで絶縁酸化膜108が設けられて
いる。
ート膜106を介して、低抵抗化されたポリシリコンが
埋め込まれて、トレンチ型のゲート電極(トレンチゲー
ト)107がそれぞれ形成されている。各トレンチゲー
ト107の上部には、上記N型ソース領域104の上面
の一部をそれぞれ含んで絶縁酸化膜108が設けられて
いる。
【0006】さらに、全面を被覆するようにして、その
絶縁酸化膜108の上部を含む、上記P型ベース領域1
03上にはエミッタ電極109が、また、上記シリコン
基板の、上記P型エミッタ層102の下面にはコレクタ
電極110が、それぞれ設けられてなる構成とされてい
る。
絶縁酸化膜108の上部を含む、上記P型ベース領域1
03上にはエミッタ電極109が、また、上記シリコン
基板の、上記P型エミッタ層102の下面にはコレクタ
電極110が、それぞれ設けられてなる構成とされてい
る。
【0007】ところで、このような構成のIGBT10
0は、たとえば図7に示すように、すべてのトレンチゲ
ート107の向きが同一方向となるようにして、上記シ
リコン基板上にそれぞれ形成されるようになっている。
0は、たとえば図7に示すように、すべてのトレンチゲ
ート107の向きが同一方向となるようにして、上記シ
リコン基板上にそれぞれ形成されるようになっている。
【0008】すなわち、IGBT100の終端領域20
1内は、たとえば、1つのゲートパッド領域201aと
複数(この場合、3つ)の素子領域201bとに分割さ
れている。素子領域201bの相互間は、上記ゲートパ
ッド領域201aからのポリシリコン配線を引き回すた
めの配線領域201cとなっている。
1内は、たとえば、1つのゲートパッド領域201aと
複数(この場合、3つ)の素子領域201bとに分割さ
れている。素子領域201bの相互間は、上記ゲートパ
ッド領域201aからのポリシリコン配線を引き回すた
めの配線領域201cとなっている。
【0009】通常、各素子領域201b内においては、
上記ポリシリコン配線とのボンディング性などを考慮し
て、いずれも、トレンチゲート107の向きがそれぞれ
同一方向(ここでは、図示水平方向)となるように、ト
レンチ105が形成されている(たとえば、図中のa線
に沿う断面が図6に対応している)。
上記ポリシリコン配線とのボンディング性などを考慮し
て、いずれも、トレンチゲート107の向きがそれぞれ
同一方向(ここでは、図示水平方向)となるように、ト
レンチ105が形成されている(たとえば、図中のa線
に沿う断面が図6に対応している)。
【0010】しかしながら、上記した構成のIGBT1
00は、その製造プロセスにおいて、トレンチ105内
にポリシリコンを埋め込んだ後に、高温の熱処理を施す
ようになっている。その際、トレンチ105内はポリシ
リコンで埋め込まれているため、このポリシリコンとシ
リコン基板との間に応力が働く。これは、常温に戻した
後も、残留応力として残ることになる。
00は、その製造プロセスにおいて、トレンチ105内
にポリシリコンを埋め込んだ後に、高温の熱処理を施す
ようになっている。その際、トレンチ105内はポリシ
リコンで埋め込まれているため、このポリシリコンとシ
リコン基板との間に応力が働く。これは、常温に戻した
後も、残留応力として残ることになる。
【0011】トレンチゲート107の断面方向の配置ピ
ッチL1 (図6参照)は5μm程度であり、断面方向と
直交する、ストライプ方向のトレンチゲート107の長
さは数mm程度となっている。この場合、トレンチゲー
ト107に垂直な断面方向(図示矢印A方向)の応力
は、各トレンチゲート107での応力の総和となり、ト
レンチゲート107に水平なストライプ方向(図示矢印
B方向)の応力よりも強いものとなる。
ッチL1 (図6参照)は5μm程度であり、断面方向と
直交する、ストライプ方向のトレンチゲート107の長
さは数mm程度となっている。この場合、トレンチゲー
ト107に垂直な断面方向(図示矢印A方向)の応力
は、各トレンチゲート107での応力の総和となり、ト
レンチゲート107に水平なストライプ方向(図示矢印
B方向)の応力よりも強いものとなる。
【0012】したがって、特に、大面積で、かつ、トレ
ンチゲート107の本数の多いIGBT100の場合に
は、トレンチゲート107に垂直な断面方向(図示矢印
A方向)に集中する応力に起因して、リーク電流や結晶
欠陥が発生しやすいという問題があった。
ンチゲート107の本数の多いIGBT100の場合に
は、トレンチゲート107に垂直な断面方向(図示矢印
A方向)に集中する応力に起因して、リーク電流や結晶
欠陥が発生しやすいという問題があった。
【0013】また、この種のIGBT100の製造にお
いては、たとえば図8に示すように、一枚のウェーハ3
00上に複数のIGBTペレット(P)301を形成
し、それをIGBTペレット301ごとに分割すること
で、同時に複数のIGBT100を得るのが一般的とな
っている。
いては、たとえば図8に示すように、一枚のウェーハ3
00上に複数のIGBTペレット(P)301を形成
し、それをIGBTペレット301ごとに分割すること
で、同時に複数のIGBT100を得るのが一般的とな
っている。
【0014】しかしながら、従来は、各IGBTペレッ
ト301がすべて同じ向き(Pの向きで示す)となるよ
うに、それぞれ、ウェーハ300上に形成されるように
なっている。つまり、トレンチゲート107の向きが同
一方向とされた複数のIGBT100が、すべて同じ向
き(この場合、トレンチゲート107の向きは図示矢印
B方向に一致)で、ウェーハ300上に形成されるよう
になっている。
ト301がすべて同じ向き(Pの向きで示す)となるよ
うに、それぞれ、ウェーハ300上に形成されるように
なっている。つまり、トレンチゲート107の向きが同
一方向とされた複数のIGBT100が、すべて同じ向
き(この場合、トレンチゲート107の向きは図示矢印
B方向に一致)で、ウェーハ300上に形成されるよう
になっている。
【0015】このため、特に、ウェーハ300の径が大
きい場合には、上述した通り、トレンチゲート107に
垂直な断面方向(図示矢印A方向)に集中する応力によ
ってウェーハ300に大きな反りが生じ、以降の製造プ
ロセスでの処理を妨げる原因になるという欠点があっ
た。
きい場合には、上述した通り、トレンチゲート107に
垂直な断面方向(図示矢印A方向)に集中する応力によ
ってウェーハ300に大きな反りが生じ、以降の製造プ
ロセスでの処理を妨げる原因になるという欠点があっ
た。
【0016】
【発明が解決しようとする課題】上記したように、従来
のIGBTにおいては、すべてのトレンチゲートの向き
が同一方向となるようにして形成されているため、トレ
ンチゲートに垂直な方向の応力がストライプ方向の応力
よりも強く、そのトレンチゲートに垂直な方向の強い応
力によるリーク電流の発生や結晶欠陥の発生が問題とな
っていた。
のIGBTにおいては、すべてのトレンチゲートの向き
が同一方向となるようにして形成されているため、トレ
ンチゲートに垂直な方向の応力がストライプ方向の応力
よりも強く、そのトレンチゲートに垂直な方向の強い応
力によるリーク電流の発生や結晶欠陥の発生が問題とな
っていた。
【0017】また、従来のIGBTの製造においては、
すべてのトレンチゲートの向きが同一方向となるように
して形成されている複数のIGBTを、すべて同じ向き
でウェーハ上に形成するようにしているため、トレンチ
ゲートに垂直な方向の強い応力によってウェーハに大き
な反りが生じるという問題があった。
すべてのトレンチゲートの向きが同一方向となるように
して形成されている複数のIGBTを、すべて同じ向き
でウェーハ上に形成するようにしているため、トレンチ
ゲートに垂直な方向の強い応力によってウェーハに大き
な反りが生じるという問題があった。
【0018】そこで、この発明は、一方向にのみ応力が
集中するのを緩和でき、リーク電流の発生や結晶欠陥の
発生を防止することが可能な半導体装置を提供すること
を目的としている。
集中するのを緩和でき、リーク電流の発生や結晶欠陥の
発生を防止することが可能な半導体装置を提供すること
を目的としている。
【0019】また、この発明は、一方向にのみ応力が集
中するのを緩和でき、ウェーハに大きな反りが生じるの
を防止することが可能な半導体装置の製造方法を提供す
ることを目的としている。
中するのを緩和でき、ウェーハに大きな反りが生じるの
を防止することが可能な半導体装置の製造方法を提供す
ることを目的としている。
【0020】
【課題を解決するための手段】上記の目的を達成するた
めに、この発明の半導体装置にあっては、同一基板上
に、複数のゲート電極が互いに平行になるように設けら
れたものであって、前記基板と前記ゲート電極との間に
働く応力が、前記基板内において略平均化するように、
前記ゲート電極を形成するようにした構成となってい
る。
めに、この発明の半導体装置にあっては、同一基板上
に、複数のゲート電極が互いに平行になるように設けら
れたものであって、前記基板と前記ゲート電極との間に
働く応力が、前記基板内において略平均化するように、
前記ゲート電極を形成するようにした構成となってい
る。
【0021】また、この発明の半導体装置にあっては、
複数のゲート電極が平行に設けられた複数の素子領域
を、同一基板上に、前記ゲート電極の向きが互いに直交
するように配置してなる構成とされている。
複数のゲート電極が平行に設けられた複数の素子領域
を、同一基板上に、前記ゲート電極の向きが互いに直交
するように配置してなる構成とされている。
【0022】また、この発明の半導体装置にあっては、
半導体基板と、この半導体基板上の終端領域内に設けら
れたゲートパッド領域と、このゲートパッド領域からの
配線を引き回すための、前記終端領域内に設けられた配
線領域と、この配線領域により分割され、かつ、それぞ
れ平行に設けられた各ゲート電極の向きが互いに直交す
るようにして前記終端領域内に配置された、複数の素子
領域とから構成されている。
半導体基板と、この半導体基板上の終端領域内に設けら
れたゲートパッド領域と、このゲートパッド領域からの
配線を引き回すための、前記終端領域内に設けられた配
線領域と、この配線領域により分割され、かつ、それぞ
れ平行に設けられた各ゲート電極の向きが互いに直交す
るようにして前記終端領域内に配置された、複数の素子
領域とから構成されている。
【0023】また、この発明の半導体装置の製造方法に
あっては、半導体基板上に複数のゲート電極が設けられ
た、複数の半導体装置を、同一ウェーハ上に形成する場
合であって、前記基板と前記ゲート電極との間に働く応
力が、前記ウェーハ内において略平均化するように、前
記半導体装置を形成するようになっている。
あっては、半導体基板上に複数のゲート電極が設けられ
た、複数の半導体装置を、同一ウェーハ上に形成する場
合であって、前記基板と前記ゲート電極との間に働く応
力が、前記ウェーハ内において略平均化するように、前
記半導体装置を形成するようになっている。
【0024】さらに、この発明の半導体装置の製造方法
にあっては、複数のゲート電極が同一方向に設けられた
複数の半導体装置を、同一ウェーハ上に、前記ゲート電
極の向きが互いに直交するように形成するようになって
いる。
にあっては、複数のゲート電極が同一方向に設けられた
複数の半導体装置を、同一ウェーハ上に、前記ゲート電
極の向きが互いに直交するように形成するようになって
いる。
【0025】この発明の半導体装置によれば、基板内に
おける応力の方向を略平均化できるようになる。これに
より、一方向に対する応力の影響を軽減させることが可
能となるものである。
おける応力の方向を略平均化できるようになる。これに
より、一方向に対する応力の影響を軽減させることが可
能となるものである。
【0026】また、この発明の半導体装置の製造方法に
よれば、ウェーハ内における応力の方向を略平均化でき
るようになる。これにより、一方向に対する応力の影響
を受けることなしに、半導体装置を製造することが可能
となるものである。
よれば、ウェーハ内における応力の方向を略平均化でき
るようになる。これにより、一方向に対する応力の影響
を受けることなしに、半導体装置を製造することが可能
となるものである。
【0027】
【発明の実施の形態】以下、この発明の実施の形態につ
いて図面を参照して説明する。図1は、本発明の実施の
第一の形態にかかる絶縁ゲート型半導体装置として、ス
トライプ状のトレンチ型絶縁ゲート(ゲート電極)から
なる、トレンチゲート構造を採用するIGBTの全体構
成を概略的に示すものである。
いて図面を参照して説明する。図1は、本発明の実施の
第一の形態にかかる絶縁ゲート型半導体装置として、ス
トライプ状のトレンチ型絶縁ゲート(ゲート電極)から
なる、トレンチゲート構造を採用するIGBTの全体構
成を概略的に示すものである。
【0028】このIGBT10は、たとえば、その終端
領域11内が、1つのゲートパッド領域12と3つの素
子領域13a,13b,13cとに分割されている。ゲ
ートパッド領域12は、中央付近を除く、上記終端領域
11内の一部に設けられている。素子領域13a,13
b,13cの周辺部には、上記ゲートパッド領域12か
らのポリシリコン配線を引き回すための配線領域14が
設けられている。
領域11内が、1つのゲートパッド領域12と3つの素
子領域13a,13b,13cとに分割されている。ゲ
ートパッド領域12は、中央付近を除く、上記終端領域
11内の一部に設けられている。素子領域13a,13
b,13cの周辺部には、上記ゲートパッド領域12か
らのポリシリコン配線を引き回すための配線領域14が
設けられている。
【0029】この場合、上記素子領域13a,13b,
13cは、それぞれに形成されるトレンチゲート15の
向きが、上記素子領域13aと上記素子領域13b,1
3cとの間で互いに直交するように(トレンチゲート1
5の向きが同一方向とならないように)、約90°角度
が変えられて配置されている。
13cは、それぞれに形成されるトレンチゲート15の
向きが、上記素子領域13aと上記素子領域13b,1
3cとの間で互いに直交するように(トレンチゲート1
5の向きが同一方向とならないように)、約90°角度
が変えられて配置されている。
【0030】なお、各素子領域13a,13b,13c
は、その断面構造が、上記した従来のIGBT100と
ほぼ同様の構成となっている(図6参照)。すなわち、
各素子領域13a,13b,13c内には、それぞれ、
ストライプ状で、かつ、ほぼ同一の長さからなる、複数
のトレンチゲート15が略平行に設けられている。
は、その断面構造が、上記した従来のIGBT100と
ほぼ同様の構成となっている(図6参照)。すなわち、
各素子領域13a,13b,13c内には、それぞれ、
ストライプ状で、かつ、ほぼ同一の長さからなる、複数
のトレンチゲート15が略平行に設けられている。
【0031】また、各素子領域13a,13b,13c
は、たとえば、素子領域13b,13cにおけるトレン
チゲート15の向き(図示矢印A方向)が、これらに隣
接する、素子領域13aにおけるトレンチゲート15の
向き(図示矢印B方向)と直交するようにして配置され
ている。
は、たとえば、素子領域13b,13cにおけるトレン
チゲート15の向き(図示矢印A方向)が、これらに隣
接する、素子領域13aにおけるトレンチゲート15の
向き(図示矢印B方向)と直交するようにして配置され
ている。
【0032】このような構造により、従来、一方向のみ
に集中していた応力(図7のA方向)を、素子領域13
aにおけるトレンチゲート15の向きに垂直な断面方向
(図示矢印A方向)に集中する応力と、素子領域13
b,13cにおけるトレンチゲート15の向きに垂直な
断面方向(図示矢印B方向)に集中する応力とに分散さ
せることが可能となり、一方向に対する応力の総和もほ
ぼ半減させることが可能となる。
に集中していた応力(図7のA方向)を、素子領域13
aにおけるトレンチゲート15の向きに垂直な断面方向
(図示矢印A方向)に集中する応力と、素子領域13
b,13cにおけるトレンチゲート15の向きに垂直な
断面方向(図示矢印B方向)に集中する応力とに分散さ
せることが可能となり、一方向に対する応力の総和もほ
ぼ半減させることが可能となる。
【0033】これにより、トレンチゲート15のストラ
イプ方向と直交する一方向のみに集中していた応力の方
向を、全体で略平均化できるようになる結果、IGBT
10において、一方向にのみ応力が集中するのを緩和す
ることが可能となる。
イプ方向と直交する一方向のみに集中していた応力の方
向を、全体で略平均化できるようになる結果、IGBT
10において、一方向にのみ応力が集中するのを緩和す
ることが可能となる。
【0034】したがって、たとえ、大面積で、かつ、ト
レンチゲート15の本数の多いIGBTの場合にも、一
方向に集中する応力に起因して、リーク電流や結晶欠陥
が発生するのを改善できるようになるものである。
レンチゲート15の本数の多いIGBTの場合にも、一
方向に集中する応力に起因して、リーク電流や結晶欠陥
が発生するのを改善できるようになるものである。
【0035】上記したように、IGBT内における応力
の方向を略平均化できるようにしている。すなわち、素
子領域内にそれぞれ形成されるトレンチゲートの向き
が、上下左右に隣り合うすべての素子領域との間で互い
に直交するようにしている。これにより、一方向に対す
る応力の総和を減少できるようになるため、一方向に対
する応力の影響を軽減させることが可能となる。したが
って、たとえ、大面積で、かつ、トレンチゲートの本数
の多いIGBTであっても、一方向にのみ応力が集中す
るのを緩和でき、リーク電流の発生や結晶欠陥の発生を
防止することが可能となるものである。
の方向を略平均化できるようにしている。すなわち、素
子領域内にそれぞれ形成されるトレンチゲートの向き
が、上下左右に隣り合うすべての素子領域との間で互い
に直交するようにしている。これにより、一方向に対す
る応力の総和を減少できるようになるため、一方向に対
する応力の影響を軽減させることが可能となる。したが
って、たとえ、大面積で、かつ、トレンチゲートの本数
の多いIGBTであっても、一方向にのみ応力が集中す
るのを緩和でき、リーク電流の発生や結晶欠陥の発生を
防止することが可能となるものである。
【0036】なお、上記した本発明の実施の第一の形態
においては、トレンチゲートの向きが隣り合うすべての
素子領域間で互いに直交するように構成した場合を例に
説明したが、これに限らず、たとえばいくつかの素子領
域ごとに互いの向きが直交するようにトレンチゲートを
形成することも可能である。
においては、トレンチゲートの向きが隣り合うすべての
素子領域間で互いに直交するように構成した場合を例に
説明したが、これに限らず、たとえばいくつかの素子領
域ごとに互いの向きが直交するようにトレンチゲートを
形成することも可能である。
【0037】図2は、本発明の実施の第二の形態にかか
り、いくつかの素子領域ごとに互いの向きが直交するよ
うにトレンチゲートを形成するようにした場合の例を示
すものである。
り、いくつかの素子領域ごとに互いの向きが直交するよ
うにトレンチゲートを形成するようにした場合の例を示
すものである。
【0038】このIGBT10´は、たとえば、その終
端領域11内が配線領域14によってさらに細かく分割
され、ゲートパッド領域12と、これに隣接する素子領
域13d,13eとを除いて、応力の方向が全体で略平
均化するように、3つの素子領域21,22,23ごと
に、互いの向きが直交するようにしてトレンチゲート1
5が形成されている。
端領域11内が配線領域14によってさらに細かく分割
され、ゲートパッド領域12と、これに隣接する素子領
域13d,13eとを除いて、応力の方向が全体で略平
均化するように、3つの素子領域21,22,23ごと
に、互いの向きが直交するようにしてトレンチゲート1
5が形成されている。
【0039】すなわち、少なくとも上記した3つの素子
領域13a,13b,13cがさらに3つの素子領域2
1,22,23にそれぞれ分割され、かつ、各素子領域
13a,13b,13c内における3つの素子領域2
1,22,23は互いに同一方向にそれぞれトレンチゲ
ート15が形成されるとともに、各素子領域13a,1
3b,13c間で互いに直交するように、それぞれ、3
つの素子領域21,22,23が配置されている。
領域13a,13b,13cがさらに3つの素子領域2
1,22,23にそれぞれ分割され、かつ、各素子領域
13a,13b,13c内における3つの素子領域2
1,22,23は互いに同一方向にそれぞれトレンチゲ
ート15が形成されるとともに、各素子領域13a,1
3b,13c間で互いに直交するように、それぞれ、3
つの素子領域21,22,23が配置されている。
【0040】このような構成によっても、IGBT10
´内での応力の方向を略平均化できるようになるため、
上記した実施の第一の形態に示したIGBT10とほぼ
同等の効果が期待できる。
´内での応力の方向を略平均化できるようになるため、
上記した実施の第一の形態に示したIGBT10とほぼ
同等の効果が期待できる。
【0041】しかも、このIGBT10´のように、終
端領域11内を細かく分割した場合にも、すべての素子
領域13d,13e,21,22,23における各トレ
ンチゲート15の長さがほぼ同一となるようにした場合
においては、特に、大面積のIGBTに用いて有効であ
る。
端領域11内を細かく分割した場合にも、すべての素子
領域13d,13e,21,22,23における各トレ
ンチゲート15の長さがほぼ同一となるようにした場合
においては、特に、大面積のIGBTに用いて有効であ
る。
【0042】また、上記した本発明の実施の第一,第二
の形態に示したように、ゲートパッド領域12を終端領
域11内の中央付近以外に設けるようにした場合に限ら
ず、たとえば、終端領域11内の中央付近に設けること
も可能である(センターゲート構造)。
の形態に示したように、ゲートパッド領域12を終端領
域11内の中央付近以外に設けるようにした場合に限ら
ず、たとえば、終端領域11内の中央付近に設けること
も可能である(センターゲート構造)。
【0043】図3は、この発明の実施の第三の形態にか
かり、センターゲート構造を実現するようにした場合の
例を示すものである。このIGBT10''は、たとえ
ば、その終端領域11内のほぼ中央部にゲートパッド領
域12が配置されている。そして、このゲートパッド領
域12を除く、上記終端領域11内が配線領域14によ
って細かく分割されて、上記ゲートパッド領域12の周
辺部を囲むように、複数の素子領域13〜が配置されて
いる。
かり、センターゲート構造を実現するようにした場合の
例を示すものである。このIGBT10''は、たとえ
ば、その終端領域11内のほぼ中央部にゲートパッド領
域12が配置されている。そして、このゲートパッド領
域12を除く、上記終端領域11内が配線領域14によ
って細かく分割されて、上記ゲートパッド領域12の周
辺部を囲むように、複数の素子領域13〜が配置されて
いる。
【0044】この場合も、応力の方向が全体で略平均化
するように、たとえば、4つの素子領域13〜ごとに、
互いの向きが直交するようにしてトレンチゲート15が
それぞれ形成されている。
するように、たとえば、4つの素子領域13〜ごとに、
互いの向きが直交するようにしてトレンチゲート15が
それぞれ形成されている。
【0045】図4は、この発明の実施の第四の形態にか
かり、センターゲート構造を実現するようにした場合の
他の例を示すものである。このIGBT10''' は、た
とえば、その終端領域11内のほぼ中央部にゲートパッ
ド領域12が配置されている。そして、このゲートパッ
ド領域12の周辺部を囲むようにして、1つの素子領域
13内に、閉ループ状の複数のトレンチゲート15´が
互いに平行になるように形成されている。
かり、センターゲート構造を実現するようにした場合の
他の例を示すものである。このIGBT10''' は、た
とえば、その終端領域11内のほぼ中央部にゲートパッ
ド領域12が配置されている。そして、このゲートパッ
ド領域12の周辺部を囲むようにして、1つの素子領域
13内に、閉ループ状の複数のトレンチゲート15´が
互いに平行になるように形成されている。
【0046】この場合、各トレンチゲート15´は、そ
れぞれ閉ループ状に形成されているため、トレンチゲー
トのストライプ方向と直交する一方向のみに集中してい
た応力の方向を、全体で略平均化できるようになる。
れぞれ閉ループ状に形成されているため、トレンチゲー
トのストライプ方向と直交する一方向のみに集中してい
た応力の方向を、全体で略平均化できるようになる。
【0047】次に、トレンチ内のゲート電極材料(ポリ
シリコン)の応力の影響を受けることなく、絶縁ゲート
型半導体装置の製造を可能とするための方法について説
明する。
シリコン)の応力の影響を受けることなく、絶縁ゲート
型半導体装置の製造を可能とするための方法について説
明する。
【0048】図5は、本発明の実施の他の形態にかかる
絶縁ゲート型半導体装置の製造方法の概略を、ストライ
プ状のトレンチゲートを有するIGBTを例に示すもの
である。
絶縁ゲート型半導体装置の製造方法の概略を、ストライ
プ状のトレンチゲートを有するIGBTを例に示すもの
である。
【0049】たとえば、ストライプ状のトレンチゲート
を有するIGBTの製造においては、一枚のウェーハ3
0上に複数のIGBTペレット(P)31を形成し、そ
れをIGBTペレット31ごとに分割することで、同時
に複数のIGBTを得るようになっている。
を有するIGBTの製造においては、一枚のウェーハ3
0上に複数のIGBTペレット(P)31を形成し、そ
れをIGBTペレット31ごとに分割することで、同時
に複数のIGBTを得るようになっている。
【0050】その際、ウェーハ30上には、たとえば、
隣接する上下左右のIGBTペレット31の向き(Pの
向きで示す)を、互いに約90°ずつ回転させた状態で
形成するようにする。
隣接する上下左右のIGBTペレット31の向き(Pの
向きで示す)を、互いに約90°ずつ回転させた状態で
形成するようにする。
【0051】この場合、たとえば、IGBTペレット3
1の露光に用いられるステッパの、単一のマスクパター
ンからなるレチクルの向きを露光ごとに回転させるか、
もしくは、複数のパターンを互いに約90°ずつ回転さ
せたマスクパターンをレチクルとして用いることによ
り、容易に形成できる。
1の露光に用いられるステッパの、単一のマスクパター
ンからなるレチクルの向きを露光ごとに回転させるか、
もしくは、複数のパターンを互いに約90°ずつ回転さ
せたマスクパターンをレチクルとして用いることによ
り、容易に形成できる。
【0052】すなわち、各IGBTペレット31は、ト
レンチゲートの向き(この場合、Pの向きに一致)が互
いに直交するようにして、同一ウェーハ30上にそれぞ
れ形成されるようにする。
レンチゲートの向き(この場合、Pの向きに一致)が互
いに直交するようにして、同一ウェーハ30上にそれぞ
れ形成されるようにする。
【0053】これにより、仮に、トレンチゲートの向き
が同一方向に形成されているIGBTペレット(図7参
照)の場合であっても、各IGBTペレットにおける、
トレンチゲートのストライプ方向と直交する方向に生じ
る強い応力が、ウェーハ30上において、一方向に集中
するのを改善できるようになる。
が同一方向に形成されているIGBTペレット(図7参
照)の場合であっても、各IGBTペレットにおける、
トレンチゲートのストライプ方向と直交する方向に生じ
る強い応力が、ウェーハ30上において、一方向に集中
するのを改善できるようになる。
【0054】したがって、一方向に対する応力の総和を
減少させ、応力の方向をウェーハ30内で略平均化でき
るようになる結果、たとえ、大口径のウェーハを用いる
場合においても、一方向に対する応力の影響を受けるこ
とがないため、大きな反りによる以降の製造プロセスで
の処理の悪化を防いで、良好にIGBTを製造すること
が可能となるものである。
減少させ、応力の方向をウェーハ30内で略平均化でき
るようになる結果、たとえ、大口径のウェーハを用いる
場合においても、一方向に対する応力の影響を受けるこ
とがないため、大きな反りによる以降の製造プロセスで
の処理の悪化を防いで、良好にIGBTを製造すること
が可能となるものである。
【0055】なお、隣り合うIGBTペレット31どう
しを、トレンチゲートが互いに直交するように形成する
場合に限らず、たとえば、いくつかのIGBTペレット
31ごとにトレンチゲートが互いに直交するように形成
した場合も、ほぼ同様の効果が期待できる。
しを、トレンチゲートが互いに直交するように形成する
場合に限らず、たとえば、いくつかのIGBTペレット
31ごとにトレンチゲートが互いに直交するように形成
した場合も、ほぼ同様の効果が期待できる。
【0056】特に、IGBTペレット31として、上記
した第一〜第四の各形態に示したIGBT10,IGB
T10´,IGBT10'',IGBT10''' を形成す
るようにした場合には、いずれにおいても、ウェーハ3
0の反りを減少させるのにより効果的である。
した第一〜第四の各形態に示したIGBT10,IGB
T10´,IGBT10'',IGBT10''' を形成す
るようにした場合には、いずれにおいても、ウェーハ3
0の反りを減少させるのにより効果的である。
【0057】さらに、上記したいずれの形態において
も、トレンチゲート構造のIGBTに限らず、たとえ
ば、MOS(Metal Oxide Semiconductor )やIEGT
(Injection Enhanced Gate Transistor)またはSIサ
イリスタ(SIThy(Static Induction Thyristo
r))などの、トレンチ構造の絶縁ゲートを有する各種
の絶縁ゲート型半導体装置に適用可能である。
も、トレンチゲート構造のIGBTに限らず、たとえ
ば、MOS(Metal Oxide Semiconductor )やIEGT
(Injection Enhanced Gate Transistor)またはSIサ
イリスタ(SIThy(Static Induction Thyristo
r))などの、トレンチ構造の絶縁ゲートを有する各種
の絶縁ゲート型半導体装置に適用可能である。
【0058】また、トレンチ構造の絶縁ゲートを有する
絶縁ゲート型半導体装置に限らず、プレーナ構造の絶縁
ゲートを有する各種の絶縁ゲート型半導体装置にも適用
できる。
絶縁ゲート型半導体装置に限らず、プレーナ構造の絶縁
ゲートを有する各種の絶縁ゲート型半導体装置にも適用
できる。
【0059】特に、プレーナ構造の絶縁ゲートを有する
各種の絶縁ゲート型半導体装置に適用した場合において
は、シリコン基板の厚さを減少させるのに極めて有効で
ある。
各種の絶縁ゲート型半導体装置に適用した場合において
は、シリコン基板の厚さを減少させるのに極めて有効で
ある。
【0060】また、トレンチゲートのストライプ方向の
長さや本数、素子領域の大きさや形状または個数、さら
には、ペレットの大きさや個数などに関しては、何ら一
切の制限を受けるものではない。
長さや本数、素子領域の大きさや形状または個数、さら
には、ペレットの大きさや個数などに関しては、何ら一
切の制限を受けるものではない。
【0061】さらに、ゲート電極材料として、ポリシリ
コンを例にとって説明したが、たとえば、メタル電極や
メタルシリサイド電極などの場合にも極めて有効であ
る。その他、この発明の要旨を変えない範囲において、
種々変形実施可能なことは勿論である。
コンを例にとって説明したが、たとえば、メタル電極や
メタルシリサイド電極などの場合にも極めて有効であ
る。その他、この発明の要旨を変えない範囲において、
種々変形実施可能なことは勿論である。
【0062】
【発明の効果】以上、詳述したようにこの発明によれ
ば、一方向にのみ応力が集中するのを緩和でき、リーク
電流の発生や結晶欠陥の発生を防止することが可能な半
導体装置を提供できる。
ば、一方向にのみ応力が集中するのを緩和でき、リーク
電流の発生や結晶欠陥の発生を防止することが可能な半
導体装置を提供できる。
【0063】また、この発明によれば、一方向にのみ応
力が集中するのを緩和でき、ウェーハに大きな反りが生
じるのを防止することが可能な半導体装置の製造方法を
提供できる。
力が集中するのを緩和でき、ウェーハに大きな反りが生
じるのを防止することが可能な半導体装置の製造方法を
提供できる。
【図1】この発明の実施の第一の形態にかかる絶縁ゲー
ト型半導体装置の構成を、ストライプ状のトレンチゲー
トを有するIGBTを例に示す概略平面図。
ト型半導体装置の構成を、ストライプ状のトレンチゲー
トを有するIGBTを例に示す概略平面図。
【図2】この発明の実施の第二の形態にかかる絶縁ゲー
ト型半導体装置の構成を、ストライプ状のトレンチゲー
トを有するIGBTを例に示す概略平面図。
ト型半導体装置の構成を、ストライプ状のトレンチゲー
トを有するIGBTを例に示す概略平面図。
【図3】この発明の実施の第三の形態にかかる絶縁ゲー
ト型半導体装置の構成を、ストライプ状のトレンチゲー
トを有するIGBTを例に示す概略平面図。
ト型半導体装置の構成を、ストライプ状のトレンチゲー
トを有するIGBTを例に示す概略平面図。
【図4】この発明の実施の第四の形態にかかる絶縁ゲー
ト型半導体装置の構成を、閉ループ状のトレンチゲート
を有するIGBTを例に示す概略平面図。
ト型半導体装置の構成を、閉ループ状のトレンチゲート
を有するIGBTを例に示す概略平面図。
【図5】この発明の実施の他の形態にかかる、絶縁ゲー
ト型半導体装置の製造方法の概略を説明するために示す
ウェーハの平面図。
ト型半導体装置の製造方法の概略を説明するために示す
ウェーハの平面図。
【図6】従来技術とその問題点を説明するために示す、
ストライプ状のトレンチゲートを有するIGBTの要部
の概略断面図。
ストライプ状のトレンチゲートを有するIGBTの要部
の概略断面図。
【図7】同じく、従来のストライプ状のトレンチゲート
を有するIGBTの全体構成を示す概略平面図。
を有するIGBTの全体構成を示す概略平面図。
【図8】同じく、従来の絶縁ゲート型半導体装置の製造
方法の概略を説明するために示すウェーハの平面図。
方法の概略を説明するために示すウェーハの平面図。
10…IGBT(実施の第一の形態) 10´…IGBT(実施の第二の形態) 10''…IGBT(実施の第三の形態) 10''' …IGBT(実施の第四の形態) 11…終端領域 12…ゲートパッド領域 13,13a,13b,13c,13d,13e,2
1,22,23…素子領域 14…配線領域 15…トレンチゲート(ストライプ状) 15´…トレンチゲート(閉ループ状) 30…ウェーハ 31…IGBTペレット
1,22,23…素子領域 14…配線領域 15…トレンチゲート(ストライプ状) 15´…トレンチゲート(閉ループ状) 30…ウェーハ 31…IGBTペレット
───────────────────────────────────────────────────── フロントページの続き (72)発明者 土谷 政信 神奈川県川崎市幸区小向東芝町1番地 株 式会社東芝多摩川工場内
Claims (10)
- 【請求項1】 同一基板上に、複数のゲート電極が互い
に平行になるように設けられた半導体装置であって、 前記基板と前記ゲート電極との間に働く応力が、前記基
板内において略平均化するように、前記ゲート電極を形
成するようにしたことを特徴とする半導体装置。 - 【請求項2】 前記ゲート電極は、トレンチ型の絶縁ゲ
ートであることを特徴とする請求項1に記載の半導体装
置。 - 【請求項3】 前記ゲート電極は、プレーナ型の絶縁ゲ
ートであることを特徴とする請求項1に記載の半導体装
置。 - 【請求項4】 前記ゲート電極は、ストライプ状の絶縁
ゲートであることを特徴とする請求項2または請求項3
のいずれかに記載の半導体装置。 - 【請求項5】 前記ゲート電極は、上下左右に隣接する
素子領域間で互いの向きが直交するように形成されてい
ることを特徴とする請求項4に記載の半導体装置。 - 【請求項6】 前記ゲート電極は、いくつかの素子領域
ごとに互いの向きが直交するように形成されていること
を特徴とする請求項4に記載の半導体装置。 - 【請求項7】 複数のゲート電極が平行に設けられた複
数の素子領域を、同一基板上に、前記ゲート電極の向き
が互いに直交するように配置してなることを特徴とする
半導体装置。 - 【請求項8】 半導体基板と、 この半導体基板上の終端領域内に設けられたゲートパッ
ド領域と、 このゲートパッド領域からの配線を引き回すための、前
記終端領域内に設けられた配線領域と、 この配線領域により分割され、かつ、それぞれ平行に設
けられた各ゲート電極の向きが互いに直交するようにし
て前記終端領域内に配置された、複数の素子領域とを具
備したことを特徴とする半導体装置。 - 【請求項9】 半導体基板上に複数のゲート電極が設け
られた、複数の半導体装置を、同一ウェーハ上に形成す
る方法であって、 前記基板と前記ゲート電極との間に働く応力が、前記ウ
ェーハ内において略平均化するように、前記半導体装置
を形成するようにしたことを特徴とする半導体装置の製
造方法。 - 【請求項10】 複数のゲート電極が同一方向に設けら
れた複数の半導体装置を、同一ウェーハ上に、前記ゲー
ト電極の向きが互いに直交するように形成するようにし
たことを特徴とする半導体装置の製造方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP02986598A JP3410949B2 (ja) | 1998-02-12 | 1998-02-12 | 半導体装置 |
US09/249,296 US6337498B1 (en) | 1998-02-12 | 1999-02-12 | Semiconductor device having directionally balanced gates and manufacturing method |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP02986598A JP3410949B2 (ja) | 1998-02-12 | 1998-02-12 | 半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH11233765A true JPH11233765A (ja) | 1999-08-27 |
JP3410949B2 JP3410949B2 (ja) | 2003-05-26 |
Family
ID=12287877
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Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP02986598A Expired - Fee Related JP3410949B2 (ja) | 1998-02-12 | 1998-02-12 | 半導体装置 |
Country Status (2)
Country | Link |
---|---|
US (1) | US6337498B1 (ja) |
JP (1) | JP3410949B2 (ja) |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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JP2003017698A (ja) * | 2001-07-04 | 2003-01-17 | Sanyo Electric Co Ltd | 半導体装置及びその製造方法 |
JP2008004772A (ja) * | 2006-06-22 | 2008-01-10 | Denso Corp | 半導体装置および半導体ウエハ |
JP2008205439A (ja) * | 2007-02-16 | 2008-09-04 | Power Integrations Inc | チェッカーボード型高電圧垂直トランジスタレイアウト |
JP2008205482A (ja) * | 2007-02-16 | 2008-09-04 | Power Integrations Inc | 高電圧垂直トランジスタで集積された検知トランジスタ |
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