JPH10135751A - 電力増幅装置 - Google Patents
電力増幅装置Info
- Publication number
- JPH10135751A JPH10135751A JP8290691A JP29069196A JPH10135751A JP H10135751 A JPH10135751 A JP H10135751A JP 8290691 A JP8290691 A JP 8290691A JP 29069196 A JP29069196 A JP 29069196A JP H10135751 A JPH10135751 A JP H10135751A
- Authority
- JP
- Japan
- Prior art keywords
- output
- amplifier
- output signal
- signal
- efficiency
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
- H03F3/68—Combinations of amplifiers, e.g. multi-channel amplifiers for stereophonics
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
- H03F1/02—Modifications of amplifiers to raise the efficiency, e.g. gliding Class A stages, use of an auxiliary oscillation
- H03F1/0205—Modifications of amplifiers to raise the efficiency, e.g. gliding Class A stages, use of an auxiliary oscillation in transistor amplifiers
- H03F1/0211—Modifications of amplifiers to raise the efficiency, e.g. gliding Class A stages, use of an auxiliary oscillation in transistor amplifiers with control of the supply voltage or current
- H03F1/0244—Stepped control
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F2200/00—Indexing scheme relating to amplifiers
- H03F2200/03—Indexing scheme relating to amplifiers the amplifier being designed for audio applications
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Amplifiers (AREA)
Abstract
(57)【要約】
【課題】出力直流電圧をアースレベルに近い値に設定さ
れ、半波出力信号により負荷をＢＴＬ駆動する高効率回
路内の加算回路の回路素子数を削減する。 【解決手段】左フロント用出力増幅器２ＬＦの正出力信
号、左リア用出力増幅器３ＬＲの負出力信号、右フロン
ト用出力増幅器３ＲＦの負出力信号及び右リア用出力増
幅器４ＲＲの正出力信号は加算回路９に印加され、加算
回路９からその中で最も高いレベルの出力信号を選択し
て発生する。スイッチング電源１０は加算回路９の出力
信号に応じてスイッチング動作し、各々の高効率増幅回
路の電源電圧を発生する。
れ、半波出力信号により負荷をＢＴＬ駆動する高効率回
路内の加算回路の回路素子数を削減する。 【解決手段】左フロント用出力増幅器２ＬＦの正出力信
号、左リア用出力増幅器３ＬＲの負出力信号、右フロン
ト用出力増幅器３ＲＦの負出力信号及び右リア用出力増
幅器４ＲＲの正出力信号は加算回路９に印加され、加算
回路９からその中で最も高いレベルの出力信号を選択し
て発生する。スイッチング電源１０は加算回路９の出力
信号に応じてスイッチング動作し、各々の高効率増幅回
路の電源電圧を発生する。
Description
【０００１】
【発明の属する技術分野】本発明は、４チャンネルの車
載用ステレオシステムに用いて好適な電力増幅装置に関
する。
載用ステレオシステムに用いて好適な電力増幅装置に関
する。
【０００２】
【従来の技術】従来より、特開平６−３３８７３８号公
報に開示されるように、出力直電圧をアースに非常に近
い値に設定するとともに、負荷を半波信号でＢＴＬ駆動
することにより、電力増幅装置の高効率化を達成した電
力増幅装置がある。このような電力増幅装置を図４に示
す。
報に開示されるように、出力直電圧をアースに非常に近
い値に設定するとともに、負荷を半波信号でＢＴＬ駆動
することにより、電力増幅装置の高効率化を達成した電
力増幅装置がある。このような電力増幅装置を図４に示
す。
【０００３】図４において、入力信号は第１差動増幅器
１の負入力端子に印加され、第１差動増幅器１の正及び
負出力端子から互いに逆相の出力信号が発生する。第１
差動増幅器１の正及び負出力信号は第１及び第２出力増
幅器２及び３で増幅される。第１及び第２出力増幅器２
及び３はＢＴＬ増幅器を成し、第１及び第２出力増幅器
２及び３の出力信号ａ及びｂによって負荷４（例えば、
スピーカ）がＢＴＬ駆動される。
１の負入力端子に印加され、第１差動増幅器１の正及び
負出力端子から互いに逆相の出力信号が発生する。第１
差動増幅器１の正及び負出力信号は第１及び第２出力増
幅器２及び３で増幅される。第１及び第２出力増幅器２
及び３はＢＴＬ増幅器を成し、第１及び第２出力増幅器
２及び３の出力信号ａ及びｂによって負荷４（例えば、
スピーカ）がＢＴＬ駆動される。
【０００４】また、第１及び第２出力増幅器２及び３の
出力信号ａ及びｂは非線形加算回路５で非線形加算され
る。非線形加算回路５は、第１及び第２出力増幅器２及
び３の出力信号レベルが所定レベル以下のとき加算回路
として動作するとともに、この出力信号レベルが所定レ
ベル以上のときにはクランプ回路として動作するもので
ある。非線形加算回路５の出力信号は第２差動増幅器６
の負入力端子に印加され、非線形加算回路５の出力信号
と正入力端子の基準電圧Ｖｒｅｆとの差に応じた出力信
号が第１差動増幅器１の共通端子Ｃに印加される。共通
端子Ｃは第１及び第２出力増幅器２及び３の出力直流電
圧を定めるための端子であり、第１及び第２出力増幅器
２及び３の出力信号ａ及びｂに応じて出力直流電圧が制
御される。その為、図２（イ）及び（ロ）のように、第
１及び第２出力増幅器２及び３の出力直流電圧はアース
レベルに近い電圧に設定され、第１及び第２出力増幅器
２及び３の出力信号ａ及びｂは半波出力信号となる。
出力信号ａ及びｂは非線形加算回路５で非線形加算され
る。非線形加算回路５は、第１及び第２出力増幅器２及
び３の出力信号レベルが所定レベル以下のとき加算回路
として動作するとともに、この出力信号レベルが所定レ
ベル以上のときにはクランプ回路として動作するもので
ある。非線形加算回路５の出力信号は第２差動増幅器６
の負入力端子に印加され、非線形加算回路５の出力信号
と正入力端子の基準電圧Ｖｒｅｆとの差に応じた出力信
号が第１差動増幅器１の共通端子Ｃに印加される。共通
端子Ｃは第１及び第２出力増幅器２及び３の出力直流電
圧を定めるための端子であり、第１及び第２出力増幅器
２及び３の出力信号ａ及びｂに応じて出力直流電圧が制
御される。その為、図２（イ）及び（ロ）のように、第
１及び第２出力増幅器２及び３の出力直流電圧はアース
レベルに近い電圧に設定され、第１及び第２出力増幅器
２及び３の出力信号ａ及びｂは半波出力信号となる。
【０００５】一方、第１及び第２出力増幅器２及び３の
出力信号は、加算回路７で加算され、加算により、第１
及び第２出力増幅器２及び３のうちレベルの高い信号が
選択される。加算回路７の出力信号ｃに応じてスイッチ
ング電源８がスイッチング動作し、第１及び第２出力増
幅器２及び３の電源電圧Ｖｓを発生する。
出力信号は、加算回路７で加算され、加算により、第１
及び第２出力増幅器２及び３のうちレベルの高い信号が
選択される。加算回路７の出力信号ｃに応じてスイッチ
ング電源８がスイッチング動作し、第１及び第２出力増
幅器２及び３の電源電圧Ｖｓを発生する。
【０００６】
【発明が解決しようとする課題】ところで、４チャンネ
ルの車載用ステレオシステムとして、左ステレオ信号を
増幅する第１及び第２電力増幅回路と、右ステレオ信号
を増幅する第３及び第４電力増幅回路とを備え、第１及
び第３電力増幅回路を一対にしてそれらが自動車室内の
フロントスピーカを駆動し、第２及び第４電力増幅回路
を一対にしてそれらがリアスピーカを駆動するシステム
が存在する。
ルの車載用ステレオシステムとして、左ステレオ信号を
増幅する第１及び第２電力増幅回路と、右ステレオ信号
を増幅する第３及び第４電力増幅回路とを備え、第１及
び第３電力増幅回路を一対にしてそれらが自動車室内の
フロントスピーカを駆動し、第２及び第４電力増幅回路
を一対にしてそれらがリアスピーカを駆動するシステム
が存在する。
【０００７】このような車載用ステレオシステムに図４
の電力増幅装置を用いた場合、図４の電力増幅装置は当
然４個必要となる。しかし、図４の電力増幅装置を単純
に４個組み合わせると、加算回路７も４個となり、素子
数が増大するという問題があった。特に、４個の電力増
幅装置を同一基板上に単純に集積化した場合、加算回路
によりチップ面積が増大していた。
の電力増幅装置を用いた場合、図４の電力増幅装置は当
然４個必要となる。しかし、図４の電力増幅装置を単純
に４個組み合わせると、加算回路７も４個となり、素子
数が増大するという問題があった。特に、４個の電力増
幅装置を同一基板上に単純に集積化した場合、加算回路
によりチップ面積が増大していた。
【０００８】
【課題を解決するための手段】本発明は、第１入力信号
を増幅するとともに、各々の負荷をＢＴＬ駆動する第１
及び第２高効率増幅器と、第２入力信号を増幅するとと
もに、各々の負荷をＢＴＬ駆動する第３及び第４高効率
増幅器とを備え、前記第１及び第３高効率出力増幅器を
一対とし、前記第２及び第４高効率増幅器を一対とする
電力増幅装置において、前記第１及び第４高効率増幅器
の一方の出力信号と、前記第２及び第３高効率増幅器の
他方の出力信号のうち、最高レベルの出力信号を選択す
る選択回路と、該選択回路の出力信号に応じてスイッチ
ング動作し、前記第１乃至第４高効率増幅器の電源電圧
を発生するスイッチング電源と、を備えることを特徴と
する。
を増幅するとともに、各々の負荷をＢＴＬ駆動する第１
及び第２高効率増幅器と、第２入力信号を増幅するとと
もに、各々の負荷をＢＴＬ駆動する第３及び第４高効率
増幅器とを備え、前記第１及び第３高効率出力増幅器を
一対とし、前記第２及び第４高効率増幅器を一対とする
電力増幅装置において、前記第１及び第４高効率増幅器
の一方の出力信号と、前記第２及び第３高効率増幅器の
他方の出力信号のうち、最高レベルの出力信号を選択す
る選択回路と、該選択回路の出力信号に応じてスイッチ
ング動作し、前記第１乃至第４高効率増幅器の電源電圧
を発生するスイッチング電源と、を備えることを特徴と
する。
【０００９】また、第１乃至第４高効率増幅器の各々
は、第１及び第２出力信号を発生し、負荷をＢＴＬ駆動
する第１及び第２出力増幅器と、前記第１及び第２出力
増幅器の出力信号を非線形加算する非線形加算回路と、
入力信号を増幅するとともに、前記非線形加算回路の出
力信号に応じて制御され、前記第１及び第２出力増幅器
の入力信号を発生する非線形増幅器と、から成ることを
特徴とする。
は、第１及び第２出力信号を発生し、負荷をＢＴＬ駆動
する第１及び第２出力増幅器と、前記第１及び第２出力
増幅器の出力信号を非線形加算する非線形加算回路と、
入力信号を増幅するとともに、前記非線形加算回路の出
力信号に応じて制御され、前記第１及び第２出力増幅器
の入力信号を発生する非線形増幅器と、から成ることを
特徴とする。
【００１０】さらに、前記選択回路は、ベースに前記第
１高効率増幅器の一方の出力信号及び前記第２高効率増
幅器の他方の出力信号がそれぞれ印加される第１及び第
２トランジスタと、ベースに前記第３高効率増幅器の他
方の出力信号及び前記第４高効率増幅器の一方の出力信
号がそれぞれ印加される第３及び第４トランジスタと、
エミッタ及びコレクタが共通接続され、ベースが前記第
１及び第２トランジスタのエミッタにそれぞれ接続され
る第５及び第６トランジスタと、エミッタ及びコレクタ
が共通接続され、ベースが前記第１及び第２トランジス
タのエミッタにそれぞれ接続される第７及び第８トラン
ジスタと、前記第５乃至第８トランジスタのコレクタ電
流を反転する電流ミラー回路と、ベースが前記第５乃至
第６トランジスタの共通エミッタに接続された第９トラ
ンジスタと、前記電流ミラー回路と前記第９トランジス
タのエミッタとの間に接続されたダイオードとから成る
ことを特徴とする。
１高効率増幅器の一方の出力信号及び前記第２高効率増
幅器の他方の出力信号がそれぞれ印加される第１及び第
２トランジスタと、ベースに前記第３高効率増幅器の他
方の出力信号及び前記第４高効率増幅器の一方の出力信
号がそれぞれ印加される第３及び第４トランジスタと、
エミッタ及びコレクタが共通接続され、ベースが前記第
１及び第２トランジスタのエミッタにそれぞれ接続され
る第５及び第６トランジスタと、エミッタ及びコレクタ
が共通接続され、ベースが前記第１及び第２トランジス
タのエミッタにそれぞれ接続される第７及び第８トラン
ジスタと、前記第５乃至第８トランジスタのコレクタ電
流を反転する電流ミラー回路と、ベースが前記第５乃至
第６トランジスタの共通エミッタに接続された第９トラ
ンジスタと、前記電流ミラー回路と前記第９トランジス
タのエミッタとの間に接続されたダイオードとから成る
ことを特徴とする。
【００１１】本発明によれば、第１高効率増幅器の一方
の出力信号と第２高効率増幅器の他方の出力信号とは逆
相の同一信号であり、第３高効率増幅器の一方の出力信
号と第４高効率増幅器の他方の出力信号とは逆相の同一
信号である。また、第１及び第２高効率増幅器と、第３
及び第４高効率増幅器との入力信号は略同一である。そ
の為、第１及び第４高効率増幅器の一方の出力信号と第
２及び第３高効率増幅器の他方の出力信号との組み合わ
せで、スイッチング電源を制御することができる。
の出力信号と第２高効率増幅器の他方の出力信号とは逆
相の同一信号であり、第３高効率増幅器の一方の出力信
号と第４高効率増幅器の他方の出力信号とは逆相の同一
信号である。また、第１及び第２高効率増幅器と、第３
及び第４高効率増幅器との入力信号は略同一である。そ
の為、第１及び第４高効率増幅器の一方の出力信号と第
２及び第３高効率増幅器の他方の出力信号との組み合わ
せで、スイッチング電源を制御することができる。
【００１２】
【発明の実施の形態】図１は本発明の実施の形態を示す
図であり、９は、左フロント用出力増幅器２ＬＦ、左リ
ア用出力増幅器３ＬＲ、右フロント用第２出力増幅器３
ＲＦ及び右リア用第１出力増幅器２ＲＲのそれぞれの出
力増幅器の出力信号を加算する加算回路、１０は加算回
路９の出力信号に応じてスイッチング動作し、電源電圧
を発生するスイッチング電源である。尚、図１におい
て、図４と同一の回路については図４と同一の符号を付
すが、左フロント用、左リア用、右フロント用及び右リ
ア用の電力増幅器には、番号の後ろに「ＬＦ」、「Ｌ
Ｒ」、「ＲＦ」及び「ＲＲ」を付す。また、各々の電力
増幅回路の増幅動作については、図４の従来の電力増幅
装置の動作と同一である。
図であり、９は、左フロント用出力増幅器２ＬＦ、左リ
ア用出力増幅器３ＬＲ、右フロント用第２出力増幅器３
ＲＦ及び右リア用第１出力増幅器２ＲＲのそれぞれの出
力増幅器の出力信号を加算する加算回路、１０は加算回
路９の出力信号に応じてスイッチング動作し、電源電圧
を発生するスイッチング電源である。尚、図１におい
て、図４と同一の回路については図４と同一の符号を付
すが、左フロント用、左リア用、右フロント用及び右リ
ア用の電力増幅器には、番号の後ろに「ＬＦ」、「Ｌ
Ｒ」、「ＲＦ」及び「ＲＲ」を付す。また、各々の電力
増幅回路の増幅動作については、図４の従来の電力増幅
装置の動作と同一である。
【００１３】まず、左オーディオ信号に着目して加算回
路９の動作について説明する。加算回路９には、左フロ
ント用第１出力増幅器２ＬＦ及び左リア用第２出力増幅
器３ＬＲの出力信号ａ及びｂが印加される。左フロント
用第１出力増幅器２ＬＦの出力信号ａは、正の左オーデ
ィオ信号に対応して発生しており、左リア用第２出力増
幅器３ＬＲの出力信号ｂは、負の左オーディオ信号に対
応して発生している。両方の出力信号が加算回路９で加
算されると、加算回路９の出力信号ｃは図２（ハ）のよ
うに左オーディオ信号の正負に対応した波形が交互に表
れた信号になる。加算回路９の出力信号ｃはスイッチン
グ電源１０に印加され、その出力信号に応じてスイッチ
ング電源１０はスイッチング動作し、電源電圧Ｖｓを発
生する。電源電圧Ｖｓの波形は加算回路９の出力信号と
相似形の信号が発生し、そのレベルは左フロント用第１
出力増幅器２ＬＦまたは左リア用出力増幅器３ＬＲの出
力信号より所定レベルだけ高いレベルになる。その為、
電源電圧Ｖｓは、左オーディオ信号の半周期で第１出力
増幅器２ＬＦ及び２ＬＲからの出力信号に追従し、他の
半周期で第２出力増幅器３ＬＦ及び３ＬＲからの出力信
号に追従する。よって、左フロント用及び左リア用電力
増幅装置からそれぞれ正負の出力信号を用いることによ
って、左オーディオ信号の正負に応じて出力増幅器の電
源電圧を変えることができる。
路９の動作について説明する。加算回路９には、左フロ
ント用第１出力増幅器２ＬＦ及び左リア用第２出力増幅
器３ＬＲの出力信号ａ及びｂが印加される。左フロント
用第１出力増幅器２ＬＦの出力信号ａは、正の左オーデ
ィオ信号に対応して発生しており、左リア用第２出力増
幅器３ＬＲの出力信号ｂは、負の左オーディオ信号に対
応して発生している。両方の出力信号が加算回路９で加
算されると、加算回路９の出力信号ｃは図２（ハ）のよ
うに左オーディオ信号の正負に対応した波形が交互に表
れた信号になる。加算回路９の出力信号ｃはスイッチン
グ電源１０に印加され、その出力信号に応じてスイッチ
ング電源１０はスイッチング動作し、電源電圧Ｖｓを発
生する。電源電圧Ｖｓの波形は加算回路９の出力信号と
相似形の信号が発生し、そのレベルは左フロント用第１
出力増幅器２ＬＦまたは左リア用出力増幅器３ＬＲの出
力信号より所定レベルだけ高いレベルになる。その為、
電源電圧Ｖｓは、左オーディオ信号の半周期で第１出力
増幅器２ＬＦ及び２ＬＲからの出力信号に追従し、他の
半周期で第２出力増幅器３ＬＦ及び３ＬＲからの出力信
号に追従する。よって、左フロント用及び左リア用電力
増幅装置からそれぞれ正負の出力信号を用いることによ
って、左オーディオ信号の正負に応じて出力増幅器の電
源電圧を変えることができる。
【００１４】また、右オーディオ信号に着目して加算回
路９の動作を説明するが、左オーディオ信号に着目した
際の動作と同等の動作を行う。但し、加算回路９には、
右フロント用第２出力増幅器３ＲＦ及び右リア用第１出
力増幅器２ＲＲの出力信号ｂ’及びａ’が印加される。
その為、加算回路９の出力信号は、右オーディオ信号の
正負に対応した波形が交互に表れた信号になる。加算回
路の９の出力信号に応じて発生するスイッチング電源１
０の電源電圧Ｖｓは、右オーディオ信号の半周期で第１
出力増幅器２ＲＦ及び２ＲＲからの出力信号に追従し、
他の半周期で第２出力増幅器３ＬＦ及び３ＬＲからの出
力信号に追従する。よって、右フロント用及び右リア用
電力増幅装置からそれぞれ正負の出力信号を用いること
によって、右オーディオ信号の正負に応じて出力増幅器
の電源電圧を変えることができる。
路９の動作を説明するが、左オーディオ信号に着目した
際の動作と同等の動作を行う。但し、加算回路９には、
右フロント用第２出力増幅器３ＲＦ及び右リア用第１出
力増幅器２ＲＲの出力信号ｂ’及びａ’が印加される。
その為、加算回路９の出力信号は、右オーディオ信号の
正負に対応した波形が交互に表れた信号になる。加算回
路の９の出力信号に応じて発生するスイッチング電源１
０の電源電圧Ｖｓは、右オーディオ信号の半周期で第１
出力増幅器２ＲＦ及び２ＲＲからの出力信号に追従し、
他の半周期で第２出力増幅器３ＬＦ及び３ＬＲからの出
力信号に追従する。よって、右フロント用及び右リア用
電力増幅装置からそれぞれ正負の出力信号を用いること
によって、右オーディオ信号の正負に応じて出力増幅器
の電源電圧を変えることができる。
【００１５】次に、左右フロント用電力増幅装置のオー
ディオ信号に着目して加算回路９の動作について説明す
る。加算回路９には、左フロント用第１出力増幅器２Ｌ
Ｆ及び右フロント用第２出力増幅器３ＲＦの出力信号ａ
及びｂ’が印加される。左フロント用第１出力増幅器２
ＬＦの出力信号は、正の左オーディオ信号に対応して発
生しており、右フロント用第２出力増幅器３ＲＦの出力
信号は、負の右オーディオ信号に対応して発生してい
る。両方の出力信号が加算回路９で加算されると、加算
回路９の出力信号は図２（ハ）のように正の左オーディ
オ信号と負の右オーディオ信号に対応した波形が交互に
表れる信号になる。ここで、左右ステレオ信号の波形が
異なることはほとんどないので、左右ステレオ信号は同
一波形であると考える。その結果、加算回路９の出力信
号は、左オーディオ信号または右オーディオ信号のみを
着目したときの加算回路９の出力信号と同一となる。そ
の為、加算回路９の出力信号に応じてスイッチング電源
１０から発生する電源電圧Ｖｓは、入力オーディオ信号
信号の半周期で第１出力増幅器２ＬＦ及び２ＲＦからの
出力信号に追従し、他の半周期で第２出力増幅器３ＬＦ
及び３ＲＦからの出力信号に追従する。よって、左右フ
ロント用電力増幅装置からそれぞれ正負の出力信号を用
いることによって、左右オーディオ信号に応じて出力増
幅器の電源電圧を変えることができる。
ディオ信号に着目して加算回路９の動作について説明す
る。加算回路９には、左フロント用第１出力増幅器２Ｌ
Ｆ及び右フロント用第２出力増幅器３ＲＦの出力信号ａ
及びｂ’が印加される。左フロント用第１出力増幅器２
ＬＦの出力信号は、正の左オーディオ信号に対応して発
生しており、右フロント用第２出力増幅器３ＲＦの出力
信号は、負の右オーディオ信号に対応して発生してい
る。両方の出力信号が加算回路９で加算されると、加算
回路９の出力信号は図２（ハ）のように正の左オーディ
オ信号と負の右オーディオ信号に対応した波形が交互に
表れる信号になる。ここで、左右ステレオ信号の波形が
異なることはほとんどないので、左右ステレオ信号は同
一波形であると考える。その結果、加算回路９の出力信
号は、左オーディオ信号または右オーディオ信号のみを
着目したときの加算回路９の出力信号と同一となる。そ
の為、加算回路９の出力信号に応じてスイッチング電源
１０から発生する電源電圧Ｖｓは、入力オーディオ信号
信号の半周期で第１出力増幅器２ＬＦ及び２ＲＦからの
出力信号に追従し、他の半周期で第２出力増幅器３ＬＦ
及び３ＲＦからの出力信号に追従する。よって、左右フ
ロント用電力増幅装置からそれぞれ正負の出力信号を用
いることによって、左右オーディオ信号に応じて出力増
幅器の電源電圧を変えることができる。
【００１６】また、左右リア用電力増幅装置に印加され
るオーディオ信号に着目して加算回路９の動作を説明す
るが、左右フロント用電力増幅装置に印加されるオーデ
ィオ信号に着目した際の動作と同等の動作を行う。但
し、加算回路９には、左リア用第２出力増幅器３ＬＲ及
び右リア用第１出力増幅器２ＲＲの出力信号ｂ及びａ’
が印加される。その為、加算回路９の出力信号は、負の
左オーディオ信号と正の右オーディオ信号に対応した波
形が交互に表れた信号になる。加算回路の９の出力信号
に応じて発生するスイッチング電源１０の電源電圧Ｖｓ
は、第１出力増幅器２ＬＲ及び２ＲＲからの出力信号に
追従し、第２出力増幅器３ＬＲ及び３ＲＲからの出力信
号に追従する。よって、左右リア用電力増幅装置からそ
れぞれ正負の出力信号を用いることによって、リア用の
オーディオ信号の正負に応じて出力増幅器の電源電圧を
変えることができる。
るオーディオ信号に着目して加算回路９の動作を説明す
るが、左右フロント用電力増幅装置に印加されるオーデ
ィオ信号に着目した際の動作と同等の動作を行う。但
し、加算回路９には、左リア用第２出力増幅器３ＬＲ及
び右リア用第１出力増幅器２ＲＲの出力信号ｂ及びａ’
が印加される。その為、加算回路９の出力信号は、負の
左オーディオ信号と正の右オーディオ信号に対応した波
形が交互に表れた信号になる。加算回路の９の出力信号
に応じて発生するスイッチング電源１０の電源電圧Ｖｓ
は、第１出力増幅器２ＬＲ及び２ＲＲからの出力信号に
追従し、第２出力増幅器３ＬＲ及び３ＲＲからの出力信
号に追従する。よって、左右リア用電力増幅装置からそ
れぞれ正負の出力信号を用いることによって、リア用の
オーディオ信号の正負に応じて出力増幅器の電源電圧を
変えることができる。
【００１７】以上述べたように、左オーディオ信号系統
と右オーディオ信号系統とに着目しても、また、フロン
ト系統とリア系統とに着目しても、加算回路９からは、
各々の電力増幅装置の正及び負出力信号を加算して得ら
れる信号と同一の信号が得られる。また、加算回路９は
入力信号のうち最もレベルの高い信号を選択し、選択さ
れた信号を発生するものである。その為、４つの信号が
同時に印加された場合、加算回路９はその中から最もレ
ベルの高い信号を選択し、スイッチング電源１０に印加
する。スイッチング電源１０は加算回路９の出力信号に
応じてスイッチング動作するので、スイッチング電源１
０の出力電圧Ｖｓは４つの高効率増幅回路のうち最も高
い出力レベルを発生する高効率増幅回路に合わせて発生
する。その為、この出力電圧Ｖｓにより、４つの高効率
増幅装置のすべてを十分に駆動させることができる。
と右オーディオ信号系統とに着目しても、また、フロン
ト系統とリア系統とに着目しても、加算回路９からは、
各々の電力増幅装置の正及び負出力信号を加算して得ら
れる信号と同一の信号が得られる。また、加算回路９は
入力信号のうち最もレベルの高い信号を選択し、選択さ
れた信号を発生するものである。その為、４つの信号が
同時に印加された場合、加算回路９はその中から最もレ
ベルの高い信号を選択し、スイッチング電源１０に印加
する。スイッチング電源１０は加算回路９の出力信号に
応じてスイッチング動作するので、スイッチング電源１
０の出力電圧Ｖｓは４つの高効率増幅回路のうち最も高
い出力レベルを発生する高効率増幅回路に合わせて発生
する。その為、この出力電圧Ｖｓにより、４つの高効率
増幅装置のすべてを十分に駆動させることができる。
【００１８】図１のように、加算回路９の入力信号とし
て、左フロント用出力増幅器２ＬＦの出力信号、左リア
用出力増幅器３ＬＲの出力信号、右フロント用出力増幅
器３ＲＦの出力信号及び右リア用出力増幅器２ＲＲの出
力信号の組み合わせで用いるだけでなく、左フロント用
出力増幅器３ＬＦの出力信号、左リア用出力増幅器２Ｌ
Ｒの出力信号、右フロント用出力増幅器２ＲＦの出力信
号及び右リア用出力増幅器３ＲＲの出力信号の組み合わ
せで用いても、スイッチング電源１０の出力電圧を４つ
の高効率増幅回路のうち最も高い出力レベルを発生する
高効率増幅回路に合わせて発生させることができる。
て、左フロント用出力増幅器２ＬＦの出力信号、左リア
用出力増幅器３ＬＲの出力信号、右フロント用出力増幅
器３ＲＦの出力信号及び右リア用出力増幅器２ＲＲの出
力信号の組み合わせで用いるだけでなく、左フロント用
出力増幅器３ＬＦの出力信号、左リア用出力増幅器２Ｌ
Ｒの出力信号、右フロント用出力増幅器２ＲＦの出力信
号及び右リア用出力増幅器３ＲＲの出力信号の組み合わ
せで用いても、スイッチング電源１０の出力電圧を４つ
の高効率増幅回路のうち最も高い出力レベルを発生する
高効率増幅回路に合わせて発生させることができる。
【００１９】図３は加算回路の具体回路例を示す回路図
であり、１１は左フロント用出力増幅器２ＬＦの出力信
号が印加されるトランジスタ、１２は左リア用出力増幅
器３ＬＲの出力信号が印加されるトランジスタ、１３は
右フロント用出力増幅器３ＲＦの出力信号が印加される
トランジスタ、１４は右リア用出力増幅器４ＲＲの出力
信号が印加されるトランジスタ、１５及び１６はベース
がトランジスタ１１及び１２のエミッタにそれぞれ接続
されるとともに、エミッタ及びコレクタがそれぞれ共通
接続されるトランジスタ、１７及び１８はベースがトラ
ンジスタ１３及び１４のエミッタにそれぞれ接続される
とともに、エミッタ及びコレクタがそれぞれ共通接続さ
れるトランジスタ、１９はトランジスタ１５乃至１８の
コレクタ電流を反転する電流ミラー回路、２０はベース
がトランジスタ１５乃至１８のエミッタに接続されるト
ランジスタ、２１は電流ミラー回路１９とトランジスタ
２０のエミッタとの間に接続されたダイオードである。
であり、１１は左フロント用出力増幅器２ＬＦの出力信
号が印加されるトランジスタ、１２は左リア用出力増幅
器３ＬＲの出力信号が印加されるトランジスタ、１３は
右フロント用出力増幅器３ＲＦの出力信号が印加される
トランジスタ、１４は右リア用出力増幅器４ＲＲの出力
信号が印加されるトランジスタ、１５及び１６はベース
がトランジスタ１１及び１２のエミッタにそれぞれ接続
されるとともに、エミッタ及びコレクタがそれぞれ共通
接続されるトランジスタ、１７及び１８はベースがトラ
ンジスタ１３及び１４のエミッタにそれぞれ接続される
とともに、エミッタ及びコレクタがそれぞれ共通接続さ
れるトランジスタ、１９はトランジスタ１５乃至１８の
コレクタ電流を反転する電流ミラー回路、２０はベース
がトランジスタ１５乃至１８のエミッタに接続されるト
ランジスタ、２１は電流ミラー回路１９とトランジスタ
２０のエミッタとの間に接続されたダイオードである。
【００２０】図３において、トランジスタ１１乃至１４
のうち１つが、例えば、トランジスタ１１がベースに印
加される入力信号により導通すると、そのコレクタ電流
が電流ミラー回路１９を介してトランジスタ２０及びダ
イオード２１に供給され、トランジスタ２０及びダイオ
ード２１はオンする。また、入力信号に対応したトラン
ジスタ１１のベース電圧はトランジスタ１１及び１５の
ベース−エミッタ間電圧分だけ下がり、降圧した電圧が
トランジスタ１５のエミッタに発生する。そして、トラ
ンジスタ２０及びダイオード２１がオンしているので、
トランジスタ１５のエミッタ電圧はトランジスタのベー
スエミッタ間電圧とダイオード２１の３倍の順方向電圧
との分だけ昇圧される。よって、出力端子Ｃから左フロ
ント用出力増幅器２ＬＦの出力信号に対応した電圧が発
生する。
のうち１つが、例えば、トランジスタ１１がベースに印
加される入力信号により導通すると、そのコレクタ電流
が電流ミラー回路１９を介してトランジスタ２０及びダ
イオード２１に供給され、トランジスタ２０及びダイオ
ード２１はオンする。また、入力信号に対応したトラン
ジスタ１１のベース電圧はトランジスタ１１及び１５の
ベース−エミッタ間電圧分だけ下がり、降圧した電圧が
トランジスタ１５のエミッタに発生する。そして、トラ
ンジスタ２０及びダイオード２１がオンしているので、
トランジスタ１５のエミッタ電圧はトランジスタのベー
スエミッタ間電圧とダイオード２１の３倍の順方向電圧
との分だけ昇圧される。よって、出力端子Ｃから左フロ
ント用出力増幅器２ＬＦの出力信号に対応した電圧が発
生する。
【００２１】また、４つのトランジスタのうち２つが、
例えば、トランジスタ１１及び１２がそれぞれの入力信
号により導通すると、トランジスタ１１及び１２のコレ
クタ電流が電流ミラー回路１９を介して、トランジスタ
２０及びダイオード２１に供給される。一方、トランジ
スタ１１または１２のベース電圧は、トランジスタ１１
及び１５、または、トランジスタ１２及び１６のベース
−エミッタ間電圧でそれぞれ降圧される。その後、トラ
ンジスタ１５及び１６のエミッタ電圧はトランジスタ２
０のベース−エミッタ間電圧及びダイオード２１の順方
向電圧分だけ昇圧される。トランジスタ１１及び１２の
エミッタ電圧が異なっていれば、出力端子Ｃからは左フ
ロント用出力増幅器２ＬＦ及び左リヤ用出力増幅器３Ｌ
Ｒの出力信号のうち高いほうに対応した電圧が発生す
る。
例えば、トランジスタ１１及び１２がそれぞれの入力信
号により導通すると、トランジスタ１１及び１２のコレ
クタ電流が電流ミラー回路１９を介して、トランジスタ
２０及びダイオード２１に供給される。一方、トランジ
スタ１１または１２のベース電圧は、トランジスタ１１
及び１５、または、トランジスタ１２及び１６のベース
−エミッタ間電圧でそれぞれ降圧される。その後、トラ
ンジスタ１５及び１６のエミッタ電圧はトランジスタ２
０のベース−エミッタ間電圧及びダイオード２１の順方
向電圧分だけ昇圧される。トランジスタ１１及び１２の
エミッタ電圧が異なっていれば、出力端子Ｃからは左フ
ロント用出力増幅器２ＬＦ及び左リヤ用出力増幅器３Ｌ
Ｒの出力信号のうち高いほうに対応した電圧が発生す
る。
【００２２】そして、トランジスタ１１乃至１４のうち
３つまたは４つが導通した場合には、各々出力増幅器の
出力信号のうち最も高いほうに対応した電圧が出力端子
Ｃから発生する。よって、各々の高効率増幅回路の出力
信号のうち、最も高いレベルの出力信号を選択し、最も
高いレベルの出力信号に応じた出力信号が出力端子Ｃか
ら発生する。
３つまたは４つが導通した場合には、各々出力増幅器の
出力信号のうち最も高いほうに対応した電圧が出力端子
Ｃから発生する。よって、各々の高効率増幅回路の出力
信号のうち、最も高いレベルの出力信号を選択し、最も
高いレベルの出力信号に応じた出力信号が出力端子Ｃか
ら発生する。
【００２３】
【発明の効果】本発明に依れば、左フロント及び右リア
用高効率増幅回路の一方の出力信号と、左リア及び右フ
ロント用高効率増幅回路の他方の出力信号とを加算する
ことにより、その中から最も高い出力信号を選択し、選
択された出力信号によりスイッチング電源をスイッチン
グ動作させている。その為、加算回路の入力信号として
用いられる高効率増幅回路の出力信号を削減することが
でき、その結果、加算回路の回路構成を簡単にできる。
具体的には、４チャンネルの高効率増幅回路からそれぞ
れ１つの出力信号を用いているので、加算回路を２チャ
ンネル分にすることができる。
用高効率増幅回路の一方の出力信号と、左リア及び右フ
ロント用高効率増幅回路の他方の出力信号とを加算する
ことにより、その中から最も高い出力信号を選択し、選
択された出力信号によりスイッチング電源をスイッチン
グ動作させている。その為、加算回路の入力信号として
用いられる高効率増幅回路の出力信号を削減することが
でき、その結果、加算回路の回路構成を簡単にできる。
具体的には、４チャンネルの高効率増幅回路からそれぞ
れ１つの出力信号を用いているので、加算回路を２チャ
ンネル分にすることができる。
【００２４】また、集積化した場合には、回路構成を簡
単にできるので、加算回路に係わるチップ面積を小さく
することができる。
単にできるので、加算回路に係わるチップ面積を小さく
することができる。
【図１】本発明の実施の形態を示すブロック図である。
【図２】図１の回路の各々の出力信号を示す波形図であ
る。
る。
【図３】加算回路９の具体回路例を示す回路図である。
【図４】従来例を示すブロック図である
１ 第１差動増幅器 ２ 第１出力増幅器 ３ 第２出力増幅器 ４ 負荷 ５ 非線形加算回路 ６ 第２差動増幅器 ９ 加算回路 １０ スイッチング電源
Claims (3)
- 【請求項１】第１入力信号を増幅するとともに、各々の
出力信号で負荷をＢＴＬ駆動する第１及び第２高効率増
幅器と、第２入力信号を増幅するとともに、各々の負荷
をＢＴＬ駆動する第３及び第４高効率増幅器とを備え、
前記第１及び第３高効率出力増幅器を一対とし、前記第
２及び第４高効率増幅器を他対とする電力増幅装置にお
いて、 前記第１及び第４高効率増幅器の一方の出力信号と、前
記第２及び第３高効率増幅器の他方の出力信号とのう
ち、最高レベルの出力信号を選択する選択回路と、 該選択回路の出力信号に応じてスイッチング動作し、前
記第１乃至第４高効率増幅器の電源電圧を発生するスイ
ッチング電源と、を備えることを特徴とする電力増幅装
置。 - 【請求項２】第１乃至第４高効率増幅器の各々は、 第１及び第２出力信号を発生し、負荷をＢＴＬ駆動する
第１及び第２出力増幅器と、前記第１及び第２出力増幅
器の出力信号を非線形加算する非線形加算回路と、入力
信号を増幅するとともに、出力直流電圧が前記非線形加
算回路の出力信号に応じて制御され、前記第１及び第２
出力増幅器の入力信号を発生する非線形増幅器と、 から成ることを特徴とする請求項１記載の電力増幅装
置。 - 【請求項３】前記選択回路は、 ベースに前記第１高効率増幅器の一方の出力信号及び前
記第２高効率増幅器の他方の出力信号がそれぞれ印加さ
れる第１及び第２トランジスタと、ベースに前記第３高
効率増幅器の他方の出力信号及び前記第４高効率増幅器
の一方の出力信号がそれぞれ印加される第３及び第４ト
ランジスタと、エミッタ及びコレクタが共通接続され、
ベースが前記第１及び第２トランジスタのエミッタにそ
れぞれ接続される第５及び第６トランジスタと、エミッ
タ及びコレクタが共通接続され、ベースが前記第１及び
第２トランジスタのエミッタにそれぞれ接続される第７
及び第８トランジスタと、前記第５乃至第８トランジス
タのコレクタ電流を反転する電流ミラー回路と、ベース
が前記第５乃至第６トランジスタの共通エミッタに接続
された第９トランジスタと、前記電流ミラー回路と前記
第９トランジスタのエミッタとの間に接続されたダイオ
ードとから成ることを特徴とする請求項１記載の電力増
幅装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29069196A JP3986105B2 (ja) | 1996-10-31 | 1996-10-31 | 電力増幅装置 |
| EP97118835A EP0840444B1 (en) | 1996-10-31 | 1997-10-29 | Power amplifier apparatus |
| DE69724552T DE69724552T2 (de) | 1996-10-31 | 1997-10-29 | Leistungsverstärkerapparat |
| KR1019970056411A KR100499850B1 (ko) | 1996-10-31 | 1997-10-30 | 전력증폭장치 |
| US08/961,745 US5920229A (en) | 1996-10-31 | 1997-10-31 | Power amplifier apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29069196A JP3986105B2 (ja) | 1996-10-31 | 1996-10-31 | 電力増幅装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10135751A true JPH10135751A (ja) | 1998-05-22 |
| JP3986105B2 JP3986105B2 (ja) | 2007-10-03 |
Family
ID=17759266
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29069196A Expired - Fee Related JP3986105B2 (ja) | 1996-10-31 | 1996-10-31 | 電力増幅装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5920229A (ja) |
| EP (1) | EP0840444B1 (ja) |
| JP (1) | JP3986105B2 (ja) |
| KR (1) | KR100499850B1 (ja) |
| DE (1) | DE69724552T2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100340193B1 (ko) * | 1998-03-31 | 2002-06-12 | 니시무로 타이죠 | 전력 증폭 회로 |
Families Citing this family (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11136039A (ja) * | 1997-10-31 | 1999-05-21 | Sanyo Electric Co Ltd | 電力増幅装置 |
| US7167569B1 (en) * | 2000-10-25 | 2007-01-23 | National Semiconductor Corporation | Output coupling capacitor free audio power amplifier dynamically configured for speakers and headphones with excellent click and pop performance |
| WO2004010575A1 (ja) * | 2002-07-18 | 2004-01-29 | Sony Corporation | パワーアンプ装置 |
| EP1487100A1 (en) | 2003-06-09 | 2004-12-15 | STMicroelectronics S.r.l. | Multi-channel power amplifier with channels independently self-configuring bridge or single-ended output, particulary for audio applications |
| EP1496611A1 (en) * | 2003-07-09 | 2005-01-12 | STMicroelectronics S.r.l. | Multi-channel power amplifier self-configuring to a bridge or single-ended output, particularly for audio applications |
| HUE029499T2 (en) * | 2004-05-05 | 2017-02-28 | Audera Acoustics Inc | Speaker with built-in amplifier and audio frequency amplifier |
| EP2056451A3 (en) * | 2007-10-16 | 2011-11-30 | THX Ltd | Efficient power amplifier |
Family Cites Families (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5620314A (en) * | 1979-07-27 | 1981-02-25 | Nippon Gakki Seizo Kk | Electric power amplifier |
| US4721919A (en) * | 1986-12-22 | 1988-01-26 | General Motors Corporation | Class G bridge amplifier with unipolar supplies |
| US4857861A (en) * | 1987-09-23 | 1989-08-15 | U. S. Philips Corporation | Amplifier arrangement with improved quiescent current control |
| DE69314933T2 (de) * | 1993-02-24 | 1998-06-10 | St Microelectronics Srl | Selbstkonfigurierbarer Doppelbrückenverstärker |
| JPH06260858A (ja) * | 1993-03-03 | 1994-09-16 | Sanyo Electric Co Ltd | 電力増幅装置 |
| JP3459442B2 (ja) * | 1993-03-29 | 2003-10-20 | 三洋電機株式会社 | 差動増幅回路及びそれを用いた電力増幅装置 |
| JPH0746437A (ja) * | 1993-07-26 | 1995-02-14 | Sanyo Electric Co Ltd | リモートコントローラ |
| JPH0846460A (ja) * | 1994-07-26 | 1996-02-16 | Sanyo Electric Co Ltd | 増幅回路 |
| DE19525411A1 (de) * | 1995-07-12 | 1997-01-16 | Philips Patentverwaltung | Signalverstärker |
-
1996
- 1996-10-31 JP JP29069196A patent/JP3986105B2/ja not_active Expired - Fee Related
-
1997
- 1997-10-29 DE DE69724552T patent/DE69724552T2/de not_active Expired - Fee Related
- 1997-10-29 EP EP97118835A patent/EP0840444B1/en not_active Expired - Lifetime
- 1997-10-30 KR KR1019970056411A patent/KR100499850B1/ko not_active IP Right Cessation
- 1997-10-31 US US08/961,745 patent/US5920229A/en not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100340193B1 (ko) * | 1998-03-31 | 2002-06-12 | 니시무로 타이죠 | 전력 증폭 회로 |
Also Published As
| Publication number | Publication date |
|---|---|
| KR19980033328A (ko) | 1998-07-25 |
| JP3986105B2 (ja) | 2007-10-03 |
| US5920229A (en) | 1999-07-06 |
| DE69724552T2 (de) | 2004-07-01 |
| KR100499850B1 (ko) | 2005-09-08 |
| EP0840444B1 (en) | 2003-09-03 |
| DE69724552D1 (de) | 2003-10-09 |
| EP0840444A1 (en) | 1998-05-06 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| KR100340193B1 (ko) | 전력 증폭 회로 | |
| US5424683A (en) | Differential amplification circuit wherein a DC level at an output terminal is automatically adjusted and a power amplifier wherein a BTL drive circuit is driven by a half wave | |
| JPS648923B2 (ja) | ||
| JP3986105B2 (ja) | 電力増幅装置 | |
| JPH0235486B2 (ja) | ||
| US4045744A (en) | Low-frequency power amplifier | |
| US6127888A (en) | Power amplification device | |
| KR100528107B1 (ko) | 전력증폭장치 | |
| US3938053A (en) | Integrated circuit for class-B power amplifier | |
| US4357579A (en) | Power amplifier | |
| JP2564787Y2 (ja) | 電力増幅装置 | |
| US4831337A (en) | Wideband amplifier | |
| JPH0846460A (ja) | 増幅回路 | |
| JP3474929B2 (ja) | 増幅回路 | |
| JPS6031298Y2 (ja) | 過渡音防止回路 | |
| JPH0846458A (ja) | 電力増幅装置 | |
| JP3148551B2 (ja) | オーディオ用増幅回路 | |
| JPH09294033A (ja) | 電力増幅装置 | |
| JPH10107561A (ja) | 電力増幅装置 | |
| JPS60204105A (ja) | ステレオ再生用増幅装置 | |
| JPH04288715A (ja) | Ｂｔｌ電力増幅回路 | |
| JP3281798B2 (ja) | 電力増幅回路 | |
| JPS6224974Y2 (ja) | ||
| JPH09246890A (ja) | 電力増幅装置 | |
| JPH0345567B2 (ja) |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040209 |
|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20050405 |
|
| A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20050530 |
|
| RD01 | Notification of change of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7421 Effective date: 20051226 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20070710 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100720 Year of fee payment: 3 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100720 Year of fee payment: 3 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110720 Year of fee payment: 4 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110720 Year of fee payment: 4 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120720 Year of fee payment: 5 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120720 Year of fee payment: 5 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130720 Year of fee payment: 6 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| LAPS | Cancellation because of no payment of annual fees |