JPH05244145A - 可変タイミング信号発生回路 - Google Patents

可変タイミング信号発生回路

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JPH05244145A
JPH05244145A JP3128566A JP12856691A JPH05244145A JP H05244145 A JPH05244145 A JP H05244145A JP 3128566 A JP3128566 A JP 3128566A JP 12856691 A JP12856691 A JP 12856691A JP H05244145 A JPH05244145 A JP H05244145A
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mobile station
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賢二 中原
Jiro Tsunoda
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    • H04—ELECTRIC COMMUNICATION TECHNIQUE
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    • H04B7/00—Radio transmission systems, i.e. using radiation field
    • H04B7/24—Radio transmission systems, i.e. using radiation field for communication between two or more posts
    • H04B7/26—Radio transmission systems, i.e. using radiation field for communication between two or more posts at least one of which is mobile
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    • H04B7/2671—Arrangements for Wireless Time-Division Multiple Access [TDMA] System Synchronisation
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Abstract

(57)【要約】 【目的】 温度変化又は素子の誤差により遅延時間が変
化することを防止できると共に、遅延時間を精細に設定
することができる可変タイミング信号発生回路を提供す
る。 【構成】 ＣＰＵで設定したデータはフリップフロップ
２で記憶され、このデータがプリセット値としてカウン
タ３に供給される。カウンタ３は入力トリガ（フレーム
同期信号）に基づいてカウント動作を開始する。信号発
生回路５はカウンタ３がカウントアウトしたときにタイ
ミング信号を発生する。このタイミング信号を使用して
送信タイミングを制御する。 【効果】 ディジタル移動通信において、基地局と移動
局との間の伝搬遅延時間をＣＰＵのデータに基づいてク
ロック幅の精度で補正することができる。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明はＴＤＭＡ（時分割多元接
続）フレームを利用したディジタル移動通信において通
信時の伝搬遅延時間に応じて送信タイミングを制御する
可変タイミング信号発生回路に関する。
【０００２】
【従来の技術】アナログＦＤＭＡ（周波数分割多元接
続）通信の移動体通信機では、基地局と移動局との間の
伝搬遅延について、特に対策が施されていない。一方、
ＴＤＭＡフレームを利用したディジタル通信において
は、移動局が移動することにより基地局と移動局との間
の伝搬遅延時間が変動するため、移動局から送信される
データが基地局の受信タイムスロットで正しく受信され
ない。そこで、移動局から伝搬遅延時間分だけ早くデー
タを送信すれば、基地局の受信タイムスロットで正しく
受信することができる。
【０００３】このような伝搬遅延は基地局と移動局との
間の距離及び天候等によって変化するため、移動局から
の送信タイミングも上記条件に応じて変化させる必要が
ある。従来、送信タイミングの制御は遅延素子等を切り
替えることにより行なわれ、実用化されている。
【０００４】
【発明が解決しようとする課題】しかしながら、上述し
た従来の送信タイミングの制御手段では、遅延素子等を
使用するため、遅延素子の誤差（バラツキ）又は温度変
化により遅延時間が変化するという問題点がある。ま
た、特定の遅延時間を有する複数個の遅延素子を使用
し、この複数個の遅延素子を切り替えるため、遅延時間
を精細に設定することができないという問題点がある。
【０００５】本発明はかかる問題点に鑑みてなされたも
のであって、温度変化又は素子の誤差により遅延時間が
変化することを防止できると共に、遅延時間を精細に設
定することができる可変タイミング信号発生回路を提供
することを目的とする。
【０００６】
【課題を解決するための手段】本発明に係る可変タイミ
ング信号発生回路は、基地局から送信された信号に同期
したフレーム同期信号を発生するフレーム同期信号発生
回路と、前記フレーム同期信号に基づいてカウント動作
を開始するカウンタと、ＣＰＵで設定したデータに基づ
いて前記カウンタにプリセット値を供給するインターフ
ェイス回路と、前記カウンタがカウントアウトしたとき
にタイミング信号を発生するタイミング信号発生回路
と、前記カウンタ及び前記タイミング信号発生回路にク
ロック信号を供給するクロック信号供給源とを有するこ
とを特徴とする。
【０００７】
【作用】本発明においては、基地局とこの基地局に対し
て移動する移動局との間で行なうディジタル移動通信に
おいて、移動局に可変タイミング信号発生回路を設け、
前記基地局と前記移動局との間の距離等に応じて伝搬遅
延時間が変動した場合に、可変タイミング信号発生回路
のタイミング信号により前記伝搬遅延時間を補正する。
【０００８】この場合に、フレーム同期信号発生回路は
前記基地局から送信された信号に同期したフレーム同期
信号を発生する。そして、カウンタは前記フレーム同期
信号に基づいてカウント動作を開始すると共に、インタ
ーフェイス回路からＣＰＵのデータに基づくプリセット
値が供給される。このため、前記カウンタは前記プリセ
ット値からカウントし、カウントアウトする。タイミン
グ信号発生回路は前記カウンタがカウントアウトしたと
きに発生する信号を入力し、この信号に基づいてタイミ
ング信号を発生する。このタイミング信号を使用して移
動局からの送信タイミングを制御することにより、基地
局と移動局との間の伝搬遅延時間を補正することができ
る。なお、前記カウンタ及び前記タイミング信号発生回
路はクロック信号供給源から供給されるクロック信号に
より動作する。
【０００９】本発明によれば、ＣＰＵで設定したデータ
により移動局からの送信タイミングを制御することがで
きるので、温度変化又は素子の誤差により伝搬遅延時間
が変化することを防止できる。また、移動局からの送信
タイミングは、基地局と移動局との間の伝搬遅延時間に
応じて、クロック信号の信号幅の精度で精細に設定する
ことができる。
【００１０】カウンタにプリセット値を供給するインタ
ーフェイス回路は以下に示すようにして構成することが
できる。即ち、アドレスデコーダはＣＰＵで割り付けら
れたアドレスを検出する。そして、フリップフロップは
前記アドレスデコーダの検出結果に基づいて、前記ＣＰ
Ｕから前記アドレスと同時に供給されるデータを取り込
み、このデータをプリセット値としてカウンタに供給す
る。
【００１１】
【実施例】次に、本発明の実施例について添付の図面を
参照して説明する。
【００１２】図１は本発明の実施例に係る可変タイミン
グ信号発生回路を示すブロック図である。アドレスデコ
ーダ１はＣＰＵ（図示せず）で割り付けられた１６ビッ
トのアドレスを検出する。ＯＲゲート１０はアドレスデ
コーダ１の検出結果とＣＰＵから供給されるライト信号
（ＷＲ）とを入力し、双方のＯＲをとって出力する。フ
リップフロップ２はＯＲゲート１０の出力をクロック入
力し、ＣＰＵから供給される８ビットのデータを記憶す
る。プリセット付きカウンタ３はフリップフロップ２の
出力をプリセット値として入力し、所定の入力トリガ
（ＴＲＩＧ）に基づいてカウント動作を開始する。この
入力トリガとしては、フレーム同期信号発生回路（図示
せず）が基地局からの送信信号に同期して発生するフレ
ーム同期信号を使用する。タイミング信号発生回路５は
カウンタ３がカウントアウトしたときに発生する信号を
入力し、この信号に基づいてタイミング信号（パルス信
号）を発生する。なお、カウンタ３及びタイミング信号
発生回路５はクロック信号供給源４から供給されるクロ
ック信号により動作する。
【００１３】次に、上述の如く構成される可変タイミン
グ信号発生回路を基地局に対して移動する移動局に設け
た場合の動作について説明する。
【００１４】即ち、基地局と移動局との間の伝搬遅延時
間が変動した場合、ＣＰＵから伝搬遅延時間を補正する
ためのデータを供給する。このデータはＣＰＵから供給
されるアドレス及びライト信号に基づいてフリップフロ
ップ２に取り込まれて記憶される。このフリップフロッ
プ２から出力されるデータはプリセット付きカウンタ３
のプリセット値として供給される。カウンタ３は入力ト
リガが入力されると、クロック信号供給源４のクロック
信号でカウント動作を開始する。そして、カウンタ３が
カウントアウトすると、タイミング信号発生回路がタイ
ミング信号を発生する。このタイミング信号を使用して
移動局からの送信タイミングを制御することにより、基
地局と移動局との間の伝搬遅延時間を補正することがで
きる。
【００１５】本実施例によれば、ＣＰＵで設定したデー
タに基づいてカウンタ３にプリセット値を供給し、カウ
ンタ３がプリセット値からカウント動作を開始してカウ
ントアウトするまでの遅延時間で移動局からの送信タイ
ミングを制御することができるので、温度変化又は素子
の誤差により伝搬遅延時間が変化することを防止でき
る。また、移動局からの送信タイミングは、基地局と移
動局との間の伝搬遅延時間に応じて、クロック信号の信
号幅の精度で精細に設定することができる。
【００１６】例えば、基地局と移動局との間に伝搬遅延
がない場合は、図２に示すように、基準局の送信タイム
スロット６と移動局の受信タイムスロット７との時系列
が一致し、移動局の送信タイムスロット９と基地局の受
信タイムスロット８との時系列が一致する。このため、
基地局及び移動局の送信・受信間のタイムスロットは共
に例えば２タイムスロットになる。
【００１７】しかしながら、基地局と移動局との間に伝
搬遅延がある場合には、図３に示すように、基地局の送
信タイムスロット６と移動局の受信タイムスロット７と
の間に伝搬遅延時間Ｔが生じる。この伝搬遅延時間Ｔを
補正せずに移動局から基地局に信号を送信すると、基地
局で受信するときに伝搬遅延時間Ｔが２倍になり、基地
局の送信・受信間のタイムスロットは２タイムスロット
以上になる。
【００１８】そこで、本実施例に係る可変タイミング信
号発生回路を使用することにより、伝搬遅延時間Ｔを考
慮して移動局からの送信タイミングを制御する。これに
より、図４に示すように、基地局の受信タイムスロット
８で正しく受信することができる。
【００１９】
【発明の効果】以上説明したように本発明によれば、Ｃ
ＰＵで設定したデータに基づいてインターフェイス回路
がカウンタにプリセット値を供給し、フレーム同期信号
に基づいて前記カウンタがカウント動作を開始し、この
カウンタがカウントアウトしたときにタイミング信号発
生回路がタイミング信号を発生するから、基地局と移動
局との間のディジタル移動通信において、ＣＰＵで設定
したデータにより移動局からの送信タイミングを制御す
ることができる。このため、温度変化又は素子の誤差に
より伝搬遅延時間が変化することを防止できる。また、
移動局からの送信タイミングは、基地局と移動局との間
の伝搬遅延時間に応じて、クロック信号の信号幅の精度
で精細に設定することができる。従って、ＴＤＭＡ通信
における伝搬遅延を容易に補正することができる。
【図面の簡単な説明】
【図１】本発明の実施例に係る可変タイミング信号発生
回路を示すブロック図である。
【図２】伝搬遅延がない場合の基地局と移動局との間の
送信・受信状態を時系列的に示すタイミング図である。
【図３】伝搬遅延がある場合の基地局と移動局との間の
送信・受信状態を時系列的に示すタイミング図である。
【図４】本実施例に係る可変タイミング信号発生回路を
使用して伝搬遅延を補正した場合の基地局と移動局との
間の送信・受信状態を時系列的に示すタイミング図であ
る。
【符号の説明】
１；アドレスデコーダ ２；フリップフロップ ３；プリセット付きカウンタ ４；クロック信号供給源 ５；タイミング信号発生回路 ６，９；送信タイムスロット ７，８；受信タイムスロット

Claims (2)

    【特許請求の範囲】
  1. 【請求項１】 基地局から送信された信号に同期したフ
    レーム同期信号を発生するフレーム同期信号発生回路
    と、前記フレーム同期信号に基づいてカウント動作を開
    始するカウンタと、ＣＰＵで設定したデータに基づいて
    前記カウンタにプリセット値を供給するインターフェイ
    ス回路と、前記カウンタがカウントアウトしたときにタ
    イミング信号を発生するタイミング信号発生回路と、前
    記カウンタ及び前記タイミング信号発生回路にクロック
    信号を供給するクロック信号供給源とを有することを特
    徴とする可変タイミング信号発生回路。
  2. 【請求項２】 前記インターフェイス回路は前記ＣＰＵ
    で割り付けられたアドレスを検出するアドレスデコーダ
    と、前記ＣＰＵから前記アドレスと同時に供給されるデ
    ータを前記アドレスデコーダの検出結果に基づいて取り
    込むフリップフロップとを有することを特徴とする請求
    項１に記載の可変タイミング信号発生回路。
JP3128566A 1991-04-30 1991-04-30 可変タイミング信号発生回路 Expired - Lifetime JP2723691B2 (ja)

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