JP6339066B2 - Led製造のためのpvd緩衝層 - Google Patents

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Description

(関連出願の相互参照)
本出願は、2012年4月26日出願の米国仮特許出願第61/638,893号の利益を主張するものであり、この特許文献の内容全体を参照により本明細書に組み込む。
本発明の実施形態は、III族窒化物材料の分野に関し、詳細には、物理的気相堆積(PVD)により形成される窒化アルミニウム緩衝層を有する窒化ガリウムベースの発光ダイオード(LED)の製造に関する。
III−V族材料は、半導体産業、および発光ダイオード(LED)などの関連産業において、ますます重要な役割を果たしている。しばしば、欠陥または亀裂を生じずに、III−V族材料を異種の基板の上で成長または堆積させる(ヘテロエピタキシとして知られている)ことは難しい。例えば、選択フィルム、例えば窒化ガリウムフィルムの高品質表面保護は、順次に製造される材料層のスタックを使用する多くの用途において簡単ではない。基板とデバイス層の間に1つまたは複数の緩衝層を含むことが、一手法となっている。しかし、III−V族材料は、しばしばプロセス条件の影響を受けやすく、製造プロセスの特定の期間にそのような条件を回避するように配慮しなければならない。しかし、敏感なIII−V族フィルムと、損傷をもたらす可能性がある条件との相互作用を回避することも、多くの用途において簡単ではない。
本発明の実施形態は、物理的気相堆積(PVD)で形成された窒化アルミニウム緩衝層を有する窒化ガリウムベースの発光ダイオード(LED)の製造を対象とする。
一実施形態では、基板の上に緩衝層を製造する方法が、基板の表面を前処理することを含む。また、この方法は、その後、窒素ベースのガスまたはプラズマを用いて、物理的気相堆積(PVD)チャンバ内に収容されたアルミニウム含有ターゲットから基板の表面上に窒化アルミニウム(AlN)層を反応性スパッタリングすることも含む。
一実施形態では、半導体装置が、基板と、基板の上に配置された窒化アルミニウム(AlN)緩衝層とを含み、AlN緩衝層が、根二乗平均で約1ナノメートル未満の粗さと、約200arcsec未満の(002)ピークのFWHMを有する(002)方向での結晶配向とを有する原子的に滑らかな表面を有する。
一実施形態では、基板の上に緩衝層を製造する方法が、基板の表面上にプレシード層を形成することを含む。また、この方法は、窒素ベースのガスまたはプラズマを用いて、物理的気相堆積(PVD)チャンバ内に収容されたアルミニウム含有ターゲットからプレシード層上に窒化アルミニウム(AlN)層を反応性スパッタリングすることも含む。
本発明の1つまたは複数の実施形態による、ベンチマーククラスタツールの概略図、ベンチマークLED構造、およびベンチマーク時間対堆積プロットを示す図である。 本発明の一実施形態による、LED構造の製造に関するクラスタツールの概略図と、対応する温度対時間プロットとを示す図である。 本発明の一実施形態によるLED構造と、対応する時間対堆積プロットとを示す図である。 本発明の一実施形態によるPVDチャンバに関するプロセスキットの断面図である。 本発明の一実施形態によるPVDチャンバに関するプロセスキットの断面図である。 本発明の一実施形態によるPVDチャンバに関するプロセスキットの断面図である。 本発明の一実施形態による、PVDチャンバ用のパワー送達源の断面図である。 本発明の一実施形態による、III族窒化物材料の製造に適したMOCVDチャンバの概略断面図である。 本発明の一実施形態による、III族窒化物材料の製造に適したHVPEチャンバの概略断面図である。
物理的気相堆積(PVD)により形成される窒化アルミニウム緩衝層を有する窒化ガリウムベースの発光ダイオード(LED)の製造を述べる。以下の説明では、本発明の実施形態を完全に理解できるように、プロセスチャンバ構成および材料レジームなど、いくつかの具体的な詳細を記載する。これらの具体的な詳細を伴わなくても本発明の実施形態を実施することができることは、当業者には明らかであろう。また、本発明の実施形態を不要に曖昧にしないように、特定のダイオード構成などよく知られているフィーチャは詳述しない。さらに、図面に示される様々な実施形態は、例示的に表したものであり、必ずしも縮尺通りには描かれていないことを理解されたい。さらに、本明細書における実施形態では明示的に開示されないことがあるが、他の配置および構成も本発明の精神および範囲内にあるものとみなされる。
LED製造法は、基板と、アンドープおよび/またはドープ窒化ガリウムのデバイス層との間に窒化ガリウムの緩衝層を形成することを含むことができる。本明細書で述べる実施形態では、そのような窒化ガリウム緩衝層の代わりに、基板と、アンドープおよびドープ窒化ガリウムのデバイス層との間で窒化アルミニウム緩衝層が使用される。窒化アルミニウム層は、PVDプロセスにおいてスパッタ堆積によって形成することができる。これは、典型的には有機金属気相堆積(MOCVD)チャンバまたはハイドライド気相エピタキシ(HVPE)チャンバ内で行われるIII族窒化物緩衝層の形成とは対照的である。窒化アルミニウム層は、PVDチャンバ内に収容された窒化アルミニウムターゲットからの非反応性スパッタリングによって形成することができ、あるいは、PVDチャンバ内に収容され、窒素ベースのガスまたはプラズマと反応させられるアルミニウムターゲットからの反応性スパッタリングによって形成することができる。
1つまたは複数の実施形態に従って、GaNベースのデバイス用のPVD AlN緩衝層に関するプロセス条件を本明細書で述べる。また、1つまたは複数の同じまたは異なる実施形態に従って、窒化ガリウムベースのデバイス用のPVD窒化アルミニウム緩衝層に関する基板前処理も本明細書で述べる。
本明細書で述べる実施形態の1つまたは複数は、LED製造に使用されるマルチチャンバ製造ツールにおいて、より高いスループットを実現可能にすることができる。また、窒化ガリウム緩衝層ではなく、PVDにより形成される窒化アルミニウム層を含むことによって、アンドープおよびドープ窒化ガリウムのデバイス層を全体的に薄くすることができる。特定の例では、アンドープ部分を薄くする、または完全になくすことができる。さらに、窒化アルミニウム層を堆積するために使用されるのと同じPVD堆積チャンバ内で、サファイア基板など受取り基板の予備スパッタ洗浄を行うことができる。さらに、PVDによる窒化アルミニウム層は、300℃未満の温度で形成することができるので、LED製造の全体のサーマルバジェットを減少させることができる。対照的に、典型的な窒化ガリウム緩衝層は、500〜600℃の間で形成される。本明細書で述べる実施形態の1つまたは複数は、より速い堆積速度、例えば、アンドープおよび/またはn型ドープ窒化ガリウムなどの材料に関する成長速度の2倍の堆積速度を実現可能にすることができる。より速い速度を実現することができる理由は、いくつかの実施形態では、アンドープおよび/またはn型ドープ窒化ガリウム層を上で成長させるためのより良く整合された結晶配向および形態学的関係を提供することができる窒化アルミニウム(AlN)緩衝層上にアンドープおよび/またはn型ドープ窒化ガリウム層が形成されるからである。本明細書で述べる実施形態の1つまたは複数は、説明する操作の多くがクラスタツール内でインサイチュで行われるので、酸化物除去操作をなくすことを実現可能にすることができる。本明細書で述べる実施形態の1つまたは複数は、PVDにより形成される窒化アルミニウム緩衝層上に窒化ガリウムを形成することによって、窒化ガリウム結晶の品質の改良を実現可能にすることができる。
本発明の実施形態は、本明細書で述べるシステムおよび方法の研究中に開発されたベンチマークシステムまたは方法に勝る改良を提供することができる。例えば、図1は、本発明の1つまたは複数の実施形態による、ベンチマーククラスタツールの概略図、ベンチマークLED構造、およびベンチマーク時間対堆積プロットを示す。
図1を参照すると、ベンチマーククラスタツール100は、アンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ102(MOCVD1:u−GaN/n−GaN)と、多重量子井戸(MQW)MOCVD反応チャンバ104(MOCVD2:MQW)と、p型窒化ガリウムMOCVD反応チャンバ106(MOCVD3:p−GaN)とを含む。また、ベンチマーククラスタツール100は、ロードロック108と、キャリアカセット110と、高電圧用途のための任意選択のさらなるドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ112とを含むこともでき、それらはすべて図1に示されている。
ベンチマークLED構造120は、様々な材料層のスタックを含み、層の多くは、III−V族材料を含む。例えば、ベンチマークLED構造120は、シリコンまたはサファイア基板122(基板:サファイア、Si)と、厚さ20ナノメートルの緩衝層124(LT緩衝)と、厚さ約4ミクロンのアンドープ/n型窒化ガリウム複合層126(u−GaN/n−GaN)とを含む。緩衝層124は、比較的低い処理温度で形成される窒化ガリウム層でよい。緩衝層124とアンドープ/n型窒化ガリウム複合層126は、ベンチマーククラスタツール100のアンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ102内で形成される。また、ベンチマークLED構造120は、30〜500ナノメートルの範囲内の厚さを有するMQW構造128を含む。MQW構造128は、ベンチマーククラスタツール100のMQW MOCVD反応チャンバ104内で形成される。また、ベンチマークLED構造120は、厚さ約20ナノメートルのp型窒化ガリウムアルミニウム層130(p−AlGaN)と、50〜200ナノメートルの範囲内の厚さを有するp型窒化ガリウム層132(p−GaN)とを含む。p型窒化ガリウムアルミニウム層130とp型窒化ガリウム層132は、ベンチマーククラスタツール100のp型窒化ガリウムMOCVD反応チャンバ106内で形成される。
ベンチマーク時間対堆積プロット140は、ベンチマーククラスタツール100内でのチャンバ使用を表す。MQW MOCVD反応チャンバ104内でのMQW構造128の形成は、約2時間の成長時間を有する。p型窒化ガリウムMOCVD反応チャンバ106内でのp型窒化ガリウムアルミニウム層130とp型窒化ガリウム層132の形成は、約1時間の成長時間を有する。また、アンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ102内での緩衝層124とアンドープ/n型窒化ガリウム複合層126の形成は、約3.5時間の成長時間を有する。チャンバ102のチャンバ洗浄のために、さらに約1時間必要となることがある。したがって、全体として、ベンチマーククラスタツール100内でベンチマークLED構造120を製造するためのサイクル時間は、アンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ102のサイクル時間によって決定され、これは約4.5時間である。洗浄時間は、必ずしもそうではないが、停止のための時間と、洗浄時間と、回復時間とを含むこともあることを理解されたい。また、チャンバ使用の合間に洗浄が必ず行われるわけではないこともあるので、上記の値は平均を表すこともあることを理解されたい。
図1に関連して述べたアンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ102内での緩衝層124とアンドープ/n型窒化ガリウム複合層126の形成に特有の、LED材料堆積のためのベンチマークタイミングシーケンスを以下に提供する。例えば、約3.5時間の成長時間は、10分間のサファイア基板の高温処理と、5分間の緩衝層の低温形成と、10分間の緩衝アニーリング操作と、30分間の成長回復操作と、2時間のアンドープ/n型窒化ガリウム複合層形成操作と、30分間の温度勾配および安定化操作(例えば、温度勾配2〜3℃/秒)とに分けられる。
図1に関連して述べたベンチマークシステムおよび方法を参照すると、ベンチマーク手法は、LEDの各機能層に関して均衡の取れていないタイムフローを生じることがある。例えば、アンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ102内での緩衝層124とアンドープ/n型窒化ガリウム複合層126の形成は、3.5時間であり、MQW MOCVD反応チャンバ104内でのMQW構造128の形成は2時間であり、p型窒化ガリウムMOCVD反応チャンバ106内でのp型窒化ガリウムアルミニウム層130とp型窒化ガリウム層132の形成は1時間である。さらに、上述したように、アンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ102内での行程の間に、さらに約1時間のチャンバ洗浄(場合によってはポンプダウン時間を含む)が必要とされることがある。そのような追加のチャンバ洗浄は、基板汚染を避けるために必要とされることがある。したがって、3つのMOCVDチャンバを用いた構造120の漸進的な成長は、MQW MOCVD反応チャンバ104およびp型窒化ガリウムMOCVD反応チャンバ106に関してかなりの遊休時間を生じ、システム100の全体的なスループットを減少させる。
本発明の一態様では、LED構造を製造するためのクラスタシステムのスループットは、上述したMOCVD材料成長機能または操作の1つまたはその一部を、PVDスパッタリング堆積機能または操作で置き換えることによって改良することができる。例えば、図2Aは、本発明の一実施形態による、LED構造の製造に関するクラスタツールの概略図と、対応する温度対時間プロットとを示す。図2Bは、本発明の一実施形態によるLED構造と、対応する時間対堆積プロットとを示す。
図2Aを参照すると、クラスタツール200は、PVD窒化アルミニウムスパッタチャンバ202(PVD AlN)と、アンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ204(MOCVD1:u−GaN/n−GaN)と、多重量子井戸(MQW)MOCVD反応チャンバ206(MOCVD2:MQW)と、p型窒化ガリウムMOCVD反応チャンバ208(MOCVD3:p−GaN)とを含む。また、クラスタツール200は、ロードロック210と、キャリアカセット212と、移送チャンバ214とを含むこともでき、それらはすべて図2Aに示されている。
したがって、本発明の一実施形態によれば、マルチチャンバシステムは、金属アルミニウムまたはアルミニウム化合物のターゲットを含むPVDチャンバと、アンドープ窒化ガリウムおよび/またはn型窒化ガリウムまたはそれら両方を堆積するように適合されたチャンバとを含む。一実施形態では、PVDチャンバのターゲットは、窒化アルミニウムから構成される。そのような実施形態では、堆積したい材料と同じ材料からターゲットが構成されているので、反応性スパッタリングを使用する必要はない。しかし、代替実施形態では、アルミニウムから構成されるターゲットが使用され、そのアルミニウムターゲットから、窒素源によって、または窒素源の存在下で、窒化アルミニウムの反応性スパッタリングが行われる。一実施形態では、図2Aに示されるように、アンドープまたはn型窒化ガリウムを堆積するように適合されたチャンバは、MOCVDチャンバである。しかし、代替実施形態では、アンドープまたはn型窒化ガリウムを堆積するように適合されたチャンバは、ハイドライド気相エピタキシ(HVPE)チャンバである。一実施形態では、図2Aに示されるように、PVDチャンバと、アンドープまたはn型窒化ガリウムを堆積するように適合されたチャンバとが、クラスタツール構成内に含まれる。しかし、代替実施形態では、PVDチャンバと、アンドープまたはn型窒化ガリウムを堆積するように適合されたチャンバとが、インラインツール構成内に含まれる。本明細書で述べるPVDに基づく堆積プロセスは、標準室温に近い温度で行われることがあり、またはより高温で行われることもある。
図2Bを参照すると、LED構造220は、様々な材料層のスタックを含み、層の多くは、III−V族材料を含む。例えば、LED構造220は、シリコンまたはサファイア基板222(基板:サファイアSi)と、約10〜200ナノメートルの範囲内の厚さを有する窒化アルミニウム層224(AlN)とを含む。窒化アルミニウム層224は、クラスタツール200のPVD窒化アルミニウムスパッタチャンバ202内でスパッタ堆積によって形成される。また、LED構造220は、厚さ約4ミクロンのアンドープ/n型窒化ガリウム複合層またはn型窒化ガリウム単層226(n−GaN)を含む。アンドープ/n型窒化ガリウム複合層またはn型窒化ガリウム単層226は、クラスタツール200のアンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ204内で形成される。また、LED構造220は、30〜500ナノメートルの範囲内の厚さを有するMQW構造228を含む。MQW構造228は、クラスタツール200のMQW MOCVD反応チャンバ206内で形成される。一実施形態では、MQW構造228は、InGaN井戸/GaNバリア材料層の1つまたは複数の磁場対から構成される。また、LED構造220は、厚さ約20ナノメートルのp型窒化ガリウムアルミニウム層230(p−AlGaN)と、50〜200ナノメートルの範囲内の厚さを有するp型窒化ガリウム層232(p−GaN)とを含む。p型窒化ガリウムアルミニウム層230とp型窒化ガリウム層232は、クラスタツール200のp型窒化ガリウムMOCVD反応チャンバ208内で形成される。上記の厚さまたは厚さ範囲は例示的実施形態であり、他の適切な厚さまたは厚さ範囲も本発明の実施形態の精神および範囲内にあるものとみなされることを理解されたい。
時間対堆積プロット240は、クラスタツール200内でのチャンバ使用を表す。MQW MOCVD反応チャンバ206内でのMQW構造228の形成は、約2時間の成長時間を有する。p型窒化ガリウムMOCVD反応チャンバ208内でのp型窒化ガリウムアルミニウム層230とp型窒化ガリウム層232の形成は、約1時間の成長時間を有する。さらに、本発明の一実施形態によれば、アンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ204内でのアンドープ/n型窒化ガリウム複合層またはn型窒化ガリウム単層226の形成は、わずか約2時間の成長時間を有する。チャンバ204のチャンバ洗浄のために、さらに約1時間必要となることがある。しかし、洗浄時間は、停止のための時間と、洗浄時間と、回復時間とを含むこともあることを理解されたい。また、洗浄は、チャンバ使用の合間に必ず行われるわけではないこともあるので、上記の値は平均を表すこともあることを理解されたい。
したがって、窒化ガリウム層126を形成するために使用されるMOCVDチャンバ内で図1の緩衝層124などの緩衝層を形成するのではなく、代わりに窒化アルミニウム緩衝層224が含まれ、別のチャンバ内で、特にPCV窒化アルミニウムスパッタチャンバ202内で形成される。AlNの成長は、(約400トルから約10−8トルへの)ポンプ時間を除いて約5分間かかることがあるが、MOCVDチャンバ1とは別のチャンバ内での形成により、クラスタツール200のスループットが増加する。例えば、全体として、クラスタツール200内でLED構造220を製造するためのサイクル時間は、ここでも、アンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ204のサイクル時間によって決定され、これは、ベンチマークシステムでの4.5時間に対して、約3時間に短縮される。したがって、3つのMOCVDチャンバに加えて1つのPVDチャンバを用いた構造220の漸進的な成長は、MQW MOCVD反応チャンバ206およびp型窒化ガリウムMOCVD反応チャンバ208に関する遊休時間をはるかに短くし、システム200の全体のスループットを改良する。例えば、一実施形態では、ツールスループットは、1日当たり約5.3回の行程から、1日当たり約8回の行程に改良され、約50%のスループット改良を示す。
再び図2Aを参照すると、クラスタツール200内でのLED構造の製造に関する代表的な温度対時間プロット250が提供される。プロット250の領域252は、アンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ204内で形成されるアンドープ/n型窒化ガリウム複合層またはn型窒化ガリウム単層226の形成に特有のものである。この領域内では、ただ1つの温度勾配(約1100℃から約400℃への低下)が必要とされる。そのような単一勾配事象要件は、上述したようなアンドープおよび/またはn型窒化ガリウムMOCVD反応チャンバ102内での緩衝層124とアンドープ/n型窒化ガリウム複合層126の形成に関するタイミングシーケンスとは全く異なる。緩衝層124とアンドープ/n型窒化ガリウム複合層126の形成の場合には、チャンバは、基板処理のための高温で始まり、緩衝層製造のための温度に低下し、窒化ガリウム堆積のための温度に再び上昇し、最後に、安定化のために再び低下する。しかし、MQWおよびp−GaNの形成に特有のプロット250の領域254および256は、どちらの場合にもほぼ同じであることに留意されたい。一実施形態では、プロット250の領域258を参照すると、PVDにより形成される窒化アルミニウムに関する温度対時間のプロットは、約20〜1200℃の範囲内での高温(HT)プロセスまたは低温(LT)プロセスを含むことができる。
クラスタツール200に関するスループット改良に加えて、1つのPVDチャンバと3つのMOCVDチャンバとを備えるツール構成にはさらなる利益が存在することがある。例えば、第1のMOCVDチャンバに送達する必要がある反応ガスがより少量であるので、コスト節約が実現される。PVDチャンバ技術および設計は、ベンチマーククラスタツール100のチャンバ102のような、緩衝層とデバイス層の両方に専用のMOCVDチャンバに関する設定時間および複雑さに比べて単純であることがある。上記のプロセスが、デバイス層226のアンドープ窒化ガリウム部分に関する厚さ減少を実現可能にする場合、より単純な全面的な(down−the−line)エッチバックプロセスを実施することができる。また、このプロセスは、サイクル時間を短縮しながら、材料および動作コストの節約を実現可能にすることもできる。また、窒化ガリウム緩衝層の代わりに窒化アルミニウム緩衝層を使用することによって、LEDデバイスなどのデバイスの活性層の欠陥の減少を実現することができる。
したがって、本発明の一実施形態によれば、マルチチャンバシステムは、窒化アルミニウムターゲットを含むPVDチャンバと、アンドープまたはn型窒化ガリウムを堆積するための第1のMOCVDチャンバとを含む。また、マルチチャンバシステムは、多重量子井戸(MQW)構造を堆積するための第2のMOCVDチャンバと、p型窒化アルミニウムガリウムもしくはp型窒化ガリウムまたはそれら両方を堆積するための第3のMOCVDチャンバとを含む。一実施形態では、窒化アルミニウムターゲットを有するPVDチャンバは、窒化アルミニウムの非反応性スパッタリング用のものである。特定のそのような実施形態では、PVDチャンバは、約20〜200℃の範囲内の低い温度またはわずかに高い温度での窒化アルミニウムの非反応性スパッタリング用のものである。別の特定のそのような実施形態では、PVDチャンバは、約200〜1200℃の範囲内の高温での窒化アルミニウムの非反応性スパッタリング用のものである。
堆積温度に関係なく、所要の材料特性(例えば、適切な欠陥密度、結晶粒径、結晶配向など)を実現するために、LED構造220内に含むのに適した、PVDにより堆積された窒化アルミニウム層を、ある時点で400〜1400℃の範囲内、例えば約900℃の高温にさらすことが必要となることもあり得る。本発明の一実施形態によれば、窒化アルミニウム層の上に追加の層を製造する前に、PVDにより堆積された窒化アルミニウム層に対して高速熱処理(RTP)プロセスが行われる。このとき、RTPチャンバは、LED構造220に関する上述した製造プロセスに何らかの形で関連付けられることがある。一実施形態では、PVDチャンバと3つのMOCVDチャンバとを含むクラスタツールまたはインラインツールなどのツールが、RTPチャンバも含む。しかし、代替実施形態では、RTPプロセスはPVDチャンバ内で行われる。別の代替実施形態では、LED構造220に関する上述した製造プロセスに、レーザアニーリング機能が関連付けられる。
第1の態様では、PVD窒化アルミニウム緩衝層のための基板前処理を述べる。そのような緩衝層は、例えばGaNベースのデバイスに含まれることがある。一実施形態では、AlN材料特性を改良する基板前処理プロセスの詳細を、そのような基板前処理に有用なハードウェアと共に述べる。
PVD AlNは、サファイアやシリコンなど異種基板上に成長させるGaNベースのLEDおよびパワーデバイス用の緩衝層として使用することができる。PVD AlN緩衝層は、緩衝層の上に成長させるGaN層の材料品質を改良するために使用することができ、したがってデバイス性能および信頼性を改良するために含むことができる。サファイア上でのGaNの典型的なMOCVD成長において、PVD AlNプロセスを使用すると、限定はしないが、基板プリベーク、低温MOCVD緩衝形成、および何らかの温度上昇操作などの操作を省略することができる。さらに、処理時間を約10〜30%短縮することができる。ガリウムに起因する損傷からシリコン基板を保護するためにAlN層が必要となり得るシリコン上でのGaNの成長に関して、特にチャンバ洗浄時間も考慮に入れると、PVD AlN層は、通常はエピタキシャル成長に基づくプロセスよりも約3〜6時間節約することができる。そのようなプロセス時間短縮は、システムスループットを大幅に高めることができる。PVD AlNの結晶品質が、上に成長させるGaN層の材料品質に直接的な影響を及ぼすことがあることを理解されたい。したがって、以下により詳細に述べるように、一実施形態では、PVD AlN層は、高い結晶品質およびプロセス再現性の向上を提供する。
一実施形態では、異種基板、例えばサファイアの前処理が実施されて、表面汚染物質および粒子を基板から除去し、またAlおよびN原子を受け取るように基板表面を準備して、高度に組織化された結晶構造でAlN結晶層を形成する。1つのそのような実施形態では、基板前処理は、例えばPVDによるAlNの堆積を、約1ナノメートル未満の表面粗さ(根二乗平均で;AFMに基づいて)および(002)XRD FWHM<50arcsecで可能にする。さらに、実行毎およびウエハ毎の高いプロセス再現性、ならびにウエハ内部での高い一様性も実現することができる。
一実施形態では、基板前処理は、PVD堆積チャンバ内でインサイチュで行われる。1つのそのような実施形態では、基板がチャンバ内に装填され、基板の表面付近でプラズマを発生するためにチャンバのペデスタルにバイアス(電圧)が印加される。特定の実施形態では、発生されるプラズマは、窒素、Ar、水素、または他のガスラジカルおよびイオンを含み、これらを使用して、基板表面汚染物質および粒子を除去し、基板の表面構造を変更して、基板と堆積されるエピタキシャル膜との間のより良い結晶整合を保証することができる。一実施形態では、プラズマ密度、バイアス、および処理時間は、基板表面を効果的に洗浄し、かつ基板表面を損傷しないように調節される(例えば、印加されるバイアスは約−5V〜−1000Vの範囲内であり、処理時間は約1秒〜15分の範囲内である)。一実施形態では、対応する電源の周波数は、約100kHz〜100MHzの範囲内である。一実施形態では、前処理中のペデスタルの温度は、約−50℃〜1000℃の範囲内である。一実施形態では、使用されるハードウェアは、チャンバ本体、1つまたは複数の電源、1つまたは複数のターゲット、マグネトロン、ペデスタル、高温ヒータなどを含み、それらの例は以下により詳細に述べる。
1つのそのような実施形態では、基板前処理に関する上記の操作およびプロセスの組合せを使用して、実施毎およびウエハ毎の高い再現性ならびにウエハ内部での高い一様性を有して、高品質のAlN堆積が行われる。特定の実施形態では、その後、XRD(002)FWHM<200arcsecおよびXRD(102)FWHM<300arcsecを有する高品質GaNをPVD AlN層の上に成長させる。別の特定の実施形態では、その後、XRD(002)FWHM<100arcsecおよびXRD(102)FWHM<150arcsecを有する高品質GaNをPVD AlN層の上に成長させる。一実施形態では、上述した基板前処理の使用は、従来式に準備される基板でしばしば観察されるAlNおよびGaN結晶品質のばらつきを減少させる、またはなくす。
第2の態様では、物理的気相堆積(PVD)窒化アルミニウム(AlN)緩衝層を形成するためのプロセス条件を述べる。そのような緩衝層は、例えばGaNベースのデバイスに含まれることがある。一実施形態では、特定の特性および性質を有するAlNを堆積するために、パラメータプロセス窓が提供される。
発光ダイオード(LED)の製造は、典型的には、基板上の金属有機化学気相堆積(MOCVD)による低温緩衝層の形成を含む。典型的には、MOCVDによる緩衝層の堆積の後、活性デバイス層、例えば、非ドープ層、Siドープのn型層、MQW層、およびMgドープのp型GaN層が形成される。基板プレベーキングは、通常は高温(例えば約1050℃よりも高い温度)で行われる。対照的に、緩衝層の堆積は、通常は低温(例えば、約500〜600℃の範囲内の温度)で行われる。これらのプロセスは、MOCVDプロセスの総時間の約10〜30%を占めることがある。エクスサイチュ堆積緩衝層によってMOCVDスループットを向上させることができる。したがって、以下により詳細に述べるように、一実施形態では、PVDによって形成されるエクスサイチュ堆積AlN緩衝層を述べる。一実施形態では、PVDプロセスは、別のチャンバ内で行われる。
一実施形態では、プロセス条件は、GaNデバイス製造で使用するのに適したAlN緩衝(テンプレート)を有する基板を形成するために提供される。1つのそのような実施形態では、AlN緩衝層は、約1ナノメートル未満(根二乗平均で;原子力顕微鏡によって測定される)の粗さと、(002)方向での良好な結晶配向(XRD回折によって検証される;(002)ピークのFWHM<200arcsec)とを有する原子的に滑らかな表面を有するように形成される。特定のそのような実施形態では、AlN膜厚は、約500ナノメートル未満である。
一実施形態では、AlN緩衝層は、PCDチャンバ内に収容され、窒素ベースのガスまたはプラズマと反応されるアルミニウム含有ターゲットからの反応性スパッタリングによって形成される。1つのそのような実施形態では、エピタキシ成長のための準備が整っている基板がPVDチャンバ内に装填され、Al含有ターゲットおよび窒素含有プロセスガスを使用して基板上に連続AlN膜が堆積される。しかし、別の実施形態では、AlNの堆積前に、Al、AlO、SiN、ZnO、ZnS、ZrN、TiNなどから構成されることがあるプレシード層がまず堆積されて、基板表面を保護し、より高品質のAlNの堆積および/またはPVD AlN層に関する高い堆積速度を可能にする。1つの特定の実施形態では、プレシード層は、より低い出力、圧力、またはガス流量などで、窒素含有ガスを伴わずに、汚染されたAl含有ターゲットをスパッタリングすることによって形成される。プレシード層の堆積後、一実施形態では、Al含有ターゲットおよび窒素含有プロセスガスを使用してプレシード層上に連続AlN膜が堆積される。
一実施形態では、基板の選択肢は、限定はしないが、サファイア、SiC、Si、ダイヤモンド、LiAlO、ZnO、W、Cu、GaN、AlGaN、AlN、ソーダ石灰/高シリカガラス、合致した格子定数および熱膨張率を有する基板、上に成長させる窒化物材料に適合する基板または上に成長させる窒化物材料に合わせて設計された基板、所望の窒化物成長温度で熱的および化学的に安定な基板、ならびにパターン形成されていない基板またはパターン形成された基板を含む。一実施形態では、ターゲットの選択肢は、限定はしないが、Al含有金属、合金、化合物、例えばAl、AlN、AlGa、Alなどを含み、ターゲットは、層適合性およびデバイス性能を改良するためにII/IV/VI族元素でドープされることがある。一実施形態では、スパッタリングプロセスガスは、限定はしないが、N、NH、NO、NOなどの窒素含有ガスと、Ar、Ne、Krなどの不活性ガスとを含むことがある。
本発明の一実施形態によれば、AlN緩衝層を堆積する前に、基板は、熱的に(例えば、高速熱処理(RTP)、高温でのベークなど)、化学的に(H、HSO、HCl、HNO、HF、NH4F、原子Hなど)、および/または物理的に(例えば、プレスパッタリング)、インサイチュおよび/またはエクスサイチュ手法によって前処理される。
一実施形態では、PVDチャンバカソードの電源は、約0〜20kWの範囲内の出力と、約0〜60MHzの範囲内の周波数とを有するRF電源を含む。また、DC供給電源が含まれ、約0〜50kWの範囲内の出力を有し、またはパルスDC電源が含まれ、約0〜50kWの範囲内の出力と、約1〜100KHzの範囲内の周波数と、約1〜99%の範囲内のデューティサイクルとを有する。1つのそのような実施形態では、プロセス開始シーケンスは、最初にRF電源をオンに切り替える、最初にDC電源をオンに切り替える、またはRFとDCを同時にオンに切り替えることを含む。電源がオンに切り替えられる前、後、またはそれと同時に、窒素含有ガスの流れを開始することができることを理解されたい。さらなる実施形態では、例えば、基板浮遊電位を調節するため、チャンバ内の反応物のイオン化比、エネルギー、および移動度を変更するため、堆積された膜の応力を制御するため、表面形態および結晶品質を改良するため、堆積速度を高めるために、コンデンサチューナがペデスタルに接続される。
一実施形態では、ウエハ表面温度およびその一様性を制御するために静電チャックが使用される。一実施形態では、堆積温度範囲は、約200〜550℃、550〜1000℃、または1000〜1400℃である。一実施形態では、堆積プロセス範囲は、約0.1〜100mTorrである。
本発明の一実施形態によれば、スパッタリング出力、基板バイアス、ガス流量、圧力、温度、およびガス組成中のIII/V比に対する調節が行われて、反応物ガスを金属またはNリッチにして、垂直成長または横方向成長を促進する。一実施形態では、AlN緩衝層に関して約0.1A/sよりも高い堆積速度が実現され、この速度は、プロセスを通して可変である。一実施形態では、堆積されるAlN膜の最終的な厚さは、約1〜1000nmの範囲内である。
一実施形態では、プロセス終了は、最初にRF電源をオフにする、最初に(パルス)DC電源をオフにする、またはRFとDCを同時にオフにすることを含み、プロセスガスは、表面形態、化学量論、および極性を制御するために、電源がオフにされる前に、それと同時に、またはその後にオフにされる。一実施形態では、熱処理(例えば、RTP、レーザアニーリング、高温ベークなど)または化学処理(溶液ベース、ガスベースなど)、インサイチュおよびエクスサイチュ処理などを含むプロセス後処理が使用される。一実施形態では、ターゲット取込みおよび/またはガスライン送達によってドーパントが添加されて、例えばPVD AlN膜がその上にIII族窒化物デバイスを製造するのに適したものになるように、PVD AlN膜の電気的、機械的、および光学的特性を調節する。
一実施形態では、堆積されるPVD AlN膜は、単層、多層、または上述したプロセス条件を通して製造される異なる組成または特性を有する複数対の交互層の形態である。全体として、一実施形態では、緩衝層形成プロセスは、目標の圧縮応力または引張り応力(例えば、約−10GPa〜10GPaの範囲内)を有する膜を実現するための応力設計を含む。追加または代替として、プロセスは、約70%〜100%の範囲内の密度でAlN膜を堆積するように調節することができる。
1つのそのような実施形態では、上記の操作およびプロセスの組合せを使用して、PVD AlN膜が、非常に滑らかな表面(例えばRMSで0.5ナノメートル)を有して堆積され、約40ナノメートルの厚さで高い材料品質((002)ピークのFWHMが約50arcsec)である。特定の実施形態では、高品質のGaN膜((002)のFWHM<200arcsecおよび(102)のFWHM<300arcsec)が、PVD AlN層上に形成される。別の実施形態では、高品質のGaN膜((002)のFWHM<100arcsecおよび(102)のFWHM<150arcsec)が、PVD AlN層上に形成される。したがって、一実施形態では、低温MOCVD GaN/AlN緩衝層が必要なくなる。一実施形態では、そのようなテンプレート上に堆積された全LEDスタックは、PVD AlN層を使用しない同じ構造のLEDに比べて、約10〜45%の明るさの改良を示した。
3つのMOCVDチャンバと共に1つのPVDチャンバを収容するのに適したツールプラットフォームの例示的実施形態は、Opus(商標)AdvantEdge(商標)システムまたはCentura(商標)システムを含み、どちらもApplied Materials, Inc.(米国カリフォルニア州サンタクララ)から市販されている。本発明の実施形態は、さらに、マルチチャンバ処理プラットフォームの一構成要素として、統合計測(IM)チャンバを含む。IMチャンバは、本明細書で述べるものなどの複数セグメント化されたスパッタまたはエピタキシャル成長プロセスなど、統合堆積プロセスの適応制御を可能にするために制御信号を提供することができる。IMチャンバは、厚さ、粗さ、組成など様々なフィルム特性を測定するのに適した計測装置を含むことができ、さらに、限界寸法(CD)、側壁角度(SWA)、フィーチャ高さ(HT)などの格子パラメータを真空下で自動で特徴付けることが可能であることもある。限定はしないが、例として、リフレクトメトリやスキャトロメトリなどの光学技法が挙げられる。特に有利な実施形態では、真空光学CD(OCD)技法が採用され、この技法では、スパッタおよび/またはエピタキシャル成長が進行するときに、開始材料に形成された格子の属性が監視される。他の実施形態では、計測操作は、別個のIMチャンバ内ではなくプロセスチャンバ内で、例えばプロセスチャンバ内でインサイチュで行われる。
クラスタツール200などのマルチチャンバ処理プラットフォームは、さらに、任意選択の基板アライナチャンバと、カセットを保持するロードロックチャンバとを含むことがあり、これらのチャンバは、ロボットハンドラを含む移送チャンバに結合される。本発明の一実施形態では、マルチチャンバ処理プラットフォーム200の適応制御は、制御装置によって提供される。制御装置は、様々なサブプロセスおよびサブコントローラを制御するための工業環境で使用することができる汎用データ処理システムの任意の形態の1つでよい。一般に、制御装置は、一般的な構成要素の中でもとりわけメモリおよび入出力(I/O)回路と通信する中央処理装置(CPU)を含む。一例として、制御装置は、本明細書で述べる任意の方法/プロセスの操作の1つまたは複数を実施する、または何らかの形で開始することができる。そのような操作を実施および/または開始する任意のコンピュータプログラムコードは、コンピュータプログラムプロダクトとして具現化することができる。本明細書で述べる各コンピュータプログラムプロダクトは、コンピュータ可読媒体(例えば、フロッピーディスク、コンパクトディスク、DVD、ハードドライブ、ランダムアクセスメモリなど)によって担持することができる。
本明細書で企図されるプロセスおよびツール構成に適したPVDチャンバとしては、Applied Materials, Inc.(米国カリフォルニア州サンタクララ)から市販されているEndura PVDシステムを挙げることができる。Endura PVDシステムは、優れたエレクトロマイグレーション耐性および表面形態を提供し、また、維持費が安く、システム信頼性が高い。本明細書で実施されるPVDプロセスは、所要の圧力で、また、プロセスキャビティ内で堆積される種の指向性の流れを生み出す適切なターゲットとウエハの間の距離で行うことができる。やはりApplied Materials, Inc.(米国カリフォルニア州サンタクララ)から市販されているARISTOチャンバなどのインラインシステムと適合性があるチャンバは、自動装荷および除荷機能と、磁気的キャリア輸送システムとを提供し、かなり短縮されたサイクル時間を可能にする。やはりApplied Materials, Inc.(米国カリフォルニア州サンタクララ)から市販されているAKT−PiVot 55KV PVDシステムは、スパッタリング堆積用の縦型プラットフォームを有する。AKT−PiVotシステムのモジュールアーキテクチャは、かなり速いサイクル時間を提供し、また多様な構成を実現可能にして、製造効率を最大にする。従来のインラインシステムとは異なり、AKT−PiVotの並列処理機能は、各フィルム層に関する異なるプロセス時間によって引き起こされる障害をなくす。また、システムのクラスタ状の構成が、個々のモジュールの保守中にも連続的な操作を可能にする。含まれるロータリカソード技術が、従来のシステムに比べて約3倍のターゲット利用を可能にする。PiVotシステムの堆積モジュールは、事前スパッタユニットを特徴とし、事前スパッタユニットは、同じ結果を実現するために他のシステムで必要とされる最大50枚の基板に対して、ただ1つの基板を使用してターゲット調整を実現可能にする。
本発明の一態様では、適切なプロセスキットの設計が、PVDプロセスチャンバでのRFチャンバ機能に重要となり得る。一例として、図3A〜図3Cは、本発明の一実施形態によるPVDチャンバに関するプロセスキットの断面図を示す。図3Dは、本発明の一実施形態による、PVDチャンバ用のパワー送達源の断面図を示す。
図3A〜図3Cを参照すると、PVDチャンバ用のプロセスキット300は、上側アダプタ302と、下側アダプタ304と、下側シールド306と、DTESC308とを有する第1の部分(図3A)を含む。また、PVDチャンバ用のプロセスキット300は、ターゲット310と、ダークスペースシールド312と、Alスペーサ314とを有する第2の部分(図3B)も含む。また、PVDチャンバ用のプロセスキット300は、カバーリング316と、堆積リング318とを有する第3の部分(図3C)も含む。
図3Dを参照すると、PVDチャンバ用のパワー送達源350は、RF整合部352と、RF供給部354とを含む。供給源分配プレート356(例えばアルミニウム源分配プレート)および接地シールド358(例えばアルミニウムシートメタル)も、金属ハウジング360およびリング磁石362と共に含まれる。パワー送達源350は、DCフィルタボックス364およびDC供給部366も含む。上部プレート368および分配プレート370も、延長ブロック372、シャフト374、およびターゲット376と共に含まれる。
上述したMOCVDチャンバ204、206、または208の1つまたは複数として使用するのに適していることがあるMOCVD堆積チャンバの一例が、図4に示されており、図4を参照しながら説明する。図4は、本発明の一実施形態によるMOCVDチャンバの概略断面図である。
図4に示される装置4100は、チャンバ4102と、ガスデリバリシステム4125と、遠隔プラズマ源4126と、真空システム4112とを含む。チャンバ4102は、処理体積4108を取り囲むチャンバ本体4103を含む。シャワーヘッドアセンブリ4104が、処理体積4108の一端に配設され、基板キャリア4114が、処理体積4108の他端に配設される。下側ドーム4119が、下側体積4110の一端に配設され、基板キャリア4114が、下側体積4110の他端に配設される。基板キャリア4114は、プロセス位置で図示されているが、例えば基板4140を装荷または除荷することができる下側位置に移動させることができる。下側体積4110内で堆積が生じるのを防止する一助となるように、また、チャンバ4102から排気口4109に排気ガスを送る一助となるように、基板キャリア4114の周縁に巡らせて排気リング4120を配設させることができる。下側ドーム4119は、高純度水晶などの透明材料からなることがあり、基板4140の放射加熱のために光が通過できるようにする。放射加熱は、下側ドーム4119の下に配設された複数の内側ランプ4121Aおよび外側ランプ4121Bによって提供することができ、反射器4166を使用して、内側および外側ランプ4121A、4121Bによって提供される放射エネルギーへのチャンバ4102の露出の制御を補助することができる。また、基板4140のより精密な温度制御のために、ランプの追加のリングを使用することもできる。
基板キャリア4114は、1つまたは複数の凹部4116を含むことができ、凹部4116内に、1つまたは複数の基板4140を処理中に配設することができる。基板キャリア4114は、6つ以上の基板4140を搬送することができる。一実施形態では、基板キャリア4114は、8つの基板4140を搬送する。より多数、またはより少数の基板4140を基板キャリア4114上で搬送することもできることを理解されたい。典型的な基板4140は、サファイア、炭化ケイ素(SiC)、シリコン、または窒化ガリウム(GaN)を含むことがある。ガラス基板4140など他のタイプの基板4140を処理することもできることを理解されたい。基板4140のサイズは、直径50mm〜100mm以上でよい。基板キャリア4114は、200mm〜750mmの範囲内でよい。基板キャリア4114は、SiCまたはSiC被覆黒鉛を含めた様々な材料から形成することができる。チャンバ4102の内部で、本明細書で述べるプロセスに従って、他のサイズの基板4140を処理することもできることを理解されたい。シャワーヘッドアセンブリ4104は、従来のMOCVDチャンバよりも多数の基板4140および/または大きい基板4140にわたってより均一な堆積を可能にすることができ、それにより、スループットを高め、基板4140当たりの処理コストを減少させる。
基板キャリア4114は、処理中に軸の周りで回転することができる。一実施形態では、基板キャリア4114は、約2RPMから約100RPMで回転することができる。別の実施形態では、基板キャリア4114は、約30RPMで回転することができる。基板キャリア4114の回転は、基板4140の均一な加熱、および各基板4140に対する処理ガスの均一な露出の一助となる。
複数の内側および外側ランプ4121A、4121Bを同心円または同心区域(図示せず)内に配置することができ、各ランプ区域に個別に電力供給することができる。一実施形態では、基板4140および基板キャリア4114の温度を測定するために、高温計(図示せず)など1つまたは複数の温度センサをシャワーヘッドアセンブリ4104の内部に配設することができ、温度データは、制御装置(図示せず)に送信することができ、制御装置は、個々のランプ区域への電力を調節して、基板キャリア4114にわたって所定の温度プロファイルを維持することができる。別の実施形態では、個々のランプ区域への電力は、前駆体の流れまたは前駆体濃度の不均一性を補償するように調節することができる。例えば、外側ランプ区域の近くの基板キャリア4114の領域内で前駆体濃度が低い場合、この領域内での前駆体の枯渇を補償する一助となるように外側ランプ区域への電力を調節することができる。
内側ランプ4121Aおよび外側ランプ4121Bは、基板4140を約400℃〜約1200℃の温度に加熱することができる。本発明は、内側ランプ4121Aおよび外側ランプ4121Bのアレイの使用に限定されないことを理解されたい。チャンバ4102およびチャンバ4102内部の基板4140に適切な温度が適切に加えられることを保証するために、任意の適切な加熱源を利用することができる。例えば、別の実施形態では、加熱源は、基板キャリア4114と熱的に接触する抵抗加熱要素(図示せず)を含むことができる。
ガスデリバリシステム4125は複数のガス源を含むことがあり、または、実行されるプロセスによっては、発生源のいくつかはガス源ではなく液体源でよく、その場合、ガスデリバリシステムは、液体を気化させるために液体注入システムまたは他の手段(例えばバブラ)を含むことがある。次いで、蒸気をキャリアガスと混合させてから、チャンバ4102に送達することができる。前駆体ガス、キャリアガス、パージガス、洗浄/エッチングガスなど様々なガスを、ガスデリバリシステム4125から、シャワーヘッドアセンブリ4104への個別の供給ライン4131、4132、および4133に供給することができる。供給ライン4131、4132、および4133は、各ラインでのガスの流れを監視および調整または遮断するために、遮断弁およびマスフローコントローラまたは他のタイプの制御装置を含むことができる。
導管4129が、遠隔プラズマ源4126から洗浄/エッチングガスを受け取ることができる。遠隔プラズマ源4126は、ガスデリバリシステム4125から供給ライン4124を通してガスを受け取ることができ、シャワーヘッドアセンブリ4104と遠隔プラズマ源4126の間にはバルブ4130を配設することができる。バルブ4130は、プラズマ用の導管として働くように適合させることができる供給ライン4133を通してシャワーヘッドアセンブリ4104内に洗浄/エッチングガスまたはプラズマを流すために開放することができる。別の実施形態では、装置4100が遠隔プラズマ源4126を含まないことがあり、洗浄/エッチングガスは、非プラズマ洗浄および/またはエッチング用のガスデリバリシステム4125から、シャワーヘッドアセンブリ4104への代替の供給ライン構成を使用して送達することができる。
遠隔プラズマ源4126は、チャンバ4102の洗浄および/または基板4140のエッチングに適合された高周波またはマイクロ波プラズマ源でよい。洗浄および/またはエッチングガスを、供給ライン4124を通して遠隔プラズマ源4126に供給して、プラズマ種を生成することができ、そのプラズマ種を、導管4129および供給ライン4133を通して送って、シャワーヘッドアセンブリ4104を通してチャンバ4102内に分散させることができる。洗浄用途のためのガスは、フッ素、塩素、または他の反応性元素を含むことがある。
別の実施形態では、ガスデリバリシステム4125および遠隔プラズマ源4126は、前駆体ガスを遠隔プラズマ源4126に供給してプラズマ種を生成することができるように適切に適合させることができ、そのプラズマ種を、シャワーヘッドアセンブリ4104を通して送って、基板4140上に例えばIII−V族フィルムなどのCVD層を堆積することができる。一般に、物質の一状態であるプラズマは、プロセスガス(例えば前駆体ガス)に電気エネルギーまたは電磁波(例えば無線周波やマイクロ波)を送達して、プロセスガスを少なくとも一部分解させて、イオン、電子、および中性粒子(例えばラジカル)などのプラズマ種を生成することによって生成される。一例では、プラズマは、約100ギガヘルツ(GHz)未満の周波数での送達電磁エネルギーによってプラズマ源4126の内部領域で生成される。別の例では、プラズマ源4126は、約162メガヘルツ(MHz)の周波数など約0.4キロヘルツ(kHz)〜約200メガヘルツ(MHz)の間の周波数で、約4キロワット(kW)未満の出力レベルで電磁エネルギーを送達するように構成される。生成されるプラズマは、前駆体ガスの発生および活性を高め、したがって、堆積プロセス中に基板の表面に達する活性化されたガスは急速に反応して、改良された物理的および電気的特性を有する層を形成することができると考えられる。
パージガス(例えば窒素)は、シャワーヘッドアセンブリ4104から、および/または基板キャリア4114の下およびチャンバ本体4103の底部の近くに配設された入口または管(図示せず)から、チャンバ4102内に送達することができる。パージガスは、チャンバ4102の下側体積4110に入り、基板キャリア4114および排気リング4120を通って上方向に流れ、環状排気チャネル4105の周りに配設された複数の排気口4109内に流れる。排気導管4106は、環状排気チャネル4105を真空システム4112に接続し、真空システム4112は、真空ポンプ(図示せず)を含む。チャンバ4102の圧力は、バルブシステム4107を使用して制御することができ、バルブシステム4107は、排気ガスが環状排気チャネル4105から引き出される流量を制御する。
上述したチャンバ204の代替実施形態(または他のチャンバに関する代替実施形態)のHVPEチャンバ204として使用するのに適していることがあるHVPE堆積チャンバの一例を、図5に関して図示して説明する。図5は、本発明の一実施形態による、III族窒化物材料の製造に適したHVPEチャンバ500の概略断面図である。
装置500は、蓋504によって密閉されたチャンバ502を含む。第1のガス源510からの処理ガスが、ガス分散シャワーヘッド506を通してチャンバ502に送達される。一実施形態では、ガス源510は窒素含有化合物を含む。別の実施形態では、ガス源510はアンモニアを含む。一実施形態では、ヘリウムや二原子窒素など不活性ガスも、ガス分散シャワーヘッド506またはチャンバ502の壁508を通して導入される。ガス源510とガス分散シャワーヘッド506の間にエネルギー源512を配設することができる。一実施形態では、エネルギー源512はヒータを含む。エネルギー源512は、窒素含有ガスからの窒素がより高い反応性をもつように、アンモニアなどガス源510からのガスを分解することができる。
第1のガス源510からのガスと反応させるために、前駆体材料を、1つまたは複数の第2の前駆体ガス源518から送達することができる。前駆体は、前駆体源518内の前駆体の上に、および/または前駆体を通して反応性ガスを流すことによって、チャンバ502に送達させることができる。一実施形態では、反応性ガスは、二原子塩素など塩素含有ガスを含む。塩素含有ガスは、前駆体源と反応して、塩化物を生成することができる。前駆体と反応する塩素含有ガスの効果を高めるために、塩素含有ガスは、チャンバ532内のボート領域を蛇行して通ることがあり、抵抗加熱器520によって加熱されることがある。塩素含有ガスがチャンバ532を通して蛇行される滞留時間を延ばすことによって、塩素含有ガスの温度を制御することができる。塩素含有ガスの温度を高めることによって、塩素は、より迅速に前駆体と反応することができる。すなわち、温度は、塩素と前駆体の反応に対する触媒となる。
前駆体の反応性を高めるために、第2のチャンバ532内部の抵抗加熱器520によってボート内で前駆体を加熱することができる。次いで、塩化物反応生成物をチャンバ502に送達することができる。反応性塩化物生成物は、まず、管522に入り、管522の内部で一様に分散する。管522は、別の管524に接続される。塩化物反応生成物は、第1の管522の内部で一様に分散された後、第2の管524に入る。次いで、塩化物反応生成物はチャンバ502に入り、チャンバ502内で窒素含有ガスと混ざり、サセプタ514の上に配設された基板516の上に窒化物層を形成する。一実施形態では、サセプタ514は炭化ケイ素を含む。窒化物層は、例えばn型窒化ガリウムを含むことがある。窒素や塩素など他の反応生成物は、排気口526を通して排気される。
LEDおよび関連のデバイスは、例えば、III−V族フィルム、特にIII族窒化物フィルムの層から製造することができる。本発明のいくつかの実施形態は、専用のMOCVDチャンバ内など、製造ツールの専用チャンバ内で窒化ガリウム(GaN)層を形成することに関する。本発明のいくつかの実施形態では、GaNは、二元化合物GaNフィルムであるが、他の実施形態では、GaNは、三元化合物フィルム(例えば、InGaN、AlGaN)または四元化合物フィルム(例えば、InAlGaN)である。少なくともいくつかの実施形態では、III族窒化物材料層は、エピタキシャル成長によって形成される。III族窒化物材料層は、基板上に直接形成されることがあり、または、基板上に設けられた緩衝層の上に形成されることがある。他の企図される実施形態は、PVDにより形成される緩衝層、例えばPVDにより形成される窒化アルミニウムの上に直接堆積されたp型ドープ窒化ガリウム層を含む。
本発明の実施形態は、上述した選択基板上での層の形成に限定されないことを理解されたい。他の実施形態は、パターン形成されていない、またはパターン形成された任意の適切な単結晶基板の使用を含むことができ、例えば非反応性PVD手法で、基板上に高品質の窒化アルミニウム層をスパッタ堆積することができる。基板は、限定はしないが、サファイア(Al)基板、シリコン(Si)基板、炭化ケイ素(SiC)基板、シリコンオンダイヤモンド(SOD)基板、水晶(SiO)基板、ガラス基板、酸化亜鉛(ZnO)基板、酸化マグネシウム(MgO)基板、およびリチウムアルミニウムオキシド(LiAlO)基板などの1つでよい。マスキングやエッチングなど任意のよく知られている方法を利用して、平坦な基板からポストなどのフィーチャを形成して、パターン形成された基板を作成することができる。しかし、特定の実施形態では、パターン形成されたサファイア基板(PSS)が、(0001)の配向で使用される。パターン形成されたサファイア基板は、光抽出効率を高めるので、LEDの製造中に使用するのに理想的なものとなり得る。そのような光抽出効率の向上は、新世代の固体発光デバイスの製造に非常に有用である。基板選択基準は、欠陥形成を緩和するための格子整合、および熱応力を緩和するための熱膨張率(CTE)整合を含むことができる。
上述したように、III族窒化物フィルムをドーピングすることができる。III族窒化物フィルムは、限定はしないが、Mg、Be、Ca、Sr、または2つの価電子を有する任意のI族またはII族の元素など、任意のp型ドーパントを使用してp型ドーピングすることができる。III族窒化物フィルムは、1×1016〜1×1020atoms/cmの間の導電性レベルにp型ドーピングすることができる。III族窒化物フィルムは、限定はしないが、ケイ素もしくは酸素、または任意の適切なIV族もしくはVI族元素など、任意のn型ドーパントを使用してn型ドーピングすることができる。III族窒化物フィルムは、1×1016〜1×1020atoms/cmの間の導電性レベルにn型ドーピングすることができる。
上記のプロセスは、クラスタツール、または複数のチャンバを有する他のツール、例えばLEDの層を製造するための専用チャンバを有するように構成されたインラインツールの内部で、専用チャンバ内で行うことができることを理解されたい。また、本発明の実施形態をLEDの製造に限定する必要はないことを理解されたい。例えば、別の実施形態では、限定はしないが電界効果トランジスタ(FET)デバイスなど、LEDデバイス以外のデバイスを、本明細書で述べる手法によって製造することができる。そのような実施形態では、層の基板の上にp型材料が必要ないことがある。p型層の代わりに、n型またはアンドープ材料を使用することもできる。また、堆積および/または熱的アニーリングの様々な組合せなど複数の操作を、単一のプロセスチャンバで行うことができることを理解されたい。
以上、PVDにより形成される窒化アルミニウム緩衝層の製造を開示した。

Claims (10)

  1. ダイヤモンド基板、LiAlO 基板、W基板、Cu基板、AlGaN基板、およびソーダ石灰/高シリカガラス基板からなる群から一つ選択される基板と、
    前記基板の上に配置された窒化アルミニウム(AlN)緩衝層と、
    前記AlN緩衝層の上に配置された窒化ガリウム(GaN)ベースのデバイスを備える半導体装置であって、
    前記AlN緩衝層が、根二乗平均で1ナノメートル未満の粗さと、200arcsec未満の(002)ピークのFWHMを有する(002)方向での結晶配向とを有する原子的に滑らかな表面を有し、前記半導体装置は、
    前記基板と前記AlN緩衝層との間に直接配置されたプレシード層
    をさらに備え、前記プレシード層が、SiN、ZnO、ZnS、ZrN、およびTiNからなる群から選択される層を含む、半導体装置。
  2. 前記AlN緩衝層が500ナノメートル未満の厚さを有する請求項1に記載の半導体装置。
  3. 前記AlN緩衝層の前記(002)方向での前記結晶配向が、50arcsec未満の前記(002)ピークのFWHMを有する請求項1に記載の半導体装置。
  4. 窒化ガリウム(GaN)ベースのデバイスを形成するために基板上に緩衝層を製造する方法であって、前記方法は、
    基板の表面上にプレシード層を形成すること、および
    窒素ベースのガスまたはプラズマを用いて、物理的気相堆積(PVD)チャンバ内に収容されたアルミニウム含有ターゲットから前記プレシード層上に窒化アルミニウム(AlN)層を反応性スパッタリングすること
    を含み、
    前記アルミニウム含有ターゲットは、Al含有金属、合金、化合物からなる群から一つ選択され、かつ、II族及びVI族原子からなる群から一つ選択される原子がドープされている、方法。
  5. 前記プレシード層を形成することが、Al、AlO、SiN、ZnO、ZnS、ZrN、およびTiNからなる群から選択される層を形成することを含む請求項に記載の方法。
  6. 前記プレシード層を形成することは、Al含有ターゲットの無窒素スパッタリングを含む、請求項またはに記載の方法。
  7. 前記プレシード層は、前記AlN層の反応性スパッタリング中に前記基板の表面を保護する、請求項からのいずれか一項に記載の方法。
  8. 反応性スパッタリング法で前記AlN層を形成する前に、前記基板に、熱的、化学的、及び物理的な前処理からなる群から選択される前処理をする、請求項からのいずれか一項に記載の方法。
  9. 前記基板は、サファイア基板、SiC基板、Si基板、ダイヤモンド基板、LiAlO基板、ZnO基板、W基板、Cu基板、GaN基板、AlGaN基板、およびソーダ石灰/高シリカガラス基板からなる群から一つから選択される、請求項からのいずれか一項に記載の方法。
  10. 前記窒素ベースのガスまたはプラズマは、N、NH、NO、NOからなる群から選択されるガスを含むか、またはベースとする、請求項からのいずれか一項に記載の方法。
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Families Citing this family (32)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9396933B2 (en) * 2012-04-26 2016-07-19 Applied Materials, Inc. PVD buffer layers for LED fabrication
US9929310B2 (en) 2013-03-14 2018-03-27 Applied Materials, Inc. Oxygen controlled PVD aluminum nitride buffer for gallium nitride-based optoelectronic and electronic devices
DE102013112785B3 (de) * 2013-11-19 2015-02-26 Aixatech Gmbh Verfahren zur Herstellung eines Verbundkörpers mit zumindest einer funktionellen Schicht oder zur weiteren Herstellung elektronischer oder opto-elektronischer Bauelemente
KR102145205B1 (ko) * 2014-04-25 2020-08-19 삼성전자주식회사 반도체 소자 제조방법 및 증착 장치의 유지보수방법
JP6817072B2 (ja) 2014-05-27 2021-01-20 シランナ・ユー・ブイ・テクノロジーズ・プライベート・リミテッドSilanna Uv Technologies Pte Ltd 光電子デバイス
US11322643B2 (en) 2014-05-27 2022-05-03 Silanna UV Technologies Pte Ltd Optoelectronic device
JP6636459B2 (ja) 2014-05-27 2020-01-29 シランナ・ユー・ブイ・テクノロジーズ・プライベート・リミテッドSilanna Uv Technologies Pte Ltd 半導体構造と超格子とを用いた高度電子デバイス
WO2015181656A1 (en) 2014-05-27 2015-12-03 The Silanna Group Pty Limited Electronic devices comprising n-type and p-type superlattices
CN104103720A (zh) * 2014-07-24 2014-10-15 安徽三安光电有限公司 一种氮化物半导体的制备方法
US10263139B2 (en) 2014-07-24 2019-04-16 Xiamen Sanan Optoelectronics Technology Co., Ltd. Fabrication method of nitride light emitting diodes
US9876143B2 (en) * 2014-10-01 2018-01-23 Rayvio Corporation Ultraviolet light emitting device doped with boron
KR102369933B1 (ko) * 2015-08-03 2022-03-04 삼성전자주식회사 반도체 발광소자 및 그 제조 방법
CN106711020B (zh) * 2015-11-18 2021-09-17 北京北方华创微电子装备有限公司 衬底的氮化方法及氮化镓缓冲层的制备方法
CN105590839B (zh) * 2016-03-22 2018-09-14 安徽三安光电有限公司 氮化物底层、发光二极管及底层制备方法
JP2019524982A (ja) * 2016-05-26 2019-09-05 ジョルゲンソン,ロビー Iiia族窒化物成長システムおよび方法
CN107492478B (zh) * 2016-06-12 2019-07-19 北京北方华创微电子装备有限公司 半导体设备的成膜方法以及半导体设备的氮化铝成膜方法
US10643843B2 (en) 2016-06-12 2020-05-05 Beijing Naura Microelectronics Equipment Co., Ltd. Film forming method and aluminum nitride film forming method for semiconductor apparatus
TWI589023B (zh) * 2016-06-27 2017-06-21 國立暨南國際大學 半導體裝置用基材及使用其之半導體裝置
CN106992231B (zh) * 2017-04-06 2019-05-21 厦门三安光电有限公司 氮化物半导体元件及其制作方法
KR101996424B1 (ko) * 2017-04-24 2019-07-04 아주대학교산학협력단 레이저 다이오드 및 그 제조 방법
CN107119323B (zh) * 2017-04-27 2019-08-06 云南北方驰宏光电有限公司 一种CVDZnS晶体材料的掺杂改性方法
JP6660603B2 (ja) * 2017-12-05 2020-03-11 パナソニックIpマネジメント株式会社 スパッタリング方法
US11021788B2 (en) * 2017-12-05 2021-06-01 Panasonic Intellectual Property Management Co., Ltd. Sputtering method
CN109326696B (zh) * 2018-09-19 2021-04-27 华灿光电(苏州)有限公司 一种发光二极管的外延片的制备方法
US11355620B2 (en) * 2018-10-31 2022-06-07 Taiwan Semiconductor Manufacturing Company, Ltd. FinFET device and method of forming same
CN109768125A (zh) * 2018-12-29 2019-05-17 晶能光电(江西)有限公司 硅基外延片生长方法
CN109888063B (zh) * 2019-01-23 2020-07-07 华灿光电(浙江)有限公司 AlN模板及氮化镓基发光二极管外延片的制备方法
CN109962129B (zh) * 2019-01-28 2020-12-08 华灿光电(浙江)有限公司 AlN模板及氮化镓基发光二极管外延片的制备方法
TWI698546B (zh) * 2019-06-20 2020-07-11 環球晶圓股份有限公司 具有氮化鋁成核層的基板及其製造方法
CN111740004B (zh) * 2020-08-10 2020-11-27 上海陛通半导体能源科技股份有限公司 氮化铝基薄膜结构、半导体器件及其制备方法
CN111739790B (zh) * 2020-08-25 2020-12-18 中电化合物半导体有限公司 一种氮化镓薄膜的外延结构及制备方法
US20220307129A1 (en) * 2021-03-23 2022-09-29 Applied Materials, Inc. Cleaning assemblies for substrate processing chambers

Family Cites Families (52)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0576566B1 (en) 1991-03-18 1999-05-26 Trustees Of Boston University A method for the preparation and doping of highly insulating monocrystalline gallium nitride thin films
JP2906971B2 (ja) 1993-12-30 1999-06-21 日本電気株式会社 半導体記憶装置の製造方法
US5652176A (en) 1995-02-24 1997-07-29 Motorola, Inc. Method for providing trench isolation and borderless contact
US6657300B2 (en) * 1998-06-05 2003-12-02 Lumileds Lighting U.S., Llc Formation of ohmic contacts in III-nitride light emitting devices
US6358810B1 (en) * 1998-07-28 2002-03-19 Applied Materials, Inc. Method for superior step coverage and interface control for high K dielectric capacitors and related electrodes
JP3702721B2 (ja) * 1999-03-09 2005-10-05 豊田合成株式会社 Iii族窒化物系化合物半導体素子
KR100540246B1 (ko) * 1999-12-22 2006-01-12 주식회사 하이닉스반도체 반도체 소자의 제조 방법
JP3836697B2 (ja) * 2000-12-07 2006-10-25 日本碍子株式会社 半導体素子
US7501023B2 (en) * 2001-07-06 2009-03-10 Technologies And Devices, International, Inc. Method and apparatus for fabricating crack-free Group III nitride semiconductor materials
JP3768943B2 (ja) * 2001-09-28 2006-04-19 日本碍子株式会社 Iii族窒化物エピタキシャル基板、iii族窒化物素子用エピタキシャル基板及びiii族窒化物素子
JP2003171200A (ja) * 2001-12-03 2003-06-17 Canon Inc 化合物半導体の結晶成長法、及び化合物半導体装置
JP2004006461A (ja) * 2002-05-31 2004-01-08 Nec Corp 半導体装置
JP3867161B2 (ja) * 2002-09-20 2007-01-10 独立行政法人物質・材料研究機構 薄膜素子
WO2005015642A1 (ja) * 2003-08-08 2005-02-17 Sanken Electric Co., Ltd. 半導体装置及びその製造方法
US7012016B2 (en) * 2003-11-18 2006-03-14 Shangjr Gwo Method for growing group-III nitride semiconductor heterostructure on silicon substrate
KR100576857B1 (ko) * 2003-12-24 2006-05-10 삼성전기주식회사 GaN 반도체 발광소자 및 그 제조방법
JP4833616B2 (ja) * 2004-09-13 2011-12-07 昭和電工株式会社 Iii族窒化物半導体の製造方法
SG124417A1 (en) * 2005-02-02 2006-08-30 Agency Science Tech & Res Method and structure for fabricating III-V nitridelayers on silicon substrates
JP4441415B2 (ja) * 2005-02-07 2010-03-31 国立大学法人東京工業大学 窒化アルミニウム単結晶積層基板
US7776636B2 (en) * 2005-04-25 2010-08-17 Cao Group, Inc. Method for significant reduction of dislocations for a very high A1 composition A1GaN layer
JP4722579B2 (ja) * 2005-06-22 2011-07-13 パナソニック株式会社 共振器およびこれを用いたフィルタ回路の製造方法
US7795050B2 (en) * 2005-08-12 2010-09-14 Samsung Electronics Co., Ltd. Single-crystal nitride-based semiconductor substrate and method of manufacturing high-quality nitride-based light emitting device by using the same
KR100753152B1 (ko) * 2005-08-12 2007-08-30 삼성전자주식회사 질화물계 발광소자 및 그 제조방법
US20110008205A1 (en) * 2006-01-14 2011-01-13 Mangiardi John R Multifunctional floor pads
KR101281684B1 (ko) * 2008-01-25 2013-07-05 성균관대학교산학협력단 질화물 반도체 기판의 제조방법
US20110147786A1 (en) * 2008-04-08 2011-06-23 Song June O Light-emitting device and manufacturing method thereof
WO2009129353A1 (en) * 2008-04-15 2009-10-22 Purdue Research Foundation Metallized silicon substrate for indium gallium nitride light-emitting diode
US7875534B2 (en) * 2008-07-21 2011-01-25 Taiwan Semiconductor Manufacturing Company, Ltd. Realizing N-face III-nitride semiconductors by nitridation treatment
CN101335200B (zh) * 2008-08-01 2011-08-17 武汉大学 一种AlN薄膜的制备方法
US8803189B2 (en) * 2008-08-11 2014-08-12 Taiwan Semiconductor Manufacturing Company, Ltd. III-V compound semiconductor epitaxy using lateral overgrowth
JP2010073760A (ja) * 2008-09-16 2010-04-02 Showa Denko Kk Iii族窒化物半導体積層構造体およびその製造方法
JP2011057474A (ja) * 2009-09-07 2011-03-24 Univ Of Tokyo 半導体基板、半導体基板の製造方法、半導体成長用基板、半導体成長用基板の製造方法、半導体素子、発光素子、表示パネル、電子素子、太陽電池素子及び電子機器
US8642368B2 (en) 2010-03-12 2014-02-04 Applied Materials, Inc. Enhancement of LED light extraction with in-situ surface roughening
KR20110103607A (ko) 2010-03-15 2011-09-21 엘지이노텍 주식회사 반도체 발광소자 및 그 제조방법
US20110244663A1 (en) * 2010-04-01 2011-10-06 Applied Materials, Inc. Forming a compound-nitride structure that includes a nucleation layer
CN103003961B (zh) * 2010-04-30 2015-11-25 波士顿大学理事会 具有能带结构电位波动的高效紫外发光二极管
CN102345091A (zh) * 2010-07-29 2012-02-08 鸿富锦精密工业(深圳)有限公司 涂层、具有该涂层的被覆件及该被覆件的制备方法
CN102345092A (zh) * 2010-07-29 2012-02-08 鸿富锦精密工业(深圳)有限公司 涂层、具有该涂层的被覆件及该被覆件的制备方法
CN102383093A (zh) * 2010-08-31 2012-03-21 鸿富锦精密工业(深圳)有限公司 涂层、具有该涂层的被覆件及该被覆件的制备方法
CN102477531B (zh) * 2010-11-26 2015-03-25 鸿富锦精密工业(深圳)有限公司 被覆件及其制造方法
CN102548308A (zh) * 2010-12-13 2012-07-04 鸿富锦精密工业(深圳)有限公司 壳体及其制造方法
US8409895B2 (en) * 2010-12-16 2013-04-02 Applied Materials, Inc. Gallium nitride-based LED fabrication with PVD-formed aluminum nitride buffer layer
US20120158819A1 (en) 2010-12-21 2012-06-21 Microsoft Corporation Policy-based application delivery
CN102560347A (zh) * 2010-12-27 2012-07-11 鸿富锦精密工业(深圳)有限公司 具有硬质涂层的被覆件及其制备方法
CN102534489A (zh) * 2010-12-30 2012-07-04 鸿富锦精密工业(深圳)有限公司 镀膜件及其制造方法
KR101042562B1 (ko) * 2011-02-28 2011-06-20 박건 Wurtzite 파우더를 이용한 질화물계 발광소자 및 그 제조 방법
US8778783B2 (en) * 2011-05-20 2014-07-15 Applied Materials, Inc. Methods for improved growth of group III nitride buffer layers
US8980002B2 (en) * 2011-05-20 2015-03-17 Applied Materials, Inc. Methods for improved growth of group III nitride semiconductor compounds
US20130005118A1 (en) * 2011-07-01 2013-01-03 Sung Won Jun Formation of iii-v materials using mocvd with chlorine cleans operations
US8865565B2 (en) * 2011-08-02 2014-10-21 Kabushiki Kaisha Toshiba LED having a low defect N-type layer that has grown on a silicon substrate
US20130082274A1 (en) * 2011-09-29 2013-04-04 Bridgelux, Inc. Light emitting devices having dislocation density maintaining buffer layers
US9396933B2 (en) * 2012-04-26 2016-07-19 Applied Materials, Inc. PVD buffer layers for LED fabrication

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