JP6177986B2 - 埋め込まれた磁気トンネル接合を含む論理チップ - Google Patents
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Claims (20)
- 第1の磁気トンネル接合(MTJ)であって、第1の上側MTJ層と、第1の下側MTJ層と、前記第1の上側MTJ層の第1の下側表面および前記第1の下側MTJ層の第1の上側表面に直接接触する第1のトンネル障壁と、を含む第1のMTJを備え、
前記第1の上側MTJ層は、第1の上側MTJ層側壁を含み、前記第1の下側MTJ層は、第1の水平オフセット距離を画定する第1の水平オフセットスペースによって前記第1の上側MTJ層側壁から水平方向にオフセットされている第1の下側MTJ側壁を含む装置であって、
前記装置はさらに、
モノリシック基板と、
前記第1のMTJを含むメモリ領域と、
ロジック領域と、
前記第1の上側MTJ層の前記第1の下側表面と平行な第1の水平平面と、を含み、
前記ロジック領域および前記メモリは両方とも前記モノリシック基板上に配置され、
前記第1の水平平面は、前記第1のMTJ、前記第1のMTJに隣接する第1の層間絶縁(ILD)材料、および前記ロジック領域に含まれる第2のILD材料、と交わり、前記第1のILD材料と前記第2のILD材料とは互いに等しくない
装置。 - 第1の磁気トンネル接合(MTJ)であって、第1の上側MTJ層と、第1の下側MTJ層と、前記第1の上側MTJ層の第1の下側表面および前記第1の下側MTJ層の第1の上側表面に直接接触する第1のトンネル障壁と、を含む第1のMTJを備え、
前記第1の上側MTJ層は、第1の上側MTJ層側壁を含み、前記第1の下側MTJ層は、第1の水平オフセット距離を画定する第1の水平オフセットスペースによって前記第1の上側MTJ層側壁から水平方向にオフセットされている第1の下側MTJ側壁を含む装置であって、
前記装置はさらに、
モノリシック基板、
前記第1のMTJを含むメモリ領域、
ロジック領域、および
前記第1の上側MTJ層の前記第1の下側表面と平行な第1の水平平面を備え、
前記第1の水平オフセット距離と等しい幅を有する第1のスペーサは、前記第1の上側MTJ層および前記第1のトンネル障壁に直接接触し、
前記ロジック領域および前記メモリは両方とも前記モノリシック基板上に配置され、
前記第1の水平平面は、前記第1のMTJ、前記第1のMTJに隣接する第1のILD材料、および前記ロジック領域に含まれる第2のILD材料と交わり、前記第1のILD材料と前記第2のILD材料とは互いに等しくない
装置。 - 第1の磁気トンネル接合(MTJ)であって、第1の上側MTJ層と、第1の下側MTJ層と、前記第1の上側MTJ層の第1の下側表面および前記第1の下側MTJ層の第1の上側表面に直接接触する第1のトンネル障壁と、を含む第1のMTJを備え、
前記第1の上側MTJ層は、第1の上側MTJ層側壁を含み、前記第1の下側MTJ層は、第1の水平オフセット距離を画定する第1の水平オフセットスペースによって前記第1の上側MTJ層側壁から水平方向にオフセットされている第1の下側MTJ側壁を含む装置であって、
前記装置はさらに、
第2の上側MTJ層と、第2の下側MTJ層と、前記第2の上側MTJ層の第2の下側表面および前記第2の下側MTJ層の第2の上側表面に直接接触する第2のトンネル障壁と、を含む第2のMTJと、
前記第1の下側MTJ層および前記第1のトンネル障壁のうちの少なくとも1つに接触する第1の垂直研磨停止側壁と、前記第2の下側MTJ層および前記第2のトンネル障壁のうちの少なくとも1つに接触する第2の垂直研磨停止側壁と、を備え、
前記第2の上側MTJ層は第2の上側MTJ層側壁を含み、前記第2の下側MTJ層は、第2の水平オフセット距離を画定する第2の水平オフセットスペースによって前記第2の上側MTJ層側壁から水平方向にオフセットされている第2の下側MTJ側壁を含み、
前記第1の垂直研磨停止側壁および前記第2の垂直研磨停止側壁は、前記第1のMTJと前記第2のMTJとの間に配置され、前記第1の上側MTJ層の前記第1の下側表面と平行な第1の水平平面は、前記第1のMTJ、前記第2のMTJ、前記第1の垂直研磨停止側壁、および前記第2の垂直研磨停止側壁と交わる
装置。 - 前記第1の水平オフセット距離と等しい第1の幅を有する第1のスペーサは、前記第1の上側MTJ層および前記第1のトンネル障壁に直接接触する
請求項1から3の何れか一項に記載の装置。 - 前記第1の上側MTJ層の第1の上側表面および前記第1のスペーサに直接接触する第1のハードマスクをさらに備える
請求項4に記載の装置。 - 第1のスペーサは前記第1の水平オフセットスペース内に含まれる
請求項1から5の何れか一項に記載の装置。 - 前記ロジック領域はプロセッサに含まれ、前記メモリは、スピン注入磁気抵抗ランダムアクセスメモリ(STT−MRAM)である
請求項1または2に記載の装置。 - 前記第1のILD材料は、酸化シリコン、酸窒化シリコン、多孔質酸化シリコン、フッ素化酸化シリコン、炭素ドープ酸化物、多孔質炭素ドープ酸化物、ポリイミド、ポリノルボルネン、ベンゾシクロブテン、流動性酸化物、およびポリテトラフルオロエチレンのうちの少なくとも1つを含み、前記第2のILD材料は、酸化シリコン、酸窒化シリコン、多孔質酸化シリコン、フッ素化酸化シリコン、炭素ドープ酸化物、多孔質炭素ドープ酸化物、ポリイミド、ポリノルボルネン、ベンゾシクロブテン、流動性酸化物、およびポリテトラフルオロエチレンのうちから追加の少なくとも1つを含み、
前記第1の下側MTJ層は、タンタル、白金マンガン、コバルト鉄、ルテニウム(Ru)、およびコバルト鉄ボロンのうちの少なくとも1つを含む複数の副層を含む
請求項1または7に記載の装置。 - 前記第1の水平平面は、前記第1のMTJと前記第1のILD材料との間に含まれる第1の研磨停止材料と交わる
請求項1、7および8の何れか一項に記載の装置。 - 前記第1の研磨停止材料は、前記第1のトンネル障壁および前記第1の下側MTJ層のうちの少なくとも1つと直接接触する
請求項9に記載の装置。 - 垂直MTJ層部分、追加の垂直MTJ層部分、および前記垂直MTJ層部分と前記追加の垂直MTJ層部分とに直接接触する垂直トンネル障壁部分を備え、
前記垂直MTJ層部分、前記追加の垂直MTJ層部分、および前記垂直トンネル障壁部分は全て前記ロジック領域と前記メモリ領域との間に存在し、全て前記第1の水平平面によって交わられる
請求項1または2に記載の装置。 - 前記第1の上側MTJ層、前記第1の下側MTJ層、および前記第1のトンネル障壁のうちの少なくとも1つは複数の副層を含む
請求項1から11の何れか一項に記載の装置。 - 前記第1の水平オフセット距離と等しい第1の幅を有する第1のスペーサは、前記第1の上側MTJ層および前記第1のトンネル障壁のうちの少なくとも1つに直接接触する
請求項1から3の何れか一項に記載の装置。 - モノリシック基板と、
前記基板上に配置され、磁気トンネル接合(MTJ)を備えるメモリ領域と、
前記基板上に配置されるロジック領域と、を備え、
前記MTJは、下側MTJ層および上側MTJ層に直接接触するトンネル障壁を含み、
前記トンネル障壁と平行な水平平面は、前記MTJ、前記MTJに隣接する第1の層間絶縁(ILD)材料、および前記ロジック領域に含まれる第2のILD材料と交わり、前記第1のILD材料と前記第2のILD材料とは互いに等しくない装置であって、
前記上側MTJ層は上側MTJ層側壁を含み、前記下側MTJ層は、水平オフセット距離を画定する水平オフセットスペースによって前記上側MTJ層側壁から水平方向にオフセットされている下側MTJ側壁を含み、
前記装置はさらに、前記水平オフセット距離と等しい幅を有する、前記上側MTJ層および前記トンネル障壁に直接接触するスペーサを備える
装置。 - 前記上側MTJ層の上側表面および前記スペーサに直接接触するハードマスクをさらに備える
請求項14に記載の装置。 - 前記水平平面は、前記MTJと前記第1のILD材料との間に含まれる研磨停止材料と交わる
請求項14または15に記載の装置。 - 前記研磨停止材料は、前記トンネル障壁および前記下側MTJ層のうちの少なくとも1つに直接接触する
請求項16に記載の装置。 - 磁気トンネル接合(MTJ)を備えるメモリ領域をモノリシック基板上に形成する段階と、
前記基板上に配置されるロジック領域を形成する段階と、を備え、
前記MTJは、下側MTJ層および上側MTJ層に直接接触するトンネル障壁を含み、
前記トンネル障壁と平行な水平平面は、前記MTJ、前記MTJに隣接する第1の層間絶縁(ILD)材料、および前記ロジック領域に含まれる第2のILD材料と交わり、前記第1のILD材料と前記第2のILD材料とは互いに等しくない方法であって、
前記方法はさらに、
前記下側MTJ層の側壁から水平オフセット距離だけ水平方向にオフセットされている前記上側MTJ層の側壁を形成する段階と、
前記上側MTJ層の上側表面に直接接触するハードマスクを形成する段階と、
前記水平オフセット距離と等しい幅を有する、前記上側MTJ層および前記トンネル障壁と直接接触するスペーサを形成する段階と、を備え、
前記ハードマスクおよび前記スペーサを形成する段階は、前記ハードマスクの形成および前記スペーサの形成の間で一回の真空を中断することなく、前記一回の真空の下で前記ハードマスクおよび前記スペーサを形成する段階を含む
方法。 - 磁気トンネル接合(MTJ)を備えるメモリ領域をモノリシック基板上に形成する段階と、
前記基板上に配置されるロジック領域を形成する段階と、を備え、
前記MTJは、下側MTJ層および上側MTJ層に直接接触するトンネル障壁を含み、
前記トンネル障壁と平行な水平平面は、前記MTJ、前記MTJに隣接する第1の層間絶縁(ILD)材料、および前記ロジック領域に含まれる第2のILD材料と交わり、前記第1のILD材料と前記第2のILD材料とは互いに等しくない方法であって、
前記方法はさらに、
前記下側MTJ層の側壁から水平オフセット距離だけ水平方向にオフセットされている前記上側MTJ層の側壁を形成する段階を備え、
一回の真空状態を中断することなく、(a)前記上側MTJ層に直接接触するハードマスクを形成する段階、(b)前記水平オフセット距離と等しい幅を有する、前記上側MTJ層および前記トンネル障壁と直接接触するスペーサを形成する段階、(c)前記MTJを形成すべく、前記上側MTJ層、前記トンネル障壁、および前記下側MTJ層をエッチングする段階、および(d)前記MTJ上にエッチング停止膜を形成する段階、の全てを備える
方法。 - 磁気トンネル接合(MTJ)を備えるメモリ領域をモノリシック基板上に形成する段階と、
前記基板上に配置されるロジック領域を形成する段階と、を備え、
前記MTJは、下側MTJ層および上側MTJ層に直接接触するトンネル障壁を含み、
前記トンネル障壁と平行な水平平面は、前記MTJ、前記MTJに隣接する第1の層間絶縁(ILD)材料、および前記ロジック領域に含まれる第2のILD材料と交わり、前記第1のILD材料と前記第2のILD材料とは互いに等しくない方法であって、
前記方法はさらに、
前記上側MTJ層の垂直部分の間に犠牲光吸収材料(SLAM)を形成する段階、および
前記SLAMを研磨する段階、を備える
方法。
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